JP4555103B2 - ランプ信号発生回路 - Google Patents
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Description
また、本発明に係るランプ信号発生回路は、高スルーレートが必要な場合にのみスイッチング回路を介してバッファの出力端に電流を供給するため、ランプ信号発生回路で消費される電力を減少させることができるという利点がある。
以下、添付図面を参照して本発明の好ましい実施例を説明することで、本発明を詳細に説明する。各図面に付された同一参照符号は同一部材を示す。
APSアレイ110は複数のアクティブピクセルを備え、比較器アレイ120はAPSアレイ110のカラム数だけの比較器120―1ないし120―n(ここでnは自然数)を備える。ランプ信号発生回路130は、ランプ信号を発生させて比較器アレイ120を構成する複数の比較器120―1ないし120―nに印加する。
また、CMOSイメージセンサの一部100は、デジタル信号を保存するためのバッファを更に備え得る。
周知のように、APS単位ピクセル210は、フォトダイオードPD、複数のトランジスタTx、Rx、Dx、Sx及び電流源INを備える。フォトダイオードPDは外部の光によって電圧を発生させ、伝達トランジスタTxは、フォトダイオードPDによって発生した電圧をソースフォロアトランジスタDxのゲートに伝達し、リセットトランジスタRxは、ソースフォロアトランジスタDxのゲートにリセット電圧を印加し、選択トランジスタSxは、ソースフォロアトランジスタDxによって発生した電圧をノード213に印加し、電流源INはノード213と接地電圧(または接地電源)VSSとの間に接続される。
ここで、バッファ増幅器132の出力ノード133と接続される比較器の数は、VGA解像度の場合は約640個であり、SXGA解像度の場合は約1280個である。したがって、バッファ増幅器132がランプ信号発生器131の出力信号(電圧)を駆動する能力は非常に大きくなければならない。
したがって、バッファ増幅器132は、ランプ電圧の駆動能力を増加させるために他のバッファ増幅器と直列に接続される場合がある。それを2段構造のバッファ増幅器という。その場合、バッファ増幅器の利得は1であることが好ましい。
ここで、TRSはリセットサンプリング区間を示し、TSSは信号サンプリング区間を示す。
したがって、バッファ増幅器132の出力ノード133の電圧Vbが本来の電圧に戻るには長時間TSを要する。時間TSは定着時間を意味する。
したがって、本発明は、1つのバッファ増幅器を用いつつも定着時間の遅延問題を解決すると共に、ランプ信号発生器で消費される電力を減少させ得る新たな構造を有するランプ信号発生回路を提供する。
ランプ信号発生器131はランプ信号を発生させる。バッファ132は、第1入力端(+)と第2入力端(−)と出力端とを備える。バッファ132の第1入力端(+)はランプ信号発生器131の出力端403と接続し、バッファ132の第2入力端(−)はバッファ132の出力端133と接続する。
ここで、TRSはリセットサンプリング区間を示し、TSSは信号サンプリング区間を示す。
スイッチング回路502は、NMOSトランジスタで実現でき、NMOSトランジスタは、ゲートに入力される制御電圧Vgに応答してバッファ132の出力端133を接地電源VSSと接続させる。
ランプ信号発生回路は、ランプ信号発生器131、バッファ132、第1比較器401、第2比較器501、第1スイッチング回路402及び第2スイッチング回路502を備える。
第2スイッチング回路502はNMOSトランジスタで実現でき、NMOSトランジスタは、ゲートに入力される制御電圧Vgに応答してバッファ132の出力端133を接地電源VSSと接続させる。
132 バッファ
133 出力端
400 ランプ信号発生回路
401 比較器
402 スイッチング回路
Claims (11)
- ランプ信号を発生させるランプ信号発生器と、
前記ランプ信号発生器の出力信号を受信してバッファリングするバッファと、
前記ランプ信号発生器の出力信号と前記バッファの出力信号とを受信し、受信された信号の電圧を比較してその比較結果を出力する第1比較器と、
前記第1比較器の出力信号に応答して、第1電源と前記バッファの出力端との間をスイッチングする第1スイッチング回路と、を備えることを特徴とするランプ信号発生回路。 - 前記バッファは、第1入力端と第2入力端と出力端とを備え、
前記第1比較器は、第1入力端と第2入力端と出力端とを備え、
前記バッファの第1入力端は前記ランプ信号発生器の出力端と接続し、前記バッファの第2入力端は前記バッファの出力端と接続し、
前記第1比較器の第1入力端は前記バッファの出力端と接続し、前記第1比較器の第2入力端は前記ランプ信号発生器の出力端と接続し、前記第1比較器の出力端は前記第1スイッチング回路の制御端と接続することを特徴とする請求項1に記載のランプ信号発生回路。 - 前記第1電源は、供給電源または接地電源であることを特徴とする請求項1に記載のランプ信号発生回路。
- 前記第1スイッチング回路は、PMOSトランジスタまたはNMOSトランジスタであることを特徴とする請求項1に記載のランプ信号発生回路。
- 前記第1比較器は、所定の入力オフセット電圧を有することを特徴とする請求項1に記載のランプ信号発生回路。
- 前記ランプ信号発生器の出力信号と前記バッファの出力信号とを受信し、受信された信号の電圧を比較してその比較結果を出力する第2比較器と、
前記第2比較器の出力信号に応答して、第2電源と前記バッファの出力端との間をスイッチングする第2スイッチング回路と、を更に備えることを特徴とする請求項1に記載のランプ信号発生回路。 - 前記第2比較器は、所定の入力オフセット電圧を有することを特徴とする請求項6に記載のランプ信号発生回路。
- 前記ランプ信号発生器の出力信号と前記バッファの出力信号とを受信し、受信された信号の電圧を比較して、その比較結果を出力する第2比較器と、
前記第2比較器の出力信号に応答して、第2電源と前記バッファの出力端との間をスイッチングする第2スイッチング回路と、を更に備えることを特徴とする請求項2に記載のランプ信号発生回路。 - 前記第2比較器は、第1入力端と第2入力端と出力端とを備え、
前記第2比較器の第1入力端は前記バッファの出力端と接続し、前記第2比較器の第2入力端は前記ランプ信号発生器の出力端と接続し、前記第2比較器の出力端は前記第2スイッチング回路の制御端と接続することを特徴とする請求項8に記載のランプ信号発生回路。 - 前記第1電源は供給電源であり、前記第2電源は接地電源であることを特徴とする請求項6に記載のランプ信号発生回路。
- 前記第1スイッチング回路はPMOSトランジスタであり、前記第2スイッチング回路はNMOSトランジスタであることを特徴とする請求項6に記載のランプ信号発生回路。
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