JP4373595B2 - コンピュータシステム - Google Patents
コンピュータシステム Download PDFInfo
- Publication number
- JP4373595B2 JP4373595B2 JP2000291300A JP2000291300A JP4373595B2 JP 4373595 B2 JP4373595 B2 JP 4373595B2 JP 2000291300 A JP2000291300 A JP 2000291300A JP 2000291300 A JP2000291300 A JP 2000291300A JP 4373595 B2 JP4373595 B2 JP 4373595B2
- Authority
- JP
- Japan
- Prior art keywords
- memory
- operating frequency
- frequency
- determined
- operable
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/24—Resetting means
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/04—Generating or distributing clock signals or signals derived directly therefrom
- G06F1/08—Clock generators with changeable or programmable clock frequency
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Memory System (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
- Debugging And Monitoring (AREA)
- Multi Processors (AREA)
Description
【発明の属する技術分野】
本発明は、種類の違うメモリやCPUを使用するコンピュータシステムに関し、特に、種類の違うメモリやCPUを使用するノート型パーソナルコンピュータに関する。
【0002】
【従来の技術】
ノート型パーソナルコンピュータ(以下、「ノートPC」という。)には、現在、業界標準のメモリモジュールとしてE2PROMが搭載されている。そして、このメモリモジュールの容量、動作周波数、タイミング等を表わすデータはSPDと呼ばれている。
【0003】
インテル社製のチップセットは、430TXの世代からメモリに関するバッファ能力やタイミングを調整するレジスタを有している。従来のノートPCは、メモリモジュールのSPDの値に応じて、レジスタの設定値を調整し、これにより最適なバッファ能力とタイミングでメモリモジュールを使用している。
【0004】
一方、CPUに関しては、システム毎に固有の基本周波数で動作している。CPUの周波数の動的な切り替え技術として、インテル社のSpeedStepという技術があるが、これは、CPUの内部動作周波数を動的に変えるもので、システム毎に固有の基本周波数を変えるものではない。
【0005】
【発明が解決しようとする課題】
従来のノートPCでは、サポートしているメモリの動作周波数と、CPUの動作周波数とは一意で決まっており、サポートしていないメモリやCPUを使用した場合には、動作速度を落として動作させていたが、この場合にはシステムが不安定となりコンピュータシステムが動作しなくなるという問題があった。
【0006】
また、メモリとCPUの動作周波数は固定であるため、より高い周波数で動作するメモリなどに置き換えてもその性能を十分に発揮することができないという問題があった。
【0007】
本発明は、上記実情に鑑みてなされたものであり、メモリ及びCPUの現在の動作周波数の判別を行ない、その判別結果に基づいてメモリ及びCPUの動作周波数を切り替えることにより、コンピュータシステムを安定に動作させるとともに、メモリ及びCPUの性能を発揮することができるコンピュータシステムを提供することを目的とする。
【0008】
【課題を解決するための手段】
したがって、まず、上記目的を達成するために本発明の第1の発明によれば、予め定められたサポート動作周波数で動作する前提のコンピュータシステムにおいて、メモリの動作可能周波数を検出する第1の検出手段と、前記メモリの現在の動作周波数を検出する第2の検出手段と、前記第1の検出手段によって検出された前記メモリの動作可能周波数が、前記サポート動作周波数によってサポートされているか否かを判定するサポート動作周波数判定手段と、前記メモリの動作可能周波数が、前記サポート動作周波数によってサポートされていると判定された場合に、前記第2の検出手段によって検出された前記メモリの現在の動作周波数が前記第1の検出手段によって検出された前記メモリの動作可能周波数に合致しているか否かを判定する判定手段と、前記判定手段によって前記第2の検出手段によって検出された前記メモリの現在の動作周波数が前記第1の検出手段によって検出された前記メモリの動作可能周波数に合致していないと判定された場合に、合致していないと判定されたメモリの現在の動作周波数を、前記合致していないと判定されたメモリの動作可能周波数に対応する前記サポート動作周波数に設定する手段とを具備することを特徴とするコンピュータシステムである。
【0017】
【発明の実施の形態】
<第1の実施の形態>
図1は、本発明の第1の実施の形態に係るコンピュータシステムを示すブロック図である。なお、図1においては、本発明を説明するために必要な要素のみを示しており、ディスプレイ及び記憶装置などの要素はここでは省略している。
【0018】
本実施の形態においては、インテル社製の815Eチップセットを使用し、CPU及びメモリモジュールともに100MHzと133MHzとをサポートしている場合の制御方法を例にして説明する。
【0019】
同図に示すように、システム全体の制御を司るCPU1は、バスaを介してグラフィックメモリコントロールハブ2に接続されている。グラフィックメモリコントロールハブ2は、メモリバスcを介してメモリモジュール3に接続されている。
【0020】
このメモリモジュール3は、コンピュータシステムに設けられたスロットに対して着脱可能であり、メモリモジュールの容量、動作周波数、タイミング等を表わすデータであるSPDを格納している。
【0021】
グラフィックメモリコントロールハブ2は、バスbを介してI/Oコントロールハブ4に接続されている。このI/Oコントロールハブ4は、SMバスdを介してメモリモジュール3に接続されている。また、I/Oコントロールハブ4は、レジスタ4aを有している。
【0022】
レジスタ4aのGPIOxx1(general purpose I/O)は、現在のPSB(processor system bus)の動作周波数、すなわち、現在のCPUの動作周波数を示すものであり、”0”であれば現在のCPUの動作周波数が100MHzを意味し、”1”であれば現在のCPUの動作周波数が133MHzを意味する。また、GPIOxx2は、現在のメモリモジュール3の動作周波数を示すものであり、”0”であれば現在のメモリモジュール3の動作周波数が100MHzを意味し、”1”であれば現在のメモリモジュール3の動作周波数が133MHzを意味する。
【0023】
クロックジェネレータ5は、I/Oコントロールハブ4のレジスタ4aのGPIOxx1及びGPIOxx2の値に基づいて、CPU1及びメモリモジュール3の動作周波数のクロックを発振するものである。なお、GPIOxx1及びGPIOxx2の値は、システムを立ち上げた時に有効となる。
【0024】
また、I/Oコントロールハブ4にはバスeを介してEC/KBC(embedded controller / keyboard controller)6が接続されている。
【0025】
次に、本実施の形態に係るコンピュータシステムのCPU及びメモリモジュー.ルの動作周波数の切り替え動作について図10のフローチャートを参照して説明する。なお、動作周波数の切り替え動作は、BIOS(basic input output system)処理に基づいて行なわれるものとする。
【0026】
まず、最初に、ノートPCが起動されると、CPU1は、I/Oコントロールハブ4のGPIOxx1の設定を読み出し、現在のPSB(processor system bus)の動作周波数、すなわち現在のCPUの動作周波数を読み出す(S1)。図2は、S1の動作を視覚的に説明するための図である。
【0027】
ここで、GPIOxx1(general purpose I/O)の値が”0”であれば現在のCPUの動作周波数が100MHzを意味し、”1”であれば現在のCPUの動作周波数が133MHzを意味する。
【0028】
次に、CPU1のレジスタ、例えば、キャッシュメモリからCPUの動作可能周波数(個別動作可能周波数)を読み出す(S2)。ここでは、CPUの動作可能周波数として、100MHz或いは133MHzがCPU1のレジスタに格納されているものとする。図3は、S2の動作を視覚的に説明するための図である。
【0029】
次に、CPU1は、I/Oコントロールハブ4のGPIOxx2の設定を読み出し、現在のメモリモジュール3の動作周波数を読み出す(S3)。図4は、S3の動作を視覚的に説明するための図である。
【0030】
ここで、GPIOxx2の値が”0”であれば現在のメモリモジュール3の動作周波数が100MHzを意味し、”1”であれば現在のメモリモジュール3の動作周波数が133MHzを意味する。
【0031】
CPU1は、メモリモジュール3に格納されたSPD3aをSMバスdを介して読み出すことにより、メモリモジュール3の動作可能周波数(個別動作可能周波数)を読み出す(S4)。図5は、S4の動作を視覚的に説明するための図である。
【0032】
ここでは、例えば、メモリアドレス126の値によってメモリモジュール3の動作可能周波数が求められる。
【0033】
具体的には、メモリアドレス126の値が「63H」以下である場合には、メモリモジュール3の動作可能周波数は99MHz以下であり、「64H〜84H」である場合には、メモリモジュール3の動作可能周波数は100MHz〜132MHz及び「85H」以上である場合には、メモリモジュール3の動作可能周波数は133MHz以上である。
【0034】
次に、CPU1は、読み出された現在のCPU1の動作可能周波数及びメモリモジュール3の動作可能周波数がサポートしている動作周波数であるか否かを判定する(S5)。
【0035】
具体的には、本実施の形態においては、CPU1及びメモリモジュール3の動作周波数は、100MHz及び133MHzで動作していることを前提としているので、例えば、メモリモジュール3の現在の動作可能周波数が99MHz以下である場合には、サポートしている動作周波数ではないと判定される。
【0036】
S5において、サポートしている動作周波数ではないと判断された場合には、図示せぬディスプレイ上にメッセージを表示して動作周波数の切り替え処理を終了する(S6)。なお、メッセージについては、図7を参照。
【0037】
一方、S5において、サポートしている動作周波数であると判定された場合には、図7に示す設定処理を行なう(S7)。
【0038】
図7に示した例のうち、いくつかの例を説明する。
【0039】
1. CPUの個別動作可能周波数が100MHz、メモリモジュールの個別動作可能周波数がどのような周波数でもよい場合であって、現在のGPIOxx1の値が133MHz、GPIOxx2の値がどのような動作周波数であってもよい場合
→ GPIOxx1の値を100MHzに設定し、GPIOxx2の値は変更しない。
【0040】
2. CPUの個別動作可能周波数が100MHz、メモリモジュールの個別動作可能周波数が99MHz以下である場合であって、現在のGPIOxx1の値が100MHz、GPIOxx2の値がどのような動作周波数であってもよい場合
→ GPIOxx1及びGPIOxx2の値は変更しない。
【0041】
3. CPUの個別動作可能周波数が100MHz、メモリモジュールの個別動作可能周波数が100MHz〜132MHz、133MHz以上である場合であって、現在のGPIOxx1の値が100MHz、GPIOxx2の値が100MHzである場合
→ GPIOxx1及びGPIOxx2の値は変更しない。
【0042】
すなわち、S7の設定処理においては、CPU及びメモリモジュールの個別動作可能周波数が、GPIOxx1、GPIOxx2の値が示す現在の動作周波数と異なる場合には、GPIOxx1、GPIOxx2の値をCPU及びメモリモジュールの個別動作可能周波数にあわせる処理を行なう。
【0043】
図6は、CPU1がレジスタ4aの値を設定する動作を視覚的に説明するための図である。
【0044】
S7において、設定処理終了後、CPU1は再起動が必要か否かの判断を行なう(S8)。具体的には,S7における設定処理において、GPIOxx1及びGPIOxx2の値のうち少なくとも1つを変更した場合に、再起動が必要とされる。これは、GPIOxx1及びGPIOxx2の値は、再起動後に初めて有効となるからである。
【0045】
S8において、再起動が必要と判断された場合には、ノートPCの再起動処理が行なわれ(S10)、S1の処理に戻る。一方、S8において、再起動処理が不要と判断された場合には、後続する他の処理に進む(S9)。なお、図8は、再起動処理を視覚的に説明するための図である。
【0046】
図9は、本実施の形態に係るコンピュータシステムの回路図である。
【0047】
同図において、GPIOxx1の出力を”0”にすることでCPUのPSB(processor system bus)を100MHzに、”1”にすることで133MHzに変えることができる。GPIOxx1の出力は、I/Oコントロールハブ内のレジスタで設定する。
【0048】
また、GPIOxx2の出力を”0”にすることでメモリモジュールのクロックを100MHzに、”1”にすることで133MHzに変えることができる。GPIOxx2の出力は、I/Oコントロールハブ内のレジスタで設定する。
【0049】
すなわち、本実施の形態のコンピュータシステムにおいては、現在のCPUの動作可能周波数及び現在のメモリモジュールの動作可能周波数を検出するとともに、I/Oコントロールハブ4内のレジスタ4aに設定されたGPIOxx1及びGPIOxx2の値を読み出す。
【0050】
そして、まず、検出された現在のメモリモジュール及びCPUの動作可能周波数が、予め定められた動作周波数(本実施の形態においては、CPU及びメモリモジュールともに100MHz、133MHz)に合致しているかの判定が行なわれ、合致していない場合には、メモリモジュール及びCPUを取り替えなければならない旨のメッセージを表示し、動作周波数切り替え処理を終了する。
【0051】
一方、検出された現在のメモリモジュール及びCPUの動作可能周波数が、予め定められた動作周波数に合致している場合には、現在のCPU及びメモリモジュールの動作可能周波数が、現在のGPIOxx1、GPIOxx2の値が示す動作周波数と異なるか否かの判断を行ない、異なる場合には、GPIOxx1、GPIOxx2の値を現在のCPU及びメモリモジュールの動作可能周波数にあわせる。
【0052】
したがって、本実施の形態のコンピュータシステムによれば、メモリ及びCPUの現在の動作周波数の判別を行ない、その判別結果に基づいて、現在設定されている動作周波数を最適な値に変更するので、コンピュータシステムを安定に動作させるとともに、メモリ及びCPUの性能を発揮することができるコンピュータシステムを提供することができる。
【0053】
<第2の実施の形態>
次に、本発明の第2の実施の形態に係るコンピュータシステムについて説明する。上述の第1の実施の形態においては、メモリモジュールが1つの場合について説明したが、本実施の形態においては、メモリモジュールが複数の場合について説明する。
【0054】
なお、本実施の形態においては、第1の実施の形態と同様に、インテル社製の815Eチップセットを使用し、CPU及びメモリモジュールともに100MHzと133MHzとをサポートしている場合の制御方法を例にして説明する。
【0055】
図11は、本発明の第2の実施の形態に係るコンピュータシステムを示すブロック図である。なお、図1と同一の部分には同一の符号を付し、ここではその説明を省略する。
【0056】
同図に示すように、本実施の形態に係るコンピュータシステムと、図1に示したコンピュータシステムを示すブロック図と異なる点は、メモリモジュールが複数設けられている点にある。
【0057】
メモリモジュール31、32は、それぞれグラフィックメモリコントロールハブ2にメモリバスcを介してそれぞれ接続されるとともに、SMバスdを介してI/Oコントロールハブ4にそれぞれ接続されている。
【0058】
また、メモリモジュール31、32は、それぞれ対応するメモリモジュールの容量、動作周波数、タイミング等を表わすデータであるSPD31a、32aを有している。
【0059】
次に、本実施の形態に係るコンピュータシステムのCPU及び複数のメモリモジュー.ルの動作周波数の切り替え動作について図12のフローチャートを参照して説明する。なお、動作周波数の切り替え動作は、BIOS(basic input output system)処理に基づいて行なわれるものとする。
【0060】
まず、最初に、ノートPCが起動されると、CPU1は、I/Oコントロールハブ4のGPIOxx1の設定を読み出し、現在のPSB(processor system bus)の動作周波数、すなわち現在のCPUの動作周波数を読み出す(S21)。
【0061】
ここで、GPIOxx1(general purpose I/O)の値が”0”であれば現在のCPUの動作周波数が100MHzを意味し、”1”であれば現在のCPUの動作周波数が133MHzを意味する。
【0062】
次に、CPU1のレジスタ、例えば、キャッシュメモリからCPUの動作可能周波数を読み出す(S22)。ここでは、CPUの動作可能周波数として、100MHz或いは133MHzがCPU1のレジスタに格納されているものとする。
【0063】
次に、CPU1は、I/Oコントロールハブ4のGPIOxx2の設定を読み出し、現在のメモリモジュール31、32の動作周波数を読み出す(S23)。
【0064】
CPU1は、メモリモジュール31、32にそれぞれ格納されたSPD31a、32aをSMバスdを介して読み出すことにより、メモリモジュール31、32の動作可能周波数を読み出す(S24)。
【0065】
次に、CPU1は、現在のメモリモジュール31、32の動作可能周波数のうち、低いほうの現在の動作可能周波数を決定する(S25)。例えば、メモリモジュール31の現在の動作可能周波数が100MHz、メモリモジュール32の動作可能周波数が133MHzである場合には、100MHzがメモリモジュールの動作可能周波数として決定される。
【0066】
そして、CPU1は、読み出された現在のCPUの動作可能周波数、メモリモジュール31の現在の動作可能周波数及びメモリモジュール32の現在の動作可能周波数それぞれがサポートしている動作周波数であるか否かの判定をする(S26)。
【0067】
具体的には、本実施の形態においては、CPU1及びメモリモジュール31、32の動作周波数は、100MHz及び133MHzで動作していることを前提としているので、例えば、メモリモジュール31の現在の動作可能周波数が100MHzであってもメモリモジュール32の現在の動作可能周波数が99MHz以下である場合には、サポートしている動作周波数ではないと判定される。
【0068】
S26において、サポートしている動作周波数ではないと判断された場合には、図示せぬディスプレイ上にメッセージを表示して動作周波数の切り替え処理を終了する(S30)。
【0069】
一方、S26において、サポートしている動作周波数であると判定された場合には、図13に示す設定処理を行なう(S27)。
【0070】
以下、図13に示した例のうち、いくつかの例を説明する。
【0071】
1. CPUの個別動作可能周波数が100MHz、メモリモジュール31の個別動作可能周波数がどのような周波数でもよく、メモリモジュール32の個別動作可能周波数もどのような動作周波数でもよい場合であって、現在のGPIOxx1の値が133MHz、GPIOxx2の値がどのような動作周波数であってもよい場合
→ GPIOxx1の値を100MHzに設定し、GPIOxx2の値は変更しない。
【0072】
2. CPUの個別動作可能周波数が100MHz、メモリモジュール31の個別動作可能周波数が99MHz以下、メモリモジュール32の個別動作可能周波数が133MHz以上である場合であって、現在のGPIOxx1の値が100MHz、GPIOxx2の値がどのような動作周波数であってもよい場合
→ GPIOxx1及びGPIOxx2の値は変更しない。
【0073】
3. CPUの個別動作可能周波数が100MHz、メモリモジュール31の個別動作可能周波数が100MHz〜132MHz、133MHz以上、メモリモジュール32の個別動作可能周波数が133MHz以上である場合であって、現在のGPIOxx1の値が100MHz、GPIOxx2の値が100MHzである場合
→ GPIOxx1及びGPIOxx2の値は変更しない。
【0074】
すなわち、S27の設定処理においては、CPU及びS25において決定されたメモリモジュール31、32の動作可能周波数のうち周波数の低いほうの動作可能周波数が現在のGPIOxx1、GPIOxx2の値が示す動作周波数と異なる場合には、GPIOxx1、GPIOxx2の値をCPU及びメモリモジュールの動作可能周波数にあわせる処理を行なう。
【0075】
S27において、設定処理終了後、CPU1は再起動が必要か否かの判断を行なう(S28)。具体的には,S27における設定処理において、GPIOxx1及びGPIOxx2の値のうち少なくとも1つを変更した場合に、再起動が必要とされる。これは、GPIOxx1及びGPIOxx2の値は、再起動後に初めて有効となるからである。
【0076】
S28において、再起動が必要と判断された場合には、ノートPCの再起動処理が行なわれ(S31)、S21の処理に戻る。一方、S28において、再起動処理が不要と判断された場合には、後続する他の処理に進む(S29)。
【0077】
したがって、本実施の形態のコンピュータシステムによれば、複数のメモリモジュールが設けられている場合であっても、CPU及び複数のメモリモジュールの動作周波数を判別し、この判別結果に基づいて動作周波数を設定しなおすので、コンピュータシステムの性能を引き出すことができ、また、コンピュータシステムの動作を安定化させることができる。
【0078】
なお、本願発明は、上記各実施形態に限定されるものでなく、実施段階ではその要旨を逸脱しない範囲で種々に変形することが可能である。また、各実施形態は可能な限り適宜組み合わせて実施してもよく、その場合組み合わされた効果が得られる。さらに、上記各実施形態には種々の段階の発明が含まれており、開示される複数の構成要件における適宜な組み合わせにより種々の発明が抽出され得る。例えば実施形態に示される全構成要件から幾つかの構成要件が省略されることで発明が抽出された場合には、その抽出された発明を実施する場合には省略部分が周知慣用技術で適宜補われるものである。
【0079】
【発明の効果】
以上詳記したように、本発明によれば、メモリ及びCPUの現在の動作周波数の判別を行ない、その判別結果に基づいてメモリ及びCPUの動作周波数を切り替えることにより、コンピュータシステムを安定に動作させるとともに、メモリ及びCPUの性能を発揮することができるコンピュータシステムを提供することができる。
【図面の簡単な説明】
【図1】本発明の第1の実施の形態に係るコンピュータシステムを示すブロック図。
【図2】現在のCPUの動作周波数を読み出す場合の動作を視覚的に説明するための図。
【図3】CPUのレジスタからCPUの動作可能周波数を読み出す場合の動作を視覚的に説明するための図。
【図4】I/Oコントロールハブ4のGPIOxx2の設定を読み出す動作を視覚的に説明するための図。
【図5】SPD3aをSMバスdを介して読み出す動作を視覚的に説明するための図。
【図6】CPU1がレジスタ4aの値を設定する動作を視覚的に説明するための図。
【図7】CPU1のレジスタ4aへの値を設定及びその後の動作を説明するための図。
【図8】再起動処理を視覚的に説明するための図。
【図9】本実施の形態に係るコンピュータシステムの回路図。
【図10】本実施の形態に係るコンピュータシステムの動作を説明するためのフローチャート。
【図11】本発明の第2の実施の形態に係るコンピュータシステムを示すブロック図。
【図12】本実施の形態に係るコンピュータシステムの動作を説明するためのフローチャート。
【図13】同実施の形態に係るコンピュータシステムの設定処理を説明するための図。
【符号の説明】
1…CPU、
2…グラフィックメモリコントロールハブ、
3…メモリモジュール、
3a…SPD,
4…I/Oコントロールハブ、
4a…レジスタ、
5…クロックジェネレータ、
6…EC/KBC、
a〜e…ハブ。
Claims (12)
- 予め定められたサポート動作周波数で動作する前提のコンピュータシステムにおいて、
メモリの動作可能周波数を検出する第1の検出手段と、
前記メモリの現在の動作周波数を検出する第2の検出手段と、
前記第1の検出手段によって検出された前記メモリの動作可能周波数が、前記サポート動作周波数によってサポートされているか否かを判定するサポート動作周波数判定手段と、
前記メモリの動作可能周波数が、前記サポート動作周波数によってサポートされていると判定された場合に、前記第2の検出手段によって検出された前記メモリの現在の動作周波数が前記第1の検出手段によって検出された前記メモリの動作可能周波数に合致しているか否かを判定する判定手段と、
前記判定手段によって前記第2の検出手段によって検出された前記メモリの現在の動作周波数が前記第1の検出手段によって検出された前記メモリの動作可能周波数に合致していないと判定された場合に、合致していないと判定されたメモリの現在の動作周波数を、前記合致していないと判定されたメモリの動作可能周波数に対応する前記サポート動作周波数に設定する手段と
を具備することを特徴とするコンピュータシステム。 - 前記メモリの動作可能周波数は前記メモリに格納され、前記メモリの現在の動作周波数は前記コンピュータシステムのI/Oコントロールハブのレジスタに格納されていることを特徴とする請求項1記載のコンピュータシステム。
- 前記サポート動作周波数判定手段により前記第1の検出手段によって検出された前記メモリの動作可能周波数が、前記サポート動作周波数によってサポートされていないと判断された場合に、サポートされていないメモリを交換しなければならない旨のメッセージを表示する手段をさらに具備することを特徴とする請求項1記載のコンピュータシステム。
- 前記設定手段により、前記合致していないと判定されたメモリの現在の動作周波数が、前記合致していないと判定されたメモリの動作可能周波数に対応する前記サポート動作周波数に設定されたか否かを判定する設定状態判定手段と、
前記設定状態判定手段により設定されたと判定された場合に、コンピュータシステムを再起動する再起動手段をさらに具備することを特徴とする請求項1記載のコンピュータシステム。 - 予め定められたサポート動作周波数で動作する前提のコンピュータシステムにおいて、
第1のメモリ及び第2のメモリの動作可能周波数を検出する第1の検出手段と、
前記第1のメモリ及び前記第2のメモリに共通の現在の動作周波数を検出する第2の検出手段と、
前記第1の検出手段によって検出された前記第1のメモリ及び前記第2のメモリの動作可能周波数が前記サポート動作周波数によってサポートされているか否かを判定するサポート動作周波数判定手段と、
前記第1のメモリ及び第2のメモリの動作可能周波数が、前記サポート動作周波数によってサポートされていると判断された場合に、前記第2の検出手段によって検出された前記第1のメモリ及び前記第2のメモリに共通の現在の動作周波数が、前記第1の検出手段によって検出された前記第1のメモリ及び前記第2のメモリの動作可能周波数のうち低い方の動作可能周波数に合致しているか否かを判定する判定手段と、
前記判定手段によって合致していないと判定された場合に、合致していないと判定された第1のメモリ及び第2のメモリに共通の現在の動作周波数を、前記合致していないと判定された第1のメモリ及び第2のメモリの動作可能周波数のうち低い方の動作可能周波数に対応する前記サポート動作周波数に設定する手段と
を具備することを特徴とするコンピュータシステム。 - 前記第1のメモリ及び前記第2のメモリの動作可能周波数はそれぞれ前記第1のメモリ及び前記第2のメモリに格納され、前記第1のメモリ及び前記第2のメモリに共通の現在の動作周波数は前記コンピュータシステムのI/Oコントロールハブのレジスタに格納されていることを特徴とする請求項5記載のコンピュータシステム。
- 前記サポート動作周波数判定手段により、前記第1の検出手段によって検出された前記第1のメモリ及び第2のメモリの動作可能周波数が、前記サポート動作周波数によってサポートされていないと判断された場合に、サポートされていない第1のメモリ及び第2のメモリを交換しなければならない旨のメッセージを表示する手段をさらに具備することを特徴とする請求項5記載のコンピュータシステム。
- 前記設定手段により、前記合致していないと判定された第1のメモリ及び第2のメモリに共通の現在の動作周波数が、前記合致していないと判定された第1のメモリ及び第2のメモリの動作可能周波数のうち低い方の動作可能周波数に対応するサポート動作周波数に設定されたか否かを判定する設定状態判定手段と、
前記設定状態判定手段により設定されたと判定された場合に、コンピュータシステムを再起動する再起動手段をさらに具備することを特徴とする請求項5記載のコンピュータシステム。 - 予め定められたサポート動作周波数で動作するコンピュータシステムの動作周波数切り替え方法において、
メモリの動作可能周波数を検出し、
前記メモリの現在の動作周波数を検出し、
前記検出された前記メモリの動作可能周波数が、前記サポート動作周波数によってサポートされているか否かを判定し、
前記メモリの動作可能周波数が、前記サポート動作周波数によってサポートされていると判定された場合に、検出された前記メモリの現在の動作周波数が検出された前記メモリの動作可能周波数に合致しているか否かを判定し、
前記メモリの現在の動作周波数が前記メモリの動作可能周波数に合致していないと判定された場合に、合致していないと判定されたメモリの現在の動作周波数を、前記合致していないと判定されたメモリの動作可能周波数に対応する前記サポート動作周波数に設定するステップを具備することを特徴とするコンピュータシステムの動作周波数切り替え方法。 - 前記合致していないと判定されたメモリの現在の動作周波数が、前記合致していないと判定されたメモリの動作可能周波数に対応する前記サポート動作可能周波数に設定されたか否かを判定し、
設定されたと判定された場合に、コンピュータシステムを再起動するステップをさらに具備することを特徴とする請求項9記載のコンピュータシステムの動作周波数切り替え方法。 - 予め定められたサポート動作周波数で動作するコンピュータシステムの動作周波数の切り替え方法において、
第1のメモリ及び第2のメモリの動作可能周波数を検出し、
前記第1のメモリ及び前記第2のメモリに共通の現在の動作周波数を検出し、
前記検出された前記第1のメモリ及び前記第2のメモリの動作可能周波数が前記サポート動作周波数によってサポートされているか否かを判定し、
前記検出された前記第1のメモリ及び第2のメモリの動作可能周波数が、前記サポート動作周波数によってサポートされていると判断された場合に、前記検出された前記第1のメモリ及び前記第2のメモリに共通の現在の動作周波数が、前記検出された前記第1のメモリ及び前記第2のメモリの動作可能周波数のうち低い方の動作可能周波数に合致しているか否かを判定し、
合致していないと判定された場合に、合致していないと判定された第1のメモリ及び第2のメモリに共通の現在の動作周波数を、前記合致していないと判定された第1のメモリ及び第2のメモリの動作周波数のうち低い方の動作可能周波数に対応する前記サポート動作周波数に設定するステップを具備することを特徴とするコンピュータシステムの動作周波数の切り替え方法。 - 前記合致していないと判定された第1のメモリ及び第2のメモリに共通の現在の動作周波数が、前記合致していないと判定された第1のメモリ及び第2のメモリの動作可能周波数のうち低い方の動作可能周波数に対応するサポート動作周波数に設定されたか否かを判定し、
設定されたと判定された場合に、コンピュータシステムを再起動するステップをさらに具備することを特徴とする請求項11記載のコンピュータシステムの動作周波数の切り替え方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000291300A JP4373595B2 (ja) | 2000-09-25 | 2000-09-25 | コンピュータシステム |
US09/954,029 US6990572B2 (en) | 2000-09-25 | 2001-09-18 | Method for preventing a computer system from being started up in an unstable condition |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000291300A JP4373595B2 (ja) | 2000-09-25 | 2000-09-25 | コンピュータシステム |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2002099349A JP2002099349A (ja) | 2002-04-05 |
JP4373595B2 true JP4373595B2 (ja) | 2009-11-25 |
Family
ID=18774392
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000291300A Expired - Fee Related JP4373595B2 (ja) | 2000-09-25 | 2000-09-25 | コンピュータシステム |
Country Status (2)
Country | Link |
---|---|
US (1) | US6990572B2 (ja) |
JP (1) | JP4373595B2 (ja) |
Families Citing this family (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6721672B2 (en) | 2002-01-02 | 2004-04-13 | American Power Conversion | Method and apparatus for preventing overloads of power distribution networks |
US7307317B2 (en) * | 2003-04-04 | 2007-12-11 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device, CPU, image processing circuit and electronic device, and driving method of semiconductor device |
EP1709688A4 (en) | 2004-01-30 | 2014-12-31 | Semiconductor Energy Lab | SEMICONDUCTOR COMPONENT |
KR101187403B1 (ko) * | 2004-06-02 | 2012-10-02 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체장치 제조방법 |
JP4616586B2 (ja) * | 2004-06-30 | 2011-01-19 | 富士通株式会社 | メモリ初期化制御装置 |
US7591863B2 (en) * | 2004-07-16 | 2009-09-22 | Semiconductor Energy Laboratory Co., Ltd. | Laminating system, IC sheet, roll of IC sheet, and method for manufacturing IC chip |
TWI245287B (en) * | 2004-09-08 | 2005-12-11 | Via Tech Inc | Method for initialization drams |
JP4817760B2 (ja) * | 2005-08-26 | 2011-11-16 | キヤノン株式会社 | 情報処理装置及びそのシステムクロック周波数の設定方法 |
JP4747898B2 (ja) * | 2006-03-23 | 2011-08-17 | 日本電気株式会社 | 情報処理装置、プロセッサ動作クロック周波数の検証方法及びプロセッサ動作クロック周波数の検証プログラム |
JP5152466B2 (ja) * | 2007-02-13 | 2013-02-27 | 株式会社メガチップス | メモリコントローラ |
JP5119947B2 (ja) * | 2008-01-24 | 2013-01-16 | 富士通株式会社 | 情報処理装置 |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5420605A (en) * | 1993-02-26 | 1995-05-30 | Binar Graphics, Inc. | Method of resetting a computer video display mode |
JPH0756885A (ja) * | 1993-08-20 | 1995-03-03 | Mitsubishi Electric Corp | マイクロコンピュータ |
JP3467631B2 (ja) * | 1994-06-07 | 2003-11-17 | 株式会社ルネサステクノロジ | ロジックlsi |
US6311287B1 (en) | 1994-10-11 | 2001-10-30 | Compaq Computer Corporation | Variable frequency clock control for microprocessor-based computer systems |
JPH1185127A (ja) * | 1997-09-12 | 1999-03-30 | Totoku Electric Co Ltd | 水平同期設定回路および水平同期設定回路を内蔵したcrtディスプレイ装置 |
US6535986B1 (en) * | 2000-03-14 | 2003-03-18 | International Business Machines Corporation | Optimizing performance of a clocked system by adjusting clock control settings and clock frequency |
-
2000
- 2000-09-25 JP JP2000291300A patent/JP4373595B2/ja not_active Expired - Fee Related
-
2001
- 2001-09-18 US US09/954,029 patent/US6990572B2/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
US20020038434A1 (en) | 2002-03-28 |
US6990572B2 (en) | 2006-01-24 |
JP2002099349A (ja) | 2002-04-05 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US7627730B1 (en) | System and method for optimizing a memory controller | |
US8461895B2 (en) | Per die temperature programming for thermally efficient integrated circuit (IC) operation | |
JP4373595B2 (ja) | コンピュータシステム | |
EP1085399A1 (en) | Software-based temperature controller circuit in an electronic apparatus | |
US8117474B2 (en) | CPU clock control during cache memory stall | |
JP2009542013A (ja) | エネルギー効率的な集積回路(ic)動作のためのダイ単位電圧プログラミング | |
US20040139362A1 (en) | Data processing apparatus | |
US20080290914A1 (en) | Self-Clearing Asynchronous Interrupt Edge Detect Latching Register | |
TWI352281B (en) | Method for judging a rebooting action of a compute | |
US7219248B2 (en) | Semiconductor integrated circuit operable to control power supply voltage | |
JPH05108195A (ja) | ポータブルコンピユータ | |
CN102262550A (zh) | 计算机系统及其开关机方法 | |
JP2002140138A (ja) | 省電力移行制御装置、情報処理装置、省電力移行制御方法及び記憶媒体 | |
US6567868B1 (en) | Structure and method for automatically setting the CPU speed | |
US7315928B2 (en) | Apparatus and related method for accessing page mode flash memory | |
CN101788847B (zh) | 系统内存性能调整方法与装置 | |
TW200821844A (en) | Serial peripheral interface controlling apparatus and system thereof and method for judging whether serial peripheral interface device supporting fast read command | |
JP2003308138A (ja) | 電子機器および電子機器の駆動制御方法 | |
JPH0916280A (ja) | 低消費電力型遷移検出器を備えた自己タイミング方式のデータ処理システム | |
JPH1173764A (ja) | D−ramの種別判定方法 | |
JP2004303163A (ja) | メモリ回路、メモリ回路動作方法 | |
JPH11194851A (ja) | リアルタイムクロックの二重構成回路および二重構成方法 | |
JP2846876B2 (ja) | 情報処理装置 | |
TW550451B (en) | Programmable power-on system and method for central processing unit | |
JP2003330570A (ja) | データ処理装置、データ処理装置制御方法、データ処理装置制御プログラム |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20051018 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20080318 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20080516 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20090602 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20090715 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20090811 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20090904 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120911 Year of fee payment: 3 |
|
R151 | Written notification of patent or utility model registration |
Ref document number: 4373595 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R151 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120911 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120911 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130911 Year of fee payment: 4 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313121 Free format text: JAPANESE INTERMEDIATE CODE: R313117 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
LAPS | Cancellation because of no payment of annual fees |