JP4268956B2 - 液晶表示装置及びその製造方法 - Google Patents
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Description
本発明は液晶表示装置に関し、特にその製造工程を単純化し得る液晶表示装置及びその製造法に関する。
液晶表示装置は、バックライトユニット(Back light unit)から入射された光を利用して画像を表示する透過型と、自然光のような外部光を反射させるによって画像を表示する反射型とに大別される。透過型はバックライトユニットの電力消耗が多く、反射型は外部光に依存することにより、暗い環境では画像を表示し得ない問題点がある。
このような問題点を解決するために、バックライトユニットを利用する透過モードと外部光を利用する反射モードとが選択可能な半透過型液晶表示装置が出現した。半透過型液晶表示装置は、外部光が充分であれば反射モードに、不充分であればバックライトユニットを利用した透過モードに動作するようになるため、透過型より消費電力を減らすことができると共に、反射型とは相違に外部光の制約を受けないようになる。
一般的に、半透過型液晶パネルは、図1に図示されたように、液晶層(図示なし)を間に置いて接合されたカラーフィルター基板及び薄膜トランジスター基板と、薄膜トランジスター基板の後部に配置されたバックライトユニット60とを備える。このような半透過型液晶パネルの各画素は、反射電極28が形成された反射領域と、反射電極28が形成されていない透過領域とに区分される。
カラーフィルター基板は、上部基板52の上に形成されたブラックマトリックス(図示なし)及びカラーフィルター54、それらの上に積層された共通電極56及び配向膜(図示なし)
で構成される。
で構成される。
薄膜トランジスター基板は、下部基板2の上に形成されて、各画素領域を画成するゲートライン4及びデーターライン(図示なし)、ゲートライン4及びデーターラインと接続された薄膜トランジスター、画素領域に形成されて薄膜トランジスターと接続された画素電極32、各画素の反射領域に形成され画素電極32と重なる反射電極28を備える。
薄膜トランジスターは、ゲートライン4と接続されたゲート電極6、データーラインと接続されたソース電極16、ソース電極16と対向するドレイン電極18、ゲート電極6とゲート絶縁膜8の間にはさみ込まれ、かつ重なって、ソース及びドレイン電極16,18の間のチャンネルを形成する活性層10、その活性層10とソース及びドレイン電極16,18とのオーミック接触のためのオーミック接触層12を備える。このような薄膜トランジスターは、ゲートライン４のスキャン信号に応答して、データーライン上のビデオ信号が画素電極32に印加されて維持されるようにする。
反射電極28は、カラーフィルター基板を通じて入射された外部光をカラーフィルター基板の方に反射させる。この際、反射電極28の下に形成された有機膜24の表面がエンボッシング(Embossing)形状を有し、その上の反射電極28もエンボッシング形状を有することによって散乱効果で反射効率が増大される。
画素電極32は、薄膜トランジスターを通じて供給された画素信号により、共通電極56との間に電位差を発生させる。この電位差により誘電異方性を有する液晶が回転して、反射領域と透過領域各々の液晶層を経由する光の透過率を調節することによって、前記ビデオ信号により輝度が変化される。
この場合、反射領域と透過領域において、液晶層を経由する光の経路の長さが同一になるように、透過領域において、相対的に厚い有機膜24に透過ホール36を形成するようになる。その結果、反射領域に入射された周辺光、即ち、反射光RLが液晶層の内で液晶層→反射電極28→液晶層を経由する経路と、透過領域に入射されたバックライトユニット60の透過光TLが液晶層を経由する経路との長さが同一であることにより、反射モードと透過モードとの透過効率が同じようになる。
そして、薄膜トランジスター基板は、画素電極32に供給されたビデオ信号を安定に維持させるために、画素電極32と接続されたストリッジキャパシターをさらに備える。ストリッジキャパシターは画素電極32と接続されたストリッジ上部電極20がゲートライン4とゲート絶縁膜8の間にはさみ込まれ、かつ重なることによって形成される。ストリッジ上部電極20の下には、工程上オーミック接触層12及び活性層10がさらに重なる。
また、薄膜トランジスター基板は、薄膜トランジスターと有機膜24との間の第1保護膜22、有機膜24と反射電極28との間の第2保護膜26、反射電極28と画素電極32との間の第3保護膜30をさらに備えている。これによって、画素電極32は第1乃至第3保護膜22,26,30と有機膜24及び反射電極28を貫通する第1及び第2コンタクトホール34,38各々を通じて、ドレイン電極18及びストリッジ上部電極20と接続される。
このような半透過型液晶パネルにおいて、薄膜トランジスター基板は、半導体工程を含むと共に、多数のマスク工程を必要とすることになり、製造工程が複雑となるため、液晶パネルの製造単価の上昇の重要な原因になっている。
以下、半透過型薄膜トランジスター基板の製造方法を図2a乃至図2fを参照して説明する。
図2aを参照すると、第1マスク工程を利用して、下部基板2上にゲートライン４、ゲート電極6を含むゲートパターンが形成される。
下部基板2上にスパッタリング方法などの蒸着方法によりゲート金属層が形成される。続いて、第1マスクを利用したフォトリソグラフィ工程とエッチング工程によってゲート金属層がパターニングされることにより、ゲートライン4、ゲート電極8を含むゲートパターンが形成される。ゲート金属層としては、Al、Mo、Cr等の金属の単一層または二重層構造が利用される。
図2bを参照すると、ゲートパターンが形成された基板2上にゲート絶縁膜8が形成されるとともに、その上に第2マスク工程で活性層10及びオーミック接触層12を含む半導体パターンと；データーライン、ソース電極16、ドレイン電極18、およびストリッジ上部電極20を含むソース／ドレインパターンとが積層される。
ゲートパターンが形成された下部電極2上にPECVD、スパッタリングなどの蒸着方法により、ゲート絶縁膜8、非晶質シリコン層、不純物がドーピングされた非晶質シリコン層、そして、ソース／ドレイン金属層が順に形成される。ゲート絶縁膜8としては、酸化シリコン（SiOx）または窒化シリコン（SiNｘ）などのような無機絶縁物質が、ソース／ドレイン金属層としては、Al、Mo、Crなどの金属の単一層または二重層構造が利用される。
そして、ソース／ドレイン金属層の上に、第2マスクを利用したフォトリソグラフィ工程でフォトレジストパターンを形成するようにする。この場合、第2マスクとしては、薄膜トランジスターのチャンネル部に回折露光部を有する回折露光マスクを利用することにより、チャンネル部のフォトレジストパターンが他のソース／ドレインパターン部より低い高さを有するようにする。
続いて、フォトレジストパターンを利用したウェットエッチング工程によって、ソース／ドレイン金属層がパターニングされることにより、データーライン、ソース電極16、そのソース電極16と一体化されたドレイン電極18、ストリッジ電極20を含むソース／ドレインパターンが形成される。
次に、同一のフォトレジストパターンを利用したドライエッチング工程によって、不純物がドーピングされた非晶質シリコン層と非晶質シリコン層とが同時にパターニングされることにより、オーミック接触層12と活性層10とが形成される。
そして、アッシング(Ashing)工程によって、チャンネル部において相対的に低い高さを有するフォトレジストパターンが除去された後、ドライエッチング工程によって、チャンネル部のソース／ドレインパターン及びオーミック接触層12がエッチングされる。これによって、チャンネル部の活性層10が露出されるとともに、ソース電極16とドレイン電極18は分離される。
続いて、ストリップ工程によって、ソース／ドレインパターン上に残っているフォトレジストパターンが除去される。
図2cを参照すると、ソース／ドレインパターンが形成されたゲート絶縁膜8上に、第1保護膜22が形成されるとともに、その上に第3マスク工程で第1及び第2初期コンタクトホール35,37と透過ホール36とを有し、エンボッシング形状の表面を有する有機膜24が形成される。
ソース／ドレインパターンが形成されたゲート絶縁膜8上に、第1保護膜22と有機膜24が順に形成される。第１保護膜22としては、ゲート絶縁膜8のような無機絶縁物質が、有機膜24としては、アクリルなどのような感光性有機物質が利用される。
次に、第3マスクを利用したフォトリソグラフィ工程で有機膜24をパターニングすることにより、第3マスクの透過部に対応して、有機膜24を貫通する第1及び第2オープンホール35,37と透過ホール36とが形成される。この際に、第3マスクは、透過部を除いた残り部分が、遮断部と回折露光部が繰り返す構造を有し、これに対応して、残っている有機膜24は、段差を有する遮断領域(突出部)及び回折露光領域(溝部)が繰り返す構造にパターニングされる。続いて、突出部及び溝部が繰り返す有機膜24を焼成することにより、有機膜24の表面がエンボッシング形状を有するようになる。
図2dを参照すると、エンボッシング形状を有する有機膜24の上に、第2保護膜26が形成されるとともに、その上に第4マスク工程で反射電極28が形成される。
エンボッシング表面を有する有機膜24上に、第2保護膜26及び反射金属層がエンボッシング形状を維持して積層される。第2保護膜26としては、第1保護膜22のような無機絶縁物質が、反射金属層としては、AlNdなどのような反射率の高い金属が利用される。
続いて、第4マスクを利用したフォトリソグラフィ工程及びエッチング工程で反射金属層がパターニングされることにより、各画素に独立した、有機膜24の第1及び第2オープンホール35,37と透過ホール36でオープンされた反射電極28が形成される。
図2eを参照すると、第5マスク工程で反射電極28を覆う第3保護膜30が形成されるとともに、第1乃至第3保護膜22,26,30を貫通する第1及び第２コンタクトホール34,38が形成される。
反射電極28を覆う第3保護膜30が形成されるとともに、第5マスクを利用したフォトリソグラフィ工程及びエッチング工程により、有機膜24の第1及び第2オープンホール35,37にて第1乃至第3保護膜22,26,30を貫通する第1及び第2コンタクトホール34,38が形成される。第1及び第2コンタクトホール34,38はそれぞれドレイン電極18とストリッジ上部電極20とを露出させる。第3保護膜30としては、第2保護膜26のように、無機絶縁物質が利用される。
図2ｆを参照すると、第6マスク工程を利用して、第3保護膜30上に画素電極32が形成される。
第3保護膜30上にスパッタリングなどの蒸着方法によって透明導電層が形成されるとともに、第6マスクを利用したフォトリソグラフィ工程とエッチング工程により、透明導電層がパターニングされて、各画素領域に画素電極32が形成される。画素電極32は第1及び第2コンタクトホール34,38を通じてドレイン電極18及びストリッジ上部電極20と接続される。透明導電層としては、インジウム・スズ・酸化物(Indium Tin Oxide：ITO)などが利用される。
このように、従来の半透過型薄膜トランジスター基板では、6マスク工程で形成されるため、製造工程が複雑であるという欠点がある。また、従来の半透過型薄膜トランジスター基板としては、画素電極32と、ドレイン電極18及びストリッジ上部電極20各々との接続のために、第1及び第2コンタクトホール34,38のマージンを充分に確保しなければならない。このため、透過領域の開口率が減少するという問題がある。
本発明の目的は、工程を単純化しながらも透過領域の開口率を増大し得る液晶表示装置及びその製造方法を提供することである。
前記目的を達成するために、本発明の実施形態の液晶表示装置は、第1及び第2基板と；透明な第1導電層と不透明な第2導電層とが積層された二重構造にて、前記第1基板上に形成されたゲートラインと；前記ゲートラインの上の第1絶縁膜と；前記ゲートラインと交差して画素領域を画成するデータラインと；前記ゲートライン及びデータラインと接続された薄膜トランジスターと；前記画素領域に前記第1導電層で形成された画素電極と；ゲート絶縁膜を間に置きゲートラインと重なってストリッジキャパシターを形成するストリッジ上部電極と；前記トランジスター上の第2絶縁膜から前記第1絶縁膜まで貫通して前記画素電極を露出させる透過ホールと；前記透過ホールのエッジ部を通じて露出された前記薄膜トランジスターのドレイン電極及びストリッジ上部電極を前記画素電極と接続させる反射電極と；前記ゲートラインの第1導電層から伸長されたゲートパッドと；前記第1導電層で形成されデータリンクを通じて前記データラインと接続されたデータパッドと；前記第1及び第2基板間の液晶層とを備え；前記第1及び第2絶縁膜は前記ゲートパッド及びデータパッド領域から除去されるようになっていることを特徴とする。
本発明の実施形態の液晶表示装置の製造方法は、第1及び第2基板を設ける段階と；第1マスクを利用して透明な第1導電層と不透明な第2導電層とが積層された二重構造を有するゲートライン及びゲート電極と、前記第1導電層を有する画素電極を形成する段階と；前記ライン及び電極らの上に第１絶縁膜を形成する段階と；第2マスクを利用して前記第1絶縁膜の上に半導体パターンを形成すると共に、データーライン、ソース電極、ドレイン電極、ストリッジ上部電極を含むソース／ドレインパターンを形成する段階と；第3マスクを利用して前記ソース／ドレインパターン上に第2絶縁膜を形成し、前記第2絶縁膜から前記第1絶縁膜まで貫通する透過ホールを透過領域に形成する段階と；第4マスクを利用して前記透過ホールを通じて前記ドレイン電極及びストリッジ上部電極を前記画素電極と接続させる反射電極を反射領域に形成する段階と；前記第1及び第2基板の間に液晶層を形成する段階とを含む。
本発明による液晶表示装置及びその製造方法では、二重構造のゲートパターンと、単一層構造の透明導電パターンをハーフトーンマスク(または回折マスク)を利用して、一つのマスク工程で形成することにより、工程を単純化できる。また、ハーフトーンマスク(または回折マスク)工程によって、二重構造ゲートパターンの第1及び第2導電層が階段形態で一定の段差を有するようになるため、第1及び第2導電層の急傾斜によるソース／ドレインパターンの断線を防止し得る。
また、本発明による液晶表示装置及びその製造方法では、有機膜のパターニングの際、画素電極を露出させる透過ホールを形成し、透過ホールのエッジ部を経由する反射電極でドレイン電極及びストリッジ上部電極を画素電極と接続させる。これによって、工程を一層単純化し得るだけでなく、ドレイン電極及びストリッジ上部電極を画素電極と接続させるための別のコンタクトホールが不要になるので、その分透過領域の開口率を増大し得る。
また、本発明による液晶表示装置及びその製造方法は、反射電極と同一の金属のコンタクト電極により、互いに異なる層に形成されたデーターリンク及びデーターラインを接続させるとともに、静電気防止素子の薄膜トランジスターを相互接続させる。これによって、4マスク工程で工程を単純化し得る。
加えて、本発明による液晶表示装置及びその製造方法は、反射電極及びコンタクト電極を二重構造に形成し、低コンタクト抵抗を有する第1反射金属層が透明導電層と接続させることによって、コンタクト抵抗を一層減少させることができる。
以下、図3乃至図18bを参照して本発明の望ましい実施例について説明する。
図3は本発明の実施形態の半透過型薄膜トランジスター基板を図示した平面図であり、図4は図3に図示された半透過型薄膜トランジスター基板をII−II'、III−III'、IV−IV'線に沿って切断して図示した断面図である。
図3と図4に図示された半透過型薄膜トランジスター基板は、下部基板142上にゲート絶縁膜144を間にはさまれて交差して画素領域を画成するゲートライン102及びデータライン104、そのゲートライン102及びデータライン104と接続された薄膜トランジスター106、各画素の反射領域に形成された反射電極152、各画素領域に形成され、反射電極152を通じて薄膜トランジスター106と接続された画素電極118を備えている。そして、半透過型薄膜トランジスター基板は、反射電極153を通じて画素電極118に接続されたストリッジ上部電極122と前端ゲートライン102が重なって形成されたストリッジキャパシター120、ゲートライン102と接続されたゲートパッド128、データライン104と接続されたデータパッド138を備える。このような半透過型薄膜トランジスター基板で各画素領域は反射電極152が形成された反射領域と反射電極152が形成されない透過領域に区分される。
薄膜トランジスター106はゲートライン102と接続されたゲート電極108、データライン104と接続されたソース電極110、ソース電極110と向かい合う画素電極118と接続されたドレイン電極112、ゲート絶縁膜144の間にはさみ込まれ、かつゲート電極108と重なってソース電極110とドレイン電極112の間にチャンネルを形成する活性層114、ソース電極110及びドレイン電極112とのオーミック接触のためにチャンネル部を除いた活性層114上に形成されたオーミック接触層116を備える。このような薄膜トランジスター106はゲートライン102のスキャン信号に応答してデータライン104上のビデオ信号が画素電極118に印加されて維持されるようにする。
ここで、ゲートライン102及びゲート電極108は透明導電層101で成る第1導電層101と、その上に金属層で成る第2導電層103が積層された二重構造を有する。
そして、活性層114及びオーミック接触層116を含む半導体パターン115はデーターライン104とも重なるように形成される。
反射電極152は各画素の反射領域に形成されて外部光を反射させる。このような反射電極152は、その下の有機膜148の形状によってエンボッシング形状を有するようになることにより散乱効果で反射効率を増大させる。反射電極152は第1及び第2反射金属層151,153が積層された二重構造を有する。第1反射金属層151には透明導電層である画素電極118とのコンタクト抵抗を減少させることができるMoなどのような金属が、第2反射金属層153にはAlNdなどのように反射率が高い金属が利用される。
画素電極118は、各画素領域に形成され透過ホール154のエッジ部を経由する反射電極152を通じてドレイン電極112と接続される。画素電極118は、ゲートライン102の第1導電層101のような透明導電層で形成され、透過領域で透過ホール154を通じて露出される。
画素電極118は、薄膜トランジスターを通じて供給された画素信号によりカラーフィルター基板(図示なし)の共通電極と電位差を発生させる。この電位差により誘電異方性を有する液晶が回転して反射領域と透過領域夫々の液晶層を経由する光の透過率が調節されるため、前記ビデオ信号によって輝度が異なるようになる。
透過ホール154は、透過領域で画素電極118上のゲート絶縁膜144と、薄膜トランジスター106上の保護膜146、有機膜148を貫通して形成される。これによって、反射領域と透過領域で液晶層を経由する光経路の長さが同一になるので、反射モードと透過モードの透過効率が同一になるようになる。
ストリッジキャパシター120は、画素電極118と接続されたストリッジ上部電極122がゲート絶縁膜144を間に置き前端ゲートライン102と重なって形成される。ストリッジ上部電極122は透過ホール154のエッジ部を経由する反射電極152を通じて画素電極118と接続され、ストリッジ上部電極122の下には半導体パターン115が更に重なる。
ゲートライン102はゲートパッド128を通じてゲートドライバー(図示なし)と接続される。ゲートパッド128はゲートライン102の第1導電層101が延長されて形成される。
データライン104は、データパッド138を通じてデータドライバー(図示なし)と接続される。データパッド138はゲートパッド128のように第1導電層101で形成される。このようなデータパッド138は別のコンタクト電極(図示せず)を通じてデータライン104と接続される。
ゲートパッド128及びデータパッド138が形成されたパッド領域では、ゲート絶縁膜144、保護膜146、有機膜148が除去される。
このように、本発明の実施形態の半透過型薄膜トランジスター基板では、透過ホール154のエッジ部を経由する反射電極152を通じて画素電極118がドレイン電極112及びストリッジ上部電極122と接続される。これによって、画素電極118とドレイン電極112及びストリッジ上部電極122との接続のための別のコンタクトホールが不要になるため、その分だけ透過領域の開口率を増大し得るようになる。
そして、反射電極152のうち、透明導電層とのコンタクト抵抗の少ない第1反射金属層151が画素電極118と接続されるようになる。これによって、第1反射金属層151にはMoを、第2反射金属層153にはAlNdを、画素電極118にはITOを利用する場合、AlNdとITOはMoを通じてのみ接続するようになるため、Al203生成によるAlNdとITOとのコンタクト抵抗増加を防止することができるようになる。
このような構成を有する本発明の実施形態の薄膜トランジスター基板は次の通り5マスク工程で形成される。
図5a及び図5bは、本発明の実施形態の半透過型薄膜トランジスター基板の製造方法のうち、第1マスク工程を説明するための平面図と断面図であり、図6a乃至図6eは第1マスク工程を具体的に説明するための断面図である。
第1マスク工程において、下部基板142上にゲートライン102、ゲートライン102と接続されたゲート電極108を含むゲートパターンと、ゲートパッド128、データパッド138、画素電極118を含む透明導電パターンとが形成される。ゲートパターンは、第1及び第2導電層101,103が積層された二重構造で、透明導電パターンはゲートパターンの第1導電層101と同一の単一層で形成される。このように二重構造を有するゲートパターンと、単一層構造を有する透明導電パターンは、ハーフトーン(Half Tone)マスクまたは回折マスクを利用することにより一つのマスク工程で形成される。以下ではハーフトーンマスクを利用した場合だけを例示して説明することにする。
具体的に、図6aに図示されたように、下部基板142の上にスパッタリング方法などの蒸着方法により、第1及び第2導電層101,103が積層されるとともに、その上にフォトレジスト167が形成される。第1導電層101としては、ITO、TO、TZOなどのような透明導電物質が、第2導電層103としては、Mo、Ti、Cu、Al(Nd)系などの金属物質が利用される。
次に、ハーフトーンマスク260を利用したフォトリソグラフィ工程で、フォトレジスト167を露光及び現象することにより、図6bに図示されるように、段差を有するフォトレジストパターン168が形成される。
ハーフトーンマスク260は、透明な石英（SiO2；Quartz）基板266と、その上に形成された遮断層262及び部分透過層264を備える。部分透過層264と重なる遮断層262はゲートパターンが形成される領域に位置して紫外線UVを遮断することにより現象後に第1フォトレジストパターン268Aが残るようにする。遮断層262と重ならない部分の透過層264は透明導電パターンが形成される領域に位置して紫外線UVを部分的に透過させることにより現象後に第1フォトレジストパターン268Aより薄い第2フォトレジストパターン268Bが残るようにする。このために、遮断層262はCr、CrOxなどのような金属で、部分透過層264はMoSixなどで形成される。
続いて、段差を有するフォトレジストパターン268を利用したエッチング工程において、第1及び第2導電層101,103をパターニングすることにより、図6cに図示される通り、二重構造のゲートパターンと、その上に第2導電層103が残っている透明導電パターンが形成される。
次に、酸素（O２）プラズマを利用したアッシング工程により、フォトレジストパターン268をアッシングすることにより、図6dに図示されるように、第1フォトレジストパターン268Aは厚さが薄くなり、第2フォトレジストパターン268Bは除去される。そして、アッシングされた第1フォトレジストパターン268Aを利用したエッチング工程で透明導電パターン上の第2導電層103が除去される。この際、アッシングされた第1フォトレジストパターン268Aに従ってパターニングされた第2導電層103の両側部がもう一度更にエッチングされることによりゲートパターンの第1及び第2導電層101,103は階段形態で一定の段差を有するようになる。これによって、第1及び第2導電層101,103の側面部が高い急傾斜を有する場合、その上で発生し得るソース／ドレイン金属層の断線不良を防止できることとなる。
そして、ストリップ工程でゲートパターン上に残存していた第1フォトレジストパターン268Aが図6eに図示される通りに除去される。
図7a及び図7bは、本発明の実施形態の薄膜トランジスター基板の製造方法のうち、第2マスク工程を説明するための平面図と断面図であり、図8a乃至図8eは、第2マスク工程を具体的に説明するための断面図である。
ゲートパターンと画素電極118とが形成された下部基板142の上に、ゲート絶縁膜144が形成され、その上に第2マスク工程でデーターライン104、ソース電極110、ドレイン電極112、ストリッジ上部電極122を含むソース／ドレインパターンと、ソース／ドレインパターンの背面に沿って重なる活性層114及びオーミック接触層116を含む半導体パターン115が形成される。このような半導体パターン115とソース／ドレインパターンは回折露光マスクを利用した一つのマスク工程で形成される。
具体的に、図8aのように、ゲートパターンが形成された下部基板142の上に、ゲート絶縁膜144、非晶質シリコン層105、不純物(ｎ＋またはｐ＋)がドーピングされた非晶質シリコン層107、ソース／ドレイン金属層109が順に形成される。例えば、ゲート絶縁膜144、非晶質シリコン層105、不純物がドーピングされた非晶質シリコン層107はPECVD方法により、ソース／ドレイン金属層109はスパッタリング方法により形成される。ゲート絶縁膜144には酸化シリコンSiOx、窒化シリコンSiNxなどのような無機絶縁物質が、ソース／ドレイン金属層109にはCr、Mo、MoW、Al／Cr、Cu、Al(Nd)、Al／Mo、Al(Nd)／Al、Al(Nd)／Cr、Mo／Al(Nd)／Mo、Cu／Mo、Ti／Al(Nd)／Tiなどが利用され、二重層が例えばAl／Crである場合、Crを先ず形成した後にAlを形成することとなる。
そして、ソース／ドレイン金属層109上にフォトレジスト219が塗布された後、回折露光マスク310を利用したフォトリソグラフィ工程でフォトレジスト219を露光及び現象することにより、図8bに図示される通りに、段差を有するフォトレジストパターン220が形成される。
そして、ソース／ドレイン金属層109上にフォトレジスト219が塗布された後、回折露光マスク310を利用したフォトリソグラフィ工程でフォトレジスト219を露光及び現象することにより、図8bに図示される通りに、段差を有するフォトレジストパターン220が形成される。
回折露光マスク210は、透明な石英基板212と、その上にCr、CrOxなどのような金属層で形成された遮断層214及び回折露光用スリット216を備える。遮断層214は半導体パターン及びソース／ドレインパターンが形成される領域に位置して紫外線を遮断することにより現象後に第1フォトレジストパターン220Aが残るようにする。回折露光用スリット216は薄膜トランジスターのチャンネルが形成される領域に位置して紫外線を回折させることにより現象後に第1フォトレジストパターン220Aより薄い第2フォトレジストパターン220Bが残るようにする。
続いて、段差を有するフォトレジストパターン220を利用したエッチング工程において、ソース／ドレイン金属層109がパターニングされることにより、図8cに図示されるように、ソース／ドレインパターンと、その下の半導体パターン115とが形成される。この場合、ソース／ドレインパターンのうちソース電極110とドレイン電極112は一体化された構造を有する。
次に、酸素（O2）プラズマを利用したアッシング工程によってフォトレジストパターン220をアッシングすることにより、図8dに図示されたように、第1フォトレジストパターン220Aは薄くなり、第2フォトレジストパターン220Bは除去される。そして、アッシングされた第1フォトレジストパターン220Aを利用したエッチング工程において、第2フォトレジストパターン220Bの除去で露出されたソース／ドレインパターンと、その下のオーミック接触層116が除去されることによりソース電極110とドレイン電極112は分離され活性層114が露出される。これによって、ソース電極110とドレイン電極112の間には活性層114から成るチャンネルが形成される。この際に、アッシングされた第1フォトレジストパターン220Aに従ってソース/ドレインパターンの両側部が一度更にエッチングされることによりソース／ドレインパターンと半導体パターン115は階段形態で一定の段差を有するようになる。
そして、ストリップ工程でソース／ドレインパターンの上に残存していた第1フォトレジストパターン220Aが図8eに示す通り除去される。
図9a及び図9bは、本発明の実施形態の薄膜トランジスター基板の製造方法のうち、第3マスク工程を説明するための平面図と断面図であり、図10a乃至図10ｃは、第3マスク工程を段階的に説明するための断面図である。
第3マスク工程でソース／ドレインパターンが形成されたゲート絶縁膜144上に透過領域で透過ホール154を有する保護膜146及び有機膜148が形成される。
図10aを参照すると、ソース／ドレインパターンが形成されたゲート絶縁膜144の上に、PECVDなどの蒸着方法で保護膜146が形成される。保護膜146としては、ゲート絶縁膜144のような無機絶縁物質が利用される。
図10bを参照すると、反射領域でエンボッシング表面を有し、透過領域で透過ホール154を有する有機膜148が保護膜146の上に形成される。具体的には、有機膜148はアクリルなどのような感光性有機物質をスピンコーティング方法で保護膜146上にコーティングすることにより形成される。
次に、第3マスクを利用したフォトリソグラフィ工程で有機膜148をパターニングすることにより、第3マスクの透過部に対応して、透過領域で有機膜148を貫通する透過ホール154が形成され、ゲートパッド128及びデータパッド138が形成されたパッド領域の有機膜148が除去される。
また、第3マスクで透過部を除いた残り部分が、遮断部と回折露光部(または半透過部)が繰り返す構造を有し、これに対応して、有機膜148は反射領域で段差を有する遮断領域(突出部)及び回折露光領域(溝部)が繰り返す構造でパターニングされる。続いて、突出部及び溝部が繰り返えされた有機膜148を塑性することにより反射領域で有機膜148の表面はエンボッシング形状を有するようになる。
図10cを参照すると、有機膜148をマスクに利用して、その下の保護膜146及びゲート絶縁膜144をパターニングすることにより、透過ホール154はゲート絶縁膜144まで貫通するようになり、パッド領域の保護膜146及びゲート絶縁膜144が除去される。この場合、透過ホール154を通じて露出されたドレイン電極112及びストリッジ上部電極122とその下の半導体パターン115もエッチングされる。ここで、エッチング速度の差異に因りドレイン電極112及びストリッジ上部電極122とその下の半導体パターン115よりゲート絶縁膜144のエッジ部がやや突出された構造を有するようになる。このような透過ホール154は画素電極118の第2導電層103を露出させ、そのエッジ部はドレイン電極112及びストリッジ上部電極122の側面を露出させる。
図11a及び図11bは、本発明の実施形態の薄膜トランジスター基板の製造方法のうち第４マスク工程を説明するための平面図と断面図である。
第4マスク工程において各画素の反射領域に反射電極153が形成される。
具体的に、エンボッシング表面を有する有機膜148の上に反射金属層がエンボッシング形状を維持して形成される。反射金属層はMoなどのように画素電極118とのコンタクト抵抗の少ない第1反射金属層151と、AlNdなどのように反射率の高い第2反射金属層153が積層された二重構造に形成される。続いて、第4マスクを利用したフォトリソグラフィ工程及びエッチング工程で、第1及び第2反射金属層151,153がパターニングされることにより、各画素の反射領域ごとに反射電極152が形成される。このような反射電極152は透過ホール154のエッジ部を経由して、ドレイン電極112と画素電極118とを接続させて、ストリッジ上部電極122と画素電極118とを接続させる。これによって、画素電極118とドレイン電極112及びストリッジ上部電極122との接続のための別のコンタクトホールが不要になるので、透過領域の開口率を増大させることができるようになる。また、反射電極152のうち第1反射金属層151が透明導電層である画素電極118と接続されるため、コンタクト抵抗を減少させることができるようになる。
このように、本発明の実施形態の半透過型薄膜トランジスター基板の製造方法は、画素電極118をハーフトーンまたは回折マスクを利用してゲートパターンのように形成し、反射電極152に画素電極118とドレイン電極112及びストリッジ上部電極122を接続させることにより一つのマスク工程を減らすことができるようになる。
図12は、本発明の実施形態の半透過型薄膜トランジスター基板の周辺部を概略的に図示したものである。
図12に図示された半透過型薄膜トランジスター基板100は、ゲートパッド128と同一層に形成されたデータパッド138をデータライン104と接続させるためのコンタクト電極160を備える。言い換えると、コンタクト電極160はデータパッド138から伸長されたデータリンク136とデータライン104を接続させる。ここで、コンタクト電極160をアクティブ領域182に形成される反射電極152と同一の金属層AlNd、AlNd／Moで形成することにする。このようなコンタクト電極160は外部へ露出する場合、酸化作用で腐蝕する問題があるため、シーリング材180により密封される領域、即ち、シーリング材180とアクティブ領域182との間に位置して腐蝕を防止することができる。
また、薄膜トランジスター基板100は、アクティブ領域182に流入される静電気を遮断するための静電気防止素子190を備える。静電気防止素子190は、データライン104またはゲートライン102と接続され、相互接続関係を有する多数個の薄膜トランジスター300,310,320で構成される。静電気防止素子190は静電気などによる高電圧領域では低いインピーダンスを有するため、過電流が放電されるようにすることにより静電気の流入を遮断し、正常的な駆動環境では高いインピーダンスを有するため、データライン104またはゲートライン102を通じて供給される駆動信号には影響を与えないようにする。このような静電気防止素子190は薄膜トランジスター300,310,320を相互接続させるために多数のコンタクト電極を必要とする。このような多数のコンタクト電極も反射電極152と同一の金属層（AlNd、AlNd／Mo）で形成されることとなる。これによって、静電気防止素子190もシーリング材180により密封される領域、即ち、シーリング材180とアクティブ領域182との間に形成される。
図13は、図12に図示されたデータライン104と接続されたコンタクト電極160及び静電気防止素子190を具体的に図示した平面図であり、図14は図13に図示された薄膜トランジスター基板をＶ−Ｖ'、VI−VI'線に沿って切断して図示した断面図である。
図13と図14に図示されたデータリンク136は、データパッド138から延長されてシーリング材180で密封される領域に位置するデータライン104の末端部分と重なる。データリンク136はデータパッド138と同様に第1導電層101である透明導電層でのみ形成される。
第1コンタクト電極160は、データリンク136とデータライン104との重なる部分に形成された第1コンタクトホール162にかけて形成されて、データライン104及びデータリンク136を接続させる。第1コンタクトホール162は、有機膜148から保護膜146、データライン104、半導体パターン115、ゲート絶縁膜144まで貫通してデータリンク136を露出させる。これによって、第1コンタクト電極160は第1コンタクトホール162を通じて露出されたデータライン104と側面接続され、データリンク136とは面接続するようになる。データライン104と接続された静電気防止素子は第2乃至第4薄膜トランジスター300,310,320を備える、
第2薄膜トランジスター300は、データライン104と接続された第2ソース電極304と、その第2ソース電極304と対向する第2ドレイン電極306と、第2ソース及びドレイン電極304,06と半導体パターン115及びゲート絶縁膜144の間にはさみ込まれ、かつ重なる第2ゲート電極302を備える。ここで、第2ゲート電極302は第1及び第2導電層101,103の二重構造を有する。
第3薄膜トランジスター310は、第2薄膜トランジスターの第2ソース電極304と第2ゲート電極302との間にダイオード型で接続される。このために、第3薄膜トランジスター310は、前記第2ソース電極304と接続された第3ソース電極314と、その第3ソース電極314と対向する第3ドレイン電極316と、その第3ソース及びドレイン電極314,316と半導体パターン115及びゲート絶縁膜144を間に置き重なる第3ゲート電極312とを備える。ここで、第3ゲート電極312は第1及び第2導電層101,103の二重構造を有する。そして、第3ゲート電極312は、第2コンタクトホール340にかけて形成された第2コンタクト電極332を通じて第3ソース電極314と接続される。第2コンタクトホール340は、有機膜148、保護膜146、第3ソース電極314、半導体パターン115、ゲート絶縁膜144、第3ゲート電極312の第2導電層103を貫通して第3ゲート電極312の第1導電層101を露出させる。
第4薄膜トランジスター320は、前記第2薄膜トランジスターの第2ドレイン電極306と第2ゲート電極302との間にダイオード型で接続される。このために、第4薄膜トランジスター320は、前記第2ドレイン電極306と接続された第4ソース電極324と、その第4ソース電極324と対向された第4ドレイン電極326と、その第4ソース及びドレイン電極324,326と半導体パターン115及びゲート絶縁膜144の間にはさみ込まれ、かつ重なる、第4ゲート電極322とを備える。ここで、第4ゲート電極322は第1及び第2導電層101,103の二重構造を有する。第4ドレイン電極326は、第3ドレイン電極316と接続され、第3コンタクトホール344に亘って形成された第3コンタクト電極334を通じて第2ゲート電極302と接続される。また、第4ゲート電極322は第4コンタクトホール348に亘って形成された第4コンタクト電極336を通じて第4ソース電極324と接続される。第3コンタクトホール344は、有機膜148、保護膜146、第4ドレイン電極326、半導体パターン115、ゲート絶縁膜144、第2ゲート電極302の第1導電層103を貫通して形成され、第4コンタクトホール348は有機膜148、保護膜14、第4ソース電極324、半導体パターン115、ゲート絶縁膜144、第4ゲート電極322の第1導電層103を貫通して形成される。
ここで、第1乃至第4コンタクト電極160,332,334,336は前述した通り、反射電極152と同一に第1及び第2反射金属層151,153が積層された二重構造を有する。これによって、第1乃至第4コンタクト電極160,332,334,336の第1反射金属層151が透明導電層である第1導電層103と接続されるため、コンタクト抵抗を減少させることができる。
このような構造を有する半透過型薄膜トランジスター基板は、前述した通り、4マスク工程で形成される。これを図15a乃至図19bを参照して説明する。
図15a及び図15bを参照すると、第1マスク工程で下部基板142上にデータパッド138と共にデータリンク136、第2乃至第4ゲート電極302,312,322を含むゲートパターンが形成される。ここで、データパッド138及びデータリンク136は、第1導電層101である透明導電層だけで形成され、第2乃至第4ゲート電極302,312,322を含むゲートパターンは第1及び第2導電層101,103が積層された二重構造を有する。このような第1マスク工程は、図5a乃至図6eで前述した通り、ハーフトーンマスク(または回折マスク)を利用する。
図16a及び図16bを参照すると、第2マスク工程でゲート絶縁膜144と、活性層114及びオーミック接触層116を含む半導体パターン115と、データライン104、第2乃至第4ソース電極304,314,324、第2乃至第4ドレイン電極306,316,326を含むソース／ドレインパターンが形成される。このような第2マスク工程は、図7a乃至図8eで前述した通りである。
図17a及び図17bを参照すると、第3マスク工程で保護膜146及び有機膜148が形成され、有機膜148からゲート絶縁膜144まで貫通する第1コンタクトホール162と、第2乃至第3ゲート電極の第2導電層103まで貫通する第2乃至第4コンタクトホール340,344,348が形成される。このような第3マスク工程は図9a乃至図10cで前述した通りである。この場合、有機膜148はパッド領域では除去され、画素領域のように反射電極152が形成されない部分ではエンボッシング表面を有しない。
図18a及び図18bを参照すると、第4マスク工程で反射電極152と同一である二重構造の第1乃至第4コンタクト電極160,332,334,336が形成される。このような第4マスク工程は、図11a及び図11bで前述した通りである。
以上説明した内容を通じて、当業者であれば本発明の技術思想を逸脱しない範囲で多様な変更及び修正が可能であることが分る。従って、本発明の技術的範囲は明細書の詳細な説明に記載された内容に限定されるものではなく、特許請求の範囲の記載により定められるべきものである。
2，14２：下部基板
4，102：ゲートライン
6，108，302，312，322：ゲート電極
8，144：ゲート絶縁膜
10，114：活性層
12，116：オーミック接触層
16，110，304，314，324：ソース電極
20，112，306，316，326：ドレイン電極
20，122：ストリッジ上部電極
22，26，30，146：保護膜
24，148：有機膜
28，152：反射電極
32，118：画素電極
34，38，162，340，344，348：コンタクトホール
35，37：開口部
36，154：透過ホール
52：上部基板
54：カラーフィルター
56：共通電極
100：薄膜トランジスター基板
101：第1導電層
108：第2導電層
113：第3導電層
106，300，310，320：薄膜トランジスター
115：半導体パターン
128：ゲートパッド 136：データリンク
138：データパッド
151：第1反射金属層
160，262，332，334，336：コンタクト電極
180：シーリング材
182：アクティブ領域
190：静電気防止素子
210：回折露光マスク
212，266：石英基板
214，262：遮断層
216：スリット
219，167：フォトレジスト
105：非晶質シリコン層
107：不純物ドーピングされた非晶質シリコン層
109：ソース／ドレイン金属層
168，220：フォトレジストパターン
153：第2反射金属層
168A，220A：第1フォトレジストパターン
260：ハーフトーンマスク
168B，220B：第2フォトレジストパターン
264：部分透過層
4，102：ゲートライン
6，108，302，312，322：ゲート電極
8，144：ゲート絶縁膜
10，114：活性層
12，116：オーミック接触層
16，110，304，314，324：ソース電極
20，112，306，316，326：ドレイン電極
20，122：ストリッジ上部電極
22，26，30，146：保護膜
24，148：有機膜
28，152：反射電極
32，118：画素電極
34，38，162，340，344，348：コンタクトホール
35，37：開口部
36，154：透過ホール
52：上部基板
54：カラーフィルター
56：共通電極
100：薄膜トランジスター基板
101：第1導電層
108：第2導電層
113：第3導電層
106，300，310，320：薄膜トランジスター
115：半導体パターン
128：ゲートパッド 136：データリンク
138：データパッド
151：第1反射金属層
160，262，332，334，336：コンタクト電極
180：シーリング材
182：アクティブ領域
190：静電気防止素子
210：回折露光マスク
212，266：石英基板
214，262：遮断層
216：スリット
219，167：フォトレジスト
105：非晶質シリコン層
107：不純物ドーピングされた非晶質シリコン層
109：ソース／ドレイン金属層
168，220：フォトレジストパターン
153：第2反射金属層
168A，220A：第1フォトレジストパターン
260：ハーフトーンマスク
168B，220B：第2フォトレジストパターン
264：部分透過層
Claims (42)
- 第1及び第2基板と；透明な第1導電層と不透明な第2導電層が積層された二重構造にて前記第1基板上に形成されたゲートラインと；前記ゲートラインの上の第1絶縁膜と；前記ゲートラインと交差して画素領域を画成するデータラインと；前記ゲートライン及びデータラインと接続された薄膜トランジスターと；前記画素領域に前記第1導電層で形成された画素電極と；ゲート絶縁膜を間に置きゲートラインと重なってストリッジキャパシターを形成するストリッジ上部電極と；前記薄膜トランジスターの上の第2絶縁膜から前記第1絶縁膜まで貫通して、前記画素電極を露出させる透過ホールと；前記透過ホールのエッジ部を通じて露出された前記薄膜トランジスターのドレイン電極及びストリッジ上部電極を前記画素電極と接続させる反射電極と；前記ゲートラインの第1導電層から伸長されたゲートパッドと；前記第1導電層で形成されデータリンクを通じて前記データラインと接続されたデータパッドと；前記第1及び第2基板間の液晶層を備え；前記第1及び第2絶縁膜は前記ゲートパッド及びデータパッド領域から除去されていることを特徴とする液晶表示装置。
- 前記薄膜トランジスターと前記第2絶縁膜との間の第3絶縁膜をさらに備えることを特徴とする請求項1に記載の液晶表示装置。
- 前記第3絶縁膜は、無機絶縁物質で形成されたことを特徴とする請求項2に記載の液晶表示装置。
- 前記透過ホールは、第3絶縁膜を貫通することを特徴とする請求項2に記載の液晶表示装置。
- 前記第2絶縁膜は、有機絶縁膜で形成されたことを特徴とする請求項1に記載の液晶表示装置。
- 前記第2絶縁膜及びデータラインと、第1絶縁膜を貫通して、前記データラインの末端部分と重なるデータリンクを露出させる第1コンタクトホールと；前記第1コンタクトホールを通じて前記データラインと側面接続されるとともに、前記データリンクと面接続された第1コンタクト電極をさらに備えることを特徴とする請求項1に記載の液晶表示装置。
- 前記第1コンタクト電極は、前記反射電極と同一の金属で形成されたことを特徴とする請求項6に記載の液晶表示装置。
- 前記第１コンタクト電極は、シーリング材により密封される領域に形成されたことを特徴とする請求項6に記載の液晶表示装置。
- 前記反射電極及び前記第1コンタクト電極は、AlNd及びMoの二重層構造で形成されたことを特徴とする請求項6に記載の液晶表示装置。
- 前記ゲートライン及びデータラインのうち、いずれか一つと接続された静電気防止素子をさらに備えることを特徴とする請求項1に記載の液晶表示装置。
- 前記静電気防止素子は、前記ゲートライン及びデータラインのうち、いずれか一つと接続された第2薄膜トランジスター；前記第2薄膜トランジスターのゲート電極及びソース電極の間にダイオード形態で接続された第3薄膜トランジスターと；前記第2薄膜トランジスターのゲート電極及びドレイン電極の間にダイオード形態で接続された第4薄膜トランジスターと；第2コンタクトホールを通じて前記第3薄膜トランジスターのソース電極及びゲート電極を接続させる第2コンタクト電極と；第3コンタクトホールを通じて前記第3または第4薄膜トランジスターのドレイン電極と前記第2薄膜トランジスターのゲート電極を接続させる第3コンタクト電極と；第4コンタクトホールを通じて前記第4薄膜トランジスターのソース電極及びゲート電極を接続させる第4コンタクト電極を備えることを特徴とする請求項10に記載の液晶表示装置。
- 前記第2乃至第4薄膜トランジスターのゲート電極は、前記ゲートラインのように二重層構造で形成されたことを特徴とする請求項11に記載の液晶表示装置。
- 前記第2乃至第4コンタクト電極は、前記反射電極と同一の金属で形成されたことを特徴とする請求項11に記載の液晶表示装置。
- 前記第2乃至第4コンタクトホールは、前記第2絶縁膜から前記ソース電極またはドレイン電極と半導体パターン、前記第1絶縁膜と前記ゲート電極の第2導電層まで貫通して、前記ゲート電極の第1導電層を露出させることを特徴とする請求項11に記載の液晶表示装置。
- 前記第2乃至第4コンタクト電極は、シーリング材により密封される領域に形成されたことを特徴とする請求項11に記載の液晶表示装置。
- 前記反射電極と、第2乃至第4コンタクト電極は、AlNd及びMoの二重層構造で形成されたことを特徴とする請求項11に記載の液晶表示装置。
- 前記第2絶縁膜は、エンボッシング表面を有することを特徴とする請求項1に記載の液晶表示装置。
- 前記反射電極は、エンボシング表面を有することを特徴とする請求項17に記載の液晶表示装置。
- 第1及び第2基板を設ける段階と；第１マスクを利用して透明な第1導電層と不透明な第2導電層が積層された二重構造を有するゲートライン及びゲート電極と、前記第1導電層を有する画素電極を形成する段階と；前記ライン及び電極の上に第1絶縁膜を形成する段階と；第2マスクを利用して前記第1絶縁膜の上に半導体パターンを形成すると共に、データライン、ソース電極、ドレイン電極、ストリッジ上部電極を含むソース／ドレインパターンを形成する段階と；第3マスクを利用して前記ソース／ドレインパターンの上に第2絶縁膜を形成し、前記第2絶縁膜から前記第1絶縁膜まで貫通する透過ホールを透過領域に形成する段階と；第4マスクを利用して前記透過ホールを通じて前記ドレイン電極及びストリッジ上部電極を前記画素電極と接続させる反射電極を反射領域に形成する段階と；前記第1及び第2基板の間に液晶層を形成する段階とを含むことを特徴とする液晶表示装置の製造方法。
- 前記データラインは、前記半導体パターンの一部と重なることを特徴とする請求項19に記載の液晶表示装置の製造方法。
- 前記反射領域は、前記画素電極の一部分と重なることを特徴とする請求項20に記載の液晶表示装置の製造方法。
- 前記第2絶縁膜を形成する以前に、第3絶縁膜を形成する段階をさらに含むことを特徴とする請求項19に記載の液晶表示装置の製造方法。
- 前記第3絶縁膜は、無機絶縁物質で形成されたことを特徴とする請求項22に記載の液晶表示装置の製造方法。
- 前記透過ホールは、前記第3絶縁膜を貫通するように形成されたことを特徴とする請求項22に記載の液晶表示装置の製造方法。
- 前記第2絶縁膜は、有機絶縁物質で形成されたことを特徴とする請求項19に記載の液晶表示装置の製造方法。
- 前記第1マスクを利用して、前記ゲートラインの第1導電層から伸長されたゲートパッドと、前記データラインと接続されるデータパッドを形成する段階と；前記第3マスクを利用して、前記ゲートパッド及びデータパッドが形成されたパッド領域で前記第1及び第2絶縁膜を除去する段階とをさらに含むことを特徴とする請求項19に記載の液晶表示装置の製造方法。
- 前記ゲートパッド及びデータパッドは、同一の構造を有することを特徴とする請求項26に記載の液晶表示装置の製造方法。
- 前記第1マスクを利用して、前記データパッドから伸長されて、前記データラインの末端部分と重なるデータリンクを形成する段階と；前記第3マスクを利用して第2絶縁膜から前記データラインを経由して前記第1絶縁膜まで貫通して、前記データリンクを露出させる第1コンタクトホールを形成する段階と；前記第4マスクを利用して前記第1コンタクトホールを通じて前記データライン及びデータリンクを接続させる第1コンタクト電極を形成する段階とをさらに含むことを特徴とする請求項26に記載の液晶表示装置の製造方法。
- 前記第1コンタクト電極は、シーリング材により密封される領域に形成されたことを特徴とする請求項28に記載の液晶表示装置の製造方法。
- 前記反射電極及び第1コンタクト電極は、AlNd及びMoの二重層構造で形成されたことを特徴とする請求項28に記載の液晶表示装置の製造方法。
- 前記ゲートライン及びデータラインのうち、いずれ一つと接続された第2薄膜トランジスター、前記第2薄膜トランジスターのゲート電極及びソース電極の間にダイオード形態で接続された第3薄膜トランジスター、前記第2薄膜トランジスターのゲート電極及びドレイン電極の間にダイオード形態で接続された第4薄膜トランジスターを含む静電気防止素子を形成する段階をさらに含むことを特徴とする請求項19に記載の液晶表示装置の製造方法。
- 前記静電気防止素子を形成する段階は、前記第1マスクを利用して前記二重構造を有する前記第2乃至第4薄膜トランジスターのゲート電極を形成する段階と；前記第2マスクを利用して前記第1絶縁膜の上に前記第2乃至第4薄膜トランジスターの半導体パターンとソース電極及びドレイン電極を形成する段階と；前記第3マスクを利用して第2乃至第4コンタクトホールを形成する段階と；前記第4マスクを利用して第2乃至第4コンタクト電極を形成する段階とを含むことを特徴とする請求項31に記載の液晶表示装置の製造方法。
- 前記第2コンタクトホールは、前記第３薄膜トランジスターのゲート電極及びソース電極の重畳部に形成されたことを特徴とする請求項32に記載の液晶表示装置の製造方法。
- 前記第3コンタクトホールは、前記第3または第4薄膜トランジスターのドレイン電極と、前記第2薄膜トランジスターのゲート電極との重畳部に形成されたことを特徴とする請求項32に記載の液晶表示装置の製造方法。
- 前記第4コンタクトホールは、前記第4薄膜トランジスターのソース電極及びゲート電極の重なる部分に形成されたことを特徴とする請求項32に記載の液晶表示装置の製造方法。
- 前記第2コンタクト電極は、前記第2コンタクトホールを通じて前記第3薄膜トランジスターのソース電極及びゲート電極を接続させることを特徴とする請求項32に記載の液晶表示装置の製造方法。
- 前記第3コンタクト電極は、前記第3コンタクトホールを通じて前記第3または第4薄膜トランジスターのドレイン電極と、前記第2薄膜トランジスターゲート電極とを接続させることを特徴とする請求項32に記載の液晶表示装置の製造方法。
- 前記第4コンタクト電極は、前記第4コンタクトホールを通じて、前記第4薄膜トランジスターのソース電極及びゲート電極を接続させることを特徴とする請求項32に記載の液晶表示装置の製造方法。
- 前記第2乃至第4コンタクト電極は、シーリング材により密封される領域に形成されたことを特徴とする請求項32に記載の液晶表示装置の製造方法。
- 前記反射電極と前記第2乃至第4コンタクト電極は、AlNd及びMoの二重層構造で形成されたことを特徴とする請求項32に記載の液晶表示装置の製造方法。
- 前記第2絶縁膜は、エンボッシング表面を有することを特徴とする請求項19に記載の液晶表示装置の製造方法。
- 前記反射電極は、前記第２絶縁膜に対応してエンボッシング表面を有することを特徴とする請求項41に記載の液晶表示装置の製造方法。
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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Families Citing this family (36)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR101043675B1 (ko) | 2004-06-05 | 2011-06-22 | 엘지디스플레이 주식회사 | 반투과형 박막 트랜지스터 기판 및 그 제조 방법 |
| KR101057779B1 (ko) * | 2004-06-05 | 2011-08-19 | 엘지디스플레이 주식회사 | 반투과형 박막 트랜지스터 기판 및 그 제조 방법 |
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| KR20070070382A (ko) * | 2005-12-29 | 2007-07-04 | 엘지.필립스 엘시디 주식회사 | 액정 표시 장치용 어레이 기판 및 그 제조 방법 |
| KR101338613B1 (ko) * | 2006-12-28 | 2013-12-06 | 엘지디스플레이 주식회사 | 박막 트랜지스터 기판 및 그 제조방법 |
| CN101561604B (zh) * | 2008-04-17 | 2011-07-06 | 北京京东方光电科技有限公司 | 薄膜晶体管液晶显示器阵列基板结构及制造方法 |
| JP5536986B2 (ja) | 2008-04-30 | 2014-07-02 | 三菱電機株式会社 | 液晶表示装置 |
| WO2010029865A1 (en) * | 2008-09-12 | 2010-03-18 | Semiconductor Energy Laboratory Co., Ltd. | Display device |
| CN102881696A (zh) | 2008-09-19 | 2013-01-16 | 株式会社半导体能源研究所 | 显示装置 |
| WO2010032638A1 (en) * | 2008-09-19 | 2010-03-25 | Semiconductor Energy Laboratory Co., Ltd. | Display device |
| WO2010038819A1 (en) | 2008-10-03 | 2010-04-08 | Semiconductor Energy Laboratory Co., Ltd. | Display device |
| EP2172977A1 (en) | 2008-10-03 | 2010-04-07 | Semiconductor Energy Laboratory Co., Ltd. | Display device |
| TWI383232B (zh) * | 2009-03-19 | 2013-01-21 | Au Optronics Corp | 薄膜電晶體陣列基板 |
| DE102010003121A1 (de) | 2010-03-22 | 2011-09-22 | Osram Opto Semiconductors Gmbh | Organische Lichtemittierende Vorrichtung mit homogener Leuchtdichteverteilung |
| TWM406261U (en) * | 2010-12-01 | 2011-06-21 | Chunghwa Picture Tubes Ltd | Pixel structure and display panel |
| KR101833235B1 (ko) | 2011-07-14 | 2018-04-16 | 삼성디스플레이 주식회사 | 박막 트랜지스터 어레이 기판, 이를 포함하는 유기 발광 표시 장치 및 그 제조 방법 |
| CN107564967B (zh) | 2012-07-20 | 2020-10-23 | 株式会社半导体能源研究所 | 显示装置 |
| KR102368865B1 (ko) | 2012-07-20 | 2022-03-02 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 표시 장치, 및 표시 장치를 포함하는 전자 장치 |
| KR102061764B1 (ko) * | 2013-07-31 | 2020-01-03 | 엘지디스플레이 주식회사 | 정전기 방전 회로 및 이를 구비한 디스플레이 장치 |
| KR102131191B1 (ko) * | 2013-09-30 | 2020-07-08 | 엘지디스플레이 주식회사 | 프린지 필드 스위칭 모드 액정표시장치용 어레이 기판 및 이의 제조 방법 |
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| KR20150137218A (ko) * | 2014-05-28 | 2015-12-09 | 삼성디스플레이 주식회사 | 액정표시장치 및 이의 제조 방법 |
| TWI566409B (zh) * | 2014-08-26 | 2017-01-11 | 元太科技工業股份有限公司 | 電晶體及其製作方法 |
| CN104409483B (zh) * | 2014-10-16 | 2017-11-14 | 京东方科技集团股份有限公司 | 阵列基板及其制造方法、显示装置 |
| CN105070684B (zh) * | 2015-07-17 | 2018-01-05 | 京东方科技集团股份有限公司 | 阵列基板的制备方法、阵列基板及显示装置 |
| CN105070727B (zh) * | 2015-08-21 | 2019-01-15 | 京东方科技集团股份有限公司 | 一种薄膜晶体管阵列基板、其制作方法及显示装置 |
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| KR102556023B1 (ko) * | 2016-02-26 | 2023-07-17 | 삼성디스플레이 주식회사 | 감광성 박막 소자 및 이를 포함하는 생체 정보 감지 장치 |
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| JP6732829B2 (ja) * | 2018-03-29 | 2020-07-29 | 株式会社Ｊｏｌｅｄ | 半導体装置および表示装置 |
| CN109273500A (zh) * | 2018-09-21 | 2019-01-25 | 京东方科技集团股份有限公司 | 一种oled显示基板、显示装置和制作方法 |
| US10852603B2 (en) * | 2019-02-04 | 2020-12-01 | Omnivision Technologies, Inc. | LCOS pixel film layer design for reflection rate improvement |
| CN114078834A (zh) * | 2020-08-17 | 2022-02-22 | 深超光电（深圳）有限公司 | 静电防护结构、薄膜晶体管基板及显示面板 |
Family Cites Families (28)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62285464A (ja) * | 1986-06-03 | 1987-12-11 | Matsushita Electric Ind Co Ltd | 薄膜トランジスタアレイ基板及びその製造方法 |
| US5162933A (en) | 1990-05-16 | 1992-11-10 | Nippon Telegraph And Telephone Corporation | Active matrix structure for liquid crystal display elements wherein each of the gate/data lines includes at least a molybdenum-base alloy layer containing 0.5 to 10 wt. % of chromium |
| KR940004322B1 (ko) | 1991-09-05 | 1994-05-19 | 삼성전자 주식회사 | 액정표시장치 및 그 제조방법 |
| US5317433A (en) | 1991-12-02 | 1994-05-31 | Canon Kabushiki Kaisha | Image display device with a transistor on one side of insulating layer and liquid crystal on the other side |
| JPH06235939A (ja) * | 1993-02-12 | 1994-08-23 | Hitachi Ltd | 液晶表示装置及びその製造方法 |
| DE4339721C1 (de) | 1993-11-22 | 1995-02-02 | Lueder Ernst | Verfahren zur Herstellung einer Matrix aus Dünnschichttransistoren |
| JP2674516B2 (ja) * | 1994-07-21 | 1997-11-12 | 日本電気株式会社 | アクティブマトリクス基板およびその製造方法 |
| TW321731B (ja) | 1994-07-27 | 1997-12-01 | Hitachi Ltd | |
| JP2639356B2 (ja) * | 1994-09-01 | 1997-08-13 | 日本電気株式会社 | 薄膜トランジスタの製造方法 |
| JP3866783B2 (ja) | 1995-07-25 | 2007-01-10 | 株式会社 日立ディスプレイズ | 液晶表示装置 |
| KR0156202B1 (ko) | 1995-08-22 | 1998-11-16 | 구자홍 | 액정표시장치 및 그 제조방법 |
| JPH09113931A (ja) | 1995-10-16 | 1997-05-02 | Sharp Corp | 液晶表示装置 |
| JP3072707B2 (ja) * | 1995-10-31 | 2000-08-07 | インターナショナル・ビジネス・マシーンズ・コーポレ−ション | 液晶表示装置及びその製造方法 |
| JP3625598B2 (ja) | 1995-12-30 | 2005-03-02 | 三星電子株式会社 | 液晶表示装置の製造方法 |
| US6043971A (en) * | 1998-11-04 | 2000-03-28 | L.G. Philips Lcd Co., Ltd. | Electrostatic discharge protection device for liquid crystal display using a COG package |
| KR100684868B1 (ko) * | 2000-03-08 | 2007-02-20 | 삼성전자주식회사 | 반사 투과 복합형 박막트랜지스터 액정표시장치 및 그형성 방법 |
| KR100372579B1 (ko) * | 2000-06-21 | 2003-02-17 | 엘지.필립스 엘시디 주식회사 | 액정표시장치용 어레이기판과 그 제조방법 |
| JP2002107762A (ja) * | 2000-10-02 | 2002-04-10 | Sharp Corp | 液晶用マトリクス基板の製造方法 |
| US6620655B2 (en) * | 2000-11-01 | 2003-09-16 | Lg.Phillips Lcd Co., Ltd. | Array substrate for transflective LCD device and method of fabricating the same |
| KR100386849B1 (ko) * | 2001-07-10 | 2003-06-09 | 엘지.필립스 엘시디 주식회사 | 박막 트랜지스터 표시장치의 정전방전 방지회로 |
| TW508830B (en) * | 2001-08-28 | 2002-11-01 | Hannstar Display Corp | Thin film transistor structure having four procedures of mask processing and the manufacturing method |
| TW562962B (en) * | 2002-01-15 | 2003-11-21 | Chi Mei Optoelectronics Corp | Liquid crystal display device |
| KR100456151B1 (ko) * | 2002-04-17 | 2004-11-09 | 엘지.필립스 엘시디 주식회사 | 박막 트랜지스터 어레이 기판 및 그 제조 방법 |
| US6876416B2 (en) * | 2002-04-30 | 2005-04-05 | Samsung Electronics Co., Ltd. | Liquid crystal display apparatus having alignment film and method of manufacturing the same |
| US6897925B2 (en) * | 2002-07-31 | 2005-05-24 | Lg.Philips Lcd Co. Ltd. | Transflective liquid crystal display device and method for manufacturing the same |
| KR100971955B1 (ko) * | 2002-11-11 | 2010-07-23 | 엘지디스플레이 주식회사 | 액정표시장치용 어레이기판 제조방법 |
| JP4167085B2 (ja) * | 2003-02-07 | 2008-10-15 | 株式会社 日立ディスプレイズ | 液晶表示装置 |
| JP4628693B2 (ja) * | 2004-03-31 | 2011-02-09 | 富士通株式会社 | 液晶表示装置用基板及びその製造方法並びにそれを備えた液晶表示装置 |
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Cited By (4)
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|---|---|---|---|---|
| US9703157B2 (en) | 2008-10-08 | 2017-07-11 | Semiconductor Energy Laboratory Co., Ltd. | Display device |
| KR101764623B1 (ko) * | 2008-10-08 | 2017-08-03 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 |
| US9915843B2 (en) | 2008-10-08 | 2018-03-13 | Semiconductor Energy Laboratory Co., Ltd. | Display device with pixel including capacitor |
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