JP4255953B2 - 半導体装置 - Google Patents
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又、仮にプローブを当てて試験が行えたとしても、CSPは一般的に端子が多く多ピンであるため、一つ一つプローブを当てて導通試験を行うことは効率が非常に悪い。
図1は、半導体記憶装置としてのSDRAM(Synchronous Dynamic Random Access Memory)に設けられたテストモードエントリー回路の回路図である。図1において、テストモードエントリー回路は、電源投入検出回路としてのスタータ回路11、通常動作モード認識回路部12、テストモード認識回路部13及びテストモード判定回路部14を備えている。
図1において、テストモード認識回路部13は、第1モードとしての導通試験モードを検出する回路であって、本実施形態では、外部装置から出力されてくるチップセレクト信号/CS、コラムアドレスストローブ信号/CAS及びクロックイネーブル信号CKEを入力端子を介して入力し、その各信号に基づいて検出する。そして、本実施形態では、チップセレクト信号/CS、コラムアドレスストローブ信号/CAS及びクロックイネーブル信号CKEが共にLレベルの時、導通試験モードにエントリーされるものとする。
従って、ノア回路76の出力端子に接続されたインバータ回路77の出力は、テストモード信号φtsと通常動作モード検出信号φsxが共にLレベルの時、Lレベルとなる。又、インバータ回路77の出力は、テストモード信号φts及び通常動作モード検出信号φsxの少なくともいずれか一方がHレベルになると、Hレベルとなる。
従って、アクティブ電源電圧Vssは基準電圧Vrefと同じ値になるように制御されている。
(1)SDRAMに設けられたテストモードエントリー回路は、テストモード認識回路部13において、コラムアドレスストローブ信号/CAS、チップセレクト信号/CS及びクロックイネーブル信号CKEの3個の信号、即ち、3個という非常に少ない数の信号の組み合わせで導通試験モードをエントリーすることができる。
また、導通試験モード信号φtsがHレベルになる前にHレベルの通常動作モード検出信号φsxが発生した時には、導通試験モードにならないように構成した。
(2)さらに、電源投入後において他の通常コマンドより先だって外部装置から出力されるPALLコマンドを検出してHレベルの通常動作モード検出信号φsxを得るようにした。従って、導通試験モードに入る確率は極めて低くすることができ、直ちにPALLコマンド及びそれに続く種々のコマンドに基づく通常の動作を直ちに実行することができる。
○前記実施形態では、PALLコマンドが発生した時、Hレベルの検出信号φsxを得るようにしたが、これに限定されるものではなく、通常のコマンド、例えば、シングルバンクプリチャージコマンド、バンクアクティブコマンド、モードレジスタセットコマンド、リフレッシュコマンド、リードコマンド、ライトコマンド等の各種の通常コマンドを用いてもよい。特に、電源立ち上げ後により早く出力されるコマンドがより効果的である。
12 通常動作モード認識回路部
13 テストモード認識回路部
14 テストモード判定回路部
75 アクティブ電源発生回路
φts テストモード信号
φ1 テストモード検出信号
φsx 通常動作モード検出信号
Claims (2)
- 外部コマンドに応答してテストモードを検出するテストモード認識部と、
前記外部コマンドに応答して前記テストモードとは異なる通常動作モードを検出する通常動作モード認識部を含み、
電源投入信号によりテストモードへのエントリーを保持するラッチ回路が初期セットされ、その初期セットした状態で前記テストモード認識部が一旦前記テストモードを検出した場合には前記ラッチ回路を初期セットした状態から反転し保持してテストモード信号を出力し、前記テストモード信号の出力後は前記テストモードの検出にかかわらず前記テストモード信号の出力を禁止し、前記初期セットした状態で前記通常動作モード認識部が一旦前記通常動作モードを検出した場合には以降前記テストモードの検出にかかわらずテストモード信号の出力を禁止するテストモードエントリー回路
を有することを特徴とする半導体装置。 - 外部信号の特定の論理レベルに応答してテストモード検出信号を出力し、次いで前記外部信号の論理レベルに応答して前記テストモード検出信号の出力を停止するための信号を出力するテストモード認識部と、
特定の外部コマンドに応答して通常動作モード信号を出力する通常動作モード認識部と、
前記テストモード検出信号と、前記テストモード検出信号の出力を停止するための信号および前記通常動作モード信号を入力するモード判定部とを有し、
当該モード判定部は、前記テストモード検出信号の出力が一旦検出されると前記テストモード検出信号の出力を停止するための信号により、また前記通常動作モード信号の出力が一旦検出されると前記通常動作モード信号により前記テストモード検出信号の出力停止状態を維持するテストモードエントリー回路
を有することを特徴とする半導体装置。
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