JP3464229B2 - テレビジョン受信機におけるビデオ信号への制御機能の同期化方法およびその装置 - Google Patents
テレビジョン受信機におけるビデオ信号への制御機能の同期化方法およびその装置Info
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- H04N5/765—Interface circuits between an apparatus for recording and another apparatus
Description
【０００１】
【産業上の利用分野】本発明はテレビジョン受信機にお
けるビデオ信号への制御機能の同期化のための方法およ
びこの方法の実行のための装置に関する。
けるビデオ信号への制御機能の同期化のための方法およ
びこの方法の実行のための装置に関する。
【０００２】テレビジョン受信機は長い間アンテナが受
信した画像を再生するために用いられる器具であり、新
しい画像を修正したりあるいは発生したりするのには決
して用いることができない器具とされてきた。この立場
は、集積回路の出現およびデータ伝送システムすなわち
テレテキストシステムの発生とともに変化し始めてい
る。今日では、テレビジョンセットは単にテレテキスト
ページのみならずメニューの表示にも用いられる。メニ
ューはテレビジョンセットの会話形制御を可能にする要
素であり、ユーザの命令は遠隔制御ユニットによりテレ
ビジョンセットに送信される。
信した画像を再生するために用いられる器具であり、新
しい画像を修正したりあるいは発生したりするのには決
して用いることができない器具とされてきた。この立場
は、集積回路の出現およびデータ伝送システムすなわち
テレテキストシステムの発生とともに変化し始めてい
る。今日では、テレビジョンセットは単にテレテキスト
ページのみならずメニューの表示にも用いられる。メニ
ューはテレビジョンセットの会話形制御を可能にする要
素であり、ユーザの命令は遠隔制御ユニットによりテレ
ビジョンセットに送信される。
【０００３】テキストのページ表示を促す命令あるいは
制御はユーザにその命令から生ずる動作を伝え、あるい
はユーザに次の選択を助言する。
制御はユーザにその命令から生ずる動作を伝え、あるい
はユーザに次の選択を助言する。
【０００４】新しいＤ２−ＭＡＣパケット標準はこれら
文字発生器の斬新的適用を可能にする。というのは、こ
れはディジタル形式でサブタイトルを伝送する可能性お
よび受信機から表示装置を制御する可能性を提供する。
従って、自分のテレビジョンセットによりユーザは今で
は場合によってテレテキストのページ、サブタイトル、
あるいはメニューを表示する画像発生器を好きなように
処理できる。このリストは完全なものではなく、将来は
もっと長くなるであろう。
文字発生器の斬新的適用を可能にする。というのは、こ
れはディジタル形式でサブタイトルを伝送する可能性お
よび受信機から表示装置を制御する可能性を提供する。
従って、自分のテレビジョンセットによりユーザは今で
は場合によってテレテキストのページ、サブタイトル、
あるいはメニューを表示する画像発生器を好きなように
処理できる。このリストは完全なものではなく、将来は
もっと長くなるであろう。
【０００５】近年中に、ほとんどのテレビジョンセット
はテレビジョン画面上にメニューを表示することを可能
にする文字発生器を含むことになるであろう。この方法
の利点は、それが制御機能のコストを低減し一方同時に
遠隔制御ユニットの押しボタンの数を減らすことにより
テレビジョンの信頼性を改善することである。
はテレビジョン画面上にメニューを表示することを可能
にする文字発生器を含むことになるであろう。この方法
の利点は、それが制御機能のコストを低減し一方同時に
遠隔制御ユニットの押しボタンの数を減らすことにより
テレビジョンの信頼性を改善することである。
【０００６】
【従来の技術およびその課題】通常の場合に対応するテ
レビジョンセットの構成を図１に示す。
レビジョンセットの構成を図１に示す。
【０００７】図１のブロック図で、アンテナ１は中間周
波数受信および増幅回路２に接続されている。回路２の
復調された出力はビデオカセットレコーダ３およびスイ
ッチ４の入力側に接続される。スイッチ４の他の入力は
ビデオカセットレコーダ３の出力に接続されている。ス
イッチ４の出力は２個の処理チャネルに接続されてい
る。これらチャネルの一番目はクロミナンスデコーダ５
およびＲＧＢマトリックス６を有する。二番目のチャネ
ルはデータ分離器７（すなわちテレテキストデータのよ
うなデータ）および記憶装置８Ａと関連がある文字発生
器８を有している。文字発生器８は、遠隔制御ボックス
１０と協同して作動する（一般には赤外線）、マイクロ
コントローラ９により制御される。回路６および８のＲ
ＧＢ出力はそれぞれスイッチ１１の入力に接続されてお
り、スイッチ１１に続いてビデオ増幅器１２および陰極
管１３がある。スイッチ１１は文字発生器８により制御
される。
波数受信および増幅回路２に接続されている。回路２の
復調された出力はビデオカセットレコーダ３およびスイ
ッチ４の入力側に接続される。スイッチ４の他の入力は
ビデオカセットレコーダ３の出力に接続されている。ス
イッチ４の出力は２個の処理チャネルに接続されてい
る。これらチャネルの一番目はクロミナンスデコーダ５
およびＲＧＢマトリックス６を有する。二番目のチャネ
ルはデータ分離器７（すなわちテレテキストデータのよ
うなデータ）および記憶装置８Ａと関連がある文字発生
器８を有している。文字発生器８は、遠隔制御ボックス
１０と協同して作動する（一般には赤外線）、マイクロ
コントローラ９により制御される。回路６および８のＲ
ＧＢ出力はそれぞれスイッチ１１の入力に接続されてお
り、スイッチ１１に続いてビデオ増幅器１２および陰極
管１３がある。スイッチ１１は文字発生器８により制御
される。
【０００８】かかるシステムでは、ビデオカセットレコ
ーダは決して文字発生器の出力を記録することはしない
こが分る。このアーキテクチャはＤ２−ＭＡＣパケット
デコーダを用いる時には使われないことは明白である。
事実、この場合は、サブタイトルが存在する時はそれを
記録することが不可欠である。
ーダは決して文字発生器の出力を記録することはしない
こが分る。このアーキテクチャはＤ２−ＭＡＣパケット
デコーダを用いる時には使われないことは明白である。
事実、この場合は、サブタイトルが存在する時はそれを
記録することが不可欠である。
【０００９】図２のブロック図では、図１の構成要素と
同じ構成要素には、同じ参照番号が割り当てられてい
る。図２のテレビジョンセットのアンテナ１はまず第１
に、最初の中間出力周波数チューナ２Ａに接続され、こ
のチューナは振幅変調チャネルと関係し、また圧縮した
側波帯を有している。
同じ構成要素には、同じ参照番号が割り当てられてい
る。図２のテレビジョンセットのアンテナ１はまず第１
に、最初の中間出力周波数チューナ２Ａに接続され、こ
のチューナは振幅変調チャネルと関係し、また圧縮した
側波帯を有している。
【００１０】アンテナ１は更に第２の中間周波数チュー
ナ２Ｂに接続され、このチューナは周波数Ｄ２−ＭＡＣ
変調チャネルに関係している。
ナ２Ｂに接続され、このチューナは周波数Ｄ２−ＭＡＣ
変調チャネルに関係している。
【００１１】チューナ２Ａの出力は３個の入力をもつス
イッチ４Ａの第１入力に接続され、またビデオカセット
レコーダ３の入力に接続される。ビデオカセットレコー
ダの出力はスイッチ４Ａの第２入力に接続される。スイ
ッチの第３入力はチューナ２ＢのＣＶＢＳ（複合ビデオ
ベースバンド信号）出力に接続される。スイッチ４Ａに
続くのは、まず第１は回路５，６，１１および１２であ
り、次は回路７および８である。スイッチ１４は、回路
８と回路１１との間に置かれている。発生器８は遠隔制
御ユニット１０と協同するマイクロプロセッサ９により
制御される。
イッチ４Ａの第１入力に接続され、またビデオカセット
レコーダ３の入力に接続される。ビデオカセットレコー
ダの出力はスイッチ４Ａの第２入力に接続される。スイ
ッチの第３入力はチューナ２ＢのＣＶＢＳ（複合ビデオ
ベースバンド信号）出力に接続される。スイッチ４Ａに
続くのは、まず第１は回路５，６，１１および１２であ
り、次は回路７および８である。スイッチ１４は、回路
８と回路１１との間に置かれている。発生器８は遠隔制
御ユニット１０と協同するマイクロプロセッサ９により
制御される。
【００１２】チューナ２ＢのＤ２−ＭＡＣ出力からの下
流には、ＭＡＣデコーダ１５、データ分離器１６、文字
発生器１７、およびスイッチ１８がそれぞれ接続され、
スイッチ１８のもう１個の入力はデコーダ１５に接続さ
れ、このスイッチは記憶装置１７Ａが関係している発生
器１７により制御されている。スイッチ１８の出力はス
イッチ１４の入力側およびＰＡＬコーダ１９に接続され
ており、ＰＡＬコーダの出力はビデオカセットレコーダ
３に接続されている。発生器８の出力はＯＲゲートの使
用していない入力に接続され、ＯＲゲートのもう一方の
入力はチューナ２ＢからのＤ２−ＭＡＣ信号を受信す
る。これらＤ２−ＭＡＣ信号はまたスイッチ１４も制御
する。
流には、ＭＡＣデコーダ１５、データ分離器１６、文字
発生器１７、およびスイッチ１８がそれぞれ接続され、
スイッチ１８のもう１個の入力はデコーダ１５に接続さ
れ、このスイッチは記憶装置１７Ａが関係している発生
器１７により制御されている。スイッチ１８の出力はス
イッチ１４の入力側およびＰＡＬコーダ１９に接続され
ており、ＰＡＬコーダの出力はビデオカセットレコーダ
３に接続されている。発生器８の出力はＯＲゲートの使
用していない入力に接続され、ＯＲゲートのもう一方の
入力はチューナ２ＢからのＤ２−ＭＡＣ信号を受信す
る。これらＤ２−ＭＡＣ信号はまたスイッチ１４も制御
する。
【００１３】かくして、図２の装置では、Ｄ２−ＭＡＣ
デコーダ１５と関連する文字発生器１７は独立したサブ
アセンブリとして設計されていることが分る。この場
合、テレビジョンセットは２個の文字発生器８および１
７を有しており、とりわけ１個の文字発生器１７はサブ
タイトルのみのために使用されている。ＰＡＬエンコー
ダに接続されるビデオカセットレコーダはサブタイトル
のみを記録し、メニュー（これは文字発生器８で作成す
る）は記録しない。この方法の主な欠点はそのコストで
ある。というのは２個の文字発生器を用いることが必要
である。
デコーダ１５と関連する文字発生器１７は独立したサブ
アセンブリとして設計されていることが分る。この場
合、テレビジョンセットは２個の文字発生器８および１
７を有しており、とりわけ１個の文字発生器１７はサブ
タイトルのみのために使用されている。ＰＡＬエンコー
ダに接続されるビデオカセットレコーダはサブタイトル
のみを記録し、メニュー（これは文字発生器８で作成す
る）は記録しない。この方法の主な欠点はそのコストで
ある。というのは２個の文字発生器を用いることが必要
である。
【００１４】より経済的な方法は、INTERMETALL EPのデ
ィジタル集積回路を使用する。そのアーキテクチャはＤ
２−ＭＡＣ回路と文字発生器が全装置の基本構成要素を
生ずるように設計されてきた。
ィジタル集積回路を使用する。そのアーキテクチャはＤ
２−ＭＡＣ回路と文字発生器が全装置の基本構成要素を
生ずるように設計されてきた。
【００１５】図３はこの方法の新しい回路を示すもので
ある。図示していない他の回路として、Ｄ２−ＭＡＣお
よびＣＶＢＳ信号を与える上流（特に中間周波数チュー
ナ）に接続される回路および下流（ＲＧＢビデオ信号を
受信するビデオ回路）に接続される回路とがある。
ある。図示していない他の回路として、Ｄ２−ＭＡＣお
よびＣＶＢＳ信号を与える上流（特に中間周波数チュー
ナ）に接続される回路および下流（ＲＧＢビデオ信号を
受信するビデオ回路）に接続される回路とがある。
【００１６】図３のこの装置にはアナログ／ディジタル
変換器２１、その出力バス２２に接続されるテレビジョ
ンセット陰極管の走査プロセッサ２３、ビデオプロセッ
サ２４、ＭＡＣデコーダ２５、およびＣＶＢＳデータ分
離器２６が含まれる。回路２４および２５の出力バスは
ディジタル／アナログ変換器２７に接続される。デコー
ダ２５はＭＡＣデータ分離器２８に接続され、分離器そ
れ自体はデータ発生器２９に接続される。この発生器２
９はＣＶＢＳ分離器２６にも接続されている。発生器２
９の出力は変換器２７に接続される。変換器２７のＲＧ
Ｂアナログ出力はまず第１にテレビジョンセットのビデ
オ回路（図示していない）に接続され、次にＲＡＬエン
コーダであるエンコーダ３０に接続される。エンコーダ
３０の出力はビデオカセットレコーダ３１に接続され
る。
変換器２１、その出力バス２２に接続されるテレビジョ
ンセット陰極管の走査プロセッサ２３、ビデオプロセッ
サ２４、ＭＡＣデコーダ２５、およびＣＶＢＳデータ分
離器２６が含まれる。回路２４および２５の出力バスは
ディジタル／アナログ変換器２７に接続される。デコー
ダ２５はＭＡＣデータ分離器２８に接続され、分離器そ
れ自体はデータ発生器２９に接続される。この発生器２
９はＣＶＢＳ分離器２６にも接続されている。発生器２
９の出力は変換器２７に接続される。変換器２７のＲＧ
Ｂアナログ出力はまず第１にテレビジョンセットのビデ
オ回路（図示していない）に接続され、次にＲＡＬエン
コーダであるエンコーダ３０に接続される。エンコーダ
３０の出力はビデオカセットレコーダ３１に接続され
る。
【００１７】従って、図３のこの回路では、ただ１個の
文字発生器のみを用いることが可能である。しかし、サ
ブタイトルに対応する文字と、メニューに対応する文字
とを識別することは不可能になり、ユーザがそのビデオ
カセットレコーダにメニューを記録しようと欲するかど
うかには疑問がある。
文字発生器のみを用いることが可能である。しかし、サ
ブタイトルに対応する文字と、メニューに対応する文字
とを識別することは不可能になり、ユーザがそのビデオ
カセットレコーダにメニューを記録しようと欲するかど
うかには疑問がある。
【００１８】
【課題を解決するための手段】本発明の目的はメニュー
記録の抑止のようないくつかの機能を、テレビジョン受
信機において制御可能にする方法、及びいくつかの異な
る機能にさえも実行が簡単で、かつ受信機の画面上に表
示されるビデオ信号と同期して実行できる方法を提供す
ることである。
記録の抑止のようないくつかの機能を、テレビジョン受
信機において制御可能にする方法、及びいくつかの異な
る機能にさえも実行が簡単で、かつ受信機の画面上に表
示されるビデオ信号と同期して実行できる方法を提供す
ることである。
【００１９】本発明の目的はまた、この方法を実行する
ための装置、とりわけ、特にメニューおよびサブタイト
ルを発生する文字発生器１個のみの使用とすることで安
価な画像合成装置を提供することである。
ための装置、とりわけ、特にメニューおよびサブタイト
ルを発生する文字発生器１個のみの使用とすることで安
価な画像合成装置を提供することである。
【００２０】本発明による方法はＰビットにディジタル
化したビデオ信号を基礎にしており、挿入制御（または
命令）ビットはこのＰビットと関連している。ここでＬ
ビットがＰ＋１ビットに加えられ、ＰとＬは≧１であ
る。Ｌビットは受信機の画面上に表示される信号と同期
した命令に対応する。この方法の一面に従い、これらＬ
ビットの少くとも一個はビデオ信号の少くとも一部分の
記録を制御するのに用いられる。これらビデオ信号は受
信機と関連する発生器により生成される合成信号を含ん
でいる可能性がある。
化したビデオ信号を基礎にしており、挿入制御（または
命令）ビットはこのＰビットと関連している。ここでＬ
ビットがＰ＋１ビットに加えられ、ＰとＬは≧１であ
る。Ｌビットは受信機の画面上に表示される信号と同期
した命令に対応する。この方法の一面に従い、これらＬ
ビットの少くとも一個はビデオ信号の少くとも一部分の
記録を制御するのに用いられる。これらビデオ信号は受
信機と関連する発生器により生成される合成信号を含ん
でいる可能性がある。
【００２１】本発明による装置はビデオ信号の発生器、
たとえば文字発生器、に関連する記憶装置を含む。ここ
で記憶装置には、ビデオ信号と同期されなければならな
い機能の制御のための装置に接続される少くとも一個の
入出力を含み、またここで記憶装置はビデオ信号の垂直
および水平パルスを受信する行カウンタ、列カウンタに
よりアドレス指定される。本発明の実施例に従って、少
くとも一個の入出力ワイヤは合成信号発生器、例えば文
字発生器に接続され、かつ記録装置の記録命令に接続さ
れる。
たとえば文字発生器、に関連する記憶装置を含む。ここ
で記憶装置には、ビデオ信号と同期されなければならな
い機能の制御のための装置に接続される少くとも一個の
入出力を含み、またここで記憶装置はビデオ信号の垂直
および水平パルスを受信する行カウンタ、列カウンタに
よりアドレス指定される。本発明の実施例に従って、少
くとも一個の入出力ワイヤは合成信号発生器、例えば文
字発生器に接続され、かつ記録装置の記録命令に接続さ
れる。
【００２２】
【実施例】本発明は一般に用いられている文字発生器
（例えば回路ＴＰＵ２７３３）を基礎にしている。ビデ
オ信号にこの文字発生器の出力信号の挿入はいわゆる
「高速空白化」信号によって確認される。本発明ではこ
の文字発生器を使用して記録機能を制御するために少く
とも１個の第２の「高速空白化」信号をそれに与える。
これらの付加信号は表示された画像と同期する少くとも
１個の挿入ウィンドウの作成を可能とする。
（例えば回路ＴＰＵ２７３３）を基礎にしている。ビデ
オ信号にこの文字発生器の出力信号の挿入はいわゆる
「高速空白化」信号によって確認される。本発明ではこ
の文字発生器を使用して記録機能を制御するために少く
とも１個の第２の「高速空白化」信号をそれに与える。
これらの付加信号は表示された画像と同期する少くとも
１個の挿入ウィンドウの作成を可能とする。
【００２３】これらのような付加信号の作成には文字発
生器によって作成される文字の画面上表示に対し「それ
自体」よく知られている技法を利用する。
生器によって作成される文字の画面上表示に対し「それ
自体」よく知られている技法を利用する。
【００２４】第１の方法は表示さるべき画像が格納され
ている記憶装置を使用することにある。各文字または画
面の各画素は１個以上の２進数で表わされる。画像の各
主構成要素に１ビットのみが割り当てられるなら（赤、
緑、青）、画像の各画素には３ビットが使用される。既
知の技法に従って、付加のビットが通常用いられる「挿
入制御」（又は挿入命令）情報を作成するために各画素
に割り当てられる。本発明により、その情報がビデオカ
セットレコーダに記録されるべきかどうかを指示するた
めに、第５ビットが第２の挿入制御を作成するための各
画素に付加される。これら制御または命令はビデオ連鎖
から受信せよという命令に基づいて、文字発生器８と関
連し、またその文字発生器と記憶装置が関連している。
文字発生器は低周波数で記憶装置３２へ書き込むが（表
示されるべきテキストが修正されなければならない時に
限る）、記憶装置の読み取りはビデオ周波数で行われ
る。画面上テキストの位置は水平および垂直の同期信号
によって定められる。実際には、この実施例は各集積回
路の物理構造に関係している。もしテレテキスト文字の
標準発生器を考えるならば、テキストの１ページは各々
４０文字の３５行で表わされ、各レターは１バイトで定
義される。従って１キロバイトの記憶装置が１ページの
文字を表わすのに必要である。各バイトは厳密な意味で
の文字発生器により文字に変換される。一般に、行はチ
ップ上バッファメモリー内のページメモリーに転送され
る。このバッファメモリーは実時間で文字発生器をフィ
ードしこの文字発生器がビデオ信号Ｒ，Ｇ，Ｂを与え
る。
ている記憶装置を使用することにある。各文字または画
面の各画素は１個以上の２進数で表わされる。画像の各
主構成要素に１ビットのみが割り当てられるなら（赤、
緑、青）、画像の各画素には３ビットが使用される。既
知の技法に従って、付加のビットが通常用いられる「挿
入制御」（又は挿入命令）情報を作成するために各画素
に割り当てられる。本発明により、その情報がビデオカ
セットレコーダに記録されるべきかどうかを指示するた
めに、第５ビットが第２の挿入制御を作成するための各
画素に付加される。これら制御または命令はビデオ連鎖
から受信せよという命令に基づいて、文字発生器８と関
連し、またその文字発生器と記憶装置が関連している。
文字発生器は低周波数で記憶装置３２へ書き込むが（表
示されるべきテキストが修正されなければならない時に
限る）、記憶装置の読み取りはビデオ周波数で行われ
る。画面上テキストの位置は水平および垂直の同期信号
によって定められる。実際には、この実施例は各集積回
路の物理構造に関係している。もしテレテキスト文字の
標準発生器を考えるならば、テキストの１ページは各々
４０文字の３５行で表わされ、各レターは１バイトで定
義される。従って１キロバイトの記憶装置が１ページの
文字を表わすのに必要である。各バイトは厳密な意味で
の文字発生器により文字に変換される。一般に、行はチ
ップ上バッファメモリー内のページメモリーに転送され
る。このバッファメモリーは実時間で文字発生器をフィ
ードしこの文字発生器がビデオ信号Ｒ，Ｇ，Ｂを与え
る。
【００２５】挿入制御信号は異なる方法で準備すること
も可能である。一つの方法は挿入信号が活動状態にある
ことを報告するために１文字を表わすバイトの１ビット
を使用することにある。第２ビットの使用がそれ故に第
２の独立な挿入信号の供給を可能にする。表わすことが
できる文字の数の減少を防ぐために、文字を表わすバイ
トを８〜１０ビットに拡張することも可能である。挿入
信号を定義する別の方法は１個の挿入始めアドレスと１
個の挿入終わりアドレスを定義することにある。もし記
憶装置が４０文字の２５行で編成されているならば、こ
の方法では比較器と、各挿入信号に対し、関連している
行カウンタおよび列カウンタを使用するであろう。
も可能である。一つの方法は挿入信号が活動状態にある
ことを報告するために１文字を表わすバイトの１ビット
を使用することにある。第２ビットの使用がそれ故に第
２の独立な挿入信号の供給を可能にする。表わすことが
できる文字の数の減少を防ぐために、文字を表わすバイ
トを８〜１０ビットに拡張することも可能である。挿入
信号を定義する別の方法は１個の挿入始めアドレスと１
個の挿入終わりアドレスを定義することにある。もし記
憶装置が４０文字の２５行で編成されているならば、こ
の方法では比較器と、各挿入信号に対し、関連している
行カウンタおよび列カウンタを使用するであろう。
【００２６】図４は５個のメモリー「ページ」Ｐ１〜Ｐ
５を示している。これらページの各々は１フレームの容
量を有している。表現の便宜上、各ページはＭ列、Ｎ行
の直交行列の形をとり、１行当りＭ画素でＮ行を有する
画面画像に対応させる。最初の３ページＰ１〜Ｐ３はそ
れぞれ各フレームの画素の構成要素Ｒ，Ｇ，Ｂに対応す
る。第４ページＰ４は各フレームの各画素に対し、通常
の挿入制御（ただ１ビット上で「イエス」又は「ノ
ー」）を記憶する。第５ページＰ５は、各フレームの各
画素に対し、ビデオカセットレコーダの対応する画素の
記録又は非記録に関し１ビット上で命令を記憶する。当
然、これら「ページ」Ｐ１〜Ｐ４は物理的にははっきり
分けられず、その各々がフレームのランダムアクセスメ
モリーのＭ×Ｎアドレスに対応する。また他の機能、た
とえば問題のビデオカセットレコーダ以外の装置への記
録、警報、特殊効果等を実施するためにより多くの数の
付加「ページ」Ｐ６，Ｐ７，…を実行することが可能な
ことも明らかである。
５を示している。これらページの各々は１フレームの容
量を有している。表現の便宜上、各ページはＭ列、Ｎ行
の直交行列の形をとり、１行当りＭ画素でＮ行を有する
画面画像に対応させる。最初の３ページＰ１〜Ｐ３はそ
れぞれ各フレームの画素の構成要素Ｒ，Ｇ，Ｂに対応す
る。第４ページＰ４は各フレームの各画素に対し、通常
の挿入制御（ただ１ビット上で「イエス」又は「ノ
ー」）を記憶する。第５ページＰ５は、各フレームの各
画素に対し、ビデオカセットレコーダの対応する画素の
記録又は非記録に関し１ビット上で命令を記憶する。当
然、これら「ページ」Ｐ１〜Ｐ４は物理的にははっきり
分けられず、その各々がフレームのランダムアクセスメ
モリーのＭ×Ｎアドレスに対応する。また他の機能、た
とえば問題のビデオカセットレコーダ以外の装置への記
録、警報、特殊効果等を実施するためにより多くの数の
付加「ページ」Ｐ６，Ｐ７，…を実行することが可能な
ことも明らかである。
【００２７】図５は本発明の一実施例のブロック図を示
す。この回路の記憶装置は受信機の単一の文字発生器に
接続されているか、あるいはこの発生器を含む集積回路
の一部を形成している。この文字発生器はメニュー用お
よび記録しなればならないサブタイトル用の双方に対す
る文字を作成する。
す。この回路の記憶装置は受信機の単一の文字発生器に
接続されているか、あるいはこの発生器を含む集積回路
の一部を形成している。この文字発生器はメニュー用お
よび記録しなればならないサブタイトル用の双方に対す
る文字を作成する。
【００２８】図５の回路は入力Ｉにおいて、表示しよう
とするまたもし必要なら記録しようとする文字を受信す
る記憶装置３２を有している。現在用いられているもの
のような記憶装置の入出力は一般には１個で同じユニッ
トであるが、図では説明を明確にするために分けて示し
てある。記憶装置３２はＰ個の同一「ページ」で構成さ
れ、そのおのおのがビデオ画像のＮ行、Ｍ列の画素に対
応するＮ「行」、Ｍ「列」よりなる。従って、この記憶
装置は平行に置かれ、かつそれぞれが少くともＭ×Ｎビ
ットを記憶する能力をもつＰ個の同一回路で構成されて
いるが、あるいはＭ×Ｎアドレスにより、少くともＰ出
力ビットを有する１個の記憶装置であってもよい。ここ
では上に規定される通り、Ｐは少くとも１に等しい。
とするまたもし必要なら記録しようとする文字を受信す
る記憶装置３２を有している。現在用いられているもの
のような記憶装置の入出力は一般には１個で同じユニッ
トであるが、図では説明を明確にするために分けて示し
てある。記憶装置３２はＰ個の同一「ページ」で構成さ
れ、そのおのおのがビデオ画像のＮ行、Ｍ列の画素に対
応するＮ「行」、Ｍ「列」よりなる。従って、この記憶
装置は平行に置かれ、かつそれぞれが少くともＭ×Ｎビ
ットを記憶する能力をもつＰ個の同一回路で構成されて
いるが、あるいはＭ×Ｎアドレスにより、少くともＰ出
力ビットを有する１個の記憶装置であってもよい。ここ
では上に規定される通り、Ｐは少くとも１に等しい。
【００２９】記憶装置３２は行カウンタ３３と列カウン
タ３４によりアドレス指定される。さらに、文字発生器
８を通してＤ２−ＭＡＣパケットデコーダの場合には、
記憶装置３２の出力Ｏはもしサブタイトルがあればそれ
を記録するためにデータ分離器（図１の分離器７）から
来る命令信号を受信する。
タ３４によりアドレス指定される。さらに、文字発生器
８を通してＤ２−ＭＡＣパケットデコーダの場合には、
記憶装置３２の出力Ｏはもしサブタイトルがあればそれ
を記録するためにデータ分離器（図１の分離器７）から
来る命令信号を受信する。
【００３０】受信機の画面上に表示する画像と同期しな
ければならない別の種類の機能の計画があれば記憶装置
３２のセルの容量、入力Ｉおよび出力Ｏのビット数、な
らびに復号回路の容量（以下に述べる回路３５）におい
て相関的に増加が行われる。
ければならない別の種類の機能の計画があれば記憶装置
３２のセルの容量、入力Ｉおよび出力Ｏのビット数、な
らびに復号回路の容量（以下に述べる回路３５）におい
て相関的に増加が行われる。
【００３１】入力Ｉに送信される命令は個々のワイヤで
独立に伝送するか、あるいは同一ワイヤに多重化（時分
割多重方式または１個かつ同一搬送波の異なる変調）し
て伝送される。
独立に伝送するか、あるいは同一ワイヤに多重化（時分
割多重方式または１個かつ同一搬送波の異なる変調）し
て伝送される。
【００３２】カウンタ３３のリセット入力ＲＥＳＥＴは
ビデオ信号の垂直同期信号Ｖsyncを受信し、またそのカ
ウント入力はビデオ信号の水平同期信号Ｈsyncを受信す
る。この信号Ｈsyncはまたカウンタ３４のリセット入力
ＲＥＳＥＴにも送信され、カウンタ３４のカウント入力
は画素クロック信号ＨＰ、すなわち画素の周波数で現れ
る同期信号を受信する。Ｖsync，Ｈsync，ＨＰの信号が
通常の方法で得られる。
ビデオ信号の垂直同期信号Ｖsyncを受信し、またそのカ
ウント入力はビデオ信号の水平同期信号Ｈsyncを受信す
る。この信号Ｈsyncはまたカウンタ３４のリセット入力
ＲＥＳＥＴにも送信され、カウンタ３４のカウント入力
は画素クロック信号ＨＰ、すなわち画素の周波数で現れ
る同期信号を受信する。Ｖsync，Ｈsync，ＨＰの信号が
通常の方法で得られる。
【００３３】記憶装置３２の読取り出力Ｏ（Ｐビット）
は復号回路３５に接続される。この回路３５は記憶装置
３２の出力Ｐにくる別の信号を分離する単純なバッファ
回路であってもよい。これらの信号は当然、ビデオ信号
のＲＧＢ構成要素、ページＰ４に記憶され、サブタイト
ルおよび／またはメニュー（重ね書きによる）の受信機
画面上表示に対する命令ＣＶ、およびサブタイトル（メ
ニューではない）のビデオカセットレコーダへの記録を
起動する本発明による記録命令ＣＥである。従って、も
し記憶装置３２の「ページ」数が５より大であれば、回
路３５は出力ＣＥと類似の他の付加出力を有する。再度
当然のことながら、もし１個以上の２進数が画像の各主
要構成要素（Ｒ，Ｇ，Ｂ）に割り当てられるならば、回
路３５は出力ＲＧＢと一致し、対応する数の出力を有す
る。
は復号回路３５に接続される。この回路３５は記憶装置
３２の出力Ｐにくる別の信号を分離する単純なバッファ
回路であってもよい。これらの信号は当然、ビデオ信号
のＲＧＢ構成要素、ページＰ４に記憶され、サブタイト
ルおよび／またはメニュー（重ね書きによる）の受信機
画面上表示に対する命令ＣＶ、およびサブタイトル（メ
ニューではない）のビデオカセットレコーダへの記録を
起動する本発明による記録命令ＣＥである。従って、も
し記憶装置３２の「ページ」数が５より大であれば、回
路３５は出力ＣＥと類似の他の付加出力を有する。再度
当然のことながら、もし１個以上の２進数が画像の各主
要構成要素（Ｒ，Ｇ，Ｂ）に割り当てられるならば、回
路３５は出力ＲＧＢと一致し、対応する数の出力を有す
る。
【００３４】ビデオ画像ＲＧＢは記憶装置３２のすべて
のワードを逐次読取ることにより作成される。列カウン
タ３４は画素クロックにより増分し、Ｈsyncにより、す
なわち各行の終わりにゼロ設定される。このカウンタは
従って、記憶装置の行走査を制御している。信号Ｈsync
は記憶装置の垂直走査を規定する行カウンタ３３のクロ
ックとしても用いられ、Ｖsyncによりすなわち各フレー
ムの終わりにリセットされる。
のワードを逐次読取ることにより作成される。列カウン
タ３４は画素クロックにより増分し、Ｈsyncにより、す
なわち各行の終わりにゼロ設定される。このカウンタは
従って、記憶装置の行走査を制御している。信号Ｈsync
は記憶装置の垂直走査を規定する行カウンタ３３のクロ
ックとしても用いられ、Ｖsyncによりすなわち各フレー
ムの終わりにリセットされる。
【００３５】本発明の経済的変形として、記憶装置３２
の代わりに、制限された規模の記憶装置が用いられる。
一例としてその読取りをＨsyncおよびＶsyncにより制御
し、かつその出力ビット数が常にＰ＋１＋Ｌに等しいよ
うな一部の画素の記憶に減らす例がある。この場合に
は、これら２個の行の垂直位置は行カウンタにより定義
され、行カウンタの状態は適当な論理回路により復号さ
れる。この論理回路の作成は当業者にとっては自明であ
る。
の代わりに、制限された規模の記憶装置が用いられる。
一例としてその読取りをＨsyncおよびＶsyncにより制御
し、かつその出力ビット数が常にＰ＋１＋Ｌに等しいよ
うな一部の画素の記憶に減らす例がある。この場合に
は、これら２個の行の垂直位置は行カウンタにより定義
され、行カウンタの状態は適当な論理回路により復号さ
れる。この論理回路の作成は当業者にとっては自明であ
る。
【図１】通常のテレビジョンセットのブロック図。
【図２】別のテレビジョンセットのブロック図。
【図３】従来の装置を示すブロック図。
【図４】Ｒ，Ｇ，Ｂおよび挿入ページを示す図。
【図５】本発明による装置のブロック図。
１ アンテナ
２，２Ａ，２Ｂ 中間周波数チューナ
３，３１ ビデオカセットレコーダ
４，４Ａ，１１，１４，１８ スイッチ
５ クロミナンスデコーダ
６ ＲＧＢマトリックス
７，１６ データ分離器
８，１７ 文字発生器
８Ａ，１７Ａ，３２ 記憶装置
９ マイクロコントローラ
１０ 遠隔制御ボックス
１２ ビデオ増幅器
１３ 陰極管
１５ Ｄ２−ＭＡＣデコーダ
１９ ＰＡＬコーダ
２０ ＯＲゲート
２１ アナログ／ディジタル変換器
２２ 出力バス
２３ 走査プロセッサ
２４ ビデオプロセッサ
２５ ＭＡＣデコーダ
２６ ＣＶＢＳデータ分離器
２７ ディジタル／アナログ変換器
２８ ＭＡＣデータ分離器
２９ データ発生器
３０ エンコーダ
３３ 行カウンタ
３４ 列カウンタ
３５ 復号回路
─────────────────────────────────────────────────────
フロントページの続き
(58)調査した分野(Int.Cl.7，ＤＢ名)
H04N 5/04
H04N 5/445
H04N 5/66
H04N 9/00
Claims (4)
- 【請求項１】挿入制御機能を受像機におけるビデオ信号
と同期化する方法であって、 ビデオ画像の少なくとも一部の画素群を画定するデータ
であって、各画素がＰビットに符号化されたデータを供
給するステップと、 前記データを走査して第１のビデオ信号を供給するステ
ップと、 挿入制御ビットを前記Ｐビット画素と組み合わせてＰ＋
１ビットを形成し、前記挿入制御ビットは前記第１のビ
デオ信号上で行われる前記挿入制御機能を制御するステ
ップと、 前記Ｐ＋１ビットにＬビットを付加するステップとをそ
なえ、 挿入制御機能を受像機におけるビデオ信号と同期化する
方法。（ここで、前記Ｐおよび前記Ｌは少なくとも１に
等しいものであって、前記Ｌビットは前記ディスプレー
信号機能とは異なる少なくとも１つの記録機能を画定す
るものであり、該記録機能は前記第１のビデオ信号上で
行われるものである。） - 【請求項２】請求項１記載の方法において、 前記第１のビデオ信号は、前記受像機と組み合わされた
合成ビデオ信号発生器により供給されるものであり、 前記走査は、第２のビデオ信号と同期を取るように制御
され、 ビデオ信号記録手段が前記テレビジョン受像機に組み合
わされ、 前記第２のビデオ信号に対する前記第１のビデオ信号の
第1の挿入は、前記挿入制御ビットに相当する前記制御
信号によって制御され、前記合成ビデオ信号は前記受像
機によりディスプレーされ、 前記第２のビデオ信号に対する前記第１のビデオ信号の
第２の挿入は、前記Ｌビットの一つに相当する制御信号
によって制御され、合成ビデオ信号は前記ビデオ信号記
録手段によって記録される方法。 - 【請求項３】請求項１記載の方法において、 前記第１のビデオ信号は、前記受像機と組み合わされた
合成ビデオ信号発生器により供給されるものであり、 前記記録機能は、前記第２のビデオ信号に対する前記第
１のビデオ信号の挿入中における制御を含み、合成ビデ
オ信号はビデオ記録器に出力される方法。 - 【請求項４】挿入制御機能を受像機におけるビデオ信号
と同期化する装置であって、 前記ビデオ信号との同期を要する前記機能を制御するた
めの制御装置に接続された出力を有するメモリと、 前記メモリの入力に接続された文字発生器と、 垂直および水平の同期パルスを受信して前記メモリのア
ドレッシングを行うラインカウンタおよびコラムカウン
タと、 前記メモリの出力に接続されたデコーダであって、前記
メモリから読み出されたデータから第１のビデオ信号、
第１制御信号および少なくとも第２制御信号を生成する
デコーダと、 前記制御装置は第１および第２の結合装置を有し、該第
１および第２の結合装置は前記第１のビデオ信号および
第２のビデオ信号を受信し、前記第１結合装置は前記第
１制御信号により制御されるもので、ディスプレー装置
に接続されており、前記第２結合装置は少なくとも１つ
の前記第２制御信号によって制御され、前記第２結合装
置の出力は前記ディスプレー装置から分離されている記
録装置の入力に接続された装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| FR9016134 | 1990-12-21 | ||
| FR9016134A FR2670982A1 (fr) | 1990-12-21 | 1990-12-21 | Procede de synchronisation de fonctions de commande avec des signaux video dans un recepteur de television et dispositif de mise en óoeuvre. |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06225175A JPH06225175A (ja) | 1994-08-12 |
| JP3464229B2 true JP3464229B2 (ja) | 2003-11-05 |
Family
ID=9403559
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP35576591A Expired - Fee Related JP3464229B2 (ja) | 1990-12-21 | 1991-12-21 | テレビジョン受信機におけるビデオ信号への制御機能の同期化方法およびその装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5563663A (ja) |
| EP (1) | EP0493180B1 (ja) |
| JP (1) | JP3464229B2 (ja) |
| KR (1) | KR100255440B1 (ja) |
| DE (1) | DE69129403D1 (ja) |
| FR (1) | FR2670982A1 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5827071A (en) * | 1996-08-26 | 1998-10-27 | Sorensen; Steven Michael | Method, computer program product, and system for teaching or reinforcing information without requiring user initiation of a learning sequence |
| JP3101580B2 (ja) * | 1997-02-26 | 2000-10-23 | 三洋電機株式会社 | 画像記録再生装置 |
Family Cites Families (20)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5399826A (en) * | 1977-02-14 | 1978-08-31 | Hitachi Ltd | Controller for data display |
| JPS5718169A (en) * | 1980-07-09 | 1982-01-29 | Toshiba Corp | Synchronizing circuit of video control data |
| JPS5718168A (en) * | 1980-07-09 | 1982-01-29 | Toshiba Corp | Key signal generation device |
| US4602286A (en) * | 1982-01-15 | 1986-07-22 | Quantel Limited | Video processing for composite images |
| US4420770A (en) * | 1982-04-05 | 1983-12-13 | Thomson-Csf Broadcast, Inc. | Video background generation system |
| GB8405947D0 (en) * | 1984-03-07 | 1984-04-11 | Quantel Ltd | Video signal processing systems |
| US4631585A (en) * | 1984-05-07 | 1986-12-23 | Rca Corporation | Apparatus for synchronizing the operation of a microprocessor with a television synchronization signal useful in generating an on-screen character display |
| DE3417276A1 (de) * | 1984-05-10 | 1985-11-14 | Grundig E.M.V. Elektro-Mechanische Versuchsanstalt Max Grundig holländ. Stiftung & Co KG, 8510 Fürth | Videoheimanlage mit einem videotextdecoder |
| JPH0638644B2 (ja) * | 1986-01-20 | 1994-05-18 | 株式会社日立製作所 | 文字図形表示回路 |
| JPS63114472A (ja) * | 1986-10-31 | 1988-05-19 | Victor Co Of Japan Ltd | 画像処理装置 |
| JPS63144665A (ja) * | 1986-12-06 | 1988-06-16 | Sony Corp | テレビジヨン映像中に文字等を表示する方法 |
| JPS63165922A (ja) * | 1986-12-27 | 1988-07-09 | Nec Corp | サブ画面入出力タイミング発生器 |
| JP2614629B2 (ja) * | 1988-02-12 | 1997-05-28 | 日本電気ホームエレクトロニクス株式会社 | Ｃａｔｖターミナル |
| DE3809075A1 (de) * | 1988-03-18 | 1989-09-28 | Philips Patentverwaltung | Steuersignalgenerator fuer die verarbeitung eines videosignales |
| JPH01248771A (ja) * | 1988-03-30 | 1989-10-04 | Hitachi Ltd | ビデオテープレコーダの文字表示方式 |
| JPH01266591A (ja) * | 1988-04-18 | 1989-10-24 | Matsushita Electric Ind Co Ltd | 画像表示装置 |
| JP3191873B2 (ja) * | 1988-07-13 | 2001-07-23 | 三菱電機株式会社 | 半導体測定装置 |
| US4962428A (en) * | 1989-04-20 | 1990-10-09 | Motorola, Inc. | Multistandard OSD in a TV receiver including display positioning |
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| US5077608A (en) * | 1990-09-19 | 1991-12-31 | Dubner Computer Systems, Inc. | Video effects system able to intersect a 3-D image with a 2-D image |
-
1990
- 1990-12-21 FR FR9016134A patent/FR2670982A1/fr active Granted
-
1991
- 1991-12-13 DE DE69129403T patent/DE69129403D1/de not_active Expired - Lifetime
- 1991-12-13 EP EP91403392A patent/EP0493180B1/fr not_active Expired - Lifetime
- 1991-12-20 KR KR1019910023594A patent/KR100255440B1/ko not_active IP Right Cessation
- 1991-12-21 JP JP35576591A patent/JP3464229B2/ja not_active Expired - Fee Related
-
1994
- 1994-01-10 US US08/180,786 patent/US5563663A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| EP0493180B1 (fr) | 1998-05-13 |
| DE69129403D1 (de) | 1998-06-18 |
| EP0493180A1 (fr) | 1992-07-01 |
| KR100255440B1 (ko) | 2000-05-01 |
| US5563663A (en) | 1996-10-08 |
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| FR2670982A1 (fr) | 1992-06-26 |
| FR2670982B1 (ja) | 1993-02-26 |
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