JP3402363B2 - 送信ダイバーシチ方式送信機における遅延時間制御方式。 - Google Patents
送信ダイバーシチ方式送信機における遅延時間制御方式。Info
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Description
【０００１】
【発明の属する技術分野】本発明は、移動通信に用いら
れるダイバーシチ方式の送信機に関し、特に、複数の送
信部の遅延時間を制御して、相互の遅延時間の差が許容
範囲内に収まるように制御する遅延時間制御方式に関す
る。
れるダイバーシチ方式の送信機に関し、特に、複数の送
信部の遅延時間を制御して、相互の遅延時間の差が許容
範囲内に収まるように制御する遅延時間制御方式に関す
る。
【０００２】
【従来の技術】従来、同時に複数の送信部から同じ変調
波を送信して、受信点においてそれらの変調タイミング
が一致することでダイバーシチ利得を得るような送信ダ
イバーシチ方式においては、送信出力端において変調タ
イミングが一致している（少なくとも許容範囲内にあ
る）必要がある。従って、このような目的で使用するダ
イバーシチ方式の複数の送信部は、それぞれの変調デー
タの遅延時間の差を許容範囲内に抑える必要がある。
波を送信して、受信点においてそれらの変調タイミング
が一致することでダイバーシチ利得を得るような送信ダ
イバーシチ方式においては、送信出力端において変調タ
イミングが一致している（少なくとも許容範囲内にあ
る）必要がある。従って、このような目的で使用するダ
イバーシチ方式の複数の送信部は、それぞれの変調デー
タの遅延時間の差を許容範囲内に抑える必要がある。
【０００３】これらの送信部の遅延時間に差を生じる原
因としては、回路部品の遅延時間にばらつきがある事が
挙げられる。特に、ＲＦ周波数に変換される前の中間周
波数（ＩＦ）に実装される、ＩＦフィルタの遅延量のば
らつきの影響が大きい。また、これらの遅延時間のばら
つきの影響度は、変調データの伝送速度（チップレー
ト）が高くなるほど大きくなる。そのため、高速データ
伝送を行うＣＤＭＡ方式の移動通信システムなどでは、
ダイバーシチ方式の送信機を実現するためには、それぞ
れの送信部における遅延時間の制御が必要になってく
る。
因としては、回路部品の遅延時間にばらつきがある事が
挙げられる。特に、ＲＦ周波数に変換される前の中間周
波数（ＩＦ）に実装される、ＩＦフィルタの遅延量のば
らつきの影響が大きい。また、これらの遅延時間のばら
つきの影響度は、変調データの伝送速度（チップレー
ト）が高くなるほど大きくなる。そのため、高速データ
伝送を行うＣＤＭＡ方式の移動通信システムなどでは、
ダイバーシチ方式の送信機を実現するためには、それぞ
れの送信部における遅延時間の制御が必要になってく
る。
【０００４】図７は、従来の遅延時間制御方式の一例を
示す。この遅延時間制御方式では、ベースバンド信号発
生器１０１が発生した信号を送信部１００a、１００bの
遅延回路１０２a、１０２bで遅延させて送信するが、そ
の遅延量を制御する為には、あらかじめ求められた遅延
量設定値１０９によって遅延量制御回路１０８が制御を
行う。遅延量設定値１０９は、実際にそれを使用する送
信部１００a、１００bの遅延量を測定することによって
得られる。
示す。この遅延時間制御方式では、ベースバンド信号発
生器１０１が発生した信号を送信部１００a、１００bの
遅延回路１０２a、１０２bで遅延させて送信するが、そ
の遅延量を制御する為には、あらかじめ求められた遅延
量設定値１０９によって遅延量制御回路１０８が制御を
行う。遅延量設定値１０９は、実際にそれを使用する送
信部１００a、１００bの遅延量を測定することによって
得られる。
【０００５】
【発明が解決しようとする課題】上述した従来の遅延時
間制御方式では、遅延量設定値１０９を得るためには、
毎回送信部の遅延量を測定する必要があるので、生産効
率が悪い。また、遅延量設定値１０９は、ダイバーシチ
方式の送信機の生産時に設定されるだけであるため、運
用中に温度変動や経年変化によって遅延量の差に変化が
あった場合には、期待通りのダイバーシチ利得が得られ
なくなる場合があるという問題点がある。
間制御方式では、遅延量設定値１０９を得るためには、
毎回送信部の遅延量を測定する必要があるので、生産効
率が悪い。また、遅延量設定値１０９は、ダイバーシチ
方式の送信機の生産時に設定されるだけであるため、運
用中に温度変動や経年変化によって遅延量の差に変化が
あった場合には、期待通りのダイバーシチ利得が得られ
なくなる場合があるという問題点がある。
【０００６】本発明の目的は、生産効率を改善するとと
もに、運用中に温度変動や経年変化があった場合でも、
期待通りのダイバーシチ利得を得ることが可能な遅延時
間制御方式を提供することである。
もに、運用中に温度変動や経年変化があった場合でも、
期待通りのダイバーシチ利得を得ることが可能な遅延時
間制御方式を提供することである。
【０００７】
【課題を解決するための手段】本発明の 遅延時間制御
方式は、同時に複数の送信部から一つのベースバンド信
号を遅延回路により遅延させて同じ変調波を送信して、
受信点においてそれらの変調タイミングが一致すること
でダイバーシチ利得を得る送信ダイバーシチ方式送信機
において、各送信部はＲＦ出力信号を検波して検波信号
を出力する検波器を備え、二つの送信部の検波器の出力
する検波信号を比較して比較信号を出力する比較器と、
前記比較器の出力する比較信号をもとに、送信出力端に
おいて変調タイミングが一致するように前記二つの送信
部の遅延回路を制御する遅延量制御回路とを有する。
方式は、同時に複数の送信部から一つのベースバンド信
号を遅延回路により遅延させて同じ変調波を送信して、
受信点においてそれらの変調タイミングが一致すること
でダイバーシチ利得を得る送信ダイバーシチ方式送信機
において、各送信部はＲＦ出力信号を検波して検波信号
を出力する検波器を備え、二つの送信部の検波器の出力
する検波信号を比較して比較信号を出力する比較器と、
前記比較器の出力する比較信号をもとに、送信出力端に
おいて変調タイミングが一致するように前記二つの送信
部の遅延回路を制御する遅延量制御回路とを有する。
【０００８】前記遅延量制御回路は、前記比較器から出
力される比較信号の平均振幅を求め、その値がしきい値
以下になるように、前記二つの送信部の遅延回路を制御
して、遅延時間相互の差が許容範囲内に収まるようにす
るものを含む。
力される比較信号の平均振幅を求め、その値がしきい値
以下になるように、前記二つの送信部の遅延回路を制御
して、遅延時間相互の差が許容範囲内に収まるようにす
るものを含む。
【０００９】nを１より大きい整数とするとき、複数の
送信部がn個であり、前記比較器および遅延量制御回路
がそれぞれn−１個であるものを含む。
送信部がn個であり、前記比較器および遅延量制御回路
がそれぞれn−１個であるものを含む。
【００１０】前記送信部は遅延回路と変調器と周波数変
換器と増幅器とから構成され、前記遅延回路はベースバ
ンド信号が入力する端に設けられたものを含む。
換器と増幅器とから構成され、前記遅延回路はベースバ
ンド信号が入力する端に設けられたものを含む。
【００１１】前記送信部は遅延回路と変調器と周波数変
換器と増幅器とから構成され、前記遅延回路は前記変調
器と周波数変換器の間に設けられたものを含む。
換器と増幅器とから構成され、前記遅延回路は前記変調
器と周波数変換器の間に設けられたものを含む。
【００１２】前記送信部は遅延回路と変調器と周波数変
換器と増幅器とから構成され、前記遅延回路は前記周波
数変換器と増幅器の間に設けられたものを含む。
換器と増幅器とから構成され、前記遅延回路は前記周波
数変換器と増幅器の間に設けられたものを含む。
【００１３】前記送信部は遅延回路と変調器と周波数変
換器と増幅器とから構成され、前記遅延回路は前記増幅
器の出力側に設けられたものを含む。
換器と増幅器とから構成され、前記遅延回路は前記増幅
器の出力側に設けられたものを含む。
【００１４】ベースバンド信号をＯＮ／ＯＦＦ制御し、
前記ＯＮ／ＯＦＦ時の検波出力の立ち上がり、および立
ち下がりのタイミングを比較して、そのタイミングが許
容の時間内に収まるように前記送信部の遅延回路を制御
するものを含む。
前記ＯＮ／ＯＦＦ時の検波出力の立ち上がり、および立
ち下がりのタイミングを比較して、そのタイミングが許
容の時間内に収まるように前記送信部の遅延回路を制御
するものを含む。
【００１５】
【発明の実施の形態】次に、本発明の実施の形態につい
て図面を参照して説明する。 （第１の実施の形態）図１は本発明の遅延時間制御方式
の第１の実施の形態のブロック図を示す。
て図面を参照して説明する。 （第１の実施の形態）図１は本発明の遅延時間制御方式
の第１の実施の形態のブロック図を示す。
【００１６】図１では、２つの送信部から構成される、
ダイバーシチ方式の送信機を示しており、図７と同一構
成部分には同一符号を付してある。
ダイバーシチ方式の送信機を示しており、図７と同一構
成部分には同一符号を付してある。
【００１７】図１において、ベースバンド信号発生器１
０１で生成されたベースバンド信号は、２つの送信部１
００ａ、送信部１００ｂに入力される。それぞれの送信
部に入力されたベースバンド信号は、遅延回路１０２
ａ、１０２ｂを通って変調器１０３ａ、１０３ｂに入力
される。変調器１０３ａ、１０３ｂは、ベースバンド信
号から変調波を生成する。変調波は周波数変換器１０４
ａ、１０４ｂでＲＦ信号に変換され、増幅器１０５ａ、
１０５ｂで規定の電力まで増幅され、送信部から出力さ
れる。
０１で生成されたベースバンド信号は、２つの送信部１
００ａ、送信部１００ｂに入力される。それぞれの送信
部に入力されたベースバンド信号は、遅延回路１０２
ａ、１０２ｂを通って変調器１０３ａ、１０３ｂに入力
される。変調器１０３ａ、１０３ｂは、ベースバンド信
号から変調波を生成する。変調波は周波数変換器１０４
ａ、１０４ｂでＲＦ信号に変換され、増幅器１０５ａ、
１０５ｂで規定の電力まで増幅され、送信部から出力さ
れる。
【００１８】検波器１０６ａ、１０６ｂは、それぞれの
送信部のＲＦ出力信号を検波し検波信号を出力する。比
較器１０７では、検波部１０６ａ、１０６ｂの検波信号
を比較して、比較信号を出力する。遅延量制御回路１０
８ではこの比較信号を情報として、それぞれの送信部の
遅延回路１０２ａ、１０２ｂの遅延量を制御し、それぞ
れの送信部の遅延時間の差が許容値内に収まるように自
動的に制御を行う。それぞれの送信部の遅延時間の差が
許容値内に収まっているかどうかは、比較器１０７から
出力される比較信号から判定される。
送信部のＲＦ出力信号を検波し検波信号を出力する。比
較器１０７では、検波部１０６ａ、１０６ｂの検波信号
を比較して、比較信号を出力する。遅延量制御回路１０
８ではこの比較信号を情報として、それぞれの送信部の
遅延回路１０２ａ、１０２ｂの遅延量を制御し、それぞ
れの送信部の遅延時間の差が許容値内に収まるように自
動的に制御を行う。それぞれの送信部の遅延時間の差が
許容値内に収まっているかどうかは、比較器１０７から
出力される比較信号から判定される。
【００１９】それぞれの送信部の遅延時間に差を生じる
原因としては、回路部品の遅延時間にばらつきがある事
が挙げられる。特に、ＲＦ周波数に変換される前の中間
周波数（ＩＦ）に実装される、ＩＦフィルタの遅延量の
ばらつきの影響が大きい。また、これらの遅延時間のば
らつきの影響度は、変調データの伝送速度（チップレー
ト）が高くなるほど大きくなる。そのため、高速データ
伝送を行うＣＤＭＡ方式の移動通信システムなどでは、
ダイバーシチ方式の送信機を実現するためには、それぞ
れの送信部における遅延時間の制御が必要になる。
原因としては、回路部品の遅延時間にばらつきがある事
が挙げられる。特に、ＲＦ周波数に変換される前の中間
周波数（ＩＦ）に実装される、ＩＦフィルタの遅延量の
ばらつきの影響が大きい。また、これらの遅延時間のば
らつきの影響度は、変調データの伝送速度（チップレー
ト）が高くなるほど大きくなる。そのため、高速データ
伝送を行うＣＤＭＡ方式の移動通信システムなどでは、
ダイバーシチ方式の送信機を実現するためには、それぞ
れの送信部における遅延時間の制御が必要になる。
【００２０】以下に動作について説明する。
【００２１】ＲＦ信号は変調波であるため、その出力電
力は変調データ（ベースバンド信号）の伝送速度に比例
した速度で瞬時変動を生じる。検波器１０６ａ、１０６
ｂは、ＲＦ信号の瞬時電力変動を検波電圧として出力す
る。図２〜４にそれぞれの送信部における検波器１０６
ａ、１０６ｂの検波信号を示す。縦軸は検波電圧を示
し、横軸は伝送速度単位（チップ）で正規化した時間を
示す。横軸の１目盛りが１チップの時間を示す。
力は変調データ（ベースバンド信号）の伝送速度に比例
した速度で瞬時変動を生じる。検波器１０６ａ、１０６
ｂは、ＲＦ信号の瞬時電力変動を検波電圧として出力す
る。図２〜４にそれぞれの送信部における検波器１０６
ａ、１０６ｂの検波信号を示す。縦軸は検波電圧を示
し、横軸は伝送速度単位（チップ）で正規化した時間を
示す。横軸の１目盛りが１チップの時間を示す。
【００２２】図２は、送信部１００ａと送信部１００ｂ
の遅延時間の差が０であった場合を示す。遅延時間の差
がないため、同時刻に同じ振幅変動が生じる。そのた
め、検波部１０６ａの出力信号である検波信号ａと１０
６ｂの出力信号である検波信号ｂは重なっている。
の遅延時間の差が０であった場合を示す。遅延時間の差
がないため、同時刻に同じ振幅変動が生じる。そのた
め、検波部１０６ａの出力信号である検波信号ａと１０
６ｂの出力信号である検波信号ｂは重なっている。
【００２３】一方、図３および図４は、送信部１００ａ
と送信部１００ｂの遅延時間に差が生じた場合の検波信
号を示す。図３は、送信部１００ａの方が送信部１００
ｂよりも１／８チップだけ遅れた場合を示し、図４は、
送信部１００ａの方が送信部１００ｂよりも４／８チッ
プだけ遅れた場合を示している。
と送信部１００ｂの遅延時間に差が生じた場合の検波信
号を示す。図３は、送信部１００ａの方が送信部１００
ｂよりも１／８チップだけ遅れた場合を示し、図４は、
送信部１００ａの方が送信部１００ｂよりも４／８チッ
プだけ遅れた場合を示している。
【００２４】次に、比較器１０７から出力される比較信
号の説明を行う。比較器１０７では、検波信号ａと検波
信号ｂを比較して、それぞれの信号の差（検波信号ａ−
検波信号ｂ）を出力する。図２〜図４に、それぞれの検
波信号に対する比較信号を示す。
号の説明を行う。比較器１０７では、検波信号ａと検波
信号ｂを比較して、それぞれの信号の差（検波信号ａ−
検波信号ｂ）を出力する。図２〜図４に、それぞれの検
波信号に対する比較信号を示す。
【００２５】図２では、それぞれの送信部の遅延時間に
差がないため検波信号ａと検波信号ｂは同時刻で同じ値
となる。そのため比較信号は０になる。一方、図３、図
４に示すように、それぞれの送信部に遅延時間の差が生
じると比較信号は０にはならない。そして、遅延時間の
差が大きくなるほど比較信号の振幅変動が大きくなるこ
とがわかる。
差がないため検波信号ａと検波信号ｂは同時刻で同じ値
となる。そのため比較信号は０になる。一方、図３、図
４に示すように、それぞれの送信部に遅延時間の差が生
じると比較信号は０にはならない。そして、遅延時間の
差が大きくなるほど比較信号の振幅変動が大きくなるこ
とがわかる。
【００２６】比較器１０７で得られた比較信号を遅延量
制御回路１０８に入力し、それぞれの送信部に用意され
た遅延回路１０２ａ、１０２ｂの遅延量の制御を行う。
以下に、遅延量制御回路１０８の動作をフローチャート
を使って説明する。
制御回路１０８に入力し、それぞれの送信部に用意され
た遅延回路１０２ａ、１０２ｂの遅延量の制御を行う。
以下に、遅延量制御回路１０８の動作をフローチャート
を使って説明する。
【００２７】図５は、遅延量制御回路１０８の動作を示
すフローチャートである。
すフローチャートである。
【００２８】遅延量制御回路１０８は、比較器１０７か
ら入力される比較信号の平均振幅Vnを求め（ステップＳ
１）、あらかじめ設定されたVnのしきい値と比較する
（ステップＳ２）。比較信号の平均振幅Vnが、しきい値
よりも小さい場合は特に制御は行わず、ステップＳ１に
戻ってもう一度比較信号の平均振幅Vnを求める。従っ
て、Vnがしきい値以下であれば、比較信号の平均振幅を
繰り返し求める事になる。
ら入力される比較信号の平均振幅Vnを求め（ステップＳ
１）、あらかじめ設定されたVnのしきい値と比較する
（ステップＳ２）。比較信号の平均振幅Vnが、しきい値
よりも小さい場合は特に制御は行わず、ステップＳ１に
戻ってもう一度比較信号の平均振幅Vnを求める。従っ
て、Vnがしきい値以下であれば、比較信号の平均振幅を
繰り返し求める事になる。
【００２９】ここでVnのしきい値は、あらかじめ以下の
通り設定される。
通り設定される。
【００３０】それぞれの送信部の遅延時間の差が大きく
なると送信ダイバーシチ特性が劣化する。そこで許容さ
れるそれぞれの送信部の遅延時間の差を設定する。一
方、図２〜図４に示した通り、比較器１０７から出力さ
れる比較信号の振幅変動は、遅延時間の差に比例する関
係にある。従って、許容される遅延時間の差は、比較信
号の平均振幅の値に置き換えることが可能であり、その
値をVnのしきい値として設定することが可能である。
なると送信ダイバーシチ特性が劣化する。そこで許容さ
れるそれぞれの送信部の遅延時間の差を設定する。一
方、図２〜図４に示した通り、比較器１０７から出力さ
れる比較信号の振幅変動は、遅延時間の差に比例する関
係にある。従って、許容される遅延時間の差は、比較信
号の平均振幅の値に置き換えることが可能であり、その
値をVnのしきい値として設定することが可能である。
【００３１】一方、比較信号の平均振幅Vnが、しきい値
よりも大きい場合は、まず送信部１００ａの遅延量を1
ステップ（step）増やす（ステップＳ３）。ここで、図
３、図４に示したように、送信部１００ａの方が送信部
１００ｂよりも遅延時間が大きい場合は更に遅延時間が
大きくなり、比較信号Vnは大きくなってしまう。そこ
で、送信部１００ａの遅延量を1step増やした後に、も
う一度比較信号の平均振幅Vnを求め、Vnが大きくなった
かどうかを判定する。小さくなっていればその値がしき
い値よりも小さくなったかどうかをもう一度判定する
（ステップＳ５）。一方、Vnが大きくなっていたら、今
度は送信部１００ｂの遅延量を1ステップ（step）増や
し（ステップＳ６）、もう一度比較信号の平均振幅Vnを
求め（ステップＳ７）、しきい値より小さくなったかど
うかを判定する（ステップＳ８）。
よりも大きい場合は、まず送信部１００ａの遅延量を1
ステップ（step）増やす（ステップＳ３）。ここで、図
３、図４に示したように、送信部１００ａの方が送信部
１００ｂよりも遅延時間が大きい場合は更に遅延時間が
大きくなり、比較信号Vnは大きくなってしまう。そこ
で、送信部１００ａの遅延量を1step増やした後に、も
う一度比較信号の平均振幅Vnを求め、Vnが大きくなった
かどうかを判定する。小さくなっていればその値がしき
い値よりも小さくなったかどうかをもう一度判定する
（ステップＳ５）。一方、Vnが大きくなっていたら、今
度は送信部１００ｂの遅延量を1ステップ（step）増や
し（ステップＳ６）、もう一度比較信号の平均振幅Vnを
求め（ステップＳ７）、しきい値より小さくなったかど
うかを判定する（ステップＳ８）。
【００３２】以降、Vnがしきい値以下になるまで繰り返
し制御が行われる。その結果、自動的にそれぞれの送信
部の遅延時間の差が許容値以下になるように制御される
ことになる。
し制御が行われる。その結果、自動的にそれぞれの送信
部の遅延時間の差が許容値以下になるように制御される
ことになる。
【００３３】以上説明したように、本発明によれば、ダ
イバーシチ方式の送信機のそれぞれの遅延時間の差が、
許容値以下になるように自動的に制御する事が可能とな
る。従って、常に期待通りの送信ダイバーシチの特性を
得ることができる。
イバーシチ方式の送信機のそれぞれの遅延時間の差が、
許容値以下になるように自動的に制御する事が可能とな
る。従って、常に期待通りの送信ダイバーシチの特性を
得ることができる。
【００３４】また本発明によれば、それぞれの送信部に
使用される回路部品のばらつきを自的に補正することが
できる。更に、運用中の温度変動、経年変化による送信
ダイバーシチの特性の劣化も防止することが可能にな
る。 （第２の実施の形態）図６は本発明の遅延時間制御方式
の第２の実施の形態のブロック図を示す。
使用される回路部品のばらつきを自的に補正することが
できる。更に、運用中の温度変動、経年変化による送信
ダイバーシチの特性の劣化も防止することが可能にな
る。 （第２の実施の形態）図６は本発明の遅延時間制御方式
の第２の実施の形態のブロック図を示す。
【００３５】図６の遅延時間制御方式は、三つの送信部
１００a、１００b、１００cを備える場合で、各送信部
に遅延回路と検波器を備えた図１の制御方式に準ずる構
成である。この遅延量制御回路１０８1、１０８2によっ
て、RF信号aとRF信号b、RF信号bとRF信号cの遅延量を比
較してそれぞれの差をしきい値以下に抑えるようにして
いる。 （その他の実施の形態）第２の実施の形態は三つの送信
部を備える場合の遅延時間制御方式であるが、四つ以上
の送信部で構成されたダイバーシチ方式の送信機におい
ても、複数の比較器を用いて、２つづつの送信部の遅延
量を比較していくことで、それぞれの遅延量の差をしき
い値以下に抑えることが可能である。
１００a、１００b、１００cを備える場合で、各送信部
に遅延回路と検波器を備えた図１の制御方式に準ずる構
成である。この遅延量制御回路１０８1、１０８2によっ
て、RF信号aとRF信号b、RF信号bとRF信号cの遅延量を比
較してそれぞれの差をしきい値以下に抑えるようにして
いる。 （その他の実施の形態）第２の実施の形態は三つの送信
部を備える場合の遅延時間制御方式であるが、四つ以上
の送信部で構成されたダイバーシチ方式の送信機におい
ても、複数の比較器を用いて、２つづつの送信部の遅延
量を比較していくことで、それぞれの遅延量の差をしき
い値以下に抑えることが可能である。
【００３６】また、上述した実施の形態では遅延回路は
変調器の前段に設置されているが、変調器以降の各段お
よび増幅器の出力側に実装して遅延量を制御することも
可能である。
変調器の前段に設置されているが、変調器以降の各段お
よび増幅器の出力側に実装して遅延量を制御することも
可能である。
【００３７】更に、ベースバンド信号をＯＮ／ＯＦＦ制
御して送信する場合においても同様に制御できるほか、
ＯＮ／ＯＦＦ時の検波出力の立ち上がり、立ち下がりの
タイミングを比較して、そのタイミングが許容の時間内
に収まるように制御する方法も可能である。
御して送信する場合においても同様に制御できるほか、
ＯＮ／ＯＦＦ時の検波出力の立ち上がり、立ち下がりの
タイミングを比較して、そのタイミングが許容の時間内
に収まるように制御する方法も可能である。
【００３８】
【発明の効果】以上説明したように、本発明は、二つの
送信部の検波器の出力する検波信号を比較して遅延量を
制御することにより、ダイバーシチ方式の送信部のそれ
ぞれの遅延時間の差が、許容値以下になるように自動的
に制御する事が可能となり、常に期待通りの送信ダイバ
ーシチの特性を得ることができる効果がある。
送信部の検波器の出力する検波信号を比較して遅延量を
制御することにより、ダイバーシチ方式の送信部のそれ
ぞれの遅延時間の差が、許容値以下になるように自動的
に制御する事が可能となり、常に期待通りの送信ダイバ
ーシチの特性を得ることができる効果がある。
【００３９】また、それぞれの送信部に使用される回路
部品のばらつきを自動的に補正することができ、更に、
運用中の温度変動、経年変化による送信ダイバーシチの
特性の劣化も防止することが可能になるという効果があ
る。
部品のばらつきを自動的に補正することができ、更に、
運用中の温度変動、経年変化による送信ダイバーシチの
特性の劣化も防止することが可能になるという効果があ
る。
【図１】本発明の遅延時間制御方式の第１の実施の形態
のブロック図である。
のブロック図である。
【図２】図１の検波部１０６ａ、１０６ｂの検波信号の
一例を示すグラフである。
一例を示すグラフである。
【図３】図１の検波部１０６ａ、１０６ｂの検波信号の
他の例を示すグラフである。
他の例を示すグラフである。
【図４】図１の検波部１０６ａ、１０６ｂの検波信号の
さらに他の例を示すグラフである。
さらに他の例を示すグラフである。
【図５】図１の遅延量制御回路１０８の動作を示すフロ
ーチャートである。
ーチャートである。
【図６】本発明の遅延時間制御方式の第２の実施の形態
のブロックである。
のブロックである。
【図７】遅延時間制御方式の一従来例のブロック図であ
る。
る。
１００a、１００b、１００c 送信部
１０１ ベースバンド信号発生器
１０２a、１０２b、１０２c 遅延回路
１０３a、１０３b、１０３c 変調器
１０４a、１０４b、１０４c 周波数変換器
１０５a、１０５b、１０５c 増幅器
１０６a、１０６b、１０６c 検波器
１０７、１０７1、１０７2 比較器
１０８、１０８1、１０８2 遅延量制御回路
Claims (8)
- 【請求項１】 同時に複数の送信部から一つのベースバ
ンド信号を遅延回路により遅延させて同じ変調波を送信
して、受信点においてそれらの変調タイミングが一致す
ることでダイバーシチ利得を得る送信ダイバーシチ方式
送信機において、 各送信部はＲＦ出力信号を検波して検波信号を出力する
検波器を備え、 二つの送信部の検波器の出力する検波信号を比較して比
較信号を出力する比較器と、 前記比較器の出力する比較信号をもとに、送信出力端に
おいて変調タイミングが一致するように前記二つの送信
部の遅延回路を制御する遅延量制御回路とを有すること
を特徴とする遅延時間制御方式。 - 【請求項２】 前記遅延量制御回路は、前記比較器から
出力される比較信号の平均振幅を求め、その値がしきい
値以下になるように、前記二つの送信部の遅延回路を制
御して、遅延時間相互の差が許容範囲内に収まるように
する請求項１記載の遅延時間制御方式。 - 【請求項３】 nを１より大きい整数とするとき、複数
の送信部がn個であり、前記比較器および遅延量制御回
路がそれぞれn−１個である請求項１または２記載の遅
延時間制御方式。 - 【請求項４】 前記送信部は遅延回路と変調器と周波数
変換器と増幅器とから構成され、前記遅延回路はベース
バンド信号が入力する端に設けられた請求項１または２
または３記載の遅延時間制御方式。 - 【請求項５】 前記送信部は遅延回路と変調器と周波数
変換器と増幅器とから構成され、前記遅延回路は前記変
調器と周波数変換器の間に設けられた請求項１または２
または３記載の遅延時間制御方式。 - 【請求項６】 前記送信部は遅延回路と変調器と周波数
変換器と増幅器とから構成され、前記遅延回路は前記周
波数変換器と増幅器の間に設けられた請求項１または２
または３記載の遅延時間制御方式。 - 【請求項７】 前記送信部は遅延回路と変調器と周波数
変換器と増幅器とから構成され、前記遅延回路は前記増
幅器の出力側に設けられた請求項１または２または３記
載の遅延時間制御方式。 - 【請求項８】 ベースバンド信号をＯＮ／ＯＦＦ制御
し、前記ＯＮ／ＯＦＦ時の検波出力の立ち上がり、およ
び立ち下がりのタイミングを比較して、そのタイミング
が許容の時間内に収まるように前記送信部の遅延回路を
制御する請求項１または３から７のいずれか一記載の遅
延時間制御方式。
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|---|---|---|---|
| JP2000177110A JP3402363B2 (ja) | 2000-06-13 | 2000-06-13 | 送信ダイバーシチ方式送信機における遅延時間制御方式。 |
| US09/870,843 US7145958B2 (en) | 2000-06-13 | 2001-06-01 | Diversity type transmitter having system for controlling the delay time of each of plural transmission units |
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| SG200103427A SG100723A1 (en) | 2000-06-13 | 2001-06-09 | Diversity type transmitter having system for controlling the delay time of each of plural transmission units |
| KR10-2001-0033127A KR100381884B1 (ko) | 2000-06-13 | 2001-06-13 | 복수의 송신부 각각의 지연 시간을 제어하기 위한시스템을 갖는 다이버시티 방식 송신기 |
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| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000177110A JP3402363B2 (ja) | 2000-06-13 | 2000-06-13 | 送信ダイバーシチ方式送信機における遅延時間制御方式。 |
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|---|---|---|---|
| JP2000177110A Expired - Fee Related JP3402363B2 (ja) | 2000-06-13 | 2000-06-13 | 送信ダイバーシチ方式送信機における遅延時間制御方式。 |
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