JP3400440B2 - 半導体装置及びその製造方法 - Google Patents

半導体装置及びその製造方法

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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は、半導体装置の構造、
特にボンディングパッド(電極)部の構造及びその製造
方法に関するものである。
【0002】
【従来の技術】従来の半導体装置は、例えば、特開20
00−183104号公報に開示されている半導体装置
のように、ボンディングパッドを、タングステン、チタ
ン、或いはタングステン・チタン合金等とからなる金属
層と、銅を含有するアルミニウム(アルミニウム系合
金)とからなる金属層とから形成している。
【0003】すなわち、従来のボンディングパッドは、
金属層により形成されるものであった。
【0004】
【発明が解決しようとする課題】しかしながら、このよ
うな半導体装置においては、以下のような問題がある。
【0005】すなわち、金属層からなるボンディングパ
ッドでは、ワイヤボンディング時の衝撃を、ボンディン
グパッド下に形成される衝撃吸収特性を有する保護被膜
だけでは十分に吸収できない場合がある。そして、この
ような場合、ボンディングパッドをはじめボンディング
パッド下に形成される回路構造が損傷(ボンディングダ
メージ)を受けることになる。
【0006】そして、この損傷によって製造歩留まりや
製品の信頼性が低下する。
【0007】よって、上述の問題点における技術的な解
決方法の出現がこれまで望まれていた。
【0008】
【課題を解決するための手段】そこで、この発明の半導
体装置は、下記のような構成上の特徴を有する。
【0009】すなわち、半導体素子及びこの半導体素子
と電気的に接続された金属層を有する半導体基板と、こ
の金属層上に形成され、バイアホールを有するとともに
このバイアホールによって金属層を露出させる絶縁層
と、バイアホールを含む絶縁層上に形成され、金属層と
バイアホールを介して電気的に接続される導電性の衝撃
緩衝材から構成される導電性衝撃緩衝層と、この導電性
衝撃緩衝層を被覆する導電性被覆層とを具え、導電性被
覆層には、ボンディングワイヤが接合されている。
【0010】このようにすると、衝撃緩衝層が、ワイヤ
ボンディング時におけるボンディングパッド下の回路構
造への衝撃を緩衝することができる。
【0011】
【発明の実施の形態】以下、図面を参照して、この発明
の実施の形態につき説明する。尚、各図は、この発明が
理解できる程度に各構成成分の形状、大きさ及び配置関
係を概略的に示してあるに過ぎず、従って、この発明を
図示例に限定するものではない。また、各図において、
図を分かり易くするために断面を示すハッチング(斜
線)は一部分を除き省略してある。尚、以下の説明は、
好適例であるに過ぎないので、数値的条件は例示された
値に何ら限定されない。
【0012】また、以下の各実施の形態で用いられる積
層体22は、図1〜図7において共通であり、以下の構
成を有している。すなわち、積層体22は、図示しない
半導体素子が形成された半導体基板10上に、導電層と
してのアルミ系合金からなる膜厚約4.5×102nm
の金属膜12を設けた後、任意好適なエッチングにより
パターンを形成する。そして、金属膜12上に、層間絶
縁層としての酸化シリコンからなる膜厚約8×102
mの酸化物膜14及び導電層としてのアルミ系合金から
なる膜厚約6×102nmの金属膜16を順次形成して
なる多層配線構造を有している。そして、金属膜16上
にシリコン・ナイトライドからなる膜厚約4×102
m〜1.5×103nmの保護膜18を形成した後、任
意好適なエッチングにより表層にバイアホール20を形
成してなる。尚、半導体基板10に形成された半導体素
子と後述するボンディングパッドとを電気的に接続する
当たり、金属層12及び金属層16は図示しない多層配
線構造によって接続されているものとする。
【0013】そして、以下の各実施の形態では、この積
層体22上にボンディングパッドを形成する例につき説
明する。
【0014】<第1の実施の形態>第1の実施の形態に
よれば、第1工程として、半導体素子が形成された半導
体基板と、半導体素子と電気的に接続される導電層と、
導電層間に設けられた絶縁層とを備えてなる積層体に、
積層体の上方から液状の導電性樹脂材を滴下して、この
積層体上に導電性樹脂層を形成する。
【0015】この実施の形態では、この導電性樹脂材
を、銀(Ag)や金(Au)等の導電性粒子を60〜7
0wt%程度、エポキシ樹脂を10〜20wt%程度及びそ
の他流動性を持たせるための溶剤や希釈材等を10〜3
0wt%程度配合して作成する。この導電性樹脂材の導電
率は約1×105S・m-1程度、平均粒径は1〜1×1
3nm程度とする。また、粘度は後述の導電性樹脂供
給部から十分に吐出できる流動性を有する程度とする。
【0016】第1工程において、先ず、積層体22の上
方に設けられた導電性樹脂供給部24から、導電性樹脂
材を0.5〜1.0mg程度滴下する。
【0017】この導電性樹脂材の滴下によって、積層体
22の表層に形成されている、保護膜18に形成される
バイアホール20内及びバイアホール20の周辺の保護
膜18上に、導電性樹脂層26が連続的に形成される。
これにより、バイアホール20から保護膜18上に溢れ
出す導電性樹脂材によって、例えば、概ね、縦1×10
5nm程度、横1×105nm程度及び膜厚1×104
2×104nm程度の導電性樹脂層26が形成されると
共に、バイアホール20が導電性樹脂材によって充填さ
れて、導電層(ここでは、金属膜16)と後述するボン
ディングパッドとを電気的に接続するためのバイアコン
タクト、すなわち接続部が形成される(図1(A)参
照)。
【0018】次に、第2工程として、導電性樹脂層を加
熱によって硬化させて、ボンディングパッドとしての衝
撃緩衝層を得る。
【0019】この導電性樹脂層26が設けられた積層体
22を、窒素(N2)等の不活性ガス雰囲気中で、約1
00℃〜200℃の温度範囲内の好適な温度(標準的に
は約180℃)で約30〜120分(標準的には約60
分)間加熱する。この加熱によって、導電性樹脂層26
を硬化させることにより、衝撃緩衝層28を得る(図1
(B)参照)。
【0020】その後に、衝撃緩衝層上に導電性を有する
被着層を形成する。
【0021】この実施の形態では、導電性樹脂層26を
硬化して得られた衝撃緩衝層28上に、無電解メッキ法
によって、ニッケル(Ni)からなる膜厚が約2×10
3nm〜5×103nmの第1サブ被着層36と、金(A
u)もしくは白金(Pd)からなる膜厚が約3×102
nm〜8×102nmの第2サブ被着層38とを順次形
成してなる被着層40を形成して、ボンディングパッド
30を得る。(図1(C)参照)。
【0022】尚、第1サブ被着層36は、第2サブ被着
層38表面の平滑性を得られるものであれば良い。ま
た、第2サブ被着層38は、ボンディングワイヤ(後
述)との良好な接合性が得られるものであれば良い。ま
た、被着層40を必ずしも設ける必要はないが、設ける
ことにより後工程におけるボンディングワイヤとの良好
な接合性、例えば、接着強度を高めることができる。
【0023】次に、第3工程として、硬化した導電性樹
脂層すなわち衝撃緩衝層の上側に、ボンディングワイヤ
を接合して電気的な接続を行う。
【0024】そこで、被着層40上に、金(Au)から
なるボンディングワイヤ42を接合してワイヤボンディ
ングを行う。(図2(A)参照)。
【0025】また、図2(B)は、第1工程における、
導電性樹脂供給部24からの導電性樹脂材の滴下量を上
述よりも増量させた場合の例であり、結果として、ボン
ディングパッドを構成する衝撃緩衝層28が、保護膜1
8上により広い面積にわたって形成される。すなわち、
バイアホール20の直上を含む領域外に、ボンディング
ワイヤ42が接合される接合領域を備えているため、ボ
ンディングワイヤ42との接合が可能なボンディングパ
ッドの接合面が拡がり、ボンディングワイヤ42をこの
接合面のどの箇所に接合するかの自由度が高くなる。
【0026】上述した説明から明らかなように、この実
施の形態では、半導体装置におけるボンディングパッド
を、導電性樹脂材からなる衝撃緩衝層で構成することが
できる。
【0027】そのため、ボンディングパッドの硬度を金
属膜である場合よりも低下させることができ、ワイヤボ
ンディング時の衝撃によるボンディングパッド下の回路
構造への損傷を、この衝撃緩衝層によって緩和させるこ
とができる。
【0028】また、ボンディングパッドの膜厚を、導電
性樹脂材の滴下量を適宜調節することにより制御でき
る。よって、ワイヤボンディングの衝撃の程度や条件等
によって、膜厚を適宜調節でき、十分な衝撃吸収作用を
得ることができる。
【0029】また、金属層によってボンディングパッド
を形成する場合に比べて、マスクの形成やエッチング等
の処理が不要であるため、より安価な設備で製造するこ
とができる。
【0030】<第2の実施の形態>第2の実施の形態に
よれば、第1の実施の形態における第1工程を同様にし
て行う前に、導電性樹脂供給部から滴下する導電性樹脂
材の流動範囲を制限する拡がり防止膜を積層体上に設け
る。
【0031】また、この拡がり防止膜は、予備膜に開孔
部を開け、開孔部を有する残存した予備膜部分を、拡が
り防止膜として積層体上に載置して形成する。そこで、
凸部を有する第1押出し部とこの凸部が嵌合する凹部を
有する第1受け部とを備える開孔手段を用意する。そし
て、この第1押出し部と第1受け部との間に予備膜を設
けた後に、第1押出し部と第1受け部との間に荷重を加
えて、凸部を凹部に嵌合させることにより予備膜に開孔
部を設ける。そして、この開孔部を備える予備膜を拡が
り防止膜として用いる。詳細を以下に説明する。
【0032】先ず、拡がり防止膜を積層体22(図1及
び図2参照)上に形成するあたり、予備膜として、エポ
キシ樹脂やポリイミド樹脂から作られる膜厚が約2×1
4〜5×104nmの絶縁膜シート44を用いる。そし
て、この絶縁膜シート44を、開孔手段32である第1
押出し部46と第1受け部48との間に設けて固定する
(図3(A)参照)。次に、第1押出し部46と第1受
け部48との間に好適な荷重を加えて、第1押出し部の
凸部を第1受け部の凹部に嵌合させて、絶縁膜シート4
4に開孔部50を形成する(図3(B)参照)。このよ
うにして、絶縁膜シート44に一括して、ウェハ(図示
せず)に形成されている全ての半導体素子に対する開孔
部50を形成することができる(図3(C))。
【0033】そして、この開孔部50を有する絶縁膜シ
ート44を拡がり防止膜52として、積層体22上に形
成する。先ず、拡がり防止膜52を、第1積層体22上
の所定の位置に位置決めをする。そして、拡がり防止膜
を、約100℃〜200℃の温度範囲内の好適な温度で
加熱しながら、約1〜5P程度の荷重を加えることで積
層体22に熱圧着させて接合する(図3(D)参照)。
【0034】然る後に、第1の実施の形態と同様に第1
工程〜第3工程を行い、図4(A)に示すような半導体
装置が得られる。尚、図4(B)は第1の実施の形態で
の場合と同様に、導電性樹脂材の滴下量を増量させて得
られた半導体装置である。
【0035】上述した説明から明らかなように、この実
施の形態においても、第1の実施の形態と同様の効果を
得ることができる。
【0036】更に、この実施の形態では、拡がり防止膜
の形成を、ウェハに対して一括して形成できるので、個
々の半導体素子に対して個別に形成する場合に比べて製
造コストを低減できる。
【0037】また、この実施の形態では、拡がり防止膜
によって、滴下した導電性樹脂材の流動範囲を制限で
き、第1の実施の形態よりも確実に所望の領域にボンデ
ィングパッドを形成できる。また、不所望の領域に導電
性樹脂が流出することで集積回路が汚染されるのを防止
できる。
【0038】また、拡がり防止膜を設けたことにより、
導電性樹脂供給部の位置決めは、第1の実施の形態の場
合ほど厳密に行わなくて済む。よって、性能や設備等の
点からも導電性樹脂供給部を含む装置の価格が安価とな
り、製造コストを低減できる。
【0039】<第3の実施の形態>第3の実施の形態に
よれば、先ず、第1工程として、半導体素子が形成され
た半導体基板と、半導体素子と電気的に接続される導電
層と、該導電層間に設けられた絶縁層とを備えてなる積
層体上に、導電性樹脂材で作られた衝撃緩衝層をボンデ
ィングパッドとして形成する。
【0040】また、この衝撃緩衝層は、板状の予備膜を
打ち抜きによって得られる板状の予備膜部分で衝撃緩衝
層を形成するとともに、融着手段によって積層体上に融
着する。そこで、先ず、凸部を有する第2押出し部とこ
の凸部が嵌合する孔部を有する第2受け部とを備える打
抜き手段34を用意する。そして、この第2押出し部と
第2受け部との間に板状の予備膜を設けた後に、第2押
出し部と第2受け部との間に荷重を加えて、凸部を孔部
に嵌合させて板状の予備膜を積層体上に打ち抜く。そし
て、この打ち抜かれた予備膜を衝撃緩衝層として用い
る。詳細を以下に説明する。
【0041】先ず、この実施の形態では、予備膜とし
て、銀(Ag)や金(Au)等の導電性粒子を30〜5
0wt%程度、ポリイミド樹脂を10〜20wt%程度、エ
ポキシ樹脂を1〜5wt%程度及びその他低応力材や添加
材等を25〜59wt%程度配合したのち、膜厚が約2×
104〜5×104nmの板状となるように成形した衝撃
緩衝フィルム54(導電率は約1×105S・m-1
度)を用いる。尚、導電性粒子を含有する樹脂をポリイ
ミド樹脂もしくはエポキシ樹脂のいずれか一方としても
良く、このときの配合は、ポリイミド樹脂(もしくは、
エポキシ樹脂)を10〜20wt%程度、導電性粒子を3
0〜50wt%程度、その他低応力材や添加材等を30〜
60wt%程度である。そして、この衝撃緩衝フィルム5
4を、打ち抜き手段34である第2押出し部56と第2
受け部58との間に設けるとともに、積層体22(ここ
では、金属膜16及び保護膜18のみを図示)上の所望
の位置に固定する(図5(A)参照)。次に、第2押出
し部56と第2受け部58との間に好適な荷重を加え
て、第2押出し部の凸部を第1受け部の孔部に嵌合させ
て、衝撃緩衝フィルム54を積層体上に打ち抜く。これ
により、バイアホール20上を覆うように形成された衝
撃緩衝層60が得られる(図5(B)参照)。
【0042】尚、第2押出し部56は、加熱手段として
のヒータ66を埋設しており、約100℃〜200℃に
加熱されている。よって、この打ち抜きの際に、衝撃緩
衝層60として打ち出される衝撃緩衝フィルムは、この
ヒータ66による加熱によって溶融して、積層体22
(ここでは、金属膜16及び保護膜18のみを図示)上
に融着される。
【0043】また、この実施の形態において、ウェハ
(図示せず)上の全ての半導体素子に対する衝撃緩衝層
60を、この打ち抜き手段34によって積層体22上に
一括して形成することができる(図5(C)参照)。
【0044】その後に、衝撃緩衝層60上に導電性を有
する被着層40を形成する。
【0045】この衝撃緩衝層60上に、第1の実施の形
態で既に説明したと同様な方法、材料及び膜で、第1サ
ブ被着層36と第2サブ被着層38とを順次形成してな
る被着層40を形成して、ボンディングパッド30を得
る(図5(D)参照)。
【0046】然る後に、第2工程として、導電性樹脂膜
上にボンディングワイヤを接合して、電気的な接続を行
う。
【0047】そこで、被着層40上に金(Au)からな
るボンディングワイヤ42を接合しワイヤボンディング
を行う(図6(A)参照)。
【0048】尚、図6(B)は、第1工程において、衝
撃緩衝層60の領域を上述よりも大きく構成した場合の
例であり、結果として、ボンディングパッド30を構成
する衝撃緩衝層60が、保護膜18上により広い面積に
わたって形成される。そのため、図2(B)を参照して
既に説明したと同様に、ボンディングワイヤ42を接合
する際の自由度を与えることができる。
【0049】次に、第2工程の後であって、第2工程で
得られた構造体を、封止材中に埋設させて封止処理を行
うとともに、この封止処理によってバイアホール内に衝
撃緩衝層を埋め込む。
【0050】つまり、第2工程で得られた構造体62
を、封止材としてのモールド樹脂64中に埋設させて、
約170℃〜190℃の温度範囲内の好適な温度で、1
×10 7Pの加圧下のもとで封止処理を行う。尚、ボン
ディングワイヤ42のうち、ボンディングパッド30と
接合されていない端部は、不図示である所望の基板の配
線電極と接続されている。
【0051】この封止処理が行われている間に、バイア
ホール20上を覆っていた衝撃緩衝層60が軟化してバ
イアホール20内に完全に充填されるため、ボンディン
グパッド30と金属層16との電気的な接続が完了する
(図7参照)。
【0052】上述した説明から明らかなように、この実
施の形態においても、第1の実施の形態と同様の効果を
得ることができる。
【0053】更に、この実施の形態では、膜厚の均一化
した板状の衝撃緩衝フィルムでボンディングパッドを形
成できるのため、ボンディングパッドとボンディングワ
イヤとの安定した接続(接合)性が得られる。
【0054】また、この実施の形態では、衝撃緩衝層の
形成を、ウェハに対して一括して形成できるので、個々
の半導体素子に対して個別に形成する場合に比べて製造
コストを低減できる。
【0055】以上、この発明の実施の形態における条件
等は、上述の組合せのみに限定されない。よって、任意
好適な段階において好適な条件を組み合わせることで、
この発明を適用させることができる。
【0056】例えば、衝撃緩衝層の形状は、上述の実施
の形態のように連続して形成されている場合のみに限ら
れるものではなく、互いに離間して形成されていても良
い。
【0057】また、積層体の構成は、この発明を適用で
きる構成であれば、上述の実施例の構成のみに限定され
るものではない。
【0058】
【発明の効果】上述した説明から明らかなように、この
発明によれば、ボンディングパッドを構成する衝撃緩衝
層が、ワイヤボンディング時におけるボンディングパッ
ド下の回路構造への衝撃を緩衝する。したがって、回路
構造の損傷(ボンディングダメージ)を低減できるのた
め、製造歩留まりや製品の信頼性が向上する。
【図面の簡単な説明】
【図1】この発明の第1の実施の形態である半導体装置
の製造工程を示す図である。
【図2】この発明の第1の実施の形態である半導体装置
を示す図である。
【図3】この発明の第2の実施の形態である半導体装置
の製造工程を示す図である。
【図4】この発明の第2の実施の形態である半導体装置
を示す図である。
【図5】この発明の第3の実施の形態である半導体装置
の製造工程を示す図である。
【図6】この発明の第3の実施の形態である半導体装置
を示す図である。
【図7】この発明の第3の実施の形態である半導体装置
の製造工程を示す図である。
【符号の説明】
10:半導体基板 12,16:金属膜 14:酸化物膜 18:保護膜 20:バイアホール 22:積層体 24:導電性樹脂供給部 26:導電性樹脂層 28:衝撃緩衝層 30:ボンディングパッド 32:開孔手段 34:打ち抜き手段 36:第1サブ被着層 38:第2サブ被着層 40:被着層 42:ボンディングワイヤ 44:絶縁膜シート 46:第1押出し部 48:第1受け部 50:開孔部 52:拡がり防止膜 54:衝撃緩衝フィルム 56:第2押出し部 58:第2受け部 62:構造体 64:モールド樹脂 66:ヒータ
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7,DB名) H01L 21/60 H01L 21/3205

Claims (7)

    (57)【特許請求の範囲】
  1. 【請求項1】 半導体素子及び該半導体素子と電気的に
    接続された金属層を有する半導体基板と、該金属層上に
    形成され、バイアホールを有するとともに該バイアホー
    ルによって前記金属層を露出させる絶縁層と、前記バイ
    アホールを含む前記絶縁層上に形成され、前記金属層と
    前記バイアホールを介して電気的に接続される導電性の
    衝撃緩衝材から構成される導電性衝撃緩衝層と、該導電
    性衝撃緩衝層を被覆する導電性被覆層とを具え、前記導電性被覆層には、ボンディングワイヤが接合され
    ている ことを特徴とする半導体装置。
  2. 【請求項2】 請求項1に記載の半導体装置において、
    前記衝撃緩衝材は、エポキシ樹脂及びポリイミド樹脂の
    双方またはいずれか一方を含有することを特徴とする半
    導体装置。
  3. 【請求項3】 請求項1または2に記載の半導体装置に
    おいて、前記導電性衝撃緩衝層及び前記導線性被覆層
    は、前記バイアホールを除く前記絶縁層上に所定領域形
    成されているとともに、該所定領域上の前記導電性被覆
    層には、前記ボンディングワイヤが接合されていること
    を特徴とする半導体装置。
  4. 【請求項4】 半導体素子が形成された半導体基板と、
    前記半導体素子と電気的に接続される導電層と、該導電
    層間に設けられた絶縁層とを備えてなる積層体に、該積
    層体の上方から液状の導電性樹脂材を滴下して、前記積
    層体上に導電性樹脂層を形成する第1工程と、 前記導電性樹脂層を加熱によって硬化させて、ボンディ
    ングパッドとしての衝撃緩衝層を得る第2工程と、 前記衝撃緩衝層の上側にボンディングワイヤを接合する
    第3工程とを備えることを特徴とする半導体装置の製造
    方法。
  5. 【請求項5】 請求項に記載の半導体装置の製造方法
    において、前記第2工程と前記第3工程との間に、前記
    衝撃緩衝層の上側に導電性の被着層を形成する工程を更
    に備えることを特徴とする半導体装置の製造方法。
  6. 【請求項6】 請求項4または5に記載の半導体装置の
    製造方法において、前記第1工程の前に、滴下される前
    記導電性樹脂材の流動範囲を制限する拡がり防止膜を、
    前記積層体上に形成する工程を更に備えることを特徴と
    する半導体装置の製造方法。
  7. 【請求項7】 請求項に記載の半導体装置の製造方法
    において、凸部を有する第1押出し部と該凸部が嵌合す
    る凹部を有する第1受け部とを備える開孔手段を用意
    し、前記第1押出し部と前記第1受け部との間に予備膜
    を設けた後に、前記第1押出し部と前記第1受け部との
    間に荷重を加えて前記凸部を前記凹部に嵌合させること
    により前記予備膜に開孔部を形成して、該開孔部を備え
    る前記予備膜を前記拡がり防止膜として用いることを特
    徴とする半導体装置の製造方法。
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WO2004105133A1 (en) * 2003-05-26 2004-12-02 Axalto Sa Wire bonding on in-line connection pads
JP2005032769A (ja) * 2003-07-07 2005-02-03 Seiko Epson Corp 多層配線の形成方法、配線基板の製造方法、デバイスの製造方法
US7071554B2 (en) * 2004-05-27 2006-07-04 Intel Corporation Stress mitigation layer to reduce under bump stress concentration
US20080001288A1 (en) * 2004-11-25 2008-01-03 Yoshimichi Sogawa Semiconductor Device and Manufacturing Method Thereof, Semiconductor Package, and Electronic Apparatus
US8581403B2 (en) 2008-01-30 2013-11-12 Nec Corporation Electronic component mounting structure, electronic component mounting method, and electronic component mounting board
JP2011035037A (ja) * 2009-07-30 2011-02-17 Sony Corp 回路基板の製造方法および回路基板
CN114303045A (zh) * 2019-09-20 2022-04-08 Tdk电子股份有限公司 传感器设备和用于制造传感器设备的方法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5842193A (en) * 1995-07-28 1998-11-24 Sterling Software, Inc. Knowledge based planning and analysis (KbPA)™
US5998875A (en) * 1996-12-19 1999-12-07 Telefonaktiebolaget Lm Ericsson Flip-chip type connection with elastic contacts
US6028354A (en) * 1997-10-14 2000-02-22 Amkor Technology, Inc. Microelectronic device package having a heat sink structure for increasing the thermal conductivity of the package
US6277669B1 (en) * 1999-09-15 2001-08-21 Industrial Technology Research Institute Wafer level packaging method and packages formed

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