JP3303154B2 - 半導体発光素子 - Google Patents

半導体発光素子

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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本願発明は、高輝度特性を得るこ
とができるようにした半導体発光素子に関する。
【0002】
【従来の技術】この種の半導体発光素子の基本的な構成
は、たとえば図8に示すように、基板2eの表面上に、
バッファ層9、n型半導体層3e、発光層4e、および
p型半導体層5eを順次積層させた積層部6eを形成し
た構成となっている。このような半導体発光素子を駆動
させるには、n型半導体層3eとp型半導体層5eとの
各層に電圧印加を行う必要がある。そこで、従来では、
たとえば積層部6eの最表層(最上層)の位置へ一方の
電極8eを形成するとともに、積層部6eの符号Bで示
す部分をエッチングによって除去処理し、このエッチン
グされた領域Bに他方の電極8fを設け、これら一対の
電極8e,8fにワイヤボンディングなどが行えるよう
にしていた。
【0003】
【発明が解決しようとする課題】しかしながら、上記従
来の半導体発光素子では、電極8e,8fを積層部6e
の最表層やエッチング処理した領域Bに設けているため
に、次のような難点があった。
【0004】すなわち、上記半導体発光素子が赤色LE
Dや緑色LEDとして構成された場合には、たとえば基
板2eとして不透明なGaP基板が用いられることによ
り、発光層4eから発せられる光の一部は水平方向に出
射するが、それ以外の大部分の光は積層部6eの最表層
の位置から矢印a方向に沿って外部へ出射する。また、
青色LEDとして構成された場合には、基板2eとして
透光性を有するサファイア基板が用いられ、発光層4e
の光の一部は基板2eの裏面側から出射するものの、や
はり他の残りは積層部6eの最表層の部位から出射す
る。
【0005】ところが、上記従来の半導体発光素子で
は、一方の電極8eを積層部6eの最表層に形成してい
るために、この最表層から出射される光がこの電極8e
によって遮られる。また、積層部6eにエッチング処理
を施した領域Bにおいては、発光層4eが形成されてお
らず、当然ながら発光を行わせることができない。
【0006】したがって、本来ならば、積層部6eの形
成面積Aのほぼ全域を発光させ得るにもかかわらず、実
際には、電極8eの面積A1とエッチング処理された面
積A2との合計の面積分だけ発光面積が減少し、狭くな
っていた。その結果、従来では、実質的な発光強度が低
いものとなっていた。
【0007】本願発明は、このような事情のもとで考え
出されたものであって、半導体発光素子の積層部の最表
面の部位から光を出射させる場合に、この光が電極によ
って遮られるなどして発光輝度が低下することを防止
し、高い発光輝度が効率よく得られるようにすることを
その課題としている。
【0008】
【課題を解決するための手段】上記の課題を解決するた
め、本願発明では、次の技術的手段を講じている。
【0009】本願発明は、基板の表面上に、n型半導体
層、発光層、およびp型半導体層から構成される積層部
が形成され、上記発光層から発せられる光が上記積層部
の最表面の部位から出射するように構成されている半導
体発光素子において、上記積層部の側面部には、上記n
型半導体層とp型半導体層との各層に電圧印加を行うた
めの一対の電極と、これら一対の電極と上記側面部との
間に挟まれた絶縁層と、が形成されているとともに、上
記絶縁層のうち、上記n型半導体層およびp型半導体層
の端面部または端縁部に接触する箇所には絶縁層の除去
処理が施され、この除去処理が施された部位を介して上
記一対の電極がn型半導体層およびp型半導体層に導通
しており、上記基板の裏面には、上記一対の電極のいず
れか一方と導通する導電層が形成されていることを特徴
としている。
【0010】本願発明においては、一対の電極が積層部
の側面部に形成され、しかもこれら一対の電極はn型半
導体層およびp型半導体層の端面部または端縁部と導通
しているために、従来とは異なり、積層部の最表面の部
位が電極によって大きな面積で覆われるようなことはな
い。また、電極を設けるためのスペースを確保する観点
から積層部の一部を大きくエッチングするような必要も
なくなり、発光層を大きな面積に形成することができ
る。したがって、積層部の最表面において発光する部位
の面積を大きくとることができ、発光層から発せられる
光を積層部の最表面から効率よく外部へ出射させること
ができる。その結果、従来に比較し、発光強度を強める
ことができ、発光効率を向上させることができる。
【0011】また、積層部の側面部と各電極との相互間
に絶縁層が形成されているために、たとえば1つの電極
がn型半導体層とp型半導体層の双方に導通して短絡が
生じるなどといった不具合を適切に回避させた上で、各
電極をn型半導体層やp型半導体層の各端面部の面積よ
りも大きな面積に形成することができる。したがって、
n型半導体層やp型半導体層の厚みが小さい場合であっ
ても、各電極を比較的大きな面積に形成することができ
る。その結果、各電極に対してたとえばワイヤボンディ
ングなどの配線作業を行う場合に、その作業を容易に行
うことができる。
【0012】さらに、一対の電極のうち何れか一方の電
極と導通する導電層が基板の裏面に形成されているため
に、この半導体発光素子をたとえばリードフレームにボ
ンディングする場合には、この基板の裏面の導電層をリ
ードフレームに接触させてボンディングすることによ
り、実質的に、この導電層と導通した一方の電極につい
ての電気配線作業を行う手間が省けることとなる。すな
わち、一方の電極は上記導電層を介してリードフレーム
と導通し、結局、ワイヤボンディングなどの電気配線接
続は、他方の電極についてのみ行えばよいこととなる。
したがって、一対の電極に電気配線接続を行う際の作業
が簡素化され、その作業能率を高めることができる。
【0013】
【実施例の説明】以下、本願発明の好ましい実施例を、
図面を参照しつつ具体的に説明する。
【0014】図1に示す半導体発光素子1は、青色LE
Dとして構成されており、絶縁基板である透明または半
透明のサファイア基板2の表面に、n型半導体層3、発
光層4、およびp型半導体層5から構成される積層部6
を形成したものである。この積層部6およびサファイア
基板2の側面部には、絶縁層7a,7b、および一対の
電極8a,8bが各々形成されている。
【0015】積層部6は、サファイア基板2の表面上に
窒化ガリウムのバッファ層9を成長させ、その表面に順
次n型半導体層3などを形成したものである。積層部6
の具体的な構成としては、n型半導体層3が、n型Ga
N層31、およびn型AlGaN層32(Al0.2 Ga
0.8 N)によって形成されている。発光層4は、InG
aN層(In0.15Ga0.85N)によって形成されてい
る。また、p型半導体層5は、p型AlGaN層51
(Al0.2 Ga0.8 N)、およびp型GaN層52によ
って形成されている。なお、上記各層の厚みは、下層側
から各層31,32,4,51,52の順に、たとえば
3μm、300nm、500nm、300nm、150
nmに設定されている。
【0016】絶縁層7a,7bは、積層部6の両側面部
およびファイア基板2の両側面部に、たとえば酸化シリ
コン(SiO2 )製の絶縁膜を形成することにより形成
されている。一方の絶縁層7aは、積層部6の最表面に
位置するp型GaN層52の端面部52Aと接触する箇
所にエッチングが施されている。また他方の絶縁膜7b
は、n型GaN層31の端面部31Aと接触する箇所に
エッチングが施されている。
【0017】電極8a,8bは、たとえば導電製金属な
どの導電性膜を絶縁層7a,7bの外表面に形成するこ
とにより構成されたものである。これらの各電極8a,
8bは、上記絶縁層7a,7bにエッチングが施された
部分にも形成されており、これらエッチングの部位を介
してp型GaN層52の端面部52A、およびn型Ga
N層31の端面部31Aと相互に接触し、導通してい
る。
【0018】次に、上記した半導体発光素子1の製造方
法の一例を説明する。
【0019】まず、図3(a)に示すように、サファイ
ア基板2上に積層部6を形成するが、これは従来既知の
有機金属化学気相成長法(MOCVD法)によって、上
述した各成分の単結晶層を順次成長させることにより行
うことができる。このような積層部6の形成は、所定面
積のウエハに対して行うのが通例であり、積層部6を形
成した後には、ダイシングにより、たとえば平面視にお
いて一辺が0.5mm程度の正方形状のチップに分割す
るという手法が採用される。
【0020】次いで、上記した積層部6の形成およびダ
イシングが終了した後には、図3(b)に示すように、
積層部6およびサファイア基板2の側面部に絶縁層7
a,7bを形成する。この後には、絶縁層7a,7bに
エッチング処理を施し、図3(c)に示すように、最表
層のp型GaN層52の端面部52Aと、n型GaN層
31の端面部31Aとの各箇所に接触した部位の絶縁膜
を一部除去し、スルーホールなどを形成する。絶縁膜の
除去処理方法はエッチング処理に限定されず、レーザー
光の照射手段などを採用してもよい。
【0021】絶縁層7a,7bの一部除去が終了した後
には、これら絶縁層7a,7bの外表面に導電性膜を形
成する。これにより、図1に示したように、p型GaN
層52に導通した電極8aと、n型GaN層31に導通
した電極8bとを形成することができる。絶縁層7a,
7bや電極8a,8bの形成は、スパッタリング法、あ
るいはCVD法などによって行うことができる。
【0022】以上のようにして製造された半導体発光素
子1は、たとえば図2に示すように、リードフレーム1
0のリード10b上にボンディングして用いられるが、
その電気配線接続は、たとえばリード10a、10bに
対して、半導体発光素子1の左右両側面に形成された電
極8a,8bを金線11a,11bを用いてワイヤボン
ディングすればよい。電極8a,8bは、半導体発光素
子1の各一側面部の全域にわたって比較的大きな面積で
形成されているため、ワイヤボンディングを適切に行う
ことが可能である。また、電極8a,8bは比較的大き
な面積で形成されているものの、図1に示すように、こ
れら各電極8a,8bは積層部6の側面部に絶縁層7
a,7bを介して形成されていることにより、これら各
電極8a,8bがp型GaN層52やn型GaN層31
以外の他の層に不当に導通するようなことが適切に防止
されている。したがって、短絡を発生させるようなこと
もない。
【0023】さらに、各電極8a,8bに電圧を印加
し、電流供給を行わせると、発光層4は青色に発光する
が、その光は透明または半透明なサファイア基板2の裏
面側から下方向へ出射する他、積層部6の最表面の部位
から上方向にも出射する。
【0024】このような発光状態において、この半導体
発光素子1の積層部6の表面部に電極は形成されていな
いため、発光層4から発せられる光は効率よく上方向へ
出射することとなる。また、発光層4がエッチングによ
ってその面積が減じられているようなこともなく、発光
層4の発光面積としては、サファイア基板2と同一の大
きな面積に形成しておくことができる。したがって、積
層部6の最表面の部位から上向きに出射される光量を多
くすることができる。
【0025】図4は、本願発明に係る半導体発光素子の
一例を示す断面図である(以後、図1で示した実施例と
同一部位は同一符号で示す)。
【0026】図4に示す半導体発光素子1Aは、その各
部の基本的な構成は、図1で示した半導体発光素子1と
その基本的な構成が共通する。ただし、サファイア基板
2の裏面に、導電層12が形成されている点において、
半導体発光素子1とは相違している。この導電層12の
一端部側は、n型GaN層31に導通した電極8bの下
端部と導通接触するように形成されている。この導電層
12の材質としては、電極8bと同一の導電性材料を用
いることができる。
【0027】この半導体発光素子1Aでは、図5に示す
ように、リードフレーム10にボンディングを行う場合
に、サファイア基板2の裏面の導電層12を、たとえば
導電性接着剤を用いてリード10bに直接ボンディング
させれば、金線を用いて電極8b側をリード10bにワ
イヤボンディングする必要がなくなる。すなわち、他方
の電極8a側のみ金線11aを用いてリード10aにワ
イヤボンディングすればよい。したがって、リードフレ
ーム10へのボンディング作業が一層容易化される。
【0028】また、導電層12は、サファイア基板2の
裏面側に配置されているため、この導電層12が仮に不
透明であっても、積層部6の最表面の部位から上方向へ
出射される光を阻害することはない。したがって、上記
図1で示した半導体発光素子1と同様に、高い発光輝度
が得られる。導電層12は、サファイア基板2の下方へ
出射する光を上方向へ反射させる作用を発揮するため、
積層部6の最表面の部位の発光輝度を一層高める作用も
期待できる。
【0029】なお、上記した実施例では、電極8a,8
bを、積層部6の側面部のみならず、サファイア基板2
の側面部にも一連に形成しているために、各電極8a,
8bの全体の面積を厚みの小さな積層部6の側面部の面
積よりも大きくすることができ、ワイヤボンディングな
どを行う場合に好都合となる。しかし、本願発明は必ず
しもこれに限定されない。たとえば図6に示すように、
絶縁層7a,7b、および一対の電極8a,8bを、サ
ファイア基板2の側面部に形成しない構成とすることも
可能である。
【0030】本願発明においては、たとえば図7に示す
ように、最表層のp型GaN層52の端面部52Aに接
触する絶縁層7aの部位にエッチングを施すことなく、
電極8aをその絶縁層7aの上端よりも上側に延伸させ
ることにより、p型GaN層52の端縁部52Bの上面
52Cに接触させてもよい。このような構成であって
も、電極8aが大きな面積でp型GaN層52を覆うよ
うなことはないため、本願発明の目的は達成される。
【0031】このことは、他方の電極8bについても同
様であり、たとえば上記図7に示すように、この他方の
電極8bをn型GaN層31の端面部31Aに接触させ
ず、たとえばその端縁部31Bの上面31Cに接触させ
て導通させてもよい。この場合、n型GaN層31より
も上方の部位Cをエッチングにより一部除去する手段を
採用するが、この場合のエッチングは、電極8bの全体
をn型GaN層31の上面に形成するための処理ではな
く、あくまでも電極8bの一部をn型GaN層31に接
触させて導通させるための僅かな領域のエッチング処理
でよい。したがって、このようなエッチング処理によっ
て発光層4の面積が大幅に減少するようなことはなく、
やはり高い発光輝度を得ることが可能である。
【0032】本願発明に係る半導体発光素子は、上記し
た青色の発光LEDに限定されず、これ以外の赤色や緑
色の発光LEDなどにも当然に適用することが可能であ
る。したがって、基板2の具体的な材質などが限定され
ないことは勿論のこと、積層部6を構成するn型半導体
層、発光層、およびp型半導体層の具体的な材質なども
上記実施例に限定されない。本願発明に係る半導体発光
素子の各部の具体的な構成は種々に設計変更自在であ
る。また、その具体的な製造方法も種々に変更自在であ
る。
【図面の簡単な説明】
【図1】半導体発光素子の一例を示す断面図である。
【図2】図1に示す半導体発光素子をリードフレームに
ボンディングした一例を示す説明図である。
【図3】( a)〜(c)は、図1に示す半導体発光素
子の製造方法の一例を示す断面図である。
【図4】本願発明に係る半導体発光素子の一例を示す断
面図である。
【図5】図4に示す半導体発光素子をリードフレームに
ボンディングした一例を示す説明図である。
【図6】半導体発光素子の他の例を示す断面図である。
【図7】半導体発光素子の他の例を示す断面図。
【図8】従来の半導体発光素子の一例を示す断面図。
【符号の説明】
1,1A 半導体発光素子 2 基板(サファイア基板) 3 n型半導体層 4 発光層 5 p型半導体層 6 積層部 7a,7b 絶縁層 8a,8b 電極

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項1】 基板の表面上に、n型半導体層、発光
    層、およびp型半導体層から構成される積層部が形成さ
    れ、上記発光層から発せられる光が上記積層部の最表面
    の部位から出射するように構成されている半導体発光素
    子において、上記積層部の側面部には、 上記n型半導体層とp型半導
    体層との各層に電圧印加を行うための一対の電極と、こ
    れら一対の電極と上記側面部との間に挟まれた絶縁層
    と、が形成されているとともに、 上記絶縁層のうち、上記n型半導体層およびp型半導体
    層の端面部または端縁部に接触する箇所には絶縁層の除
    去処理が施され、この除去処理が施された部位を介して
    上記一対の電極がn型半導体層およびp型半導体層に導
    通しており、 上記基板の裏面には、上記一対の電極のいずれか一方と
    導通する導電層が形成されて いることを特徴とする、半
    導体発光素子。
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* Cited by examiner, † Cited by third party
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10294493A (ja) * 1997-02-21 1998-11-04 Toshiba Corp 半導体発光デバイス
JP4644947B2 (ja) * 2001-02-05 2011-03-09 日亜化学工業株式会社 窒化物半導体素子及びその製造方法
WO2008143635A1 (en) 2007-01-17 2008-11-27 The Board Of Trustees Of The University Of Illinois Optical systems fabricated by printing-based assembly
KR101007128B1 (ko) * 2009-02-19 2011-01-10 엘지이노텍 주식회사 발광소자 및 그 제조방법
JP2010283125A (ja) * 2009-06-04 2010-12-16 Disco Abrasive Syst Ltd 発光ダイオード
KR101707118B1 (ko) * 2010-10-19 2017-02-15 엘지이노텍 주식회사 발광소자 및 그 발광 소자의 제조 방법
JP6032823B2 (ja) * 2012-09-27 2016-11-30 富士機械製造株式会社 半導体装置及びその製造方法
CN103400916A (zh) * 2013-08-21 2013-11-20 深圳市凯信光电有限公司 一种led晶片结构
DE102014102029A1 (de) 2014-02-18 2015-08-20 Osram Opto Semiconductors Gmbh Verfahren zur Herstellung von Halbleiterbauelementen und Halbleiterbauelement
JP6637703B2 (ja) 2015-09-10 2020-01-29 アルパッド株式会社 半導体発光装置

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20130074037A (ko) * 2011-12-26 2013-07-04 엘지이노텍 주식회사 발광소자
KR101886153B1 (ko) * 2011-12-26 2018-09-11 엘지이노텍 주식회사 발광소자

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