JP3299755B2 - 制御システム - Google Patents
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- 238000009434 installation Methods 0.000 description 4
- 238000012423 maintenance Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 2
- 230000003044 adaptive effect Effects 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/06—Addressing a physical block of locations, e.g. base addressing, module addressing, memory dedication
- G06F12/0646—Configuration or reconfiguration
- G06F12/0669—Configuration or reconfiguration with decentralised address assignment
- G06F12/0676—Configuration or reconfiguration with decentralised address assignment the address being position dependent
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- Engineering & Computer Science (AREA)
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- General Engineering & Computer Science (AREA)
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- Crystals, And After-Treatments Of Crystals (AREA)
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- Vehicle Body Suspensions (AREA)
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- Selective Calling Equipment (AREA)
- Exchange Systems With Centralized Control (AREA)
Description
【発明の詳細な説明】 発明の分野 本発明は、マザーボードと、少なくとも１つの補助カ
ードとを備えた制御システムであって、上記マザーボー
ドは、少なくとも２つの補助カードコネクタと、制御ア
ドレス及び制御データを転送する制御バスとを有し、上
記補助カードは、上記補助カードコネクタの１つに接続
され、そして上記制御バスを経て選択的に制御するため
の制御アドレスを有しているような制御システムに係
る。
ードとを備えた制御システムであって、上記マザーボー
ドは、少なくとも２つの補助カードコネクタと、制御ア
ドレス及び制御データを転送する制御バスとを有し、上
記補助カードは、上記補助カードコネクタの１つに接続
され、そして上記制御バスを経て選択的に制御するため
の制御アドレスを有しているような制御システムに係
る。
先行技術 種々の種類の制御システムにおいては、通常、マスタ
ーユニットが共通の制御バスを経てスレーブユニットを
制御する。バスに接続された各制御ユニットは、それに
アドレスされたコマンドを、共通バスに与えられたコマ
ンドの中から識別するための制御アドレス（識別子）を
有している。スレーブユニットを実施するモジュール又
は回路カードにおいては、制御アドレスが固定布線によ
って作られるか、又は例えば、スイッチによってアドレ
スをセットすることができる。或いは又、各モジュール
又はカードがマスターユニットから専用の制御信号を受
け取ってもよい。この公知の解決策の欠点は、他に同じ
カードがある場合に、各カードにセットされた又はセッ
トされるべきアドレスを知る必要があることである。使
用されるモジュール及びカードは、製造、販売、設置又
は保守が異なるから、それらの設置には、特定の設定や
同調が必要となる。
ーユニットが共通の制御バスを経てスレーブユニットを
制御する。バスに接続された各制御ユニットは、それに
アドレスされたコマンドを、共通バスに与えられたコマ
ンドの中から識別するための制御アドレス（識別子）を
有している。スレーブユニットを実施するモジュール又
は回路カードにおいては、制御アドレスが固定布線によ
って作られるか、又は例えば、スイッチによってアドレ
スをセットすることができる。或いは又、各モジュール
又はカードがマスターユニットから専用の制御信号を受
け取ってもよい。この公知の解決策の欠点は、他に同じ
カードがある場合に、各カードにセットされた又はセッ
トされるべきアドレスを知る必要があることである。使
用されるモジュール及びカードは、製造、販売、設置又
は保守が異なるから、それらの設置には、特定の設定や
同調が必要となる。
発明の要旨 本発明の目的は、上記問題を解消する制御システムを
提供することである。
提供することである。
これは、本発明によれば、最初に述べた形式の制御シ
ステムにおいて、制御アドレスがカード位置指向のもの
であり、補助カードの制御アドレスは、補助カードが補
助カードコネクタに接続されるまで決定されず、更に、
マザーボードは、補助カードコネクタに接続される手段
であって、補助カードコネクタを経て補助カードへカー
ド位置の制御アドレスデータを与える手段を備えている
ことを特徴とする制御システムによって達成される。
ステムにおいて、制御アドレスがカード位置指向のもの
であり、補助カードの制御アドレスは、補助カードが補
助カードコネクタに接続されるまで決定されず、更に、
マザーボードは、補助カードコネクタに接続される手段
であって、補助カードコネクタを経て補助カードへカー
ド位置の制御アドレスデータを与える手段を備えている
ことを特徴とする制御システムによって達成される。
本発明においては、補助カードの制御アドレスはカー
ドコネクタ指向のものであり、これらは、配線によって
セットされるか、スイッチによってセットされるか、又
はマザーボード上の他の対応する仕方でセットされる。
補助カードがマザーボードの補助カードコネクタに接続
されたときには、補助カードは、常に、マザーボードか
らコネクタを経て正しいアドレスを得る。本発明によれ
ば、ユーザは、必要なアドレスデータを個別にセットす
る必要はなく、これは、組み立て、テスト、設置及び保
守を容易にする。更に、補助カードは同一のものであ
り、制御アドレスについても、製造、販売、設置又は保
守についても、何ら相違点をもたない。
ドコネクタ指向のものであり、これらは、配線によって
セットされるか、スイッチによってセットされるか、又
はマザーボード上の他の対応する仕方でセットされる。
補助カードがマザーボードの補助カードコネクタに接続
されたときには、補助カードは、常に、マザーボードか
らコネクタを経て正しいアドレスを得る。本発明によれ
ば、ユーザは、必要なアドレスデータを個別にセットす
る必要はなく、これは、組み立て、テスト、設置及び保
守を容易にする。更に、補助カードは同一のものであ
り、制御アドレスについても、製造、販売、設置又は保
守についても、何ら相違点をもたない。
図面の簡単な説明 以下、添付図面を参照し、本発明の好ましい実施例を
説明する。
説明する。
図１は、ベースステーションにおいてコンバイナフィ
ルタを制御するための本発明による制御システムのブロ
ック図である。
ルタを制御するための本発明による制御システムのブロ
ック図である。
図２は、マザーボードからコネクタを経て補助カード
へ制御アドレスデータを入力するところを示す図であ
る。
へ制御アドレスデータを入力するところを示す図であ
る。
好ましい実施例の詳細な説明 原理的に、本発明は、異なる制御アドレスをもつ多数
の同一の補助カードを、共通の制御バスを含むマザーボ
ード又はバスカードに接続すべきであるいかなる制御装
置にも適用できる。しかしながら、以下の説明では、本
発明は、無線システムのベースステーションにおけるコ
ンバイナフィルタを制御する制御システムによって例示
する。ベースステーションにおいては、多数の無線送信
器が１つのアンテナ又はアンテナラインに接続され、各
無線送信器は、その無線送信器の送信周波数に中心周波
数が同調されたそれ自身のバンドパスフィルタを経て接
続される。この種のバンドパスフィルタは、コンバイナ
フィルタと称する。コンバイナフィルタは、送信信号を
その関連無線送信器からできるだけ低い電力ロスでアン
テナへ供給する一方、異なる周波数の他の無線送信器に
よりアンテナの方向からその関連無線送信器へと発生さ
れる送信信号の漏れをできるだけ効率良く防止するもの
である。これらのコンバイナバンドパスフィルタは、所
定の送信周波数に同定同調されてもよいし、或いはコン
バイナフィルタは所望の周波数に同調可能であってもよ
い。後者の場合、通常は、適応制御がコンバイナフィル
タに関連され、フィルタにおけるロスを最小にする。
の同一の補助カードを、共通の制御バスを含むマザーボ
ード又はバスカードに接続すべきであるいかなる制御装
置にも適用できる。しかしながら、以下の説明では、本
発明は、無線システムのベースステーションにおけるコ
ンバイナフィルタを制御する制御システムによって例示
する。ベースステーションにおいては、多数の無線送信
器が１つのアンテナ又はアンテナラインに接続され、各
無線送信器は、その無線送信器の送信周波数に中心周波
数が同調されたそれ自身のバンドパスフィルタを経て接
続される。この種のバンドパスフィルタは、コンバイナ
フィルタと称する。コンバイナフィルタは、送信信号を
その関連無線送信器からできるだけ低い電力ロスでアン
テナへ供給する一方、異なる周波数の他の無線送信器に
よりアンテナの方向からその関連無線送信器へと発生さ
れる送信信号の漏れをできるだけ効率良く防止するもの
である。これらのコンバイナバンドパスフィルタは、所
定の送信周波数に同定同調されてもよいし、或いはコン
バイナフィルタは所望の周波数に同調可能であってもよ
い。後者の場合、通常は、適応制御がコンバイナフィル
タに関連され、フィルタにおけるロスを最小にする。
図１は、コンバイナフィルタの制御システムを示して
いる。この制御システムの例示的なユニットは、共通の
制御バス６を含むマザーボード１である。このマザーボ
ード１は、カードコネクタ９によってマスター制御カー
ド５に接続され、これは、制御アドレス及び制御データ
をバス６に出力する。又、マザーボード１は、少なくと
も２つの補助カードコネクタ2A、2B及び2Cを備えてい
る。補助カード、この実施例ではステッパモータ制御カ
ード3A、3B及び3Cは、各コネクタ2A、2B及び2Cに各々挿
入される。更に、マザーボード１は、カードコネクタに
よって直接的にか又はケーブルにより、１群のコンバイ
ナフィルタユニット４に接続される。このコンバイナフ
ィルタユニットの各々は、コンバイナフィルタの中心周
波数を機械的に制御するステッパモータ42を備えてい
る。又、コンバイナフィルタカード４は、制御ロジック
41を備え、これは、対応するステッパモータ制御カード
3A、3B又は3Cから対応するモータ制御バスＭ−R1ないし
10を経て制御信号45を受け取る。又、コンバイナカード
４は、モータ42が末端位置、例えばゼロ位置にあるとき
を指示する少なくとも１つのガードスイッチユニット45
を備えている。このカードスイッチ45の状態は、ガード
スイッチ状態ライン44により対応するステッパモータ制
御カード3A、3B又は3Cへ指示される。状態ライン44は、
各モータ制御バスＭ−R1ないし10の一部分である。
いる。この制御システムの例示的なユニットは、共通の
制御バス６を含むマザーボード１である。このマザーボ
ード１は、カードコネクタ９によってマスター制御カー
ド５に接続され、これは、制御アドレス及び制御データ
をバス６に出力する。又、マザーボード１は、少なくと
も２つの補助カードコネクタ2A、2B及び2Cを備えてい
る。補助カード、この実施例ではステッパモータ制御カ
ード3A、3B及び3Cは、各コネクタ2A、2B及び2Cに各々挿
入される。更に、マザーボード１は、カードコネクタに
よって直接的にか又はケーブルにより、１群のコンバイ
ナフィルタユニット４に接続される。このコンバイナフ
ィルタユニットの各々は、コンバイナフィルタの中心周
波数を機械的に制御するステッパモータ42を備えてい
る。又、コンバイナフィルタカード４は、制御ロジック
41を備え、これは、対応するステッパモータ制御カード
3A、3B又は3Cから対応するモータ制御バスＭ−R1ないし
10を経て制御信号45を受け取る。又、コンバイナカード
４は、モータ42が末端位置、例えばゼロ位置にあるとき
を指示する少なくとも１つのガードスイッチユニット45
を備えている。このカードスイッチ45の状態は、ガード
スイッチ状態ライン44により対応するステッパモータ制
御カード3A、3B又は3Cへ指示される。状態ライン44は、
各モータ制御バスＭ−R1ないし10の一部分である。
本発明によれば、ステッパモータ制御カード3A、3B及
び3Cは、同一のものであって、カードコネクタ2A、2B及
び2Cによって形成されたカード位置に自由に配列するこ
とができる。各カードコネクタ2A、2B及び2Cに対し、専
用のカード位置指向の制御アドレスエンコード回路8A、
8B及び8Cが、例えば、固定布線、調整可能なコードスイ
ッチ又は他の何らかの対応する手段によって、マザーボ
ード１上に設けられている。エンコードされた制御アド
レスデータは、カードコネクタ2A、2B及び2Cにおける所
定の信号ラインに接続されている。例えば、制御カード
3Aがコネクタ2Aに挿入されたときには、マザーボード１
の制御アドレスコード8Aがコネクタ2Aを経て制御カード
3A内のライン10に接続され、そこから、制御カード3Aの
制御ユニット31によって読み取ることができる。図２の
実施例では、マザーボード１に配線された２ビットの制
御アドレス「01」をコネクタ2Aを経て制御カード3Aによ
って読み取ることができる。制御アドレスは、制御カー
ド3Aに、このカード位置においてバス６のどのコマンド
に応答すべきかそしてどのコンバイナユニットが制御さ
れるかを指示する。これと対応的に、制御カード3Bは、
マザーボードに配線された２ビットの制御アドレス「1
1」をコネクタ2Bを経て受け取る。
び3Cは、同一のものであって、カードコネクタ2A、2B及
び2Cによって形成されたカード位置に自由に配列するこ
とができる。各カードコネクタ2A、2B及び2Cに対し、専
用のカード位置指向の制御アドレスエンコード回路8A、
8B及び8Cが、例えば、固定布線、調整可能なコードスイ
ッチ又は他の何らかの対応する手段によって、マザーボ
ード１上に設けられている。エンコードされた制御アド
レスデータは、カードコネクタ2A、2B及び2Cにおける所
定の信号ラインに接続されている。例えば、制御カード
3Aがコネクタ2Aに挿入されたときには、マザーボード１
の制御アドレスコード8Aがコネクタ2Aを経て制御カード
3A内のライン10に接続され、そこから、制御カード3Aの
制御ユニット31によって読み取ることができる。図２の
実施例では、マザーボード１に配線された２ビットの制
御アドレス「01」をコネクタ2Aを経て制御カード3Aによ
って読み取ることができる。制御アドレスは、制御カー
ド3Aに、このカード位置においてバス６のどのコマンド
に応答すべきかそしてどのコンバイナユニットが制御さ
れるかを指示する。これと対応的に、制御カード3Bは、
マザーボードに配線された２ビットの制御アドレス「1
1」をコネクタ2Bを経て受け取る。
又、制御カード3Aは、対応するカード位置の制御アド
レスが制御バス６上にあるときに、ガードスイッチ状態
データ44をコンバイナカード４からマザーボード１上の
１つ以上の共通のカードスイッチ状態ライン７に切り換
えるためのスイッチング手段32も備えている。制御ユニ
ット１は、バス６を監視し、そして制御信号33によりス
イッチングユニット32を制御する。
レスが制御バス６上にあるときに、ガードスイッチ状態
データ44をコンバイナカード４からマザーボード１上の
１つ以上の共通のカードスイッチ状態ライン７に切り換
えるためのスイッチング手段32も備えている。制御ユニ
ット１は、バス６を監視し、そして制御信号33によりス
イッチングユニット32を制御する。
又、マザーボード１上のエンコード回路8A、8B及び8C
は、他の固定カード位置指向の制御情報、例えば、制御
されるべきコンバイナユニットの周波数データを含んで
もよい。
は、他の固定カード位置指向の制御情報、例えば、制御
されるべきコンバイナユニットの周波数データを含んで
もよい。
添付図面及び上記説明は、単に本発明を解説するもの
に過ぎないことを理解されたい。その細部において、本
発明の制御システムは、請求の範囲内で変更し得るもの
である。
に過ぎないことを理解されたい。その細部において、本
発明の制御システムは、請求の範囲内で変更し得るもの
である。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平５−75303（ＪＰ，Ａ) 特開 昭60−201461（ＪＰ，Ａ) 特開 昭62−193598（ＪＰ，Ａ) 実開 昭62−151656（ＪＰ，Ｕ) (58)調査した分野(Int.Cl.7，ＤＢ名) G06F 13/10 - 13/14
Claims (4)
- 【請求項１】無線システムのコンバイナフィルタを制御
するための制御システムにおいて、 少なくとも２つの補助カードコネクタ、制御アドレス及
び制御データを転送する制御バス及び上記補助カードコ
ネクタの各々に関連付けられていて、各補助カードが各
補助カードコネクタへ挿入されるとき該補助カードコネ
クタを介して該補助カードへカードコネクタ特定制御ア
ドレスを与えるためのアドレスロジックを有しているマ
ザーボードと、 各々がステッパモータ、該ステッパモータのための制御
ユニット及びガードスイッチユニットを備えた複数のコ
ンバイナフィルタと、 各々が補助カードとして上記補助カードコネクタの各々
に挿入され、該補助カードコネクタの上記コネクタ特定
制御アドレスを採用するステッパモータ制御カードを備
える少なくとも１つのステッパモータ制御カードフィル
タユニットと、 上記マザーボードに接続され、上記挿入された各ステッ
パモータ制御カードを選択的に制御するためのマスター
制御器と、 上記マスター制御器と上記挿入された各ステッパモータ
制御カードとの間において上記挿入された各ステッパモ
ータ制御カードに共通の少なくとも１つのカードスイッ
チ状態ラインと、 を備えており、上記挿入された各ステッパモータ制御カ
ードは、各補助カードコネクタの上記コネクタ特定制御
アドレスが上記制御バスに現れるとき、各コンバイナフ
ィルタユニットから受け取ったガードスイッチ状態デー
タを上記共通のスイッチ状態ラインへと供給するように
構成されていることを特徴とする制御システム。 - 【請求項２】上記アドレスロジックは、上記マザーボー
ド上の布線されたエンコード回路を含む請求項１に記載
の制御システム。 - 【請求項３】上記アドレスロジックは、上記マザーボー
ド上のエンコードスイッチを含む請求項１に記載の制御
システム。 - 【請求項４】上記アドレスロジックは、更に、カード位
置に関する他の固定制御情報を上記カードコネクタを経
て上記補助カードへ与える請求項１または２または３に
記載の制御システム。
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| FI925779A FI93589C (fi) | 1992-12-18 | 1992-12-18 | Ohjausjärjestelmä |
| FI925779 | 1992-12-18 | ||
| PCT/FI1993/000545 WO1994015291A1 (en) | 1992-12-18 | 1993-12-17 | Control system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07504059A JPH07504059A (ja) | 1995-04-27 |
| JP3299755B2 true JP3299755B2 (ja) | 2002-07-08 |
Family
ID=8536426
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP51484694A Expired - Fee Related JP3299755B2 (ja) | 1992-12-18 | 1993-12-17 | 制御システム |
Country Status (9)
| Country | Link |
|---|---|
| US (1) | US5504671A (ja) |
| EP (1) | EP0627101B1 (ja) |
| JP (1) | JP3299755B2 (ja) |
| AT (1) | ATE181431T1 (ja) |
| AU (1) | AU669042B2 (ja) |
| DE (1) | DE69325365T2 (ja) |
| FI (1) | FI93589C (ja) |
| NO (1) | NO309118B1 (ja) |
| WO (1) | WO1994015291A1 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US7610063B2 (en) * | 2003-05-09 | 2009-10-27 | Alcatel-Lucent Usa Inc. | System for determining information for circuit packs connected by a single line bus |
Family Cites Families (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4670855A (en) * | 1982-02-24 | 1987-06-02 | Digital Equipment Corporation | Interchangeable interface circuit structure |
| DE3236812A1 (de) * | 1982-10-05 | 1984-04-05 | Standard Elektrik Lorenz Ag, 7000 Stuttgart | Fernwirksystem |
| US4726071A (en) * | 1984-12-31 | 1988-02-16 | Orion Industries, Inc. | Microprocessor controlled self-tuning resonant cavity and method |
| US4813014A (en) * | 1986-04-14 | 1989-03-14 | Phi Technologies, Inc. | Digital audio memory system |
| US4905182A (en) * | 1987-03-13 | 1990-02-27 | Apple Computer, Inc. | Self-configuring memory management system with on card circuitry for non-contentious allocation of reserved memory space among expansion cards |
| US4964038A (en) * | 1987-10-28 | 1990-10-16 | International Business Machines Corp. | Data processing system having automatic address allocation arrangements for addressing interface cards |
| WO1990014621A1 (en) * | 1989-05-24 | 1990-11-29 | Hitachi, Ltd. | Sequence controller system |
| US5265238A (en) * | 1991-01-25 | 1993-11-23 | International Business Machines Corporation | Automatic device configuration for dockable portable computers |
| CA2092486C (en) * | 1992-05-11 | 1999-05-11 | Vincent Ferri | Automatic slot identification and address decoding system |
-
1992
- 1992-12-18 FI FI925779A patent/FI93589C/fi active IP Right Grant
-
1993
- 1993-12-17 EP EP94901981A patent/EP0627101B1/en not_active Expired - Lifetime
- 1993-12-17 WO PCT/FI1993/000545 patent/WO1994015291A1/en active IP Right Grant
- 1993-12-17 DE DE69325365T patent/DE69325365T2/de not_active Expired - Fee Related
- 1993-12-17 US US08/290,830 patent/US5504671A/en not_active Expired - Lifetime
- 1993-12-17 AU AU56527/94A patent/AU669042B2/en not_active Ceased
- 1993-12-17 JP JP51484694A patent/JP3299755B2/ja not_active Expired - Fee Related
- 1993-12-17 AT AT94901981T patent/ATE181431T1/de not_active IP Right Cessation
-
1994
- 1994-08-17 NO NO943048A patent/NO309118B1/no not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| FI925779A0 (fi) | 1992-12-18 |
| JPH07504059A (ja) | 1995-04-27 |
| FI93589C (fi) | 1995-04-25 |
| AU5652794A (en) | 1994-07-19 |
| EP0627101A1 (en) | 1994-12-07 |
| DE69325365D1 (de) | 1999-07-22 |
| NO943048D0 (no) | 1994-08-17 |
| ATE181431T1 (de) | 1999-07-15 |
| WO1994015291A1 (en) | 1994-07-07 |
| NO943048L (no) | 1994-08-17 |
| FI93589B (fi) | 1995-01-13 |
| DE69325365T2 (de) | 1999-11-18 |
| EP0627101B1 (en) | 1999-06-16 |
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| AU669042B2 (en) | 1996-05-23 |
| NO309118B1 (no) | 2000-12-11 |
| US5504671A (en) | 1996-04-02 |
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