JP3202416B2 - 同期整流コンバータ - Google Patents
同期整流コンバータInfo
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- JP3202416B2 JP3202416B2 JP14841093A JP14841093A JP3202416B2 JP 3202416 B2 JP3202416 B2 JP 3202416B2 JP 14841093 A JP14841093 A JP 14841093A JP 14841093 A JP14841093 A JP 14841093A JP 3202416 B2 JP3202416 B2 JP 3202416B2
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Description
【0001】
【産業上の利用分野】本発明は同期整流コンバータの改
良に関するもので、特に他の直流電源と並列接続して用
いることのできる同期整流コンバータに関するものであ
る。
良に関するもので、特に他の直流電源と並列接続して用
いることのできる同期整流コンバータに関するものであ
る。
【0002】
【従来の技術】従来、この種の同期整流回路を用いたD
C−DCコンバータとしては、図3に示すように、直流
入力電源1の直流電圧を、半導体スイッチ2のスイッチ
ング動作によって矩形波パルス電圧に変換し、この矩形
波パルス電圧をトランス3によって所望の電圧に変換し
た後、半導体整流素子(同期整流FET)4および(転
流FET)5の整流回路と、チョークコイル6およびコ
ンデンサ7による平滑回路により整流・平滑して、その
平均値電圧として取り出すようにしている。なお、前記
した半導体スイッチ2のスイッチング動作の制御は、こ
の同期整流コンバータの出力電圧を検出する電圧検出制
御回路8により、その検出状況に基づいて制御される。
C−DCコンバータとしては、図3に示すように、直流
入力電源1の直流電圧を、半導体スイッチ2のスイッチ
ング動作によって矩形波パルス電圧に変換し、この矩形
波パルス電圧をトランス3によって所望の電圧に変換し
た後、半導体整流素子(同期整流FET)4および(転
流FET)5の整流回路と、チョークコイル6およびコ
ンデンサ7による平滑回路により整流・平滑して、その
平均値電圧として取り出すようにしている。なお、前記
した半導体スイッチ2のスイッチング動作の制御は、こ
の同期整流コンバータの出力電圧を検出する電圧検出制
御回路8により、その検出状況に基づいて制御される。
【0003】一般に同期整流回路の場合は、前述した図
3のように整流素子4,5として半導体スイッチを用い
て同期動作させる場合と、同期整流素子4のみに半導体
スイッチを用いて同期動作させる場合とがあるが、本発
明は変換効率の向上を重視した前者の回路、即ち、同期
整流素子4,5を共に電界効果型の半導体スイッチ(F
ET)を用いた回路を対象としている。そこで前記半導
体整流素子4を同期整流FET4、前記半導体整流素子
5を転流FET5と表現する。なお、転流FET5では
転流期間全域に亘ってゲート信号を得ることができない
ので、通常は転流用ダイオード9を付加してある。そし
て、このような同期整流コンバータは、小容量から大容
量のものまで取り揃え、負荷容量に応じた同期整流コン
バータを選択して用いられるようにしている。
3のように整流素子4,5として半導体スイッチを用い
て同期動作させる場合と、同期整流素子4のみに半導体
スイッチを用いて同期動作させる場合とがあるが、本発
明は変換効率の向上を重視した前者の回路、即ち、同期
整流素子4,5を共に電界効果型の半導体スイッチ(F
ET)を用いた回路を対象としている。そこで前記半導
体整流素子4を同期整流FET4、前記半導体整流素子
5を転流FET5と表現する。なお、転流FET5では
転流期間全域に亘ってゲート信号を得ることができない
ので、通常は転流用ダイオード9を付加してある。そし
て、このような同期整流コンバータは、小容量から大容
量のものまで取り揃え、負荷容量に応じた同期整流コン
バータを選択して用いられるようにしている。
【0004】
【発明が解決しようとする課題】しかし、負荷容量に応
じた同期整流コンバータを用意するということは、その
機種数を多くすることであり、各機種毎に在庫を必要と
することになるため、設計、生産および物品管理の上か
ら機種数の削減が望まれており、同一機種の並列接続に
よる大容量負荷への対応が検討されているが、図3に示
してある従来の同期整流コンバータを並列接続して用い
る場合や、他の直流電源(電池等)を並列接続して用い
る場合には、次ような問題が生ずる。即ち、出力端子1
0,11に前述したように同種の他の同期整流コンバー
タや、電池等の外部直流電源12が並列接続されている
場合において、この並列接続された他の電源の方が、本
同期整流コンバータの出力電圧よりも相対的に電圧が高
くなり、電圧検出制御回路8がこれを検知して半導体ス
イッチ2の動作を停止させた場合や、本同期整流コンバ
ータがその保護装置の動作等により電力供給を停止した
場合には、出力端子10,11から外部直流電源12の
電圧が供給されて、同期整流FET4および転流FET
5のゲートに印加されることになり、両FET4,5は
導通状態が継続されることになる。これは、整流素子と
してFETを用いるとき、そのゲートのバイアスがソー
ス電位に対して正常であれば、この両FET4,5のド
レイン−ソース間にはどちらの方向にも電流が流れるこ
とができるので出力端子から電流は逆流入し、やがては
破壊される可能性がある。本発明は、出力端子10,1
1に並列接続される外部直流電源12の電圧が、本体の
同期整流コンバータの出力電圧よりも高い電圧になるこ
となどによって、本同期整流コンバータが不動作状態に
なった場合においても、同期整流FET4および転流F
ET5が外部直流電源12によってオン状態にならない
ようにした同期整流コンバータを提供するものである。
じた同期整流コンバータを用意するということは、その
機種数を多くすることであり、各機種毎に在庫を必要と
することになるため、設計、生産および物品管理の上か
ら機種数の削減が望まれており、同一機種の並列接続に
よる大容量負荷への対応が検討されているが、図3に示
してある従来の同期整流コンバータを並列接続して用い
る場合や、他の直流電源(電池等)を並列接続して用い
る場合には、次ような問題が生ずる。即ち、出力端子1
0,11に前述したように同種の他の同期整流コンバー
タや、電池等の外部直流電源12が並列接続されている
場合において、この並列接続された他の電源の方が、本
同期整流コンバータの出力電圧よりも相対的に電圧が高
くなり、電圧検出制御回路8がこれを検知して半導体ス
イッチ2の動作を停止させた場合や、本同期整流コンバ
ータがその保護装置の動作等により電力供給を停止した
場合には、出力端子10,11から外部直流電源12の
電圧が供給されて、同期整流FET4および転流FET
5のゲートに印加されることになり、両FET4,5は
導通状態が継続されることになる。これは、整流素子と
してFETを用いるとき、そのゲートのバイアスがソー
ス電位に対して正常であれば、この両FET4,5のド
レイン−ソース間にはどちらの方向にも電流が流れるこ
とができるので出力端子から電流は逆流入し、やがては
破壊される可能性がある。本発明は、出力端子10,1
1に並列接続される外部直流電源12の電圧が、本体の
同期整流コンバータの出力電圧よりも高い電圧になるこ
となどによって、本同期整流コンバータが不動作状態に
なった場合においても、同期整流FET4および転流F
ET5が外部直流電源12によってオン状態にならない
ようにした同期整流コンバータを提供するものである。
【0005】
【課題を解決するための手段】本願の第1の発明による
同期整流コンバータは、直流入力電圧をスイッチング素
子により矩形波パルス電圧に変換してトランスの1次巻
線に印加し、そのトランスの2次巻線で取り出された所
望の電圧パルスを、同期整流FET、転流FET、チョ
ークコイル、コンデンサ等により整流・平滑して直流電
圧を出力すると共に、該直流出力電圧を検知して前記ス
イッチング素子の動作を制御する電圧検出制御回路を備
えた同期整流コンバータにおいて、前記同期整流FET
はそのゲートを出力端子の負極側に接続せしめて当該同
期整流コンバータに並列接続される外部直流電源によっ
て動作されないようにすると共に、前記トランスの1次
側または2次側の電流値を検出し、その検出電流値が所
定値以下になった場合に前記転流FETをオフ動作せし
めるスイッチ回路を設け、前記外部直流電源によって当
該同期整流コンバータの出力端の直流電圧が所定電圧以
上に上昇した場合に、前記スイッチ回路を介して前記転
流FETを不動作状態にするものである。
同期整流コンバータは、直流入力電圧をスイッチング素
子により矩形波パルス電圧に変換してトランスの1次巻
線に印加し、そのトランスの2次巻線で取り出された所
望の電圧パルスを、同期整流FET、転流FET、チョ
ークコイル、コンデンサ等により整流・平滑して直流電
圧を出力すると共に、該直流出力電圧を検知して前記ス
イッチング素子の動作を制御する電圧検出制御回路を備
えた同期整流コンバータにおいて、前記同期整流FET
はそのゲートを出力端子の負極側に接続せしめて当該同
期整流コンバータに並列接続される外部直流電源によっ
て動作されないようにすると共に、前記トランスの1次
側または2次側の電流値を検出し、その検出電流値が所
定値以下になった場合に前記転流FETをオフ動作せし
めるスイッチ回路を設け、前記外部直流電源によって当
該同期整流コンバータの出力端の直流電圧が所定電圧以
上に上昇した場合に、前記スイッチ回路を介して前記転
流FETを不動作状態にするものである。
【0006】本願の第2の発明による同期整流コンバー
タは、直流入力電圧をスイッチング素子により矩形波パ
ルス電圧に変換してトランスの1次巻線に印加し、その
トランスの2次巻線で取り出された所望の電圧パルス
を、同期整流FET、転流FET、チョークコイル、コ
ンデンサ等により整流・平滑して直流電圧を出力すると
共に、該直流出力電圧を検知して前記スイッチング素子
の動作を制御する電圧検出制御回路を備えた同期整流コ
ンバータにおいて、前記トランスの1次側または2次側
の電流値を検出し、その検出電流値が所定値以下になっ
た場合に前記同期整流FET及び前記転流FETをオフ
動作せしめるスイッチ回路を前記同期整流FET及び前
記転流FETの駆動回路にそれぞれ設け、当該同期整流
コンバータに並列接続される外部直流電源によって出力
端の直流電圧が所定電圧以上に上昇した場合に、前記各
スイッチ回路をそれぞれ介して前記同期整流FET及び
前記転流FETを不動作状態にするものである。
タは、直流入力電圧をスイッチング素子により矩形波パ
ルス電圧に変換してトランスの1次巻線に印加し、その
トランスの2次巻線で取り出された所望の電圧パルス
を、同期整流FET、転流FET、チョークコイル、コ
ンデンサ等により整流・平滑して直流電圧を出力すると
共に、該直流出力電圧を検知して前記スイッチング素子
の動作を制御する電圧検出制御回路を備えた同期整流コ
ンバータにおいて、前記トランスの1次側または2次側
の電流値を検出し、その検出電流値が所定値以下になっ
た場合に前記同期整流FET及び前記転流FETをオフ
動作せしめるスイッチ回路を前記同期整流FET及び前
記転流FETの駆動回路にそれぞれ設け、当該同期整流
コンバータに並列接続される外部直流電源によって出力
端の直流電圧が所定電圧以上に上昇した場合に、前記各
スイッチ回路をそれぞれ介して前記同期整流FET及び
前記転流FETを不動作状態にするものである。
【0007】
【実施例】図1は本発明の第1の実施例を示す回路図で
あり、図3に示した従来例と同一部分は同一符号で表し
ている。最初に、本実施例における同期整流FET4の
動作状態について説明する。同期整流FET4は、負極
性ラインに接続されているチョークコイル6の出力側に
そのゲートが接続されているので、本同期整流コンバー
タの2次側に正常な矩形波パルスが出力されていれば同
期整流FET4は正常に動作するようになっている。し
かし、並列接続されている外部直流電源12の電圧の方
が本同期整流コンバータの出力電圧より相対的に高くな
ったこと等により、本同期整流コンバータが動作を停止
した場合、外部直流電源12が出力端子10,11に接
続されていても、同期整流FET4はそのゲートに適正
な正極性の電圧が印加されないため、外部直流電源12
によっては動作されないようになっている。
あり、図3に示した従来例と同一部分は同一符号で表し
ている。最初に、本実施例における同期整流FET4の
動作状態について説明する。同期整流FET4は、負極
性ラインに接続されているチョークコイル6の出力側に
そのゲートが接続されているので、本同期整流コンバー
タの2次側に正常な矩形波パルスが出力されていれば同
期整流FET4は正常に動作するようになっている。し
かし、並列接続されている外部直流電源12の電圧の方
が本同期整流コンバータの出力電圧より相対的に高くな
ったこと等により、本同期整流コンバータが動作を停止
した場合、外部直流電源12が出力端子10,11に接
続されていても、同期整流FET4はそのゲートに適正
な正極性の電圧が印加されないため、外部直流電源12
によっては動作されないようになっている。
【0008】次に、転流FET5の動作について説明す
る。図1から明らかなように、トランス3の1次側回路
に電流トランス13を設け、その検出出力を電流検出制
御回路14で検出しトランジスタ16をオンにする。こ
のときスイッチ回路15のスイッチ素子17(図の例で
はpチャネルFET)のゲートは負バイアスのまま推移
するが、スイッチ素子17はそのソースが正になった期
間、即ちトランス3のフライバック電圧が発生している
間のみ導通して転流FET5のゲートに電圧を印加す
る。従って、本同期整流コンバータが正常に動作してい
れば、半導体スイッチ2に流れる電流は定められた電流
値以上になり、電流検出制御回路14およびスイッチ回
路15をオン状態として転流FET5のゲートをバイア
スし、転流FET5をオン状態とする。ここで注意すべ
きことは、電流検出制御回路14のトランジスタ16は
コンデンサ21と抵抗22による時定数で1周期に亘っ
てオン状態を保持していることである。
る。図1から明らかなように、トランス3の1次側回路
に電流トランス13を設け、その検出出力を電流検出制
御回路14で検出しトランジスタ16をオンにする。こ
のときスイッチ回路15のスイッチ素子17(図の例で
はpチャネルFET)のゲートは負バイアスのまま推移
するが、スイッチ素子17はそのソースが正になった期
間、即ちトランス3のフライバック電圧が発生している
間のみ導通して転流FET5のゲートに電圧を印加す
る。従って、本同期整流コンバータが正常に動作してい
れば、半導体スイッチ2に流れる電流は定められた電流
値以上になり、電流検出制御回路14およびスイッチ回
路15をオン状態として転流FET5のゲートをバイア
スし、転流FET5をオン状態とする。ここで注意すべ
きことは、電流検出制御回路14のトランジスタ16は
コンデンサ21と抵抗22による時定数で1周期に亘っ
てオン状態を保持していることである。
【0009】この状態において、本同期整流コンバータ
の動作が、その外部直流電源12の電圧が相対的に高い
電圧になったことを電圧検出制御回路8で検出されて、
半導体スイッチ2へのスイッチングパルスの送出が停止
することにより、1次側の電流が所定電流値以下になる
ため、電流検出制御回路14がオフ状態になり、これに
より転流FET5の動作を制御するスイッチ回路15は
オフ状態になる。このように、転流FET5のオン・オ
フ状態の制御はトランス3の1次側に流れる電流値の検
出によって行われるものであるため、出力端子10,1
1に外部直流電源12が接続されていても、その出力端
子10.11から転流FET5に電流が流れ込む逆流現
象は生じない。なお、本同期整流コンバータの負荷が無
負荷または転流負荷時においては、転流FET5のゲー
ト信号をオフにし、転流FET5には電流が流れなくな
るが、転流用ダイオード9の順方向には転流電流が流れ
る。
の動作が、その外部直流電源12の電圧が相対的に高い
電圧になったことを電圧検出制御回路8で検出されて、
半導体スイッチ2へのスイッチングパルスの送出が停止
することにより、1次側の電流が所定電流値以下になる
ため、電流検出制御回路14がオフ状態になり、これに
より転流FET5の動作を制御するスイッチ回路15は
オフ状態になる。このように、転流FET5のオン・オ
フ状態の制御はトランス3の1次側に流れる電流値の検
出によって行われるものであるため、出力端子10,1
1に外部直流電源12が接続されていても、その出力端
子10.11から転流FET5に電流が流れ込む逆流現
象は生じない。なお、本同期整流コンバータの負荷が無
負荷または転流負荷時においては、転流FET5のゲー
ト信号をオフにし、転流FET5には電流が流れなくな
るが、転流用ダイオード9の順方向には転流電流が流れ
る。
【0010】図2は本発明の第2の実施例を示す回路図
であり、図1に示した第1の実施例と同一部分は同一符
号で表している。この実施例は、同期整流FET4のゲ
ート制御をも、図1で示した転流FET5のオン・オフ
動作の制御と同様に、本同期整流コンバータの1次側回
路電流を検知してオン・オフ制御する回路例である。
即ち、図2では本同期整流コンバータの負荷電流が決め
られた電流値以上になると、1次側電流を電流トランス
13を介して電流検出制御回路23で検出し、スイッチ
回路25をオンする。スイッチ回路25の出力(pチャ
ンネルFET26)は2つに分岐され、1つは同期整流
FET4のゲートを駆動して同期整流FET4をオン状
態にさせる。更に分岐されたもう一つは転流FET5の
制御回路27に接続されており、この制御回路27の出
力により図1の実施例と同様にスイッチ回路15を制御
して転流FET5をオン状態にする。
であり、図1に示した第1の実施例と同一部分は同一符
号で表している。この実施例は、同期整流FET4のゲ
ート制御をも、図1で示した転流FET5のオン・オフ
動作の制御と同様に、本同期整流コンバータの1次側回
路電流を検知してオン・オフ制御する回路例である。
即ち、図2では本同期整流コンバータの負荷電流が決め
られた電流値以上になると、1次側電流を電流トランス
13を介して電流検出制御回路23で検出し、スイッチ
回路25をオンする。スイッチ回路25の出力(pチャ
ンネルFET26)は2つに分岐され、1つは同期整流
FET4のゲートを駆動して同期整流FET4をオン状
態にさせる。更に分岐されたもう一つは転流FET5の
制御回路27に接続されており、この制御回路27の出
力により図1の実施例と同様にスイッチ回路15を制御
して転流FET5をオン状態にする。
【0011】図2の電流検出制御回路23で検出した電
流の位相と、これによって動作する同期整流FET4の
位相は同位相であるため、図1に示した電流検出制御回
路14に比べると、図2の電流検出制御回路23は大き
な時定数回路は不要である。しかし、その代りに転流F
ET5の制御回路27には、図1の電流検出回路14と
同じ時定数回路が必要である。次に、電流トランス13
で検出される電流値が所定値以下になると、電流検出制
御回路23とそれに続くスイッチ回路25をオフ状態に
し、同期整流FET4をオフ状態にする。また、同時に
転流FET5の制御回路27とそれに続くスイッチ回路
15をオフ状態にして転流FET5をオフにする。従っ
て、半導体スイッチ2が動作を停止しているとき、或い
は回路電流が少ないときには同期整流FET4または転
流FET5はオフ状態になり、外部直流電源12と並列
運転時にも出力端子10,11から逆流電流が流れ込む
ことはない。
流の位相と、これによって動作する同期整流FET4の
位相は同位相であるため、図1に示した電流検出制御回
路14に比べると、図2の電流検出制御回路23は大き
な時定数回路は不要である。しかし、その代りに転流F
ET5の制御回路27には、図1の電流検出回路14と
同じ時定数回路が必要である。次に、電流トランス13
で検出される電流値が所定値以下になると、電流検出制
御回路23とそれに続くスイッチ回路25をオフ状態に
し、同期整流FET4をオフ状態にする。また、同時に
転流FET5の制御回路27とそれに続くスイッチ回路
15をオフ状態にして転流FET5をオフにする。従っ
て、半導体スイッチ2が動作を停止しているとき、或い
は回路電流が少ないときには同期整流FET4または転
流FET5はオフ状態になり、外部直流電源12と並列
運転時にも出力端子10,11から逆流電流が流れ込む
ことはない。
【0012】なお、図1および図2の抵抗18,19,
28,29およびダイオード20,30はトランス3に
電圧が発生していないときに同期整流FET4および転
流FET5のゲート回路のインピーダンスが高くなって
誤動作するのを防ぐ目的で設けられたものである。ま
た、図1および図2に示した実施例は、いずれも電流検
出をトランス3の1次側で行っているが、トランス3の
2次側で行ってもよい。また回路電流の検出には電流ト
ランス13を使っているが、代わりに低抵抗を使ってそ
の両端の電圧降下を検出して電流検出制御回路14また
は23の入力信号とすることもできる。ただし、1次側
で検出電圧降下を検出する場合は、フォトカプラ等を用
いて絶縁された信号で整流回路を制御する必要がある。
28,29およびダイオード20,30はトランス3に
電圧が発生していないときに同期整流FET4および転
流FET5のゲート回路のインピーダンスが高くなって
誤動作するのを防ぐ目的で設けられたものである。ま
た、図1および図2に示した実施例は、いずれも電流検
出をトランス3の1次側で行っているが、トランス3の
2次側で行ってもよい。また回路電流の検出には電流ト
ランス13を使っているが、代わりに低抵抗を使ってそ
の両端の電圧降下を検出して電流検出制御回路14また
は23の入力信号とすることもできる。ただし、1次側
で検出電圧降下を検出する場合は、フォトカプラ等を用
いて絶縁された信号で整流回路を制御する必要がある。
【0013】
【発明の効果】以上述べたように本発明によれば、同期
整流コンバータの入力側電流または出力側電流を検出し
て、その検出電流が定められた電流値以上の場合にのみ
転流FETを動作させ(この場合、同期整流FETは他
の手段により外部直流電源の逆流電流阻止が行われ
る。)、または同期整流FETと転流FETを動作さ
せ、当該同期整流コンバータに並列接続された外部直流
電源によっては前記同期整流FET、転流FETが動作
されないようにしたものであり、外部直流電源の並列接
続運転を可能にし、特に同種の同期整流コンバータを負
荷容量に応じて並列接続ができるようにしたもので、運
転の安全性と共に、同期整流コンバータの機種の削減を
図り得る効果を奏するものである。
整流コンバータの入力側電流または出力側電流を検出し
て、その検出電流が定められた電流値以上の場合にのみ
転流FETを動作させ(この場合、同期整流FETは他
の手段により外部直流電源の逆流電流阻止が行われ
る。)、または同期整流FETと転流FETを動作さ
せ、当該同期整流コンバータに並列接続された外部直流
電源によっては前記同期整流FET、転流FETが動作
されないようにしたものであり、外部直流電源の並列接
続運転を可能にし、特に同種の同期整流コンバータを負
荷容量に応じて並列接続ができるようにしたもので、運
転の安全性と共に、同期整流コンバータの機種の削減を
図り得る効果を奏するものである。
【図1】本発明による同期整流コンバータの第1の実施
例回路図である。
例回路図である。
【図2】本発明による同期整流コンバータの第2の実施
例回路図である。
例回路図である。
【図3】従来の同期整流コンバータの回路図である。
1 直流入力電源 2 半導体スイッチ 3 電圧変換トランス 4 同期整流FET 5 転流FET 6 チョークコイル 7,21 コンデンサ 8 電圧検出制御回路 9 転流用ダイオード 10,11 出力端子 12 外部直流電源 13 電流トランス 14,23 電流検出制御回路 15,25 スイッチ回路 16,24 トランジスタ 17,26 制御用FET 18,19,22,28,29 抵抗 20,30 ダイオード 27 制御回路
───────────────────────────────────────────────────── フロントページの続き (72)発明者 村上 直樹 東京都千代田区内幸町一丁目1番6号 日本電信電話株式会社内 (56)参考文献 特開 平3−218264(JP,A) 実開 平4−58087(JP,U) (58)調査した分野(Int.Cl.7,DB名) H02M 3/28
Claims (2)
- 【請求項1】 直流入力電圧をスイッチング素子により
矩形波パルス電圧に変換してトランスの1次巻線に印加
し、そのトランスの2次巻線で取り出された所望の電圧
パルスを、同期整流FET、転流FET、チョークコイ
ル、コンデンサ等により整流・平滑して直流電圧を出力
すると共に、該直流出力電圧を検知して前記スイッチン
グ素子の動作を制御する電圧検出制御回路を備えた同期
整流コンバータにおいて、前記同期整流FETはそのゲ
ートを出力端子の負極側に接続せしめて当該同期整流コ
ンバータに並列接続される外部直流電源によって動作さ
れないようにすると共に、前記トランスの1次側または
2次側の電流値を検出し、その検出電流値が所定値以下
になった場合に前記転流FETをオフ動作せしめるスイ
ッチ回路を設け、前記外部直流電源によって当該同期整
流コンバータの出力端の直流電圧が所定電圧以上に上昇
した場合に、前記スイッチ回路を介して前記転流FET
を不動作状態にすることを特徴とする同期整流コンバー
タ。 - 【請求項2】 直流入力電圧をスイッチング素子により
矩形波パルス電圧に変換してトランスの1次巻線に印加
し、そのトランスの2次巻線で取り出された所望の電圧
パルスを、同期整流FET、転流FET、チョークコイ
ル、コンデンサ等により整流・平滑して直流電圧を出力
すると共に、該直流出力電圧を検知して前記スイッチン
グ素子の動作を制御する電圧検出制御回路を備えた同期
整流コンバータにおいて、前記トランスの1次側または
2次側の電流値を検出し、その検出電流値が所定値以下
になった場合に前記同期整流FET及び前記転流FET
をオフ動作せしめるスイッチ回路を前記同期整流FET
及び前記転流FETの駆動回路にそれぞれ設け、当該同
期整流コンバータに並列接続される外部直流電源によっ
て出力端の直流電圧が所定電圧以上に上昇した場合に、
前記各スイッチ回路をそれぞれ介して前記同期整流FE
T及び前記転流FETを不動作状態にすることを特徴と
する同期整流コンバータ。
Priority Applications (1)
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---|---|---|---|
JP14841093A JP3202416B2 (ja) | 1993-05-28 | 1993-05-28 | 同期整流コンバータ |
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Publication number | Priority date | Publication date | Assignee | Title |
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-
1993
- 1993-05-28 JP JP14841093A patent/JP3202416B2/ja not_active Expired - Fee Related
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KR101797397B1 (ko) * | 2016-11-11 | 2017-11-14 | 김규식 | 인체 밀착형 허리띠 |
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