JP3171980B2 - フェーズロックドループ回路 - Google Patents
フェーズロックドループ回路Info
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Description
【０００１】
【産業上の利用分野】本発明は、映像信号を処理するク
ロックを発生するフェーズロックドループ（以下ＰＬＬ
という）回路に関する。
ロックを発生するフェーズロックドループ（以下ＰＬＬ
という）回路に関する。
【０００２】
【従来の技術】本発明の適用範囲である入力映像信号の
水平同期信号を含む複数の同期信号に同期したクロック
を発生する場合には、従来それぞれの同期信号に同期し
たクロックを発生する電圧制御発振器を独立に備えたＰ
ＬＬ回路を複数設けている。そして、必要に応じてそれ
ぞれのＰＬＬ回路のクロックを切換えて使用したり、そ
の複数のＰＬＬ回路のクロックを同時に使用したりして
いる。
水平同期信号を含む複数の同期信号に同期したクロック
を発生する場合には、従来それぞれの同期信号に同期し
たクロックを発生する電圧制御発振器を独立に備えたＰ
ＬＬ回路を複数設けている。そして、必要に応じてそれ
ぞれのＰＬＬ回路のクロックを切換えて使用したり、そ
の複数のＰＬＬ回路のクロックを同時に使用したりして
いる。
【０００３】図３に、従来のＰＬＬ回路を示す。この例
では、水平同期信号と色副搬送波に関するＰＬＬ回路で
ある。水平同期信号用位相比較器20は、入力端子10から
の映像信号の水平同期信号ｆH の位相と１／Ｎ分周器50
の出力クロックの位相を比較し差信号電圧を生成する。
ループフィルタ30は、位相比較器20からの差信号電圧に
含まれる高周波成分を減衰させたり、前記差信号電圧の
過渡的変動を押えて、次段の電圧制御発振器ＶＣＯ40に
印加する。電圧制御発振器ＶＣＯ40は、水平同期信号ｆ
H のＮ倍のＮｆH クロック（以下ＮｆH クロックと略
す。）を発生する。そして、このＮｆH クロックを１／
Ｎ分周器50に供給する。
では、水平同期信号と色副搬送波に関するＰＬＬ回路で
ある。水平同期信号用位相比較器20は、入力端子10から
の映像信号の水平同期信号ｆH の位相と１／Ｎ分周器50
の出力クロックの位相を比較し差信号電圧を生成する。
ループフィルタ30は、位相比較器20からの差信号電圧に
含まれる高周波成分を減衰させたり、前記差信号電圧の
過渡的変動を押えて、次段の電圧制御発振器ＶＣＯ40に
印加する。電圧制御発振器ＶＣＯ40は、水平同期信号ｆ
H のＮ倍のＮｆH クロック（以下ＮｆH クロックと略
す。）を発生する。そして、このＮｆH クロックを１／
Ｎ分周器50に供給する。
【０００４】また、色副搬送波用位相比較器60は、入力
端子10からの映像信号のカラーバスト信号ｆscの位相と
１／Ｍ分周器90の出力クロックの位相を比較し差信号電
圧を生成する。ループフィルタ70は、その差信号電圧に
対してループフィルタ30と同様な動作を行ない、次段の
水晶振動子を使用した電圧制御発振器ＶＣＸＯ80に印加
する。電圧制御発振器ＶＣＸＯ80は、色副搬送ｆscのＭ
倍のＭｆscクロックを発生する。そして、このＭｆscク
ロックを１／Ｍ分周器90に供給する。
端子10からの映像信号のカラーバスト信号ｆscの位相と
１／Ｍ分周器90の出力クロックの位相を比較し差信号電
圧を生成する。ループフィルタ70は、その差信号電圧に
対してループフィルタ30と同様な動作を行ない、次段の
水晶振動子を使用した電圧制御発振器ＶＣＸＯ80に印加
する。電圧制御発振器ＶＣＸＯ80は、色副搬送ｆscのＭ
倍のＭｆscクロックを発生する。そして、このＭｆscク
ロックを１／Ｍ分周器90に供給する。
【０００５】電圧制御発振器ＶＣＯ40のＮｆH クロック
出力は、入力映像信号がＶＴＲの再生映像信号の様に多
分にジッタを生じていたり、垂直同期信号近傍の水平同
期信号の位相変化であるスキューを生じていても、水平
同期信号を常にＮ分割している。従って、テレビジョン
信号処理において、主たる映像信号の一部分に縮小した
他の映像信号を同時に映出するいわゆるピクチャー・イ
ン・ピクチャーの特殊処理等に、ＮｆH クロックは適合
している。
出力は、入力映像信号がＶＴＲの再生映像信号の様に多
分にジッタを生じていたり、垂直同期信号近傍の水平同
期信号の位相変化であるスキューを生じていても、水平
同期信号を常にＮ分割している。従って、テレビジョン
信号処理において、主たる映像信号の一部分に縮小した
他の映像信号を同時に映出するいわゆるピクチャー・イ
ン・ピクチャーの特殊処理等に、ＮｆH クロックは適合
している。
【０００６】一方、電圧制御発振器ＶＣＸＯ80のＭｆsc
クロックは、前述のＶＴＲ等においても色副搬送波がＡ
ＰＣ回路によって安定に保たれているので、水晶振動子
を利用した高安定なＭｆscクロックを発生することがで
きる。そして、色副搬送波の周波数と水平同期信号及び
垂直同期信号の周波数の関係が保たれた、即ちＮｆH＝
Ｍｆsc（例えばＮ＝910 ，Ｍ＝４）の関係が成立する映
像の標準信号では、フレーム間の差信号を利用した輝度
信号と色信号の分離（以下Ｙ／Ｃ分離という）用の処理
クロックとしてＭｆscクロックを利用出来る。またＭｆ
scクロックを色副搬送波の特定位相に同期させることに
よって、色復調を簡易にすることができる。つまり、分
周率Ｍを４としてＭｆscクロックを生成し、色副搬送波
のＩ軸及びＱ軸の位相に同期する様にＰＬＬを構成す
る。すると、ＭｆscクロックによるＹ／Ｃ分離の色信号
のサンプル出力が、Ｉ・Ｑ・−Ｉ・−Ｑという値にな
り、１・０・−１・０及び０・１・０・−１を乗じるこ
とによって、簡単にＩ出力及びＱ出力を得る。また、Ｒ
−Ｙ軸及びＢ−Ｙ軸にＭｆscクロックを同期させること
によって、簡単にＲ−Ｙ出力及びＢ−Ｙ出力を得ること
も出来る。
クロックは、前述のＶＴＲ等においても色副搬送波がＡ
ＰＣ回路によって安定に保たれているので、水晶振動子
を利用した高安定なＭｆscクロックを発生することがで
きる。そして、色副搬送波の周波数と水平同期信号及び
垂直同期信号の周波数の関係が保たれた、即ちＮｆH＝
Ｍｆsc（例えばＮ＝910 ，Ｍ＝４）の関係が成立する映
像の標準信号では、フレーム間の差信号を利用した輝度
信号と色信号の分離（以下Ｙ／Ｃ分離という）用の処理
クロックとしてＭｆscクロックを利用出来る。またＭｆ
scクロックを色副搬送波の特定位相に同期させることに
よって、色復調を簡易にすることができる。つまり、分
周率Ｍを４としてＭｆscクロックを生成し、色副搬送波
のＩ軸及びＱ軸の位相に同期する様にＰＬＬを構成す
る。すると、ＭｆscクロックによるＹ／Ｃ分離の色信号
のサンプル出力が、Ｉ・Ｑ・−Ｉ・−Ｑという値にな
り、１・０・−１・０及び０・１・０・−１を乗じるこ
とによって、簡単にＩ出力及びＱ出力を得る。また、Ｒ
−Ｙ軸及びＢ−Ｙ軸にＭｆscクロックを同期させること
によって、簡単にＲ−Ｙ出力及びＢ−Ｙ出力を得ること
も出来る。
【０００７】しかしながら、色副搬送波の周波数と水平
同期信号及び垂直同期信号の関係が保たれない、即ちＮ
ｆH ≠Ｍｆscの関係にある映像の非標準信号では、Ｍｆ
scクロックでピクチャー・イン・ピクチャー等の特殊処
理ができない。
同期信号及び垂直同期信号の関係が保たれない、即ちＮ
ｆH ≠Ｍｆscの関係にある映像の非標準信号では、Ｍｆ
scクロックでピクチャー・イン・ピクチャー等の特殊処
理ができない。
【０００８】そこで従来より、スイッチ100 により、映
像の標準信号の場合は電圧制御発振器ＶＣＸＯ80のＭｆ
scクロックを選択し、映像の非標隼信号の場合は電圧制
御発振器40のＮｆH クロックを選択し、これらをシステ
ムクロックとして出力端子103 から出力している。
像の標準信号の場合は電圧制御発振器ＶＣＸＯ80のＭｆ
scクロックを選択し、映像の非標隼信号の場合は電圧制
御発振器40のＮｆH クロックを選択し、これらをシステ
ムクロックとして出力端子103 から出力している。
【０００９】したがって、従来のPLL回路では、Mfｓｃ
クロックを発生する電圧制御発振器８０が、Nf H クロッ
クを発生する電圧制御発振器４０と独立して設けられて
おり、回路構成の規模が大きくなるといった問題があっ
た。
クロックを発生する電圧制御発振器８０が、Nf H クロッ
クを発生する電圧制御発振器４０と独立して設けられて
おり、回路構成の規模が大きくなるといった問題があっ
た。
【００１０】
【発明が解決しようとする課題】従来、映像信号の水平
同期信号を含む複数の同期信号に同期したクロックを発
生する場合には、それぞれの同期信号に同期したクロッ
クを発生する電圧制御発振器を備えていた。
同期信号を含む複数の同期信号に同期したクロックを発
生する場合には、それぞれの同期信号に同期したクロッ
クを発生する電圧制御発振器を備えていた。
【００１１】本発明では、ＮｆH クロックを発生する電
圧制御発振器だけを備え、それ以外の電圧制御発振器を
必要としないＰＬＬ回路を提供することを目的とする。
圧制御発振器だけを備え、それ以外の電圧制御発振器を
必要としないＰＬＬ回路を提供することを目的とする。
【００１２】
【課題を解決するための手段】入力映像信号の水平同期
信号に同期した信号を出力する電圧制御発振器と、前記
電圧制御発振器の出力を分周する分周器と、前記分周器
の出力と前記入力映像信号の水平同期信号の位相差に応
じた差信号電圧を生成し、これを前記電圧制御発振器に
印加する第１の位相比較器と、前記電圧制御発振器の出
力信号と前記入力映像信号の水平同期信号以外の同期信
号の位相差に応じた差信号電圧を生成し、これを前記第
１の位相比較器の出力差信号電圧に加算する第２の位相
比較器とからPLL回路を構成する。
信号に同期した信号を出力する電圧制御発振器と、前記
電圧制御発振器の出力を分周する分周器と、前記分周器
の出力と前記入力映像信号の水平同期信号の位相差に応
じた差信号電圧を生成し、これを前記電圧制御発振器に
印加する第１の位相比較器と、前記電圧制御発振器の出
力信号と前記入力映像信号の水平同期信号以外の同期信
号の位相差に応じた差信号電圧を生成し、これを前記第
１の位相比較器の出力差信号電圧に加算する第２の位相
比較器とからPLL回路を構成する。
【００１３】
【作用】まず、前記電圧制御発振器、分周器及び第１の
位相比較器のループで、入力映像信号の水平同期信号に
位相同期したクロック出力を前記電圧制御発振器が発生
する。そして、前記第２の位相比較器は、水平同期信号
以外の色副搬送波等の同期信号の位相と、前記電圧制御
発振器のクロック出力の位相を比較して差信号電圧を生
成し、この差信号電圧を前記第１の位相比較器の差信号
電圧に加える。以上により、本発明のＰＬＬ回路は、色
副搬送波等の同期信号にも位相同期する。
位相比較器のループで、入力映像信号の水平同期信号に
位相同期したクロック出力を前記電圧制御発振器が発生
する。そして、前記第２の位相比較器は、水平同期信号
以外の色副搬送波等の同期信号の位相と、前記電圧制御
発振器のクロック出力の位相を比較して差信号電圧を生
成し、この差信号電圧を前記第１の位相比較器の差信号
電圧に加える。以上により、本発明のＰＬＬ回路は、色
副搬送波等の同期信号にも位相同期する。
【００１４】
【実施例】本発明の第１の実施例を図１を用いて説明す
る。本実施例は、水平同期信号と色副搬送波に関するＰ
ＬＬ回路であり、先に説明した従来例の回路構成と同一
のものは、同一の番号を付している。まず初めに、加算
器110 がないと仮定して説明する。水平同期信号用の第
１の位相比較器20は、入力端子10からの映像信号の水平
同期信号ｆH の位相と１／Ｎ分周器50の出力クロックの
位相を比較し差信号電圧を生成する。ループフィルタ30
は、位相比較器20からの差信号電圧に含まれる高周波成
分を減衰させたり、前記差信号電圧の過渡的変動を押え
て、次段の電圧制御発振器ＶＣＯ40に印加する。電圧制
御発振器ＶＣＯ40は、水平同期信号ｆH のＮ倍のＮｆH
クロックを発生する。そして、このＮｆH クロックを１
／Ｎ分周器50並びに出力端子103 に供給する。以上は、
従来例と同じである。
る。本実施例は、水平同期信号と色副搬送波に関するＰ
ＬＬ回路であり、先に説明した従来例の回路構成と同一
のものは、同一の番号を付している。まず初めに、加算
器110 がないと仮定して説明する。水平同期信号用の第
１の位相比較器20は、入力端子10からの映像信号の水平
同期信号ｆH の位相と１／Ｎ分周器50の出力クロックの
位相を比較し差信号電圧を生成する。ループフィルタ30
は、位相比較器20からの差信号電圧に含まれる高周波成
分を減衰させたり、前記差信号電圧の過渡的変動を押え
て、次段の電圧制御発振器ＶＣＯ40に印加する。電圧制
御発振器ＶＣＯ40は、水平同期信号ｆH のＮ倍のＮｆH
クロックを発生する。そして、このＮｆH クロックを１
／Ｎ分周器50並びに出力端子103 に供給する。以上は、
従来例と同じである。
【００１５】色副搬送波用の位相比較器60は、入力端子
10からの映像信号のカラーバ−スト信号ｆscの位相と１
／Ｍ分周器90の出力クロックの位相を比較し差信号電圧
を生成する。ループフィルタ70は、その差信号電圧に対
してループフィルタ30と同様な動作を行ない、次段のNu
merical Control Oscillator（ＮＣＯ）81に印加する。
ＮＣＯ81は、ディジタル数値で制御可能な発振回路であ
り、副搬送波ｆscのＭ倍のＭｆscクロックを発生する。
そして、このＭｆscクロックを１／Ｍ分周器90と次段の
水平同期信号用の第２の位相比較器21に印加する。
10からの映像信号のカラーバ−スト信号ｆscの位相と１
／Ｍ分周器90の出力クロックの位相を比較し差信号電圧
を生成する。ループフィルタ70は、その差信号電圧に対
してループフィルタ30と同様な動作を行ない、次段のNu
merical Control Oscillator（ＮＣＯ）81に印加する。
ＮＣＯ81は、ディジタル数値で制御可能な発振回路であ
り、副搬送波ｆscのＭ倍のＭｆscクロックを発生する。
そして、このＭｆscクロックを１／Ｍ分周器90と次段の
水平同期信号用の第２の位相比較器21に印加する。
【００１６】水平同期信号用の第２の位相比較器21は、
ＮＣＯ81からのＭｆscクロックの位相と電圧制御発振器
40からのＮｆH クロックの位相を比較し差信号電圧を生
成する。この差信号電圧は、フィルタ31により適当な時
定数が与えられ、加算器110に加えられる。加算器110
は、フィルタ出力と、第１の位相比較器20の出力を加算
する。電圧制御発振器40のＮｆH クロックは、出力端子
103 に供給されるとともに、システムクロックとして水
平同期信号用の第１の位相比較器20、ループフィルタ3
0、位相比較器60、ループフィルタ70、ＮＣＯ81、フィ
ルタ31に印加される。ＮｆH クロックは、前述した様
に、水平同期信号用の第２の位相比較器21にも加えられ
ており、位相比較の対象となる。
ＮＣＯ81からのＭｆscクロックの位相と電圧制御発振器
40からのＮｆH クロックの位相を比較し差信号電圧を生
成する。この差信号電圧は、フィルタ31により適当な時
定数が与えられ、加算器110に加えられる。加算器110
は、フィルタ出力と、第１の位相比較器20の出力を加算
する。電圧制御発振器40のＮｆH クロックは、出力端子
103 に供給されるとともに、システムクロックとして水
平同期信号用の第１の位相比較器20、ループフィルタ3
0、位相比較器60、ループフィルタ70、ＮＣＯ81、フィ
ルタ31に印加される。ＮｆH クロックは、前述した様
に、水平同期信号用の第２の位相比較器21にも加えられ
ており、位相比較の対象となる。
【００１７】従って、ＮＣＯ81が発生する色副搬送波Ｍ
ｆscは、ディジタルデータのままで表現すると、バース
ト信号期間のデータによってＮｆH クロックに対する位
相関係を検出できる。そこで、色副搬送波Ｍｆscの特定
サンプル位相（例えば、Ｉ軸とＱ軸）に対するＮｆH ク
ロックの位相を、水平同期信号用の第２の位相比較器21
によって検出する。そして、後段のフィルタ31を通して
適当な時定数を与える。更に、水平同期信号用の第１の
位相比較器20の出力に、フィルタ31の出力を加算器110
によって加算する。
ｆscは、ディジタルデータのままで表現すると、バース
ト信号期間のデータによってＮｆH クロックに対する位
相関係を検出できる。そこで、色副搬送波Ｍｆscの特定
サンプル位相（例えば、Ｉ軸とＱ軸）に対するＮｆH ク
ロックの位相を、水平同期信号用の第２の位相比較器21
によって検出する。そして、後段のフィルタ31を通して
適当な時定数を与える。更に、水平同期信号用の第１の
位相比較器20の出力に、フィルタ31の出力を加算器110
によって加算する。
【００１８】すると、ＮｆH クロック発生用のＰＬＬ
は、フィルタ31と水平同期信号用の第１の位相比較器20
の加算出力が０になるように動作する。結果的にフィル
タ31の出力が減少するように調整され、ＮｆH クロック
は色副搬送波の特定サンプル位相（例えばＩ軸とＱ軸の
位相）に調整される。即ち、ＮｆH ＝Ｍｆscとなる。こ
こで、水平同期信号用の第１の位相比較器20と第２の位
相比較器21の利得にあまり差がないとＮｆH クロックの
位相の調整は完全でなくなるが、ＮｆH クロックの１周
期以下の位相調整において第２の位相比較器21の利得を
第１の位相比較器20の利得より十分大きくすることによ
って、希望の位相に調整できる。また、水平同期信号だ
けによる同期位相を一定期間（例えば数十ｆH ）測定
し、その後水平同期信号用の第２の位相比較器21でＮｆ
H クロックとＭｆscクロックの位相比較をしその差信号
電圧であって常に位相を補正できる値をフィルタ31より
出力することによっても本発明のＰＬＬ回路を希望の位
相に調整することが出来る。
は、フィルタ31と水平同期信号用の第１の位相比較器20
の加算出力が０になるように動作する。結果的にフィル
タ31の出力が減少するように調整され、ＮｆH クロック
は色副搬送波の特定サンプル位相（例えばＩ軸とＱ軸の
位相）に調整される。即ち、ＮｆH ＝Ｍｆscとなる。こ
こで、水平同期信号用の第１の位相比較器20と第２の位
相比較器21の利得にあまり差がないとＮｆH クロックの
位相の調整は完全でなくなるが、ＮｆH クロックの１周
期以下の位相調整において第２の位相比較器21の利得を
第１の位相比較器20の利得より十分大きくすることによ
って、希望の位相に調整できる。また、水平同期信号だ
けによる同期位相を一定期間（例えば数十ｆH ）測定
し、その後水平同期信号用の第２の位相比較器21でＮｆ
H クロックとＭｆscクロックの位相比較をしその差信号
電圧であって常に位相を補正できる値をフィルタ31より
出力することによっても本発明のＰＬＬ回路を希望の位
相に調整することが出来る。
【００１９】本発明の第２の実施例を図２を用いて説明
する。先に説明した第１の実施例の回路構成と同一のも
のは、同一番号を付しており、それらの説明は省略す
る。本実施例の色副搬送波用の位相比較器61は、第１の
実施例の色副搬送波用の位相比較器60と水平同期信号用
の第２の位相比較器21を兼ねた場合である。位相比較器
61は、入力映像信号のカラーバースト信号ｆscと１／Ｍ
分周器90の出力クロックの位相を比較するだけでなく、
カラーバースト信号ｆscと電圧制御発振器40のＮｆH ク
ロックの位相をも比較する。つまり、位相比較器61は、
ＮｆH クロック位相と色副搬送波の特定位相を比較し差
信号電圧を発生し、ループフィルタ70に印加する。
する。先に説明した第１の実施例の回路構成と同一のも
のは、同一番号を付しており、それらの説明は省略す
る。本実施例の色副搬送波用の位相比較器61は、第１の
実施例の色副搬送波用の位相比較器60と水平同期信号用
の第２の位相比較器21を兼ねた場合である。位相比較器
61は、入力映像信号のカラーバースト信号ｆscと１／Ｍ
分周器90の出力クロックの位相を比較するだけでなく、
カラーバースト信号ｆscと電圧制御発振器40のＮｆH ク
ロックの位相をも比較する。つまり、位相比較器61は、
ＮｆH クロック位相と色副搬送波の特定位相を比較し差
信号電圧を発生し、ループフィルタ70に印加する。
【００２０】この場合、ＮｆH クロックは周波数引き込
み時は、水平同期信号用の第１の位相比較器20を含むル
ープで、ＰＬＬ回路の周波数調整をする。そして、その
後の位相引き込み時は、第１の位相比較器20の差信号電
圧の大きさを検出する周波数同期検出回路113 によっ
て、電圧制御回路112 の動作を制御する。具体的には、
第１の位相比較器20の差信号電圧が微小のとき、電圧制
御回路112 はループフィルタ70の出力を加算器111 に供
給する。第１の位相比較器20の差信号電圧が大きいと
き、電圧制御回路112 はループフィルタ70の出力を減少
させて加算器111 に供給する。以上により、位相同期動
作が行なわれる。
み時は、水平同期信号用の第１の位相比較器20を含むル
ープで、ＰＬＬ回路の周波数調整をする。そして、その
後の位相引き込み時は、第１の位相比較器20の差信号電
圧の大きさを検出する周波数同期検出回路113 によっ
て、電圧制御回路112 の動作を制御する。具体的には、
第１の位相比較器20の差信号電圧が微小のとき、電圧制
御回路112 はループフィルタ70の出力を加算器111 に供
給する。第１の位相比較器20の差信号電圧が大きいと
き、電圧制御回路112 はループフィルタ70の出力を減少
させて加算器111 に供給する。以上により、位相同期動
作が行なわれる。
【００２１】本発明は、第１及び第２の実施例のように
加算器１１０、１１１に加える差信号電圧の取り出し方
を変えるだけでなく、これらの加算器の位置をループフ
ィルタ３０の後にすることも可能である。また電圧制御
発振器４０のNfHクロックを、色副搬送波の特定位相に
調整するだけでなく、たとえば文字多重の文字多重信号
のクロックの特定位相に調整する場合に使用してもよ
い。
加算器１１０、１１１に加える差信号電圧の取り出し方
を変えるだけでなく、これらの加算器の位置をループフ
ィルタ３０の後にすることも可能である。また電圧制御
発振器４０のNfHクロックを、色副搬送波の特定位相に
調整するだけでなく、たとえば文字多重の文字多重信号
のクロックの特定位相に調整する場合に使用してもよ
い。
【００２２】
【発明の効果】以上詳述した様に、本発明では、水平同
期信号に同期した出力信号を発生する電圧制御発振器だ
けを備えれば良く、水平同期信号以外の同期信号に同期
した出力信号を発生する為の専用の電圧制御発振器を削
減できる。
期信号に同期した出力信号を発生する電圧制御発振器だ
けを備えれば良く、水平同期信号以外の同期信号に同期
した出力信号を発生する為の専用の電圧制御発振器を削
減できる。
【図１】本発明のＰＬＬ回路の第１の実施例を示すブロ
ック図である。
ック図である。
【図２】本発明のＰＬＬ回路の第２の実施例を示すブロ
ック図である。
ック図である。
【図３】従来のＰＬＬ回路を示すブロック図である。
10…映像信号入力端子、20…水平同期信号用の第１の位
相比較器、21…水平同期信号用の第２の位相比較器、30
…ループフィルタ、31…フィルタ、40…電圧制御発振
器、50…１／Ｎ分周器、60…色副搬送波用の位相比較
器、70…ループフィルタ、81…Numerical Control Osci
llator（ＮＣＯ）、90…１／Ｍ分周器、103 …出力端
子、110 ，111 …加算器、112 …電圧制御回路、113 …
周波数同期検出回路。
相比較器、21…水平同期信号用の第２の位相比較器、30
…ループフィルタ、31…フィルタ、40…電圧制御発振
器、50…１／Ｎ分周器、60…色副搬送波用の位相比較
器、70…ループフィルタ、81…Numerical Control Osci
llator（ＮＣＯ）、90…１／Ｍ分周器、103 …出力端
子、110 ，111 …加算器、112 …電圧制御回路、113 …
周波数同期検出回路。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 川井 清幸 神奈川県横浜市磯子区新杉田町８番地 株式会社東芝 映像メディア技術研究所 内 (72)発明者 佐藤 耕一 東京都港区新橋３丁目３番９号 東芝エ ー・ブイ・イー株式会社内 (56)参考文献 特開 平４−196796（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H04N 5/04 - 5/12 H04N 9/44 - 9/78 H03L 7/00 - 7/26
Claims (1)
- 【請求項１】 入力映像信号の水平同期信号に同期した
信号を出力する電圧制御発振器と、 前記電圧制御発振器の出力を分周する分周器と、 前記分周器の出力と前記入力映像信号の水平同期信号の
位相差に応じた差信号電圧を生成し、これを前記電圧制
御発振器に印加する第１の位相比較器と、 前記電圧制御発振器の出力信号と前記入力映像信号の水
平同期信号以外の同期信号の位相差に応じた差信号電圧
を生成し、これを前記第１の位相比較器の出力差信号電
圧に加算する第２の位相比較器とを具備したことを特徴
とするフェーズロックドループ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP04423393A JP3171980B2 (ja) | 1993-03-05 | 1993-03-05 | フェーズロックドループ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP04423393A JP3171980B2 (ja) | 1993-03-05 | 1993-03-05 | フェーズロックドループ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06261223A JPH06261223A (ja) | 1994-09-16 |
| JP3171980B2 true JP3171980B2 (ja) | 2001-06-04 |
Family
ID=12685821
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP04423393A Expired - Fee Related JP3171980B2 (ja) | 1993-03-05 | 1993-03-05 | フェーズロックドループ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3171980B2 (ja) |
-
1993
- 1993-03-05 JP JP04423393A patent/JP3171980B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH06261223A (ja) | 1994-09-16 |
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Legal Events
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