JP3114628B2 - 映像信号時分割回路 - Google Patents
映像信号時分割回路Info
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- JP3114628B2 JP3114628B2 JP08254515A JP25451596A JP3114628B2 JP 3114628 B2 JP3114628 B2 JP 3114628B2 JP 08254515 A JP08254515 A JP 08254515A JP 25451596 A JP25451596 A JP 25451596A JP 3114628 B2 JP3114628 B2 JP 3114628B2
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Description
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は映像信号時分割回路
に関し、特にハイビジョン用ビット直列信号の映像処理
を行なう映像信号時分割回路に関する。
に関し、特にハイビジョン用ビット直列信号の映像処理
を行なう映像信号時分割回路に関する。
【０００２】
【従来の技術】一般に、ハイビジョン用ビット直列信号
の処理は、直接シリアルパラレル変換を行なった後、ハ
イビジョン専用の回路にて各種の映像処理が行なわれて
いる。
の処理は、直接シリアルパラレル変換を行なった後、ハ
イビジョン専用の回路にて各種の映像処理が行なわれて
いる。
【０００３】図３は従来の映像信号時分割回路を示すブ
ロック図である。
ロック図である。
【０００４】図３を参照すると、ハイビジョン用入力信
号２１のシリアルデータをパラレルデータに変換するシ
リアルパラレル変換器１６と、変換したパラレルデータ
を映像処理する映像処理回路１７と、映像処理されたパ
ラレルデータをシリアルデータに変換しハイビジョン用
出力信号３８を出力するパラレルシリアル変換器１８と
から構成されている。この場合、映像処理回路１７はハ
イビジョン用に専用設計されたものが必要となる。
号２１のシリアルデータをパラレルデータに変換するシ
リアルパラレル変換器１６と、変換したパラレルデータ
を映像処理する映像処理回路１７と、映像処理されたパ
ラレルデータをシリアルデータに変換しハイビジョン用
出力信号３８を出力するパラレルシリアル変換器１８と
から構成されている。この場合、映像処理回路１７はハ
イビジョン用に専用設計されたものが必要となる。
【０００５】なお、このようなハイビジョン用映像信号
回路の一例として、特開平２−２１７０９４号公報記載
の「ディジタル映像信号記録再生方法及びその装置」が
知られている。この公報では、ハイビジョンの輝度信号
と色差信号とを５チャンネルに分割して、ハイビジョン
スタジオ規格信号の１／２のデータレートに変換しビデ
オ装置にディジタル記録する技術が記載されている。
回路の一例として、特開平２−２１７０９４号公報記載
の「ディジタル映像信号記録再生方法及びその装置」が
知られている。この公報では、ハイビジョンの輝度信号
と色差信号とを５チャンネルに分割して、ハイビジョン
スタジオ規格信号の１／２のデータレートに変換しビデ
オ装置にディジタル記録する技術が記載されている。
【０００６】ハイビジョン用映像ディジタル信号のビッ
トレートは、１．４８５Ｇｂｐｓであり、そのままシリ
アルパラレル変換すると輝度信号は７４．２５ＭＨｚ、
色差信号は３７．１２５ＭＨｚのサンプリングレートと
なるため、この高速の輝度信号を処理するためには専用
回路が必要となる。
トレートは、１．４８５Ｇｂｐｓであり、そのままシリ
アルパラレル変換すると輝度信号は７４．２５ＭＨｚ、
色差信号は３７．１２５ＭＨｚのサンプリングレートと
なるため、この高速の輝度信号を処理するためには専用
回路が必要となる。
【０００７】
【発明が解決しようとする課題】上述した従来の映像信
号時分割回路は、高速の信号処理にハイビジョン用の専
用回路が新規に必要となりかつ回路構成が複雑化するた
め、経済性を損なうという欠点を有している。
号時分割回路は、高速の信号処理にハイビジョン用の専
用回路が新規に必要となりかつ回路構成が複雑化するた
め、経済性を損なうという欠点を有している。
【０００８】本発明の目的は、ハイビジョン用映像ディ
ジタル信号の映像処理回路として、現在使用のＮＴＳＣ
（コンポジット／コンポーネント方式）の映像処理回路
を流用することができる簡易回路構成の信号時分割回路
を提供することにある。
ジタル信号の映像処理回路として、現在使用のＮＴＳＣ
（コンポジット／コンポーネント方式）の映像処理回路
を流用することができる簡易回路構成の信号時分割回路
を提供することにある。
【０００９】
【課題を解決するための手段】本発明の映像信号時分割
回路は、単一入力の映像信号を一度４チャンネルに時分
割するとともに、前記映像信号から検出して得られる同
期信号を前記４チャンネルの時分割信号の各々に挿入
し、これら挿入した信号の各々を映像処理した４チャン
ネルの映像信号を、前記４チャンネルの映像信号の一つ
から検出して得られる基準信号とともに多重化すること
を特徴としている。
回路は、単一入力の映像信号を一度４チャンネルに時分
割するとともに、前記映像信号から検出して得られる同
期信号を前記４チャンネルの時分割信号の各々に挿入
し、これら挿入した信号の各々を映像処理した４チャン
ネルの映像信号を、前記４チャンネルの映像信号の一つ
から検出して得られる基準信号とともに多重化すること
を特徴としている。
【００１０】単一入力の映像信号を４チャンネルの時分
割信号として出力する時分割手段と、前記映像信号から
第１の基準信号を検出し同期信号を出力する第１の基準
信号検出手段と、前記時分割信号に前記同期信号を挿入
する基準信号挿入手段と、この基準信号挿入手段が出力
する第１，第２の色差信号および第１，第２の輝度信号
の各々に対応して設けた映像処理手段と、これら映像処
理手段が出力する各々の映像信号を多重化し出力する多
重化手段と、前記映像処理手段が出力する第１の色差信
号から前記同期信号を検出し第２の基準信号を前記多重
化手段に出力する第２の基準信号検出手段と、を備えた
ことを特徴としている。
割信号として出力する時分割手段と、前記映像信号から
第１の基準信号を検出し同期信号を出力する第１の基準
信号検出手段と、前記時分割信号に前記同期信号を挿入
する基準信号挿入手段と、この基準信号挿入手段が出力
する第１，第２の色差信号および第１，第２の輝度信号
の各々に対応して設けた映像処理手段と、これら映像処
理手段が出力する各々の映像信号を多重化し出力する多
重化手段と、前記映像処理手段が出力する第１の色差信
号から前記同期信号を検出し第２の基準信号を前記多重
化手段に出力する第２の基準信号検出手段と、を備えた
ことを特徴としている。
【００１１】また、前記映像処理手段が、シリアルデー
タをパラレルデータに変換するシリアルパラレル変換器
と、前記パラレルデータを映像処理する映像処理回路
と、この映像処理回路が出力するパラレルデータをシリ
アルデータに変換するパラレルシリアル変換器とを有す
ることを特徴としている。なお、前記映像信号がハイビ
ジョン用映像信号であることを特徴としている。
タをパラレルデータに変換するシリアルパラレル変換器
と、前記パラレルデータを映像処理する映像処理回路
と、この映像処理回路が出力するパラレルデータをシリ
アルデータに変換するパラレルシリアル変換器とを有す
ることを特徴としている。なお、前記映像信号がハイビ
ジョン用映像信号であることを特徴としている。
【００１２】
【発明の実施の形態】次に、本発明の実施の形態につい
て図面を参照して説明する。
て図面を参照して説明する。
【００１３】図１は本発明の映像信号時分割回路の一つ
の実施の形態を示すブロック図である。
の実施の形態を示すブロック図である。
【００１４】図１に示す本実施の形態は、ハイビジョン
用入力信号２１を時分割し分割ビット信号２３，２４，
２５，および２６を出力する多重分離部１と、タイミン
グ基準コードを検出し同期出力信号２７を出力するタイ
ミング基準コード検出部２と、分割ビット信号２３，２
４，２５および２６に同期出力信号２７を挿入するタイ
ミング基準コード挿入部３と、この基準コード挿入部３
が出力する分割シリアル信号Ｐｂ，Ｙ０，ＰｒおよびＹ
１を映像処理するシリアルディジタル映像処理部７，７
ａ，７ｂおよび７ｃと、これら各々のシリアルディジタ
ル映像処理部７，７ａ，７ｂおよび７ｃが出力する映像
処理信号３２，３３，３４および３５を多重化しハイビ
ジョン用出力信号２２を出力する多重化部９と、タイミ
ング基準コード３６を多重化部９に出力するタイミング
基準コード検出部８とから構成されている。
用入力信号２１を時分割し分割ビット信号２３，２４，
２５，および２６を出力する多重分離部１と、タイミン
グ基準コードを検出し同期出力信号２７を出力するタイ
ミング基準コード検出部２と、分割ビット信号２３，２
４，２５および２６に同期出力信号２７を挿入するタイ
ミング基準コード挿入部３と、この基準コード挿入部３
が出力する分割シリアル信号Ｐｂ，Ｙ０，ＰｒおよびＹ
１を映像処理するシリアルディジタル映像処理部７，７
ａ，７ｂおよび７ｃと、これら各々のシリアルディジタ
ル映像処理部７，７ａ，７ｂおよび７ｃが出力する映像
処理信号３２，３３，３４および３５を多重化しハイビ
ジョン用出力信号２２を出力する多重化部９と、タイミ
ング基準コード３６を多重化部９に出力するタイミング
基準コード検出部８とから構成されている。
【００１５】なお、図１において図３に示す構成要素に
対応するものは同一の参照数字または符号を付し、その
説明を省略する。
対応するものは同一の参照数字または符号を付し、その
説明を省略する。
【００１６】図２は本実施の形態の動作を説明するタイ
ムチャートである。
ムチャートである。
【００１７】次に、図１および図２を参照して本実施の
形態の動作をより詳細に説明する。
形態の動作をより詳細に説明する。
【００１８】ハイビジョン用入力信号２１であるビット
レート１．４８５Ｇｂｐｓのシリアルデータは、多重分
離部１により４チャンネルの分割ビット信号２３，２
４，２５，２６に分割される。各々の信号のビットレー
トは３７１Ｍｂｐｓとなる。
レート１．４８５Ｇｂｐｓのシリアルデータは、多重分
離部１により４チャンネルの分割ビット信号２３，２
４，２５，２６に分割される。各々の信号のビットレー
トは３７１Ｍｂｐｓとなる。
【００１９】ハイビジョン用入力信号２１はタイミング
基準コード検出部２にも出力され、同期信号の検出およ
びライン情報の抽出を行なう。同期信号の検出はハイビ
ジョン用入力信号２１に含まれている１６進表示のデー
タ“３ＦＦ”，“３ＦＦ”，“０００”，“０００”，
“０００”，“０００”の各１０ビット×６＝６０ビッ
トの並びを検出する事により行なわれる。
基準コード検出部２にも出力され、同期信号の検出およ
びライン情報の抽出を行なう。同期信号の検出はハイビ
ジョン用入力信号２１に含まれている１６進表示のデー
タ“３ＦＦ”，“３ＦＦ”，“０００”，“０００”，
“０００”，“０００”の各１０ビット×６＝６０ビッ
トの並びを検出する事により行なわれる。
【００２０】１６進表示なので、例えば“３ＦＦ”はバ
イナリーとして“１１１１１１１１１１”を示す。
“０”はローレベルを“１”はハイレベルを示す。
イナリーとして“１１１１１１１１１１”を示す。
“０”はローレベルを“１”はハイレベルを示す。
【００２１】ここでディジタルデータのフレーム構成
（以下ディジタルラインと記す）は、１ディジタルライ
ン４４００Ｔｓ（Ｔｓはタイムスロットで１Ｔｓ＝１／
２・Ｔ；Ｔ＝１３．４６８ｎｓ）は、ディジタルブラン
キング期間（５６０Ｔｓ）とデータであるディジタル有
効ライン（３８４０Ｔｓ）とから構成される。
（以下ディジタルラインと記す）は、１ディジタルライ
ン４４００Ｔｓ（Ｔｓはタイムスロットで１Ｔｓ＝１／
２・Ｔ；Ｔ＝１３．４６８ｎｓ）は、ディジタルブラン
キング期間（５６０Ｔｓ）とデータであるディジタル有
効ライン（３８４０Ｔｓ）とから構成される。
【００２２】同期信号はハイビジョン用入力信号２１の
中に、１ディジタルライン中に２度出現し、それぞれ多
重ＥＡＶ１０、多重ＳＡＶ１４と呼称される。同期信号
を検出すると継続するデータ群“ＸＹＺ”データを抽出
しディジタルライン情報を得る。この“ＸＹＺ”データ
は１６進表示ではなく単にデータ名称を示し、映像信号
の第１フィールド／第２フィールドの識別、フィールド
ブランキング期間／その他の期間の識別、ＳＡＶ／ＥＡ
Ｖの識別の情報が含まれている。多重分離部１から出力
された分割ビット信号２３，２４，２５，２６には同期
信号が含まれていないため同期信号を新規に挿入する必
要がある。
中に、１ディジタルライン中に２度出現し、それぞれ多
重ＥＡＶ１０、多重ＳＡＶ１４と呼称される。同期信号
を検出すると継続するデータ群“ＸＹＺ”データを抽出
しディジタルライン情報を得る。この“ＸＹＺ”データ
は１６進表示ではなく単にデータ名称を示し、映像信号
の第１フィールド／第２フィールドの識別、フィールド
ブランキング期間／その他の期間の識別、ＳＡＶ／ＥＡ
Ｖの識別の情報が含まれている。多重分離部１から出力
された分割ビット信号２３，２４，２５，２６には同期
信号が含まれていないため同期信号を新規に挿入する必
要がある。
【００２３】この挿入処理は、タイミング基準コード挿
入部３で、タイミング基準コード検出部２が出力する同
期出力信号２７により行なわれることになる。このとき
挿入される同期信号は、多重ＥＡＶ１０についてはタイ
ミング基準コード検出部２で検出・抽出された“３Ｆ
Ｆ”，“０００”，“０００”，“ＸＹＺ”の４ワード
からなる同期信号であり、多重ＳＡＶについてはタイミ
ング基準コード検出部２で検出・抽出された“３Ｆ
Ｆ”，“０００”の２ワードからなる同期信号が挿入さ
れる。多重ＳＡＶ１４に“ＸＹＺ”の情報を挿入しない
のは多重ＥＡＶ１０に挿入された“ＸＹＺ”の情報から
容易に多重ＳＡＶ１４の“ＸＹＺ”の情報が生成される
ためである。
入部３で、タイミング基準コード検出部２が出力する同
期出力信号２７により行なわれることになる。このとき
挿入される同期信号は、多重ＥＡＶ１０についてはタイ
ミング基準コード検出部２で検出・抽出された“３Ｆ
Ｆ”，“０００”，“０００”，“ＸＹＺ”の４ワード
からなる同期信号であり、多重ＳＡＶについてはタイミ
ング基準コード検出部２で検出・抽出された“３Ｆ
Ｆ”，“０００”の２ワードからなる同期信号が挿入さ
れる。多重ＳＡＶ１４に“ＸＹＺ”の情報を挿入しない
のは多重ＥＡＶ１０に挿入された“ＸＹＺ”の情報から
容易に多重ＳＡＶ１４の“ＸＹＺ”の情報が生成される
ためである。
【００２４】タイミング基準コード挿入部３から出力さ
れる４本の分割シリアル信号Ｐｂ，Ｙ０，Ｐｒ，Ｙ１に
はそれぞれに同期信号が挿入されているので、各信号毎
に同期分離および映像処理が可能となる。
れる４本の分割シリアル信号Ｐｂ，Ｙ０，Ｐｒ，Ｙ１に
はそれぞれに同期信号が挿入されているので、各信号毎
に同期分離および映像処理が可能となる。
【００２５】シリアルディジタル映像処理部７，７ａ，
７ｂ，７ｃは、各々シリアルパラレル変換器４，４ａ，
４ｂ，４ｃと、映像処理回路５，５ａ，５ｂ，５ｃと、
パラレルシリアル変換器６，６ａ，６ｂ，６ｃとを有し
ている。
７ｂ，７ｃは、各々シリアルパラレル変換器４，４ａ，
４ｂ，４ｃと、映像処理回路５，５ａ，５ｂ，５ｃと、
パラレルシリアル変換器６，６ａ，６ｂ，６ｃとを有し
ている。
【００２６】シリアルディジタル映像処理部７，７ａ，
７ｂ，７ｃは、入出力信号のビットレートが３７１Ｍｂ
ｐｓであるため、従来使用のＮＴＳＣ用シリアルディジ
タル映像処理部との共用が可能である。つまりＮＴＳＣ
用シリアルディジタル信号のビットレートは、コンポー
ネント信号の場合、通常の１３．５ＭＨｚサンプリング
の場合で２７０Ｍｂｐｓ、１８ＭＨｚサンプリングの場
合で３６０Ｍｂｐｓであるため、ほぼ同一周波数帯域な
のでＮＴＳＣで使用されている映像処理回路で処理が可
能となる。
７ｂ，７ｃは、入出力信号のビットレートが３７１Ｍｂ
ｐｓであるため、従来使用のＮＴＳＣ用シリアルディジ
タル映像処理部との共用が可能である。つまりＮＴＳＣ
用シリアルディジタル信号のビットレートは、コンポー
ネント信号の場合、通常の１３．５ＭＨｚサンプリング
の場合で２７０Ｍｂｐｓ、１８ＭＨｚサンプリングの場
合で３６０Ｍｂｐｓであるため、ほぼ同一周波数帯域な
のでＮＴＳＣで使用されている映像処理回路で処理が可
能となる。
【００２７】このことは従来使用のＮＴＳＣ用シリアル
ディジタル映像処理部の手段を流用して、ハイビジョン
映像信号の映像処理が可能であることを示しており、回
路の簡素化と資源の流用が行なえることを示す。
ディジタル映像処理部の手段を流用して、ハイビジョン
映像信号の映像処理が可能であることを示しており、回
路の簡素化と資源の流用が行なえることを示す。
【００２８】分割シリアル信号Ｐｂ，Ｙ０，Ｐｒ，Ｙ１
はシリアルディジタル映像処理部７，７ａ，７ｂ，７ｃ
により映像処理が行なわれた後、多重化部９に出力さ
れ、元のハイビジョン用信号に戻され、ハイビジョン用
出力信号２２として出力される。このとき、分割シリア
ル信号Ｐｂ，Ｙ０，Ｐｒ，Ｙ１のうち分割シリアル信号
Ｐｂに対応する映像処理信号３２のみがタイミング基準
コード検出部８に出力され、同期信号である“３Ｆ
Ｆ”，“０００”，“０００”，“ＸＹＺ”の４ワード
の多重ＥＡＶ１０および“３ＦＦ”，“０００”の２ワ
ードの多重ＳＡＶ１４の同期信号が検出される。
はシリアルディジタル映像処理部７，７ａ，７ｂ，７ｃ
により映像処理が行なわれた後、多重化部９に出力さ
れ、元のハイビジョン用信号に戻され、ハイビジョン用
出力信号２２として出力される。このとき、分割シリア
ル信号Ｐｂ，Ｙ０，Ｐｒ，Ｙ１のうち分割シリアル信号
Ｐｂに対応する映像処理信号３２のみがタイミング基準
コード検出部８に出力され、同期信号である“３Ｆ
Ｆ”，“０００”，“０００”，“ＸＹＺ”の４ワード
の多重ＥＡＶ１０および“３ＦＦ”，“０００”の２ワ
ードの多重ＳＡＶ１４の同期信号が検出される。
【００２９】また、タイミング基準コード検出部８で
は、検出した多重ＥＡＶ１０、多重ＳＡＶ１４により映
像信号のライン番号データの再生成を行なう。タイミン
グ基準コード検出部８で抽出された多重ＥＡＶ１０、多
重ＳＡＶ１４のデータおよび再生成された映像信号の多
重ライン番号データ１１は、映像処理信号３２，３３，
３４，３５が多重化部９で合成されるときにタイミング
基準コード３６として挿入される。
は、検出した多重ＥＡＶ１０、多重ＳＡＶ１４により映
像信号のライン番号データの再生成を行なう。タイミン
グ基準コード検出部８で抽出された多重ＥＡＶ１０、多
重ＳＡＶ１４のデータおよび再生成された映像信号の多
重ライン番号データ１１は、映像処理信号３２，３３，
３４，３５が多重化部９で合成されるときにタイミング
基準コード３６として挿入される。
【００３０】図２を参照すると、（Ａ）はハイビジョン
用映像信号の規格化したデータ形式を示す。ただし、１
０ビットを１ワードとしてワード単位で表記している
（図ではワードをＴｓとして表記）。
用映像信号の規格化したデータ形式を示す。ただし、１
０ビットを１ワードとしてワード単位で表記している
（図ではワードをＴｓとして表記）。
【００３１】ここで、（Ａ）の信号を時間軸方向に４分
割し、多重ＥＡＶ１０、多重ライン番号データ１１、多
重誤り検出符号データ１２、多重補助データ／未定義ワ
ードデータ１３、多重ＳＡＶ１４についてのみ、“３Ｆ
Ｆ”，“０００”，“０００”，“ＸＹＺ”および“３
ＦＦ”，“０００”のデータに設定したものが、それぞ
れ（Ｂ）のＰｂデータ、（Ｃ）のＹ０データ、（Ｄ）の
Ｐｒデータ、（Ｅ）のＹ１データに含まれる。
割し、多重ＥＡＶ１０、多重ライン番号データ１１、多
重誤り検出符号データ１２、多重補助データ／未定義ワ
ードデータ１３、多重ＳＡＶ１４についてのみ、“３Ｆ
Ｆ”，“０００”，“０００”，“ＸＹＺ”および“３
ＦＦ”，“０００”のデータに設定したものが、それぞ
れ（Ｂ）のＰｂデータ、（Ｃ）のＹ０データ、（Ｄ）の
Ｐｒデータ、（Ｅ）のＹ１データに含まれる。
【００３２】（Ｂ），（Ｃ），（Ｄ），（Ｅ）の信号に
おける“３ＦＦ”，“０００”，“０００”，“ＸＹ
Ｚ”の期間のデータは、信号（Ａ）の多重ＥＡＶ１０の
データであり、これら“３ＦＦ”，“０００”，“００
０”，“ＸＹＺ”のデータをそのまま挿入している。こ
のデータの挿入により信号（Ａ）の多重ライン番号デー
タ１１および多重誤り検出符号データ１２の情報は無く
なるが、これら情報は“ＸＹＺ”の情報により容易に再
生できる。
おける“３ＦＦ”，“０００”，“０００”，“ＸＹ
Ｚ”の期間のデータは、信号（Ａ）の多重ＥＡＶ１０の
データであり、これら“３ＦＦ”，“０００”，“００
０”，“ＸＹＺ”のデータをそのまま挿入している。こ
のデータの挿入により信号（Ａ）の多重ライン番号デー
タ１１および多重誤り検出符号データ１２の情報は無く
なるが、これら情報は“ＸＹＺ”の情報により容易に再
生できる。
【００３３】なお、分割された（Ｂ），（Ｃ），
（Ｄ），（Ｅ）の信号はそれぞれ単独に同期信号を有す
るため、映像処理部で個別に同期分離が行なわれるた
め、個別処理が可能となる。また、多重補助データ／未
定義ワードデータ１３およびディジタル有効ライン１５
については、（Ａ）の信号を（Ｂ），（Ｃ），（Ｄ），
（Ｅ）の信号にそれぞれ時分割して挿入している。
（Ｄ），（Ｅ）の信号はそれぞれ単独に同期信号を有す
るため、映像処理部で個別に同期分離が行なわれるた
め、個別処理が可能となる。また、多重補助データ／未
定義ワードデータ１３およびディジタル有効ライン１５
については、（Ａ）の信号を（Ｂ），（Ｃ），（Ｄ），
（Ｅ）の信号にそれぞれ時分割して挿入している。
【００３４】上述のように、ハイビジョン用入力信号２
１を時分割した後に、タイミング用のタイミング基準コ
ード３６を挿入するように構成している。
１を時分割した後に、タイミング用のタイミング基準コ
ード３６を挿入するように構成している。
【００３５】
【発明の効果】以上説明したように、本発明の映像信号
時分割回路はハイビジョン用映像信号をシリアルディジ
タルデータのまま時間軸方向に４分割し、３７１Ｍｂｐ
ｓのシリアルディジタル信号４チャンネルの信号として
得ることができるので、ＮＴＳＣ用のシリアルディジタ
ル信号の映像処理部がそのまま流用できるという経済性
に優れた効果を有している。
時分割回路はハイビジョン用映像信号をシリアルディジ
タルデータのまま時間軸方向に４分割し、３７１Ｍｂｐ
ｓのシリアルディジタル信号４チャンネルの信号として
得ることができるので、ＮＴＳＣ用のシリアルディジタ
ル信号の映像処理部がそのまま流用できるという経済性
に優れた効果を有している。
【図１】本発明の映像信号時分割回路の一つの実施の形
態を示すブロック図である。
態を示すブロック図である。
【図２】図２は本実施の形態の動作を説明するタイムチ
ャートである。
ャートである。
【図３】従来の映像信号時分割回路を示すブロック図で
ある。
ある。
１ 多重分離部 ２ タイミング基準コード検出部 ３ タイミング基準コード挿入部 ４，４ａ，４ｂ，４ｃ シリアルパラレル変換器 ５，５ａ，５ｂ，５ｃ 映像処理回路 ６，６ａ，６ｂ，６ｃ パラレルシリアル変換器 ７，７ａ，７ｂ，７ｃ シリアルディジタル映像処理
部 ８ タイミング基準コード検出部 ９ 多重化部 １０ 多重ＥＡＶ １１ 多重ライン番号データ １２ 多重誤り検出符号データ １３ 多重補助データ／未定義ワードデータ １４ 多重ＳＡＶ １５ ディジタル有効ライン １６ シリアルパラレル変換器 １７ 映像処理回路 １８ パラレルシリアル変換器 ２１ ハイビジョン用入力信号 ２２ ハイビジョン用出力信号 ２３，２４，２５，２６ 分割ビット信号 ２７ 同期出力信号 ３２，３３，３４，３５ 映像処理信号 ３６ タイミング基準コード
部 ８ タイミング基準コード検出部 ９ 多重化部 １０ 多重ＥＡＶ １１ 多重ライン番号データ １２ 多重誤り検出符号データ １３ 多重補助データ／未定義ワードデータ １４ 多重ＳＡＶ １５ ディジタル有効ライン １６ シリアルパラレル変換器 １７ 映像処理回路 １８ パラレルシリアル変換器 ２１ ハイビジョン用入力信号 ２２ ハイビジョン用出力信号 ２３，２４，２５，２６ 分割ビット信号 ２７ 同期出力信号 ３２，３３，３４，３５ 映像処理信号 ３６ タイミング基準コード
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ Ｈ０４Ｎ 9/815 (58)調査した分野(Int.Cl.7，ＤＢ名) H04N 11/00 - 11/24 H04N 5/91 - 5/956 H04N 7/00 - 7/08 H04N 9/79 - 9/898
Claims (4)
- 【請求項１】 単一入力の映像信号を一度４チャンネル
に時分割するとともに、前記映像信号から検出して得ら
れる同期信号を前記４チャンネルの時分割信号の各々に
挿入し、これら挿入した信号の各々を映像処理した４チ
ャンネルの映像信号を、前記４チャンネルの映像信号の
一つから検出して得られる基準信号とともに多重化する
ことを特徴とする映像信号時分割回路。 - 【請求項２】 単一入力の映像信号を４チャンネルの時
分割信号として出力する時分割手段と、前記映像信号か
ら第１の基準信号を検出し同期信号を出力する第１の基
準信号検出手段と、前記時分割信号に前記同期信号を挿
入する基準信号挿入手段と、この基準信号挿入手段が出
力する第１，第２の色差信号および第１，第２の輝度信
号の各々に対応して設けた映像処理手段と、これら映像
処理手段が出力する各々の映像信号を多重化し出力する
多重化手段と、前記映像処理手段が出力する第１の色差
信号から前記同期信号を検出し第２の基準信号を前記多
重化手段に出力する第２の基準信号検出手段と、を備え
たことを特徴とする映像信号時分割回路。 - 【請求項３】 前記映像処理手段が、シリアルデータを
パラレルデータに変換するシリアルパラレル変換器と、
前記パラレルデータを映像処理する映像処理回路と、こ
の映像処理回路が出力するパラレルデータをシリアルデ
ータに変換するパラレルシリアル変換器とを有すること
を特徴とする請求項２記載の映像信号時分割回路。 - 【請求項４】 前記映像信号がハイビジョン用映像信号
であることを特徴とする請求項１又は請求項２記載の映
像信号時分割回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP08254515A JP3114628B2 (ja) | 1996-09-26 | 1996-09-26 | 映像信号時分割回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP08254515A JP3114628B2 (ja) | 1996-09-26 | 1996-09-26 | 映像信号時分割回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10108217A JPH10108217A (ja) | 1998-04-24 |
| JP3114628B2 true JP3114628B2 (ja) | 2000-12-04 |
Family
ID=17266124
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP08254515A Expired - Fee Related JP3114628B2 (ja) | 1996-09-26 | 1996-09-26 | 映像信号時分割回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3114628B2 (ja) |
Families Citing this family (3)
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-
1996
- 1996-09-26 JP JP08254515A patent/JP3114628B2/ja not_active Expired - Fee Related
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| Publication number | Publication date |
|---|---|
| JPH10108217A (ja) | 1998-04-24 |
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