JP3102443B2 - データ入力装置 - Google Patents
データ入力装置Info
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Description
【０００１】
【産業上の利用分野】この発明は、人間の操作によって
計算機に入力するためのデータ入力装置に関するもので
ある。
計算機に入力するためのデータ入力装置に関するもので
ある。
【０００２】
【従来の技術】図６は従来のこの種のデータ入力装置の
構成を示すブロック図であり、図６において、演算処理
装置としてのＣＰＵ（１）にプログラムデータメモリ
（２）、データ入力インタフェース回路（３）、ホスト
インタフェース回路（５）を接続し、上記データ入力イ
ンタフェース回路（３）にデータ入力接点（４）を接続
し、上記ホストインタフェース回路（５）にホストＣＰ
Ｕ部（６）を接続して構成されている。
構成を示すブロック図であり、図６において、演算処理
装置としてのＣＰＵ（１）にプログラムデータメモリ
（２）、データ入力インタフェース回路（３）、ホスト
インタフェース回路（５）を接続し、上記データ入力イ
ンタフェース回路（３）にデータ入力接点（４）を接続
し、上記ホストインタフェース回路（５）にホストＣＰ
Ｕ部（６）を接続して構成されている。
【０００３】次に動作について説明する。手動によりデ
ータ入力接点（４）を操作して入力したデータをＣＰＵ
（１）がプログラムデータメモリ（２）にメモリされた
プログラムに従って処理し、ホストインタフェース回路
（５）を介してホストＣＰＵ部（６）に入力する。
ータ入力接点（４）を操作して入力したデータをＣＰＵ
（１）がプログラムデータメモリ（２）にメモリされた
プログラムに従って処理し、ホストインタフェース回路
（５）を介してホストＣＰＵ部（６）に入力する。
【０００４】
【発明が解決しようとする課題】従来のデータ入力装置
は以上のように構成されているので、ホストＣＰＵ部
（６）がデータ入力接点（４）に対する信号コードを得
るためには、必ず人間の介入が必要となり、一連の接点
入力を長時間規則的に繰り返し、ホストＣＰＵ部（６）
に対し送信し続けることが困難である。このため繰り返
しを必要とするデータ入力に対するシステムの耐久テス
ト、不具合再現テストを実施する上で問題点があった。
は以上のように構成されているので、ホストＣＰＵ部
（６）がデータ入力接点（４）に対する信号コードを得
るためには、必ず人間の介入が必要となり、一連の接点
入力を長時間規則的に繰り返し、ホストＣＰＵ部（６）
に対し送信し続けることが困難である。このため繰り返
しを必要とするデータ入力に対するシステムの耐久テス
ト、不具合再現テストを実施する上で問題点があった。
【０００５】この発明は、上記のような問題点を解消す
ることを課題になされたもので、人間による一連のデー
タ入力操作時の入力接点およびタイミングを記憶するこ
とができるとともに、その記憶に従って繰り返し自由に
再生することができるデータ入力装置を得ることを目的
とする。
ることを課題になされたもので、人間による一連のデー
タ入力操作時の入力接点およびタイミングを記憶するこ
とができるとともに、その記憶に従って繰り返し自由に
再生することができるデータ入力装置を得ることを目的
とする。
【０００６】
【課題を解決するための手段】この発明に係るデータ入
力装置は、ホスト計算機にデータを入力するためのデー
タ入力装置において、データを入力する入力接点とイン
タフェースするデータ入力インタフェース回路と、演算
処理に必要なプログラムデータを記憶するプログラムデ
ータメモリと、プログラムを実行するＣＰＵと、ホスト
ＣＰＵとインタフェースするホストインタフェース回路
と、前記入力接点から入力した一連の入力データおよび
入力時のタイミングデータを対にして記憶する操作記憶
メモリと、この操作記憶メモリに対する入力データの記
憶処理および再生処理を行なうためのプログラムを記憶
した操作再生プログラムメモリとを具備し、前記操作再
生プログラムメモリに記憶されている再生処理を行なう
ためのプログラムを前記ＣＰＵで実行することにより、
前記操作記憶メモリに記憶された一連の入力データおよ
び入力時のタイミングデータに基づいて、前記ホストＣ
ＰＵを利用することなくそのデータを入力した時と同じ
データ並びに同じデータの入力タイミングで前記ホスト
計算機における試験のために使用されるデータ入力を再
現させることを特徴とする。
力装置は、ホスト計算機にデータを入力するためのデー
タ入力装置において、データを入力する入力接点とイン
タフェースするデータ入力インタフェース回路と、演算
処理に必要なプログラムデータを記憶するプログラムデ
ータメモリと、プログラムを実行するＣＰＵと、ホスト
ＣＰＵとインタフェースするホストインタフェース回路
と、前記入力接点から入力した一連の入力データおよび
入力時のタイミングデータを対にして記憶する操作記憶
メモリと、この操作記憶メモリに対する入力データの記
憶処理および再生処理を行なうためのプログラムを記憶
した操作再生プログラムメモリとを具備し、前記操作再
生プログラムメモリに記憶されている再生処理を行なう
ためのプログラムを前記ＣＰＵで実行することにより、
前記操作記憶メモリに記憶された一連の入力データおよ
び入力時のタイミングデータに基づいて、前記ホストＣ
ＰＵを利用することなくそのデータを入力した時と同じ
データ並びに同じデータの入力タイミングで前記ホスト
計算機における試験のために使用されるデータ入力を再
現させることを特徴とする。
【０００７】
【作用】この発明における操作記憶メモリは、入力接点
から入力した一連の入力データおよび入力時のタイミン
グデータを記憶し、操作再生プログラムメモリは、上記
操作記憶メモリへの記憶処理および再生処理を行うため
に必要なプログラムを格納していることにより、人的に
入力した入力データを正確に繰返し再現できる。
から入力した一連の入力データおよび入力時のタイミン
グデータを記憶し、操作再生プログラムメモリは、上記
操作記憶メモリへの記憶処理および再生処理を行うため
に必要なプログラムを格納していることにより、人的に
入力した入力データを正確に繰返し再現できる。
【０００８】
【実施例】実施例１． 以下、この発明の一実施例を図について説明
する。前記図６と同一部分には同一符号を付して重複説
明を省略した図１において、（７）は操作記憶メモリ
で、データ入力時の一連の入力データおよびタイミング
データを記憶するもので、ＣＰＵ（１）のバスライン
（９）上に接続されている。（８）は操作再生プログラ
ムメモリで、一連の入力データとタイミングデータを操
作記憶メモリに記憶させる記憶処理プログラムおよび該
操作記憶メモリに記憶した入力データを再生してホスト
ＣＰＵ（６）にデータ送信する再生処理プログラムを記
憶するもので、ＣＰＵ（１）のバスライン（９）上に接
続されている。
する。前記図６と同一部分には同一符号を付して重複説
明を省略した図１において、（７）は操作記憶メモリ
で、データ入力時の一連の入力データおよびタイミング
データを記憶するもので、ＣＰＵ（１）のバスライン
（９）上に接続されている。（８）は操作再生プログラ
ムメモリで、一連の入力データとタイミングデータを操
作記憶メモリに記憶させる記憶処理プログラムおよび該
操作記憶メモリに記憶した入力データを再生してホスト
ＣＰＵ（６）にデータ送信する再生処理プログラムを記
憶するもので、ＣＰＵ（１）のバスライン（９）上に接
続されている。
【０００９】図２は上記操作再生プログラムメモリ
（８）に格納されているプログラムのフローチャートを
示すもので、スタート後に行われる入力接点チェック処
理（ステップＳＴ２−１）、入力有かの判断（ステップ
ＳＴ２−２）、入力接点に対応する信号コードをホスト
に送信する処理（ステップＳＴ２−１２）および計数値
カウント・タイムディレー（ステップＳＴ２−１３）は
従来と同等の処理であるが、それを除く処理プログラム
が操作再生プログラムメモリ（８）に格納されている。
以下、図２のフローチャートについて説明する。
（８）に格納されているプログラムのフローチャートを
示すもので、スタート後に行われる入力接点チェック処
理（ステップＳＴ２−１）、入力有かの判断（ステップ
ＳＴ２−２）、入力接点に対応する信号コードをホスト
に送信する処理（ステップＳＴ２−１２）および計数値
カウント・タイムディレー（ステップＳＴ２−１３）は
従来と同等の処理であるが、それを除く処理プログラム
が操作再生プログラムメモリ（８）に格納されている。
以下、図２のフローチャートについて説明する。
【００１０】ＣＰＵ（１）のリセットにより、初期化処
理実行後、データ入力インタフェース回路（３）を介し
てデータ入力接点（４）の有無を入力接点チェック処理
（ステップＳＴ２−１）し入力有かをチェック（ステッ
プＳＴ２−２）し、ＹＥＳ、つまり、新たな入力接点が
あるならば、データ入力接点（４）に対応する処理に移
行し、ＮＯ、つまり、新たな入力接点がなければ、タイ
ムディレー（例えば５０ｍｓｅｃ）の後に計数値をカウ
ントアップし（ステップＳＴ２−１３）、再びステップ
ＳＴ２−１に戻ってデータ入力接点（４）のチェック処
理を実行する。上記ステップＳＴ２−２の判断におい
て、新たな入力接点があった場合、そのデータ入力接点
（４）が図３に示す各処理に対応するものかどうかを順
次チェックする。図３は、操作再生処理の制御に必要な
処理に対応する接点の組合せを示す例で、例えば記憶ス
タート処理は、“ｃｎｔｒｌ”，“ｓｈｉｆｔ”，
“ｓ”の３ケの接点が同時に入力された時に起動される
ことを示す。この対応データは、図４に示すように、操
作記憶メモリ（７）に格納されており、システムによっ
て変更可能である。新たな入力接点はこのデータに基づ
いて順次チェックされ該当する処理を実行する。以下各
処理について述べる。
理実行後、データ入力インタフェース回路（３）を介し
てデータ入力接点（４）の有無を入力接点チェック処理
（ステップＳＴ２−１）し入力有かをチェック（ステッ
プＳＴ２−２）し、ＹＥＳ、つまり、新たな入力接点が
あるならば、データ入力接点（４）に対応する処理に移
行し、ＮＯ、つまり、新たな入力接点がなければ、タイ
ムディレー（例えば５０ｍｓｅｃ）の後に計数値をカウ
ントアップし（ステップＳＴ２−１３）、再びステップ
ＳＴ２−１に戻ってデータ入力接点（４）のチェック処
理を実行する。上記ステップＳＴ２−２の判断におい
て、新たな入力接点があった場合、そのデータ入力接点
（４）が図３に示す各処理に対応するものかどうかを順
次チェックする。図３は、操作再生処理の制御に必要な
処理に対応する接点の組合せを示す例で、例えば記憶ス
タート処理は、“ｃｎｔｒｌ”，“ｓｈｉｆｔ”，
“ｓ”の３ケの接点が同時に入力された時に起動される
ことを示す。この対応データは、図４に示すように、操
作記憶メモリ（７）に格納されており、システムによっ
て変更可能である。新たな入力接点はこのデータに基づ
いて順次チェックされ該当する処理を実行する。以下各
処理について述べる。
【００１１】まず、新たな入力接点が記憶スタート接点
かを判断し（ステップＳＴ２−３）、ＹＥＳの場合は操
作記憶メモリ（７）の制御データ中の処理モードを記憶
モードとする（ステップＳＴ２−４）。既に記憶モード
であった場合は、直前までの記憶データを全て初期化
（クリア）した後、記憶モードとし、タイムディレー後
次の入力接点チェック処理に戻る。
かを判断し（ステップＳＴ２−３）、ＹＥＳの場合は操
作記憶メモリ（７）の制御データ中の処理モードを記憶
モードとする（ステップＳＴ２−４）。既に記憶モード
であった場合は、直前までの記憶データを全て初期化
（クリア）した後、記憶モードとし、タイムディレー後
次の入力接点チェック処理に戻る。
【００１２】ステップＳＴ２−３の判断がＮＯの場合、
新たな入力接点が記憶終了接点かを判断し（ステップＳ
Ｔ２−５）、ＹＥＳの場合は操作記憶メモリ（７）の記
憶モードを解除（ステップＳＴ２−６）、つまり、制御
データ中の処理モードを記憶完了モードとし、更にその
時の計数値を再生用データの最新の計数値格納エリアに
設定する。そして、タイムディレーの後、次の入力接点
チェック処理に戻る。ステップＳＴ２−５の判断がＮＯ
の場合、新たな入力接点が繰返し設定接点かを判断し
（ステップＳＴ２−７）、ＹＥＳの場合は以降接点入力
が数値コードの間、それを“繰返し回数”として入力処
理し、操作記憶メモリ（７）の制御データ中の“繰返し
回数”にセットする。例えば、接点“１”，“２”，
“８”と順に入力した場合、“繰返し回数を１２８とし
てセットする。数値以外の接点が入力された場合は、そ
こで終了とする。もし数値が入力されなかった場合は、
前回値とする（ステップＳＴ２−８）。
新たな入力接点が記憶終了接点かを判断し（ステップＳ
Ｔ２−５）、ＹＥＳの場合は操作記憶メモリ（７）の記
憶モードを解除（ステップＳＴ２−６）、つまり、制御
データ中の処理モードを記憶完了モードとし、更にその
時の計数値を再生用データの最新の計数値格納エリアに
設定する。そして、タイムディレーの後、次の入力接点
チェック処理に戻る。ステップＳＴ２−５の判断がＮＯ
の場合、新たな入力接点が繰返し設定接点かを判断し
（ステップＳＴ２−７）、ＹＥＳの場合は以降接点入力
が数値コードの間、それを“繰返し回数”として入力処
理し、操作記憶メモリ（７）の制御データ中の“繰返し
回数”にセットする。例えば、接点“１”，“２”，
“８”と順に入力した場合、“繰返し回数を１２８とし
てセットする。数値以外の接点が入力された場合は、そ
こで終了とする。もし数値が入力されなかった場合は、
前回値とする（ステップＳＴ２−８）。
【００１３】ステップＳＴ２−７の判断がＮＯの場合、
新たなデータ入力接点（４）が再生スタート接点かを判
断し（ステップＳＴ２−９）、ＹＥＳの場合は操作記憶
メモリ（７）に格納されている情報に基づき再生処理を
行う（ステップＳＴ２−１０）。
新たなデータ入力接点（４）が再生スタート接点かを判
断し（ステップＳＴ２−９）、ＹＥＳの場合は操作記憶
メモリ（７）に格納されている情報に基づき再生処理を
行う（ステップＳＴ２−１０）。
【００１４】ステップＳＴ２−９の判断がＮＯの場合、
記憶モード移行後の最初の接点入力からの時間計数値と
共に接点番号に対応する信号コードを記憶し、記憶処理
を行なう（ステップＳＴ２−１１）。
記憶モード移行後の最初の接点入力からの時間計数値と
共に接点番号に対応する信号コードを記憶し、記憶処理
を行なう（ステップＳＴ２−１１）。
【００１５】図５は上記ステップＳＴ２−１０における
再生処理のフローチャートを示す。まず、処理モードが
既に記憶完了済み（＝２）かを判断し（ステップＳＴ５
−１）、ＹＥＳの場合は接点登録数が０でないかを判断
する（ステップＳＴ５−２）。ＹＥＳの場合は第１のカ
ウンタ（＝０）、繰り返し回数（＝０）かを判断し（ス
テップＳＴ５−３，ＳＴ５−４）、ＮＯの場合は第１の
カウンタのカウント数が繰り返し回数より小さいかを判
断する（ステップＳＴ５−５）。
再生処理のフローチャートを示す。まず、処理モードが
既に記憶完了済み（＝２）かを判断し（ステップＳＴ５
−１）、ＹＥＳの場合は接点登録数が０でないかを判断
する（ステップＳＴ５−２）。ＹＥＳの場合は第１のカ
ウンタ（＝０）、繰り返し回数（＝０）かを判断し（ス
テップＳＴ５−３，ＳＴ５−４）、ＮＯの場合は第１の
カウンタのカウント数が繰り返し回数より小さいかを判
断する（ステップＳＴ５−５）。
【００１６】ＹＥＳの場合は上記ステップＳＴ５−４の
判断がＹＥＳの場合とともに第２のカウンタ（＝０）、
第２のカウンタのカウント数が登録数より小さいかを判
断し（ステップＳＴ５−６，ＳＴ５−７）、ＹＥＳの場
合は接点番号ｌ番目をホストに送信する（ステップＳＴ
５−８）、次いで時間計数値ｌ番目のタイムディレーを
発生させた後（ステップＳＴ５−９）、強制ストップ入
力無かを判断し（ステップＳＴ５−１０）、ＹＥＳの場
合は第２のカウンタをインクリメントしてステップＳＴ
５−７に戻り動作を繰り返す。また、ステップＳＴ５−
７の判断がＮＯの場合は第１のカウンタをインクリメン
トしてステップＳＴ５−４に戻り上記の動作を繰り返
す。
判断がＹＥＳの場合とともに第２のカウンタ（＝０）、
第２のカウンタのカウント数が登録数より小さいかを判
断し（ステップＳＴ５−６，ＳＴ５−７）、ＹＥＳの場
合は接点番号ｌ番目をホストに送信する（ステップＳＴ
５−８）、次いで時間計数値ｌ番目のタイムディレーを
発生させた後（ステップＳＴ５−９）、強制ストップ入
力無かを判断し（ステップＳＴ５−１０）、ＹＥＳの場
合は第２のカウンタをインクリメントしてステップＳＴ
５−７に戻り動作を繰り返す。また、ステップＳＴ５−
７の判断がＮＯの場合は第１のカウンタをインクリメン
トしてステップＳＴ５−４に戻り上記の動作を繰り返
す。
【００１７】新たな入力接点が図３に示す接点の何れで
もない場合、もし、処理モード＝２の時は、タイミング
記憶用の計数値を初期化（＝０）とすると共に操作記憶
メモリ（７）の接点番号１のエリアに入力された接点情
報（信号コード）を格納する。続いて再び、図３に示す
接点以外の入力があった場合、処理モード＝３とし、そ
の時の計数値を計数値１のエリアに格納し、入力された
接点情報（信号コード）を、接点番号２のエリアに格納
する。
もない場合、もし、処理モード＝２の時は、タイミング
記憶用の計数値を初期化（＝０）とすると共に操作記憶
メモリ（７）の接点番号１のエリアに入力された接点情
報（信号コード）を格納する。続いて再び、図３に示す
接点以外の入力があった場合、処理モード＝３とし、そ
の時の計数値を計数値１のエリアに格納し、入力された
接点情報（信号コード）を、接点番号２のエリアに格納
する。
【００１８】このようにして、記憶すべき接点入力毎
に、計数値をそれぞれ“計数値”のエリアに、接点情報
（信号コード）を“接点番号”のエリアに格納する（ス
テップＳＴ２−１１）。
に、計数値をそれぞれ“計数値”のエリアに、接点情報
（信号コード）を“接点番号”のエリアに格納する（ス
テップＳＴ２−１１）。
【００１９】次に入力接点をホストＣＰＵ部（６）に送
信する必要がある場合は、従来と同様にホストＣＰＵ部
（６）にデータを送信する（ステップＳＴ２−１２）。
更に、次の入力接点のチェックを行う前に、タイムディ
レーと共に計数値をカウントアップし、タイミングデー
タとして保持する（ステップＳＴ２−１３）。
信する必要がある場合は、従来と同様にホストＣＰＵ部
（６）にデータを送信する（ステップＳＴ２−１２）。
更に、次の入力接点のチェックを行う前に、タイムディ
レーと共に計数値をカウントアップし、タイミングデー
タとして保持する（ステップＳＴ２−１３）。
【００２０】実施例２． 上記の実施例１では、操作記憶メモリ（７）および操作
再生プログラムメモリ（８）は、ＣＰＵ（１）のバスラ
イン（９）に接続された個別のメモリデバイスとしてい
るが、プログラムデータメモリ（２）と共通のメモリデ
バイス内に持たせてもよい。また、データ入力接点
（４）は通常のキーボード入力装置の他、タッチ入力等
他の入力手段であってもよい。
再生プログラムメモリ（８）は、ＣＰＵ（１）のバスラ
イン（９）に接続された個別のメモリデバイスとしてい
るが、プログラムデータメモリ（２）と共通のメモリデ
バイス内に持たせてもよい。また、データ入力接点
（４）は通常のキーボード入力装置の他、タッチ入力等
他の入力手段であってもよい。
【００２１】実施例３． 実施例１では、操作記憶メモリ（７）に記憶される接点
情報は２５６ケ分であるが、メモリの許す限り更に大き
くとってもよい。また、図３に示す処理に割りつけられ
た入力接点との関係は自由に変更可能である。更に、操
作記憶メモリ（７）の構成は必要な情報エリアがあれ
ば、その割付は自由である。
情報は２５６ケ分であるが、メモリの許す限り更に大き
くとってもよい。また、図３に示す処理に割りつけられ
た入力接点との関係は自由に変更可能である。更に、操
作記憶メモリ（７）の構成は必要な情報エリアがあれ
ば、その割付は自由である。
【００２２】実施例４． 実施例１では、強制ストップ入力処理等図３に示す処理
を接点入力としているが、これは、ホストＣＰＵ部
（６）からの受信データによって入力可能としてもよ
い。
を接点入力としているが、これは、ホストＣＰＵ部
（６）からの受信データによって入力可能としてもよ
い。
【００２３】実施例５． 実施例１では接点入力のチェックをタイムディレー５０
ｍｓｅｃを例としているが、特にその必要はなく、ＣＰ
Ｕ（１）の性能、ホストＣＰＵ部（６）とのインターフ
ェース処理等の負荷から考慮して最適な値にすればよ
く、タイムディレーが短い程、再生タイミングの精度が
高くなる。
ｍｓｅｃを例としているが、特にその必要はなく、ＣＰ
Ｕ（１）の性能、ホストＣＰＵ部（６）とのインターフ
ェース処理等の負荷から考慮して最適な値にすればよ
く、タイムディレーが短い程、再生タイミングの精度が
高くなる。
【００２４】
【発明の効果】以上のように、この発明のよれば、入力
接点から入力した一連の入力データおよび入力時のタイ
ミングデータを操作記憶メモリに記憶し、この操作記憶
メモリに対する入力データの記憶処理および再生処理を
行い再生した入力データをホストＣＰＵ部に送るプログ
ラムを操作再生プログラムメモリに記憶するように構成
したので、オペレータと全く同様の操作を何度でも再現
できる。また、ホストＣＰＵ部側での再生プログラムも
不要となり、ホストＣＰＵ部の負荷も通常と変化なく、
容易にオペレータ入力を再現できる等の効果がある。
接点から入力した一連の入力データおよび入力時のタイ
ミングデータを操作記憶メモリに記憶し、この操作記憶
メモリに対する入力データの記憶処理および再生処理を
行い再生した入力データをホストＣＰＵ部に送るプログ
ラムを操作再生プログラムメモリに記憶するように構成
したので、オペレータと全く同様の操作を何度でも再現
できる。また、ホストＣＰＵ部側での再生プログラムも
不要となり、ホストＣＰＵ部の負荷も通常と変化なく、
容易にオペレータ入力を再現できる等の効果がある。
【図１】この発明の実施例によるデータ入力装置を示す
ブロック図である。
ブロック図である。
【図２】この発明の一実施例装置における操作再生プロ
グラムの処理フローチャート図である。
グラムの処理フローチャート図である。
【図３】この発明の実施例装置における入力接点と処理
の対応表である。
の対応表である。
【図４】この発明の実施例装置における操作記憶メモリ
の構成図である。
の構成図である。
【図５】この発明の実施例装置における再生処理のフロ
ーチャート図である。
ーチャート図である。
【図６】従来のデータ入力装置を示すブロック図であ
る。
る。
（１） ＣＰＵ （２） プログラム・データメモリ （３） データ入力インタフェース回路 （４） データ入力接点 （５） ホスト・インタフェース回路 （６） ホストＣＰＵ部 （７） 操作記憶メモリ （８） 操作再生プログラム・メモリ
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平２−77819（ＪＰ，Ａ) 特開 平４−257909（ＪＰ，Ａ) 特開 平３−14116（ＪＰ，Ａ) 特開 平３−27466（ＪＰ，Ａ) 実開 昭62−158498（ＪＰ，Ｕ)
Claims (1)
- 【請求項１】 ホスト計算機にデータを入力するための
データ入力装置において、 データを入力する入力接点とインタフェースするデータ
入力インタフェース回路と、 演算処理に必要なプログラムデータを記憶するプログラ
ムデータメモリと、プログラムを実行するＣＰＵと、 ホストＣＰＵとインタフェースするホストインタフェー
ス回路と、 前記入力接点から入力した一連の入力データおよび入力
時のタイミングデータを対にして記憶する操作記憶メモ
リと、 こ の操作記憶メモリに対する入力データの記憶処理およ
び再生処理を行なうためのプログラムを記憶した操作再
生プログラムメモリと、 を 具備し、前記操作再生プログラムメモリに記憶されて
いる再生処理を行なうためのプログラムを前記ＣＰＵで
実行することにより、前記操作記憶メモリに記憶された
一連の入力データおよび入力時のタイミングデータに基
づいて、前記ホストＣＰＵを利用することなくそのデー
タを入力した時と同じデータ並びに同じデータの入力タ
イミングで前記ホスト計算機における試験のために使用
されるデータ入力を再現させることを特徴とするデータ
入力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03127709A JP3102443B2 (ja) | 1991-05-30 | 1991-05-30 | データ入力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03127709A JP3102443B2 (ja) | 1991-05-30 | 1991-05-30 | データ入力装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04352214A JPH04352214A (ja) | 1992-12-07 |
| JP3102443B2 true JP3102443B2 (ja) | 2000-10-23 |
Family
ID=14966773
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03127709A Expired - Fee Related JP3102443B2 (ja) | 1991-05-30 | 1991-05-30 | データ入力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3102443B2 (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0277819A (ja) * | 1988-09-13 | 1990-03-16 | Nec Corp | キーボード入力装置の評価装置 |
| JP2744528B2 (ja) * | 1991-02-12 | 1998-04-28 | 富士ファコム制御株式会社 | キーボード入力装置 |
-
1991
- 1991-05-30 JP JP03127709A patent/JP3102443B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04352214A (ja) | 1992-12-07 |
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