JP3096114B2 - ファクシミリ装置 - Google Patents
ファクシミリ装置Info
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- JP3096114B2 JP3096114B2 JP03304007A JP30400791A JP3096114B2 JP 3096114 B2 JP3096114 B2 JP 3096114B2 JP 03304007 A JP03304007 A JP 03304007A JP 30400791 A JP30400791 A JP 30400791A JP 3096114 B2 JP3096114 B2 JP 3096114B2
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Description
【０００１】
【産業上の利用分野】本発明は、ファクシミリ装置にお
けるモータ制御に関する。
けるモータ制御に関する。
【０００２】
【従来の技術】従来より、ファクシミリ装置において
は、読み取り原稿を搬送する駆動源としてステッピング
モータが用いられてきた。そして、特に近年において
は、高画質を実現するため、より精度の高いモータ制御
技術が要求されている。
は、読み取り原稿を搬送する駆動源としてステッピング
モータが用いられてきた。そして、特に近年において
は、高画質を実現するため、より精度の高いモータ制御
技術が要求されている。
【０００３】そこで、このような要求に応える手段とし
て、モータ制御専用のスレーブＣＰＵを設け、ホストＣ
ＰＵの管理のもとでモータ制御を行わせるという方法が
とられている。スレーブＣＰＵとしては、ＲＯＭ、ＲＡ
Ｍ、Ｉ／Ｏ制御部等を内蔵したワンチップマイクロコン
ピュータが用いられている。
て、モータ制御専用のスレーブＣＰＵを設け、ホストＣ
ＰＵの管理のもとでモータ制御を行わせるという方法が
とられている。スレーブＣＰＵとしては、ＲＯＭ、ＲＡ
Ｍ、Ｉ／Ｏ制御部等を内蔵したワンチップマイクロコン
ピュータが用いられている。
【０００４】図２は、ワンチップマイクロコンピュータ
の構成例を示すブロック図である。このワンチップマイ
クロコンピュータは、ＣＰＵ２０１と、プログラムで用
いる制御変数等を格納するためのＲＡＭ２０２と、制御
プログラムを格納したＲＯＭ２０３と、例えばあるタイ
マ値をセットすることで所望の周期ごとに割り込みをか
けるのに用いるタイマ２０４と、相励磁ＩＣ２０６を介
してモータ２０７を制御するためのＩ／Ｏ制御部２０５
と、外部バス２１１を介してホストＣＰＵとのコマンド
インターフェースを実現するバスＩ／Ｆ制御部２０９
と、スレーブＣＰＵ内部バス２１０とを有する。
の構成例を示すブロック図である。このワンチップマイ
クロコンピュータは、ＣＰＵ２０１と、プログラムで用
いる制御変数等を格納するためのＲＡＭ２０２と、制御
プログラムを格納したＲＯＭ２０３と、例えばあるタイ
マ値をセットすることで所望の周期ごとに割り込みをか
けるのに用いるタイマ２０４と、相励磁ＩＣ２０６を介
してモータ２０７を制御するためのＩ／Ｏ制御部２０５
と、外部バス２１１を介してホストＣＰＵとのコマンド
インターフェースを実現するバスＩ／Ｆ制御部２０９
と、スレーブＣＰＵ内部バス２１０とを有する。
【０００５】以下、このような構成におけるモータの制
御方法について説明する。
御方法について説明する。
【０００６】まず、ホストＣＰＵからのトリガコマンド
をバスＩ／Ｆ制御部２０９を介して受け取る。
をバスＩ／Ｆ制御部２０９を介して受け取る。
【０００７】このトリガコマンドには、周波数情報とス
テップ数情報を含んでいる。
テップ数情報を含んでいる。
【０００８】例えば、４００ｐｐｓで４ステップ動かす
場合には、タイマ２０４に２．５ｍｓｅｃという値を設
定して、２．５ｍｓｅｃごとに励磁相を切り換える割り
込みプログラムを発生させる。この割り込み内で４回励
磁相を切り換えればモータが４ステップ動くことにな
る。また高速でモータを回転させる場合、モータの自起
動周波数から加速して行き所望の周波数まで到達させる
という加速制御が必要となる。
場合には、タイマ２０４に２．５ｍｓｅｃという値を設
定して、２．５ｍｓｅｃごとに励磁相を切り換える割り
込みプログラムを発生させる。この割り込み内で４回励
磁相を切り換えればモータが４ステップ動くことにな
る。また高速でモータを回転させる場合、モータの自起
動周波数から加速して行き所望の周波数まで到達させる
という加速制御が必要となる。
【０００９】図３は、１６００ｐｐｓまでの加速制御の
例を説明する模式図である。
例を説明する模式図である。
【００１０】図中Ａのタイミングで４００ｐｐｓ−１ス
テップのトリガコマンドを受け取ると、スレーブＣＰＵ
は、図中ａのタイミングで励磁相を切り換えて１ステッ
プだけモータを動かす。なお、この１ステップはファク
シミリ装置でいうスーパーファイン１ライン分［１５．
４ライン／ｍｍ］に相当する。
テップのトリガコマンドを受け取ると、スレーブＣＰＵ
は、図中ａのタイミングで励磁相を切り換えて１ステッ
プだけモータを動かす。なお、この１ステップはファク
シミリ装置でいうスーパーファイン１ライン分［１５．
４ライン／ｍｍ］に相当する。
【００１１】次に、図中Ｂのタイミングで８００ｐｐｓ
−２ステップのトリガコマンドを受け取ると、スレーブ
ＣＰＵは、図中ｂ１、ｂ２のタイミングで励磁相を切り
換えてモータを２ステップ動かす。そして、図中Ｄのタ
イミングで、到達目標である１６００ｐｐｓ−４ステッ
プのトリガコマンドを受け取ると、図中ｄ１、ｄ２、ｄ
３、ｄ４のタイミングで励磁相を切り換える。以降、こ
のトリガコマンドによって１６００ｐｐｓでモータを回
転させる。
−２ステップのトリガコマンドを受け取ると、スレーブ
ＣＰＵは、図中ｂ１、ｂ２のタイミングで励磁相を切り
換えてモータを２ステップ動かす。そして、図中Ｄのタ
イミングで、到達目標である１６００ｐｐｓ−４ステッ
プのトリガコマンドを受け取ると、図中ｄ１、ｄ２、ｄ
３、ｄ４のタイミングで励磁相を切り換える。以降、こ
のトリガコマンドによって１６００ｐｐｓでモータを回
転させる。
【００１２】一方、ホストＣＰＵの負荷をより一層軽減
するために、前述の加速情報をスレーブＣＰＵ内のＲＯ
Ｍにテーブルとして取り込み、ホストＣＰＵは加速を意
識せずにトリガコマンドを発行するだけでスレーブＣＰ
Ｕ側で独自に加速するという方法もとられている。
するために、前述の加速情報をスレーブＣＰＵ内のＲＯ
Ｍにテーブルとして取り込み、ホストＣＰＵは加速を意
識せずにトリガコマンドを発行するだけでスレーブＣＰ
Ｕ側で独自に加速するという方法もとられている。
【００１３】図４は、スレーブＣＰＵのＲＯＭ２０３内
の加速情報テーブルの例を示す模式図である。
の加速情報テーブルの例を示す模式図である。
【００１４】スレーブＣＰＵは、この加速情報テーブル
を何種類か有しており、ホストＣＰＵからのコマンドに
よりいずれか１つを選択する。
を何種類か有しており、ホストＣＰＵからのコマンドに
よりいずれか１つを選択する。
【００１５】テーブル内のデータはポインタにより管理
させており、トリガコマンドを受けるとポインタの指し
ている周波数とステップ数でモータを動かした後、ポイ
ンタを次データにセットする。このようにポインタを移
動して行けば簡単に加速制御が実現できる。加速情報テ
ーブルの終わりには、終了コードを設けてあり、次デー
タが終了コードの場合には、ポインタの位置を固定して
以降のトリガコマンドに対してはその指し示す周波数デ
ータとステップ数データにてモータを回転させる。
させており、トリガコマンドを受けるとポインタの指し
ている周波数とステップ数でモータを動かした後、ポイ
ンタを次データにセットする。このようにポインタを移
動して行けば簡単に加速制御が実現できる。加速情報テ
ーブルの終わりには、終了コードを設けてあり、次デー
タが終了コードの場合には、ポインタの位置を固定して
以降のトリガコマンドに対してはその指し示す周波数デ
ータとステップ数データにてモータを回転させる。
【００１６】
【発明が解決しようとする課題】しかしながら、上記従
来例において、スレーブＣＰＵであるワンチップマイク
ロコンピュータの内蔵ＲＯＭの容量は少なく、加速情報
テーブルを何種類ももつのは困難である。
来例において、スレーブＣＰＵであるワンチップマイク
ロコンピュータの内蔵ＲＯＭの容量は少なく、加速情報
テーブルを何種類ももつのは困難である。
【００１７】また、ワンチップマイクロコンピュータの
プログラム容量と加速情報テーブルが占める容量とを常
に考慮しながら設計しなければならず、プログラム開発
においても極めて不便であった。
プログラム容量と加速情報テーブルが占める容量とを常
に考慮しながら設計しなければならず、プログラム開発
においても極めて不便であった。
【００１８】本発明は、ホストＣＰＵに負担をかけるこ
となく、かつスレーブＣＰＵ側のメモリ容量を大きくす
ることなく、複数種類の加速情報テーブルを使い分けて
高精度のモータ制御を行うことができるファクシミリ装
置を提供することを目的とする。
となく、かつスレーブＣＰＵ側のメモリ容量を大きくす
ることなく、複数種類の加速情報テーブルを使い分けて
高精度のモータ制御を行うことができるファクシミリ装
置を提供することを目的とする。
【００１９】
【課題を解決するための手段】本発明は、装置全体の制
御をつかさどるホストＣＰＵの他に、このホストＣＰＵ
の制御下におかれるモータ制御用のＲＯＭ、ＲＡＭ内蔵
型のスレーブＣＰＵを有するファクシミリ装置におい
て、ホストＣＰＵ側のＲＯＭ内に複数通りの加速情報テ
ーブルを設けるとともに、スレーブＣＰＵ内蔵のＲＡＭ
に前記加速情報テーブル１つ分が格納できるエリアを設
け、原稿を読み取る前にＲＯＭ内のテーブル群の内から
１つを選択してスレーブＣＰＵ内の格納エリアに転送
し、ホストＣＰＵから発行されるトリガコマンドに対し
てスレーブＣＰＵが内蔵ＲＡＭに格納した加速情報を基
にモータを回転させることを特徴とする。
御をつかさどるホストＣＰＵの他に、このホストＣＰＵ
の制御下におかれるモータ制御用のＲＯＭ、ＲＡＭ内蔵
型のスレーブＣＰＵを有するファクシミリ装置におい
て、ホストＣＰＵ側のＲＯＭ内に複数通りの加速情報テ
ーブルを設けるとともに、スレーブＣＰＵ内蔵のＲＡＭ
に前記加速情報テーブル１つ分が格納できるエリアを設
け、原稿を読み取る前にＲＯＭ内のテーブル群の内から
１つを選択してスレーブＣＰＵ内の格納エリアに転送
し、ホストＣＰＵから発行されるトリガコマンドに対し
てスレーブＣＰＵが内蔵ＲＡＭに格納した加速情報を基
にモータを回転させることを特徴とする。
【００２０】
【実施例】図１は、本発明の一実施例におけるファクシ
ミリ装置の構成を示すブロック図である。
ミリ装置の構成を示すブロック図である。
【００２１】ホストＣＰＵ１０１は、装置全体を制御す
るＣＰＵである。また、ＲＡＭ１０２は、主にホストＣ
ＰＵ１０１のプログラム制御変数を格納するためのメモ
リであり、ＲＡＭ１０３は、ホストＣＰＵ１０１の制御
プログラムを格納するためのメモリである。また、スレ
ーブＣＰＵ１０４は、ステッピングモータ１０５を制御
する専用のサブＣＰＵである。
るＣＰＵである。また、ＲＡＭ１０２は、主にホストＣ
ＰＵ１０１のプログラム制御変数を格納するためのメモ
リであり、ＲＡＭ１０３は、ホストＣＰＵ１０１の制御
プログラムを格納するためのメモリである。また、スレ
ーブＣＰＵ１０４は、ステッピングモータ１０５を制御
する専用のサブＣＰＵである。
【００２２】さらに、この装置には、ホストＣＰＵ１０
１と各部をつなぐバス１０６と、ＣＣＤや画像処理ＩＣ
等からなるスキャナ１０７と、原稿の有無等を検知する
センサ１０８と、各種入力キーや表示器等を設けた操作
部１０９とを有する。
１と各部をつなぐバス１０６と、ＣＣＤや画像処理ＩＣ
等からなるスキャナ１０７と、原稿の有無等を検知する
センサ１０８と、各種入力キーや表示器等を設けた操作
部１０９とを有する。
【００２３】なお、以上は、主に本発明の制御に必要な
構成について示したものであり、この他にも通信のため
のモデム、記録のためのプリンタ等、通常のファクシミ
リ装置が有する構成が設けられているが、ここでは本実
施例の説明にあたって直接関係はないので省略する。
構成について示したものであり、この他にも通信のため
のモデム、記録のためのプリンタ等、通常のファクシミ
リ装置が有する構成が設けられているが、ここでは本実
施例の説明にあたって直接関係はないので省略する。
【００２４】図５は、本実施例における加速情報テーブ
ルのデータの流れを説明するブロック図である。
ルのデータの流れを説明するブロック図である。
【００２５】ホストＣＰＵ１０１は、ＲＯＭ１０３内に
存在する複数種類の加速情報テーブル（５０５、５０
６、５０７）のうちから１つを選択する。この選択手段
としては操作部１０９のキーによる。
存在する複数種類の加速情報テーブル（５０５、５０
６、５０７）のうちから１つを選択する。この選択手段
としては操作部１０９のキーによる。
【００２６】例えばファクシミリ装置における副走査方
向の原稿送りモードである、標準、ファイン、スーパー
ファインがオペレータによって選ばれると、ホストＣＰ
Ｕ１０１はバス１０６を経由して加速情報テーブルをス
レーブＣＰＵ１０４へ転送する。スレーブＣＰＵ１０４
は、受信した加速情報テーブルを内蔵ＲＡＭのエリア５
０４にセットする。なお、ここでデータの転送に関して
は低い周波数の方から転送するという取り決めのもとで
行なわれる。
向の原稿送りモードである、標準、ファイン、スーパー
ファインがオペレータによって選ばれると、ホストＣＰ
Ｕ１０１はバス１０６を経由して加速情報テーブルをス
レーブＣＰＵ１０４へ転送する。スレーブＣＰＵ１０４
は、受信した加速情報テーブルを内蔵ＲＡＭのエリア５
０４にセットする。なお、ここでデータの転送に関して
は低い周波数の方から転送するという取り決めのもとで
行なわれる。
【００２７】具体的には、図６に示すように、まずデー
タ転送開始コマンドを発行した後、周波数データ１、ス
テップ数データ１、周波数データ２、ステップ数データ
２、……周波数データＮ、ステップ数データＮを順次転
送する。そして、データ転送終了コマンドを発行をする
ことにより、加速情報テーブル格納エリア５０４の終わ
りに終了コードをセットする。
タ転送開始コマンドを発行した後、周波数データ１、ス
テップ数データ１、周波数データ２、ステップ数データ
２、……周波数データＮ、ステップ数データＮを順次転
送する。そして、データ転送終了コマンドを発行をする
ことにより、加速情報テーブル格納エリア５０４の終わ
りに終了コードをセットする。
【００２８】なお、ここで周波数データは、スレーブＣ
ＰＵ１０４が実際にタイマ２０４に設定する値にしてや
ればスレーブＣＰＵ１０４側での変換作業が不要にな
る。
ＰＵ１０４が実際にタイマ２０４に設定する値にしてや
ればスレーブＣＰＵ１０４側での変換作業が不要にな
る。
【００２９】以上のようにして加速情報テーブルのセッ
トが終了した後、ホストＣＰＵ１０１からのトリガコマ
ンドに対して、まず、テーブルの先頭データでモータ１
０５を動かし、ポインタを次データにセットする。
トが終了した後、ホストＣＰＵ１０１からのトリガコマ
ンドに対して、まず、テーブルの先頭データでモータ１
０５を動かし、ポインタを次データにセットする。
【００３０】以降、ポインタを移動しながらモータ１０
５を動かして行き、テーブルの最後のデータ（到達目標
データ）になったらポインタを固定したままモータ１０
５を回転させる。
５を動かして行き、テーブルの最後のデータ（到達目標
データ）になったらポインタを固定したままモータ１０
５を回転させる。
【００３１】また、複数ページの原稿を読む場合には、
各ページを読み取る前に加速情報テーブルの転送を行え
ばよい。
各ページを読み取る前に加速情報テーブルの転送を行え
ばよい。
【００３２】この場合、センサ１０８により、前ページ
の後端が読み取り位置を過ぎて、次ページの先端が読み
取り位置の手前に到達したタイミングで、操作部１０９
から次ページの情報を得て、それに対応する加速情報テ
ーブルを転送する。
の後端が読み取り位置を過ぎて、次ページの先端が読み
取り位置の手前に到達したタイミングで、操作部１０９
から次ページの情報を得て、それに対応する加速情報テ
ーブルを転送する。
【００３３】さらに、原稿を読み取りながら送信するダ
イレクト送信時には、その交信モード（標準、ファイ
ン、スーパーファイン）によって加速情報テーブルを選
択してもよい。
イレクト送信時には、その交信モード（標準、ファイ
ン、スーパーファイン）によって加速情報テーブルを選
択してもよい。
【００３４】
【発明の効果】本発明によれば、ホストＣＰＵに負担を
かけることなく、かつスレーブＣＰＵ側のメモリ容量を
大きくすることなく、複数種類の加速情報テーブルを使
い分けて高精度のモータ制御を行うことができるので、
特にＲＯＭ容量の少ないワンチップマイクロコンピュー
タをスレーブＣＰＵに用いた場合でも、様々なパターン
のモータ送り制御を実現できる効果がある。
かけることなく、かつスレーブＣＰＵ側のメモリ容量を
大きくすることなく、複数種類の加速情報テーブルを使
い分けて高精度のモータ制御を行うことができるので、
特にＲＯＭ容量の少ないワンチップマイクロコンピュー
タをスレーブＣＰＵに用いた場合でも、様々なパターン
のモータ送り制御を実現できる効果がある。
【図１】本発明の一実施例を示すブロック図である。
【図２】ワンチップマイクロコンピュータの構成例を示
すブロック図である。
すブロック図である。
【図３】モータの加速制御の例を説明する模式図であ
る。
る。
【図４】従来のスレーブＣＰＵのＲＯＭ内に格納された
加速情報テーブルの例を示す模式図である。
加速情報テーブルの例を示す模式図である。
【図５】上記実施例における加速情報テーブルのデータ
の流れを説明するブロック図である。
の流れを説明するブロック図である。
【図６】上記実施例におけるデータ転送シーケンスを示
す模式図である。
す模式図である。
１０１…ホストＣＰＵ、 １０２…ＲＡＭ、 １０３…ＲＡＭ、 １０４…スレーブＣＰＵ、 １０５…ステッピングモータ、 １０６…バス、 １０７…スキャナ、 １０８…センサ、 １０９…操作部。
フロントページの続き (56)参考文献 特開 昭63−39272（ＪＰ，Ａ) 特開 昭63−299672（ＪＰ，Ａ) 特開 昭63−305667（ＪＰ，Ａ) 特開 昭64−62964（ＪＰ，Ａ) 特開 平１−194753（ＪＰ，Ａ) 特開 平１−233958（ＪＰ，Ａ) 特開 平２−200471（ＪＰ，Ａ) 特開 平２−207659（ＪＰ，Ａ) 特開 平３−114357（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H04N 1/04 - 1/207
Claims (3)
- 【請求項１】 装置全体の制御をつかさどるホストＣＰ
Ｕの他に、このホストＣＰＵの制御下におかれるモータ
制御用のＲＯＭ、ＲＡＭ内蔵型のスレーブＣＰＵを有す
るファクシミリ装置において、 ホストＣＰＵ側のＲＯＭ内に複数通りの加速情報テーブ
ルを設けるとともに、スレーブＣＰＵ内蔵のＲＡＭに前
記加速情報テーブル１つ分が格納できるエリアを設け、
原稿を読み取る前にＲＯＭ内のテーブル群の内から１つ
を選択してスレーブＣＰＵ内の格納エリアに転送し、ホ
ストＣＰＵから発行されるトリガコマンドに対してスレ
ーブＣＰＵが内蔵ＲＡＭに格納した加速情報を基にモー
タを回転させることを特徴とするファクシミリ装置。 - 【請求項２】 請求項１において、 前記ホストＣＰＵ側のＲＯＭ内に格納された加速情報テ
ーブルを選択する操作キーを有し、複数ページの原稿を
読み取る場合には、各ページを読み取る前に当該キー情
報を得ることにより、その情報を基に加速情報テーブル
群から１つを選択して前記スレーブＣＰＵに転送するこ
とを特徴とするファクシミリ装置。 - 【請求項３】 請求項１において、 ダイレクト送信時には、その交信モードに基づいてホス
トＣＰＵ側のＲＯＭ内に格納された加速情報テーブル群
から１つを選択して前記スレーブＣＰＵに転送すること
を特徴とするファクシミリ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03304007A JP3096114B2 (ja) | 1991-10-23 | 1991-10-23 | ファクシミリ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03304007A JP3096114B2 (ja) | 1991-10-23 | 1991-10-23 | ファクシミリ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05122470A JPH05122470A (ja) | 1993-05-18 |
| JP3096114B2 true JP3096114B2 (ja) | 2000-10-10 |
Family
ID=17927941
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03304007A Expired - Fee Related JP3096114B2 (ja) | 1991-10-23 | 1991-10-23 | ファクシミリ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3096114B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7072058B1 (en) | 1999-11-24 | 2006-07-04 | Ricoh Company, Ltd. | Image processing apparatus |
| US9994050B1 (en) | 2016-12-14 | 2018-06-12 | Konica Minolta, Inc. | Sheet conveying system and image forming system |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3560335B2 (ja) | 2000-11-21 | 2004-09-02 | キヤノン株式会社 | ステッピングモータ制御装置およびその方法、ならびに画像読取装置およびその方法 |
-
1991
- 1991-10-23 JP JP03304007A patent/JP3096114B2/ja not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7072058B1 (en) | 1999-11-24 | 2006-07-04 | Ricoh Company, Ltd. | Image processing apparatus |
| US9994050B1 (en) | 2016-12-14 | 2018-06-12 | Konica Minolta, Inc. | Sheet conveying system and image forming system |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05122470A (ja) | 1993-05-18 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20070804 Year of fee payment: 7 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080804 Year of fee payment: 8 |
|
| LAPS | Cancellation because of no payment of annual fees |