JP3082554B2 - セルフヒーリングリングスイッチ - Google Patents

セルフヒーリングリングスイッチ

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JP3082554B2 JP06001112A JP111294A JP3082554B2 JP 3082554 B2 JP3082554 B2 JP 3082554B2 JP 06001112 A JP06001112 A JP 06001112A JP 111294 A JP111294 A JP 111294A JP 3082554 B2 JP3082554 B2 JP 3082554B2
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    • H04J2203/0089—Multiplexing, e.g. coding, scrambling, SONET

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明はセルフヒーリングリング
用伝送装置の装置構成に係り、特にセルフヒーリングリ
ングスイッチに関する。
【０００２】
【従来の技術】現在、自動復旧を行うリング型ネットワ
ークとしては、"Bellcore TechnicalAdvisory TA-NWT-0
01230,issue 3"に記載されているように、2-Fiber Bidi
rectional Line Switched Ring(2-Fiber BLSR), 4-Fibe
r Bidirectional Line Switched Ring(4-Fiber BLSR),
Unidirectional Path Switched Ring(UPSR)がある。2-
Fiber BLSRは、各ノード間を２本の回線で接続し、各回
線内の容量を二分し、一方を現用、他方を予備として用
いる方式である（図３(a)）。通常時のパスの設定で
は、上りと下りは同一の経路を通過する（図３(b)）。
図３に示すようなネットワークにおいて、例えばノード
A-B間の回線30-4,31-4に障害が発生した場合、障害区間
を通過するパスを反対回り方向の予備容量を用いて迂回
（リングスイッチ）させる（図４）。このときリングス
イッチを実行するのは、障害端ノード（本例では、ノー
ドAとB。）である。その他のノードは中継処理を実行す
る。ノード構成の例を図５に示す。各ノードはリング用
の回線の他に挿入回線11と分岐回線12をもつ。これを図
３(a)のノードAに適用する場合、CW方向現用受信回線20
は図３の回線30-4、CCW方向現用受信回線22は図３(a)の
回線31-1、CW方向現用送信回線24は図３の回線30-1、CC
W方向現用送信回線26は図３(a)の回線31-4に対応する。
リングスイッチはスイッチ34-1により、タイムスロット
を入れ替えることで容易に実現できる。
【０００３】4-Fiber BLSRは、現用回線と予備回線を設
け、各ノード間を４本の回線で接続する。そして通常は
現用回線を用いて伝送し、障害発生時などに予備回線を
用いてトラヒックを救済する方式である（図６(a)）。
通常時のパスの設定では、上りと下りは同一の経路を通
過する（図６(b)）。図６(a)に示すようなネットワーク
において、例えばノードA-B間の現用回線30-4にのみ障
害が発生した場合、障害区間を通過するパスを予備回線
32-4を用いて伝送する（スパンスイッチ:図７(a)）。ま
たノードA-B間の現用回線と予備回線の両方に障害が発
生した場合、障害区間を通過するパスを反対回り方向の
予備回線に迂回（リングスイッチ）させる（図７
(b)）。スパンスイッチ、リングスイッチを実行するの
は、障害端ノード（本例では、ノードAとBである。）で
ある。その他のノードは中継処理を実行する。ノード構
成の例を図８に示す。これを図６(a)のノードAに適用す
る場合、CW方向現用受信回線20は図６(a)の回線30-4、C
W方向予備受信回線21は図６(a)の回線32-4、CCW方向現
用受信回線22は図６(a)の回線31-1、CCW方向予備受信回
線23は図６(a)の回線33-1、CW方向現用送信回線24は図
６(a)の回線30-1、CW方向予備送信回線25は図６(a)の回
線32-1、CCW方向現用送信回線26は図６(a)の回線31-4、
CCW方向予備送信回線27は図６(a)の回線33-4に対応す
る。各ノードはリング用の回線の他に挿入回線11と分岐
回線12をもつ。
【０００４】UPSRは、ノード間を２本の回線で接続し、
一方を現用、他方を予備とする（図９(a)）。従って、
通常時のパスの設定では、上りと下りは異なる経路（同
一方向経路）を通過する（図９(b)）。図９(b)では反時
計回り方向(Counter Clockwise : CCW)のパスが現用で
あり、通常は現用を用いて伝送する。時計回り方向(Clo
ckwise : CW)のパスは予備である。現用と予備の両方に
パスを設定し、パス終端ノードにおいて現用側を選択す
る。図９(a)においてノードA-B間に障害が発生した場
合、パス終端ノードでは予備を選択することにより障害
から復旧する（図１０）。ノード構成を図１１に示す。
これを図９(a)のノードAに適用する場合、CW方向予備受
信回線21は図９(a)の回線32-4、CCW方向現用受信回線22
は図９(a)の回線31-1、CW方向予備送信回線25は図９(a)
の回線32-1、CCW方向現用送信回線26は図９(a)の回線31
-4に対応する。出力ハイウェイ15-5,15-7はそれぞれ現
用と予備に対応している。現用と予備の選択は、セレク
タ2で行う。各ノードはリング用の回線の他に挿入回線1
1と分岐回線12と予備をもつ。
【０００５】
【発明が解決しようとする課題】従来の構成は、各種リ
ングスイッチモードの各々に対応する構成である。した
がって、同一の装置において、ソフトウェアの変更のみ
で、前記複数のリングスイッチモードを実現することは
不可能である。
【０００６】本発明は上記の欠点を解決するもので、ソ
フトウェアの変更のみで、上記複数のリングスイッチモ
ードを実現することを目的とする。
【０００７】
【課題を解決するための手段】この目的を達成するため
本発明は、空間スイッチをアッドドロップスイッチの前
後に設け、かつ、アッドドロップスイッチの出力１本と
第２の空間スイッチの出力１本をタイムスロット単位に
選択可能なセレクタの入力段に接続する。
【０００８】
【作用】本発明の作用を図１を用いて説明する。図１に
示す回路は、スイッチ1、セレクタ2、セレクタ制御部3
からなるセルフヒーリングリングスイッチ（SHRSW）、
受信インターフェース4-1〜4-5、送信インターフェース
部5-1〜5-5からなるノードである。スイッチ1は５入力
５出力であり、セレクタ2は２入力１出力である。スイ
ッチ1の入力端子に受信側回線20〜23と挿入回線11を受
信インターフェース部4-1〜4-5を介して接続し、出力ハ
イウェイ15-1〜15-4を送信側回線24〜27に送信インター
フェース部5-1〜5-4を介して接続する。また、出力ハイ
ウェイa15-5をセレクタ2の入力端子に接続する。出力ハ
イウェイb15-4を２つに分岐させ、分岐した方を出力ハ
イウェイb'15-6とし、セレクタ2のもう一方の入力端子
に接続する。
【０００９】まず、このSHRSWを2-Fiber BLSRに用いる
場合の方法について説明する。2-Fiber BLSRにおけるリ
ングスイッチは、スイッチ1のタイムスロット入れ替え
により容易に実現できる。また、セレクタ2は常時出力
ハイウェイa15-5を選択する。2-Fiber BLSRは予備回線
を必要としないので、出力ハイウェイb15-4は用いな
い。次に、このSHRSWを4-Fiber BLSRに用いる場合の方
法について説明する。4-FiberBLSRにおけるリングスイ
ッチは、スパンスイッチと同様にスイッチ1により容易
に実現できる。この場合も、セレクタ2は出力ハイウェ
イa15-5を常時選択する。この時出力ハイウェイb15-4を
リング用の予備回線に割り当てる。
【００１０】次にこのSHRSWをUPSRに用いる場合の方法
を図１を用いて説明する。UPSRの場合、ノード間を接続
する回線は２本である。従って、スイッチ1の出力ハイ
ウェイに空きができる。そこで、出力ハイウェイのうち
出力ハイウェイa15-5と出力ハイウェイb15-4を分岐回線
としてもちいる。そして、スイッチ1により、２つの分
岐回線のうち一方を時計回り方向(CW)パス、他方を反時
計回り方向(CCW)パスとして割り当てる。セレクタ2は前
記２つの出力ハイウェイのうちから一方をパス単位に選
択する。そして選択した系に障害が発生した場合は、他
方に切り替えることにより障害から復旧することが可能
である。すなわち、スイッチ1の出力ハイウェイのう
ち、4-Fiber BLSR時にリング出力回線に割り当てていた
出力ハイウェイのうちから１本をUPSR時に分岐回線用に
割り当てる。そして、２本の分岐回線のうちから正常な
方をセレクタ2が選択することにより、障害復旧動作を
可能にする。
【００１１】さらに、リニアスイッチ（1:1,1+1切替）
にもちいた場合でも空間スイッチを制御することにより
容易に対応できる。
【００１２】上記のように、本発明による回路構成はい
ずれの切替モードにも適用可能である。したがって、同
一の回路構成により、ソフトウェアを交換するだけでい
ずれの切替モードをも実現できる。
【００１３】
【実施例】本発明の第１の実施例を図１を用いて説明す
る。図１に示す回路は、スイッチ1、セレクタ2、セレク
タ制御部3からなるセルフヒーリングリングスイッチ（S
HRSW）、受信インターフェース4-1〜4-5、送信インター
フェース部5-1〜5-5からなるノードである。スイッチ1
は５入力５出力であり、セレクタ2は２入力１出力であ
る。スイッチ1の入力端子に受信側回線20〜23と挿入回
線11を受信インターフェース部4-1〜4-5を介して接続
し、出力ハイウェイ15-1〜15-4を送信側回線24〜27に送
信インターフェース部5-1〜5-4を介して接続する。ま
た、出力ハイウェイa15-5をセレクタ2の入力端子に接続
する。出力ハイウェイb15-4を２つに分岐させ、分岐し
た方を出力ハイウェイb'15-6とし、セレクタ2のもう一
方の入力端子に接続する。
【００１４】スイッチ1の構成を図２に示す。図２に示
す回路は、第１の空間スイッチ7、アッドドロップスイ
ッチ6、第２の空間スイッチ8、遅延挿入部9、制御部28
からなるセルフヒーリングリングスイッチ（SHRSW）で
ある。空間スイッチ7と8は４入力４出力である。アッド
ドロップスイッチ6は４入力４出力である。そして、空
間スイッチ7の入力端子にリング受信側回線20〜23を受
信インターフェース部を介して接続する。空間スイッチ
8の出力端子をリング送信側回線24〜27に送信インター
フェース部を介して接続する。挿入回線11をアッドドロ
ップスイッチの入力端子に接続する。
【００１５】図１に戻り、セレクタ2の一方の入力端子
には、アッドドロップスイッチ6の出力端子（ハイウェ
イa15-5）を接続する。セレクタ2のもう一方の入力端子
には、空間スイッチ8の出力ハイウェイb15-4を分岐させ
た出力ハイウェイb'15-6を接続する。
【００１６】次に、本実施例で用いるフレームはANSIで
標準化されているSTS-12(622.08Mb/s)信号である。これ
を図１２に示す。本例では、ＳＴＳ単位の切替を対象と
する。
【００１７】図１に戻り、図１および図２の回路を2-Fi
ber BLSRに用いる方法を説明する。2-Fiber BLSRでは、
予備の回線は用いない。従って、空間スイッチ7と8の設
定は図１３に示すように固定される。すなわち、時計回
り方向（CW方向）と反時計回り方向（CCW方向）の現用
回線を常に選択し、アッドドロップスイッチ6と接続す
る。リングスイッチ時には、アッドドロップスイッチ6
が出力タイムスロットを変更することにより、現用パス
を反対方向の予備容量を用いて伝送する。図１２のフレ
ームをもちいる場合、例えばSTS-1#1〜#6を現用、STS-1
#7〜#12を予備とすればよい。セレクタ2は常時、ハイウ
ェイa15-5を選択し、分岐回線12に接続する。すなわ
ち、ハイウェイa15-5を常に分岐回線として用いる。
【００１８】次にこのSHRSWを4-Fiber BLSRに用いる場
合の方法を図１を用いて説明する。4-Fiber BLSRに用い
る場合、リングスイッチ時とスパンスイッチ時における
アッドドロップスイッチの動作は固定である。空間スイ
ッチ7と8は通常時は図１４に示すように現用回線とアッ
ドドロップスイッチ6を接続する。受信側のスパンスイ
ッチ実行時には、空間スイッチ7が現用回線の代わりに
予備回線をアッドドロップスイッチ6に接続する（図１
５）。送信側でのスパンスイッチ実行時には、空間スイ
ッチ8が同様の操作を行う。リングスイッチ実行時にも
空間スイッチ7と8が現用回線の代わりに予備回線をアッ
ドドロップスイッチ6に接続することにより障害から復
旧する。例えば、CW方向現用受信回線20とCW方向予備受
信回線21の両方に障害が発生した場合は図１６(a)に示
すような設定により、リングスイッチを実行する。すな
わち、空間スイッチ7が、CW方向現用受信回線20の代わ
りにCCW方向予備受信回線23をアッドドロップスイッチ
に接続する。空間スイッチ8は、CCW方向現用送信回線26
の代わりにCW方向予備送信回線25をアッドドロップスイ
ッチ6に接続する。また、フルパススルー実行時は図１
６(b)に示す設定となる。すなわち、現用回線に対する
空間スイッチ7と8の設定は変更しない。そして、CW方向
予備受信回線21をCW方向予備送信回線25に接続する。こ
の時遅延挿入素子9は、他の回線に生じる遅延と同等の
遅延をパススルーする回線に生じさせる。さらに、CCW
方向予備受信回線23をCCW方向予備送信回線27に遅延素
子9を介して接続する。セレクタ2は常時、ハイウェイa1
5-5を選択し、分岐回線12に接続する。すなわち、ハイ
ウェイa15-5を常に分岐回線として用いる。
【００１９】次にこのSHRSWをUPSRに用いる場合の方法
を図１７を用いて説明する。UPSRに用いる場合、ノード
間の接続には２回線しか用いない。従って、CCW方向を
現用、CW方向を予備として用いる場合、CCW予備回線23,
27およびインターフェース4-4,5-4は不要となる。よっ
て空間スイッチ7と8の設定は図１７に示すように固定す
る。そして、アッドドロップスイッチ6は、当該ノード
でドロップするパスのうち、CW方向回線を経由してきた
パスとCCW方向回線を経由するパスをそれぞれ出力ハイ
ウェイ15-4と15-5に出力する（図１８）。セレクタ2
は、両者のうちから正常な方を選択することにより障害
復旧を可能にする。図１８においては、チャンネル1(ch
1)のCCWパスに障害が発生しているので、ch1のみCW側を
選択したことを示している。この時、受信インターフェ
ース部からの障害検出情報19を用いてセレクタ制御部3
がセレクタを制御する。ここでチャンネルとは、各パス
（ＳＴＳ）に対して割り当てられているタイムスロット
を指す。また、ＶＴ単位の切替をする場合には、チャン
ネルはＶＴを指す。
【００２０】次に、空間スイッチ7と8を用いれば、リニ
アスイッチ（1+1,1:n）モードにも容易に対応できる。1
+1の場合、空間スイッチ8はアッドドロップスイッチ6の
出力を現用と予備の両方に同時に出力する機能（分配機
能）をもつ。
【００２１】上記実施例におけるアッドドロップスイッ
チ6は時分割スイッチでも実現可能である。
【００２２】上記実施例におけるスイッチ1は時分割ス
イッチでも実現可能である。
【００２３】上記実施例における遅延挿入素子は、半導
体メモリにより実現可能である。
【００２４】また、上記実施例におけるスイッチ1は、
以下に示す構成によっても可能である（図１９）。即
ち、第１の空間スイッチ7、アッドドロップスイッチ6、
第２の空間スイッチ8、遅延挿入部9、制御部28からなる
セルフヒーリングリングスイッチ（SHRSW）において、
空間スイッチ7と8を５入力５出力とし、アッドドロップ
スイッチ6を４入力４出力とする。そして、空間スイッ
チ7の入力端子にリング受信側回線20〜23および挿入回
線11を受信インターフェース部を介して接続する。空間
スイッチ8の出力端子をリング送信側回線24〜27に送信
インターフェース部を介して接続する。ハイウェイ14-5
が空間スイッチ7を介してアッドドロップスイッチ6に接
続され、ハイウェイ15-5が空間スイッチ8を経由してい
ることが前述の実施例との違いであり、容易に実現可能
である。
【００２５】また、上記実施例におけるスイッチ1は、
以下に示す構成によっても可能である（図２０）。即
ち、第１の空間スイッチ7、アッドドロップスイッチ6、
第２の空間スイッチ8、遅延挿入部9、制御部28からなる
セルフヒーリングリングスイッチ（SHRSW）において、
空間スイッチ8を５入力５出力とし、アッドドロップス
イッチ6を４入力４出力とする。空間スイッチ8の出力端
子をリング送信側回線24〜27に送信インターフェース部
を介して接続する。ハイウェイ15-5が空間スイッチ8を
経由していることが前述の実施例との違いであり、容易
に実現可能である。また、上記実施例におけるスイッチ
1は、以下に示す構成によっても可能である（図２
１）。即ち、第１の空間スイッチ7、アッドドロップス
イッチ6、第２の空間スイッチ8、遅延挿入部9、制御部2
8からなるセルフヒーリングリングスイッチ（SHRSW）に
おいて、アッドドロップスイッチ6を５入力５出力とす
る。そして、空間スイッチ7の入力端子にリング受信側
回線20〜23を受信インターフェース部を介して接続す
る。空間スイッチ8の出力端子をリング送信側回線24〜2
7に送信インターフェース部を介して接続する。アッド
ドロップスイッチ6の規模を大きくし遅延挿入素子9を省
いたことが前述の実施例との違いであり、容易に実現可
能である。
【００２６】また、上記実施例におけるスイッチ1は、
以下に示す構成によっても可能である（図２２）。即
ち、第１の空間スイッチ7、アッドドロップスイッチ6、
第２の空間スイッチ8、遅延挿入部9、制御部28からなる
セルフヒーリングリングスイッチ（SHRSW）において、
空間スイッチ8を５入力５出力とし、アッドドロップス
イッチ6を５入力５出力とする。そして、空間スイッチ7
の入力端子にリング受信側回線20〜23を受信インターフ
ェース部を介して接続する。空間スイッチ8の出力端子
をリング送信側回線24〜27に送信インターフェース部を
介して接続する。ハイウェイ15-5が空間スイッチ8を経
由していること、およびアッドドロップスイッチ6の規
模を大きくし遅延挿入素子9を省いたことが前述の実施
例との違いであり、容易に実現可能である。
【００２７】
【発明の効果】ソフトウェアの変更のみで、2-Fiber BL
SR, 4-Fiber BLSR, UPSRの各種リングスイッチモードを
切り替えることを可能とする。また、リングスイッチモ
ードからリニアスイッチモードへの変更、およびその逆
の変更も可能となる。
【図面の簡単な説明】
【図１】本発明におけるノードの基本構成を示す図。
【図２】本発明の第１の実施例におけるスイッチ部の構
成を示す図。
【図３】2-Fiber BLSRの説明図。
【図４】2-Fiber BLSRにおける復旧例。
【図５】2-Fiber BLSRにおけるノード構成従来例。
【図６】4-Fiber BLSRの説明図。
【図７】4-Fiber BLSRにおける復旧例。
【図８】4-Fiber BLSRにおけるノード構成従来例。
【図９】UPSRの説明図。
【図１０】UPSRにおける復旧例。
【図１１】UPSRにおけるノード構成従来例。
【図１２】本発明の実施例におけるフレーム構成。
【図１３】2-Fiber BLSRにおける設定を示す図。
【図１４】4-Fiber BLSRにおける設定を示す図。
【図１５】4-Fiber BLSRにおけるスパンスイッチを示す
図。
【図１６】4-Fiber BLSRにおけるリングスイッチを示す
図。
【図１７】UPSRにおける設定を示す図。
【図１８】UPSRにおける復旧方法を示す図。
【図１９】スイッチ1の第２の構成方法を示す図。
【図２０】スイッチ1の第３の構成方法を示す図。
【図２１】スイッチ1の第４の構成方法を示す図。
【図２２】スイッチ1の第５の構成方法を示す図。
【符号の説明】 1…セルフヒーリングリングスイッチ、2…セレクタ、3
…セレクタ制御部、4-1〜4-5…受信インターフェース、
5-1〜5-5…送信インターフェース、6…アッドドロップ
スイッチ、7…空間スイッチ、8…空間スイッチ、9…遅
延素子、10-1〜10-4…ノード、11…挿入回線、12…分岐
回線、14-1〜14-5…ハイウェイ、15-1〜15-7…ハイウェ
イ、16…ハイウェイ、17-1〜17-5…ハイウェイ、18-1〜
18-5…ハイウェイ、19…障害検出情報、20…CW方向現用
受信回線、21…CW方向予備受信回線、22…CCW方向現用
受信回線、23…CCW方向予備受信回線、24…CW方向現用
送信回線、25…CW方向予備送信回線、26…CCW方向現用
送信回線、27…CCW方向予備送信回線、28…制御部、30-
1〜30-4…CW現用回線、31-1〜31-4…CCW現用回線、32-1
〜32-4…CW予備回線、33-1〜33-4…CCW予備回線、34-1
〜34-3…従来例におけるスイッチ。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平５−91103（ＪＰ，Ａ) 特開 昭62−159599（ＪＰ，Ａ) 特開 平２−27855（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H04L 12/437 H04J 3/00 H04J 3/08

Claims (7)

    (57)【特許請求の範囲】
  1. 【請求項１】リングネットワーク用のセルフヒーリング
    リングスイッチであって、 少なくとも５入力５出力の第１の空間スイッチと、少な
    くとも４入力４出力のアッドドロップスイッチと、少な
    くとも５入力５出力の第２の空間スイッチと、遅延挿入
    素子とを含むスイッチと、 前記スイッチの第１出力ハイウェイと、前記スイッチの
    分岐された第２の出力ハイウェイとを入力とし分岐回線
    に出力するセレクタとを含み、 前記第１の空間スイッチの出力のうちの４本を前記アッ
    ドドロップスイッチの入力端子に接続し、前記アッドド
    ロップスイッチの４本の出力を前記第２の空間スイッチ
    の入力端子に接続し、前記第１の空間スイッチの出力の
    うち前記アッドドロップスイッチに接続しないものを前
    記遅延挿入素子の入力に接続し、前記遅延挿入素子の出
    力を前記第２の空間スイッチの入力のうち前記アッドド
    ロップスイッチと接続しない入力に接続し、 挿入回線からの信号を前記第１の空間スイッチの入力端
    子に接続し、前記第２の空間スイッチの出力ハイウェイ
    のうち１本を前記第１の出力ハイウェイとし、前記第２
    の空間スイッチの出力ハイウェイのうちその他の１本を
    前記第２の出力ハイウェイとするセルフヒーリングリン
    グスイッチ。
  2. 【請求項２】リングネットワーク用のセルフヒーリング
    リングスイッチであって、 少なくとも４入力４出力の第１の空間スイッチと、少な
    くとも４入力４出力のアッドドロップスイッチと、少な
    くとも４入力４出力の第２の空間スイッチと、遅延挿入
    素子とを含むスイッチと、 前記スイッチの第１出力ハイウェイと、前記スイッチの
    分岐された第２の出力ハイウェイとを入力とし分岐回線
    に出力するセレクタとを含み、 前記第１の空間スイッチの出力のうちの少なくとも３本
    を前記アッドドロップスイッチの入力端子に接続し、前
    記アッドドロップスイッチの少なくとも３本の出力端子
    を前記第２の空間スイッチの入力端子に接続し、前記第
    １の空間スイッチの出力端子のうち前記アッドドロップ
    スイッチに接続しなかった出力端子と前記第２の空間ス
    イッチの入力端子を前記遅延挿入素子を介して接続し、 挿入回線からの信号を前記アッドドロップスイッチの入
    力端子に接続し、前記アッドドロップスイッチの出力の
    うち第２の空間スイッチに接続しないものを前記第１の
    出力ハイウェイとし、前記第２の空間スイッチの出力ハ
    イウェイのうち一本を前記第２の出力ハイウェイとする
    セルフヒーリングリングスイッチ。
  3. 【請求項３】リングネットワーク用のセルフヒーリング
    リングスイッチであって、 少なくとも４入力４出力の第１の空間スイッチと、少な
    くとも４入力４出力のアッドドロップスイッチと、少な
    くとも５入力５出力の第２の空間スイッチと、遅延挿入
    素子とを含むスイッチと、 前記スイッチの第１出力ハイウェイと、前記スイッチの
    分岐された第２の出力ハイウェイとを入力とし分岐回線
    に出力するセレクタとを含み、 前記第１の空間スイッチの出力のうちの３本を前記アッ
    ドドロップスイッチの入力端子に接続し、前記アッドド
    ロップスイッチの４本の出力端子を前記第２の空間スイ
    ッチの入力端子に接続し、前記第１の空間スイッチの出
    力端子のうち前記アッドドロップスイッチに接続しなか
    った出力端子と前記第２の空間スイッチ の入力端子を前記遅延挿入素子を介して接続し、挿入回
    線からの信号を前記アッドドロップスイッチの入力端子
    に接続し、前記第２の空間スイッチの出力のうち１本を
    前記第１の出力ハイウェイとし、前記第２の空間スイッ
    チの出力ハイウェイのうち他の１本を前記第２の出力ハ
    イウェイとするセルフヒーリングリングスイッチ。
  4. 【請求項４】リングネットワーク用のセルフヒーリング
    リングスイッチであって、 少なくとも４入力４出力の第１の空間スイッチと、少な
    くとも５入力５出力のアッドドロップスイッチと、少な
    くとも４入力４出力の第２の空間スイッチとを含むスイ
    ッチと、 前記スイッチの第１出力ハイウェイと、前記スイッチの
    分岐された第２の出力ハイウェイとを入力とし分岐回線
    に出力するセレクタとを含み、 前記第１の空間スイッチの出力のうちの４本を前記アッ
    ドドロップスイッチの入力端子に接続し、前記アッドド
    ロップスイッチの４本の出力端子を前記第２の空間スイ
    ッチの入力端子に接続し、 挿入回線からの信号を前記アッドドロップスイッチの入
    力端子に接続し、前記アッドドロップスイッチの出力の
    うち前記第２の空間スイッチに接続しないものを前記第
    １の出力ハイウェイとし、前記第２の空間スイッチの出
    力ハイウェイのうち１本を前記第２の出力ハイウェイと
    するセルフヒーリングリングスイッチ。
  5. 【請求項５】リングネットワーク用のセルフヒーリング
    リングスイッチであって、 少なくとも４入力４出力の第１の空間スイッチと、少な
    くとも５入力５出力のアッドドロップスイッチと、少な
    くとも５入力５出力の第２の空間スイッチとを含むスイ
    ッチと、 前記スイッチの第１出力ハイウェイと、前記スイッチの
    分岐された第２の出力ハイウェイとを入力とし分岐回線
    に出力するセレクタとを含み、 前記第１の空間スイッチの出力のうちの４本を前記アッ
    ドドロップスイッチの入力端子に接続し、前記アッドド
    ロップスイッチの５本の出力を前記第２の空間スイッチ
    の入力端子に接続し、 挿入回線からの信号を前記アッドドロップスイッチの入
    力端子に接続し、前記第２の空間スイッチの出力ハイウ
    ェイのうち１本を前記第１の出力ハイウェイとし、前記
    第２の空間スイッチの出力ハイウェイのうち他の１本を
    前記第２の出力ハイウェイとするセルフヒーリングリン
    グスイッチ。
  6. 【請求項６】前記アッドドロップスイッチは、データメ
    モリとアドレス管理メモリとからなる時分割スイッチで
    あることを特徴とする請求項１乃至５のいずれか一に記
    載のセルフヒーリングリングスイッチ。
  7. 【請求項７】前記遅延挿入素子は、半導体メモリまたは
    フリップフロップであることを特徴とする請求項１乃至
    ３のいずれか一に記載のセルフヒーリングリングスイッ
    チ。
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