JP2875957B2 - ディスク再生装置の同期内挿及び同期状態検出装置 - Google Patents
ディスク再生装置の同期内挿及び同期状態検出装置Info
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- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1876—Interpolating methods
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- G—PHYSICS
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- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/19—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
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- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/19—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier
- G11B27/28—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording
- G11B27/30—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording
- G11B27/3027—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording used signal is digitally coded
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- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【０００１】
【産業上の利用分野】本発明はディスク再生装置のセク
タ単位のデータ処理のための同期信号発生装置に係り、
より詳しくは同期パターンが存しないか、あるいは損傷
された同期パターンを有するディスクセクタを存する場
合も同期を検出でき、同期の検出状態情報を発生しうる
システムに関する。
タ単位のデータ処理のための同期信号発生装置に係り、
より詳しくは同期パターンが存しないか、あるいは損傷
された同期パターンを有するディスクセクタを存する場
合も同期を検出でき、同期の検出状態情報を発生しうる
システムに関する。
【０００２】
【従来の技術】一般に、ＣＤ−ＲＯＭ、ＣＩ−Ｉ、ミニ
ディスクなどにおけるデータフォーマットはセクタ単位
で構成される。これらの製品はデータをディスクに記録
する場合、セクタ単位にスクランブルして記録し、逆に
ディスクからデータを再生する場合もやはりデータを読
み取ってディスクランブル処理してから再生する。従っ
て、かかるディスク再生装置はディスクから読み取った
データを再生するために各セクタ毎に同期パターンを検
出することが要求される。
ディスクなどにおけるデータフォーマットはセクタ単位
で構成される。これらの製品はデータをディスクに記録
する場合、セクタ単位にスクランブルして記録し、逆に
ディスクからデータを再生する場合もやはりデータを読
み取ってディスクランブル処理してから再生する。従っ
て、かかるディスク再生装置はディスクから読み取った
データを再生するために各セクタ毎に同期パターンを検
出することが要求される。
【０００３】図１（Ａ）は１セクタに対するデータ、図
１（Ｂ）はデータ処理に用いられるクロック、図１
（Ｃ）は１セクタのデータから得られた検出同期信号の
例をそれぞれ示している。図１（Ａ）に示した１セクタ
は総２３５２バイトよりなり、１セクタの先頭には１２
バイトの同期パターンＳＹＮＣ ＰＡＴＴＥＲＮが設け
られている。セクタに対する同期検出が行なわれた場
合、図１（Ｃ）に示すタイミングで検出同期信号ＳＹＮ
ＣＤＥＴが発生する。
１（Ｂ）はデータ処理に用いられるクロック、図１
（Ｃ）は１セクタのデータから得られた検出同期信号の
例をそれぞれ示している。図１（Ａ）に示した１セクタ
は総２３５２バイトよりなり、１セクタの先頭には１２
バイトの同期パターンＳＹＮＣ ＰＡＴＴＥＲＮが設け
られている。セクタに対する同期検出が行なわれた場
合、図１（Ｃ）に示すタイミングで検出同期信号ＳＹＮ
ＣＤＥＴが発生する。
【０００４】しかし、従来は再生データの同期パターン
を検出するための同期検出回路のみを用いるので、中間
にエラーが生じて同期パターンが異なったり、トラック
ジャンプなどによりディスクから１セクタに相当する時
間の範囲で読み取られるデータ内に同期信号が存しない
場合、かかるエラーが判別できなくなり、制御部でこれ
に対応する措置を早めに取りにく問題があった。
を検出するための同期検出回路のみを用いるので、中間
にエラーが生じて同期パターンが異なったり、トラック
ジャンプなどによりディスクから１セクタに相当する時
間の範囲で読み取られるデータ内に同期信号が存しない
場合、かかるエラーが判別できなくなり、制御部でこれ
に対応する措置を早めに取りにく問題があった。
【０００５】また、同期パターンが変化したことを検出
されないと、ディスクランブル処理されるセクタ区間が
代わるので、ユーザーが所望のデータを正確に再生でき
ないという問題があった。
されないと、ディスクランブル処理されるセクタ区間が
代わるので、ユーザーが所望のデータを正確に再生でき
ないという問題があった。
【０００６】同期表示がない、或は損傷された場合もデ
ィスクセクタからデータが復元できるシステムは、１９
９３年６月３０日付けにて出願公開された公開番号ＥＰ
５４９、１５１ Ａ２に開示されている。この先行技術
はセクタデータが整列された位置を指定する同期パター
ンを検出するために、選択されたセクタを検索する。同
期パターンが検出されなければ、セクタデータフィール
ドに対応する期間の間ウィンドウを用いて同期を検出
し、上記の期間が経った後にも同期が検出されなけれ
ば、同期未発見信号を発生する。同期未発見の場合、デ
ータ復元を通じて擬似同期信号を発生し、データブロッ
クを移動させながら同時にウィンドウの大きさを可変さ
せて再同期信号を検出する。
ィスクセクタからデータが復元できるシステムは、１９
９３年６月３０日付けにて出願公開された公開番号ＥＰ
５４９、１５１ Ａ２に開示されている。この先行技術
はセクタデータが整列された位置を指定する同期パター
ンを検出するために、選択されたセクタを検索する。同
期パターンが検出されなければ、セクタデータフィール
ドに対応する期間の間ウィンドウを用いて同期を検出
し、上記の期間が経った後にも同期が検出されなけれ
ば、同期未発見信号を発生する。同期未発見の場合、デ
ータ復元を通じて擬似同期信号を発生し、データブロッ
クを移動させながら同時にウィンドウの大きさを可変さ
せて再同期信号を検出する。
【０００７】
【発明が解決しようとする課題】本発明は以上のような
従来の問題点を解決するために案出されたもので、本発
明の目的はディスクから再生された同期パターンにエラ
ーが生じて異なったパターンを検出、或は検出されない
場合、内挿同期信号を発生させ、ユーザーが所望のデー
タを再生できるようにしたディスク再生装置の同期内挿
回路を提供することである。
従来の問題点を解決するために案出されたもので、本発
明の目的はディスクから再生された同期パターンにエラ
ーが生じて異なったパターンを検出、或は検出されない
場合、内挿同期信号を発生させ、ユーザーが所望のデー
タを再生できるようにしたディスク再生装置の同期内挿
回路を提供することである。
【０００８】本発明の他の目的は同期内挿回路により検
出される同期信号の検出状態情報を発生して制御部に知
らせることにより、マイコンがセクタ単位のデータ処理
を容易にするようにしたディスク再生装置の同期状態検
出回路を提供することである。
出される同期信号の検出状態情報を発生して制御部に知
らせることにより、マイコンがセクタ単位のデータ処理
を容易にするようにしたディスク再生装置の同期状態検
出回路を提供することである。
【０００９】
【課題を解決するための手段】及び
【作用】以上の目的を解決するために本発明によるディ
スク再生装置の同期内挿回路は以下の構成を備える。す
なわち、ウィンドウ信号とセクタ単位にデータが記録さ
れた前記ディスクから再生された検出同期信号を受け
て、前記ウィンドウ信号に応じて定められる第１ウィン
ドウ区間内に前記検出同期信号が存すれば有効検出同期
信号を発生し、ウィンドウタイミング信号と内挿同期信
号を受け、ウィンドウタイミング信号に応じて定められ
るウィンドウ区間内で前記内挿同期信号が検出同期信号
より先立つ場合は有効内挿同期信号を発生し、前記有効
内挿同期信号と前記有効検出同期信号を論理和して有効
同期信号を発生する有効同期信号発生部と、有効同期信
号発生部からの有効検出同期信号及び有効内挿同期信号
を受け、１セクタデータ間隔にカウンタークリア信号を
発生するクリア信号発生部と、カウンタークリア信号を
受け、ウィンドウタイミング信号の予め設定された幅を
定めるためのウィンドウタイミング立ち上がり信号及び
ウィンドウタイミング立ち上がり信号を発生するカウン
ター部と、ウィンドウタイミング立ち上がり信号及びウ
ィンドウタイミング立ち下がり信号に応じてウィンドウ
タイミング信号を発生し、ウィンドウタイミング立ち上
がり信号の印加時点から予め設定された時間が経過した
場合に内挿同期信号を発生する内挿同期信号発生部と、
検出同期信号と内挿同期信号に応じてウィンドウロック
信号を発生し、ウィンドウタイミング信号を印加させ前
記ウィンドウロック信号とウィンドウタイミング信号を
論理和してウィンドウ信号を発生するウィンドウ信号発
生部を備える。
スク再生装置の同期内挿回路は以下の構成を備える。す
なわち、ウィンドウ信号とセクタ単位にデータが記録さ
れた前記ディスクから再生された検出同期信号を受け
て、前記ウィンドウ信号に応じて定められる第１ウィン
ドウ区間内に前記検出同期信号が存すれば有効検出同期
信号を発生し、ウィンドウタイミング信号と内挿同期信
号を受け、ウィンドウタイミング信号に応じて定められ
るウィンドウ区間内で前記内挿同期信号が検出同期信号
より先立つ場合は有効内挿同期信号を発生し、前記有効
内挿同期信号と前記有効検出同期信号を論理和して有効
同期信号を発生する有効同期信号発生部と、有効同期信
号発生部からの有効検出同期信号及び有効内挿同期信号
を受け、１セクタデータ間隔にカウンタークリア信号を
発生するクリア信号発生部と、カウンタークリア信号を
受け、ウィンドウタイミング信号の予め設定された幅を
定めるためのウィンドウタイミング立ち上がり信号及び
ウィンドウタイミング立ち上がり信号を発生するカウン
ター部と、ウィンドウタイミング立ち上がり信号及びウ
ィンドウタイミング立ち下がり信号に応じてウィンドウ
タイミング信号を発生し、ウィンドウタイミング立ち上
がり信号の印加時点から予め設定された時間が経過した
場合に内挿同期信号を発生する内挿同期信号発生部と、
検出同期信号と内挿同期信号に応じてウィンドウロック
信号を発生し、ウィンドウタイミング信号を印加させ前
記ウィンドウロック信号とウィンドウタイミング信号を
論理和してウィンドウ信号を発生するウィンドウ信号発
生部を備える。
【００１０】また、本発明の他の目的を解決するために
本発明による同期状態検出装置は以下の構成を備える。
すなわち、前述した同期内挿回路にウィンドウタイミン
グ信号と内挿同期信号及び検出同期信号を入力され内挿
同期信号と検出同期信号が一致するかを示す第１状態信
号を発生する正常同期検出部と、ウィンドウ信号とウィ
ンドウタイミング以前立ち上がり信号とウィンドウタイ
ミング立ち下がり信号、及び検出信号を入力されウィン
ドウ信号のウィンドウ区間内に検出同期信号が存しない
ことを示す第２状態信号を発生する第１異常同期検出部
と、ウィンドウ信号とウィンドウタイミング信号とウィ
ンドウタイミング立ち上がり信号及び検出同期信号を入
力されウィンドウ信号のウィンドウ区間の外に検出同期
信号が存することを示す第３状態信号を発生する第２異
常同期検出部を含む。
本発明による同期状態検出装置は以下の構成を備える。
すなわち、前述した同期内挿回路にウィンドウタイミン
グ信号と内挿同期信号及び検出同期信号を入力され内挿
同期信号と検出同期信号が一致するかを示す第１状態信
号を発生する正常同期検出部と、ウィンドウ信号とウィ
ンドウタイミング以前立ち上がり信号とウィンドウタイ
ミング立ち下がり信号、及び検出信号を入力されウィン
ドウ信号のウィンドウ区間内に検出同期信号が存しない
ことを示す第２状態信号を発生する第１異常同期検出部
と、ウィンドウ信号とウィンドウタイミング信号とウィ
ンドウタイミング立ち上がり信号及び検出同期信号を入
力されウィンドウ信号のウィンドウ区間の外に検出同期
信号が存することを示す第３状態信号を発生する第２異
常同期検出部を含む。
【００１１】
【実施例】以下、添付した図２乃至図１３に基づき本発
明に係る実施例を詳細に説明する。
明に係る実施例を詳細に説明する。
【００１２】図２は本発明のディスク再生装置の同期内
挿回路を示したブロック構成図であって、図示の如く５
つのブロックから構成される。
挿回路を示したブロック構成図であって、図示の如く５
つのブロックから構成される。
【００１３】一番目のブロックである有効同期信号発生
部１０はディスクから再生された検出同期信号ＳＹＮＣ
ＤＥＴと内挿同期信号発生部４０で形成された内挿同期
信号ＳＹＮＣＩＮＳを含む種々の信号を入力し、実際に
データを再生するに必要な有効同期信号ＳＹＮＣを形成
する。
部１０はディスクから再生された検出同期信号ＳＹＮＣ
ＤＥＴと内挿同期信号発生部４０で形成された内挿同期
信号ＳＹＮＣＩＮＳを含む種々の信号を入力し、実際に
データを再生するに必要な有効同期信号ＳＹＮＣを形成
する。
【００１４】有効同期信号発生部１０の出力端には二番
目のブロックであるクリア信号発生部２０が連結され
る。クリア信号発生部２０は有効同期信号発生部１０に
より発生される有効内挿同期信号ＶＳＹＩＮＳと有効検
出同期信号ＶＳＹＤＥＴを入力し、クリア信号を発生し
てカウンター部３０に供給する。
目のブロックであるクリア信号発生部２０が連結され
る。クリア信号発生部２０は有効同期信号発生部１０に
より発生される有効内挿同期信号ＶＳＹＩＮＳと有効検
出同期信号ＶＳＹＤＥＴを入力し、クリア信号を発生し
てカウンター部３０に供給する。
【００１５】三番目のブロックであるカウンター部３０
は２３５２進カウンターを備えて１セクタ（２３５２バ
イト）をカウントし、クリア信号発生部２０からクリア
信号ＣＮＴＣＬＲが入力される度にリセットされる。カ
ウンター部３０はウィンドウ時点（タイミング）の決定
に使われるウィンドウタイミング立ち上がり信号ＷＩＮ
Ｒと、ウィンドウタイミング立ち上がり信号ＷＩＮＲよ
り１クロック先立ちウィンドウタイミング以前立ち上が
り信号ＷＩＮＲＢ、及びウィンドウタイミング立ち下が
り信号ＷＩＮＦを発生する。
は２３５２進カウンターを備えて１セクタ（２３５２バ
イト）をカウントし、クリア信号発生部２０からクリア
信号ＣＮＴＣＬＲが入力される度にリセットされる。カ
ウンター部３０はウィンドウ時点（タイミング）の決定
に使われるウィンドウタイミング立ち上がり信号ＷＩＮ
Ｒと、ウィンドウタイミング立ち上がり信号ＷＩＮＲよ
り１クロック先立ちウィンドウタイミング以前立ち上が
り信号ＷＩＮＲＢ、及びウィンドウタイミング立ち下が
り信号ＷＩＮＦを発生する。
【００１６】四番目のブロックである内挿同期信号発生
部４０はカウンター部３０の出力信号を入力し、ウィン
ドウタイミング信号ＷＴＩＭＥを形成し、ウィンドウタ
イミング信号ＷＴＩＭＥの上昇エッジから予め設定され
た時間が経った時点に内挿同期信号ＳＹＮＣＩＮＳを形
成する。
部４０はカウンター部３０の出力信号を入力し、ウィン
ドウタイミング信号ＷＴＩＭＥを形成し、ウィンドウタ
イミング信号ＷＴＩＭＥの上昇エッジから予め設定され
た時間が経った時点に内挿同期信号ＳＹＮＣＩＮＳを形
成する。
【００１７】最後のブロックであるウィンドウ信号発生
部５０は検出同期信号ＳＹＮＣＤＥＴと内挿同期信号Ｓ
ＹＮＣＩＮＳのタイミングを比較してウィンドウロック
信号ＷＮＤＬＫを発生させ、ウィンドウロック信号ＷＮ
ＤＬＫとウィンドウタイミング信号ＷＴＩＭＥを用いて
ウィンドウ信号ＷＩＮＤＯＷを形成する。
部５０は検出同期信号ＳＹＮＣＤＥＴと内挿同期信号Ｓ
ＹＮＣＩＮＳのタイミングを比較してウィンドウロック
信号ＷＮＤＬＫを発生させ、ウィンドウロック信号ＷＮ
ＤＬＫとウィンドウタイミング信号ＷＴＩＭＥを用いて
ウィンドウ信号ＷＩＮＤＯＷを形成する。
【００１８】前述した構成の図２の同期内挿回路の動作
を図３乃至図７に示した各ブロックの詳細回路図と、図
１２（Ａ）〜図１２（Ｈ）および図１３（Ａ）〜図１３
（Ｊ）の波形図に基づき更に詳しく説明する。
を図３乃至図７に示した各ブロックの詳細回路図と、図
１２（Ａ）〜図１２（Ｈ）および図１３（Ａ）〜図１３
（Ｊ）の波形図に基づき更に詳しく説明する。
【００１９】図３は図２に示した有効同期信号発生部１
０の詳細回路図である。
０の詳細回路図である。
【００２０】有効同期信号発生部１０において、インバ
ータＩＮＶ１は図示していない同期検出回路からのクロ
ック信号ＣＫ（図１２（Ａ）参照）が入力し、それを反
転してＪＫフリップフロップＦＦ１へ出力する。ナンド
ゲートＮＡＮＤ１は内挿同期信号発生部４０からのウィ
ンドウタイミング信号ＷＴＩＭＥ（図１２（Ｆ）参照）
と検出同期信号ＳＹＮＣＤＥＴを否定論理積してＪＫフ
リップフロップＦＦ１の入力端Ｋに出力する。ＪＫフリ
ップフロップＦＦ１はカウンター部３０からのウィンド
ウタイミング以前立ち上がり信号ＷＩＮＲＢ（図１２
（Ｃ）参照）を入力端Ｊに受け、マスタリセット信号Ｍ
ＲＳＴをリセット端ＲＳに受ける。ＪＫフリップフロッ
プＦＦ１はウィンドウタイミング以前立ち上がり信号Ｗ
ＩＮＲＢ（図１２（Ｃ））とナンドゲートＮＡＮＤ１か
ら出力される信号を受けて、インバータＩＮＶ１から印
加される反転されたクロック信号ＣＫの下降エッジによ
り出力する。アンドゲートＡＮＤ２にはフリップフロッ
プＦＦ１の出力端Ｑを通じて出力される信号と内挿同期
信号発生部４０からの内挿同期信号ＳＹＮＣＩＮＳ（図
１２（Ｈ））が印加され、ウィンドウタイミング信号Ｗ
ＴＩＭＥのハイレベル区間内で内挿同期信号ＳＹＮＣＩ
ＮＳが検出同期信号ＳＹＮＣＤＥＴより先に発生する場
合にハイレベルの有効内挿同期信号ＶＳＹＩＮＳを出力
する。アンドゲートＡＮＤ１には検出同期信号ＳＹＮＣ
ＤＥＴとウィンドウ信号発生部５０からのウィンドウ信
号ＷＩＮＤＯＷが供給される。アンドゲートＡＮＤ１は
ウィンドウ信号ＷＩＮＤＯＷ（図１３（Ｇ））のハイレ
ベル区間内で検出同期信号ＳＹＮＣＤＥＴ（図１３
（Ｃ））がハイレベルの値を有すればハイレベルの有効
検出同期信号ＶＳＹＤＥＴを出力する。オアゲートＯＲ
１はアンドゲートＡＮＤ１、ＡＮＤ２の出力信号を供給
され論理和して図１３（Ｂ）に示した通りの有効同期信
号ＳＹＮＣを出力する。有効同期信号発生部１０から発
生される有効内挿同期信号ＶＳＹＩＮＳおよび有効同期
信号ＶＳＹＤＥＴはクリア信号発生部２０に供給され
る。
ータＩＮＶ１は図示していない同期検出回路からのクロ
ック信号ＣＫ（図１２（Ａ）参照）が入力し、それを反
転してＪＫフリップフロップＦＦ１へ出力する。ナンド
ゲートＮＡＮＤ１は内挿同期信号発生部４０からのウィ
ンドウタイミング信号ＷＴＩＭＥ（図１２（Ｆ）参照）
と検出同期信号ＳＹＮＣＤＥＴを否定論理積してＪＫフ
リップフロップＦＦ１の入力端Ｋに出力する。ＪＫフリ
ップフロップＦＦ１はカウンター部３０からのウィンド
ウタイミング以前立ち上がり信号ＷＩＮＲＢ（図１２
（Ｃ）参照）を入力端Ｊに受け、マスタリセット信号Ｍ
ＲＳＴをリセット端ＲＳに受ける。ＪＫフリップフロッ
プＦＦ１はウィンドウタイミング以前立ち上がり信号Ｗ
ＩＮＲＢ（図１２（Ｃ））とナンドゲートＮＡＮＤ１か
ら出力される信号を受けて、インバータＩＮＶ１から印
加される反転されたクロック信号ＣＫの下降エッジによ
り出力する。アンドゲートＡＮＤ２にはフリップフロッ
プＦＦ１の出力端Ｑを通じて出力される信号と内挿同期
信号発生部４０からの内挿同期信号ＳＹＮＣＩＮＳ（図
１２（Ｈ））が印加され、ウィンドウタイミング信号Ｗ
ＴＩＭＥのハイレベル区間内で内挿同期信号ＳＹＮＣＩ
ＮＳが検出同期信号ＳＹＮＣＤＥＴより先に発生する場
合にハイレベルの有効内挿同期信号ＶＳＹＩＮＳを出力
する。アンドゲートＡＮＤ１には検出同期信号ＳＹＮＣ
ＤＥＴとウィンドウ信号発生部５０からのウィンドウ信
号ＷＩＮＤＯＷが供給される。アンドゲートＡＮＤ１は
ウィンドウ信号ＷＩＮＤＯＷ（図１３（Ｇ））のハイレ
ベル区間内で検出同期信号ＳＹＮＣＤＥＴ（図１３
（Ｃ））がハイレベルの値を有すればハイレベルの有効
検出同期信号ＶＳＹＤＥＴを出力する。オアゲートＯＲ
１はアンドゲートＡＮＤ１、ＡＮＤ２の出力信号を供給
され論理和して図１３（Ｂ）に示した通りの有効同期信
号ＳＹＮＣを出力する。有効同期信号発生部１０から発
生される有効内挿同期信号ＶＳＹＩＮＳおよび有効同期
信号ＶＳＹＤＥＴはクリア信号発生部２０に供給され
る。
【００２１】図４は図２に示したクリア信号発生部３０
の詳細回路図である。
の詳細回路図である。
【００２２】クリア信号発生部２０において、フリップ
フロップＦＦ２、ＦＦ３はマスタリセット信号ＭＲＳＴ
をリセットＲＳに、そしてインバータＩＮＶ２により反
転されるクロック信号ＣＫをクロック入力に入力され
る。ＤフリップフロップＦＦ２は有効内挿同期信号ＶＳ
ＹＩＮＳを入力Ｄに印加されクロック信号ＣＫの下降エ
ッジにより出力し、フリップフロップＦＦ３は有効検出
同期信号ＶＳＹＤＥＴを入力Ｄに印加され、やはりクロ
ック信号のＣＫの下降エッジにより出力する。ナンドゲ
ートＮＡＮＤ２は反転された有効内挿同期信号ＶＳＹＩ
ＮＳとフリップフロップＦＦ２の出力信号を印加され否
定論理積して出力する。ナンドゲートＮＡＮＤ３は反転
された有効検出同期信号ＶＳＹＤＥＴとフリップフロッ
プＦＦ３の出力信号を入力され否定論理積して出力す
る。アンドゲートＡＮＤ３はマスタリセット信号ＭＲＳ
Ｔと、有効内挿同期信号ＶＳＹＩＮＳ及び有効検出同期
信号ＶＳＹＤＥＴを論理和してカウンタークリア信号Ｃ
ＮＴＣＬＲを発生する。カウンタークリア信号ＣＮＴＣ
ＬＲはカウンター部３０が２３５２個のクロック信号Ｃ
Ｋをカウンティングする度にカウンター部３０をリセッ
トするための信号であって、クロック信号ＣＫの１周期
の半分にあたる時間の間ローレベルの値を有する。
フロップＦＦ２、ＦＦ３はマスタリセット信号ＭＲＳＴ
をリセットＲＳに、そしてインバータＩＮＶ２により反
転されるクロック信号ＣＫをクロック入力に入力され
る。ＤフリップフロップＦＦ２は有効内挿同期信号ＶＳ
ＹＩＮＳを入力Ｄに印加されクロック信号ＣＫの下降エ
ッジにより出力し、フリップフロップＦＦ３は有効検出
同期信号ＶＳＹＤＥＴを入力Ｄに印加され、やはりクロ
ック信号のＣＫの下降エッジにより出力する。ナンドゲ
ートＮＡＮＤ２は反転された有効内挿同期信号ＶＳＹＩ
ＮＳとフリップフロップＦＦ２の出力信号を印加され否
定論理積して出力する。ナンドゲートＮＡＮＤ３は反転
された有効検出同期信号ＶＳＹＤＥＴとフリップフロッ
プＦＦ３の出力信号を入力され否定論理積して出力す
る。アンドゲートＡＮＤ３はマスタリセット信号ＭＲＳ
Ｔと、有効内挿同期信号ＶＳＹＩＮＳ及び有効検出同期
信号ＶＳＹＤＥＴを論理和してカウンタークリア信号Ｃ
ＮＴＣＬＲを発生する。カウンタークリア信号ＣＮＴＣ
ＬＲはカウンター部３０が２３５２個のクロック信号Ｃ
Ｋをカウンティングする度にカウンター部３０をリセッ
トするための信号であって、クロック信号ＣＫの１周期
の半分にあたる時間の間ローレベルの値を有する。
【００２３】図５は図２に示したカウンター部３０の詳
細回路図である。カウンターＣＮＴ１はクロック信号Ｃ
Ｋをカウンティングし、クリア信号発生部２０から供給
されるカウンタークリア信号ＣＮＴＣＬＲのローレベル
によりリセットされる。カウンターＣＮＴ１の出力端に
連結されたデコーダＤＣＤ１〜ＤＣＤ３の内、第１デコ
ーダＤＣＤ１はカウンターＣＮＴ１の出力信号が２３０
１の時、第２デコーダＤＣＤ２はカウンターＣＮＴ１の
出力信号が２３０２の時、第３のデコーダＤＣＤ３はカ
ウンターＣＮＴ１の出力信号が４７の時、夫々ハイレベ
ル信号を出力する。ここで、前述したデコーダＤＣＤ１
〜ＤＣＤ３の検出値２３０１、２３０２、４７はウィン
ドウタイミング信号ＷＴＩＭＥにあわせて定められるも
ので、本実施例ではウィンドウタイミング信号ＷＴＩＭ
Ｅのハイレベル区間を内挿同期信号を基準として−４８
番目のバイトから＋４８番目のバイトまでの区間と設定
したためである。デコーダＤＣＤ１〜ＤＣＤ３の出力信
号は夫々フリップフロップＦＦ４〜ＦＦ６の入力Ｄに供
給される。
細回路図である。カウンターＣＮＴ１はクロック信号Ｃ
Ｋをカウンティングし、クリア信号発生部２０から供給
されるカウンタークリア信号ＣＮＴＣＬＲのローレベル
によりリセットされる。カウンターＣＮＴ１の出力端に
連結されたデコーダＤＣＤ１〜ＤＣＤ３の内、第１デコ
ーダＤＣＤ１はカウンターＣＮＴ１の出力信号が２３０
１の時、第２デコーダＤＣＤ２はカウンターＣＮＴ１の
出力信号が２３０２の時、第３のデコーダＤＣＤ３はカ
ウンターＣＮＴ１の出力信号が４７の時、夫々ハイレベ
ル信号を出力する。ここで、前述したデコーダＤＣＤ１
〜ＤＣＤ３の検出値２３０１、２３０２、４７はウィン
ドウタイミング信号ＷＴＩＭＥにあわせて定められるも
ので、本実施例ではウィンドウタイミング信号ＷＴＩＭ
Ｅのハイレベル区間を内挿同期信号を基準として−４８
番目のバイトから＋４８番目のバイトまでの区間と設定
したためである。デコーダＤＣＤ１〜ＤＣＤ３の出力信
号は夫々フリップフロップＦＦ４〜ＦＦ６の入力Ｄに供
給される。
【００２４】ＤフリップフロップＦＦ４〜ＦＦ６は、カ
ウンターＣＮＴ１の出力信号が変る時に不安定になるデ
コーダＤＣＤ１〜ＤＣＤ３の出力信号を安定した信号に
させる機能を果たす。
ウンターＣＮＴ１の出力信号が変る時に不安定になるデ
コーダＤＣＤ１〜ＤＣＤ３の出力信号を安定した信号に
させる機能を果たす。
【００２５】ＤフリップフロップＦＦ４はデコーダＤＣ
Ｄ１により形成されたウィンドウタイミング以前立ち上
がり信号ＷＩＮＲＢ（図１２（Ｃ））を出力する。同様
に、フリップフロップＦＦ５はウィンドウタイミング信
号ＷＴＩＭＥの立ち上がり時点−４８を決定するウィン
ドウタイミング立ち上がり信号ＷＩＮＲ（図１２
（Ｄ））を出力し、フリップフロップＦＦ６はウィンド
ウタイミング信号ＷＴＩＭＥの下降時点＋４８を決定す
るウィンドウタイミング立ち上がり信号ＷＩＮＦ（図１
２（Ｅ））を出力する。カウンター部３０により形成さ
れた信号ＷＩＮＲＢ、ＷＩＮＲ、ＷＩＮＦは内挿同期信
号発生部４０に供給される。
Ｄ１により形成されたウィンドウタイミング以前立ち上
がり信号ＷＩＮＲＢ（図１２（Ｃ））を出力する。同様
に、フリップフロップＦＦ５はウィンドウタイミング信
号ＷＴＩＭＥの立ち上がり時点−４８を決定するウィン
ドウタイミング立ち上がり信号ＷＩＮＲ（図１２
（Ｄ））を出力し、フリップフロップＦＦ６はウィンド
ウタイミング信号ＷＴＩＭＥの下降時点＋４８を決定す
るウィンドウタイミング立ち上がり信号ＷＩＮＦ（図１
２（Ｅ））を出力する。カウンター部３０により形成さ
れた信号ＷＩＮＲＢ、ＷＩＮＲ、ＷＩＮＦは内挿同期信
号発生部４０に供給される。
【００２６】図６は図２に示した内挿同期信号発生部４
０の詳細回路図である。
０の詳細回路図である。
【００２７】ウィンドウタイミング立ち上がり信号ＷＩ
ＮＲ（図１２（Ｄ））はインバータＩＮＶ３により反転
され、ＲＳフリップフロップＦＦ７のセット端Ｓに印加
される。アンドゲートＡＮＤ４はウィンドウタイミング
立ち下がり信号ＷＩＮＦ（図１２（Ｅ））を反転させる
インバータＩＮＶ４の出力信号と、マスタリセット信号
ＭＲＳＴを論理積し、ＲＳフリップフロップＦＦ７のリ
セット端Ｒに出力する。ＲＳフリップフロップＦＦ７は
ウィンドウタイミング立ち上がり信号ＷＩＮＲがハイレ
ベルの瞬間からウィンドウタイミング信号ＷＴＩＭＥ
（図１２（Ｆ））をハイレベルにし、ウィンドウ立ち下
がり信号ＷＩＮＦがハイレベルの瞬間からウィンドウタ
イミング信号ＷＴＩＭＥをローレベルにする。マスタリ
セット信号ＭＲＳＴをリセット端ＲＳに印加されるＤフ
リップフロップＦＦ８は、ＲＳフリップフロップＦＦ７
から出力されたウィンドウタイミング信号ＷＴＩＭＥを
入力端Ｄに印加され、クロック信号ＣＫを反転させるイ
ンバータＩＮＶ５の出力信号に同期させ出力端Ｑを通じ
て出力する。ＤフリップフロップＦＦ８の出力信号はイ
ンバータＩＮＶ６により反転されナンドゲートＮＡＮＤ
４に印加される。ナンドゲートＮＡＮＤ４はＲＳフリッ
プフロップＦＦ７の出力信号とインバータＩＮＶ６の出
力信号を否定論理積してアンドゲートＡＮＤ５に出力す
る。アンドゲートＡＮＤ５はマスタリセット信号ＭＲＳ
ＴとナンドゲートＮＡＮＤ４の出力信号を論理積してカ
ウンターＣＮＴ２のクリア端ＣＬＲに出力する。アンド
ゲートＡＮＤ５により出力される信号はウィンドウタイ
ミング信号ＷＴＩＭＥがハイレベルとなる時点にローレ
ベル状態にされる。カウンターＣＮＴ２において、ＲＳ
フリップフロップＦＦ７の出力信号ＷＴＩＭＥはそのイ
ネーブル端ＥＮに、クロック信号ＣＫはそのクロック端
ＣＬＫに夫々印加され、ウィンドウタイミング信号ＷＴ
ＩＭＥはハイレベルに印加される間クロック信号ＣＫを
カウントする。第４デコーダＤＣＤ４は前記カウンター
ＣＮＴ２の８ビットカウント値信号（図１２（Ｇ））の
４８番目をカウントするとハイレベル信号を出力する。
この信号は内挿同期信号ＳＹＮＣＩＮＳ（図１２
（Ｈ））であってＤフリップフロップＦＦ９を経ながら
安定的になる。
ＮＲ（図１２（Ｄ））はインバータＩＮＶ３により反転
され、ＲＳフリップフロップＦＦ７のセット端Ｓに印加
される。アンドゲートＡＮＤ４はウィンドウタイミング
立ち下がり信号ＷＩＮＦ（図１２（Ｅ））を反転させる
インバータＩＮＶ４の出力信号と、マスタリセット信号
ＭＲＳＴを論理積し、ＲＳフリップフロップＦＦ７のリ
セット端Ｒに出力する。ＲＳフリップフロップＦＦ７は
ウィンドウタイミング立ち上がり信号ＷＩＮＲがハイレ
ベルの瞬間からウィンドウタイミング信号ＷＴＩＭＥ
（図１２（Ｆ））をハイレベルにし、ウィンドウ立ち下
がり信号ＷＩＮＦがハイレベルの瞬間からウィンドウタ
イミング信号ＷＴＩＭＥをローレベルにする。マスタリ
セット信号ＭＲＳＴをリセット端ＲＳに印加されるＤフ
リップフロップＦＦ８は、ＲＳフリップフロップＦＦ７
から出力されたウィンドウタイミング信号ＷＴＩＭＥを
入力端Ｄに印加され、クロック信号ＣＫを反転させるイ
ンバータＩＮＶ５の出力信号に同期させ出力端Ｑを通じ
て出力する。ＤフリップフロップＦＦ８の出力信号はイ
ンバータＩＮＶ６により反転されナンドゲートＮＡＮＤ
４に印加される。ナンドゲートＮＡＮＤ４はＲＳフリッ
プフロップＦＦ７の出力信号とインバータＩＮＶ６の出
力信号を否定論理積してアンドゲートＡＮＤ５に出力す
る。アンドゲートＡＮＤ５はマスタリセット信号ＭＲＳ
ＴとナンドゲートＮＡＮＤ４の出力信号を論理積してカ
ウンターＣＮＴ２のクリア端ＣＬＲに出力する。アンド
ゲートＡＮＤ５により出力される信号はウィンドウタイ
ミング信号ＷＴＩＭＥがハイレベルとなる時点にローレ
ベル状態にされる。カウンターＣＮＴ２において、ＲＳ
フリップフロップＦＦ７の出力信号ＷＴＩＭＥはそのイ
ネーブル端ＥＮに、クロック信号ＣＫはそのクロック端
ＣＬＫに夫々印加され、ウィンドウタイミング信号ＷＴ
ＩＭＥはハイレベルに印加される間クロック信号ＣＫを
カウントする。第４デコーダＤＣＤ４は前記カウンター
ＣＮＴ２の８ビットカウント値信号（図１２（Ｇ））の
４８番目をカウントするとハイレベル信号を出力する。
この信号は内挿同期信号ＳＹＮＣＩＮＳ（図１２
（Ｈ））であってＤフリップフロップＦＦ９を経ながら
安定的になる。
【００２８】図７は図２に示したウィンドウ信号発生部
５０の詳細回路図である。
５０の詳細回路図である。
【００２９】ナンドゲートＮＡＮＤ５は、内挿同期信号
ＳＹＮＣＩＮＳ（図１３（Ｄ））と検出同期信号ＳＹＮ
ＣＤＥＴ（図１３（Ｃ））を否定論理積し、それをＲＳ
フリップフロップＦＦ１０のセット端Ｓに出力する。フ
リップフロップＦＦ１０は内挿同期信号ＳＹＮＣＩＮＳ
と検出同期信号ＳＹＮＣＤＥＴの全てがハイレベル状態
を有する際ウィンドウクロック信号ＷＮＤＬＫ（図１３
（Ｆ））をハイレベル状態に出力する。ナンドゲートＮ
ＡＮＤ６は検出同期信号ＳＹＮＣＤＥＴとウィンドウタ
イミング信号ＷＴＩＭＥを否定論理積してＤフリップフ
ロップＦＦ１１の入力端Ｄに供給する。ナンドゲートＮ
ＡＮＤ６はウィンドウタイミング信号ＷＴＩＭＥがハイ
レベル状態を有する間に検出同期信号ＳＹＮＣＤＥＴが
ハイレベル状態になると、ローレベル信号をフリップフ
ロップＦＦ１１に出力する。ＤフリップフロップＦＦ１
１の出力信号はカウンターＣＮＴ３のクリア端ＣＬＲに
供給される。カウンターＣＮＴ３はウィンドウタイミン
グ信号ＷＴＩＭＥをカウントし、ＤフリップフロップＦ
Ｆ１１の出力Ｑによりクリアされる。かかるカウンター
ＣＮＴ３はハイレベル状態のウィンドウタイミング信号
ＷＴＩＭＥ内にハイレベル状態の検出同期信号ＳＹＮＣ
ＤＥＴが入っていないウィンドウタイミング信号ＷＴＩ
ＭＥの個数情報を２ビット出力端ＱＡ、ＱＢを通じて出
力する。カウンターＣＮＴ３の２ビット出力端ＱＡ、Ｑ
ＢはそれぞれナンドゲートＮＡＮＤ７の入力端に連結さ
れる。ナンドゲートＮＡＮＤ７はカウンターＣＮＴ３の
出力信号の値が”１１（２進数）”、即ち十進数で３の
場合にローレベル信号を出力する。アンドゲートＡＮＤ
６はナンドゲートＮＡＮＤ７の出力信号とマスタリセッ
ト信号ＭＲＳＴを論理積してＲＳフリップフロップＦＦ
１０リセット端Ｒに出力する。従って、ウィンドウタイ
ミング信号ＷＴＩＭＥのハイレベル区間内にハイレベル
の検出同期信号ＳＹＮＣＤＥＴが存しないウィンドウタ
イミング信号ＷＴＩＭＥが連続的に２度検出されれば、
フリップフロップＦＦ１０はアンドゲートＡＮＤ６から
出力されたローレベル状態を出力する。
ＳＹＮＣＩＮＳ（図１３（Ｄ））と検出同期信号ＳＹＮ
ＣＤＥＴ（図１３（Ｃ））を否定論理積し、それをＲＳ
フリップフロップＦＦ１０のセット端Ｓに出力する。フ
リップフロップＦＦ１０は内挿同期信号ＳＹＮＣＩＮＳ
と検出同期信号ＳＹＮＣＤＥＴの全てがハイレベル状態
を有する際ウィンドウクロック信号ＷＮＤＬＫ（図１３
（Ｆ））をハイレベル状態に出力する。ナンドゲートＮ
ＡＮＤ６は検出同期信号ＳＹＮＣＤＥＴとウィンドウタ
イミング信号ＷＴＩＭＥを否定論理積してＤフリップフ
ロップＦＦ１１の入力端Ｄに供給する。ナンドゲートＮ
ＡＮＤ６はウィンドウタイミング信号ＷＴＩＭＥがハイ
レベル状態を有する間に検出同期信号ＳＹＮＣＤＥＴが
ハイレベル状態になると、ローレベル信号をフリップフ
ロップＦＦ１１に出力する。ＤフリップフロップＦＦ１
１の出力信号はカウンターＣＮＴ３のクリア端ＣＬＲに
供給される。カウンターＣＮＴ３はウィンドウタイミン
グ信号ＷＴＩＭＥをカウントし、ＤフリップフロップＦ
Ｆ１１の出力Ｑによりクリアされる。かかるカウンター
ＣＮＴ３はハイレベル状態のウィンドウタイミング信号
ＷＴＩＭＥ内にハイレベル状態の検出同期信号ＳＹＮＣ
ＤＥＴが入っていないウィンドウタイミング信号ＷＴＩ
ＭＥの個数情報を２ビット出力端ＱＡ、ＱＢを通じて出
力する。カウンターＣＮＴ３の２ビット出力端ＱＡ、Ｑ
ＢはそれぞれナンドゲートＮＡＮＤ７の入力端に連結さ
れる。ナンドゲートＮＡＮＤ７はカウンターＣＮＴ３の
出力信号の値が”１１（２進数）”、即ち十進数で３の
場合にローレベル信号を出力する。アンドゲートＡＮＤ
６はナンドゲートＮＡＮＤ７の出力信号とマスタリセッ
ト信号ＭＲＳＴを論理積してＲＳフリップフロップＦＦ
１０リセット端Ｒに出力する。従って、ウィンドウタイ
ミング信号ＷＴＩＭＥのハイレベル区間内にハイレベル
の検出同期信号ＳＹＮＣＤＥＴが存しないウィンドウタ
イミング信号ＷＴＩＭＥが連続的に２度検出されれば、
フリップフロップＦＦ１０はアンドゲートＡＮＤ６から
出力されたローレベル状態を出力する。
【００３０】一方、ウィンドウタイミング信号ＷＴＩＭ
Ｅンハイレベル区間内にハイレベルの検出同期信号ＳＹ
ＮＣＤＥＴが存しないウィンドウタイミング信号ＷＴＩ
ＭＥが連続的に２度検出されなければ、ウィンドウロッ
ク信号ＷＮＤＬＫはハイレベル状態を保ち続ける。
Ｅンハイレベル区間内にハイレベルの検出同期信号ＳＹ
ＮＣＤＥＴが存しないウィンドウタイミング信号ＷＴＩ
ＭＥが連続的に２度検出されなければ、ウィンドウロッ
ク信号ＷＮＤＬＫはハイレベル状態を保ち続ける。
【００３１】オアゲートＯＲ２はインバータＩＮＶ７に
よりウィンドウロック信号ＷＮＤＬＫとウィンドウタイ
ミング信号ＷＴＩＭＥを論理和して出力する。オアゲー
トＯＲ２により発生されるウィンドウ信号ＷＩＮＤＯＷ
はＲＳフリップフロップＦＦ１０から出力されるウィン
ドウロック信号ＷＮＤＬＫがハイレベル状態のウィンド
ウタイミング信号ＷＴＩＭＥと同一なレベル状態を有
し、ウィンドウロック信号ＷＮＤＬＫがローレベル状態
のときはウィンドウロック信号ＷＮＤＬＫと同一なレベ
ル状態を有する。
よりウィンドウロック信号ＷＮＤＬＫとウィンドウタイ
ミング信号ＷＴＩＭＥを論理和して出力する。オアゲー
トＯＲ２により発生されるウィンドウ信号ＷＩＮＤＯＷ
はＲＳフリップフロップＦＦ１０から出力されるウィン
ドウロック信号ＷＮＤＬＫがハイレベル状態のウィンド
ウタイミング信号ＷＴＩＭＥと同一なレベル状態を有
し、ウィンドウロック信号ＷＮＤＬＫがローレベル状態
のときはウィンドウロック信号ＷＮＤＬＫと同一なレベ
ル状態を有する。
【００３２】図８は本発明の実施例によるディスク再生
装置の同期状態検出回路を示す全体ブロック構成図であ
る。
装置の同期状態検出回路を示す全体ブロック構成図であ
る。
【００３３】本発明の実施例による同期状態検出回路
は、正常同期検出部６０と、第１異常同期検出部７０及
び第２異常同期検出部８０を含み、図２の装置において
生成される信号を用いて同期状態を検出する。
は、正常同期検出部６０と、第１異常同期検出部７０及
び第２異常同期検出部８０を含み、図２の装置において
生成される信号を用いて同期状態を検出する。
【００３４】正常同期検出部６０は内挿同期信号ＳＹＮ
ＣＩＮＳ（図１３（Ｄ））と検出時信号ＳＹＮＣＤＥＴ
（図１３（Ｄ））が同時にハイレベルに検出されるかを
示す第１状態信号ＯＫＳＹを発生する。第１異常同期検
出部７０は現在の有効同期信号ＳＹＮＣがウィンドウ信
号ＷＩＮＤＯＷのハイレベル区間内にハイレベルの検出
同期信号ＳＹＮＣＤＥＴが存しないことを示す第２状態
信号ＮＯＳＹを発生する。第２異常同期信号検出部８０
はウィンドウ信号ＷＩＮＤＯＷのハイレベル区間の外に
検出同期信号ＳＹＮＣＤＥＴが存することを示す第３状
態信号ＩＬＳＹを発生する。
ＣＩＮＳ（図１３（Ｄ））と検出時信号ＳＹＮＣＤＥＴ
（図１３（Ｄ））が同時にハイレベルに検出されるかを
示す第１状態信号ＯＫＳＹを発生する。第１異常同期検
出部７０は現在の有効同期信号ＳＹＮＣがウィンドウ信
号ＷＩＮＤＯＷのハイレベル区間内にハイレベルの検出
同期信号ＳＹＮＣＤＥＴが存しないことを示す第２状態
信号ＮＯＳＹを発生する。第２異常同期信号検出部８０
はウィンドウ信号ＷＩＮＤＯＷのハイレベル区間の外に
検出同期信号ＳＹＮＣＤＥＴが存することを示す第３状
態信号ＩＬＳＹを発生する。
【００３５】前述した構成を有する同期状態検出回路の
動作を図９乃至図１１の詳細回路図と、図１３（Ａ）乃
至図１３（Ｊ）に基づき更に具体的に説明する。
動作を図９乃至図１１の詳細回路図と、図１３（Ａ）乃
至図１３（Ｊ）に基づき更に具体的に説明する。
【００３６】図９は図８に示した正常同期検出部６０の
詳細回路図である。
詳細回路図である。
【００３７】ナンドゲートＮＡＮＤ８は検出同期信号Ｓ
ＹＮＣＤＥＴ（図１３（Ｃ））と内挿同期信号ＳＹＮＣ
ＩＮＳ（図１３（Ｄ））を否定論理積し、それをＲＳフ
リップフロップＦＦ１２のセット端Ｓに出力する。ＲＳ
フリップフロップＦＦ１２は内挿同期信号ＳＹＮＣＩＮ
Ｓと検出同期信号ＳＹＮＣＤＥＴの全てがハイレベルの
時、ハイレベル信号を出力する。ＤフリップフロップＦ
Ｆ１４は入力端Ｄを通じて印加される信号をインバータ
１０により反転されるウィンドウタイミング信号ＷＴＩ
ＭＥに同期させ出力する。
ＹＮＣＤＥＴ（図１３（Ｃ））と内挿同期信号ＳＹＮＣ
ＩＮＳ（図１３（Ｄ））を否定論理積し、それをＲＳフ
リップフロップＦＦ１２のセット端Ｓに出力する。ＲＳ
フリップフロップＦＦ１２は内挿同期信号ＳＹＮＣＩＮ
Ｓと検出同期信号ＳＹＮＣＤＥＴの全てがハイレベルの
時、ハイレベル信号を出力する。ＤフリップフロップＦ
Ｆ１４は入力端Ｄを通じて印加される信号をインバータ
１０により反転されるウィンドウタイミング信号ＷＴＩ
ＭＥに同期させ出力する。
【００３８】一方、インバータＩＮＶ８はクロック信号
ＣＫを反転させＤフリップフロップＦＦ１３のクロック
端に出力する。マスタリセット信号ＭＲＳＴをリセット
ＲＳに印加されるＤフリップフロップＦＦ１３は、ウィ
ンドウタイミング信号ＷＴＩＭＥ（図１３（Ｅ））をそ
の入力端Ｄに印加され、クロック信号ＣＫの下降エッジ
に同期させインバータＩＮＶ９に出力する。ナンドゲー
トＮＡＮＤ９はインバータＩＮＶ９により反転された信
号とウィンドウタイミング信号ＷＴＩＭＥを否定論理積
してＲＳフリップフロップＦＦ１２のリセットＲに供給
する。かかるナンドゲートＮＡＮＤ９の出力信号はウィ
ンドウタイミング信号ＷＴＩＭＥの上昇エッジでローレ
ベル信号となる。ＲＳフリップフロップＦＦ１２はナン
ドゲートＮＡＮＤ９からローレベル信号が印加されれば
出力端ＯＵＴを通じてローレベルを出力する。ＲＳフリ
ップフロップＦＦ１２の出力信号はＤフリップフロップ
ＦＦ１４の入力Ｄに印加される。フリップフロップＦＦ
１４は、ウィンドウタイミング信号ＷＴＩＭＥを反転さ
せるインバータＩＮＶ１０の出力信号をそのクロック端
に入力し、第１状態信号ＯＫＳＹ（図１３（Ｈ））を出
力する。ウィンドウタイミング信号ＷＴＩＭＥの下降エ
ッジに同期され出力される第１状態信号ＯＫＳＹは、内
挿同期信号ＳＹＮＣＩＮＳと検出同期信号ＳＹＮＣＤＥ
Ｔが同時にハイレベル状態の場合にハイレベルとなる。
そして、内挿同期信号ＳＹＮＣＩＮＳと検出同期信号Ｓ
ＹＮＣＤＥＴが同時にハイレベル状態でなければローレ
ベル状態を有する。ここで、第１状態信号ＯＫＳＹは検
出同期信号ＳＹＮＣＤＥＴ（図１３（Ｃ））が一つ以前
のセクタの有効同期信号ＳＹＮＣ又は内挿同期信号ＳＹ
ＮＣＩＮＳから２３５２バイト後に生成されることを示
す。
ＣＫを反転させＤフリップフロップＦＦ１３のクロック
端に出力する。マスタリセット信号ＭＲＳＴをリセット
ＲＳに印加されるＤフリップフロップＦＦ１３は、ウィ
ンドウタイミング信号ＷＴＩＭＥ（図１３（Ｅ））をそ
の入力端Ｄに印加され、クロック信号ＣＫの下降エッジ
に同期させインバータＩＮＶ９に出力する。ナンドゲー
トＮＡＮＤ９はインバータＩＮＶ９により反転された信
号とウィンドウタイミング信号ＷＴＩＭＥを否定論理積
してＲＳフリップフロップＦＦ１２のリセットＲに供給
する。かかるナンドゲートＮＡＮＤ９の出力信号はウィ
ンドウタイミング信号ＷＴＩＭＥの上昇エッジでローレ
ベル信号となる。ＲＳフリップフロップＦＦ１２はナン
ドゲートＮＡＮＤ９からローレベル信号が印加されれば
出力端ＯＵＴを通じてローレベルを出力する。ＲＳフリ
ップフロップＦＦ１２の出力信号はＤフリップフロップ
ＦＦ１４の入力Ｄに印加される。フリップフロップＦＦ
１４は、ウィンドウタイミング信号ＷＴＩＭＥを反転さ
せるインバータＩＮＶ１０の出力信号をそのクロック端
に入力し、第１状態信号ＯＫＳＹ（図１３（Ｈ））を出
力する。ウィンドウタイミング信号ＷＴＩＭＥの下降エ
ッジに同期され出力される第１状態信号ＯＫＳＹは、内
挿同期信号ＳＹＮＣＩＮＳと検出同期信号ＳＹＮＣＤＥ
Ｔが同時にハイレベル状態の場合にハイレベルとなる。
そして、内挿同期信号ＳＹＮＣＩＮＳと検出同期信号Ｓ
ＹＮＣＤＥＴが同時にハイレベル状態でなければローレ
ベル状態を有する。ここで、第１状態信号ＯＫＳＹは検
出同期信号ＳＹＮＣＤＥＴ（図１３（Ｃ））が一つ以前
のセクタの有効同期信号ＳＹＮＣ又は内挿同期信号ＳＹ
ＮＣＩＮＳから２３５２バイト後に生成されることを示
す。
【００３９】図１０は図８に示した第１異常同期検出部
７０の詳細回路図である。
７０の詳細回路図である。
【００４０】アンドゲートＡＮＤ７はウィンドウタイミ
ング以前立ち上がり信号ＷＩＮＲＢを反転させるインバ
ータＩＮＶ１１の出力信号とマスタリセット信号ＭＲＳ
Ｔを論理積し、それをＲＳフリップフロップＦＦ１５の
セット端Ｓに供給する。ＲＳフリップフロップＦＦ１５
はウィンドウタイミング以前立ち上がり信号ＷＩＮＲＢ
がローレベルでありながらマスタリセット信号ＭＲＳＴ
がハイレベルの場合を除けばハイレベル信号を出力す
る。ナンドゲートＮＡＮＤ１０は検出同期信号ＳＹＮＣ
ＤＥＴ（図１３（Ｃ））とウィンドウ信号ＷＩＮＤＯＷ
（図１３（Ｇ））を否定論理積してＤフリップフロップ
ＦＦ１６の入力Ｄに供給する。ＤフリップフロップＦＦ
１６はハイレベル状態のウィンドウタイミング信号ＷＴ
ＩＭＥ内にハイレベル状態の検出同期信号ＳＹＮＣＤＥ
Ｔが存すれば、ローレベル信号をフリップフロップＦＦ
１５のリセット端Ｓに出力する。ＲＳフリップフロップ
ＦＦ１５はリセット端Ｒにローレベル信号が入力されれ
ば、出力端ＯＵＴを通じてローレベル信号を出力する。
フリップフロップＦＦ１７は、ウィンドウタイミング立
ち下がり信号ＷＩＮＦをそのクロック端に、フリップフ
ロップＦＦ１５の出力信号を入力端Ｄに受ける。フリッ
プフロップＦＦ１７はウィンドウタイミング立ち下がり
信号ＷＩＮＦがハイレベル状態に存すれば、ローレベル
状態を有する第２状態信号（図１３（Ｉ））を出力し、
前述した区間内に検出同期信号ＷＩＮＤＥＴがローレベ
ル状態に存すれば、ハイレベル状態を有する第２状態信
号ＮＯＳＹを出力する。
ング以前立ち上がり信号ＷＩＮＲＢを反転させるインバ
ータＩＮＶ１１の出力信号とマスタリセット信号ＭＲＳ
Ｔを論理積し、それをＲＳフリップフロップＦＦ１５の
セット端Ｓに供給する。ＲＳフリップフロップＦＦ１５
はウィンドウタイミング以前立ち上がり信号ＷＩＮＲＢ
がローレベルでありながらマスタリセット信号ＭＲＳＴ
がハイレベルの場合を除けばハイレベル信号を出力す
る。ナンドゲートＮＡＮＤ１０は検出同期信号ＳＹＮＣ
ＤＥＴ（図１３（Ｃ））とウィンドウ信号ＷＩＮＤＯＷ
（図１３（Ｇ））を否定論理積してＤフリップフロップ
ＦＦ１６の入力Ｄに供給する。ＤフリップフロップＦＦ
１６はハイレベル状態のウィンドウタイミング信号ＷＴ
ＩＭＥ内にハイレベル状態の検出同期信号ＳＹＮＣＤＥ
Ｔが存すれば、ローレベル信号をフリップフロップＦＦ
１５のリセット端Ｓに出力する。ＲＳフリップフロップ
ＦＦ１５はリセット端Ｒにローレベル信号が入力されれ
ば、出力端ＯＵＴを通じてローレベル信号を出力する。
フリップフロップＦＦ１７は、ウィンドウタイミング立
ち下がり信号ＷＩＮＦをそのクロック端に、フリップフ
ロップＦＦ１５の出力信号を入力端Ｄに受ける。フリッ
プフロップＦＦ１７はウィンドウタイミング立ち下がり
信号ＷＩＮＦがハイレベル状態に存すれば、ローレベル
状態を有する第２状態信号（図１３（Ｉ））を出力し、
前述した区間内に検出同期信号ＷＩＮＤＥＴがローレベ
ル状態に存すれば、ハイレベル状態を有する第２状態信
号ＮＯＳＹを出力する。
【００４１】図１１は図８に示した第２異常同期検出部
８０の詳細回路図である。
８０の詳細回路図である。
【００４２】ナンドゲートＮＡＮＤ１１は、検出同期信
号ＳＹＮＣＤＥＴと、ウィンドウ信号ＷＩＮＤＯＷを反
転させるインバータＩＮＶ１２の出力信号とを否定論理
積して、それをＤフリップフロップＦＦ１８の入力端Ｄ
に出力する。ＤフリップフロップＦＦ１８はクロック信
号ＣＫを反転出力するインバータＩＮＶ１４の出力信号
に応じて動作し、ウィンドウ信号ＷＩＮＤＯＷがローレ
ベル状態の区間で検出同期信号ＳＹＮＣＤＥＴがハイレ
ベル状態に存すれば、ローレベル信号をＲＳフリップフ
ロップＦＦ１９のセット端Ｓに出力する。ＲＳフリップ
フロップＦＦ１９はローレベル信号がセット端Ｓに印加
されれば、出力端ＯＵＴを通じてハイレベル信号をＤフ
リップフロップＦＦ２１に出力する。Ｄフリップフロッ
プＦＦ２１はクロック信号に印加されるウィンドウタイ
ミング信号ＷＴＩＭＥに同期されハイレベル状態を有す
る第３状態信号ＩＬＳＹ（図１３（Ｊ））を出力する。
号ＳＹＮＣＤＥＴと、ウィンドウ信号ＷＩＮＤＯＷを反
転させるインバータＩＮＶ１２の出力信号とを否定論理
積して、それをＤフリップフロップＦＦ１８の入力端Ｄ
に出力する。ＤフリップフロップＦＦ１８はクロック信
号ＣＫを反転出力するインバータＩＮＶ１４の出力信号
に応じて動作し、ウィンドウ信号ＷＩＮＤＯＷがローレ
ベル状態の区間で検出同期信号ＳＹＮＣＤＥＴがハイレ
ベル状態に存すれば、ローレベル信号をＲＳフリップフ
ロップＦＦ１９のセット端Ｓに出力する。ＲＳフリップ
フロップＦＦ１９はローレベル信号がセット端Ｓに印加
されれば、出力端ＯＵＴを通じてハイレベル信号をＤフ
リップフロップＦＦ２１に出力する。Ｄフリップフロッ
プＦＦ２１はクロック信号に印加されるウィンドウタイ
ミング信号ＷＴＩＭＥに同期されハイレベル状態を有す
る第３状態信号ＩＬＳＹ（図１３（Ｊ））を出力する。
【００４３】一方、ＤフリップフロップＦＦ２０はイン
バータ１３により反転されたウィンドウタイミング立ち
上がり信号ＷＩＮＲを入力端Ｄに受け、インバータＩＮ
Ｖ１４により反転されたクロック信号ＣＫに同期して出
力する。ＤフリップフロップＦＦ２０はクロック信号Ｃ
Ｋの下降エッジでウィンドウタイミング立ち上がり信号
ＷＩＮＲがハイレベル状態ならローレベル信号をアンド
ゲートＡＮＤ８に出力する。アンドゲートＡＮＤ８はマ
スタリセット信号ＭＲＳＴとＤフリップフロップＦＦ２
０の出力信号を論理積してＲＳフリップフロップＦＦ１
９に出力する。ＲＳフリップフロップＦＦ１９はアンド
ゲートＡＮＤ８の出力信号がローレベル状態を有すれ
ば、ローレベル信号をＤフリップフロップＦＦ２１Ｊの
入力端Ｄに出力する。フリップフロップＦＦ２１はクロ
ック信号に印加されるウィンドウタイミング信号ＷＴＩ
ＭＥに応じてローレベル状態を有する第３状態信号ＩＬ
ＳＹ３を出力する。ウィンドウ信号ＷＩＮＤＯＷのロー
レベル区間で検出同期信号ＳＹＮＣＤＥＴがハイレベル
状態なら、第３状態信号ＩＬＳＹはハイレベル状態を有
し、ウィンドウ信号ＷＩＮＤＯＷのハイレベル区間で検
出同期信号ＳＹＮＣＤＥＴがローレベル状態を有すれば
第３状態信号ＩＬＳＹはローレベル状態を有する。
バータ１３により反転されたウィンドウタイミング立ち
上がり信号ＷＩＮＲを入力端Ｄに受け、インバータＩＮ
Ｖ１４により反転されたクロック信号ＣＫに同期して出
力する。ＤフリップフロップＦＦ２０はクロック信号Ｃ
Ｋの下降エッジでウィンドウタイミング立ち上がり信号
ＷＩＮＲがハイレベル状態ならローレベル信号をアンド
ゲートＡＮＤ８に出力する。アンドゲートＡＮＤ８はマ
スタリセット信号ＭＲＳＴとＤフリップフロップＦＦ２
０の出力信号を論理積してＲＳフリップフロップＦＦ１
９に出力する。ＲＳフリップフロップＦＦ１９はアンド
ゲートＡＮＤ８の出力信号がローレベル状態を有すれ
ば、ローレベル信号をＤフリップフロップＦＦ２１Ｊの
入力端Ｄに出力する。フリップフロップＦＦ２１はクロ
ック信号に印加されるウィンドウタイミング信号ＷＴＩ
ＭＥに応じてローレベル状態を有する第３状態信号ＩＬ
ＳＹ３を出力する。ウィンドウ信号ＷＩＮＤＯＷのロー
レベル区間で検出同期信号ＳＹＮＣＤＥＴがハイレベル
状態なら、第３状態信号ＩＬＳＹはハイレベル状態を有
し、ウィンドウ信号ＷＩＮＤＯＷのハイレベル区間で検
出同期信号ＳＹＮＣＤＥＴがローレベル状態を有すれば
第３状態信号ＩＬＳＹはローレベル状態を有する。
【００４４】
【発明の効果】以上述べたように、本発明によれば、デ
ィスクから検出された同期信号にエラーが生じてそれが
異なったり、或は検出されない場合、内挿同期信号を発
生させデータを正確に再生でき、同期信号の検出状態を
判別して制御部に知らせてセクタ単位のデータ処理が容
易になる。
ィスクから検出された同期信号にエラーが生じてそれが
異なったり、或は検出されない場合、内挿同期信号を発
生させデータを正確に再生でき、同期信号の検出状態を
判別して制御部に知らせてセクタ単位のデータ処理が容
易になる。
【００４５】
【図１】１セクタに対するデータと、データ処理に用い
られるクロック、及び１セクタのデータから得られる検
出同期信号のタイミングを示す図である。
られるクロック、及び１セクタのデータから得られる検
出同期信号のタイミングを示す図である。
【図２】本発明の同期内挿回路を示したブロック構成図
である。
である。
【図３】図２の有効同期信号発生部の詳細回路図であ
る。
る。
【図４】図２のクリア信号発生部の詳細回路図である。
【図５】図２のカウンター部の詳細回路図である。
【図６】図２の内挿同期信号発生部の詳細回路図であ
る。
る。
【図７】図２のウィンドウ信号発生部の詳細回路図であ
る。
る。
【図８】本発明の同期状態検出回路を示したブロック図
である。
である。
【図９】図８の正常同期検出部の詳細回路図である。
【図１０】図８の第１異常同期検出部の詳細回路図であ
る。
る。
【図１１】図８の第２異常同期検出部の詳細回路図であ
る。
る。
【図１２】本発明の同期内挿回路及び同期状態検出回路
に関連した波形図である。
に関連した波形図である。
【図１３】本発明の同期内挿回路及び同期状態検出回路
に関連した波形図である。
に関連した波形図である。
１０ 有効同期信号発生部 ２０ クリア信号発生部 ３０ カウンター部 ４０ 内挿同期信号発生部 ５０ ウィンドウ信号発生部 ６０ 正常同期検出部 ７０ 第１異常同期検出部 ８０ 第２異常同期検出部 ＦＦ１〜ＦＦ２１ フリップフロップ ＣＮＴ１〜ＣＮＴ３ カウンター ＮＡＮＤ１〜ＮＡＮＤ１１ ナンドゲート ＡＮＤ１〜ＡＮＤ８ アンドゲート ＩＮＶ１〜ＩＮＶ１４ インバータ ＤＥＤ１〜ＤＣＤ４ デコーダ
Claims (16)
- 【請求項１】 セクタ単位にデータが記録されたディス
クから読み取られたデータをセクタ単位に再生のための
同期信号を発生する装置において、 ウィンドウ信号と前記ディスクから再生された検出同期
信号を受け、前記ウィンドウ信号に応じて定められるウ
ィンドウ区間内に前記検出同期信号が存すれば有効検出
同期信号を発生し、ウィンドウタイミング信号と内挿同
期信号を受けてウィンドウタイミング信号に応じて定め
られるウィンドウ区間内で前記内挿同期信号が検出同期
信号より先立つ場合は有効内挿同期信号を発生し、前記
有効内挿同期信号と前記有効検出同期信号を論理和して
有効同期信号を発生する有効同期信号発生部と、 前記有効同期信号発生部からの有効検出同期信号及び有
効内挿同期信号を受け、１セクタデータ間隔にカウンタ
ークリア信号を発生するクリア信号発生部と、 前記カウンタークリア信号を受け、ウィンドウタイミン
グ信号の予め設定された幅を定めるためのウィンドウタ
イミング立ち上がり信号及びウィンドウタイミング立ち
下がり信号を発生するカウンター部と、 ウィンドウタイミング立ち上がり信号及びウィンドウタ
イミング立ち下がり信号に応じてウィンドウタイミング
信号を発生し、前記ウィンドウタイミング立ち上がり信
号の受けた時点から予め設定された時間が経過した場合
に内挿同期信号を発生する内挿同期信号発生部と、 検出同期信号と内挿同期信号に応じてウィンドウロック
信号を発生し、ウィンドウタイミング信号を受け、前記
ウィンドウロック信号とウィンドウタイミング信号を論
理和してウィンドウ信号を発生するウィンドウ信号発生
部とを含む同期内挿回路。 - 【請求項２】 前記有効同期信号発生部は、 検出同期信号とウィンドウ信号を論理積として有効検出
同期信号を発生する第１アンドゲートと、 ウィンドウタイミング信号と内挿同期信号を否定論理積
する第１ナンドゲートと、 ウィンドウタイミング立ち上がり信号より１クロック先
立ちウィンドウタイミング以前立ち上がり信号を入力端
Ｊに、第１ナンドゲートの出力信号を反転入力端Ｋにそ
れぞれ入力されクロック信号のローエッジに同期させ出
力するＪＫフリップフロップと、 前記ＪＫフリップフロップの出力信号と内挿同期信号を
論理積して有効内挿同期信号を発生する第２アンドゲー
トと、 前記第１アンドゲートと第２アンドゲートの出力信号を
論理和して有効同期信号を発生する第１オアゲートを備
えることを特徴とする請求項１に記載の同期内挿回路。 - 【請求項３】 前記クリア信号発生部は、 有効内挿同期信号を入力されたクロック信号のローエッ
ジに同期させ出力する第１Ｄフリップフロップと、 前記第１Ｄフリップフロップの出力信号と反転された有
効内挿同期信号を否定論理積する第２ナンドゲートと、 有効検出同期信号を、入力されたクロック信号のローエ
ッジに同期させ出力する第２Ｄフリップフロップと、 前記第２Ｄフリップフロップの出力信号と反転された有
効検出同期信号を否定論理積する第３ナンドゲートと、 前記第２ナンドゲートと第３ナンドゲートの出力信号を
論理積してカウンタークリア信号を発生する第３アンド
ゲートとを備えることを特徴とする請求項１に記載のデ
ィスク再生装置の同期内挿回路。 - 【請求項４】 前記カウンター部は、 クロック信号をカウントし、前記カウンタークリア信号
に応じてリセットされる第１カウンターと、 前記第１カウンターの出力信号の値が第１設定値に達す
るかを検出する第１デコーダと、 前記第１カウンターの出力信号の値が第２設定値に達す
るかを検出する第２デコーダと、 前記第１カウンターの出力信号の値が第３設定値に達す
るかを検出する第３デコーダとを含むことを特徴とする
請求項１に記載の同期内挿回路。 - 【請求項５】 前記所定の設定された値は、前記内挿同
期信号の発生時点を中心とする所定の値と定められるこ
とを特徴とする請求項４に記載の同期内挿回路。 - 【請求項６】 前記内挿同期信号発生部は、 反転されたウィンドウタイミング立ち下がり信号とマス
タリセット信号を論理積する第４アンドゲートと、 ローレベルを有する反転されたウィンドウタイミング立
ち上がり信号に応じてセットされ、前記第４アンドゲー
トから出力されるローレベル信号に応じてリセットさ
れ、ウィンドウタイミング信号を発生する第１ＲＳフリ
ップフロップと、 前記ウィンドウタイミング信号とマスタリセット信号及
びクロック信号を入力し、ウィンドウタイミング信号の
立ち上がりエッジを検出する立ち上がりエッジ検出器
と、 前記立ち上がりエッジ検出器から出力されるローレベル
信号に応じてクリアされ、ウィンドウタイミング信号に
応じてイネーブルされる間クロック信号をカウントする
第２カウンターと、 前記第２カウンターの出力信号の値が第４設定値信号に
達するかを検出する第４デコーダとを含むことを特徴と
する請求項４に記載の同期内挿回路。 - 【請求項７】 前記立ち上がりエッジ検出器は、 前記ウィンドウタイミング信号を、入力されたクロック
信号のローエッジに同期させ出力する第３Ｄフリップフ
ロップと、 前記第３Ｄフリップフロップの出力信号を反転させる第
１インバータと、 ウィンドウタイミング信号と前記第１インバータの出力
信号を否定論理積する第４ナンドゲートと、 前記第４ナンドゲートの出力信号とマスタリセット信号
を論理積して第５アンドゲートとを備えることを特徴と
する請求項６に記載のディスク再生装置の同期内挿回
路。 - 【請求項８】 前記第４デコーダはウィンドウタイミン
グ信号の立ち上がりエッジから４８個のクロックが生ず
る瞬間を検出して出力信号を発生することを特徴とする
請求項７に記載の同期内挿回路。 - 【請求項９】 前記ウィンドウ信号発生部は、 内挿同期信号と検出同期信号を否定論理積する第５ナン
ドゲートと、 検出同期信号とウィンドウタイミング信号を否定論理積
する第６ナンドゲートと、 第６ナンドゲートの出力信号を、入力されたクロック信
号の立ち上がりエッジに同期させ出力する第４Ｄフリッ
プフロップと、 前記第４Ｄフリップフロップの出力信号のローレベルに
よりクリアされ、クロック信号をカウントして２ビット
信号を出力する第３カウンターと、 第３カウンターの出力信号が第５設定値の時を検出して
ローレベル信号を出力する第７ナンドゲートと、 前記第５ナンドゲートから出力されるローレベル信号に
応じてセットされ、前記第７ナンドゲートから出力され
るローレベル信号に応じてリセットされ、ウィンドウク
ロック信号を発生する第２ＲＳフリップフロップと、 前記ウィンドウクロック信号を反転させる第２インバー
タと、 前記第２インバータの出力信号とウィンドウタイミング
信号を論理和してウィンドウ信号を発生する第２オアゲ
ートを備えることを特徴とする請求項７に記載の同期内
挿回路。 - 【請求項１０】 トラックを有するディスクにセクタ単
位に記録されたデータを再生するための同期信号を発生
する装置において、 前記ディスクから再生された検出同期信号とウィンドウ
信号発生部からのウィンドウ信号を受け、前記ウィンド
ウ信号に応じて定められる第１ウィンドウ区間内に前記
検出同期信号が存すれば有効検出同期信号を発生し、ウ
ィンドウタイミング信号と内挿同期信号を受け、ウィン
ドウタイミング信号に応じて定められる第２ウィンドウ
区間内で前記内挿同期信号が検出同期信号より先立つ場
合は有効内挿同期信号を発生し、前記有効内挿同期信号
と前記有効検出同期信号を有効同期信号に出力する有効
同期信号発生部と、 前記有効同期信号発生部からの有効検出同期信号及び有
効内挿同期信号を受け、１セクタデータ間にカウンター
クリア信号を発生するクリア信号発生部と、 前記カウンタークリア信号を受け、ウィンドウタイミン
グ以前立ち上がり信号と、ウィンドウタイミング信号の
第２ウィンドウ区間を定めるためのウィンドウタイミン
グ立ち上がり信号及びウィンドウタイミング立ち下がり
信号を発生するカウンター部と、 前記ウィンドウタイミング立ち上がり信号及びウィンド
ウタイミング立ち下がり信号に応じてウィンドウタイミ
ング信号を発生し、前記ウィンドウタイミング立ち上が
り信号から予め設定された時間が経過した場合に内挿同
期信号を発生する内挿同期信号発生部と、 検出同期信号と内挿同期信号のタイミングを比較してウ
ィンドウロック信号を発生し、ウィンドウタイミング信
号を受け、前記ウィンドウロック信号とウィンドウタイ
ミング信号を論理和してウィンドウ信号を発生するウィ
ンドウ信号発生部と、 ウィンドウタイミング信号と内挿同期信号及び検出同期
信号を入力させ内挿同期信号と検出同期信号が一致する
かを示す第１状態信号を発生する正常同期検出部を含む
ことを特徴とする同期状態検出装置。 - 【請求項１１】 前記正常同期検出部は、 内挿同期信号と検出同期信号を否定論理積する第１ナン
ドゲートと、 ウィンドウタイミング信号とマスタリセット信号及びク
ロック信号を受け、ウィンドウタイミング信号の立ち上
がりエッジを検出する立ち上がりエッジ検出器と、 前記第１ナンドゲートから出力されるローレベル信号に
応じてセットされ、前記立ち上がりエッジ検出器から出
力されるローレベル信号に応じてリセットされる第１Ｒ
Ｓフリップフロップと、 前記第１ＲＳフリップフロップの出力信号を受け、ロー
レベル状態のウィンドウタイミング信号に同期させ第１
状態信号を出力する第１Ｄフリップフロップとを備える
ことを特徴とする請求項１０に記載の同期状態検出装
置。 - 【請求項１２】 前記立ち上がりエッジ検出器は、 前記ウィンドウタイミング信号を入力されクロック信号
のローエッジに同期させ出力する第２Ｄフリップフロッ
プと、 前記第２Ｄフリップフロップの出力信号を反転させる第
１インバータと、 ウィンドウタイミング信号と前記第１インバータの出力
信号を否定論理積する第２ナンドゲートとを備えること
を特徴とする請求項１１に記載の同期状態検出装置。 - 【請求項１３】 前記ウィンドウ信号とウィンドウタイ
ミング以前立ち上がり信号とウィンドウタイミング立ち
下がり信号及び検出同期信号を入力されウィンドウ信号
の第１ウィンドウ区間内に検出同期信号が存しないこと
を示す第２状態信号を発生する第１異常同期信号検出を
更に含むことを特徴とする請求項１０に記載の同期状態
検出装置。 - 【請求項１４】 前記第１異常同期検出部は、 反転されたウィンドウタイミング以前立ち上がり信号と
マスタリセット信号を論理積する第１アンドゲートと、 検出同期信号とウィンドウ信号を否定論理積して出力す
る第３ナンドゲートと、 前記第３ナンドゲートの出力信号を入力し、クロック信
号のローエッジに同期させ出力する第３Ｄフリップフロ
ップと、 前記第１アンドゲートから出力されるローレベル信号に
応じてセットされ、前記第３Ｄフリップフロップから出
力されるローレベル信号に応じてリセットされる第２Ｒ
Ｓフリップフロップと、 前記第２ＲＳフリップフロップの出力信号をウィンドウ
タイミング立ち下がりエッジ信号の立ち上がりエッジに
同期させ出力する第４Ｄフリップフロップとを備えるこ
とを特徴とする請求項１３に記載の同期状態検出装置。 - 【請求項１５】 ウィンドウ信号とウィンドウタイミン
グ信号とウィンドウタイミング立ち上がり信号及び検出
同期信号を入力されウィンドウ信号の第１ウィンドウ区
間の外に検出同期信号が存していることを示す第３状態
信号を発生する第２異常同期検出部を更に備えることを
特徴とする請求項１０に記載の同期状態検出装置。 - 【請求項１６】 前記第２異常同期検出部は、 検出同期信号と反転したウィンドウ信号を否定論理積す
る第４ナンドゲートと、 前記第４ナンドゲートの出力信号を入力し、クロック信
号のローエッジに同期させ出力する第５Ｄフリップフロ
ップと、 反転されたウィンドウタイミング立ち上がり信号を入力
し、クロック信号のローエッジに同期させ出力する第６
Ｄフリップフロップと、 前記第６Ｄフリップフロップの出力信号とマスタリセッ
ト信号を論理積する第２アンドゲートと、 前記第５Ｄフリップフロップから出力されるローレベル
信号に応じてセットされ、前記第２アンドゲートから出
力されるローレベル信号に応じてリセットされる第２Ｒ
Ｓフリップフロップと、 前記第２ＲＳフリップフロップの出力信号を入力し、ウ
ィンドウタイミング信号のローエッジに同期させ第３状
態信号を出力する第７Ｄフリップフロップとを備えるこ
とを特徴とする請求項１５に記載の同期状態検出装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR93-19587 | 1993-09-24 | ||
| KR1019930019587A KR0157585B1 (ko) | 1993-09-24 | 1993-09-24 | 디스크재생장치의 동기내삽회로 및 동기상태검출회로 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07176151A JPH07176151A (ja) | 1995-07-14 |
| JP2875957B2 true JP2875957B2 (ja) | 1999-03-31 |
Family
ID=19364494
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6229642A Expired - Lifetime JP2875957B2 (ja) | 1993-09-24 | 1994-09-26 | ディスク再生装置の同期内挿及び同期状態検出装置 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5517513A (ja) |
| JP (1) | JP2875957B2 (ja) |
| KR (1) | KR0157585B1 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6536011B1 (en) * | 1998-10-22 | 2003-03-18 | Oak Technology, Inc. | Enabling accurate demodulation of a DVD bit stream using devices including a SYNC window generator controlled by a read channel bit counter |
| JP2000252951A (ja) * | 1999-03-01 | 2000-09-14 | Sony Corp | 同期信号検出方法及び無線通信装置 |
| KR100910553B1 (ko) * | 2008-03-26 | 2009-08-03 | 주식회사 텔레칩스 | 싱크 에러가 포함된 데이터 ｃｄ 판독 방법 |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4453260A (en) * | 1982-06-15 | 1984-06-05 | Tokyo Shibaura Denki Kabushiki Kaisha | Synchronizing circuit for detecting and interpolating sync signals contained in digital signal |
| JPH0644818B2 (ja) * | 1984-04-13 | 1994-06-08 | 日本電信電話株式会社 | 表示装置 |
| GB2187067B (en) * | 1986-02-21 | 1989-11-29 | Fuji Xerox Co Ltd | Stellate store and broadcast network with collision avoidance |
| JP2811802B2 (ja) * | 1989-09-20 | 1998-10-15 | ソニー株式会社 | 情報伝送装置 |
| US5406569A (en) * | 1991-10-31 | 1995-04-11 | Sony Corporation | Error correcting apparatus for digital data and digital synchronizing detecting apparatus |
-
1993
- 1993-09-24 KR KR1019930019587A patent/KR0157585B1/ko not_active IP Right Cessation
-
1994
- 1994-09-26 US US08/311,855 patent/US5517513A/en not_active Expired - Lifetime
- 1994-09-26 JP JP6229642A patent/JP2875957B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| US5517513A (en) | 1996-05-14 |
| KR0157585B1 (ko) | 1998-12-15 |
| JPH07176151A (ja) | 1995-07-14 |
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