JP2572445B2 - 輪郭補正回路 - Google Patents
輪郭補正回路Info
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- JP2572445B2 JP2572445B2 JP1141145A JP14114589A JP2572445B2 JP 2572445 B2 JP2572445 B2 JP 2572445B2 JP 1141145 A JP1141145 A JP 1141145A JP 14114589 A JP14114589 A JP 14114589A JP 2572445 B2 JP2572445 B2 JP 2572445B2
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Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は映像信号の輪郭補正に係り、特に輪郭部の信
号変化を検出して、変化部分を補正信号と置換すること
により、簡単な構成で良好な補正効果を得るようにした
輪郭補正回路に関する。
号変化を検出して、変化部分を補正信号と置換すること
により、簡単な構成で良好な補正効果を得るようにした
輪郭補正回路に関する。
［従来の技術］ 色信号低域変換方式のVTR（ビデオテープレコーダ
ー）では、色信号の帯域は500KHzに制限され、輝度信号
の帯域（数MHz）に比べ著しく低い。そのため、映像の
輪郭部で色のぼけやにじみが目立つ。この問題を解決す
るためには、輪郭部の信号の変化を急峻にし輪郭補正を
かける必要がある。
ー）では、色信号の帯域は500KHzに制限され、輝度信号
の帯域（数MHz）に比べ著しく低い。そのため、映像の
輪郭部で色のぼけやにじみが目立つ。この問題を解決す
るためには、輪郭部の信号の変化を急峻にし輪郭補正を
かける必要がある。
この種の輪郭補正に係る米国特許第4,030,121号明細
書に記載の従来技術では、入力信号の１次微分成分と２
次微分成分を乗算した結果から補正信号を生成し、入力
信号に加算することにより輪郭補正を行なつている。
書に記載の従来技術では、入力信号の１次微分成分と２
次微分成分を乗算した結果から補正信号を生成し、入力
信号に加算することにより輪郭補正を行なつている。
［発明が解決しようとする課題］ 上記従来技術の補正方法によれば輪郭部の波形のなま
りは大幅に改善される。しかし、上記方法では、１次微
分信号をもとに近似的な補正信号を生成しているため
に、エツジ部では波形のなまりが残るという問題があつ
た。
りは大幅に改善される。しかし、上記方法では、１次微
分信号をもとに近似的な補正信号を生成しているため
に、エツジ部では波形のなまりが残るという問題があつ
た。
また、上記従来技術には、１次微分信号に演算処理を
施すことにより、より正確な補正信号を生成して上記問
題点を解決する手段も示されているが、この方法は回路
規模、コストの増大という問題を持つている。
施すことにより、より正確な補正信号を生成して上記問
題点を解決する手段も示されているが、この方法は回路
規模、コストの増大という問題を持つている。
本発明の目的は、簡易な構成で良好な補正効果を得ら
れる輪郭補正回路を提供することにある。
れる輪郭補正回路を提供することにある。
［課題を解決するための手段］ 上記目的は、映像信号をデイジタル化、１次微分（差
分）、絶対値及び２次微分を求める回路と、デイジタル
信号を一時記憶する手段とを設け、映像信号の輪郭部の
信号変化を検出し、変化時の信号を変化の前後の信号に
置き換える構成とすることにより達成される。
分）、絶対値及び２次微分を求める回路と、デイジタル
信号を一時記憶する手段とを設け、映像信号の輪郭部の
信号変化を検出し、変化時の信号を変化の前後の信号に
置き換える構成とすることにより達成される。
［作用］ 映像信号の１次微分の絶対値をとり、さらに２次微分
をとることによつて、映像信号の変化期間、即ち輪郭部
が求まる。２次微分信号が正の期間の信号を変化が始ま
る直前の値に置き換え、同じく負の期間は変化終了後の
値に置き換える。これにより、輪郭部の信号はパルス状
に急峻に変化するので、色のぼけ、にじみを改善する輪
郭補正効果が得られる。
をとることによつて、映像信号の変化期間、即ち輪郭部
が求まる。２次微分信号が正の期間の信号を変化が始ま
る直前の値に置き換え、同じく負の期間は変化終了後の
値に置き換える。これにより、輪郭部の信号はパルス状
に急峻に変化するので、色のぼけ、にじみを改善する輪
郭補正効果が得られる。
［実施例］ 以下、本発明の実施例を図面を参照して説明する。
第１図は本発明の第１の実施例のブロツク図であつ
て、１はA/D変換器、2,4は微分（差分）回路、３は絶対
値化回路、５は波形整形回路、６はメモリ、７はメモリ
６の書き込みを制御するパルスを生成する書き込み制御
パルス発生回路、８は同じく読み出しを制御するパルス
を生成する読み出し制御パルス発生回路、９はD/A変換
器、10はアナログ入力端子、11はアナログ出力端子、12
は遅延回路である。
て、１はA/D変換器、2,4は微分（差分）回路、３は絶対
値化回路、５は波形整形回路、６はメモリ、７はメモリ
６の書き込みを制御するパルスを生成する書き込み制御
パルス発生回路、８は同じく読み出しを制御するパルス
を生成する読み出し制御パルス発生回路、９はD/A変換
器、10はアナログ入力端子、11はアナログ出力端子、12
は遅延回路である。
第２図は本実施例の動作波形図であり、Ａ〜Ｆの各波
形は第１図のＡ〜Ｆの各点の波形を示す。
形は第１図のＡ〜Ｆの各点の波形を示す。
第１図、第２図において、アナログ入力端子10から入
力した映像信号入力Ａを微分回路２で微分し、その絶対
値をとるとＢに示す波形が得られる。さらにこの変形Ｂ
を微分回路４で微分するとＣの波形となる。この波形Ｃ
は映像の輪郭分のうち、その信号の変化開始点から輪郭
部の中央まで（変位の前）で正の値を、また中央から変
化の終了点まで（変位の後）負の値を持つものである。
この信号は波形Ｃに点線で示す所定の閾値と比較する。
これは、２次微分信号の変化が輪郭によつて発生したも
のか、雑音によるものかを判別し、雑音の影響を除くた
めである。
力した映像信号入力Ａを微分回路２で微分し、その絶対
値をとるとＢに示す波形が得られる。さらにこの変形Ｂ
を微分回路４で微分するとＣの波形となる。この波形Ｃ
は映像の輪郭分のうち、その信号の変化開始点から輪郭
部の中央まで（変位の前）で正の値を、また中央から変
化の終了点まで（変位の後）負の値を持つものである。
この信号は波形Ｃに点線で示す所定の閾値と比較する。
これは、２次微分信号の変化が輪郭によつて発生したも
のか、雑音によるものかを判別し、雑音の影響を除くた
めである。
波形Ｃを、波形成形回路５を通して生形し（検波し）
て、検出信号波形D,Eを得、これら正の値を波形Ｄと負
の値の波形Ｅとから輪郭部と判別されたら、輪郭の位
置、幅を符号化し、輪郭検出情報として、遅延回路12か
らの映像信号とともにメモリ６に記録する。上記の符号
化は、例えば、輪郭検出信号波形Ｄ及びＥが立ち上るタ
イミングと、波形D,Eのそれぞれのパルスがハイレベル
にある期間のクロツク数として符号化する。遅延回路12
は、輪郭検出信号と映像信号の位相合せを行なう。
て、検出信号波形D,Eを得、これら正の値を波形Ｄと負
の値の波形Ｅとから輪郭部と判別されたら、輪郭の位
置、幅を符号化し、輪郭検出情報として、遅延回路12か
らの映像信号とともにメモリ６に記録する。上記の符号
化は、例えば、輪郭検出信号波形Ｄ及びＥが立ち上るタ
イミングと、波形D,Eのそれぞれのパルスがハイレベル
にある期間のクロツク数として符号化する。遅延回路12
は、輪郭検出信号と映像信号の位相合せを行なう。
読み出し側では、上記輪郭検出情報をもとに読み出し
アドレスの制御を行なう。通常は読み出しアドレスを順
次１づつ加算するが、２次微分が正でありその期間がｎ
クロツク分（n:整数）という情報が出力されたらｎクロ
ツクの間、その直前のアドレスを保持する。また、２次
微分が負でありその期間がｍクロツク分（m:整数）とい
う情報が出力されたら、現アドレスにｍを加算したアド
レスをｍクロツクの期間出力する。
アドレスの制御を行なう。通常は読み出しアドレスを順
次１づつ加算するが、２次微分が正でありその期間がｎ
クロツク分（n:整数）という情報が出力されたらｎクロ
ツクの間、その直前のアドレスを保持する。また、２次
微分が負でありその期間がｍクロツク分（m:整数）とい
う情報が出力されたら、現アドレスにｍを加算したアド
レスをｍクロツクの期間出力する。
なお、第１図では、輪郭部の検出をアナログ信号処理
より行うように示しているが、A/D変換回路１を通した
映像信号を用いてデジタル処理する構成とすることもで
きる。
より行うように示しているが、A/D変換回路１を通した
映像信号を用いてデジタル処理する構成とすることもで
きる。
以上の操作により、メモリ６から読み出される信号
は、Ｆに示すような信号となる。つまり、輪郭部で信号
が変化を始めたら、開始直前の値を保持し、変曲点（２
次微分が０となる点）以後は変化終了後の値に置きかえ
る。第２図中、波形Ａの（・）と波形Ｆ（・，○，△）
は対応する画素を示す。
は、Ｆに示すような信号となる。つまり、輪郭部で信号
が変化を始めたら、開始直前の値を保持し、変曲点（２
次微分が０となる点）以後は変化終了後の値に置きかえ
る。第２図中、波形Ａの（・）と波形Ｆ（・，○，△）
は対応する画素を示す。
これにより、輪郭部の信号変化はパルス状の急峻な変
化となり、かつ輪郭部前後にプリシユート等の波形変動
は生じず、良好な輪郭補正を行なうことができる。
化となり、かつ輪郭部前後にプリシユート等の波形変動
は生じず、良好な輪郭補正を行なうことができる。
本発明の本質は、輪郭部の信号をその前後の信号で置
換することにあり、メモリに書き込む輪郭情報、メモリ
読み出し方法は必ずしも上記手段には限られず、同様な
効果が得られれば他の方法でもかまわない。
換することにあり、メモリに書き込む輪郭情報、メモリ
読み出し方法は必ずしも上記手段には限られず、同様な
効果が得られれば他の方法でもかまわない。
また、本実施例では入力信号自身から輪郭情報を抽出
しているが、RGB信号（R:赤色信号、G:緑色信号、B:青
色信号）、輝度信号（Ｙ）と色差信号（Ｒ−Y,B−Ｙ）
等のコンポーネント映像信号を取り扱う では、他の信
号の輪郭情報を用いてもよいし、自分自身と他の信号の
両者の検出信号を併用してもよい。
しているが、RGB信号（R:赤色信号、G:緑色信号、B:青
色信号）、輝度信号（Ｙ）と色差信号（Ｒ−Y,B−Ｙ）
等のコンポーネント映像信号を取り扱う では、他の信
号の輪郭情報を用いてもよいし、自分自身と他の信号の
両者の検出信号を併用してもよい。
第３図は本発明の第２図の実施例を説明するブロツク
図であつて、81〜83はデータ値を一時保持するデータホ
ールド回路（例えばＤフリツプフロツプ）、84〜86は１
水平走査期間（1H）分のデータを記憶する記憶手段（メ
モリ）、87〜91はマルチプレクサ（スイツチ）、92は遅
延回路、93は上記メモリ及びスイツチを制御する信号を
生成するメモリスイツチコントローラである。図中メモ
リコントローラ93からの信号線は省略した。
図であつて、81〜83はデータ値を一時保持するデータホ
ールド回路（例えばＤフリツプフロツプ）、84〜86は１
水平走査期間（1H）分のデータを記憶する記憶手段（メ
モリ）、87〜91はマルチプレクサ（スイツチ）、92は遅
延回路、93は上記メモリ及びスイツチを制御する信号を
生成するメモリスイツチコントローラである。図中メモ
リコントローラ93からの信号線は省略した。
第４図は第２図に示した実施例の動作波形図、第５図
はメモリの入出力を説明する模式図である。
はメモリの入出力を説明する模式図である。
以下、第４図、第５図を用いて第３図の動作の詳細を
説明する。
説明する。
微分回路2,4及び絶対値回路３、波形整形回路５によ
り、先の実施例に示したごとく入力信号Ａの２次微分が
正となる期間を示すパルスＢ（S1）、同じく負となる期
間を示すパルスＣ（S2）を得る。
り、先の実施例に示したごとく入力信号Ａの２次微分が
正となる期間を示すパルスＢ（S1）、同じく負となる期
間を示すパルスＣ（S2）を得る。
マルチプレクサ（スイツチ）87は１水平走査（以下ラ
インと略す）毎に端子a,b,cを順次選択する。メモリA,
B,C84〜86は3Hで１サイクル分の、またそれぞれ1Hづつ
ずれた動作を行なうので、以下メモリA84の動作につい
てのみ説明する。
インと略す）毎に端子a,b,cを順次選択する。メモリA,
B,C84〜86は3Hで１サイクル分の、またそれぞれ1Hづつ
ずれた動作を行なうので、以下メモリA84の動作につい
てのみ説明する。
まず、マルチプレクサ87が端子ａを選択した時にマル
チプレクサ88は端子ｂを選択する。これに連動してデー
タホールド回路81はパルスＢ（S1）を受けつける。マル
チプレクサ87,88が上記状態でなければパルスS1は受け
つけない。パルスS1がハイレベル（以下ハイと略す）の
時には、このパルスS1がハイとなる直前のデータを保持
する。これにより、データホールド回路出力、即ちメモ
リA84の入力信号Ｗは第４図Ｄに示すものとなる。この
時、同時にパルスＣ（S2）も書き込む。
チプレクサ88は端子ｂを選択する。これに連動してデー
タホールド回路81はパルスＢ（S1）を受けつける。マル
チプレクサ87,88が上記状態でなければパルスS1は受け
つけない。パルスS1がハイレベル（以下ハイと略す）の
時には、このパルスS1がハイとなる直前のデータを保持
する。これにより、データホールド回路出力、即ちメモ
リA84の入力信号Ｗは第４図Ｄに示すものとなる。この
時、同時にパルスＣ（S2）も書き込む。
次のラインでは、マルチプレクサ88は端子ａを選択
し、メモリA84の出力を選択する。また、この期間、メ
モリA84の書き込みと時間的に逆方向に読み出す。これ
は、ランダムアクセス可能なメモリを用いれば容易に実
現できる。同時に、先に書き込んだパルスＣ（S2）を読
み出し、データホールド回路81に入力する。データホー
ルド回路81では、パルスS2がハイの期間、このハイとな
る直前の値を保持する。これによりデータホールド回路
出力は、第４図Ｅ（Ｒ′Ｗ′）に示すものとなり、これ
を再びメモリA84に書き込む。従つてこの操作中は、見
かけ上、読み出しと書き込みを同時に行なつている。
し、メモリA84の出力を選択する。また、この期間、メ
モリA84の書き込みと時間的に逆方向に読み出す。これ
は、ランダムアクセス可能なメモリを用いれば容易に実
現できる。同時に、先に書き込んだパルスＣ（S2）を読
み出し、データホールド回路81に入力する。データホー
ルド回路81では、パルスS2がハイの期間、このハイとな
る直前の値を保持する。これによりデータホールド回路
出力は、第４図Ｅ（Ｒ′Ｗ′）に示すものとなり、これ
を再びメモリA84に書き込む。従つてこの操作中は、見
かけ上、読み出しと書き込みを同時に行なつている。
上記操作を１ライン分行なつた後に、メモリA84から
順方向に読み出す。この時マルチプレクサ91は端子ａを
選択し、上記信号が出力された。
順方向に読み出す。この時マルチプレクサ91は端子ａを
選択し、上記信号が出力された。
以上の操作により、信号の輪郭部では、その２次微分
信号が０となる点を変化点としてパルス状に変化し、入
力信号の輪郭補正を行なうことができる。
信号が０となる点を変化点としてパルス状に変化し、入
力信号の輪郭補正を行なうことができる。
尚、遅延回路92は、輪郭情報を持つ、パルスS1,S2と
データホールド回路の入力信号のタイミングを合わすも
のである。
データホールド回路の入力信号のタイミングを合わすも
のである。
次に、1HメモリA,B,Cの切替について説明する。
先に述べたように、本動作は、メモリへの書き込み
（Ｗ）、逆方向読み出し（Ｒ′）書き込み（Ｗ′）、読
み出し（Ｒ）それぞれ1Hづつ計3Hで１サイクル終了す
る。
（Ｗ）、逆方向読み出し（Ｒ′）書き込み（Ｗ′）、読
み出し（Ｒ）それぞれ1Hづつ計3Hで１サイクル終了す
る。
各メモリの動作を第５図に示す。同図において、R,W,
R′,W′は前記のもの、ｎは信号のライン数を示す。図
に示す操作により、輪郭補正した信号を欠落することな
く出力できる。
R′,W′は前記のもの、ｎは信号のライン数を示す。図
に示す操作により、輪郭補正した信号を欠落することな
く出力できる。
本実施例では、メモリ容量は3H分でよく、小規模な回
路で完全な輪郭補正を行なうことができる。
路で完全な輪郭補正を行なうことができる。
第６図は本発明の第３の実施例の説明図、第７図は第
６図の動作波形図であつて、本実施例は第２の実施例で
示したデータホールド回路81を巡回形構成のフイルタに
置き換えたものである。第６図において、100は係数乗
算器でその係数は１−Ｋ（０≦Ｋ≦１）,101も同じく係
数乗算器でその係数はK,102は加算器、103は遅延回路で
例えばＤフリツプフロツプである。
６図の動作波形図であつて、本実施例は第２の実施例で
示したデータホールド回路81を巡回形構成のフイルタに
置き換えたものである。第６図において、100は係数乗
算器でその係数は１−Ｋ（０≦Ｋ≦１）,101も同じく係
数乗算器でその係数はK,102は加算器、103は遅延回路で
例えばＤフリツプフロツプである。
本実施例の動作は基本的には前記の第２の実施例と同
じであるが、データの置換方法が異なる。乗算器100,10
1の係数に含まれるＫは、前記のパルスS1あるいはS2が
ローレベルの時は、Ｋ＝０である。ハイレベルの時、Ｋ
は所定の値（Ｋ≦１）をとる。これにより、第７図に示
すようにＫ＝１の場合には第２の実施例と同様にパルス
状に変化する。Ｋの値を小さくすると、例えば図示のよ
うにＫ＝0.76とすると、変化は緩やかになり、Ｋ＝０に
近づくにつれて入力信号の波形に近づく。
じであるが、データの置換方法が異なる。乗算器100,10
1の係数に含まれるＫは、前記のパルスS1あるいはS2が
ローレベルの時は、Ｋ＝０である。ハイレベルの時、Ｋ
は所定の値（Ｋ≦１）をとる。これにより、第７図に示
すようにＫ＝１の場合には第２の実施例と同様にパルス
状に変化する。Ｋの値を小さくすると、例えば図示のよ
うにＫ＝0.76とすると、変化は緩やかになり、Ｋ＝０に
近づくにつれて入力信号の波形に近づく。
本実施例は、係数Ｋの値を適当に選ぶことにより、輪
郭部の信号変化を急峻なものから、緩やかなものにまで
自由に可変できる特徴をもつ。
郭部の信号変化を急峻なものから、緩やかなものにまで
自由に可変できる特徴をもつ。
次に、本発明の第４の実施例を説明する。
本発明は、輪郭部の信号データを輪郭部直前、直後の
データで置換することにより輪郭補正を行なうものであ
るが、輪郭部直後のデータは、現信号に対して未来の情
報であり、また輪郭部の波形広がりは必ずしも一定では
なく、現信号に対してどれだけ先の信号を置換すればよ
いか一義的には定められない。そこで先の実施例では、
１ライン分の信号を一担記憶し、未来の情報を得た上で
置換処理を行なつていた。従つてどのような信号に対し
ても完全に補正効果が得られる反面、メモリを必要とす
るという問題があつた。
データで置換することにより輪郭補正を行なうものであ
るが、輪郭部直後のデータは、現信号に対して未来の情
報であり、また輪郭部の波形広がりは必ずしも一定では
なく、現信号に対してどれだけ先の信号を置換すればよ
いか一義的には定められない。そこで先の実施例では、
１ライン分の信号を一担記憶し、未来の情報を得た上で
置換処理を行なつていた。従つてどのような信号に対し
ても完全に補正効果が得られる反面、メモリを必要とす
るという問題があつた。
本実施例では、補正範囲を限定することにより未来の
情報をメモリを用いずにシフトレジスタ、フリツプフロ
ツプ等による遅延で得るようにしたものである。
情報をメモリを用いずにシフトレジスタ、フリツプフロ
ツプ等による遅延で得るようにしたものである。
第８図は本発明の第４実施例を説明するブロツク図で
あつて、41は信号を最大ｎビツト遅延させる遅延素子、
例えばシフトレジスタであり、ｎビツト以下の任意の遅
延がとれるタツプ付のものである。42,44はデータホー
ルド回路、43,45はマルチプレクサ、46は信号をｎビツ
ト遅延する遅延素子、47はセツトリセツトフリツプフロ
ツプ、48はAND回路である。
あつて、41は信号を最大ｎビツト遅延させる遅延素子、
例えばシフトレジスタであり、ｎビツト以下の任意の遅
延がとれるタツプ付のものである。42,44はデータホー
ルド回路、43,45はマルチプレクサ、46は信号をｎビツ
ト遅延する遅延素子、47はセツトリセツトフリツプフロ
ツプ、48はAND回路である。
また第９図は本実施例のパルスタイミングを示す波形
図であり、Ａ〜Ｊは第８図のＡ〜Ｊの各点に対応する。
図であり、Ａ〜Ｊは第８図のＡ〜Ｊの各点に対応する。
以下、本実施例の動作を説明する。
信号S1,S2は第１の実施例で示したものと同じであ
り、S1は２次微分信号が正となる期間ハイになる信号、
S2は同じく負となる期間ハイになる信号である。S1はｎ
ビツト遅延したものがパルスＣである。S1とパルスＣを
セツトリセツトフリツプフロツプ47に入力し、S1の立ち
下りでセツト、パルスＣの立ち下りでリセツトするとパ
ルス幅がｎビツトのパクスＦを得る。パルスＦとパルス
ＣのAND（論理積）をとることにより、S1のパルス幅が
ｎビツト以下であればパルス幅はS1と同じで、ｎビツト
以上であればパルス幅はｎビツトに制限されたパクスＨ
を得る。S2もS1と同様で、最大パルス幅をｎビツトに制
限されたパルスＩを得る。即ちパルスH,IはS1,S2をｎビ
ツト遅延しかつ、パルス幅を最大ｎビツトに制限したも
のになる。またカウンタ49は、パルスS2のハイレベル期
間をカウントするものである。
り、S1は２次微分信号が正となる期間ハイになる信号、
S2は同じく負となる期間ハイになる信号である。S1はｎ
ビツト遅延したものがパルスＣである。S1とパルスＣを
セツトリセツトフリツプフロツプ47に入力し、S1の立ち
下りでセツト、パルスＣの立ち下りでリセツトするとパ
ルス幅がｎビツトのパクスＦを得る。パルスＦとパルス
ＣのAND（論理積）をとることにより、S1のパルス幅が
ｎビツト以下であればパルス幅はS1と同じで、ｎビツト
以上であればパルス幅はｎビツトに制限されたパクスＨ
を得る。S2もS1と同様で、最大パルス幅をｎビツトに制
限されたパルスＩを得る。即ちパルスH,IはS1,S2をｎビ
ツト遅延しかつ、パルス幅を最大ｎビツトに制限したも
のになる。またカウンタ49は、パルスS2のハイレベル期
間をカウントするものである。
入力映像信号は、輪郭情報S1,S2との位相を遅延回路9
2で合わせる（波形Ｊ）。これをシフトレジスタ41でｎ
ビツト遅延すると波形Ｋに点数で示す波形となる。とこ
ろで、前記のパルスＨをデータホールド回路42に入力
し、パルスＨがハイの期間はその前の値を保持する。ま
た、パルスＩをデータホールド回路44、マルチプレクサ
45に入力し、パルスＩがハイの期間はその前の値を保持
しかつマルチプレクサはこの間データホールド回路44の
出力を選択する。マルチプレクサ43は前記のカウンタ49
のカウント値をｍとすると、（ｎ−ｍ）ビツト遅延した
信号を選択する。かかくマルチプレクサ43の動作による
と、パルスS2のハイレベル期間でカウンタ49がｋ個まで
カウントするとした場合（即ち、このパルスS2がｋビッ
トの長さとした場合）、カウント49のカウント値が０の
パルスS2（第９図Ｂ）の開始時点では、シフトレジスタ
41のｎ端子が選択されて、入力映像信号ＪでのパルスS2
の開始時点よりもｎビット前の信号がｎビット遅延され
て得られ、カウンタ49のカウント値が１のパルスS2（第
９図Ｂ）の開始時点よりも１ビット後の時点では、シフ
トレジスタ41の（ｎ−１）端子が選択されて、入力映像
信号ＪでのパルスS2の開始時点よりも（ｎ−２）ビット
前の信号が（ｎ−１）ビット遅延されて得られ、以下、
カウンタ49のカウント値が２になると、シフトレジスタ
41の（ｎ−２）端子が選択されて、入力映像信号Ｊでの
パルスS2の開始時点よりも（ｎ−４）ビット前の信号が
（ｎ−２）ビット遅延されて得られ、……、カウンタ49
のカウント値が最後のｋになると、シフトレジスタ41の
（ｎ−ｋ）端子が選択されて、入力映像信号Ｊでのパル
スS2の開始時点よりも（ｎ−2k）ビット前の信号が（ｎ
−ｋ）ビット遅延されて得られる。
2で合わせる（波形Ｊ）。これをシフトレジスタ41でｎ
ビツト遅延すると波形Ｋに点数で示す波形となる。とこ
ろで、前記のパルスＨをデータホールド回路42に入力
し、パルスＨがハイの期間はその前の値を保持する。ま
た、パルスＩをデータホールド回路44、マルチプレクサ
45に入力し、パルスＩがハイの期間はその前の値を保持
しかつマルチプレクサはこの間データホールド回路44の
出力を選択する。マルチプレクサ43は前記のカウンタ49
のカウント値をｍとすると、（ｎ−ｍ）ビツト遅延した
信号を選択する。かかくマルチプレクサ43の動作による
と、パルスS2のハイレベル期間でカウンタ49がｋ個まで
カウントするとした場合（即ち、このパルスS2がｋビッ
トの長さとした場合）、カウント49のカウント値が０の
パルスS2（第９図Ｂ）の開始時点では、シフトレジスタ
41のｎ端子が選択されて、入力映像信号ＪでのパルスS2
の開始時点よりもｎビット前の信号がｎビット遅延され
て得られ、カウンタ49のカウント値が１のパルスS2（第
９図Ｂ）の開始時点よりも１ビット後の時点では、シフ
トレジスタ41の（ｎ−１）端子が選択されて、入力映像
信号ＪでのパルスS2の開始時点よりも（ｎ−２）ビット
前の信号が（ｎ−１）ビット遅延されて得られ、以下、
カウンタ49のカウント値が２になると、シフトレジスタ
41の（ｎ−２）端子が選択されて、入力映像信号Ｊでの
パルスS2の開始時点よりも（ｎ−４）ビット前の信号が
（ｎ−２）ビット遅延されて得られ、……、カウンタ49
のカウント値が最後のｋになると、シフトレジスタ41の
（ｎ−ｋ）端子が選択されて、入力映像信号Ｊでのパル
スS2の開始時点よりも（ｎ−2k）ビット前の信号が（ｎ
−ｋ）ビット遅延されて得られる。
つまり、シフトレジスタ41のマルチプレクサ43とが、
カウンタ49のカウント値に応じて遅延時間がｎビット分
から１ビット分ずつ小さくなるように変化する可変遅延
手段を構成し、これにより、入力映像信号ＪのパクスS
1,S2の変位期間全体をパルスS2の期間内内に読み取るこ
とになり、これにより、入力映像信号Ｊでの変位期間が
パルスS2の期間内に時間軸圧縮されたものとなる。
カウンタ49のカウント値に応じて遅延時間がｎビット分
から１ビット分ずつ小さくなるように変化する可変遅延
手段を構成し、これにより、入力映像信号ＪのパクスS
1,S2の変位期間全体をパルスS2の期間内内に読み取るこ
とになり、これにより、入力映像信号Ｊでの変位期間が
パルスS2の期間内に時間軸圧縮されたものとなる。
以上の動作により、マルチプレクサ45の出力は、波形
Ｋに実線で示すものとなり、前記の第１の実施例と同様
の輪郭補正効果を得る。しかもメモリを用いないので回
路規模を小さくすることができる。
Ｋに実線で示すものとなり、前記の第１の実施例と同様
の輪郭補正効果を得る。しかもメモリを用いないので回
路規模を小さくすることができる。
第10図は本発明の第５の実施例を説明するブロツク図
であつて、51,52はデータホールド回路で、前記実施例
のものと同じである。53は減算器、54は加算器である。
またS1,S2は前記の信号の輪郭部を示すパルスである。
第11図は第10図に示した実施例の動作波形図であり、Ａ
〜Ｈの各波形は第10図Ａ〜Ｈの各点の波形である。
であつて、51,52はデータホールド回路で、前記実施例
のものと同じである。53は減算器、54は加算器である。
またS1,S2は前記の信号の輪郭部を示すパルスである。
第11図は第10図に示した実施例の動作波形図であり、Ａ
〜Ｈの各波形は第10図Ａ〜Ｈの各点の波形である。
第10図、第11図において、パルスＢ（S1）がハイの期
間、データホールド回路51は直前の値を保持するので、
その出力は波形Ｄのようになる。この出力Ｄと現信号Ａ
の差をとると信号Ｅが得られ、さらに現信号Ａを加えた
ものが信号Ｆである。ところで、パルスＢの立ち下り点
は入力２次分信号が０となる所、すなわち信号の変曲点
を表すが、信号変化が変曲点を中心に対象と仮定し、入
力信号の信号変位をａとすると、信号Ｅは変曲点でa/
2、信号Ｆは同じくａの振巾を持つことになる。データ
ホールド回路52はパルスＣ（S2）がハイの期間、その直
前の加算器出力を保持するから、振巾ａ即ち輪郭部の変
化後の値を保持することになる。また、マルチプレクサ
８は、S2がハイの期間データホールド回路52の出力を選
択すれば、マルチプレクサ８の出力は、波形Ｈに示すよ
うに輪郭を補正したものになる。
間、データホールド回路51は直前の値を保持するので、
その出力は波形Ｄのようになる。この出力Ｄと現信号Ａ
の差をとると信号Ｅが得られ、さらに現信号Ａを加えた
ものが信号Ｆである。ところで、パルスＢの立ち下り点
は入力２次分信号が０となる所、すなわち信号の変曲点
を表すが、信号変化が変曲点を中心に対象と仮定し、入
力信号の信号変位をａとすると、信号Ｅは変曲点でa/
2、信号Ｆは同じくａの振巾を持つことになる。データ
ホールド回路52はパルスＣ（S2）がハイの期間、その直
前の加算器出力を保持するから、振巾ａ即ち輪郭部の変
化後の値を保持することになる。また、マルチプレクサ
８は、S2がハイの期間データホールド回路52の出力を選
択すれば、マルチプレクサ８の出力は、波形Ｈに示すよ
うに輪郭を補正したものになる。
本実施例では、メモリ、遅延素子等は不要であり、非
常に簡便な構成で実現できる。なお、演算方法は図示し
たものには限られず、同じ効果が得られれば他の方法で
よい。
常に簡便な構成で実現できる。なお、演算方法は図示し
たものには限られず、同じ効果が得られれば他の方法で
よい。
［発明の効果］ 以上説明したように、本発明によれば、輪郭部で変化
する信号を変化の開始直前及び直後の信号を用いて置き
換えるので、プリシユート等の波形の乱れを伴なわずに
輪郭を補正することができ、前記従来技術の欠点を除い
て優れた機能の輪郭補正回路を提供することができる。
する信号を変化の開始直前及び直後の信号を用いて置き
換えるので、プリシユート等の波形の乱れを伴なわずに
輪郭を補正することができ、前記従来技術の欠点を除い
て優れた機能の輪郭補正回路を提供することができる。
第１図は本発明の第１の実施例のブロツク図、第２図は
第１図の動作波形図、第３図は本発明の第２の実施例の
ブロツク図、第４図は第２図の動作波形図、第５図は第
３図の記憶手段の入出力を説明する模式図、第６図は本
発明の第３の実施例の説明図、第７図は第６図の動作波
形図、第８図は本発明の第４の実施例のブロツク図、第
９図は第８図のパルスタイミングを示す波形図、第10図
は本発明の第５の実施例のブロツク図、第11図は第10図
の動作波形図である。 １……A/D変換器、2,4……微分回路、３……絶対値回
路、５……検波回路、６……記憶手段、７……書き込み
制御パルス発生回路、８……読み出し制御パルス発生回
路、81〜83……データホールド回路、84〜86……1Hメモ
リ。
第１図の動作波形図、第３図は本発明の第２の実施例の
ブロツク図、第４図は第２図の動作波形図、第５図は第
３図の記憶手段の入出力を説明する模式図、第６図は本
発明の第３の実施例の説明図、第７図は第６図の動作波
形図、第８図は本発明の第４の実施例のブロツク図、第
９図は第８図のパルスタイミングを示す波形図、第10図
は本発明の第５の実施例のブロツク図、第11図は第10図
の動作波形図である。 １……A/D変換器、2,4……微分回路、３……絶対値回
路、５……検波回路、６……記憶手段、７……書き込み
制御パルス発生回路、８……読み出し制御パルス発生回
路、81〜83……データホールド回路、84〜86……1Hメモ
リ。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 高橋 将 神奈川県横浜市戸塚区吉田町292番地 株式会社日立製作所家電研究所内 (72)発明者 今村 修 神奈川県横浜市戸塚区吉田町292番地 株式会社日立製作所家電研究所内 (56)参考文献 特開 平１−24681（ＪＰ，Ａ) 特開 昭63−46881（ＪＰ，Ａ) 特開 昭63−151179（ＪＰ，Ａ)
Claims (6)
- 【請求項１】入力映像信号の映像の輪郭部を補正する輪
郭補正回路において、 該入力映像信号の変位の開始から変曲点までの第１の変
位期間とこれに続く該変曲点から変位終了点までの第２
の変位期間とを検出する変位検出手段と、 該入力映像信号の該第１の変位期間直前の信号と該第２
の変位期間直後の信号とを記憶する記憶手段と、 該入力映像信号の該第１の変位期間では、該記憶手段に
記憶された該第１の変位期間直前の信号を続けて読み出
して該入力映像信号と置換し、かつ該入力映像信号の該
第２の変位期間では、該記憶手段に記憶された該第２の
変位期間直後の信号を続けて読み出して該入力映像信号
と置換する読出／置換手段と を備えたことを特徴とする輪郭補正回路。 - 【請求項２】入力映像信号の映像の輪郭部を補正する輪
郭補正回路において、 該入力映像信号の変位の開始から変曲点までの第１の変
位期間とこれに続く該変曲点から変位終了点までの第２
の変位期間とを検出する変位検出手段と、 該入力映像信号での該第１の変位期間の直前の信号を保
持する第１の保持手段と、 該第１の変位期間の該入力映像信号を該第１の保持手段
に保持されている該信号と置換する第１の置換手段と、 該第１の置換手段から出力される映像信号の１水平走査
期間分と該第２の変位期間を示す変位期間信号とを書き
込み、書込み方向とは逆方向に読み出す第１の記憶手段
と、 該第１の記憶手段から読み出される逆方向映像信号での
該第１の記憶手段から読み出される逆方向変位期間信号
が表わす該第２の変位期間の直前の信号を保持する第２
の保持手段と、 該逆方向変位期間信号が表わす該第２の変位期間の該逆
方向映像信号を該第２の保持手段に保持されている該信
号と置換する第２の置換手段と、 該第２の置換手段から出力される１水平走査期間分の映
像信号を書き込み、書込み方向とは逆方向に読み出する
第２の記憶手段と を備えたことを特徴とする輪郭補正回路。 - 【請求項３】請求項２において、 前記第１の保持手段と前記第１の置換手段とは、また、
前記第２の保持手段と前記第２の置換手段とは巡回形構
成のフィルタを形成し、 該巡回形構成のフィルタは、 入力される前記入力映像信号または前記逆方向映像信号
に、値０〜１の係数（１−Ｋ）を乗算する第１の係数乗
算器と、 入力信号に係数Ｋを乗算する第２の係数乗算器と、 該第1,第２の係数乗算器の出力信号を加算する加算器
と、 該加算器の出力信号を順次更新しながら保持し、その保
持した信号を該第２の係数乗算器の入力信号とする手段
と からなり、該係数Ｋを前記第1,第２の変位期間とそれ以
外の期間とで異ならせることを特徴とする輪郭補正回
路。 - 【請求項４】請求項２または３において、 前記第1,第２の保持手段は同じ保持手段であり、前記第
1,第２の置換手段は同じ置換手段であり、前記第1,第２
の記憶手段は同じ記憶手段であって、 前記入力映像信号と前記逆方向映像信号とを切り換えて
前記第２の保持手段と前記第２の置換手段とに供給する
切換手段を設けたことを特徴とする輪郭補正回路。 - 【請求項５】入力映像信号の映像の輪郭部を補正する輪
郭補正回路において、 該入力映像信号の変位の開始から変曲点までの第１の変
位期間を表わす第１の変位期間信号と該第１の変位期間
に続く該変曲点から変位終了点までの第２の変位期間を
表わす第２の変位期間信号とを生成する変位検出手段
と、 該入力映像信号と該第1,第２の変位期間信号とを所定期
間遅延する遅延手段と、 該遅延手段からの第１の遅延変位期間信号により、該遅
延手段からの遅延映像信号の該第１の遅延変位期間信号
が表わす第１の遅延変位期間、該第１の遅延変位期間直
前の該遅延映像信号の信号レベルに保持する第１の保持
手段と、 該入力映像信号の該変位期間の部分で遅延時間が変化し
て該第２の変位期間内に時間軸圧縮する可変遅延手段
と、 該遅延手段からの第２の遅延変位期間信号により、該可
変遅延手段の出力映像信号の該第２の遅延変位期間信号
が表わす第２の遅延変位期間、該第２の遅延変位期間直
前の該可変遅延手段の出力映像信号の信号レベルに保持
する第２の保持手段と、 該第２の遅延変位期間信号により制御され、該第２の遅
延変位期間では、該第２の保持手段の出力映像信号を選
択し、該第２の遅延変位期間以外の期間では、該第１の
保持手段の出力映像信号を選択する選択出力手段と を備えたことを特徴とする輪郭補正回路。 - 【請求項６】入力映像信号の映像の輪郭部を補正する輪
郭補正回路において、 該入力映像信号の変位の開始から変曲点までの第１の変
位期間を表わす第１の変位期間信号と該第１の変位期間
に続く該変曲点から変位終了点までの第２の変位期間を
表わす第２の変位期間信号とを生成する変位検出手段
と、 該第１の変位期間信号により、該入力映像信号の該第１
の変位期間、該第１の変位期間直前の該入力映像信号の
信号レベルに保持する第１の保持手段と、 該入力映像信号から該第１の保持手段の出力信号を減算
し、その減算出力に該入力映像信号を加算する演算手段
と、 該第２の変位期間信号により、該演算手段の出力信号の
該第２の変位期間、該第２の変位期間直前の該演算手段
の出力信号の信号レベルに保持する第２の保持手段と、 該第２の変位期間信号により、該第２の変位期間では、
該第２の保持手段の出力信号を選択し、該第２の変位期
間以外の期間では、該第１の保持手段の出力信号を選択
する選択出力手段と を備えたことを特徴とする輪郭補正回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1141145A JP2572445B2 (ja) | 1989-06-05 | 1989-06-05 | 輪郭補正回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1141145A JP2572445B2 (ja) | 1989-06-05 | 1989-06-05 | 輪郭補正回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH037477A JPH037477A (ja) | 1991-01-14 |
| JP2572445B2 true JP2572445B2 (ja) | 1997-01-16 |
Family
ID=15285206
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1141145A Expired - Lifetime JP2572445B2 (ja) | 1989-06-05 | 1989-06-05 | 輪郭補正回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2572445B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3075368B2 (ja) * | 1991-06-07 | 2000-08-14 | 日本ピストンリング株式会社 | ピストンリング |
| US5316321A (en) * | 1991-07-15 | 1994-05-31 | Teikoku Piston Ring Co., Ltd. | Nonferrous piston ring with hard surface treatment layer |
| JP2917115B2 (ja) * | 1995-11-20 | 1999-07-12 | ミネベア株式会社 | 転がり軸受 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6346881A (ja) * | 1986-08-14 | 1988-02-27 | Toshiba Corp | デジタル輪郭補正回路 |
| JP2590076B2 (ja) * | 1986-12-15 | 1997-03-12 | キヤノン株式会社 | 信号処理装置 |
| JPS6424681A (en) * | 1987-07-21 | 1989-01-26 | Mitsubishi Electric Corp | Sharpness improving device for video signal |
-
1989
- 1989-06-05 JP JP1141145A patent/JP2572445B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH037477A (ja) | 1991-01-14 |
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Legal Events
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