JP2539390B2 - マルチプロセツサシステム - Google Patents
マルチプロセツサシステムInfo
- Publication number
- JP2539390B2 JP2539390B2 JP61221846A JP22184686A JP2539390B2 JP 2539390 B2 JP2539390 B2 JP 2539390B2 JP 61221846 A JP61221846 A JP 61221846A JP 22184686 A JP22184686 A JP 22184686A JP 2539390 B2 JP2539390 B2 JP 2539390B2
- Authority
- JP
- Japan
- Prior art keywords
- control circuits
- processors
- common
- fault
- failure
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Multi Processors (AREA)
- Debugging And Monitoring (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は情報収集方式に係り、特に共通バスに接続さ
れたマルチプロセッサシステムの障害を同時に収集し
て、解析を容易にすることに好適なマルチプロセッサシ
ステムに関する。
れたマルチプロセッサシステムの障害を同時に収集し
て、解析を容易にすることに好適なマルチプロセッサシ
ステムに関する。
障害情報を収集する方式は、従来、特開昭60-235253
号公報に示されるように、ある装置が障害を検出すると
サービスプロセッサに障害の発生を知らせ、サービスプ
ロセッサが障害情報を収集するようになっていた。
号公報に示されるように、ある装置が障害を検出すると
サービスプロセッサに障害の発生を知らせ、サービスプ
ロセッサが障害情報を収集するようになっていた。
この従来の方法では、障害を検出したプロセッサある
いは入出力装置がサービスプロセッサのみに障害があっ
た旨の通知をする為、マルチプロセッサシステムの場
合、他のプロセッサ及び入出力装置の障害情報を同時に
とれなかった。
いは入出力装置がサービスプロセッサのみに障害があっ
た旨の通知をする為、マルチプロセッサシステムの場
合、他のプロセッサ及び入出力装置の障害情報を同時に
とれなかった。
また、特開昭60-120463号では、マルチプロセッサシ
ステムにおいて、子プロセッサと子プロセッサより障害
検出機能が高いプロセッサを設け、障害発生時には、親
プロセッサにより総ての障害処理を実行させ、その間、
子プロセッサの機能を停止させていた。この方法では、
他のプロセッサの情報が必要なときには、すべてのプロ
セッサを停止する必要があった。
ステムにおいて、子プロセッサと子プロセッサより障害
検出機能が高いプロセッサを設け、障害発生時には、親
プロセッサにより総ての障害処理を実行させ、その間、
子プロセッサの機能を停止させていた。この方法では、
他のプロセッサの情報が必要なときには、すべてのプロ
セッサを停止する必要があった。
上記従来技術は、マルチプロセッサシステムにおい
て、障害発生装置のみの障害情報収集で、他のプロセッ
サ、制御回路の関連障害情報を収集の点について配慮さ
れておらず、共通バスのエラー発生時の他のプロセッ
サ、制御回路の関連情報が取りにくい為、障害解析がし
にくいというような問題があった。
て、障害発生装置のみの障害情報収集で、他のプロセッ
サ、制御回路の関連障害情報を収集の点について配慮さ
れておらず、共通バスのエラー発生時の他のプロセッ
サ、制御回路の関連情報が取りにくい為、障害解析がし
にくいというような問題があった。
本発明の目的は、前記の如きの問題を除去するもので
あり、マルチプロセッサシステムにおけるすべてのプロ
セッサ、制御回路が共通バスに関する障害情報を短時間
のうちに収集する方式を提供することにある。
あり、マルチプロセッサシステムにおけるすべてのプロ
セッサ、制御回路が共通バスに関する障害情報を短時間
のうちに収集する方式を提供することにある。
上記目的は、複数のプロセッサと、複数の制御回路
と、その間を接続する共通バスとからなり、前記複数の
プロセッサの各々は、前記複数の制御回路を分担して管
理するマルチプロセッサシステムにおいて、 前記複数のプロセッサ及び前記複数の制御回路の各々
は、 前記共通バスの障害を検出して他の前記プロセッサ及
び前記制御回路に対し障害検出した旨を通知する障害検
出回路と、 前記共通バスに関する各自のログ情報を取得保持する
ログ情報処理保持手段とを有し、 また、前記複数のプロセッサの各々は、分担管理する
前記制御回路の前記ログ情報と、自身の前記ログ情報と
を収集する手段とを持つことにより達成される。
と、その間を接続する共通バスとからなり、前記複数の
プロセッサの各々は、前記複数の制御回路を分担して管
理するマルチプロセッサシステムにおいて、 前記複数のプロセッサ及び前記複数の制御回路の各々
は、 前記共通バスの障害を検出して他の前記プロセッサ及
び前記制御回路に対し障害検出した旨を通知する障害検
出回路と、 前記共通バスに関する各自のログ情報を取得保持する
ログ情報処理保持手段とを有し、 また、前記複数のプロセッサの各々は、分担管理する
前記制御回路の前記ログ情報と、自身の前記ログ情報と
を収集する手段とを持つことにより達成される。
前記複数のプロセッサ及び前記複数の制御回路の任意
の一つにおいて、前記共通バスにおける障害を検出した
とき、他の前記プロセッサ及び前記制御回路に対して障
害通知を行い、前記複数のプロセッサ及び前記複数の制
御回路の各々は、各自のログ情報を取得保持するととも
に、複数のプロセッサの各々は、分担管理する前記制御
回路のログ情報と、自身のログ情報とをあわせて収集す
る。これにより、障害を検出した装置における障害情報
だけではなく、他のすべてのプロセッサ、制御回路が障
害の発生によって起こった、共通バスに関連する障害情
報を取得し、制御回路を分担管理するプロセッサ毎に、
それらの障害情報を収集することで、マルチプロセッサ
システムにおける共通バスに関連する障害情報の収集、
及びその解析を短時間のうちに、容易かつ正確に行うこ
とができる。
の一つにおいて、前記共通バスにおける障害を検出した
とき、他の前記プロセッサ及び前記制御回路に対して障
害通知を行い、前記複数のプロセッサ及び前記複数の制
御回路の各々は、各自のログ情報を取得保持するととも
に、複数のプロセッサの各々は、分担管理する前記制御
回路のログ情報と、自身のログ情報とをあわせて収集す
る。これにより、障害を検出した装置における障害情報
だけではなく、他のすべてのプロセッサ、制御回路が障
害の発生によって起こった、共通バスに関連する障害情
報を取得し、制御回路を分担管理するプロセッサ毎に、
それらの障害情報を収集することで、マルチプロセッサ
システムにおける共通バスに関連する障害情報の収集、
及びその解析を短時間のうちに、容易かつ正確に行うこ
とができる。
以下、本発明の一実施例を第１図、第２図により説明
する。第１図は本発明に係るマルチプロセッサシステム
の情報収集方式の一実施例のシステム構成図である。
する。第１図は本発明に係るマルチプロセッサシステム
の情報収集方式の一実施例のシステム構成図である。
ここで1,2,…,nはプロセッサ、11,12,…,1nはプロセ
ッサ1,2,…,nの中にそれぞれあるログレジスタ、21,22,
…,2nはプロセッサ1,2,…,nがプログラムに割込みを発
生するための割込み発生回路、61,62,…,6nはプロセッ
サ1,2,…,nで障害を検出する為の障害検出機構、30は共
通バス線、31は共通障害検出連絡線、101,102,201,202,
…,n01,n02は制御回路、111,112,211,212,…,n11,n12は
制御回路101,102,201,202,…,n01,n02の中にそれぞれあ
るログレジスタ、121,122,221,222,…,n21,n22は制御回
路101,102,201,202,…,n01,n02で障害を検出する為の障
害検出機構である。
ッサ1,2,…,nの中にそれぞれあるログレジスタ、21,22,
…,2nはプロセッサ1,2,…,nがプログラムに割込みを発
生するための割込み発生回路、61,62,…,6nはプロセッ
サ1,2,…,nで障害を検出する為の障害検出機構、30は共
通バス線、31は共通障害検出連絡線、101,102,201,202,
…,n01,n02は制御回路、111,112,211,212,…,n11,n12は
制御回路101,102,201,202,…,n01,n02の中にそれぞれあ
るログレジスタ、121,122,221,222,…,n21,n22は制御回
路101,102,201,202,…,n01,n02で障害を検出する為の障
害検出機構である。
前記プロセッサ１は前記制御回路101,102を分担管理
している。前記プロセッサ２は前記制御回路201,202を
分担管理している。同様に前記プロセッサｎは前記制御
回路n01,n02を分担管理している。
している。前記プロセッサ２は前記制御回路201,202を
分担管理している。同様に前記プロセッサｎは前記制御
回路n01,n02を分担管理している。
第２図は制御回路101にて障害を検出した場合の障害
情報収集の手順図である。
情報収集の手順図である。
通常はプロセッサ1,2,…,nと制御回路101,102,201,20
2,…,n01,n02との間で共通バス連絡線50、共通バス線30
を通じてデータの送受信を行う。
2,…,n01,n02との間で共通バス連絡線50、共通バス線30
を通じてデータの送受信を行う。
以下、制御回路101にて障害を検出した場合の障害情
報収集方式について説明する。
報収集方式について説明する。
制御回路101の障害検出機構121で障害を検出すると、
制御回路101は障害連絡線40から共通障害連絡線31を通
じてプロセッサ1,2,…,nと残りの制御回路102,201,202,
…,n01,n02に同時に障害を検出した旨の通知を転送す
る。前記プロセッサ1,2,…,nと残りの制御回路102,201,
202,…,n01,n02はこの通知を受けとると共通バス線30に
関するログ情報をそれぞれ取得し、各々のログレジスタ
11,12,…,1n,112,211,212,…,n11,n12にセーブする。ま
た障害を検出した制御回路101もログ情報をログレジス
タ111にセーブする。
制御回路101は障害連絡線40から共通障害連絡線31を通
じてプロセッサ1,2,…,nと残りの制御回路102,201,202,
…,n01,n02に同時に障害を検出した旨の通知を転送す
る。前記プロセッサ1,2,…,nと残りの制御回路102,201,
202,…,n01,n02はこの通知を受けとると共通バス線30に
関するログ情報をそれぞれ取得し、各々のログレジスタ
11,12,…,1n,112,211,212,…,n11,n12にセーブする。ま
た障害を検出した制御回路101もログ情報をログレジス
タ111にセーブする。
次に各プロセッサ1,2,…,nの割込発生回路21,22,…,2
nよりプログラムに割込みをかけ、ログ情報収集のきっ
かけを知らせる。プログラムは割込みがあるとログ情報
を収集する必要があることを認識し、各プロセッサ1,2,
…ｎ自身のログ情報がセーブされているログレジスタ1
1,12,…,1nから収集する。また、プロセッサ１は自分が
管理している制御回路101,102から、プロセッサ２は自
分が管理している制御回路201,202から、同様にプロセ
ッサｎは自分が管理している制御回路n01,n02から、そ
れぞれ分担して収集する。
nよりプログラムに割込みをかけ、ログ情報収集のきっ
かけを知らせる。プログラムは割込みがあるとログ情報
を収集する必要があることを認識し、各プロセッサ1,2,
…ｎ自身のログ情報がセーブされているログレジスタ1
1,12,…,1nから収集する。また、プロセッサ１は自分が
管理している制御回路101,102から、プロセッサ２は自
分が管理している制御回路201,202から、同様にプロセ
ッサｎは自分が管理している制御回路n01,n02から、そ
れぞれ分担して収集する。
以上の結果、共通バス障害時に全てのプロセッサ及び
制御回路の共通バスに関するログ情報を分担して同時に
収集することが可能となる。
制御回路の共通バスに関するログ情報を分担して同時に
収集することが可能となる。
本発明によれば、障害検出時の共通バスに関するログ
情報を分担して同時に収集することができるので、マル
チプロセッサシステムにおける共通バス関連障害収集及
び解析が容易かつ正確に行なうことができ、信頼性の向
上及びサービスの向上に顕著な効果が得られる。
情報を分担して同時に収集することができるので、マル
チプロセッサシステムにおける共通バス関連障害収集及
び解析が容易かつ正確に行なうことができ、信頼性の向
上及びサービスの向上に顕著な効果が得られる。
第１図は本発明に係るマルチプロセッサシステムの情報
収集方式の一実施例のシステム構成図、第２図は障害情
報収集の手順図である。 30……共通バス線,31……共通障害連絡線,40……障害連
絡線,50……共通バス連絡線。
収集方式の一実施例のシステム構成図、第２図は障害情
報収集の手順図である。 30……共通バス線,31……共通障害連絡線,40……障害連
絡線,50……共通バス連絡線。
Claims (1)
- 【請求項１】共通バスと、共通障害連絡線と、前記共通
バス及び前記共通障害連絡線の両者に接続された複数の
プロセッサと、前記共通バス及び前記共通障害連絡線の
両者に接続された複数の制御回路とを有し、前記複数の
プロセッサの各々は前記複数の制御回路を分担して管理
するマルチプロセッサシステムであって、 前記複数のプロセッサ及び前記複数の制御回路の各々
は、前記共通バスの障害を検出して他の前記複数のプロ
セッサ及び前記複数の制御回路の各々に前記共通バスの
障害を検出した旨を前記共通障害連絡線を介して通知す
る障害検出回路と、前記複数のプロセッサ及び前記複数
の制御回路のうちの他のいずれかから前記共通障害連絡
線を介して前記共通バスの障害を通知されたことに応じ
て前記共通バスを使用するための前記共通バスに関する
情報を各自のログ情報として退避して保持するログ情報
退避保持手段とを有し、 前記複数のプロセッサの各々は、前記複数の制御回路の
うちの各自が分担管理する制御回路が退避保持する前記
ログ情報及び各自が退避保持する前記ログ情報を収集す
る手段を有することを特徴とするマルチプロセッサシス
テム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61221846A JP2539390B2 (ja) | 1986-09-22 | 1986-09-22 | マルチプロセツサシステム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61221846A JP2539390B2 (ja) | 1986-09-22 | 1986-09-22 | マルチプロセツサシステム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6378268A JPS6378268A (ja) | 1988-04-08 |
| JP2539390B2 true JP2539390B2 (ja) | 1996-10-02 |
Family
ID=16773100
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61221846A Expired - Lifetime JP2539390B2 (ja) | 1986-09-22 | 1986-09-22 | マルチプロセツサシステム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2539390B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04277858A (ja) * | 1991-03-06 | 1992-10-02 | Fujitsu Ltd | マルチプロセッサシステム |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60252962A (ja) * | 1984-05-30 | 1985-12-13 | Fuji Electric Co Ltd | プロセツサダウン通知方式 |
-
1986
- 1986-09-22 JP JP61221846A patent/JP2539390B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6378268A (ja) | 1988-04-08 |
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