JP2503032Y2 - プログラマブルコントロ―ラのプログラミング装置 - Google Patents
プログラマブルコントロ―ラのプログラミング装置Info
- Publication number
- JP2503032Y2 JP2503032Y2 JP40043690U JP40043690U JP2503032Y2 JP 2503032 Y2 JP2503032 Y2 JP 2503032Y2 JP 40043690 U JP40043690 U JP 40043690U JP 40043690 U JP40043690 U JP 40043690U JP 2503032 Y2 JP2503032 Y2 JP 2503032Y2
- Authority
- JP
- Japan
- Prior art keywords
- program
- address
- read
- programmable controller
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Debugging And Monitoring (AREA)
Description
【０００１】
【産業上の利用分野】本考案は、プログラマブルコント
ローラのプログラミング装置に関し、詳しくは作成プロ
グラムの文法チェック機能を有するプログラミング装置
に関する。
ローラのプログラミング装置に関し、詳しくは作成プロ
グラムの文法チェック機能を有するプログラミング装置
に関する。
【０００２】
【従来の技術】従来、プログラムの文法エラーを検出す
る機能を有するプログラマブルコントローラのプログラ
ミング装置では、図４に示すように、プログラムメモリ
100 からシーケンス命令単位でプログラムを読出す読出
回路210,プログラムのフォーマットエラーを検出するプ
ログラムチェック回路220,エラーを検出した場合、エラ
ー内容を表示する表示部230 によってエラー検出回路を
構成している。
る機能を有するプログラマブルコントローラのプログラ
ミング装置では、図４に示すように、プログラムメモリ
100 からシーケンス命令単位でプログラムを読出す読出
回路210,プログラムのフォーマットエラーを検出するプ
ログラムチェック回路220,エラーを検出した場合、エラ
ー内容を表示する表示部230 によってエラー検出回路を
構成している。
【０００３】
【考案が解決しようとする課題】このようなエラー検出
回路200 において、プログラムメモリ100 に格納の容量
の大きなプログラムのエラー検出をする場合、エラー検
出処理にどのくらい時間が必要なのかわからず、オペレ
ータは常時プログラミング装置に常駐していなければな
らないという問題があった。
回路200 において、プログラムメモリ100 に格納の容量
の大きなプログラムのエラー検出をする場合、エラー検
出処理にどのくらい時間が必要なのかわからず、オペレ
ータは常時プログラミング装置に常駐していなければな
らないという問題があった。
【０００４】そこで、本考案の目的は、このような不具
合を解消し、プログラムのエラー検出処理時間をオペレ
ータに報らせることのできるプログラマブルコントロー
ラのプログラミング装置を提供することにある。
合を解消し、プログラムのエラー検出処理時間をオペレ
ータに報らせることのできるプログラマブルコントロー
ラのプログラミング装置を提供することにある。
【０００５】
【課題を解決するための手段】このような目的を達成す
るために、本考案は、チェック対象のプログラムを格納
するプログラムメモリと、該プログラムメモリにおける
プログラムの最終アドレスを検出する最終アドレス検出
手段と、前記プログラムメモリに格納されたプログラム
をアドレス単位でプログラムチェックのために、順次に
読出す読出し手段と、該読出し手段の読出し対象となる
前記プログラムメモリのアドレスと、前記検出手段によ
り検出された最終アドレスとを互いに関連付けて表示す
る表示手段とを具えたことを特徴とする。
るために、本考案は、チェック対象のプログラムを格納
するプログラムメモリと、該プログラムメモリにおける
プログラムの最終アドレスを検出する最終アドレス検出
手段と、前記プログラムメモリに格納されたプログラム
をアドレス単位でプログラムチェックのために、順次に
読出す読出し手段と、該読出し手段の読出し対象となる
前記プログラムメモリのアドレスと、前記検出手段によ
り検出された最終アドレスとを互いに関連付けて表示す
る表示手段とを具えたことを特徴とする。
【０００６】
【作用】本考案では、プログラムのエラーを検出する場
合、プログラムを順次読み出し、読み出したプログラム
をチェックする。あらかじめ、チェックするプログラム
の最終アドレスを読み出し、処理中に読み出したプログ
ラムの番地と共に表示（例えば、“処理中（チェックし
ているアドレス）／（最終アドレス）”のように表示）
する。これによりオペレータはプログラムのどのあたり
をチェックしているかわかるので、処理時間の目安とな
る。
合、プログラムを順次読み出し、読み出したプログラム
をチェックする。あらかじめ、チェックするプログラム
の最終アドレスを読み出し、処理中に読み出したプログ
ラムの番地と共に表示（例えば、“処理中（チェックし
ているアドレス）／（最終アドレス）”のように表示）
する。これによりオペレータはプログラムのどのあたり
をチェックしているかわかるので、処理時間の目安とな
る。
【０００７】
【実施例】以下、図面を参照して本考案の実施例を詳細
に説明する。
に説明する。
【０００８】本考案の説明に先立って、本考案を適用し
たプログラマブルコントローラのシステム構成を図２に
示す。
たプログラマブルコントローラのシステム構成を図２に
示す。
【０００９】プログラミング装置1000は、プログラマブ
ルコントローラ2000と伝送ライン２にて結ばれ、プログ
ラマブルコントローラのプログラング，モニタ等の処理
を行う。
ルコントローラ2000と伝送ライン２にて結ばれ、プログ
ラマブルコントローラのプログラング，モニタ等の処理
を行う。
【００１０】プログラミング装置1000は表示器３，キー
ボード入力装置４を外表面に有し、また装置内部にはエ
ラー検出回路としての機能を果す中央演算処理装置(CP
U) ，プログラムモリ等が設置されている。
ボード入力装置４を外表面に有し、また装置内部にはエ
ラー検出回路としての機能を果す中央演算処理装置(CP
U) ，プログラムモリ等が設置されている。
【００１１】本考案に関わるエラー検出回路の機能的な
回路構成を図１に示す。
回路構成を図１に示す。
【００１２】図１において図４の従来例と同一の箇所に
は同一の符号を付し詳細な説明を省略する。
は同一の符号を付し詳細な説明を省略する。
【００１３】図１において、最終アドレス検出回路310
はプログラムメモリにおけるプログラムの最終アドレス
を検出する。
はプログラムメモリにおけるプログラムの最終アドレス
を検出する。
【００１４】読出し回路320 は前記プログラムメモリに
格納されたプログラムをアドレス単位でプログラムチェ
ックのために、順次に読出す。
格納されたプログラムをアドレス単位でプログラムチェ
ックのために、順次に読出す。
【００１５】表示部330 は読出し回路320 の読出し対象
となる前記プログラムメモリのアドレスと、前記検出手
段により検出された最終アドレスとを互いに関連付けて
表示する。
となる前記プログラムメモリのアドレスと、前記検出手
段により検出された最終アドレスとを互いに関連付けて
表示する。
【００１６】本実施例では図３の制御手順を実行するCP
U が最終アドレス検出回路310,読出回路320,プログラム
チェック回路220 としての機能を果す。
U が最終アドレス検出回路310,読出回路320,プログラム
チェック回路220 としての機能を果す。
【００１７】このような回路における動作手順を図３の
フローチャートを参照しながら説明する。
フローチャートを参照しながら説明する。
【００１８】本実施例ではプログラムの先頭アドレスに
プログラムの最終（格納アドレス）が記載されているも
のとする。
プログラムの最終（格納アドレス）が記載されているも
のとする。
【００１９】最終アドレス検出回路310( CPU) はCPU 内
の読出しカウンタによりプログラムメモリ100 の先頭ア
ドレスを指定して、プログラムメモリ100 のプログラム
から最終アドレスを読出す( ステップS1,S2)。
の読出しカウンタによりプログラムメモリ100 の先頭ア
ドレスを指定して、プログラムメモリ100 のプログラム
から最終アドレスを読出す( ステップS1,S2)。
【００２０】次いで読出し回路ではプログラムカウンタ
の発生する読出しアドレスを更新し、プログラム情報具
体的にはシーケンス命令をプログラムメモリ100 から読
出す（ステップS2) 。
の発生する読出しアドレスを更新し、プログラム情報具
体的にはシーケンス命令をプログラムメモリ100 から読
出す（ステップS2) 。
【００２１】次に、このときの読出しカウンタの示すア
ドレス情報と先に読出したプログラムの最終アドレス情
報とを図１の表示部330(図２の表示器３）に送り、現在
のシーケンス命令の読出しアドレスおよびプログラム最
終アドレスを互いに関連付けて表示する（ステップS4)
。
ドレス情報と先に読出したプログラムの最終アドレス情
報とを図１の表示部330(図２の表示器３）に送り、現在
のシーケンス命令の読出しアドレスおよびプログラム最
終アドレスを互いに関連付けて表示する（ステップS4)
。
【００２２】続いて、プログラムチェック回路220(CPU)
は読出しのシーケンス命令についての文法チェックを行
い、エラーを検出した場合はエラー内容を表示部330 に
表示する（ステップS6→S7) 。
は読出しのシーケンス命令についての文法チェックを行
い、エラーを検出した場合はエラー内容を表示部330 に
表示する（ステップS6→S7) 。
【００２３】以下、読出回路320 は読出しカウンタの計
数値を更新した後、プログラムチェック回路220 と共に
上述のステップS3〜S9の処理を繰り返し実行し、 読出し
たシーケンス命令の文法チェックをプログラムの最終部
分まで実行する。また、読出しカウンタの更新毎に表示
部330 の読出しアドレス情報も更新表示される。読出し
カウンタの計数値がプログラム最終アトレスに到達した
ことを読出し回路320において検知すると（ステップS9)
、本制御手順によるプログラムチェック処理を終了す
る。
数値を更新した後、プログラムチェック回路220 と共に
上述のステップS3〜S9の処理を繰り返し実行し、 読出し
たシーケンス命令の文法チェックをプログラムの最終部
分まで実行する。また、読出しカウンタの更新毎に表示
部330 の読出しアドレス情報も更新表示される。読出し
カウンタの計数値がプログラム最終アトレスに到達した
ことを読出し回路320において検知すると（ステップS9)
、本制御手順によるプログラムチェック処理を終了す
る。
【００２４】本実施例の他に次の例が挙げられる。
【００２５】1)本実施例では読出しアドレスおよびプロ
グラム最終アドレスを互いに関連付けてそのまま表示し
ているが、プログラムアドレスとプログラムのステップ
番号は１対１に対応しているので、プログラムメモリ10
0 の先頭アドレスが“０”番地ではないときはプログラ
ムアドレスをプログラムステップや、チェック処理に要
する所要時間に換算してもよいこともちろんである。
グラム最終アドレスを互いに関連付けてそのまま表示し
ているが、プログラムアドレスとプログラムのステップ
番号は１対１に対応しているので、プログラムメモリ10
0 の先頭アドレスが“０”番地ではないときはプログラ
ムアドレスをプログラムステップや、チェック処理に要
する所要時間に換算してもよいこともちろんである。
【００２６】2)プログラム最終アドレスの検出方法はプ
ログラムメモリ100 の情報記憶形態に対応して異なる。
ログラムメモリ100 の情報記憶形態に対応して異なる。
【００２７】たとえば、プログラムメモリ100 にディレ
クトリテーブルを設け、ディレクトリテーブルに記憶情
報名，先頭アドレス末尾アドレスを格納する場合はこの
ディレクトリテーブルからプログラム最終アドレスを検
出する。
クトリテーブルを設け、ディレクトリテーブルに記憶情
報名，先頭アドレス末尾アドレスを格納する場合はこの
ディレクトリテーブルからプログラム最終アドレスを検
出する。
【００２８】
【考案の効果】以上、説明したように、本考案によれ
ば、プログラムの読出しアドレスおよび最終アドレスの
表示によりプログラムのチェック処理の過程が、オペレ
ータに判るので、チェック処理の終了時間がオペレータ
に予測できる。このため、オペレータはプログラミング
装置に常駐する必要はない。
ば、プログラムの読出しアドレスおよび最終アドレスの
表示によりプログラムのチェック処理の過程が、オペレ
ータに判るので、チェック処理の終了時間がオペレータ
に予測できる。このため、オペレータはプログラミング
装置に常駐する必要はない。
【図面の簡単な説明】
【図１】本考案実施例におけるエラー検出回路の回路構
成を示すブロック図である。
成を示すブロック図である。
【図２】本考案実施例におけるプログラマブルコントロ
ーラのシステム構成を示す斜視図である。
ーラのシステム構成を示す斜視図である。
【図３】本考案実施例のエラー検出手順を示すフローチ
ャートである。
ャートである。
【図４】従来のエラー検出装置の回路構成を示すブロッ
ク図である。
ク図である。
100 プログラムメモリ 200,300 エラー検出回路 210,320 読出回路 220 プログラミングチェック回路 230,330 表示部 310 最終アドレス検出回路
Claims (1)
- 【請求項１】 チェック対象のプログラムを格納するプ
ログラムメモリと、該プログラムメモリにおけるプログ
ラムの最終アドレスを検出する最終アドレス検出手段
と、前記プログラムメモリに格納されたプログラムをア
ドレス単位でプログラムチェックのために、順次に読出
す読出し手段と、該読出し手段の読出し対象となる前記
プログラムメモリのアドレスと、前記検出手段により検
出された最終アドレスとを互いに関連付けて表示する表
示手段とを具えたことを特徴とするプログラマブルコン
トローラのプログラミング装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP40043690U JP2503032Y2 (ja) | 1990-12-12 | 1990-12-12 | プログラマブルコントロ―ラのプログラミング装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP40043690U JP2503032Y2 (ja) | 1990-12-12 | 1990-12-12 | プログラマブルコントロ―ラのプログラミング装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0490251U JPH0490251U (ja) | 1992-08-06 |
| JP2503032Y2 true JP2503032Y2 (ja) | 1996-06-26 |
Family
ID=31878679
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP40043690U Expired - Lifetime JP2503032Y2 (ja) | 1990-12-12 | 1990-12-12 | プログラマブルコントロ―ラのプログラミング装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2503032Y2 (ja) |
-
1990
- 1990-12-12 JP JP40043690U patent/JP2503032Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0490251U (ja) | 1992-08-06 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
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