JP2021501368A - Amoled画素駆動回路及びその駆動方法 - Google Patents
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Abstract
Description
前記第1薄膜トランジスタは、ゲートが第2走査制御信号にアクセスし、ソースがデータ信号に電気的に接続され、ドレインが第1ノードに電気的に接続され、
前記第2薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが第1ノードに電気的に接続され、ドレインが第2ノードに電気的に接続され、
前記第3薄膜トランジスタは、ゲートが第1走査制御信号にアクセスし、ソースが第2ノードに電気的に接続され、ドレインが第3ノードに電気的に接続され、
前記第4薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが第3ノードに電気的に接続され、ドレインが有機発光ダイオードの陽極に電気的に接続され、
前記第5薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが基準電圧にアクセスし、ドレインが第2ノードに電気的に接続され、
前記第6薄膜トランジスタは、ゲートが第1ノードに電気的に接続され、ドレインが電源高電圧にアクセスし、ソースが第3ノードに電気的に接続され、
前記コンデンサは、一端が第2ノードに電気的に接続され、他端が第3ノードに電気的に接続され、
前記有機発光ダイオードの陰極が電源低電圧にアクセスし、
前記第5薄膜トランジスタはN型薄膜トランジスタ及びP型薄膜トランジスタのうちの一方であり、前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ及び第6薄膜トランジスタはいずれもN型薄膜トランジスタ及びP型薄膜トランジスタのうちの第5薄膜トランジスタと異なるもう一方である。
閾値電圧補正段階では、前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第1電位を供給した後に第2電位を供給し、第3走査制御信号が第2電位を供給し、前記第5薄膜トランジスタオン、前記第2薄膜トランジスタ、第3薄膜トランジスタ、及び第4薄膜トランジスタがオフになり、前記第1薄膜トランジスタがオンになった後にオフになり、
表示発光段階では、前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第2電位を供給し、第3走査制御信号が第1電位を供給し、前記第2薄膜トランジスタ、及び第4薄膜トランジスタがオンになり、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオフになる。
ステップS001では、データ電圧記憶段階に入り、
前記第1走査制御信号が第1電位を供給し、前記第2走査制御信号が第1電位を供給し、第3走査制御信号が第1電位と異なる第2電位を供給し、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ及び第4薄膜トランジスタがオフになり、データ信号が第1ノードに書き込まれ、基準電圧が第2ノード及び第3ノードに書き込まれ、
ステップS002では、閾値電圧補正段階に入り、
前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第1電位を供給した後に第2電位を供給し、第3走査制御信号が第2電位を供給し、前記第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ、第3薄膜トランジスタ、及び第4薄膜トランジスタがオフになり、前記第1薄膜トランジスタがオンになった後にオフになり、
前記第2走査制御信号が第1電位である時、第3ノードが第6薄膜トランジスタによって放電し、第3ノードの電位をVdata−Vthに変更し、ここで、Vdataはデータ信号の電圧であり、Vthは第6薄膜トランジスタの閾値電圧であり、
前記第2走査制御信号が第2電位である時、第1ノードの電圧がゼロになり、第2ノードの電圧が基準電圧に維持され、第3ノードの電圧がVdata−Vthに維持され、
ステップS003では、表示発光段階に入り、
前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第2電位を供給し、第3走査制御信号が第1電位を供給し、前記第2薄膜トランジスタ、及び第4薄膜トランジスタがオンになり、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオフになり、有機発光ダイオードが発光する。
前記第1薄膜トランジスタは、ゲートが第2走査制御信号にアクセスし、ソースがデータ信号に電気的に接続され、ドレインが第1ノードに電気的に接続され、
前記第2薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが第1ノードに電気的に接続され、ドレインが第2ノードに電気的に接続され、
前記第3薄膜トランジスタは、ゲートが第1走査制御信号にアクセスし、ソースが第2ノードに電気的に接続され、ドレインが第3ノードに電気的に接続され、
前記第4薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが第3ノードに電気的に接続され、ドレインが有機発光ダイオードの陽極に電気的に接続され、
前記第5薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが基準電圧にアクセスし、ドレインが第2ノードに電気的に接続され、
前記第6薄膜トランジスタは、ゲートが第1ノードに電気的に接続され、ドレインが電源高電圧にアクセスし、ソースが第3ノードに電気的に接続され、
前記コンデンサは、一端が第2ノードに電気的に接続され、他端が第3ノードに電気的に接続され、
前記有機発光ダイオードの陰極が電源低電圧にアクセスし、
前記第5薄膜トランジスタはN型薄膜トランジスタ及びP型薄膜トランジスタのうちの一方であり、前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ及び第6薄膜トランジスタはいずれもN型薄膜トランジスタ及びP型薄膜トランジスタのうちの第5薄膜トランジスタと異なるもう一方であり、
前記第1走査制御信号、第2走査制御信号、及び第3走査制御信号を互いに組み合わせ、順に1つのデータ電圧記憶段階、1つの閾値電圧補正段階、及び1つの表示発光段階に対応付け、且つ前記有機発光ダイオードが1つのデータ電圧記憶段階及び1つの閾値電圧補正段階で発光しないように制御し、
前記データ電圧記憶段階では、前記第1走査制御信号が第1電位を供給し、前記第2走査制御信号が第1電位を供給し、第3走査制御信号が第1電位と異なる第2電位を供給し、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ及び第4薄膜トランジスタがオフになり、
前記閾値電圧補正段階では、前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第1電位を供給した後に第2電位を供給し、第3走査制御信号が第2電位を供給し、前記第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ、第3薄膜トランジスタ、及び第4薄膜トランジスタがオフになり、前記第1薄膜トランジスタがオンになった後にオフになり、
前記表示発光段階では、前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第2電位を供給し、第3走査制御信号が第1電位を供給し、前記第2薄膜トランジスタ、及び第4薄膜トランジスタがオンになり、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオフになり、
前記第1走査制御信号、第2走査制御信号、及び第3走査制御信号はいずれも外部タイミングコントローラによって供給され、
前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ、第5薄膜トランジスタ、及び第6薄膜トランジスタはいずれも低温ポリシリコン薄膜トランジスタ、酸化物半導体薄膜トランジスタ、又はアモルファスシリコン薄膜トランジスタである。
上記第1薄膜トランジスタT1は、ゲートが第2走査制御信号S2にアクセスし、ソースがデータ信号Dataに電気的に接続され、ドレインが第1ノードAに電気的に接続され、
上記第2薄膜トランジスタT2は、ゲートが第3走査制御信号S3にアクセスし、ソースが第1ノードAに電気的に接続され、ドレインが第2ノードBに電気的に接続され、
上記第3薄膜トランジスタT3は、ゲートが第1走査制御信号S1にアクセスし、ソースが第2ノードBに電気的に接続され、ドレインが第3ノードCに電気的に接続され、
上記第4薄膜トランジスタT4は、ゲートが第3走査制御信号S3にアクセスし、ソースが第3ノードCに電気的に接続され、ドレインが機発光ダイオードDの陽極に電気的に接続され、
上記第5薄膜トランジスタT5は、ゲートが第3走査制御信号S3にアクセスし、ソースが基準電圧Vrefにアクセスし、ドレインが第2ノードBに電気的に接続され、
上記第6薄膜トランジスタT6は、ゲートが第1ノードAに電気的に接続され、ドレインが電源高電圧OVDDにアクセスし、ソースが第3ノードCに電気的に接続され、
上記コンデンサC1は、一端が第2ノードBに電気的に接続され、他端が第3ノードCに電気的に接続され、
上記有機発光ダイオードDの陰極が電源低電圧OVSSにアクセスする。
ステップS001では、図5に示すように、データ電圧記憶段階1に入り、
上記第1走査制御信号S1が第1電位を供給し、上記第2走査制御信号S2が第1電位を供給し、第3走査制御信号S3が第1電位と異なる第2電位を供給し、上記第1薄膜トランジスタT1、第3薄膜トランジスタT3、及び第5薄膜トランジスタT5がオンになり、上記第2薄膜トランジスタT2及び第4薄膜トランジスタT4がオフになり、データ信号Dataが第1ノードAに書き込まれ、基準電圧Vrefが第2ノードB及び第3ノードCに書き込まれる。
上記第1走査制御信号S1が第2電位を供給し、上記第2走査制御信号S2が第1電位を供給した後に第2電位を供給し、第3走査制御信号S3が第2電位を供給し、上記第5薄膜トランジスタT5がオンになり、上記第2薄膜トランジスタT2、第3薄膜トランジスタT3、及び第4薄膜トランジスタT4がオフになり、上記第1薄膜トランジスタT1がオンになった後にオフになる。
上記第1走査制御信号S1が第2電位を供給し、上記第2走査制御信号S2が第2電位を供給し、第3走査制御信号S3が第1電位を供給し、上記第2薄膜トランジスタT2、及び第4薄膜トランジスタT4がオンになり、上記第1薄膜トランジスタT1、第3薄膜トランジスタT3、及び第5薄膜トランジスタT5がオフになり、有機発光ダイオードDが発光する。
T2 第2薄膜トランジスタ
T3 第3薄膜トランジスタ
T4 第4薄膜トランジスタ
T5 第5薄膜トランジスタ
T6 第6薄膜トランジスタ
C1 コンデンサ
D 有機発光ダイオード
1 データ電圧記憶段階
2 閾値電圧補正段階
3 表示発光段階
Claims (15)
- AMOLED画素駆動回路であって、第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ、第5薄膜トランジスタ、第6薄膜トランジスタ、コンデンサ、及び有機発光ダイオードを含み、
前記第1薄膜トランジスタは、ゲートが第2走査制御信号にアクセスし、ソースがデータ信号に電気的に接続され、ドレインが第1ノードに電気的に接続され、
前記第2薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが第1ノードに電気的に接続され、ドレインが第2ノードに電気的に接続され、
前記第3薄膜トランジスタは、ゲートが第1走査制御信号にアクセスし、ソースが第2ノードに電気的に接続され、ドレインが第3ノードに電気的に接続され、
前記第4薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが第3ノードに電気的に接続され、ドレインが有機発光ダイオードの陽極に電気的に接続され、
前記第5薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが基準電圧にアクセスし、ドレインが第2ノードに電気的に接続され、
前記第6薄膜トランジスタは、ゲートが第1ノードに電気的に接続され、ドレインが電源高電圧にアクセスし、ソースが第3ノードに電気的に接続され、
前記コンデンサは、一端が第2ノードに電気的に接続され、他端が第3ノードに電気的に接続され、
前記有機発光ダイオードの陰極が電源低電圧にアクセスし、
前記第5薄膜トランジスタはN型薄膜トランジスタ及びP型薄膜トランジスタのうちの一方であり、前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ及び第6薄膜トランジスタはいずれもN型薄膜トランジスタ及びP型薄膜トランジスタのうちの第5薄膜トランジスタと異なるもう一方である、AMOLED画素駆動回路。 - 前記第1走査制御信号、第2走査制御信号、及び第3走査制御信号を互いに組み合わせ、順に1つのデータ電圧記憶段階、1つの閾値電圧補正段階、及び1つの表示発光段階に対応付け、且つ前記有機発光ダイオードが1つのデータ電圧記憶段階及び1つの閾値電圧補正段階で発光しないように制御する、請求項1に記載のAMOLED画素駆動回路。
- 前記データ電圧記憶段階では、前記第1走査制御信号が第1電位を供給し、前記第2走査制御信号が第1電位を供給し、第3走査制御信号が第1電位と異なる第2電位を供給し、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ及び第4薄膜トランジスタがオフになり、
前記閾値電圧補正段階では、前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第1電位を供給した後に第2電位を供給し、第3走査制御信号が第2電位を供給し、前記第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ、第3薄膜トランジスタ、及び第4薄膜トランジスタがオフになり、前記第1薄膜トランジスタがオンになった後にオフになり、
前記表示発光段階では、前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第2電位を供給し、第3走査制御信号が第1電位を供給し、前記第2薄膜トランジスタ、及び第4薄膜トランジスタがオンになり、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオフになる、請求項2に記載のAMOLED画素駆動回路。 - 前記第5薄膜トランジスタはP型薄膜トランジスタであり、前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ及び第6薄膜トランジスタはいずれもN型薄膜トランジスタである、請求項3に記載のAMOLED画素駆動回路。
- 前記第1電位は高電位であり、前記第2電位は低電位である、請求項4に記載のAMOLED画素駆動回路。
- 前記第5薄膜トランジスタはN型薄膜トランジスタであり、前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ及び第6薄膜トランジスタはいずれもP型薄膜トランジスタである、請求項3に記載のAMOLED画素駆動回路。
- 前記第1電位は低電位であり、前記第2電位は高電位である、請求項6に記載のAMOLED画素駆動回路。
- 前記第1走査制御信号、第2走査制御信号、及び第3走査制御信号はいずれも外部タイミングコントローラによって供給される、請求項1に記載のAMOLED画素駆動回路。
- 前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ、第5薄膜トランジスタ、及び第6薄膜トランジスタはいずれも低温ポリシリコン薄膜トランジスタ、酸化物半導体薄膜トランジスタ、又はアモルファスシリコン薄膜トランジスタである、請求項1に記載のAMOLED画素駆動回路。
- AMOLED画素駆動回路に応用される請求項1に記載のAMOLED画素駆動方法であって、前記AMOLED画素駆動方法は、以下のステップS001〜S003を含み、
ステップS001では、データ電圧記憶段階に入り、
前記第1走査制御信号が第1電位を供給し、前記第2走査制御信号が第1電位を供給し、第3走査制御信号が第1電位と異なる第2電位を供給し、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ及び第4薄膜トランジスタがオフになり、データ信号が第1ノードに書き込まれ、基準電圧が第2ノード及び第3ノードに書き込まれ、
ステップS002では、閾値電圧補正段階に入り、
前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第1電位を供給した後に第2電位を供給し、第3走査制御信号が第2電位を供給し、前記第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ、第3薄膜トランジスタ、及び第4薄膜トランジスタがオフになり、前記第1薄膜トランジスタがオンになった後にオフになり、
前記第2走査制御信号が第1電位である時、第3ノードが第6薄膜トランジスタによって放電し、第3ノードの電位をVdata−Vthに変更し、ここで、Vdataはデータ信号の電圧であり、Vthは第6薄膜トランジスタの閾値電圧であり、
前記第2走査制御信号が第2電位である時、第1ノードの電圧がゼロになり、第2ノードの電圧が基準電圧に維持され、第3ノードの電圧がVdata−Vthに維持され、
ステップS003では、表示発光段階に入り、
前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第2電位を供給し、第3走査制御信号が第1電位を供給し、前記第2薄膜トランジスタ、及び第4薄膜トランジスタがオンになり、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオフになり、有機発光ダイオードが発光する、AMOLED画素駆動方法。 - AMOLED画素駆動回路であって、第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ、第5薄膜トランジスタ、第6薄膜トランジスタ、コンデンサ、及び有機発光ダイオードを含み、
前記第1薄膜トランジスタは、ゲートが第2走査制御信号にアクセスし、ソースがデータ信号に電気的に接続され、ドレインが第1ノードに電気的に接続され、
前記第2薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが第1ノードに電気的に接続され、ドレインが第2ノードに電気的に接続され、
前記第3薄膜トランジスタは、ゲートが第1走査制御信号にアクセスし、ソースが第2ノードに電気的に接続され、ドレインが第3ノードに電気的に接続され、
前記第4薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが第3ノードに電気的に接続され、ドレインが有機発光ダイオードの陽極に電気的に接続され、
前記第5薄膜トランジスタは、ゲートが第3走査制御信号にアクセスし、ソースが基準電圧にアクセスし、ドレインが第2ノードに電気的に接続され、
前記第6薄膜トランジスタは、ゲートが第1ノードに電気的に接続され、ドレインが電源高電圧にアクセスし、ソースが第3ノードに電気的に接続され、
前記コンデンサは、一端が第2ノードに電気的に接続され、他端が第3ノードに電気的に接続され、
前記有機発光ダイオードの陰極が電源低電圧にアクセスし、
前記第5薄膜トランジスタはN型薄膜トランジスタ及びP型薄膜トランジスタのうちの一方であり、前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ及び第6薄膜トランジスタはいずれもN型薄膜トランジスタ及びP型薄膜トランジスタのうちの第5薄膜トランジスタと異なるもう一方であり、
前記第1走査制御信号、第2走査制御信号、及び第3走査制御信号を互いに組み合わせ、順に1つのデータ電圧記憶段階、1つの閾値電圧補正段階、及び1つの表示発光段階に対応付け、且つ前記有機発光ダイオードが1つのデータ電圧記憶段階及び1つの閾値電圧補正段階で発光しないように制御し、
前記データ電圧記憶段階では、前記第1走査制御信号が第1電位を供給し、前記第2走査制御信号が第1電位を供給し、第3走査制御信号が第1電位と異なる第2電位を供給し、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ及び第4薄膜トランジスタがオフになり、
前記閾値電圧補正段階では、前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第1電位を供給した後に第2電位を供給し、第3走査制御信号が第2電位を供給し、前記第5薄膜トランジスタがオンになり、前記第2薄膜トランジスタ、第3薄膜トランジスタ、及び第4薄膜トランジスタがオフになり、前記第1薄膜トランジスタがオンになった後にオフになり、
前記表示発光段階では、前記第1走査制御信号が第2電位を供給し、前記第2走査制御信号が第2電位を供給し、第3走査制御信号が第1電位を供給し、前記第2薄膜トランジスタ、及び第4薄膜トランジスタがオンになり、前記第1薄膜トランジスタ、第3薄膜トランジスタ、及び第5薄膜トランジスタがオフになり、
前記第1走査制御信号、第2走査制御信号、及び第3走査制御信号はいずれも外部タイミングコントローラによって供給され、
前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ、第5薄膜トランジスタ、及び第6薄膜トランジスタはいずれも低温ポリシリコン薄膜トランジスタ、酸化物半導体薄膜トランジスタ、又はアモルファスシリコン薄膜トランジスタである、AMOLED画素駆動回路。 - 前記第5薄膜トランジスタはP型薄膜トランジスタであり、前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ及び第6薄膜トランジスタはいずれもN型薄膜トランジスタである、請求項11に記載のAMOLED画素駆動回路。
- 前記第1電位は高電位であり、前記第2電位は低電位である、請求項12に記載のAMOLED画素駆動回路。
- 前記第5薄膜トランジスタはN型薄膜トランジスタであり、前記第1薄膜トランジスタ、第2薄膜トランジスタ、第3薄膜トランジスタ、第4薄膜トランジスタ及び第6薄膜トランジスタはいずれもP型薄膜トランジスタである、請求項11に記載のAMOLED画素駆動回路。
- 前記第1電位は低電位であり、前記第2電位は高電位である、請求項14に記載のAMOLED画素駆動回路。
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