JP2020174147A - Wiring board and method for measuring wiring board - Google Patents

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孔太郎 高木
Kotaro Takagi
孔太郎 高木
要二 森
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要二 森
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Abstract

To enhance the quality of a wiring board.SOLUTION: A wiring board 1 includes a laminate 10 containing two or more conductor layers 21 to 24, and insulating layers 31 to 33 interposed between the respective conductor layers, and a solder resist layer 40 covering a first surface 10F and a second surface 10S of the laminate 10. The laminate 10 further has a through-hole 10a penetrating the laminate 10 in the thickness direction thereof, and the solder resist layer 40 passes through the through-hole 10a from one of the first surface 10F and the second surface 10S of the laminate 10 to the other surface, is continuous, and covers an inner wall surface 10a1 of the through-hole 10a.SELECTED DRAWING: Figure 1

Description

本発明は、配線基板及び配線基板の製造方法に関する。 The present invention relates to a wiring board and a method for manufacturing a wiring board.

特許文献1には、リジッドの基板が用いられる配線基板が開示されている。この配線基板は、この配線基板に実装される半導体チップと対向する領域を含む所定の領域に、配線基板を貫通する開口部を有している。 Patent Document 1 discloses a wiring board in which a rigid substrate is used. The wiring board has an opening penetrating the wiring board in a predetermined area including a region facing the semiconductor chip mounted on the wiring board.

特開2014−230010号公報Japanese Unexamined Patent Publication No. 2014-230010

特許文献1に開示の配線基板では、開口部の壁面から配線基板の材料が砕片となって遊離又は落下してしまい、配線基板が用いられる機器の品質に影響を及ぼすことがある。 In the wiring board disclosed in Patent Document 1, the material of the wiring board is released or dropped from the wall surface of the opening as fragments, which may affect the quality of the device in which the wiring board is used.

本発明の配線基板は、第1面及び前記第1面の反対面である第2面を有していて、2以上の導体層と前記2以上の導体層それぞれの間に介在する絶縁層とを含む積層体と、前記積層体の前記第1面及び前記第2面を覆っているソルダーレジスト層と、を有している。そして、前記積層体は前記積層体を厚さ方向に貫通する貫通孔をさらに有し、前記ソルダーレジスト層は、前記積層体の前記第1面及び前記第2面の一方から他方まで前記貫通孔の内部を通って連続していて前記内部において前記貫通孔の内壁面を覆っている。 The wiring board of the present invention has a first surface and a second surface which is an opposite surface of the first surface, and has an insulating layer interposed between two or more conductor layers and each of the two or more conductor layers. It has a laminated body containing the above, and a solder resist layer covering the first surface and the second surface of the laminated body. Then, the laminated body further has a through hole penetrating the laminated body in the thickness direction, and the solder resist layer has the through hole from one to the other of the first surface and the second surface of the laminated body. It is continuous through the inside of the inside and covers the inner wall surface of the through hole.

本発明の配線基板の製造方法は、2以上の導体層と前記2以上の導体層それぞれの間に介在する絶縁層とを含む積層体を用意することと、前記積層体を厚さ方向に貫通する貫通孔を前記積層体に形成することと、前記積層体の第1面及び第2面を覆うソルダーレジスト層を前記貫通孔の内部を通って前記第1面及び第2面の一方から他方まで連続するように形成することによって、前記貫通孔の内壁面を樹脂膜で覆うことと、を含んでいる。 The method for manufacturing a wiring board of the present invention includes preparing a laminate including two or more conductor layers and an insulating layer interposed between the two or more conductor layers, and penetrating the laminate in the thickness direction. A through hole is formed in the laminated body, and a solder resist layer covering the first surface and the second surface of the laminated body is passed through the inside of the through hole from one of the first surface and the second surface to the other. It includes covering the inner wall surface of the through hole with a resin film by forming the through hole so as to be continuous.

本発明の実施形態の配線基板によれば、貫通孔を有する配線基板において貫通孔の内壁からの発塵を抑制することができ、配線基板が用いられる機器の品質を高めることができると考えられる。本発明の実施形態の配線基板の製造方法によれば、貫通孔の内壁からの発塵が少ない配線基板を製造することができる。 According to the wiring board of the embodiment of the present invention, it is considered that dust generation from the inner wall of the through hole can be suppressed in the wiring board having the through hole, and the quality of the device in which the wiring board is used can be improved. .. According to the method for manufacturing a wiring board according to the embodiment of the present invention, it is possible to manufacture a wiring board with less dust generated from the inner wall of the through hole.

本発明の一実施形態の配線基板の一例を示す断面図。The cross-sectional view which shows an example of the wiring board of one Embodiment of this invention. 図1の例の配線基板を示す平面図。The plan view which shows the wiring board of the example of FIG. 図1の配線基板の変形例を示す部分断面図。FIG. 3 is a partial cross-sectional view showing a modified example of the wiring board of FIG. 図1の配線基板の他の変形例を示す断面図。FIG. 5 is a cross-sectional view showing another modified example of the wiring board of FIG. 図4Aの配線基板を示す平面図。The plan view which shows the wiring board of FIG. 4A. 本発明の一実施形態の配線基板の製造方法において用意される積層体の一例を示す断面図。The cross-sectional view which shows an example of the laminated body prepared in the manufacturing method of the wiring board of one Embodiment of this invention. 本発明の一実施形態の配線基板の製造方法における貫通孔の形成後の状態の一例を示す断面図。FIG. 5 is a cross-sectional view showing an example of a state after formation of a through hole in the method for manufacturing a wiring board according to an embodiment of the present invention. 本発明の一実施形態の配線基板の製造方法におけるソルダーレジスト層の形成後の状態の一例を示す断面図。FIG. 5 is a cross-sectional view showing an example of a state after formation of a solder resist layer in the method for manufacturing a wiring board according to an embodiment of the present invention.

本発明の一実施形態の配線基板が図面を参照しながら説明される。図1及び図2には、一実施形態の配線基板の一例である配線基板1の断面図及び平面図がそれぞれ示されている。図1は図2に示されるI−I線での断面図である。図1及び図2に示されるように、配線基板1は、絶縁層と導体層との積層体10と、ソルダーレジスト層40と、を備えている。積層体10は、配線基板1の厚さ方向と直交する2つの表面のうちの一方である第1面10F、及び第1面10Fの反対面である第2面10Sを有している。積層体10は、2以上の導体層(図1の例では第1〜第4の導体層21、22、23、24)と、この2以上の導体層それぞれの間に介在する絶縁層(図1の例では第1〜第3の絶縁層31、32、33)とを含んでいる。積層体10は、さらに、積層体10を厚さ方向に貫通する貫通孔10aを有している。ソルダーレジスト層40は、積層体10の第1面10F側において第1面10Fを覆っており、積層体10の第2面10S側において第2面10Sを覆っている。ソルダーレジスト層40は、積層体10の第1面10F及び第2面10Sの一方から他方まで貫通孔10aの内部を通って連続している。そして、ソルダーレジスト層40は、貫通孔10aの内部において貫通孔10aの内壁面10a1を覆っている。図2に示されるように、本実施形態では、貫通孔10aは、平面視における全周に渡ってその内壁面10a1をソルダーレジスト層40に覆われている。 A wiring board according to an embodiment of the present invention will be described with reference to the drawings. 1 and 2 show a cross-sectional view and a plan view of the wiring board 1 which is an example of the wiring board of one embodiment, respectively. FIG. 1 is a cross-sectional view taken along the line II shown in FIG. As shown in FIGS. 1 and 2, the wiring board 1 includes a laminate 10 of an insulating layer and a conductor layer, and a solder resist layer 40. The laminate 10 has a first surface 10F, which is one of two surfaces orthogonal to the thickness direction of the wiring board 1, and a second surface 10S, which is the opposite surface of the first surface 10F. The laminate 10 has two or more conductor layers (first to fourth conductor layers 21, 22, 23, 24 in the example of FIG. 1) and an insulating layer interposed between the two or more conductor layers (FIG. In the example of 1, the first to third insulating layers 31, 32, 33) are included. The laminated body 10 further has a through hole 10a that penetrates the laminated body 10 in the thickness direction. The solder resist layer 40 covers the first surface 10F on the first surface 10F side of the laminated body 10, and covers the second surface 10S on the second surface 10S side of the laminated body 10. The solder resist layer 40 is continuous from one of the first surface 10F and the second surface 10S of the laminated body 10 through the inside of the through hole 10a. The solder resist layer 40 covers the inner wall surface 10a1 of the through hole 10a inside the through hole 10a. As shown in FIG. 2, in the present embodiment, the inner wall surface 10a1 of the through hole 10a is covered with the solder resist layer 40 over the entire circumference in a plan view.

貫通孔10aは、後述されるように、例えば、レーザー加工、又はドリル加工などの機械加工によって形成されることがある。そのような加工によって切削された面であり得る貫通孔10aの内壁面には、加工による切削屑が除去されずに残存することがある。その残存する切削屑は、配線基板1のような回路基板の使用時に貫通孔の内壁面から遊離して塵芥となることがある。そして、そのような塵芥は、貫通孔10a内に浮遊したり、配線基板1及び/又は配線基板1に実装される部品Eの表面に付着したりすることがある。 The through hole 10a may be formed by machining such as laser machining or drilling, as will be described later. On the inner wall surface of the through hole 10a, which may be a surface cut by such processing, cutting chips due to processing may remain without being removed. The remaining cutting debris may be released from the inner wall surface of the through hole to become dust when a circuit board such as the wiring board 1 is used. Then, such dust may float in the through hole 10a or adhere to the surface of the wiring board 1 and / or the component E mounted on the wiring board 1.

しかし本実施形態では、貫通孔10aの内壁面10a1はソルダーレジスト層40によって覆われている。そのため、貫通孔10aの内壁面10a1において積層体10の各導体層及び各絶縁層を形成する導電性又は絶縁性の材料の切削屑などが残存したとしても、そのような切削屑などは貫通孔10a内に遊離し得ない。従って、切削屑などからなる塵芥が、配線基板1に実装され得る部品Eの機能に影響を及ぼすことが防止されると考えられる。 However, in the present embodiment, the inner wall surface 10a1 of the through hole 10a is covered with the solder resist layer 40. Therefore, even if cutting chips of a conductive or insulating material forming each conductor layer and each insulating layer of the laminated body 10 remain on the inner wall surface 10a1 of the through hole 10a, such cutting chips and the like remain through the holes. It cannot be released within 10a. Therefore, it is considered that dust composed of cutting chips and the like is prevented from affecting the function of the component E that can be mounted on the wiring board 1.

また、本実施形態では、貫通孔10aの内壁面10a1は、積層体10の第1面10F及び第2面10Sを覆っているソルダーレジスト層40によって覆われる。すなわち、内壁面10a1は、積層体10の第1面10F及び第2面10Sと一体的に、且つ、第1面10F及び第2面10Sを覆うソルダーレジスト層40と一体の被覆体によって覆われている。ソルダーレジスト層40は、後述するように、接続パッド22a、24aをそれぞれ露出させる開口41、42を有している。ソルダーレジスト層40は、第1面10F及び第2面10Sにおけるはんだショートなどの実装不良を防止すべく、各接続パッド間の分離手段として機能し得る。また、ソルダーレジスト層40は、第2及び第4の導体層22、24の酸化防止手段及び積層体10の機械的保護手段としても機能し得る。 Further, in the present embodiment, the inner wall surface 10a1 of the through hole 10a is covered with the solder resist layer 40 covering the first surface 10F and the second surface 10S of the laminated body 10. That is, the inner wall surface 10a1 is covered with a covering body integrally with the first surface 10F and the second surface 10S of the laminated body 10 and with the solder resist layer 40 covering the first surface 10F and the second surface 10S. ing. The solder resist layer 40 has openings 41 and 42 that expose the connection pads 22a and 24a, respectively, as will be described later. The solder resist layer 40 can function as a separating means between the connection pads in order to prevent mounting defects such as solder shorts on the first surface 10F and the second surface 10S. The solder resist layer 40 can also function as an antioxidant means for the second and fourth conductor layers 22 and 24 and a mechanical protection means for the laminate 10.

本実施形態では、このソルダーレジスト層40を構成し、且つ、第1面10Fから第2面10Sまで連続する被覆体によって、積層体10の第1面10F及び第2面10Sだけでなく、貫通孔10aの内壁面10a1も覆われる。従って、はんだショートなどの抑制と、塵芥による電子機器の機能不良などの抑制との両方をシンプルな構造で実現し得ると考えられる。従って、本実施形態は、配線基板及び/又は配線基板を用いる電子機器の品質向上に寄与し得ると考えられる。 In the present embodiment, the solder resist layer 40 is formed, and the covering body continuous from the first surface 10F to the second surface 10S penetrates not only the first surface 10F and the second surface 10S of the laminated body 10. The inner wall surface 10a1 of the hole 10a is also covered. Therefore, it is considered that both suppression of solder shorts and the like and suppression of malfunctions of electronic devices due to dust can be realized with a simple structure. Therefore, it is considered that this embodiment can contribute to improving the quality of the wiring board and / or the electronic device using the wiring board.

また前述した各手段としての機能を備え得るソルダーレジスト層40で貫通孔10aの内壁面10a1が覆われるので、第1〜第3の絶縁層31〜33で構成される内壁面10a1と良好に密着する被覆体を内壁面10a1上に設けることができる。 Further, since the inner wall surface 10a1 of the through hole 10a is covered with the solder resist layer 40 capable of having the functions as the above-mentioned means, the inner wall surface 10a1 composed of the first to third insulating layers 31 to 33 is in good contact with the inner wall surface 10a1. The covering body to be used can be provided on the inner wall surface 10a1.

図1の例の配線基板1において、第1絶縁層31と、その両面それぞれに積層されている第1導体層21及び第3導体層23とによって配線基板1のコア基板が形成されている。このコア基板を挟んで、第2絶縁層32及び第2導体層22を有するビルドアップ層と、第3絶縁層33及び第4導体層24を有するビルドアップ層とが形成されている。第1絶縁層31には、第1導体層21と第3導体層23とを接続するスルーホール導体31aが形成されている。なお、積層体10に含まれる導体層及び絶縁層の数は図1の例に限定されない、例えば、積層体10は、第1絶縁層31並びに第1及び第3の導体層21、23だけを含んでいてもよく、2組以上の導体層及び絶縁層によって構成されるビルドアップ層を含んでいてもよい。 In the wiring board 1 of the example of FIG. 1, the core substrate of the wiring board 1 is formed by the first insulating layer 31 and the first conductor layer 21 and the third conductor layer 23 laminated on both sides thereof. A build-up layer having the second insulating layer 32 and the second conductor layer 22 and a build-up layer having the third insulating layer 33 and the fourth conductor layer 24 are formed with the core substrate interposed therebetween. The first insulating layer 31 is formed with a through-hole conductor 31a that connects the first conductor layer 21 and the third conductor layer 23. The number of conductor layers and insulating layers included in the laminated body 10 is not limited to the example of FIG. 1. For example, the laminated body 10 includes only the first insulating layer 31 and the first and third conductor layers 21 and 23. It may be included, or may include a build-up layer composed of two or more sets of conductor layers and insulating layers.

なお、配線基板1の説明では、配線基板1の厚さ方向において第1絶縁層31から遠い側は「上側」もしくは「上方」、又は単に「上」とも称され、第1絶縁層31に近い側は「下側」もしくは「下方」、又は単に「下」とも称される。さらに、各導体層及び各絶縁層において、第1絶縁層31と反対側を向く表面は「上面」とも称され、第1絶縁層31側を向く表面は「下面」とも称される。また、配線基板1の厚さ方向は、単に「Z方向」とも称される。 In the description of the wiring board 1, the side far from the first insulating layer 31 in the thickness direction of the wiring board 1 is also referred to as "upper" or "upper", or simply "upper", and is close to the first insulating layer 31. The side is also referred to as "lower" or "lower", or simply "lower". Further, in each conductor layer and each insulating layer, the surface facing the side opposite to the first insulating layer 31 is also referred to as "upper surface", and the surface facing the first insulating layer 31 side is also referred to as "lower surface". Further, the thickness direction of the wiring board 1 is also simply referred to as "Z direction".

積層体10の第1面10F及び第2面10Sは、それぞれ、積層体10を構成する導体層及び絶縁層それぞれにおけるZ方向と略直交する表面のうち、積層体10を構成する他の導体層及び他の絶縁層に接していない部分で構成される。従って、図1の例において、第2導体層22の導体パターンが形成されている領域では第2導体層22の上面が第1面10Fであり、第2導体層22の導体パターンが形成されていない領域では第2絶縁層32の上面が第1面10Fである。同様に、第4導体層24の導体パターンが形成されている領域では第4導体層24の上面が第2面10Sであり、第4導体層24の導体パターンが形成されていない領域では第3絶縁層33の上面が第2面10Sである。 The first surface 10F and the second surface 10S of the laminated body 10 are the other conductor layers constituting the laminated body 10 among the surfaces substantially orthogonal to the Z direction in each of the conductor layer and the insulating layer constituting the laminated body 10. And a part that is not in contact with other insulating layers. Therefore, in the example of FIG. 1, in the region where the conductor pattern of the second conductor layer 22 is formed, the upper surface of the second conductor layer 22 is the first surface 10F, and the conductor pattern of the second conductor layer 22 is formed. In the absence region, the upper surface of the second insulating layer 32 is the first surface 10F. Similarly, in the region where the conductor pattern of the fourth conductor layer 24 is formed, the upper surface of the fourth conductor layer 24 is the second surface 10S, and in the region where the conductor pattern of the fourth conductor layer 24 is not formed, the third surface is the third. The upper surface of the insulating layer 33 is the second surface 10S.

各導体層(第1〜第4の導体層21〜24)は、例えば、金属箔、無電解めっき膜、及び、電解めっき膜を有し得る。各導体層は、例えば、銅、ニッケル、銀、パラジウムなどの任意の金属を単独で又は組み合わせて用いて形成され得る。 Each conductor layer (first to fourth conductor layers 21 to 24) may have, for example, a metal foil, an electroless plating film, and an electrolytic plating film. Each conductor layer can be formed, for example, with any metal such as copper, nickel, silver, palladium, alone or in combination.

各絶縁層(第1〜第3の絶縁層31〜33)は、任意の絶縁性材料を用いて形成される。絶縁性材料としては、エポキシ樹脂、ビスマレイミドトリアジン樹脂(BT樹脂)又はフェノール樹脂などが例示される。これらの樹脂を用いて形成される各絶縁層は、ガラス繊維又はアラミド繊維などの補強材、及び/又は、シリカなどの無機フィラーを含んでいてもよい。 Each insulating layer (first to third insulating layers 31 to 33) is formed by using an arbitrary insulating material. Examples of the insulating material include epoxy resin, bismaleimide triazine resin (BT resin), and phenol resin. Each insulating layer formed using these resins may contain a reinforcing material such as glass fiber or aramid fiber and / or an inorganic filler such as silica.

第2絶縁層32は、第2絶縁層32を貫通し、第1導体層21と第2導体層22とを接続するビア導体51を含んでいる。第3絶縁層33は、第3絶縁層33を貫通し、第3導体層23と第4導体層24とを接続するビア導体52を含んでいる。ビア導体51、52は、第2及び第3の絶縁層32、33それぞれを貫く貫通孔を導電体で埋めることによって形成された、所謂フィルドビアである。ビア導体51、52は、それぞれの上側の導体層と一体的に形成されている。従ってビア導体51、52は、例えば、銅又はニッケルなどからなる無電解めっき膜及び電解めっき膜によって形成されている。スルーホール導体31aも、銅又はニッケルなどからなる無電解めっき膜及び電解めっき膜によって形成されている。 The second insulating layer 32 includes a via conductor 51 that penetrates the second insulating layer 32 and connects the first conductor layer 21 and the second conductor layer 22. The third insulating layer 33 includes a via conductor 52 that penetrates the third insulating layer 33 and connects the third conductor layer 23 and the fourth conductor layer 24. The via conductors 51 and 52 are so-called filled vias formed by filling through holes penetrating the second and third insulating layers 32 and 33 with a conductor. The via conductors 51 and 52 are integrally formed with the respective upper conductor layers. Therefore, the via conductors 51 and 52 are formed of, for example, an electroless plating film and an electrolytic plating film made of copper, nickel, or the like. The through-hole conductor 31a is also formed of an electroless plating film and an electrolytic plating film made of copper, nickel, or the like.

積層体10の第1面10F側の最表層の導体層である第2導体層22は、配線基板1に実装される部品Eに対する接続パッド22aを有している。部品Eは、図1の例の様に、貫通孔10aを跨ぐように配線基板1に実装され得る。その場合、部品Eは、貫通孔10aを通過する光を受光又は出射する、撮像素子のような受光素子、又は発光素子を含む光学系要素を含む電子部品であってもよい。また、部品Eは、貫通孔10aを通過する電波を受信又は発信する無線通信機能を有する電子部品であってもよく、また、レンズなどの光学部品であってもよい。 The second conductor layer 22, which is the outermost conductor layer on the first surface 10F side of the laminated body 10, has a connection pad 22a for the component E mounted on the wiring board 1. The component E can be mounted on the wiring board 1 so as to straddle the through hole 10a as in the example of FIG. In that case, the component E may be an electronic component including a light receiving element such as an image pickup element or an optical system element including a light emitting element that receives or emits light passing through the through hole 10a. Further, the component E may be an electronic component having a wireless communication function for receiving or transmitting radio waves passing through the through hole 10a, or may be an optical component such as a lens.

このような部品Eが配線基板1に実装される場合、貫通孔10aは、光路又は導波路として機能し得る。そのような機能を有し得る貫通孔10a内に塵芥が浮遊していると、部品Eの機能がその影響を受ける虞があるが、本実施形態では、ソルダーレジスト層40によってそのような状況が回避され得る。配線基板1が用いられる電子機器の品質向上に寄与し得ると考えられる。 When such a component E is mounted on the wiring board 1, the through hole 10a can function as an optical path or a waveguide. If dust is suspended in the through hole 10a capable of having such a function, the function of the component E may be affected by the dust, but in the present embodiment, such a situation is caused by the solder resist layer 40. Can be avoided. It is considered that the wiring board 1 can contribute to improving the quality of the electronic device used.

なお、積層体10の第2面10S側の最表層の導体層である第4導体層24が、貫通孔10aを跨ぐように配線基板1に実装される部品Eに対する接続パッド22aを含んでいてもよい。第2及び第4の導体層22、24のいずれか一方に接続パッド22aが設けられてもよく、両方の導体層に接続パッド22aが設けられてもよい。 The fourth conductor layer 24, which is the outermost conductor layer on the second surface 10S side of the laminated body 10, includes a connection pad 22a for the component E mounted on the wiring board 1 so as to straddle the through hole 10a. May be good. The connection pad 22a may be provided on either one of the second and fourth conductor layers 22 and 24, or the connection pad 22a may be provided on both conductor layers.

図1の例において、第4導体層24は、複数の接続パッド24aを含んでいる。前述した第2導体層22に含まれる接続パッド22aのそれぞれは、ビア導体51、第1導体層21、スルーホール導体31a、第3導体層23、及びビア導体52を介して、複数の接続パッド24aのうちの1つ又は複数と電気的に接続され得る。図示されていないが、接続パッド22a、24aの表面には、Au、Ni/Au、Ni/Pd/Au、はんだ、又は耐熱性プリフラックスなどからなる表面保護膜が形成されていてもよい。 In the example of FIG. 1, the fourth conductor layer 24 includes a plurality of connection pads 24a. Each of the connection pads 22a included in the second conductor layer 22 described above has a plurality of connection pads via the via conductor 51, the first conductor layer 21, the through-hole conductor 31a, the third conductor layer 23, and the via conductor 52. It may be electrically connected to one or more of 24a. Although not shown, a surface protective film made of Au, Ni / Au, Ni / Pd / Au, solder, heat-resistant preflux, or the like may be formed on the surfaces of the connection pads 22a and 24a.

ソルダーレジスト層40は、接続パッド22aを露出させる開口41、及び、接続パッド24aを露出させる開口42を有している。ソルダーレジスト層40は、絶縁性を有する任意の材料を用いて形成され得る。ソルダーレジスト層40の材料は、例えばエポキシ樹脂、ポリイミド樹脂などを主原料として構成され得る。複数の開口41、42それぞれをファインピッチで並ぶように形成することができ、しかも、貫通孔10aの内壁面10a1上に、ソルダーレジスト層40の材料を十分に付着させることができる。 The solder resist layer 40 has an opening 41 for exposing the connection pad 22a and an opening 42 for exposing the connection pad 24a. The solder resist layer 40 can be formed by using any material having an insulating property. The material of the solder resist layer 40 may be composed of, for example, an epoxy resin, a polyimide resin, or the like as a main raw material. The plurality of openings 41 and 42 can be formed so as to be lined up at a fine pitch, and the material of the solder resist layer 40 can be sufficiently adhered to the inner wall surface 10a1 of the through hole 10a.

図1の配線基板1では、ソルダーレジスト層40において貫通孔10aの内壁面10a1を覆っている部分の表面は、貫通孔10aの内部に向って凸となるように湾曲している。すなわち、貫通孔10aの内壁面10a1上のソルダーレジスト層40の厚さは、Z方向の中央部分で厚く、第1面10F及び第2面10Sの近傍において薄い。図1の例では、配線基板1のZ方向の中央部分を構成する第1絶縁層31は配線基板1のコア層である。そのため、第1絶縁層31には、適度な剛性を得るべくガラス繊維又はアラミド繊維などの補強材が含められることがある。そのような繊維状の材料を第1絶縁層31が含んでいる場合、貫通孔10aの形成によって切断された繊維屑が、内壁面10a1におけるZ方向の中央部分から比較的長く突出することがある。図1の例のように内壁面10a1上において湾曲する表面を有するソルダーレジスト層40は、そのような繊維屑を露出させずに覆い易い点で好ましい。 In the wiring board 1 of FIG. 1, the surface of the portion of the solder resist layer 40 that covers the inner wall surface 10a1 of the through hole 10a is curved so as to be convex toward the inside of the through hole 10a. That is, the thickness of the solder resist layer 40 on the inner wall surface 10a1 of the through hole 10a is thick in the central portion in the Z direction and thin in the vicinity of the first surface 10F and the second surface 10S. In the example of FIG. 1, the first insulating layer 31 forming the central portion of the wiring board 1 in the Z direction is the core layer of the wiring board 1. Therefore, the first insulating layer 31 may include a reinforcing material such as glass fiber or aramid fiber in order to obtain appropriate rigidity. When the first insulating layer 31 contains such a fibrous material, the fiber debris cut by the formation of the through hole 10a may protrude relatively long from the central portion of the inner wall surface 10a1 in the Z direction. .. The solder resist layer 40 having a curved surface on the inner wall surface 10a1 as in the example of FIG. 1 is preferable because it is easy to cover such fiber debris without exposing it.

図1の例において、内壁面10a1上のソルダーレジスト層40の最大の厚さT1としては、10μm以上、80μm以下が例示される。また、積層体10の第1面10F上及び第2面10S上におけるソルダーレジスト層40の厚さT2としては、10μm以上、50μm以下が例示される。また厚さT1と厚さT2との比(T1/T2)は、例えば1.0以上、3.0以下である。厚さT1と厚さT2との比がこの範囲内にあれば、第1面10F上及び第2面10S上と内壁面10a1上との間でのソルダーレジスト層40の厚さ方向の熱膨張量(熱収縮量)の差異によるソルダーレジスト層40の歪みや剥離が生じ難いと考えられる。 In the example of FIG. 1, the maximum thickness T1 of the solder resist layer 40 on the inner wall surface 10a1 is 10 μm or more and 80 μm or less. Further, examples of the thickness T2 of the solder resist layer 40 on the first surface 10F and the second surface 10S of the laminated body 10 are 10 μm or more and 50 μm or less. The ratio of the thickness T1 to the thickness T2 (T1 / T2) is, for example, 1.0 or more and 3.0 or less. If the ratio of the thickness T1 to the thickness T2 is within this range, thermal expansion in the thickness direction of the solder resist layer 40 between the first surface 10F and the second surface 10S and the inner wall surface 10a1. It is considered that the solder resist layer 40 is unlikely to be distorted or peeled due to the difference in the amount (heat shrinkage amount).

図2に示されるように、図1の配線基板1が有する貫通孔10aは、全体として矩形の平面形状を有しており、配線基板1の略中央部に形成されている。前述したように、ソルダーレジスト層40は、平面視で貫通孔10aの全周に渡って内壁面10a1を覆っている。なお、図2の例と異なり、内壁面10a1は、必ずしも貫通孔10aの周囲全周に渡ってソルダーレジスト層40によって覆われていなくてもよい。貫通孔10aの内壁面10a1が部分的に露出していても、少なくともソルダーレジスト層40に覆われている部分からの塵芥の離脱は防止され得る。 As shown in FIG. 2, the through hole 10a included in the wiring board 1 of FIG. 1 has a rectangular planar shape as a whole, and is formed in a substantially central portion of the wiring board 1. As described above, the solder resist layer 40 covers the inner wall surface 10a1 over the entire circumference of the through hole 10a in a plan view. Unlike the example of FIG. 2, the inner wall surface 10a1 does not necessarily have to be covered with the solder resist layer 40 over the entire circumference of the through hole 10a. Even if the inner wall surface 10a1 of the through hole 10a is partially exposed, the detachment of dust from at least the portion covered with the solder resist layer 40 can be prevented.

図2の例において、複数の接続パッド22aは、貫通孔10aの対向する一組の2辺それぞれの外側にこの2辺に沿って配列され、ソルダーレジスト層40の開口41内に露出している。配線基板1に実装される部品E(図1参照)は、例えば、貫通孔10aを跨ぐように配線基板1に搭載され、部品Eの所定の端子(図示せず)が接続パッド22aに接続される。接続パッド22aは、図2の例に限定されず、部品Eに応じて任意の位置に任意の数だけ設けられる。接続パッド22aは、例えば、略矩形の貫通孔10aの4辺それぞれの外側に、この4辺それぞれに沿って配列されてもよい。 In the example of FIG. 2, the plurality of connection pads 22a are arranged along the two sides of the pair of facing holes 10a facing each other, and are exposed in the opening 41 of the solder resist layer 40. .. The component E (see FIG. 1) mounted on the wiring board 1 is mounted on the wiring board 1 so as to straddle the through hole 10a, and a predetermined terminal (not shown) of the component E is connected to the connection pad 22a. To. The connection pads 22a are not limited to the example of FIG. 2, and an arbitrary number of connection pads 22a are provided at an arbitrary position according to the component E. The connection pads 22a may be arranged, for example, on the outside of each of the four sides of the substantially rectangular through hole 10a along each of the four sides.

ソルダーレジスト層40の貫通孔10a内での断面形状は、図1に例示されるような湾曲する表面を有する形状に限定されない。図3には、図1の配線基板1の変形例が示されており、その変形例における図1のIII部に相当する部分が示されている。 The cross-sectional shape of the solder resist layer 40 in the through hole 10a is not limited to the shape having a curved surface as illustrated in FIG. FIG. 3 shows a modified example of the wiring board 1 of FIG. 1, and a portion corresponding to part III of FIG. 1 in the modified example is shown.

図3の変形例では、ソルダーレジスト層40は、貫通孔10aの内壁面10a1を覆っている部分において略平坦な表面を有している。ソルダーレジスト層40の表面が貫通孔10aの内部に向って湾曲していないので、貫通孔10aの開口サイズを図1の例に比べて小さくできることがある。ソルダーレジスト層40は、貫通孔10a内において、このような平坦な表面を有していてもよく、貫通孔10aの内壁面10a1さえ意図せず露出しなければ、内壁面10a1に向って凹むように湾曲する表面を有していてもよい。図3におけるソルダーレジスト層40以外の構成要素の構造及び形状は図1の例と同様であるため、それらの構成要素に関する説明は省略される。 In the modified example of FIG. 3, the solder resist layer 40 has a substantially flat surface at a portion covering the inner wall surface 10a1 of the through hole 10a. Since the surface of the solder resist layer 40 is not curved toward the inside of the through hole 10a, the opening size of the through hole 10a may be smaller than that in the example of FIG. The solder resist layer 40 may have such a flat surface in the through hole 10a, and if even the inner wall surface 10a1 of the through hole 10a is not unintentionally exposed, the solder resist layer 40 is recessed toward the inner wall surface 10a1. It may have a curved surface. Since the structures and shapes of the components other than the solder resist layer 40 in FIG. 3 are the same as those in the example of FIG. 1, the description of these components is omitted.

図4A及び図4Bには、図1の配線基板1のさらに他の例である配線基板1aの断面図と平面図とが、それぞれ示されている。図4Aは、図4Bに示されるIVA−IVA線での断面図である。図4A及び図4Bに示されるように、配線基板1aのソルダーレジスト層40は、積層体10の第1面10F及び第2面10Sのそれぞれにおいて、貫通孔10aの周囲に開口40aを有している。開口40aには、積層体10の第1面10F又は第2面10Sが露出している。 4A and 4B show a cross-sectional view and a plan view of the wiring board 1a, which is still another example of the wiring board 1 of FIG. 1, respectively. FIG. 4A is a cross-sectional view taken along the line IVA-IVA shown in FIG. 4B. As shown in FIGS. 4A and 4B, the solder resist layer 40 of the wiring board 1a has an opening 40a around the through hole 10a on each of the first surface 10F and the second surface 10S of the laminated body 10. There is. The first surface 10F or the second surface 10S of the laminated body 10 is exposed in the opening 40a.

配線基板1aでは、図4Bに示されるように、複数の開口40aが、平面視で貫通孔10aの周囲に貫通孔10aを囲むように形成されている。また、複数の開口40aそれぞれは、スリット状の平面形状を有し、一連の開口40aが、貫通孔10aの平面視における各辺に沿って、ミシン目状に一列に配列されている。貫通孔10aの周囲に開口40aのようなソルダーレジスト層40の不連続部を設けることによって、前述した、第1面10F上及び第2面10S上と内壁面10a1上のとの間でのソルダーレジスト層40の熱膨張量(熱収縮量)の差異による歪みを吸収できることがある。従ってソルダーレジスト層40の剥離などを防止できることがある。 In the wiring board 1a, as shown in FIG. 4B, a plurality of openings 40a are formed so as to surround the through hole 10a in a plan view. Further, each of the plurality of openings 40a has a slit-shaped planar shape, and a series of openings 40a are arranged in a perforated line along each side of the through hole 10a in a plan view. By providing a discontinuous portion of the solder resist layer 40 such as an opening 40a around the through hole 10a, the solder between the first surface 10F and the second surface 10S and the inner wall surface 10a1 described above. It may be possible to absorb strain due to a difference in the amount of thermal expansion (amount of thermal contraction) of the resist layer 40. Therefore, peeling of the solder resist layer 40 may be prevented.

図4Bの例では、複数の開口40aのそれぞれは、接続パッド22aに対応するように形成されている。すなわち、複数の開口40aの配列ピッチと、接続パッド22aの配列ピッチとは略等しい。複数の開口40aそれぞれと、各接続パッド22それぞれとが対向している。また、貫通孔10aを挟んで対向する2つの接続パッド22a、及び、貫通孔10a挟んで対向する2つの開口40aが、一列に並べられている。開口40aのような不連続部がこのように形成されると、部品Eの実装後に部品Eとソルダーレジスト層40との熱膨張率の違いによって生じ得る応力が不連続部によって緩和されると推定される。従って、ソルダーレジスト層40にクラックなどが生じ難いと考えられる。 In the example of FIG. 4B, each of the plurality of openings 40a is formed so as to correspond to the connection pad 22a. That is, the arrangement pitch of the plurality of openings 40a and the arrangement pitch of the connection pad 22a are substantially equal to each other. Each of the plurality of openings 40a and each of the connection pads 22 face each other. Further, two connection pads 22a facing each other across the through hole 10a and two openings 40a facing each other across the through hole 10a are arranged in a row. When a discontinuity such as the opening 40a is formed in this way, it is estimated that the stress that may occur due to the difference in the coefficient of thermal expansion between the component E and the solder resist layer 40 after mounting the component E is relaxed by the discontinuity. Will be done. Therefore, it is considered that cracks and the like are unlikely to occur in the solder resist layer 40.

また、図4A及び図4Bの例では、開口40aは、貫通孔10aと接続パッド22aとの間に形成されている。配線基板1aに部品Eが実装されると、接続パッド22aの周囲にアンダーフィル材などの保護樹脂(図示せず)が充填されることがある。その場合、保護樹脂の充填時に保護樹脂が貫通孔10a内に流れ込むおそれがある。しかし、図4A及び図4Bの例のように、開口40aのような不連続部が部品Eの実装面(図4Aでは第1面10F)に形成されていると、ある程度の量の保護樹脂が不連続部内に流れ込んで滞留し得ると考えられる。従って、貫通孔10a内への保護樹脂の流入が防止され易いと考えられる。 Further, in the examples of FIGS. 4A and 4B, the opening 40a is formed between the through hole 10a and the connection pad 22a. When the component E is mounted on the wiring board 1a, a protective resin (not shown) such as an underfill material may be filled around the connection pad 22a. In that case, the protective resin may flow into the through hole 10a when the protective resin is filled. However, as in the examples of FIGS. 4A and 4B, when a discontinuity portion such as the opening 40a is formed on the mounting surface of the component E (first surface 10F in FIG. 4A), a certain amount of protective resin is formed. It is considered that it may flow into the discontinuity and stay there. Therefore, it is considered that the inflow of the protective resin into the through hole 10a is likely to be prevented.

開口40aのような不連続部の平面形状、及び複数の不連続部の配列は、図4Bの例に限定されない。例えば、不連続部として1つの連続的な溝が形成され、その溝によって貫通孔10aが囲まれていてもよい。不連続部は任意の平面形状を有し得る。また、不連続部は必ずしも貫通孔10aをその周囲全周に渡って囲んでいなくてもよい。また、開口40aのような不連続部は、図4Aの例の様に、積層体10の第1面10F及び第2面10Sの両方に設けられていなくてもよい。第1面10Fと第2面10Sとのいずれか一方だけに、例えば部品Eが実装される面だけに、設けられていてもよい。図4A及び図4Bにおけるソルダーレジスト層40の不連続部以外の構成要素の構造及び形状は、図1の例と同様であるため、それらの構成要素に関する説明は省略される。 The planar shape of the discontinuous portion such as the opening 40a and the arrangement of the plurality of discontinuous portions are not limited to the example of FIG. 4B. For example, one continuous groove may be formed as a discontinuous portion, and the through hole 10a may be surrounded by the groove. The discontinuity can have any planar shape. Further, the discontinuous portion does not necessarily have to surround the through hole 10a over the entire circumference thereof. Further, the discontinuous portion such as the opening 40a may not be provided on both the first surface 10F and the second surface 10S of the laminated body 10, as in the example of FIG. 4A. It may be provided on only one of the first surface 10F and the second surface 10S, for example, only on the surface on which the component E is mounted. Since the structures and shapes of the components other than the discontinuous portion of the solder resist layer 40 in FIGS. 4A and 4B are the same as those in the example of FIG. 1, the description of these components is omitted.

つぎに、図1に示される配線基板1を例に、一実施形態の配線基板の製造方法が、図5A〜図5Cを参照して説明される。 Next, the method for manufacturing the wiring board of one embodiment will be described with reference to FIGS. 5A to 5C, using the wiring board 1 shown in FIG. 1 as an example.

図5Aに示されるように、本実施形態の配線基板の製造方法は、2以上の導体層(図5Aでは第1〜第4の導体層21、22、23、24)と、この2以上の導体層それぞれの間に介在する絶縁層(図5Aでは、第1〜第3の絶縁層31、32、33)とを含む積層体10を用意することを含んでいる。積層体10は、例えば第1絶縁層31の一方の表面に第1導体層21、第2絶縁層32、及び第2導体層22を順に形成すると共に、第1絶縁層31の他方の表面に第3導体層23、第3絶縁層33、及び第4導体層24を順に形成することによって用意される。 As shown in FIG. 5A, the method for manufacturing the wiring board of the present embodiment includes two or more conductor layers (first to fourth conductor layers 21, 22, 23, 24 in FIG. 5A) and two or more conductor layers. It includes preparing a laminate 10 including an insulating layer (in FIG. 5A, the first to third insulating layers 31, 32, 33) interposed between the conductor layers. The laminate 10 forms, for example, the first conductor layer 21, the second insulating layer 32, and the second conductor layer 22 in this order on one surface of the first insulating layer 31, and on the other surface of the first insulating layer 31. It is prepared by forming the third conductor layer 23, the third insulating layer 33, and the fourth conductor layer 24 in this order.

例えば第1絶縁層31となる絶縁基板とその両面それぞれに積層された銅箔とを有する両面銅張積層板が用意される。両面銅張積層板には、レーザー加工によって、スルーホール導体31aを形成するための貫通孔が形成され、貫通孔の内壁及び両面銅張積層板の表面上に無電解めっき又はスパッタリングなどによって導体膜が形成される。そして、この導体膜をシード層及び給電層として用いる電解めっき、及び、適切なマスクを用いるエッチングなどを含むサブトラクティブ法によって、所望の導体パターンを有する第1導体層21及び第3導体層23、並びにスルーホール導体31aが形成される。即ち配線基板1のコア基板が形成される。第1及び第3の導体層21、23、並びにスルーホール導体31aは、セミアディティブ法によって形成されてもよい。 For example, a double-sided copper-clad laminate having an insulating substrate to be the first insulating layer 31 and copper foil laminated on both sides thereof is prepared. A through hole for forming a through-hole conductor 31a is formed in the double-sided copper-clad laminate by laser processing, and a conductor film is formed on the inner wall of the through hole and the surface of the double-sided copper-clad laminate by electroless plating or sputtering. Is formed. Then, the first conductor layer 21 and the third conductor layer 23 having a desired conductor pattern are subjected to a subtractive method including electroplating using this conductor film as a seed layer and a feeding layer, and etching using an appropriate mask. In addition, a through-hole conductor 31a is formed. That is, the core substrate of the wiring board 1 is formed. The first and third conductor layers 21, 23, and the through-hole conductor 31a may be formed by a semi-additive method.

第1導体層21上、及び第1導体層21の導体パターン間に露出する第1絶縁層31の露出面上に、例えばシート状のエポキシ樹脂が積層され、熱圧着されることによって、第2絶縁層32が形成される。第2絶縁層32の形成と同様の方法で、好ましくは第2絶縁層32の形成と同時に、第3導体層23上、及び第3導体層23の導体パターン間に露出する第1絶縁層31の露出面上に第3絶縁層33が形成される。第2及び第3の絶縁層32、33の形成において、銅箔などの金属箔が、第2及び第3の絶縁層32、33の上に熱圧着されてもよい。第2及び第3の絶縁層32、33には、所定の位置に、ビア導体51、52の形成用の孔が、レーザー光の照射などによって形成される。 A sheet-like epoxy resin is laminated on the exposed surface of the first insulating layer 31 exposed between the conductor patterns of the first conductor layer 21 and the first conductor layer 21, and is thermocompression bonded to the second. The insulating layer 32 is formed. The first insulating layer 31 is exposed on the third conductor layer 23 and between the conductor patterns of the third conductor layer 23, preferably at the same time as the formation of the second insulating layer 32, in the same manner as the formation of the second insulating layer 32. A third insulating layer 33 is formed on the exposed surface of the above. In the formation of the second and third insulating layers 32 and 33, a metal foil such as a copper foil may be thermocompression bonded onto the second and third insulating layers 32 and 33. Holes for forming the via conductors 51 and 52 are formed in the second and third insulating layers 32 and 33 at predetermined positions by irradiation with laser light or the like.

そして、例えばセミアディティブ法によって、第2絶縁層32の上に所望の導体パターンを有する第2導体層22が形成され、第2絶縁層32内にビア導体51が形成される。また、第2導体層22及びビア導体51の形成方法と同様の方法で、好ましくは第2導体層22の形成と同時に、第3絶縁層33の上に所望の導体パターンを有する第4導体層24が形成され、第3絶縁層33内にビア導体52が形成される。例えば、以上の工程を経ることによって、第2導体層22側の表面として第1面10Fを有し、第4導体層24側の表面として第2面10Sを有する積層体10が用意される。 Then, for example, by a semi-additive method, a second conductor layer 22 having a desired conductor pattern is formed on the second insulating layer 32, and a via conductor 51 is formed in the second insulating layer 32. Further, a fourth conductor layer having a desired conductor pattern on the third insulating layer 33 at the same time as the formation of the second conductor layer 22 is preferably performed by the same method as the method for forming the second conductor layer 22 and the via conductor 51. 24 is formed, and the via conductor 52 is formed in the third insulating layer 33. For example, by going through the above steps, a laminate 10 having a first surface 10F as a surface on the second conductor layer 22 side and a second surface 10S as a surface on the fourth conductor layer 24 side is prepared.

図5Bに示されるように、本実施形態の配線基板の製造方法は、さらに、積層体10を積層体10の厚さ方向に貫通する貫通孔10aを積層体10の所定の領域に形成することを含んでいる。貫通孔10aの形成方法としては、ドリル加工、ルーター加工又はレーザー加工などが例示されるが、貫通孔10aの形成方法はこれらに限定されない。レーザー加工によって貫通孔10aが形成される場合は、例えば、CO2レーザーなどによるレーザー光が、積層体10における貫通孔10aの形成領域の輪郭に沿って照射される。そしてレーザー光の照射経路に囲まれた部分が引き抜かれることによって貫通孔10aが形成され得る。 As shown in FIG. 5B, in the method for manufacturing a wiring board of the present embodiment, a through hole 10a that penetrates the laminated body 10 in the thickness direction of the laminated body 10 is further formed in a predetermined region of the laminated body 10. Includes. Examples of the method for forming the through hole 10a include drilling, router processing, and laser processing, but the method for forming the through hole 10a is not limited to these. When the through hole 10a is formed by laser processing, for example, laser light from a CO 2 laser or the like is irradiated along the contour of the formation region of the through hole 10a in the laminated body 10. Then, the through hole 10a can be formed by pulling out the portion surrounded by the irradiation path of the laser light.

図5Cに示されるように、本実施形態の配線基板の製造方法は、さらに、積層体10の第1面10F及び第2面10Sを覆うソルダーレジスト層40を形成すること、及び、貫通孔10aの内壁面10a1を、ソルダーレジスト層40と一体の樹脂膜によって覆うことを含んでいる。ソルダーレジスト層40は、図5Cに示されるように、貫通孔10aの内部を通って、積層体10の第1面10F及び第2面10Sの一方から他方まで連続するように形成される。そのようにソルダーレジスト層40を形成することによって、貫通孔10aの内壁面10a1が、ソルダーレジスト層40の一部である樹脂膜によって覆われる。 As shown in FIG. 5C, the method for manufacturing the wiring board of the present embodiment further forms a solder resist layer 40 covering the first surface 10F and the second surface 10S of the laminate 10, and the through hole 10a. The inner wall surface 10a1 of the above is covered with a resin film integrated with the solder resist layer 40. As shown in FIG. 5C, the solder resist layer 40 is formed so as to pass through the inside of the through hole 10a and be continuous from one of the first surface 10F and the second surface 10S of the laminated body 10. By forming the solder resist layer 40 in this way, the inner wall surface 10a1 of the through hole 10a is covered with the resin film which is a part of the solder resist layer 40.

ソルダーレジスト層40の形成では、例えば、感光性の樹脂を積層体10に供給することによって、図5Cに示されるように、貫通孔10aの内壁面10a1と共に、積層体10の第1面10F及び第2面10Sの全面を覆うソルダーレジスト層40が形成される。前述したように、ソルダーレジスト層40を形成する樹脂としてはエポキシ樹脂などが例示される。エポキシ樹脂などのソルダーレジスト層40の材料は、例えば、インクジェット、スピンコ―ティング、スプレーコーティング、又はロールコーティングなどの任意の方法によって供給される。このような方法によって、貫通孔10aの内壁面10a1にも、十分な量の樹脂が供給され得る。 In the formation of the solder resist layer 40, for example, by supplying a photosensitive resin to the laminate 10, as shown in FIG. 5C, together with the inner wall surface 10a1 of the through hole 10a, the first surface 10F of the laminate 10 and A solder resist layer 40 is formed so as to cover the entire surface of the second surface 10S. As described above, an epoxy resin or the like is exemplified as the resin forming the solder resist layer 40. The material of the solder resist layer 40, such as an epoxy resin, is supplied by any method such as, for example, inkjet, spin coating, spray coating, or roll coating. By such a method, a sufficient amount of resin can be supplied to the inner wall surface 10a1 of the through hole 10a.

本実施形態において、ソルダーレジスト層40を形成することは、積層体10の第1面10F及び第2面10Sの全面に形成されたソルダージスト層40に、接続パッド22a、24aをそれぞれ露出させる開口を形成することを含んでいてもよい。例えば、本硬化前のソルダーレジスト層40に対して、適切な開口パターンを有する露光マスクを用いた露光、及び現像が行われ、接続パッド22a、24aを露出させる開口が形成される。前述した不連続部が設けられる場合は、接続パッド22a、24aを露出させる開口の形成と共に形成され得る。その後、ソルダーレジスト層40は、例えば加熱されることによって最終的な状態へと本硬化される。以上の工程を経ることによって図1に示される配線基板1が完成する。 In the present embodiment, forming the solder resist layer 40 is an opening that exposes the connection pads 22a and 24a to the solder gist layer 40 formed on the entire surfaces of the first surface 10F and the second surface 10S of the laminate 10. May include forming. For example, the solder resist layer 40 before the main curing is exposed and developed using an exposure mask having an appropriate aperture pattern to form openings for exposing the connection pads 22a and 24a. When the above-mentioned discontinuity is provided, it can be formed together with the formation of an opening that exposes the connection pads 22a, 24a. After that, the solder resist layer 40 is finally cured to the final state by heating, for example. By going through the above steps, the wiring board 1 shown in FIG. 1 is completed.

なお、ソルダーレジスト層40への開口の形成後、必要に応じて、接続パッド22a、24aに表面保護膜(図示せず)が形成されてもよい。例えば、無電解めっき、半田レベラ、又はスプレーコーティングなどによって、Au、Ni/Au、Ni/Pd/Au、はんだ、又は耐熱性プリフラックスなどからなる表面保護膜が形成され得る。 After forming the opening in the solder resist layer 40, a surface protective film (not shown) may be formed on the connection pads 22a and 24a, if necessary. For example, electroless plating, solder leveler, spray coating, or the like can form a surface protective film made of Au, Ni / Au, Ni / Pd / Au, solder, heat-resistant preflux, or the like.

実施形態の配線基板は、各図面に例示される構造、並びに、本明細書において例示された構造、形状、及び材料を備えるものに限定されない。例えば、貫通孔10aは、平面視で配線基板1の任意の位置に設けられ得る。また、積層体10は、コア基板を有さず一方向に導体層と絶縁層とが積層された所謂コアレス基板であってもよい。また、ビア導体51、52及びスルーホール導体31aは必ずしも形成されていなくてもよい。 The wiring board of the embodiment is not limited to the structure exemplified in each drawing and the structure, shape, and material exemplified in this specification. For example, the through hole 10a can be provided at an arbitrary position on the wiring board 1 in a plan view. Further, the laminated body 10 may be a so-called coreless substrate in which a conductor layer and an insulating layer are laminated in one direction without having a core substrate. Further, the via conductors 51 and 52 and the through-hole conductor 31a do not necessarily have to be formed.

実施形態の配線基板の製造方法は、各図面を参照して説明された方法に限定されない。例えば、第2及び第4の導体層22、24がサブトラクティブ法でパターニングされてもよい。また、ソルダーレジスト層40は、必ずしも、その形成過程において一旦積層体10の全面を覆うように形成されなくてもよい。例えば、マスクを用いたスプレーコーティングなどによって、所望される部分だけを覆うソルダーレジスト層40が、ソルダーレジスト層40の形成において最初から形成されてもよい。実施形態の配線基板の製造方法には、前述された各工程以外に任意の工程が追加されてもよく、前述された工程のうちの一部が省略されてもよい。 The method for manufacturing the wiring board of the embodiment is not limited to the method described with reference to each drawing. For example, the second and fourth conductor layers 22 and 24 may be patterned by the subtractive method. Further, the solder resist layer 40 does not necessarily have to be formed so as to cover the entire surface of the laminated body 10 once in the forming process. For example, the solder resist layer 40 that covers only the desired portion may be formed from the beginning in the formation of the solder resist layer 40 by spray coating using a mask or the like. Arbitrary steps may be added to the method for manufacturing the wiring board of the embodiment in addition to the above-mentioned steps, or a part of the above-mentioned steps may be omitted.

1、1a 配線基板
10 積層体
10a 貫通孔
10a1 内壁面
21 第1導体層
22 第2導体層
23 第3導体層
24 第4導体層
22a 接続パッド
31 第1絶縁層(コア層)
32 第2絶縁層
33 第3絶縁層
40 ソルダーレジスト層
40a 開口(不連続部)
E 部品
1, 1a Wiring board 10 Laminated body 10a Through hole 10a 1 Inner wall surface 21 First conductor layer 22 Second conductor layer 23 Third conductor layer 24 Fourth conductor layer 22a Connection pad 31 First insulating layer (core layer)
32 Second insulating layer 33 Third insulating layer 40 Solder resist layer 40a Aperture (discontinuous part)
E parts

Claims (5)

第1面及び前記第1面の反対面である第2面を有していて、2以上の導体層と前記2以上の導体層それぞれの間に介在する絶縁層とを含む積層体と、
前記積層体の前記第1面及び前記第2面を覆っているソルダーレジスト層と、
を有する配線基板であって、
前記積層体は前記積層体を厚さ方向に貫通する貫通孔をさらに有し、
前記ソルダーレジスト層は、前記積層体の前記第1面及び前記第2面の一方から他方まで前記貫通孔の内部を通って連続していて前記内部において前記貫通孔の内壁面を覆っている。
A laminate having a first surface and a second surface opposite to the first surface, and including two or more conductor layers and an insulating layer interposed between the two or more conductor layers.
A solder resist layer covering the first surface and the second surface of the laminate, and
It is a wiring board having
The laminate further has through holes that penetrate the laminate in the thickness direction.
The solder resist layer is continuous from one of the first surface and the second surface of the laminate through the inside of the through hole and covers the inner wall surface of the through hole in the inside.
請求項1記載の配線基板であって、前記ソルダーレジスト層は、前記積層体の前記第1面上及び前記第2面上のいずれか又は両方における前記貫通孔の周囲に部分的な不連続部を有している。 The wiring board according to claim 1, wherein the solder resist layer is a partially discontinuous portion around the through hole on the first surface and / or both of the first surface and the second surface of the laminate. have. 請求項1記載の配線基板であって、前記ソルダーレジスト層における前記貫通孔の内壁面を覆っている部分の表面は、前記貫通孔の内部に向って凸となるように湾曲している。 The surface of the wiring board according to claim 1, which covers the inner wall surface of the through hole in the solder resist layer, is curved so as to be convex toward the inside of the through hole. 請求項1記載の配線基板であって、前記2以上の導体層のうちの、前記第1面側の最表層の導体層及び前記第2面側の最表層の導体層の少なくとも一方は、前記貫通孔を跨ぐように前記配線基板に実装される電子部品又は光学部品に対する接続パッドを有している。 The wiring board according to claim 1, wherein at least one of the two or more conductor layers, the outermost conductor layer on the first surface side and the outermost surface layer on the second surface side, is said to be the above. It has a connection pad for an electronic component or an optical component mounted on the wiring board so as to straddle the through hole. 2以上の導体層と前記2以上の導体層それぞれの間に介在する絶縁層とを含む積層体を用意することと、
前記積層体を厚さ方向に貫通する貫通孔を前記積層体に形成することと、
前記積層体の第1面及び第2面を覆うソルダーレジスト層を前記貫通孔の内部を通って前記第1面及び第2面の一方から他方まで連続するように形成することによって、前記貫通孔の内壁面を樹脂膜で覆うことと、
を含んでいる、配線基板の製造方法。
To prepare a laminate including two or more conductor layers and an insulating layer interposed between the two or more conductor layers,
By forming a through hole in the laminated body that penetrates the laminated body in the thickness direction,
The through hole is formed by forming a solder resist layer covering the first surface and the second surface of the laminate so as to pass through the inside of the through hole and to be continuous from one of the first surface and the second surface to the other. Covering the inner wall surface with a resin film
A method of manufacturing a wiring board, including.
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