JP2018006815A - 出力装置及び切替えシステム - Google Patents

Abstract

【課題】処理部の動作が不安定である場合に、出力している電圧を適切な電圧に切替えることができる出力装置、及び、該出力装置を備える切替えシステムを提供する。
【解決手段】ＯＲ回路２１は、ローレベル電圧又はハイレベル電圧を駆動回路に出力する。ＣＰＵ３９（処理部）は、所定処理を実行し、実行結果として、特定結果が得られたか否かを判定する。ＣＰＵ３９は、特定結果が得られなかったと判定した場合、所定処理を再び実行する。ＣＰＵ３９が所定処理を繰り返し実行している時間が所定時間以上となった場合、ＯＲ回路２１は、駆動回路に出力している電圧をローレベル電圧からハイレベル電圧に切替える。
【選択図】図２

Description

本発明は、外部から入力された信号に基づいて電圧を出力する出力装置と、該出力装置が出力した電圧に基づいてスイッチが切替えられる切替えシステムとに関する。

車両には、バッテリから負荷への給電経路にスイッチが設けられている電源システム（例えば、特許文献１を参照）が搭載されている。特許文献１に記載の電源システムでは、マイクロコンピュータ（以下では、マイコンという）がハイレベル電圧及びローレベル電圧を出力する。マイコンがハイレベル電圧を出力している場合、スイッチはオンであり、バッテリから負荷へ給電される。マイコンがローレベル電圧を出力している場合、スイッチはオフであり、バッテリから負荷への給電は停止している。

特開２００９−２６１１５３号公報

ウォッチドッグタイマが内蔵されたマイコンが提案されている。このマイコンでは、ＣＰＵ(Central Processing Unit)の動作が正常である場合、ＣＰＵは、出力部に指示して、動作が正常であることを通知する通知信号をウォッチドッグタイマに出力させる処理を繰り返し実行する。ウォッチドッグタイマは、出力部から通知信号が入力される都度、ゼロから計時を開始する。

ＣＰＵの動作が異常であるために、出力部に通知信号をウォッチドッグタイマへ出力させる処理が行われず、ウォッチドッグタイマが計時している計時時間が所定時間以上となった場合、ウォッチドッグタイマは、リセット回路にマイコンの構成部の初期化を指示する。リセット回路は、ウォッチドッグタイマによって初期化が指示された場合、マイコンの構成部を初期化する。これにより、ＣＰＵを含むマイコンの構成部の状態が初期状態、即ち、マイコンが出荷された時点の状態に戻る。この初期化により、ＣＰＵの動作が正常に戻ることが期待される。

ＣＰＵが起動するか、又は、ＣＰＵが初期化された場合、ＣＰＵは、所定処理、例えば、マイコンを構成するＲＡＭ(Random Access Memory)にデータが適切に記憶されるか否かを確認するための処理を実行する。ＣＰＵは、所定処理を実行した結果として、特定結果、例えば、ＲＡＭにデータが適切に記憶されることを示す結果が得られなかった場合、再び所定処理を実行する。ＣＰＵは、特定結果が得られるまで、所定処理を繰り返し実行する。

電源システムとして、ウォッチドッグタイマが内蔵されたマイコンによって出力された電圧に応じて、バッテリから負荷への給電経路に設けられたスイッチがオン又はオフに切替えられる電源システムが考えられる。この電源システムでは、ＣＰＵが所定処理を繰り返し実行してマイコンの動作が不安定である間、マイコンは、例えばローレベル電圧を出力する。この場合、スイッチはオフに維持される。

電源システムの中には、スイッチをオン又はオフに固定しなければならない状況では、スイッチのオンへの固定が好ましい電源システムがある。例えば、負荷がヘッドライトである電源システムでは、車両を安全に運転するため、スイッチがオンに固定され、負荷が作動し続けていることが好ましい。
従って、以上のように構成されたマイコンには、動作が不安定である場合に、出力している電圧が適切な電圧、即ち、ハイレベル電圧に切替わらないという問題がある。

本発明は斯かる事情に鑑みてなされたものであり、その目的とするところは、処理部の動作が不安定である場合に、出力している電圧を適切な電圧に切替えることができる出力装置、及び、該出力装置を備える切替えシステムを提供することにある。

本発明に係る出力装置は、２つの電圧中の一方の電圧を出力する出力回路を備える出力装置において、所定処理を実行する処理部と、該処理部が前記所定処理を実行した結果として、特定結果が得られたか否かを判定する判定部とを備え、前記処理部は、該判定部によって、前記特定結果が得られなかったと判定された場合に再び前記所定処理を実行し、前記出力回路は、前記処理部が前記所定処理を繰り返し実行している時間が所定時間以上となった場合、出力している電圧を他の電圧に切替えるように構成してあることを特徴とする。

本発明にあっては、所定処理を実行した結果として、特定結果が得られなかったと判定した場合、所定処理を再び実行する。所定処理を繰り返し実行している時間が所定時間以上となった場合、出力回路は、出力している電圧を他の電圧に切替える。
従って、所定処理が繰り返し実行されて処理部の動作が不安定である時間が所定時間以上となった場合に、出力している電圧を適切な電圧に切替えることが可能である。

本発明に係る出力装置は、前記処理部が前記所定処理を繰り返し実行している間、充電される蓄電器を備え、前記蓄電器の端子電圧値が所定電圧値以上である場合に、前記出力回路は、出力している電圧を前記他の電圧に切替えるように構成してあることを特徴とする。

本発明にあっては、所定処理を繰り返し実行している間、蓄電器は充電され、蓄電器の端子電圧値が上昇する。所定処理を繰り返し実行している時間が所定時間以上となった場合、蓄電器の端子電圧値が所定電圧値以上となり、出力している電圧が他の電圧に切替わる。
これにより、所定処理を繰り返し実行している時間が所定時間以上となった場合に、出力している電圧が他の電圧に切替わる構成を簡単にハードウェアで実現することが可能である。

本発明に係る出力装置は、前記処理部への電力供給を行う電源回路を備え、前記電源回路は、前記判定部によって前記特定結果が得られなかったと判定された場合に前記電力供給を停止し、該電力供給を停止した直後に該電力供給を再開し、前記処理部は、前記電源回路が該電力供給を再開した後に再び前記所定処理を実行するように構成してあることを特徴とする。

本発明にあっては、電源回路は、特定結果が得られなかったと判定した場合、所定処理を行う処理部を再起動する。処理部は、再起動した後、再び所定処理を実行する。

本発明に係る切替えシステムは、前述した出力装置と、スイッチと、前記出力回路が出力した電圧に基づいて該スイッチをオン又はオフに切替える切替え回路とを備えることを特徴とする。

本発明にあっては、出力装置の出力回路が出力した電圧に基づいて、スイッチがオン又はオフに切替えられる。

本発明によれば、処理部の動作が不安定である場合に、出力している電圧を適切な電圧に切替えることができる。

実施の形態１における電源システムの要部構成を示すブロック図である。 出力装置の要部構成を示すブロック図である。 初期処理の手順を示すフローチャートである。 計時再開処理の手順を示すフローチャートである。 出力処理の手順を示すフローチャートである。 出力装置の動作の一例を説明するためのタイミングチャートである。 出力装置の動作の他例を説明するためのタイミングチャートである。 実施の形態２における電源システムの要部構成を示すブロック図である。 初期処理の手順を示すフローチャートである。 実施の形態３における初期処理の手順を示すフローチャートである。

以下、本発明をその実施の形態を示す図面に基づいて詳述する。
（実施の形態１）
図１は、実施の形態１における電源システム１の要部構成を示すブロック図である。電源システム１は、車両に好適に搭載されており、バッテリ１０、メインスイッチ１１、負荷１２、駆動回路１３及び出力装置１４を備える。メインスイッチ１１は、Ｎチャネル型のＦＥＴ(Field Effect Transistor)である。

バッテリ１０の正極は、メインスイッチ１１のドレインに接続されている。メインスイッチ１１のソースは負荷１２の一端に接続されている。バッテリ１０の負極と、負荷１２の他端とは接地されている。メインスイッチ１１のゲートには、駆動回路１３が接続されている。駆動回路１３には、出力装置１４が更に接続されている。

メインスイッチ１１について、ゲートの電圧値が一定電圧値以上である場合、ドレイン及びソース間に電流が流れることが可能である。このとき、メインスイッチ１１はオンである。また、メインスイッチ１１について、ゲートの電圧値が一定電圧値未満である場合、ドレイン及びソース間に電流が流れることはない。このとき、メインスイッチ１１はオフである。

駆動回路１３は、メインスイッチ１１のゲートの電圧値を調整することによって、メインスイッチ１１をオン又はオフに切替える。駆動回路１３には、出力装置１４からハイレベル電圧及びローレベル電圧が入力される。駆動回路１３は、出力装置１４からハイレベル電圧が入力された場合、メインスイッチ１１をオンに切替え、出力装置１４からローレベル電圧が入力された場合、メインスイッチ１１をオフに切替える。駆動回路１３は切替え回路として機能する。

負荷１２は車両に搭載された電気機器である。駆動回路１３がメインスイッチ１１をオンに切替えた場合、バッテリ１０から負荷１２に給電され、負荷１２は作動する。駆動回路１３がメインスイッチ１１をオフに切替えた場合、バッテリ１０から負荷１２への給電が停止し、負荷１２は動作を停止する。

出力装置１４には、メインスイッチ１１のオンへの切替えを指示するオン信号と、メインスイッチ１１のオフへの切替えを指示するオフ信号とが入力される。出力装置１４は、入力された信号に基づいて、ハイレベル電圧又はローレベル電圧を駆動回路１３に出力する。

メインスイッチ１１、駆動回路１３及び出力装置１４を備える電源システム１は、出力装置１４が出力した電圧に基づいて、駆動回路１３がメインスイッチ１１をオン又はオフに切替える切替えシステムとしても機能する。

図２は出力装置１４の要部構成を示すブロック図である。出力装置１４は、バックアップ回路２０、ＯＲ回路２１、マイコン２２、サブスイッチ２３、切替え部２４及び抵抗Ｒ１を有する。バックアップ回路２０は、キャパシタＣ１、ダイオードＤ１及び抵抗Ｒ２を有する。ＯＲ回路２１は、２つの入力端と１つの出力端とを有する。

ＯＲ回路２１の出力端は駆動回路１３に接続されている。ＯＲ回路２１の一方の入力端には、マイコン２２と、抵抗Ｒ１の一端とが接続されている。抵抗Ｒ１の他端は接地されている。ＯＲ回路２１の他方の入力端には、バックアップ回路２０のダイオードＤ１のカソードが接続されている。ダイオードＤ１のアノードは、マイコン２２と、キャパシタＣ１及び抵抗Ｒ２夫々の一端とに接続されている。キャパシタＣ１の他端は接地されている。抵抗Ｒ２の他端はサブスイッチ２３の一端に接続されている。サブスイッチ２３の他端には電圧が印加されている。サブスイッチ２３の他端に印加されている電圧の電圧値はＶｃｃである。電圧値Ｖｃｃは一定である。

ＯＲ回路２１は、抵抗Ｒ１の一端における電圧値が第１閾値以上であるか、又は、ダイオードＤ１のカソードにおける電圧値が第２閾値以上である場合、出力端からハイレベル電圧を駆動回路１３に出力する。ＯＲ回路２１は、抵抗Ｒ１の一端における電圧値が第１閾値未満であり、かつ、ダイオードＤ１のカソードにおける電圧値が第２閾値未満である場合、出力端からローレベル電圧を出力する。駆動回路１３は、ＯＲ回路２１がハイレベル電圧を出力した場合、メインスイッチ１１をオンに切替え、ＯＲ回路２１がローレベル電圧を出力した場合、メインスイッチ１１をオフに切替える。
第１閾値及び第２閾値夫々は、一定であり、ゼロＶを超えている。ＯＲ回路２１は出力回路として機能する。ハイレベル電圧及びローレベル電圧は２つの電圧に相当する。

マイコン２２は、ＯＲ回路２１の一方の入力端にハイレベル電圧又はローレベル電圧を出力する。マイコン２２がＯＲ回路２１の一方の入力端にハイレベル電圧を出力している場合、抵抗Ｒ１の一端における電圧値は第１閾値以上である。マイコン２２がＯＲ回路２１の一方の入力端にローレベル電圧を出力している場合、抵抗Ｒ１の一端における電圧値は第１閾値未満である。

更に、マイコン２２がＯＲ回路２１の一方の入力端に電圧を出力していない場合、抵抗Ｒ１に電流が流れないため、抵抗Ｒ１の一端における電圧値はゼロＶであり、第１閾値未満である。従って、マイコン２２がＯＲ回路２１の一方の入力端に電圧を出力していない場合において、ダイオードＤ１のカソードにおける電圧値が第２閾値以上であるとき、ＯＲ回路２１は出力端からハイレベル電圧を出力する。同様の場合において、ダイオードＤ１のカソードにおける電圧値が第２閾値未満であるとき、ＯＲ回路２１は、出力端からローレベルを出力する。

マイコン２２はＩ／Ｏポート３１を有する。Ｉ／Ｏポート３１は、キャパシタＣ１の一端に接続されていると共に接地されている。Ｉ／Ｏポート３１の方向は「入力」又は「出力」に設定される。Ｉ／Ｏポート３１の方向が「出力」に設定されている場合、Ｉ／Ｏポートは、出力レベルをハイレベル又はローレベルに調整する。
Ｉ／Ｏポート３１の方向が「入力」に設定されている場合、接地される接地端と、キャパシタＣ１の一端との間におけるＩ／Ｏポート３１のインピーダンスは、開放インピーダンスである。Ｉ／Ｏポート３１のインピーダンスが開放インピーダンスであることは、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続が遮断状態であることと略同じである。開放インピーダンスは略無限大である。

Ｉ／Ｏポート３１の方向が「出力」に設定されており、かつ、Ｉ／Ｏポート３１の出力レベルがローレベルである場合、Ｉ／Ｏポート３１のインピーダンスは接地インピーダンスである。Ｉ／Ｏポート３１のインピーダンスが接地インピーダンスであることは、キャパシタＣ１の一端が接地されていることと略同じである。接地インピーダンスは略ゼロΩである。

切替え部２４はサブスイッチ２３をオン又はオフに切替える。
サブスイッチ２３がオンである場合において、Ｉ／Ｏポート３１のインピーダンスが開放インピーダンスであるとき、電流は、抵抗Ｒ２を介してＩ／Ｏポート３１に殆ど流れることはなく、サブスイッチ２３及び抵抗Ｒ２を介してキャパシタＣ１に流れる。これにより、キャパシタＣ１は充電される。キャパシタＣ１は蓄電器として機能する。
サブスイッチ２３がオンである場合において、Ｉ／Ｏポート３１とキャパシタＣ１との接続が遮断状態であるときも、電流は、抵抗Ｒ２を介してＩ／Ｏポート３１に殆ど流れることはなく、サブスイッチ２３及び抵抗Ｒ２を介してキャパシタＣ１に流れ、キャパシタＣ１は充電される。

前述したように、接地インピーダンスは略ゼロΩである。このため、サブスイッチ２３がオンである場合において、Ｉ／Ｏポート３１のインピーダンスが接地インピーダンスであるとき、電流は、抵抗Ｒ２の一端から、キャパシタＣ１に殆ど流れず、Ｉ／Ｏポート３１に流れる。更に、キャパシタＣ１の一端から電流がＩ／Ｏポート３１に流れ、キャパシタＣ１は放電する。

サブスイッチ２３がオフである場合において、Ｉ／Ｏポート３１のインピーダンスが接地インピーダンスであるときも、キャパシタＣ１の一端から電流がＩ／Ｏポート３１に流れ、キャパシタＣ１は放電する。
結果、サブスイッチ２３がオンであるか否かに無関係に、Ｉ／Ｏポート３１のインピーダンスが接地インピーダンスである場合、キャパシタＣ１は放電する。

サブスイッチ２３がオフである場合において、Ｉ／Ｏポート３１のインピーダンスが開放インピーダンスであるとき、キャパシタＣ１に係る充電及び放電が行われることはない。
同様に、サブスイッチ２３がオフである場合において、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続が遮断状態であるときも、キャパシタＣ１に係る充電及び放電が行われることはない。

キャパシタＣ１の端子電圧値、即ち、キャパシタＣ１の両端間の電圧値は、キャパシタＣ１が蓄えている電力値が大きい程、高い。従って、キャパシタＣ１が充電された場合、キャパシタＣ１の端子電圧値は上昇し、キャパシタＣ１が放電した場合、キャパシタＣ１の端子電圧値は低下する。キャパシタＣ１の端子電圧値は、ダイオードＤ１を介してＯＲ回路２１の他方の入力端に入力される。

ダイオードＤ１に電流が流れた場合にダイオードＤ１で生じる電圧降下の幅と、第２閾値との和を基準電圧値と記載する。この電圧降下の幅は、一定であるため、基準電圧値も一定である。基準電圧値は電圧値Ｖｃｃ以下である。
キャパシタＣ１の端子電圧値が基準電圧値以上である場合、ダイオードＤ１のカソードにおける電圧値は第２閾値以上である。キャパシタＣ１の端子電圧値が基準電圧値未満である場合、ダイオードＤ１のカソードにおける電圧値は第２閾値未満である。

従って、キャパシタＣ１の端子電圧値が基準電圧値未満である場合、ＯＲ回路２１は、マイコン２２が出力している電圧に応じた電圧を駆動回路１３に出力する。キャパシタＣ１の端子電圧値が基準電圧値以上である場合、ＯＲ回路２１は、マイコン２２が出力している電圧に無関係にハイレベル電圧を駆動回路１３に出力し、駆動回路１３はメインスイッチ１１をオンに切替える。

キャパシタＣ１のキャパシタンスと、抵抗Ｒ２の抵抗値ｒ２との積により、キャパシタＣ１及び抵抗Ｒ２のＣＲ時定数が算出される。キャパシタＣ１のキャパシタンス、及び、抵抗Ｒ２の抵抗値ｒ２夫々は一定である。このため、ＣＲ時定数も一定である。
キャパシタＣ１の端子電圧値がゼロＶである状態でキャパシタＣ１への充電が開始されてから、基準電圧値に到達するまでの到達時間は、電圧値ＶｃｃとＣＲ時定数とによって決まる。前述したように、電圧値Ｖｃｃ及びＣＲ時定数は一定である。このため、到達時間も一定である。

マイコン２２及び切替え部２４には、マイコン２２の起動を指示する起動信号と、マイコン２２の動作の停止を指示する停止信号とが入力される。起動信号は、例えば、図示しない車両のイグニッションスイッチがオンに切替わった場合にマイコン２２及び切替え部２４に入力される。停止信号は、例えば、イグニッションスイッチがオフに切替わった場合にマイコン２２及び切替え部２４に入力される。マイコン２２には、更に、オン信号及びオフ信号が入力される。

マイコン２２は、起動信号が入力された場合、起動し、停止信号が入力された場合、動作を停止する。マイコン２２は、起動している場合において、オン信号がマイコン２２に入力されたとき、ハイレベル電圧をＯＲ回路２１の一方の入力端に出力する。マイコン２２は、同様の場合において、オフ信号がマイコン２２に入力されたとき、ローレベル電圧をＯＲ回路２１の一方の入力端に出力する。

マイコン２２がハイレベル電圧又はローレベル電圧を出力している間、Ｉ／Ｏポート３１の方向は「出力」に設定され、Ｉ／Ｏポート３１の出力レベルはローレベルである。前述したように、Ｉ／Ｏポート３１の方向が「出力」に設定され、かつ、Ｉ／Ｏポート３１の出力レベルがローレベルである場合、Ｉ／Ｏポート３１のインピーダンスは接地インピーダンスである。
マイコン２２がハイレベル電圧又はローレベル電圧を出力していない間、Ｉ／Ｏポート３１の方向は「入力」に設定されているか、又は、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続が遮断状態となっている。前述したように、Ｉ／Ｏポート３１の方向が「入力」に設定されている場合、Ｉ／Ｏポート３１のインピーダンスは開放インピーダンスである。
マイコン２２がハイレベル電圧又はローレベル電圧を出力していない期間は、具体的には、マイコン２２が動作を停止している期間であり、マイコン２２が起動したか、又は、マイコン２２内で初期化が行われてからハイレベル電圧又はローレベル電圧の出力を開始するまでの期間である。

切替え部２４は、起動信号が入力された場合、サブスイッチ２３をオンに切替え、停止信号が入力された場合、サブスイッチ２３をオフに切替える。
従って、マイコン２２が起動してハイレベル電圧又はローレベル電圧を出力している場合、Ｉ／Ｏポート３１のインピーダンスは接地インピーダンスであり、かつ、切替え部２４はサブスイッチ２３をオンに切替えている。この場合、前述したように、キャパシタＣ１は放電する。

マイコン２２は、Ｉ／Ｏポート３１に加えて、タイマ３０、入力部３２、出力部３３，３４、ウォッチドッグタイマ（以下、ＷＤＴと記載する）３５、電源回路３６、ＲＯＭ(Read Only Memory)３７、ＲＡＭ３８、ＣＰＵ３９及びリセット回路４０を有する。タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、電源回路３６、ＲＯＭ３７、ＲＡＭ３８及びＣＰＵ３９はバス４１に接続されている。出力部３３は、バス４１の他に、ＯＲ回路２１の一方の入力端、及び、抵抗Ｒ１の一端間の接続ノードに接続されている。出力部３４は、バス４１の他に、ＷＤＴ３５に接続されている。ＷＤＴ３５は、更に、リセット回路４０に接続されている。

タイマ３０は、ＣＰＵ３９の指示に従って計時を開始する。タイマ３０が計時している計時時間が、予め設定されているタイマ時間以上となった場合、タイマ３０は、タイマ時間が経過したことを示すタイマ信号をＣＰＵ３９に出力し、計時を終了する。タイマ時間は一定である。

Ｉ／Ｏポート３１の方向は、ＣＰＵ３９によって、「入力」又は「出力」に設定される。Ｉ／Ｏポート３１の方向が「出力」に設定されている場合、Ｉ／Ｏポート３１は、ＣＰＵ３９の指示に従って、出力レベルをハイレベル又はローレベルに調整する。
入力部３２には、オン信号及びオフ信号が入力される。入力部３２は、オン信号又はオフ信号が入力された場合、その旨を通知する。
出力部３３は、ＣＰＵ３９の指示に従って、ハイレベル電圧又はローレベル電圧をＯＲ回路２１の一方の入力端に出力する。

出力部３４は、ＣＰＵ３９の指示に従って、ＣＰＵ３９が正常に動作していることを通知する通知信号をＷＤＴ３５に繰り返し出力する。
ＷＤＴ３５は、出力部３４から通知信号が入力される都度、ゼロから計時を開始する。ＷＤＴ３５が計時している計時時間が、予め設定されているＷＤＴ時間以上となった場合、ＷＤＴ３５は、リセット回路４０に、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８及びＣＰＵ３９の初期化を指示する。ＷＤＴ時間は一定である。

リセット回路４０は、ＷＤＴ３５の指示に従って、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８及びＣＰＵ３９を初期化する。具体的には、これらの状態を、初期状態、即ち、マイコン２２が出荷された時点の状態に戻す。これにより、例えば、カウンタ値及びレジスタ値等が、マイコン２２が出荷された時点の値に戻り、マイコン２２の動作モードが、マイコン２２が出荷された時点の動作モードに戻る。

電源回路３６には、起動信号及び停止信号が入力される。電源回路３６は、起動信号が入力された場合、図示しない電線を介して、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８、ＣＰＵ３９及びリセット回路４０に電力を供給する。電源回路３６は、停止信号が入力された場合、これらへの電力供給を停止する。

電源回路３６が電力供給を停止した場合、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８、ＣＰＵ３９及びリセット回路４０は動作を停止する。電源回路３６が電力供給を停止している場合、Ｉ／Ｏポート３１と、キャパシタＣ１の一端との接続は遮断状態である。同様の場合において、出力部３３と、ＯＲ回路２１の一方の入力端、及び、抵抗Ｒ１の一端間の接続ノードとの接続も遮断状態である。
停止信号が、マイコン２２の電源回路３６と、切替え部２４とに入力された場合、サブスイッチ２３はオフであり、かつ、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続が遮断状態であるため、キャパシタＣ１について充電及び放電が行われることはない。

ＣＰＵ３９は電源回路３６に再起動を指示する。電源回路３６は、ＣＰＵ３９によって、再起動を指示された場合、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８、ＣＰＵ３９及びリセット回路４０を再起動する。具体的には、電源回路３６は、これらへの電力供給を停止し、この電力供給を停止した直後に、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８、ＣＰＵ３９及びリセット回路４０への電力供給を再開する。

ＲＯＭ３７には制御プログラムＰ１が記憶されている。ＣＰＵ３９は、ＲＯＭ３７に記憶されている制御プログラムＰ１を実行する。ＣＰＵ３９は、制御プログラムＰ１を実行することによって、初期処理、計時再開処理及び出力処理を実行する。初期処理は、ＣＰＵ３９が起動したか、又は、初期化された場合に最初に実行する処理である。計時再開処理は、タイマ３０に計時を再開させる処理である。出力処理は、出力部３３にハイレベル電圧又はローレベル電圧を出力させる処理である。制御プログラムＰ１は、初期処理、計時開始処理及び出力処理をＣＰＵ３９に実行させるためのコンピュータプログラムである。ＲＡＭ３８には、ＣＰＵ３９によってデータが一時的に記憶される。

なお、制御プログラムＰ１は、コンピュータが読み取り可能に、記憶媒体Ａ１に記憶されていてもよい。制御プログラムＰ１が記憶媒体Ａ１に記憶されており、かつ、データを書き換えることができるようにＲＯＭ３７が構成されている場合、図示しない読み出し装置によって記憶媒体Ａ１から読み出された制御プログラムＰ１がＲＯＭ３７に記憶される。記憶媒体Ａ１は、光ディスク、フレキシブルディスク、磁気ディスク、磁気光ディスク又は半導体メモリ等である。光ディスクは、ＣＤ（Compact Disc）−ＲＯＭ(Read Only Memory)、ＤＶＤ（Digital Versatile Disc）−ＲＯＭ、又は、ＢＤ（Blu-ray(登録商標) Disc）等である。磁気ディスクは、例えばハードディスクである。また、図示しない通信網に接続されている図示しない外部装置から制御プログラムＰ１をダウンロードし、ダウンロードした制御プログラムＰ１をＲＯＭ３７に記憶してもよい。

当然のことながら、ＲＡＭ３８に記憶されているデータは、電源回路３６が電力供給を停止した場合、ＲＡＭ３８から消去される。ＲＯＭ３７に記憶されているデータは、電源回路３６が行う電力供給の停止によってデータが消去されることはない。
ＲＡＭ３８にはタイマフラグの値が記憶される。タイマフラグの値は、ＣＰＵ３９によってゼロ又は１に設定される。

図３は初期処理の手順を示すフローチャートである。前述したように、初期処理は、ＣＰＵ３９が起動したか、又は、初期化された場合において、ＣＰＵ３９が最初に実行する処理である。ＣＰＵ３９は、まず、ＲＡＭ３８に予め決められたデータを書き込み（ステップＳ１）、書き込んだデータをＲＡＭ３８から読み出す（ステップＳ２）。次に、ＣＰＵ３９は、ステップＳ１でＲＡＭ３８に書き込んだデータがステップＳ２でＲＡＭ３８から読み出したデータと一致するか否かを判定する（ステップＳ３）。

ＣＰＵ３９は、ステップＳ１で書き込んだデータがステップＳ２で読出したデータと一致すると判定した場合（Ｓ３：ＹＥＳ）、ＲＯＭ３７からデータを読み出し（ステップＳ４）、読み出したデータに基づいてデータ値を算出する（ステップＳ５）。次に、ＣＰＵ３９は、ステップＳ５で算出したデータ値が、予め設定されている設定値と一致するか否かを判定する（ステップＳ６）。設定値は一定である。

ＣＰＵ３９は、データ値が設定値と一致すると判定した場合（Ｓ６：ＹＥＳ）、Ｉ／Ｏポート３１の方向を「入力」に設定する（ステップＳ７）。これにより、Ｉ／Ｏポート３１のインピーダンスは開放インピーダンスとなる。
なお、ＣＰＵ３９が起動してからステップＳ７が実行されるまで、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続は遮断状態である。

次に、ＣＰＵ３９は、計時開始処理及び出力処理で用いられる種々の変数の初期値を設定し（ステップＳ８）、初期値の設定に成功したか否かを判定する（ステップＳ９）。ＣＰＵ３９は、初期値の設定に成功したと判定した場合（Ｓ９：ＹＥＳ）、タイマフラグの値をゼロに設定し（ステップＳ１０）、タイマ３０に計時を開始させる（ステップＳ１１）。これにより、タイマ３０はゼロから計時を開始する。前述したように、タイマ３０は、計時している計時時間がタイマ時間以上となった場合、タイマ信号をＣＰＵ３９に出力する。
ＣＰＵ３９は、ステップＳ１１を実行した後、初期処理を終了する。

ＣＰＵ３９は、ステップＳ１で書き込んだデータがステップＳ２で読出したデータと一致しないと判定した場合（Ｓ３：ＮＯ）、データ値が設定値と一致しないと判定した場合（Ｓ６：ＮＯ）、又は、初期値の設定に失敗したと判定した場合（Ｓ９：ＮＯ）、電源回路３６に再起動を行わせる（ステップＳ１２）。電源回路３６は、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８、ＣＰＵ３９及びリセット回路４０を再起動する。ＣＰＵ３９は、電源回路３６が電力供給を再開した後、再び初期処理を実行する。
ＣＰＵ３９は、ステップＳ１２を実行した後、初期処理を終了する。

ＣＰＵ３９は、初期処理のステップＳ１，Ｓ２を実行した結果として、ステップＳ３で、ステップＳ１で書き込んだデータがステップＳ２で読み出したデータと一致するという特定結果が得られたか否かを判定する。ＣＰＵ３９は、この特定結果が得られなかった場合、ステップＳ１２を実行し、初期処理を再び実行する。ステップＳ１，Ｓ２は所定処理に相当する。ＣＰＵ３９は処理部及び判定部として機能する。

また、ＣＰＵ３９は、初期処理のステップＳ４，Ｓ５を実行した結果として、ステップＳ６でデータ値が設定値に一致するという特定結果が得られたか否かを判定する。ＣＰＵ３９は、この特定結果が得られなかったと判定した場合、ステップＳ１２を実行し、初期処理を再び実行する。ステップＳ４，Ｓ５も所定処理に相当する。

更に、ＣＰＵ３９は、初期処理のステップＳ８を実行した結果として、ステップＳ９で初期値の設定に成功したという特定結果が得られたか否かを判定する。ＣＰＵ３９は、この特定結果が得られなかったと判定した場合、ステップＳ１２を実行し、初期処理を再び実行する。ステップＳ８も所定処理に相当する。
ＣＰＵ３９は、ステップＳ３，Ｓ６，Ｓ９の１つで特定結果が得られなかったと判定した場合、電源回路３６に再起動を行わせる。

初期化、再起動及び初期処理のいずれかが実行されている間、サブスイッチ２３はオンである。また、同様の期間においては、Ｉ／Ｏポート３１のインピーダンスが開放インピーダンスであるか、又は、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続が遮断状態である。
従って、初期化、再起動及び初期処理のいずれかが実行されている間、キャパシタＣ１は充電される。このため、ＣＰＵ３９が初期処理を繰り返し実行している間、キャパシタＣ１は充電される。前述したように、初期化はリセット回路４０によって実行され、再起動は電源回路３６によって実行される。

初期化、再起動及び初期処理のいずれかが実行されている間、出力部３３は電圧の出力を開始していないため、ＯＲ回路２１の一方の入力端の電圧値は、ゼロＶであり、第１閾値未満である。
従って、ＣＰＵ３９が初期処理を繰り返し実行している場合において、キャパシタＣ１の端子電圧値が基準電圧値未満である間、ダイオードＤ１のカソードにおける電圧値が第２閾値未満であるため、ＯＲ回路２１はローレベル電圧を駆動回路１３に出力し、駆動回路１３はメインスイッチ１１をオフに維持している。

ＣＰＵ３９が初期処理を繰り返し実行している場合において、キャパシタＣ１の端子電圧値が基準電圧値以上となったとき、ダイオードＤ１のカソードにおける電圧値が第２閾値以上となるため、ＯＲ回路２１は、駆動回路１３に出力している電圧をローレベル電圧からハイレベル電圧に切替え、駆動回路１３はメインスイッチ１１をオフからオンに切替える。

出力装置１４では、ＣＰＵ３９が初期処理を繰り返し実行している時間が基準時間以上となった場合、キャパシタＣ１の端子電圧値が基準電圧値以上となる。キャパシタＣ１の端子電圧値が基準電圧値以上となった場合、ＯＲ回路２１は、駆動回路１３に出力している電圧をローレベル電圧からハイレベル電圧に切替える。ここで、基準時間は、前述した到達時間に相当する。

図４は計時再開処理の手順を示すフローチャートである。ＣＰＵ３９は、タイマ３０からＣＰＵ３９にタイマ信号が出力される都度、計時再開処理を実行する。前述したように、タイマ３０は、自身が計時している計時時間がタイマ時間以上となった場合、タイマ信号をＣＰＵ３９に出力し、計時を終了する。このため、計時再開処理が実行された時点では、タイマ３０は計時を行っていない。
計時再開処理では、ＣＰＵ３９は、タイマフラグの値を１に設定し（ステップＳ２１）、タイマ３０に計時を開始させる（ステップＳ２２）。これにより、タイマ３０は計時を再開する。ＣＰＵ３９は、ステップＳ２２を実行した後、計時再開処理を終了する。

図５は出力処理の手順を示すフローチャートである。ＣＰＵ３９は、ステップＳ１１を実行して初期処理を終了してから、出力処理を周期的に実行する。ＣＰＵ３９は、まず、タイマフラグの値が１であるか否かを判定する（ステップＳ３０）。ＣＰＵ３９は、タイマフラグの値が１ではない、即ち、タイマフラグの値がゼロであると判定した場合（Ｓ３０：ＮＯ）、出力処理を終了する。

ＣＰＵ３９は、タイマフラグの値が１であると判定した場合（Ｓ３０：ＹＥＳ）、タイマフラグの値をゼロに設定する（ステップＳ３１）。次に、ＣＰＵ３９は、Ｉ／Ｏポート３１の方向を「出力」に設定し（ステップＳ３２）、Ｉ／Ｏポート３１に指示して、出力レベルをローレベルに調整させる（ステップＳ３３）。ＣＰＵ３９がステップＳ３２，Ｓ３３を実行することによって、バックアップ回路２０のＩ／Ｏポート３１のインピーダンスが接地インピーダンスとなる。これにより、キャパシタＣ１は放電を開始し、キャパシタＣ１の端子電圧値は低下する。

次に、ＣＰＵ３９は、出力部３４に指示して、通知信号をＷＤＴ３５へ出力させる（ステップＳ３４）。これにより、ＷＤＴ３５はゼロから計時を開始する。

ＣＰＵ３９は、ステップＳ３４を実行した後、入力部３２にオン信号が入力されたか否かを判定する（ステップＳ３５）。ＣＰＵ３９は、オン信号が入力されたと判定した場合（Ｓ３５：ＹＥＳ）、出力部３３に指示して、ハイレベル電圧をＯＲ回路２１の一方の入力端へ出力させる（ステップＳ３６）。これにより、ＯＲ回路２１はハイレベル電圧を駆動回路１３に出力し、駆動回路１３はメインスイッチ１１をオンに切替える。ＣＰＵ３９は、ステップＳ３６を実行した後、出力処理を終了する。

ＣＰＵ３９は、オン信号が入力されていないと判定した場合（Ｓ３５：ＮＯ）、オフ信号が入力されたか否かを判定する（ステップＳ３７）。ＣＰＵ３９は、オフ信号が入力されたと判定した場合（Ｓ３７：ＹＥＳ）、出力部３３に指示して、ローレベル電圧をＯＲ回路２１の一方の入力端へ出力させる（ステップＳ３８）。

ステップＳ３８が実行された時点において、キャパシタＣ１の端子電圧値が基準電圧値未満であった場合、ＯＲ回路２１はローレベル電圧を駆動回路１３に出力し、駆動回路１３はメインスイッチ１１をオフに切替える。
ステップＳ３８が実行された時点において、キャパシタＣ１の端子電圧値が基準電圧値以上であった場合、ＯＲ回路２１はハイレベル電圧を駆動回路１３に出力し続け、駆動回路１３はメインスイッチ１１をオンに維持する。
ＣＰＵ３９は、オフ信号が入力されていないと判定した場合（Ｓ３７：ＮＯ）、又は、ステップＳ３８を実行した後、出力処理を終了する。

以上のように、キャパシタＣ１の端子電圧値が基準電圧値未満である場合においては、入力部３２にオン信号が入力されたとき、ＯＲ回路２１はハイレベル電圧を出力し、入力部３２にオフ信号が入力されたとき、ＯＲ回路２１はローレベル電圧を出力する。

出力処理では、ステップＳ３６及びステップＳ３８夫々の実行は、タイマフラグの値が１である場合に許可される。ステップＳ３６又はステップＳ３８が実行された時点では、タイマフラグの値はゼロに設定されている。タイマフラグの値は、ＣＰＵ３９が計時再開処理を実行するまで、即ち、タイマ３０が計時している計時時間がタイマ時間以上となるまで、１に設定されることはない。従って、ＣＰＵ３９が計時再開処理のステップＳ２２を実行してから、タイマ時間が経過するまでに、ＯＲ回路２１が出力している電圧を２回以上切替えることはない。

図６は、出力装置１４の動作の一例を説明するためのタイミングチャートである。ここでは、ＣＰＵ３９が電源回路３６に再起動を行わせることなく初期処理を終了する例を説明する。
図６には、キャパシタＣ１の端子電圧値の推移と、ＯＲ回路２１が出力する電圧の推移とが示されている。これらの推移の横軸には、時間が示されている。図６では、ハイレベル電圧を「Ｈ」で示し、ローレベル電圧を「Ｌ」で示している。

起動信号がマイコン２２の電源回路３６と切替え部２４とに入力されるか、又は、リセット回路４０によってＣＰＵ３９が初期化された場合、サブスイッチ２３はオンであり、かつ、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続が遮断状態であるため、キャパシタＣ１の充電が開始される。起動信号が入力されるか、又は、ＣＰＵ３９が初期化された時点では、キャパシタＣ１の端子電圧値は基準電圧値Ｖｒ未満であり、かつ、出力部３３は電圧の出力を開始していないため、ＯＲ回路２１は駆動回路１３にローレベル電圧を出力し、駆動回路１３はメインスイッチ１１をオフにしている。

起動信号が入力されるか、又は、ＣＰＵ３９が初期化された後、ＣＰＵ３９は、初期処理を実行する。ここで、ＣＰＵ３９は、電源回路３６に再起動を行わせることなく、タイマフラグの値をゼロに設定し、タイマ３０の計時を開始させて初期処理を終了する。初期処理が終了した後、タイマ３０が計時している計時時間がタイマ時間以上となった場合、タイマ３０はタイマ信号をＣＰＵ３９に出力し、ＣＰＵ３９は計時再開処理を実行する。ＣＰＵ３９は、計時再開処理で、タイマフラグの値を１に設定し、タイマ３０に計時をゼロから再開させる。

次に、ＣＰＵ３９は出力処理を実行する。出力処理では、タイマフラグの値が１であるため、Ｉ／Ｏポート３１の方向は「出力」に設定され、Ｉ／Ｏポート３１の出力レベルはローレベルに調整される。これにより、Ｉ／Ｏポート３１のインピーダンスは接地インピーダンスとなり、キャパシタＣ１は放電を開始する。これ以降、起動信号が入力されるか、又は、リセット回路４０が初期化を行うまで、Ｉ／Ｏポート３１のインピーダンスは接地インピーダンスに維持される。

以上のように、起動信号が入力されるか、又は、ＣＰＵ３９が初期化されてから、最初の出力処理が実行されるまで、キャパシタＣ１は充電され、キャパシタＣ１の端子電圧値は上昇する。キャパシタＣ１の端子電圧値が基準電圧値Ｖｒ以上となる前に最初の出力処理が実行された場合、キャパシタＣ１の端子電圧値が基準電圧値Ｖｒ以上となることはなく、ＯＲ回路２１は、出力部３３が出力した電圧に従って、ハイレベル電圧又はローレベル電圧を駆動回路１３に出力する。

ＣＰＵ３９が最初の出力処理を実行した後において、入力部３２にオン信号が入力された場合、オン信号が入力された後に実行される出力処理で出力部３３はハイレベル電圧を出力し、駆動回路１３はメインスイッチ１１をオンに切替える。これにより、負荷１２は作動する。
また、ＣＰＵ３９が最初の出力処理を実行した後において、入力部３２にオフ信号が入力された場合、オフ信号が入力された後に実行される出力処理で出力部３３はローレベル電圧を出力し、駆動回路１３はメインスイッチ１１をオフに切替える。これにより、負荷１２は動作を停止する。
ただし、タイマフラグの値がゼロである場合、ＯＲ回路２１が出力している電圧が切替えられることはない。この場合、計時再開処理でタイマフラグの値が１に設定された後、ＯＲ回路２１が出力している電圧が切替えられる。

最初の出力処理が実行された後において、起動信号が入力されるか、又は、ＣＰＵ３９が初期化された場合、ＣＰＵ３９は再び初期処理を実行する。
再起動が行われない場合において、起動信号が入力されるか、又は、ＣＰＵ３９が初期化されてから出力処理が実行されるまでの時間は、キャパシタＣ１の端子電圧値がゼロＶから基準電圧値Ｖｒ以上となるまでの時間、即ち、基準時間よりも短い。

前述したように、マイコン２２の電源回路３６と切替え部２４とに停止信号が入力された場合、切替え部２４はサブスイッチ２３をオフに切替え、電源回路３６は電力供給を停止する。電源回路３６が電力供給を停止した場合、Ｉ／Ｏポート３１は動作を停止し、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続は遮断状態となる。従って、マイコン２２の電源回路３６と切替え部２４とに停止信号が入力された場合、キャパシタＣ１に係る充電及び放電は行われず、キャパシタＣ１の端子電圧値は保持される。

図７は、出力装置１４の動作の他例を説明するためのタイミングチャートである。ここでは、ＣＰＵ３９が初期処理を繰り返し実行している時間が基準時間以上となる例を説明する。
図７にも、図６と同様に、キャパシタＣ１の端子電圧値の推移と、ＯＲ回路２１が出力する電圧の推移とが示されている。これらの推移の横軸には、時間が示されている。図７でも、ハイレベル電圧を「Ｈ」で示し、ローレベル電圧を「Ｌ」で示している。

起動信号が入力されるか、又は、ＣＰＵ３９が初期化された場合、前述したように、サブスイッチ２３はオンであり、かつ、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続が遮断状態であるため、キャパシタＣ１の充電が開始される。起動信号が入力されるか、又は、ＣＰＵ３９が初期化された時点では、キャパシタＣ１の端子電圧値は基準電圧値Ｖｒ未満であり、かつ、出力部３３は電圧の出力を開始していないため、ＯＲ回路２１は駆動回路１３にローレベル電圧を出力し、駆動回路１３はメインスイッチ１１をオフにしている。

起動信号が入力されるか、又は、ＣＰＵ３９が初期化された後、ＣＰＵ３９は、初期処理を実行する。この初期処理で、ＣＰＵ３９が電源回路３６に再起動を行わせた場合、ＣＰＵ３９は再起動し、再び、初期処理を実行する。ＣＰＵ３９が再起動してから再び初期処理を実行するまでの間、サブスイッチ２３はオンであり、かつ、Ｉ／Ｏポート３１とキャパシタＣ１の一端との接続は遮断状態であるので、キャパシタＣ１の充電が継続され、キャパシタＣ１の端子電圧値は上昇し続ける。

電源回路３６が再起動を行うことなく初期処理が終了されるまで、ＣＰＵ３９は、計時再開処理及び出力処理を実行することなく、初期処理を繰り返し実行する。ＣＰＵ３９が初期処理を繰り返し実行している間、キャパシタＣ１の端子電圧値は上昇し続ける。

ＣＰＵ３９が初期処理を繰り返し実行している時間が基準時間以上となった場合、キャパシタＣ１の端子電圧値が基準電圧値Ｖｒ以上となる。キャパシタＣ１の端子電圧値が基準電圧値Ｖｒ以上となった場合、ＯＲ回路２１は、駆動回路１３に出力している電圧をローレベル電圧からハイレベル電圧に切替える。これにより、駆動回路１３はメインスイッチ１１をオフからオンに切替え、負荷１２は作動する。

キャパシタＣ１の端子電圧値が電圧値Ｖｃｃに到達した後においては、Ｉ／Ｏポート３１のインピーダンスが接地インピーダンスに切替わるまで、キャパシタＣ１の端子電圧値は電圧値Ｖｃｃに維持される。

以上のように、ＣＰＵ３９が初期処理を繰り返し実行してＣＰＵ３９の動作が不安定である時間が基準時間以上となった場合、ＯＲ回路２１が出力している電圧を、ローレベル電圧から、適切な電圧であるハイレベル電圧に切替えることができる。
また、バックアップ回路２０を設けることによって、ＣＰＵ３９が初期処理を繰り返し実行している時間が基準時間以上となった場合に、ＯＲ回路２１が出力している電圧がローレベル電圧からハイレベル電圧に切替わる構成が簡単にハードウェアで実現されている。

なお、初期処理においてＣＰＵ３９が実行する所定処理の数は３に限定されず、１であってもよい。例えば、ＲＯＭ３７に記憶されているデータが変更される確率と、初期値の設定に失敗する確率が極めて低い場合、ＣＰＵ３９はステップＳ４〜Ｓ６，Ｓ９を実行しなくてもよい。この場合、ＣＰＵ３９は、ステップＳ１で書き込んだデータがステップＳ２で読み出したデータと一致したと判定した場合（Ｓ３：ＹＥＳ）、ステップＳ７を実行する。更に、ＣＰＵ３９は、ステップＳ８を実行した後、ステップＳ１０を実行する。
また、初期処理においてＣＰＵ３９が実行する所定処理の数は、２、又は４以上であってもよい。

（実施の形態２）
図８は、実施の形態２における電源システム１の要部構成を示すブロック図である。
以下では、実施の形態２について、実施の形態１と異なる点を説明する。後述する構成を除く他の構成については、実施の形態１と共通しているため、実施の形態１と共通する構成部には実施の形態１と同一の参照符号を付してその説明を省略する。

実施の形態２における電源システム１を実施の形態１における電源システム１と比較した場合、マイコン２２の構成と、初期処理とが異なる。実施の形態２におけるマイコン２２では、リセット回路４０は、ＷＤＴ３５の他に、バス４１に接続されている。
実施の形態２では、ＷＤＴ３５だけではなく、ＣＰＵ３９も、リセット回路４０に、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８及びＣＰＵ３９の初期化を指示する。リセット回路４０は、ＷＤＴ３５又はＣＰＵ３９によって初期化が指示された場合、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８及びＣＰＵ３９を初期化する。

図９は初期処理の手順を示すフローチャートである。実施の形態２における初期処理のステップＳ４１〜Ｓ５１は、実施の形態１における初期処理のステップＳ１〜Ｓ１１と同様である。このため、ステップＳ４１〜Ｓ５１の詳細な説明を省略する。
ＣＰＵ３９は、ステップＳ４１で書き込んだデータがステップＳ４２で読出したデータと一致しないと判定した場合（Ｓ４３：ＮＯ）、データ値が設定値と一致しないと判定した場合（Ｓ４６：ＮＯ）、又は、初期値の設定に失敗したと判定した場合（Ｓ４９：ＮＯ）、リセット回路４０に初期化を行わせる（ステップＳ５２）。

これにより、リセット回路４０は、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８及びＣＰＵ３９を初期化し、ＣＰＵ３９は再び初期処理を実行する。
ＣＰＵ３９は、ステップＳ５２を実行した後、初期処理を終了する。実施の形態１で述べたように、ＣＰＵ３９は、初期化された場合、初期処理を実行する。

実施の形態２においては、電源回路３６が再起動を行う代わりに、リセット回路４０が初期化を行う。実施の形態１で述べたように、リセット回路４０が初期化を実行している間、キャパシタＣ１の充電は継続され、キャパシタＣ１の端子電圧値は上昇し続ける。
従って、以上のように構成された実施の形態２における出力装置１４も、実施の形態１における出力装置１４と同様の効果を奏する。

実施の形態２においては、ＣＰＵ３９の指示に従ってリセット回路４０が初期化を行わない場合に、起動信号が入力されるか、又は、ＷＤＴ３５の指示に従ってリセット回路４０が初期化を行ってから出力処理が実行されるまでの時間は、実施の形態１で述べた基準時間よりも短い。
ＣＰＵ３９は、ステップＳ５１を実行して初期処理を終了してから、出力処理を周期的に実行する。

なお、実施の形態２における初期処理においても、ＣＰＵ３９が実行する所定処理の数は３に限定されず、１であってもよい。例えば、ＲＯＭ３７に記憶されているデータが変更される確率と、初期値の設定に失敗する確率が極めて低い場合、ＣＰＵ３９は、ステップＳ４４〜Ｓ４６，Ｓ４９を実行しなくてもよい。この場合、ＣＰＵ３９は、ステップＳ４１で書き込んだデータがステップＳ４２で読み出したデータと一致したと判定した場合（Ｓ４３：ＹＥＳ）、ステップＳ４７を実行する。更に、ＣＰＵ３９は、ステップＳ４８を実行した後、ステップＳ５０を実行する。
また、初期処理においてＣＰＵ３９が実行する所定処理の数は、２、又は４以上であってもよい。

また、実施の形態１，２において、ＣＰＵ３９が初期処理を繰り返し実行している時間が基準時間以上となったか否かを、キャパシタＣ１の端子電圧値に基づいて検知しなくてもよい。例えば、図示しないタイマが計時している計時時間に基づいて、ＣＰＵ３９が初期処理を繰り返し実行している時間が基準時間以上となったか否かを検知してもよい。

（実施の形態３）
実施の形態３における電源システム１を実施の形態１における電源システム１と比較した場合、ＷＤＴ３５の構成と、ＣＰＵ３９が実行する初期処理とが異なる。
以下では、実施の形態３について、実施の形態１と異なる点を説明する。後述する構成を除く他の構成については、実施の形態１と共通しているため、実施の形態１と共通する構成部には実施の形態１と同一の参照符号を付してその説明を省略する。

ＷＤＴ３５は、実施の形態１と同様に作用する。従って、ＷＤＴ３５は、出力部３４から通知信号が入力される都度、ゼロから計時を開始する。実施の形態３では、ＷＤＴ３５が起動したか、又は、初期化された場合も、ＷＤＴ３５は、ゼロから計時を開始する。このため、ＷＤＴ３５は、ＣＰＵ３９が初期化処理を実行している間も、計時を行っている。実施の形態１で述べたように、ＷＤＴ３５が計時している計時時間がＷＤＴ時間以上となった場合、ＷＤＴ３５は、リセット回路４０に、タイマ３０、Ｉ／Ｏポート３１、入力部３２、出力部３３，３４、ＷＤＴ３５、ＲＯＭ３７、ＲＡＭ３８及びＣＰＵ３９の初期化を指示する。

図１０は、実施の形態３における初期処理の手順を示すフローチャートである。実施の形態３におけるステップＳ６１〜Ｓ７１は実施の形態１におけるステップＳ１〜Ｓ１１と同様である。このため、ステップＳ６１〜Ｓ７１の詳細な説明を省略する。

ＣＰＵ３９は、ステップＳ６１でＲＡＭ３８に書き込んだデータがステップＳ６２でＲＡＭ３８から読み出したデータと一致しないと判定した場合（Ｓ６３：ＮＯ）、ステップＳ６１を再び実行する。ＣＰＵ３９は、ステップＳ６１，Ｓ６２を実行した結果として、ステップＳ６３で、ステップＳ６１で書き込んだデータがステップＳ６２で読み出したデータと一致するという特定結果が得られなかったと判定した場合、ステップＳ６１，Ｓ６２を再び実行する。ＣＰＵ３９は、ステップＳ６３で特定結果が得られたと判定するまで、ステップＳ６１，Ｓ６２を繰り返し実行する。

ＣＰＵ３９は、データ値が設定値と一致しないと判定した場合（Ｓ６６：ＮＯ）、ステップＳ６４を再び実行する。ＣＰＵ３９は、ステップＳ６４，Ｓ６５を実行した結果として、ステップＳ６６でデータ値が設定値に一致するという特定結果が得られなかったと判定した場合、ステップＳ６４，Ｓ６５を再び実行する。ＣＰＵ３９は、ステップＳ６６で特定結果が得られたと判定するまで、ステップＳ６４，Ｓ６５を繰り返し実行する。

ＣＰＵ３９は、ステップＳ６９で初期値の設定に失敗したと判定した場合（Ｓ６９：ＮＯ）、ステップＳ６８を実行する。ＣＰＵ３９は、ステップＳ６８を実行した結果として、ステップＳ６９で初期値の設定に成功したという特定結果が得られなかったと判定した場合、ステップＳ６８を再び実行する。ＣＰＵ３９は、ステップＳ６９で特定結果が得られたと判定するまで、ステップＳ６８を繰り返し実行する。

ＣＰＵ３９が初期処理を実行している間にＷＤＴ３５が計時している計時時間がＷＤＴ時間以上となった場合、リセット回路４０は初期化を行い、ＣＰＵ３９は初期処理を最初から実行する。前述したように、ＷＤＴ３５が初期化された場合、ＷＤＴ３５はゼロから計時する。

実施の形態３においては、初期処理のステップＳ６３，Ｓ６６，Ｓ６９の判定が２回以上行われない場合、起動信号が入力されるか、又は、ＣＰＵ３９が初期化されてから出力処理が実行されるまでの時間は、実施の形態１で述べた基準時間よりも短く、ＷＤＴ時間よりも短い。
ＣＰＵ３９は、ステップＳ７１を実行して初期処理を終了した後、出力処理を周期的に実行する。

以上のように構成された実施の形態３における出力装置１４も、実施の形態１における出力装置１４と同様の効果を奏する。
実施の形態１においては、ＣＰＵ３９が初期処理のステップＳ３，Ｓ６，Ｓ９のいずれかで特定結果が得られなかったと判定する都度、電源回路３６が再起動を行い、ＣＰＵ３９は初期処理を再び実行する。実施の形態３においては、ＣＰＵ３９が初期処理のステップＳ６３，Ｓ６６，Ｓ６９のいずれかで特定結果が得られなかったと判定した場合、初期処理が終了されず、継続される。そして、例えば、ＣＰＵ３９が初期処理のステップＳ６１，Ｓ６２を繰り返し実行しているために初期処理の継続期間が長期化した場合、ＷＤＴ３５が計時している計時時間がＷＤＴ時間以上となる。このとき、リセット回路４０は初期化を行い、ＣＰＵ３９は初期処理を最初から実行する。

実施の形態１で述べたように、リセット回路４０が初期化を実行している間、キャパシタＣ１の充電は継続され、キャパシタＣ１の端子電圧値は上昇し続ける。従って、ＣＰＵ３９が初期処理を繰り返し実行している間、実施の形態１で述べたように、キャパシタＣ１の充電が継続され、キャパシタＣ１の端子電圧値は上昇し続ける。キャパシタＣ１の端子電圧値が基準電圧値Ｖｒ以上となった場合、ＯＲ回路２１は、抵抗Ｒ１の一端における電圧値に無関係にハイレベル電圧を駆動回路１３に出力する。

なお、実施の形態３における初期処理においてＣＰＵ３９が実行する所定処理の数は３に限定されず、１であってもよい。例えば、ＲＯＭ３７に記憶されているデータが変更される確率と、初期値の設定に失敗する確率が極めて低い場合、ステップＳ６４〜Ｓ６６，Ｓ６９を実行しなくてもよい。この場合、ＣＰＵ３９は、ステップＳ６１で書き込んだデータがステップＳ６２で読み出したデータと一致したと判定した場合（Ｓ６３：ＹＥＳ）、ステップＳ６７を実行する。更に、ＣＰＵ３９は、ステップＳ６８を実行した後、ステップＳ７０を実行する。
また、初期処理においてＣＰＵ３９が実行する所定処理の数は、２、又は４以上であってもよい。

また、実施の形態３において、起動信号が入力されるか、又は、ＷＤＴ３５の指示に従ってリセット回路４０が初期化を行ってから初期処理が終了するまでの時間が基準時間以上となったか否かを、キャパシタＣ１の端子電圧値に基づいて検知しなくてもよい。例えば、図示しないタイマが計時している計時時間に基づいて、起動信号が入力されるか、又は、ＷＤＴ３５の指示に従ってリセット回路４０が初期化を行ってから初期処理が終了するまでの時間が基準時間以上となったか否かを検知してもよい。

更に、実施の形態１〜３において、抵抗Ｒ２を介して充電される蓄電器は、キャパシタＣ１に限定されず、電池であってもよい。
また、実施の形態１〜３において、メインスイッチ１１は、Ｎチャネル型のＦＥＴに限定されず、Ｐチャネル型のＦＥＴ、バイポーラトランジスタ又はリレー接点等であってもよい。

開示された実施の形態１〜３はすべての点で例示であって、制限的なものではないと考えられるべきである。本発明の範囲は、上述した意味ではなく、特許請求の範囲によって示され、特許請求の範囲と均等の意味及び範囲内でのすべての変更が含まれることが意図される。

１１ メインスイッチ
１３ 駆動回路（切替え回路）
１４ 出力装置
２１ ＯＲ回路（出力回路）
３６ 電源回路
３９ ＣＰＵ（処理部、判定部）
Ｃ１ キャパシタ（蓄電器）

Claims (4)

1. ２つの電圧中の一方の電圧を出力する出力回路を備える出力装置において、
   所定処理を実行する処理部と、
   該処理部が前記所定処理を実行した結果として、特定結果が得られたか否かを判定する判定部と
   を備え、
   前記処理部は、該判定部によって、前記特定結果が得られなかったと判定された場合に再び前記所定処理を実行し、
   前記出力回路は、前記処理部が前記所定処理を繰り返し実行している時間が所定時間以上となった場合、出力している電圧を他の電圧に切替えるように構成してあること
   を特徴とする出力装置。
2. 前記処理部が前記所定処理を繰り返し実行している間、充電される蓄電器を備え、
   前記蓄電器の端子電圧値が所定電圧値以上である場合に、前記出力回路は、出力している電圧を前記他の電圧に切替えるように構成してあること
   を特徴とする請求項１に記載の出力装置。
3. 前記処理部への電力供給を行う電源回路を備え、
   前記電源回路は、前記判定部によって前記特定結果が得られなかったと判定された場合に前記電力供給を停止し、該電力供給を停止した直後に該電力供給を再開し、
   前記処理部は、前記電源回路が該電力供給を再開した後に再び前記所定処理を実行するように構成してあること
   を特徴とする請求項１又は請求項２に記載の出力装置。
4. 請求項１から請求項３のいずれか１つに記載の出力装置と、
   スイッチと、
   前記出力回路が出力した電圧に基づいて該スイッチをオン又はオフに切替える切替え回路と
   を備えることを特徴とする切替えシステム。

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