JP2017116927A - 発光装置 - Google Patents

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Abstract

【課題】トランジスタの特性のばらつきの影響が抑えられる半導体装置を提供する。
【解決手段】トランジスタと、第１の配線と、第２の配線と、第１のスイッチと、第２のスイッチと、第３のスイッチと、第１の容量素子と、第２の容量素子と、を有し、第１のスイッチは、第１の配線と第１の容量素子の第１電極との間の導通または非導通を選択し、第１の容量素子の第１電極は、第２の容量素子の第１電極と電気的に接続され、第１の容量素子の第２電極は、トランジスタのゲートと電気的に接続され、第２の容量素子の第
２電極は、トランジスタのソース及びドレインの一方と接続され、第２のスイッチは、第２の配線と、トランジスタのゲートとの間の導通または非導通を選択し、第３のスイッチは、第１の容量素子の第１電極と、トランジスタのソース及びドレインの一方との間の導通または非導通を選択する半導体装置。
【選択図】図１

Description

本発明は半導体装置、発光装置、または、表示装置に関する。または、それらの駆動方法
、または、それらの製造方法に関する。半導体装置としては、例えば、トランジスタなど
の能動素子等を有する半導体装置が挙げられる。発光装置としては、例えば、エレクトロ
ルミネッセンス素子（以下、ＥＬ素子という）等の発光素子を有する発光装置が挙げられ
る。表示装置としては、例えば、ＥＬ素子等の発光素子、または表示素子を有する表示装
置が挙げられる。特に、本発明は、トランジスタの特性のばらつきの影響が低減された半
導体装置、発光装置、表示装置、または、それらの駆動方法に関する。
発光素子を用いた表示装置は視認性が高く、薄型化に最適であると共に、視野角にも制限
が無いため、ＣＲＴ（ｃａｔｈｏｄｅ ｒａｙ ｔｕｂｅ）や液晶表示装置に替わる表示
装置として注目されている。発光素子を用いたアクティブマトリクス型の表示装置は、具
体的に提案されている構成がメーカーによって異なるが、通常、少なくとも発光素子と、
画素へのビデオ信号の入力を制御するトランジスタ（スイッチング用トランジスタ）と、
該発光素子に供給する電流値を制御するトランジスタ（駆動用トランジスタ）とが、各画
素に設けられている。
例えば、画素に設ける上記トランジスタをすべて同じ導電型とすることで、トランジスタ
の作製工程において、半導体膜に一導電性を付与する不純物元素の添加などの工程を、一
部省略することができる。下記の特許文献１には、ｎチャネル型トランジスタのみで画素
が構成される表示装置について記載されている。
特開２００３−１９５８１０号公報
ところで、発光装置や表示装置等の半導体装置では、トランジスタのドレイン電流が発光
素子に供給されるため、画素間においてトランジスタの特性などにばらつきが生じると、
発光素子等の表示素子の輝度にもそのばらつきが反映されてしまう。従って、例えば、閾
値電圧のばらつきを見越してトランジスタのドレイン電流の電流値を補正することができ
る画素構成の提案は、半導体装置の質向上を図る上で、重要な課題である。
上述の問題に鑑み、本発明の一態様は、トランジスタの特性のばらつきの影響が抑えられ
る、半導体装置、発光装置、または、表示装置を提供することを課題の一つとする。また
は、本発明の一態様は、トランジスタの特性の劣化の影響が抑えられる、半導体装置、発
光装置、または、表示装置を提供することを課題の一つとする。または、本発明の一態様
は、トランジスタの閾値電圧のばらつきによる輝度のばらつきが抑えられる、半導体装置
、発光装置、または、表示装置を提供することを課題の一つとする。または、本発明の一
態様は、トランジスタの移動度のばらつきによる輝度のばらつきが抑えられる、半導体装
置、発光装置、または、表示装置を提供することを課題の一つとする。または、本発明の
一態様は、トランジスタがノーマリオフ型であっても正常に動作する、半導体装置、発光
装置、または、表示装置を提供することを課題の一つとする。または、本発明の一態様は
、トランジスタがノーマリオフ型であっても、トランジスタのしきい値電圧を取得できる
、半導体装置、発光装置、または、表示装置を提供することを課題の一つとする。または
、本発明の一態様は、質の良い表示を行う半導体装置、発光装置、または、表示装置を提
供することを課題の一つとする。または、本発明の一態様は、ムラの少ない表示を行う半
導体装置、発光装置、または、表示装置を提供することを課題の一つとする。または、本
発明の一態様は、少ないトランジスタ数で、所望の回路を実現できるような、半導体装置
、発光装置、または、表示装置を提供することを課題の一つとする。または、本発明の一
態様は、少ない配線数で、所望の回路を実現できるような、半導体装置、発光装置、また
は、表示装置を提供することを課題の一つとする。または、本発明の一態様は、発光素子
の劣化の影響が抑えられる半導体装置、発光装置、または、表示装置を提供することを課
題の一つとする。または、本発明の一態様は、少ない工程数で製造される半導体装置、発
光装置、または、表示装置を提供することを課題の一つとする。
なお、これらの課題の記載は、他の課題の存在を妨げるものではない。なお、本発明の一
態様は、これらの課題の全てを解決する必要はないものとする。なお、これら以外の課題
は、明細書、図面、請求項などの記載から、自ずと明らかとなるものであり、明細書、図
面、特許請求の範囲などの記載から、これら以外の課題を抽出することが可能である。
本発明の半導体装置の一態様は、トランジスタと、第１の配線と、第２の配線と、第１の
スイッチと、第２のスイッチと、第３のスイッチと、第１の容量素子と、第２の容量素子
と、を少なくとも有する。第１のスイッチは、第１の配線と第１の容量素子の一対の電極
のうちの一方との間の導通または非導通を選択する機能を有する。第１の容量素子の一対
の電極のうちの一方は、第２の容量素子の一対の電極のうちの一方と電気的に接続される
。第１の容量素子の一対の電極のうちの他方は、トランジスタのゲートと電気的に接続さ
れる。第２の容量素子の一対の電極のうちの他方は、トランジスタのソース及びドレイン
の一方と電気的に接続される。第２のスイッチは、第２の配線と、トランジスタのゲート
との間の導通または非導通を選択する機能を有する。第３のスイッチは、第１の容量素子
の一対の電極のうちの一方と、トランジスタのソース及びドレインの一方との間の導通ま
たは非導通を選択する機能を有する。
上記構成の半導体装置では、閾値電圧のばらつきを見越してトランジスタ（以下、駆動用
トランジスタという場合がある）のソースとゲート間に印加される電圧を補正することが
できる。こうして、トランジスタのドレイン電流を補正することができる。
本発明の半導体装置の一態様は、トランジスタと、負荷と、第１の配線と、第２の配線と
、第１のスイッチと、第２のスイッチと、第３のスイッチと、第１の容量素子と、第２の
容量素子と、を少なくとも有する。第１のスイッチは、第１の配線と第１の容量素子の一
対の電極のうちの一方との間の導通または非導通を選択する機能を有する。第１の容量素
子の一対の電極のうちの一方は、第２の容量素子の一対の電極のうちの一方と電気的に接
続される。第１の容量素子の一対の電極のうちの他方は、トランジスタのゲートと電気的
に接続される。第２の容量素子の一対の電極のうちの他方は、負荷と、トランジスタのソ
ース及びドレインの一方とに、電気的に接続される。第２のスイッチは、第２の配線と、
トランジスタのゲートとの間の導通または非導通を選択する機能を有する。第３のスイッ
チは、第１の容量素子の一対の電極のうちの一方と、トランジスタのソース及びドレイン
の一方との間の導通または非導通を選択する機能を有する。
上記構成の半導体装置では、閾値電圧のばらつきを見越してトランジスタ（以下、駆動用
トランジスタという場合がある）のソースとゲート間に印加される電圧を補正することが
できる。こうして、トランジスタのドレイン電流を補正することができる。そして、当該
ドレイン電流を負荷に供給することができる。
負荷は、任意の素子や回路を用いることができる。例えば、負荷は、ＥＬ素子等の発光素
子とすることができる。ＥＬ素子等の発光素子は、発光素子のアノードとカソード間を流
れる電流の電流値に比例した輝度で発光する。
負荷として発光素子を用いる場合、一例としては、以下の（タイプＡ）または（タイプＢ
）の構成とすることができる。
（タイプＡ）
上記本発明の一態様に係る半導体装置では、トランジスタ（駆動用トランジスタ）のソー
ス及びドレインの一方は、発光素子のアノードと電気的に接続された構成とすることがで
きる。この場合、当該トランジスタはｎチャネル型トランジスタとする。そして、本発明
の一態様に係る半導体装置は、第１の配線の電位を制御する機能を有する手段（例えば、
駆動回路）を有し、当該手段（駆動回路）は、第１の配線の電位が発光素子のカソードの
電位以下となるような期間を有するように、第１の配線の電位を制御する。
（タイプＢ）
上記本発明の一態様に係る半導体装置では、トランジスタ（駆動用トランジスタ）のソー
ス及びドレインの一方は、発光素子のカソードと電気的に接続された構成とすることがで
きる。この場合、当該トランジスタはｐチャネル型トランジスタとする。そして、本発明
の一態様に係る半導体装置は、第１の配線の電位を制御する機能を有する手段（例えば、
駆動回路）を有し、当該手段（駆動回路）は、第１の配線の電位が発光素子のアノードの
電位以上となるような期間を有するように、第１の配線の電位を制御する。
第１のスイッチ乃至第３のスイッチそれぞれは、トランジスタを用いて構成することがで
きる。当該トランジスタは、駆動用トランジスタと同じ導電型のトランジスタとすること
ができる。
上記本発明の一態様に係る半導体装置は、チャネル形成領域に酸化物半導体を含むトラン
ジスタを用いて構成することができる。または、チャネル形成領域に単結晶シリコンを含
むトランジスタを用いて構成することができる。または、チャネル形成領域に多結晶シリ
コンを含むトランジスタを用いて構成することができる。または、チャネル形成領域に非
晶質シリコンを含むトランジスタを用いて構成することができる。
つまり、トランジスタとして、様々な構造のトランジスタを用いることが出来る。よって
、用いるトランジスタの種類に限定はない。トランジスタの一例としては、単結晶シリコ
ンを有するトランジスタ、または、非晶質シリコン、多結晶シリコン、微結晶（マイクロ
クリスタル、ナノクリスタル、セミアモルファスとも言う）シリコンなどに代表される非
単結晶半導体膜を有する薄膜トランジスタ（ＴＦＴ）などを用いることが出来る。
なお、トランジスタの一例としては、化合物半導体（例えば、ＳｉＧｅ、ＧａＡｓなど）
、又は酸化物半導体（例えば、ＺｎＯ、ＩｎＧａＺｎＯ、インジウム亜鉛酸化物、ＩＴＯ
（インジウム錫酸化物）、ＳｎＯ、ＴｉＯ、ＡｌＺｎＳｎＯ（ＡＺＴＯ）、ＩｎＳｎＺｎ
Ｏなど）などを有するトランジスタ又は、これらの化合物半導体又は酸化物半導体を薄膜
化した薄膜トランジスタなどを用いることが出来る。これらにより、製造温度を低くでき
るので、例えば、室温でトランジスタを製造することが可能となる。その結果、耐熱性の
低い基板、例えばプラスチック基板又はフィルム基板などに直接トランジスタを形成する
ことが出来る。なお、これらの化合物半導体又は酸化物半導体を、トランジスタのチャネ
ル部分に用いるだけでなく、それ以外の用途で用いることも出来る。例えば、これらの化
合物半導体又は酸化物半導体を配線、抵抗素子、画素電極、又は透光性を有する電極など
として用いることができる。それらをトランジスタと同時に成膜又は形成することが可能
なため、コストを低減できる。
なお、トランジスタの一例としては、有機半導体やカーボンナノチューブを有するトラン
ジスタ等を用いることができる。
なお、トランジスタの一例としては、ゲート電極が２個以上のマルチゲート構造のトラン
ジスタを用いることができる。マルチゲート構造にすると、チャネル形成領域が直列に接
続されるため、複数のトランジスタが直列に接続された構造となる。よって、マルチゲー
ト構造により、オフ電流の低減、トランジスタの耐圧向上（信頼性の向上）を図ることが
できる。または、マルチゲート構造により、飽和領域で動作する時に、ドレインとソース
との間の電圧が変化しても、ドレインとソースとの間の電流があまり変化せず、傾きがフ
ラットである電圧・電流特性を得ることができる。傾きがフラットである電圧・電流特性
を利用すると、理想的な電流源回路、又は非常に高い抵抗値をもつ能動負荷を実現するこ
とが出来る。その結果、特性のよい差動回路又はカレントミラー回路などを実現すること
が出来る。
なお、トランジスタの一例としては、チャネルの上下にゲート電極が配置されている構造
のトランジスタを適用することができる。チャネルの上下にゲート電極が配置される構造
にすることにより、複数のトランジスタが並列に接続されたような回路構成となる。よっ
て、チャネル領域が増えるため、電流値の増加を図ることができる。または、チャネルの
上下にゲート電極が配置されている構造にすることにより、空乏層ができやすくなるため
、Ｓ値の改善を図ることができる。
なお、トランジスタの一例としては、チャネル形成領域の上にゲート電極が配置されてい
る構造、チャネル形成領域の下にゲート電極が配置されている構造、正スタガ構造、逆ス
タガ構造、チャネル形成領域を複数の領域に分けた構造、チャネル形成領域を並列に接続
した構造、又はチャネル形成領域が直列に接続する構造などのトランジスタを用いること
ができる。
なお、トランジスタの一例としては、ＬＤＤ領域を設けた構造を適用できる。ＬＤＤ領域
を設けることにより、オフ電流の低減、又はトランジスタの耐圧向上（信頼性の向上）を
図ることができる。または、ＬＤＤ領域を設けることにより、飽和領域で動作する時に、
ドレインとソースとの間の電圧が変化しても、ドレイン電流があまり変化せず、傾きがフ
ラットな電圧・電流特性を得ることができる。
なお、明細書の中の図面や文章において規定されていない内容について、その内容を除く
ことを規定した発明を構成することが出来る。または、ある値について、上限値と下限値
などで示される数値範囲が記載されている場合、その範囲を任意に狭めることで、または
、その範囲の中の一点を除くことで、その範囲を一部除いて発明を規定することができる
。これらにより、例えば、従来技術が本発明の技術的範囲内に入らないことを規定するこ
とができる。
具体例としては、ある回路において、第１乃至第５のトランジスタを用いている回路図が
記載されているとする。その場合、その回路が、第６のトランジスタを有していないこと
を発明として規定することが可能である。または、その回路が、容量素子を有していない
ことを規定することが可能である。さらに、その回路が、ある特定の接続構造を有してい
る第６のトランジスタを有していない、と規定して発明を構成することができる。または
、その回路が、ある特定の接続構造を有している容量素子を有していない、と規定して発
明を構成することができる。例えば、ゲートが第３のトランジスタのゲートと接続されて
いる第６のトランジスタを有していない、と発明を規定することが可能である。または、
例えば、第１の電極が第３のトランジスタのゲートと接続されている容量素子を有してい
ない、と発明を規定することが可能である。
別の具体例としては、ある値について、例えば、「ある電圧が、３Ｖ以上１０Ｖ以下であ
ることが好適である」と記載されているとする。その場合、例えば、ある電圧が、−２Ｖ
以上１Ｖ以下である場合を除く、と発明を規定することが可能である。または、例えば、
ある電圧が、１３Ｖ以上である場合を除く、と発明を規定することが可能である。なお、
例えば、その電圧が、５Ｖ以上８Ｖ以下であると発明を規定することも可能である。なお
、例えば、その電圧が、概略９Ｖであると発明を規定することも可能である。なお、例え
ば、その電圧が、３Ｖ以上１０Ｖ以下であるが、９Ｖである場合を除くと発明を規定する
ことも可能である。
別の具体例としては、ある値について、例えば、「ある電圧が、１０Ｖであることが好適
である」と記載されているとする。その場合、例えば、ある電圧が、−２Ｖ以上１Ｖ以下
である場合を除く、と発明を規定することが可能である。または、例えば、ある電圧が、
１３Ｖ以上である場合を除く、と発明を規定することが可能である。
別の具体例としては、ある物質の性質について、例えば、「ある膜は、絶縁膜である」と
記載されているとする。その場合、例えば、その絶縁膜が、有機絶縁膜である場合を除く
、と発明を規定することが可能である。または、例えば、その絶縁膜が、無機絶縁膜であ
る場合を除く、と発明を規定することが可能である。
別の具体例としては、ある積層構造について、例えば、「ＡとＢとの間に、ある膜が設け
られている」と記載されているとする。その場合、例えば、その膜が、４層以上の積層膜
である場合を除く、と発明を規定することが可能である。または、例えば、Ａとその膜と
の間に、導電膜が設けられている場合を除く、と発明を規定することが可能である。
本発明の一態様では、駆動用トランジスタの閾値電圧に応じてソースとゲート間に印加さ
れる電圧を定めることができる。こうして、トランジスタの特性のばらつきの影響が抑え
られる、半導体装置、発光装置、または、表示装置を提供することができる。または、ト
ランジスタの特性の劣化の影響が抑えられる、半導体装置、発光装置、または、表示装置
を提供することができる。または、トランジスタの閾値電圧のばらつきによる輝度のばら
つきが抑えられる、半導体装置、発光装置、または、表示装置を提供することができる。
または、トランジスタの移動度のばらつきによる輝度のばらつきが抑えられる、半導体装
置、発光装置、または、表示装置を提供することができる。または、本発明の一態様は、
トランジスタがノーマリオフ型であっても正常に動作する、半導体装置、発光装置、また
は、表示装置を提供することができる。または、本発明の一態様は、トランジスタがノー
マリオフ型であっても、トランジスタのしきい値電圧を取得できる、半導体装置、発光装
置、または、表示装置を提供することができる。または、質の良い表示を行う半導体装置
、発光装置、または、表示装置を提供することができる。または、ムラの少ない表示を行
う半導体装置、発光装置、または、表示装置を提供することができる。または、少ないト
ランジスタ数で、所望の回路を実現できるような、半導体装置、発光装置、または、表示
装置を提供することができる。または、少ない配線数で、所望の回路を実現できるような
、半導体装置、発光装置、または、表示装置を提供することができる。または、発光素子
の劣化の影響が抑えられる半導体装置、発光装置、または、表示装置を提供することがで
きる。または、少ない工程数で製造される半導体装置、発光装置、または、表示装置を提
供することができる。
半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 タイミングチャートと半導体装置の動作を示す図。 半導体装置の動作を示す図。 半導体装置の動作を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 タイミングチャートと半導体装置の動作を示す図。 半導体装置の動作を示す図。 半導体装置の動作を示す図。 タイミングチャートと半導体装置の動作を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の動作を示す図。 半導体装置の動作を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の動作を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 電子機器の図。 半導体装置の構成を示す図。 半導体装置の構成を示す図。 半導体装置の構成を示す図とタイミングチャート。 シミュレーションの結果を示す図。 シミュレーションの結果を示す図。 電子機器の図。
以下では、本発明の実施の形態について図面を用いて詳細に説明する。ただし、本発明は
以下の説明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその形態及び
詳細を様々に変更し得ることは、当業者であれば容易に理解される。したがって、本発明
は、以下に示す実施の形態の記載内容に限定して解釈されるものではない。なお、以下に
説明する構成において、同一部分または同様な機能を有する部分については同一の符号を
異なる図面間で共通して用い、その繰り返しの説明は省略する。
なお、ある一つの実施の形態の中で述べる内容（一部の内容でもよい）は、その実施の形
態で述べる別の内容（一部の内容でもよい）、及び／または、一つ若しくは複数の別の実
施の形態で述べる内容（一部の内容でもよい）に対して、適用、組み合わせ、または置き
換えなどを行うことができる。
なお、ある一つの実施の形態において述べる図（一部でもよい）の構成は、その図の別の
部分の構成、その実施の形態において述べる別の図（一部でもよい）の構成、及び／また
は、一つ若しくは複数の別の実施の形態において述べる図（一部でもよい）の構成と組み
合わせることができる。
なお、図において、大きさ、厚さ、または領域は、明瞭化のために誇張されている場合が
ある。よって、本発明の実施形態の一態様は、必ずしもそのスケールに限定されない。ま
たは、図は、理想的な例を模式的に示したものである。よって、本発明の実施形態の一態
様は、図に示す形状などに限定されない。例えば、製造技術による形状のばらつき、誤差
による形状のばらつきなどを含むことが可能である。
なお、ＸとＹとが接続されている、と明示的に記載する場合は、ＸとＹとが電気的に接続
されている場合と、ＸとＹとが機能的に接続されている場合と、ＸとＹとが直接接続され
ている場合とを含むものとする。ここで、Ｘ、Ｙは、対象物（例えば、装置、素子、回路
、配線、電極、端子、導電膜、層、表示素子、発光素子、負荷など）であるとする。した
がって、所定の接続関係、例えば、図または文章に示された接続関係に限定されず、図ま
たは文章に示された接続関係以外のものも含むものとする。
ＸとＹとが電気的に接続されている場合の一例としては、ＸとＹとの電気的な接続を可能
とする素子（例えば、スイッチ、トランジスタ、容量素子、インダクタ、抵抗素子、ダイ
オード、表示素子、発光素子、負荷など）が、ＸとＹとの間に１個以上接続されることが
可能である。なお、スイッチは、オンオフが制御される機能を有している。つまり、スイ
ッチは、導通状態（オン状態）、または、非導通状態（オフ状態）になり、電流を流すか
流さないかを制御する機能を有している。または、スイッチは、電流を流す経路を選択し
て切り替える機能を有している。
ＸとＹとが機能的に接続されている場合の一例としては、ＸとＹとの機能的な接続を可能
とする回路（例えば、論理回路（インバータ、ＮＡＮＤ回路、ＮＯＲ回路など）、信号変
換回路（ＤＡ変換回路、ＡＤ変換回路、ガンマ補正回路など）、電位レベル変換回路（電
源回路（昇圧回路、降圧回路など）、信号の電位レベルを変えるレベルシフタ回路など）
、電圧源、電流源、切り替え回路、増幅回路（信号振幅または電流量などを大きくできる
回路、オペアンプ、差動増幅回路、ソースフォロワ回路、バッファ回路など）、信号生成
回路、記憶回路、制御回路など）が、ＸとＹとの間に１個以上接続されることが可能であ
る。なお、一例として、ＸとＹとの間に別の回路を挟んでいても、Ｘから出力された信号
がＹへ伝達される場合は、ＸとＹとは機能的に接続されているものとする。
なお、ＸとＹとが接続されている、と明示的に記載する場合は、ＸとＹとが電気的に接続
されている場合と、ＸとＹとが機能的に接続されている場合と、ＸとＹとが直接接続され
ている場合とを含むものとする。つまり、電気的に接続されている、と明示的に記載する
場合は、単に、接続されている、とのみ明示的に記載されている場合と同じであるとする
。
なお、回路図上は独立している構成要素同士が電気的に接続しているように図示されてい
る場合であっても、１つの構成要素が、複数の構成要素の機能を併せ持っている場合もあ
る。例えば配線の一部が電極としても機能する場合は、一の導電膜が、配線の機能、及び
電極の機能の両方の機能を併せ持っている。したがって、本明細書における電気的に接続
とは、このような、一の導電膜が、複数の構成要素の機能を併せ持っている場合も、その
範疇に含める。
なお、能動素子（トランジスタ、ダイオードなど）、受動素子（容量素子、抵抗素子など
）などが有するすべての端子について、その接続先を特定しなくても、当業者であれば、
発明の一態様を構成することは可能な場合がある。つまり、接続先を特定しなくても、発
明の一態様が明確であり、本明細書等に記載されていると判断することが可能な場合があ
る。特に、端子の接続先が複数のケース考えられる場合には、その端子の接続先を特定の
箇所に限定する必要はない。したがって、能動素子（トランジスタ、ダイオードなど）、
受動素子（容量素子、抵抗素子など）などが有する一部の端子についてのみ、その接続先
を特定することによって、発明の一態様を構成することが可能な場合がある。
なお、ある回路について、少なくとも接続先を特定すれば、当業者であれば、発明を特定
することが可能な場合がある。または、ある回路について、少なくとも機能を特定すれば
、当業者であれば、発明を特定することが可能な場合がある。つまり、機能を特定すれば
、発明の一態様が明確であり、本明細書等に記載されていると判断することが可能な場合
がある。したがって、ある回路について、機能を特定しなくても、接続先を特定すれば、
発明の一態様として開示されているものであり、発明の一態様を構成することが可能であ
る。または、ある回路について、接続先を特定しなくても、機能を特定すれば、発明の一
態様として開示されているものであり、発明の一態様を構成することが可能である。
なお、本発明の実施形態の一態様は、さまざまな人が実施することが出来る。しかしなが
ら、その実施は、複数の人にまたがって実施される場合がある。例えば、送受信システム
の場合において、Ａ社が送信機を製造および販売し、Ｂ社が受信機を製造および販売する
場合がある。別の例としては、ＴＦＴおよび発光素子を有する発光装置の場合において、
ＴＦＴが形成された半導体装置は、Ａ社が製造および販売する。そして、Ｂ社がその半導
体装置を購入して、その半導体装置に発光素子を成膜して、発光装置として完成させる、
という場合がある。
このような場合、Ａ社またはＢ社のいずれに対しても、特許侵害を主張できるような発明
の一態様を、構成することが出来る。従って、Ａ社またはＢ社に対して、特許侵害を主張
できるような発明の一態様は、明確であり、本明細書等に記載されていると判断する事が
出来る。例えば、送受信システムの場合において、送信機のみで発明の一態様を構成する
ことができ、受信機のみで発明の一態様を構成することができ、それらの発明の一態様は
、明確であり、本明細書等に記載されていると判断することが出来る。別の例としては、
ＴＦＴおよび発光素子を有する発光装置の場合において、ＴＦＴが形成された半導体装置
のみで発明の一態様を構成することができ、ＴＦＴおよび発光素子を有する発光装置のみ
で発明の一態様を構成することができ、それらの発明の一態様は、明確であり、本明細書
等に記載されていると判断することが出来る。
（実施の形態１）
本発明の一態様は、発光素子を有する画素だけでなく、様々な回路として用いることがで
きる。例えば、アナログ回路として用いたり、電流源としての機能を有する回路として用
いることが出来る。そこでまず、本実施の形態では、本発明で開示する回路の基本原理の
一例について述べる。
本発明の一態様に係る半導体装置は、例えば、トランジスタと、当該トランジスタにおい
て、ゲートの電位を固定した状態で、ゲートとソース間に保持されている電荷を放電する
機能を有する構成とを、少なくとも有する。本発明の一態様に係る半導体装置は、上記構
成により、トランジスタの閾値電圧や移動度などに起因するドレイン電流のばらつきを補
正することができる。
図１（Ａ）に示す回路１００は、本発明の一態様に係る半導体装置である。回路１００は
、スイッチ１１、スイッチ１２、スイッチ１３、トランジスタ１０１、容量素子１０２、
容量素子１０３を有する。なお、図１（Ａ）では、トランジスタ１０１がｎチャネル型で
ある場合を一例として示している。
具体的に、図１（Ａ）では、スイッチ１１は、配線２１と、容量素子１０２の一方の電極
（端子）又は容量素子１０３の一方の電極（端子）との間の導通状態を制御する機能を有
する。スイッチ１２は、配線２２と、容量素子１０２の他方の電極（端子）及びトランジ
スタ１０１のゲートとの間の導通状態を制御する機能を有する。スイッチ１３は、トラン
ジスタ１０１のソースまたはドレインの一方、又は、容量素子１０３の他方の電極（端子
）と、容量素子１０２の一方の電極、又は、容量素子１０３の一方の電極（端子）との間
の導通状態を制御する機能を有する。トランジスタ１０１のソースまたはドレインの他方
は、配線２３に接続されている。トランジスタ１０１のソースまたはドレインの一方、又
は、容量素子１０３の他方の電極（端子）は、配線２４に接続されている。
なお、トランジスタが有するソース（ソース端子、ソース領域またはソース電極）とドレ
イン（ドレイン端子、ドレイン領域またはドレイン電極）は、トランジスタの極性及びソ
ースとドレインに与えられる電位の高低によって、その呼び方が入れ替わる。一般的に、
ｎチャネル型トランジスタでは、ソースとドレインのうち、低い電位が与えられる方がソ
ースと呼ばれ、高い電位が与えられる方がドレインと呼ばれる。また、ｐチャネル型トラ
ンジスタでは、ソースとドレインのうち、低い電位が与えられる方がドレインと呼ばれ、
高い電位が与えられる方がソースと呼ばれる。本明細書では、便宜上、ソースとドレイン
とが固定されているものと仮定して、トランジスタの接続関係を説明する場合があるが、
実際には上記電位の関係に従ってソースとドレインの呼び方が入れ替わる。そこで、ソー
スとして機能する部分、及びドレインとして機能する部分を、ソース又はドレインと呼ば
ない場合がある。その場合、一例として、ソースとドレインとの一方を、第１端子、第１
電極、又は第１領域と表記し、ソースとドレインとの他方を、第２端子、第２電極、又は
第２領域と表記する場合がある。
なお、スイッチは、端子間の導通状態と非導通状態を切り替えて動作する機能を有してお
り、電流を流すか流さないかを制御する機能を有している素子である。または、スイッチ
は、電流を流す経路を選択して切り替える機能を有し、例えば、経路１に電流を流すこと
が出来るようにするか、経路２に電流を流すことができるようにするかを選択して切り替
える機能を有している。例えば、電気的スイッチまたは機械的なスイッチなどを用いるこ
とができる。具体的には、トランジスタ、ダイオード、デジタルマイクロミラーデバイス
（ＤＭＤ）のようにＭＥＭＳ（マイクロ・エレクトロ・メカニカル・システム）技術を用
いたスイッチ、などで構成すればよい。また、スイッチはトランジスタを組み合わせた論
理回路でもよい。スイッチとしてトランジスタを用いる場合、該トランジスタの極性は特
に限定されない。ただし、オフ電流が小さいトランジスタを用いることが望ましく、入力
電位に応じて、トランジスタの極性を使い分けることが望ましい。
なお、オフ電流が小さいトランジスタとしては、ＬＤＤ領域を有するトランジスタ、マル
チゲート構造を有するトランジスタ、または酸化物半導体をチャネル形成領域に含むトラ
ンジスタ等がある。また、トランジスタを組み合わせてスイッチとして動作させる場合、
ｎチャネル型とｐチャネル型の両方を用いた相補型のスイッチにしてもよい。相補型のス
イッチにすることで、スイッチに入力する電位が、出力電位と比べて相対的に変化しても
、適切に動作させることができる。
なお、スイッチとしてトランジスタを用いる場合、スイッチは、入力端子（ソースまたは
ドレインの一方）と、出力端子（ソースまたはドレインの他方）と、導通を制御する端子
（ゲート）とを有している場合がある。一方、スイッチとしてダイオードを用いる場合、
スイッチは、導通を制御する端子を有していない場合がある。したがって、トランジスタ
よりもダイオードをスイッチとして用いた方が、端子を制御するための配線を少なくする
ことができる。
なお、トランジスタの一例としては、チャネル形成領域の上下にゲートが配置されている
構造のトランジスタを適用することができる。半導体膜の上下にゲートを配置することに
より、複数のトランジスタが並列に接続されたような回路構成となる。よって、チャネル
形成領域が増えるため、電流値の増加を図ることができる。または、チャネル形成領域の
上下にゲートが配置されている構造にすることにより、空乏層ができやすくなるため、Ｓ
値の改善を図ることができる。
なお、トランジスタの一例としては、チャネル形成領域（もしくはその一部）にソース電
極やドレイン電極が重なっている構造のトランジスタを用いることができる。チャネル形
成領域（もしくはその一部）にソース電極やドレイン電極が重なる構造にすることによっ
て、チャネル形成領域の一部に電荷が溜まることにより動作が不安定になることを防ぐこ
とができる。
なお、容量素子１０２または容量素子１０３は、例えば、配線、半導体膜、または電極等
で絶縁膜または有機膜を挟んだ構成とすればよい。
なお、図１（Ａ）で示した回路１００は、図１（Ｂ）に示すように負荷１０４を有してい
ても良い。図１（Ｂ）に示す回路１００では、負荷１０４が、トランジスタ１０１のソー
スまたはドレインの一方、または、容量素子１０３の他方の電極と、配線２４との間に接
続されている。
なお、本明細書中において負荷とは、例えば、整流性を有するものや、容量性を有するも
のや、抵抗性を有するもの、スイッチを有する回路、画素回路、電流源回路などがある。
例えば、整流性を有するものは、印加するバイアス方向により抵抗値が異なる電流電圧特
性を有し、一方向のみにほとんど電流が流れる電気的特性を有するものであるとする。具
体的に、負荷１０４として、表示素子（液晶素子、ＥＬ素子など）、発光素子（ＥＬ（エ
レクトロルミネッセンス）素子（有機物及び無機物を含むＥＬ素子、有機ＥＬ素子、無機
ＥＬ素子）、ＬＥＤ（白色ＬＥＤ、赤色ＬＥＤ、緑色ＬＥＤ、青色ＬＥＤなど）、トラン
ジスタ（電流に応じて発光するトランジスタ）、電子放出素子、または、表示素子や発光
素子の一部（例えば、画素電極、アノード、カソード）などが挙げられる。
図１（Ｃ）に、負荷１０４として、発光素子１０４ａを用いた場合の、回路１００の構成
を示す。図１（Ｃ）では、発光素子１０４ａのアノードが、トランジスタ１０１のソース
またはドレインの一方、または、容量素子１０３の他方の電極に接続されており、発光素
子１０４ａのカソードが、配線２４に接続されている場合を一例として示している。
また、図１（Ｄ）に、負荷１０４として、発光素子１０４ｂを用いた場合の、回路１００
の構成を示す。図１（Ｄ）では、発光素子１０４ｂのカソードが、トランジスタ１０１の
ソースまたはドレインの一方、または、容量素子１０３の他方の電極に接続されており、
発光素子１０４ｂのアノードが、配線２４に接続されている場合を一例として示している
。なお、図１（Ｄ）では、トランジスタ１０１がｐチャネル型である場合を一例として示
している。
また、本発明の一態様に係る半導体装置は、例えば、図１（Ａ）乃至図１（Ｄ）に示した
回路１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を
、さらに有していても良い。
図２（Ａ）乃至図２（Ｄ）に示す半導体装置は、図１（Ａ）乃至図１（Ｄ）に示す回路１
００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２０１と、配線２
２に一定電圧や信号を供給する機能を有する回路２０２と、配線２３に一定電圧や信号を
供給する機能を有する回路２０３と、配線２４に一定電圧や信号を供給する機能を有する
回路２０４とを、それぞれ有する。
具体的に、回路２０１は、配線２１に、電位Ｖｉ１または電位Ｖｓｉｇを供給する機能を
有する。回路２０１の例としては、ソースドライバ（信号線駆動回路）などがある。した
がって、配線２１は、電位Ｖｉ１、及び／又は、電位Ｖｓｉｇを、伝えることが出来る機
能、または、供給することが出来る機能を有している。または、配線２１は、映像信号線
としての機能を有している。または、配線２１は、初期化用配線としての機能を有してい
る。
電位Ｖｉ１は、回路１００内の各ノードの電位を初期化するための電位である。または、
電位Ｖｉ１は、一例としては、容量素子１０２に電荷を供給するための電位である。また
は、電位Ｖｉ１は、一例としては、トランジスタ１０１をオン状態にするための電位であ
る。なお、電位Ｖｉ１は、一定の電位であることが望ましいが、本発明の実施形態の一態
様は、これに限定されず、パルス信号のように変動してもよい。
なお、一例としては、電位Ｖｓｉｇを回路１００に供給する前において、電位Ｖｉ１が回
路１００に供給される。
電位Ｖｓｉｇは、トランジスタ１０１のドレイン電流の大きさを制御するための電位であ
る。図２（Ｂ）に示した半導体装置の場合は、上記ドレイン電流が負荷１０４に供給され
る。図２（Ｃ）に示した半導体装置の場合は、上記ドレイン電流が発光素子１０４ａに供
給される。図２（Ｄ）に示した半導体装置の場合は、上記ドレイン電流が発光素子１０４
ｂに供給される。例えば、トランジスタ１０１のドレイン電流を一定値に保つ場合は、電
位Ｖｓｉｇの高さを一定とする。また、例えば、トランジスタ１０１のドレイン電流を一
定値としない場合は、電位Ｖｓｉｇの高さを、時間と共に変化させる。一例としては、電
位Ｖｓｉｇは映像信号、及び／又は、アナログ信号である。ただし、本発明の実施形態の
一態様は、これに限定されず、電位Ｖｓｉｇは、一定の電位でもよい。
また、回路２０２は、配線２２に、電位Ｖｉ２を供給する機能を有する。回路２０４の例
としては、電源回路などがある。したがって、配線２２は、電位Ｖｉ２を、伝えることが
出来る機能、または、供給することが出来る機能を有している。または、配線２２は、初
期化用配線としての機能を有している。なお、配線２２の電位は、一定の電位であること
が望ましいが、本発明の実施形態の一態様は、これに限定されず、パルス信号のように変
動してもよい。
電位Ｖｉ２は、回路１００内の各ノード（特にトランジスタ１０１のゲート）の電位を初
期化するための電位である。なお、図２（Ｃ）の場合、電位Ｖｉ２は、配線２４の電位と
同じ、または、それよりも低いことが好適である。これにより、発光素子１０４ａに電流
が流れることを低減することが出来る。図２（Ｄ）の場合、電位Ｖｉ２は、配線２４の電
位と同じ、または、それよりも高いことが好適である。これにより、発光素子１０４ｂに
電流が流れることを低減することが出来る。ただし、電位Ｖｉ２は、これらに限定されな
い。なお、電位Ｖｉ２は、一定の電位であることが望ましいが、本発明の実施形態の一態
様は、これに限定されず、パルス信号のように変動してもよい。
なお、配線２２は、他の配線、または、別の回路１００が有する配線と接続させることが
可能である。これにより、配線の数を減らすことが出来る。
また、回路２０３は、配線２３に、電源電位（高電源電位または低電源電位）、例えば、
電位ＶＤＤ、または、電位ＶＳＳを供給する機能を有する。または、回路２０３は、配線
２３に、信号を供給する機能を有する。回路２０３の例としては、電源回路、パルス出力
回路、ゲートドライバ回路などがある。したがって、配線２３は、電源電位または信号を
伝えることが出来る機能、または、供給することが出来る機能を有している。または、配
線２３は、トランジスタ１０１に電流を供給することが出来る機能を有している。または
、配線２３は、負荷１０４に電流を供給することが出来る機能を有している。または、配
線２３は、電源線としての機能を有している。または、配線２３は、電流供給線としての
機能を有している。なお、配線２３の電位は、一定の電位であることが望ましいが、本発
明の実施形態の一態様は、これに限定されず、パルス信号のように変動してもよい。例え
ば、配線２３の電位は、負荷１０４に、順バイアス電圧だけでなく、逆バイアス電圧を加
えるような電位であってもよい。
また、回路２０４は、配線２４に、電源電位（低電源電位または高電源電位）、例えば、
電位Ｖｃａｔを供給する機能を有する。回路２０４の例としては、電源回路などがある。
したがって、配線２４は、電源電位を伝えることが出来る機能、または、供給することが
出来る機能を有している。または、配線２４は、負荷１０４に電流を供給することが出来
る機能を有している。または、配線２４は、トランジスタ１０１に電流を供給することが
出来る機能を有している。または、配線２４は、共通線としての機能を有している。また
は、配線２４は、陰極配線としての機能を有している。または、配線２４は、陽極配線と
しての機能を有している。なお、配線２４の電位は、一定の電位であることが望ましいが
、本発明の実施形態の一態様は、これに限定されず、パルス信号のように変動してもよい
。例えば、配線２４の電位は、負荷１０４に、順バイアス電圧だけでなく、逆バイアス電
圧を加えるような電位であってもよい。
電位ＶＤＤと電位Ｖｃａｔの電位差により、トランジスタ１０１におけるドレイン電流の
向きが決まる。例えば、電位ＶＤＤが電位Ｖｃａｔより高い場合、配線２３から配線２４
へ電流が流れる。配線２３の電位が電位ＶＳＳの場合で、電位Ｖｃａｔより低い場合、配
線２４から配線２３へ電流が流れる。
なお、図２（Ａ）乃至図２（Ｄ）では、半導体装置が、回路１００に加えて、回路２０１
、回路２０２、回路２０３、及び回路２０４を有する場合を一例として示しているが、本
発明の一態様に係る半導体装置は、必ずしも回路２０１、回路２０２、回路２０３、及び
回路２０４を全て有する必要はなく、そのいずれか一つまたは複数だけを有していても良
い。
なお、トランジスタ１０１は、一例としては、少なくとも電流源としての機能を有してい
る。したがって、例えば、トランジスタ１０１は、トランジスタ１０１の両端（ソースと
ドレインの間）に加わる電圧の大きさが変化しても、概ね一定の電流を供給する機能を有
している。または、例えば、トランジスタ１０１は、負荷１０４の電位が変化しても、負
荷１０４に概ね一定の電流を供給する機能を有している。または、例えば、トランジスタ
１０１は、配線２３の電位が変化しても、概ね一定の電流を供給する機能を有している。
ただし、本発明の実施形態の一態様は、これに限定されず、トランジスタ１０１は電流源
としての機能を有さないことも可能である。例えば、トランジスタ１０１は、スイッチの
機能を有することが可能である。
なお、電流源とは別の電源として、電圧源がある。電圧源は、それに接続された回路に流
れる電流が変化しても、一定の電圧を供給する機能を有している。したがって、電圧源も
電流源も、電圧と電流とを供給する機能を有しているが、何が変化しても、一定の何を供
給する機能を有しているのか、という点で、異なった機能を有するものである。電流源は
、両端の電圧が変化しても、一定の電流を供給する機能を有し、電圧源は、電流が変化し
ても、一定の電圧を供給する機能を有している。
なお、図１などは、回路構成の一例であるため、さらに、トランジスタを追加して設ける
ことが可能である。逆に、図１などの各ノードにおいて、追加してトランジスタ、スイッ
チ、受動素子などを設けないようにすることも可能である。例えば、各スイッチの端子が
接続されたノード、トランジスタの各端子が接続されたノード、または／および、負荷の
各端子が接続されたノードにおいて、直接的に接続されたトランジスタを、これ以上は設
けないようにすることが可能である。従って、例えば、負荷１０４とトランジスタ１０１
と容量素子１０３とスイッチ１３とが接続されているノードにおいて、直接的に接続され
ているトランジスタはトランジスタ１０１のみであり、他のトランジスタはそのノードと
直接的に接続されていない、というような構成にすることが可能である。
そのため、トランジスタを追加しない場合には、少ないトランジスタ数で回路を構成する
ことが可能となる。
なお、図１及び図２に示した回路１００は、スイッチ１１、スイッチ１２、スイッチ１３
にトランジスタを用いることができる。
図１（Ａ）乃至図１（Ｄ）に示した回路１００において、スイッチ１１としてトランジス
タ１１ｔ、スイッチ１２としてトランジスタ１２ｔ、及びスイッチ１３としてトランジス
タ１３ｔを用いた場合の回路１００の構成を、図３（Ａ）乃至図３（Ｄ）に示す。なお、
図３（Ａ）乃至図３（Ｃ）では、トランジスタ１１ｔ、トランジスタ１２ｔ、及びトラン
ジスタ１３ｔが全てｎチャネル型である場合を一例として示している。また、図３（Ｄ）
では、トランジスタ１１ｔ、トランジスタ１２ｔ、及びトランジスタ１３ｔが全てｐチャ
ネル型である場合を一例として示している。トランジスタ１１ｔ、トランジスタ１２ｔ、
及びトランジスタ１３ｔを全て同じ極性のトランジスタとすることで、これらのトランジ
スタを少ない工程数で製造できる。ただし、本発明の実施形態の一態様は、これに限定さ
れず、異なる極性のトランジスタを用いることも可能である。
なお、図３（Ａ）乃至図３（Ｄ）において、トランジスタ１１ｔは、ゲートが配線３１に
接続されている。配線３１に供給される電位に従って、トランジスタ１１ｔは導通状態ま
たは非導通状態となる。トランジスタ１２ｔは、ゲートが配線３２に接続されている。配
線３２に供給される電位に従って、トランジスタ１２ｔは導通状態または非導通状態とな
る。トランジスタ１３ｔは、ゲートが配線３３に接続されている。配線３３に供給される
電位に従って、トランジスタ１３ｔは導通状態または非導通状態となる。したがって、配
線３１乃至配線３３の電位は、パルス状であり、一定ではないことが望ましいが、本発明
の実施形態の一態様は、これに限定されない。または、配線３１乃至配線３３は、ゲート
信号線（ゲート線）、選択信号線、または、スキャン線（走査線）としての機能を有して
いる。
なお、配線３１乃至配線３３において、その中の少なくとも２本の配線は、互いに接続さ
せることが可能である。または、配線３１乃至配線３３の少なくとも１本は、別の回路１
００の配線３１乃至配線３３の少なくとも１本と接続させることが可能である。
また、本発明の一態様に係る半導体装置は、図３（Ａ）乃至図３（Ｄ）に示した回路１０
０に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さらに
有していても良い。
図４（Ａ）乃至図４（Ｄ）に示す半導体装置は、図３（Ａ）乃至図３（Ｄ）に示す回路１
００に加えて、配線３１に一定電圧や信号を供給する機能を有する回路２０５と、配線３
２に一定電圧や信号を供給する機能を有する回路２０６と、配線３３に一定電圧や信号を
供給する機能を有する回路２０７とを、それぞれ有する。回路２０５、回路２０６、回路
２０７の例としては、ゲートドライバ（走査線駆動回路）などがある。
なお、回路２０１、回路２０２、回路２０３、回路２０４、回路２０５、回路２０６、回
路２０７は、一つの同じ回路であってもよいし、別々の回路であってもよい。
なお、図４（Ａ）乃至図４（Ｄ）では、半導体装置が、回路１００に加えて、回路２０５
、回路２０６、及び回路２０７を有する場合を一例として示しているが、本発明の一態様
に係る半導体装置は、必ずしも回路２０５、回路２０６、及び回路２０７を全て有する必
要はなく、そのいずれか一つまたは複数だけを有していても良い。
また、図３（Ｃ）に示す回路１００において、トランジスタ１０１、トランジスタ１１ｔ
、及びトランジスタ１３ｔがｎチャネル型、トランジスタ１２ｔがｐチャネル型である場
合の回路１００の構成を図３７（Ａ）に示す。また、図３（Ｄ）に示す回路１００におい
て、トランジスタ１０１、トランジスタ１１ｔ、及びトランジスタ１３ｔがｐチャネル型
、トランジスタ１２ｔがｎチャネル型である場合の回路１００の構成を図３７（Ｂ）に示
す。このように、様々な極性のトランジスタを用いることが出来る。
また、本発明の一態様に係る半導体装置は、図３７（Ａ）及び図３７（Ｂ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図３７（Ｃ）及び図３７（Ｄ）に示す半導体装置は、図３７（Ａ）及び図３７（Ｂ）に示
す回路１００に加えて、配線３１に一定電圧や信号を供給する機能を有する回路２０５と
、配線３２に一定電圧や信号を供給する機能を有する回路２０６と、配線３３に一定電圧
や信号を供給する機能を有する回路２０７とを、それぞれ有する。
なお、図３７（Ｃ）及び図３７（Ｄ）では、半導体装置が、回路１００に加えて、回路２
０５、回路２０６、及び回路２０７を有する場合を一例として示しているが、本発明の一
態様に係る半導体装置は、必ずしも回路２０５、回路２０６、及び回路２０７を全て有す
る必要はなく、そのいずれか一つまたは複数だけを有していても良い。
なお、トランジスタ１０１は、電流を流すときには、飽和領域で動作する場合が多い。よ
って、図３、図４、及び図３７において、トランジスタ１０１のチャネル長またはゲート
長を、トランジスタ１１ｔ、トランジスタ１２ｔ、及び／または、トランジスタ１３ｔよ
りも長くすることが望ましい。チャネル長またはゲート長を長くすることにより、飽和領
域での特性がフラットになり、キンク効果を低減することができる。好ましくは、５倍以
上、より好ましくは１０倍以上であることが望ましい。一例としては、トランジスタ１０
１のチャネル長またはゲート長は、１０μｍ以上、より好ましくは、２０μｍ以上である
。或いは、トランジスタ１０１のチャネル幅またはゲート幅を、トランジスタ１１ｔ、ト
ランジスタ１２ｔ、及び／または、トランジスタ１３ｔよりも長くすることにより、トラ
ンジスタ１０１は、飽和領域においても、多くの電流を流すことができる。好ましくは、
５倍以上、より好ましくは１０倍以上であることが望ましい。トランジスタ１０１のチャ
ネル幅またはゲート幅は、２０μｍ以上、より好ましくは、３０μｍ以上である。ただし
、本発明の実施形態の一態様は、これらに限定されない。
次いで図１（Ｃ）に示す回路１００を例に挙げて、本発明の一態様の半導体装置の動作に
ついて説明する。
図１（Ｃ）に示す回路１００の動作は、主に第１の動作、第２の動作、第３の動作、第４
の動作、第５の動作に分けることができる。ただし、これに限定されず、新たな動作の追
加、或いは、一部の動作の削除も可能である。
図１（Ｃ）に示す回路１００における、スイッチ１１、スイッチ１２、及びスイッチ１３
の動作と、配線２１の電位と、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１
）とを示すタイミングチャートの一例を、図５（Ａ）に図示する。
まず、期間Ｔ１１において行われる第１の動作について説明する。期間Ｔ１１では、図５
（Ａ）に示すように、スイッチ１１、スイッチ１２、及びスイッチ１３が導通状態である
。また、配線２１には電位Ｖｉ１が供給される。よって、期間Ｔ１１では、図５（Ｂ）に
示すように、容量素子１０２に電圧Ｖｉ２−Ｖｉ１が供給され、発光素子１０４ａのアノ
ードは電位Ｖｉ１となり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は
、電圧Ｖｉ２−Ｖｉ１となる。つまり、トランジスタ１０１、及び、容量素子１０２を、
初期化していることとなる。
なお、図１（Ｃ）に示す回路１００では、電位Ｖｉ２は、電位Ｖｉ１にトランジスタ１０
１の閾値電圧Ｖｔｈを加算した電位よりも、高いことが望ましい。つまり、電位Ｖｉ２と
電位Ｖｉ１は、トランジスタ１０１がオン状態となるような電位であることが望ましい。
また、電位Ｖｉ１に発光素子１０４ａの閾値電圧Ｖｔｈｅ（発光素子１０４ａが発光しは
じめる電圧）を加算した電位は、電位Ｖｃａｔより低いことが望ましい。例えば、電位Ｖ
ｉ１は、電位Ｖｃａｔと同じ電位か、それよりも低い電位であることが望ましい。電位Ｖ
ｉ１が、電位Ｖｃａｔよりも低い場合には、発光素子１０４ａが逆バイアス状態となるた
め、発光素子１０４ａの劣化を低減する、或いはショート箇所をリペアすることが可能で
ある。また、電位Ｖｉ２から発光素子１０４ａの閾値電圧Ｖｔｈｅを差し引いた電位は、
電位Ｖｃａｔより低いことが望ましい。なお、以下、一例として、閾値電圧Ｖｔｈｅが０
であるものと仮定する。
期間Ｔ１２において行われる第２の動作について説明する。期間Ｔ１２では、図５（Ａ）
に示すように、スイッチ１１が非導通状態、スイッチ１２及びスイッチ１３が導通状態で
ある。スイッチ１１が非導通状態となることで、容量素子１０２に蓄積されている電荷が
トランジスタ１０１を介して放出され、トランジスタ１０１のソースの電位が上昇する。
そして、トランジスタ１０１がオフ状態となると、容量素子１０２からの電荷の放出が止
まる。最終的には、トランジスタ１０１の閾値電圧Ｖｔｈが容量素子１０２に保持される
。よって、期間Ｔ１２では、図５（Ｃ）に示すように、容量素子１０２に閾値電圧Ｖｔｈ
が保持され、発光素子１０４ａのアノードは電位Ｖｉ２−Ｖｔｈとなり、トランジスタ１
０１のゲートソース間電圧（Ｖｇｓ１０１）は、閾値電圧Ｖｔｈとなる。つまり、トラン
ジスタ１０１のしきい値電圧Ｖｔｈを取得することができる。
なお、Ｖｇｓ１０１が、トランジスタ１０１のしきい値電圧Ｖｔｈに等しくなるまでには
、非常に長い時間が必要となる場合がある。したがって、Ｖｇｓ１０１は、しきい値電圧
Ｖｔｈまで完全に低下させずに、動作させる場合も多い。つまり、Ｖｇｓ１０１は、しき
い値電圧Ｖｔｈよりも、わずかに大きい値となった状態で、期間Ｔ１２が終了する場合も
多い。つまり、期間Ｔ１２が終了した時点では、Ｖｇｓ１０１は、しきい値電圧に応じた
大きさの電圧になっている、ということも出来る。
なお、第２の動作において、トランジスタ１０１のしきい値電圧Ｖｔｈが正か負かという
ことに関係なく、動作させることができる。これは、トランジスタ１０１がオフ状態とな
るまで、トランジスタ１０１のソース電位が上昇できるからである。つまり、トランジス
タ１０１のゲート電位よりも、トランジスタ１０１のソース電位の方が高くなった状態で
、ようやくトランジスタ１０１がオフし、Ｖｇｓ１０１がＶｔｈとなる、ということが可
能であるからである。したがって、トランジスタ１０１がエンハンスメント型（ノーマリ
オフ型）であっても、デプリーション型（ノーマリオン型）であっても、正常に動作させ
ることができる。
なお、発光素子１０４ａのアノードの電位が高くなったときに、発光素子１０４ａに電流
が流れないようにすることが望ましい。そのためには、発光素子１０４ａに電流が流れな
いように、電位Ｖｉ２を低い値とすることが好適である。ただし、発明の実施形態の一態
様は、これに限定されない。なお、発光素子１０４ａと直列にスイッチを設けて、それを
オフ状態にすることにより、発光素子１０４ａに電流が流れないようにすることが可能で
あれば、電位Ｖｉ２は、高い値でもよい。
期間Ｔ１３において行われる第３の動作について説明する。期間Ｔ１３では、図５（Ａ）
に示すように、スイッチ１１及びスイッチ１３が導通状態、スイッチ１２が非導通状態で
ある。また、配線２１には、一例として、電位Ｖｉ１が供給される。よって、期間Ｔ１３
では、図６（Ａ）に示すように、容量素子１０２に閾値電圧Ｖｔｈ（またはＶｔｈに応じ
た大きさの電圧）が保持され、発光素子１０４ａのアノードは電位Ｖｉ１となり、トラン
ジスタ１０１のゲートの電位は電位Ｖｉ１＋Ｖｔｈ（またはＶｔｈに応じた大きさの電圧
）となり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は、閾値電圧Ｖｔ
ｈ（またはＶｔｈに応じた大きさの電圧）となる。これにより、発光素子１０４ａのアノ
ードの電位、または、トランジスタ１０１のソースの電位を初期化することができる。
なお、上記第３の動作は必ずしも行う必要はなく、第２の動作の後に、以下に示す第４の
動作を行うようにしても良い。
なお、期間Ｔ１３における配線２１の電位は、電位Ｖｉ１に限定されず、別の大きさの電
位（例えば電位Ｖｉ３）とすることも可能である。ただし、期間Ｔ１３における配線２１
の電位を電位Ｖｉ１とすることにより、回路２０１の構成をシンプルにすることができる
。または、配線２１に、複数の回路１００が接続されている場合において、配線２１の電
位を電位Ｖｉ１とすることにより、ある回路１００では、期間Ｔ１１として動作させ、別
の回路１００では、期間Ｔ１３として動作させることが出来るため、動作期間を効率的に
使用することが出来る。
期間Ｔ１４において行われる第４の動作について説明する。期間Ｔ１４では、図５（Ａ）
に示すように、スイッチ１１が導通状態、スイッチ１２及びスイッチ１３が非導通状態で
ある。また、配線２１には電位Ｖｓｉｇが供給される。よって、期間Ｔ１４では、図６（
Ｂ）に示すように、容量素子１０２に閾値電圧Ｖｔｈ（またはＶｔｈに応じた大きさの電
圧である）が保持され、容量素子１０３に電圧Ｖｓｉｇ−Ｖｉ１−Ｖαが保持され、発光
素子１０４ａのアノードは電位Ｖｉ１＋Ｖαとなり、トランジスタ１０１のゲートの電位
は電位Ｖｓｉｇ＋Ｖｔｈとなり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０
１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１−Ｖαとなる。したがって、電位Ｖｓｉｇを容量素
子１０３に入力することが出来る。または、容量素子１０２の電圧と容量素子１０３の電
圧との和が、トランジスタ１０１のゲートソース間電圧となるようにすることが出来る。
なお、第４の動作で、電位Ｖαは、発光素子１０４ａのアノードが電気的に浮遊状態（フ
ローティング状態）となることで変動する電位である。電位Ｖαは、トランジスタ１０１
がオフであるならば、発光素子１０４ａの静電容量と、容量素子１０２及び容量素子１０
３の静電容量の比に応じて、その値が定まる。しかし、電位Ｖｓｉｇの高さによっては、
トランジスタ１０１がオンするので、トランジスタ１０１を介して発光素子１０４ａのア
ノードに電荷が流入してしまう。よって、電位Ｖαは、上記静電容量の比によってのみ決
まらず、発光素子１０４ａのアノードに流入する電荷によっても、その値が変化する。
ここで、ゲートソース間電圧Ｖｇｓを理想的な値、すなわち電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ
１に近づけるには、電位Ｖαが小さくなるように設計することが好ましい。具体的には、
発光素子１０４ａの静電容量が、容量素子１０２及び容量素子１０３の静電容量よりも十
分に大きければ、ゲートソース間電圧Ｖｇｓを理想的な値に近づけることができる。
したがって、容量素子１０３の容量値は、負荷１０４（発光素子１０４ａ）の寄生容量の
容量値よりも、小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／５
倍以下が好適である。または、容量素子１０３の電極の面積は、負荷１０４（発光素子１
０４ａ）の電極の面積よりも小さいことが望ましく、望ましくは１／２倍以下、より望ま
しくは１／５倍以下が好適である。ただし、本発明の実施形態の一態様は、これらに限定
されない。
また、ゲートソース間電圧（Ｖｇｓ１０１）を理想的な値に近づけるには、発光素子１０
４ａのアノードに流入する電荷量Ｑを小さくすることが、望ましい。よって、上記電荷量
Ｑを小さくするために期間Ｔ１４はなるべく短い方が良い。なお、上述したように、予め
期間Ｔ１３において配線２１に電位Ｖｓｉｇを供給しておくと、期間Ｔ１４においてスイ
ッチ１１を導通状態にしたときに、トランジスタ１０１のゲートの電位を、電位Ｖｓｉｇ
＋Ｖｔｈに素早く近づけることができる。よって、期間Ｔ１４を短くできるので、電荷量
Ｑを小さくする上で望ましい。
したがって、期間Ｔ１４の長さは、期間Ｔ１１、期間Ｔ１２、及び／又は、期間Ｔ１３の
長さよりも、小さいことが望ましく、望ましくは２／３倍以下、より望ましくは１／２倍
以下が好適である。ただし、本発明の実施形態の一態様は、これらに限定されない。
なお、電荷量Ｑは、上述したように小さい方が望ましいが、トランジスタ１０１の移動度
のばらつきが大きい場合は、電荷量Ｑによって移動度のばらつきを抑える効果が期待でき
る。以下、この理由について説明する。
電荷量Ｑは、期間Ｔ１４において、トランジスタ１０１のドレインからソースに流れ込む
電荷量に相当する。よって、電荷量Ｑは、トランジスタ１０１の移動度が大きいほど、大
きくなる。そして、電荷量Ｑが大きくなると、発光素子１０４ａの発光時における、トラ
ンジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）が、小さくなる。すなわち、電荷
量Ｑにより、トランジスタ１０１の移動度が大きいほど、発光素子１０４ａに供給される
電流値が小さくなるように補正がかかり、また、トランジスタ１０１の移動度が小さいほ
ど、発光素子１０４ａに供給される電流値があまり小さくならないように補正がかかる。
したがって、電荷量Ｑにより、移動度のばらつきを抑えることができる。
なお、容量素子１０２の容量値は、トランジスタ１０１のゲートの寄生容量の容量値より
も、大きいことが望ましく、望ましくは２倍以上、より望ましくは５倍以上が好適である
。または、容量素子１０２の電極の面積は、トランジスタ１０１のチャネルの面積よりも
大きいことが望ましく、望ましくは２倍以上、より望ましくは５倍以上が好適である。ま
たは、容量素子１０２の電極の面積は、トランジスタ１０１のゲート電極の面積よりも大
きいことが望ましく、望ましくは２倍以上、より望ましくは５倍以上が好適である。それ
らにより、電位Ｖｓｉｇが入力されて、容量素子１０２とトランジスタのゲート容量とで
、電圧が容量分割されたときに、容量素子１０２の電圧の減少を低減することが出来る。
ただし、本発明の実施形態の一態様は、これに限定されない。
なお、容量素子１０２の容量値は、容量素子１０３の容量値と、同じ程度の大きさである
か、それよりも、大きいことが望ましい。容量素子１０２の容量値は、容量素子１０３の
容量値と、±２０％以下の違い、より好ましくは±１０％以下の違いであることが好適で
ある。または、容量素子１０２の電極の面積は、容量素子１０３の電極の面積と、同じ程
度の大きさであるか、それよりも、大きいことが望ましい。これらにより、同じレイアウ
ト面積のなかで、最適な動作を行うことが出来る。ただし、本発明の実施形態の一態様は
、これに限定されない。
期間Ｔ１５において行われる第５の動作について説明する。期間Ｔ１５では、図５（Ａ）
に示すように、スイッチ１１、スイッチ１２及びスイッチ１３が非導通状態である。よっ
て、期間Ｔ１５では、図６（Ｃ）に示すように、容量素子１０２に閾値電圧Ｖｔｈが保持
され、容量素子１０３に電圧Ｖｓｉｇ−Ｖｉ１−Ｖαが保持され、発光素子１０４ａのア
ノードは電位Ｖｅｌとなり、トランジスタ１０１のゲートの電位は電位Ｖｓｉｇ＋Ｖｔｈ
−Ｖｉ１−Ｖα＋Ｖｅｌとなり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０
１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１−Ｖαとなる。したがって、電位Ｖｓｉｇに応じた
大きさの電流を発光素子１０４ａに流すことができ、電位Ｖｓｉｇに応じた輝度で発光素
子１０４ａを発光させることができる。
なお、電位Ｖｅｌは、トランジスタ１０１を介して、発光素子１０４ａに電流を流す際に
生じる電位である。具体的には、電位ＶＤＤと電位Ｖｃａｔの間の電位になる。
上記第５の動作では、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）を、電
圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１−Ｖαとし、トランジスタ１０１の閾値電圧Ｖｔｈを加味し
た値に設定することができる。従って、上記構成により、トランジスタ１０１の閾値電圧
Ｖｔｈのばらつきが、発光素子１０４ａに供給する電流値に影響を及ぼすのを防ぐことが
できる。または、トランジスタ１０１が劣化して、閾値電圧Ｖｔｈが変化しても、上記変
化が発光素子１０４ａに供給する電流値に影響を及ぼすのを防ぐことができる。よって、
表示ムラを低減でき、質の良い表示を行うことができる。
同様に、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）を、電圧Ｖｓｉｇ＋
Ｖｔｈ−Ｖｉ１−Ｖαとし、Ｖｅｌとは無関係な値に設定することができる。上記構成に
より、発光素子１０４ａの電圧電流特性のばらつきが、発光素子１０４ａに供給する電流
値に影響を及ぼすのを防ぐことができる。または、発光素子１０４ａが劣化して、発光素
子１０４ａの電圧電流特性が変化して、Ｖｅｌが変化しても、上記変化が発光素子１０４
ａに供給する電流値に影響を及ぼすのを防ぐことができる。よって、表示ムラを低減でき
、質の良い表示を行うことができる。
なお、第５の動作の一部の期間において、強制的にトランジスタ１０１がオフ状態になる
ようにして、発光素子１０４ａが発光しないような状況にすることも可能である。つまり
、非発光期間を設けることも可能である。例えば、スイッチ１２をオンにすることにより
、トランジスタ１０１をオフ状態にすることが可能である。
なお、本発明の一態様に係る半導体装置では、第２の動作において、トランジスタ１０１
のゲートを電位Ｖｉ２に保つ。上記動作により、トランジスタ１０１がノーマリオンであ
っても、すなわち閾値電圧Ｖｔｈがマイナスの値を有していても、トランジスタ１０１に
おいて、ソースの電位がゲートの電位Ｖｉ２よりも高くなるまで容量素子１０２に蓄積さ
れている電荷を放出することができる。よって、本発明の一態様に係る半導体装置では、
トランジスタ１０１がノーマリオンであっても、上記第５の動作において、トランジスタ
１０１の閾値電圧Ｖｔｈを加味した値になるよう、トランジスタ１０１のゲートソース間
電圧（Ｖｇｓ１０１）を設定することができる。
なお、期間Ｔ１１乃至期間Ｔ１５における、回路１００の概略図を、図７（Ａ）乃至図７
（Ｅ）に、それぞれ示す。本発明の一態様に係る半導体装置は、回路１００が、上記各期
間において図７（Ａ）乃至図７（Ｅ）に示す構造を取ることができれば良い。よって、本
発明の一態様に係る半導体装置は、図１乃至図４に示した構成を有する回路１００に限定
されるものではない。本発明の一態様に係る半導体装置は、回路１００において、図７（
Ａ）乃至図７（Ｅ）に示す構造を取りうるように、スイッチの配置や数、各種電位の供給
を行う配線の数などを、適宜変更することが可能である。
また、本発明の一態様に係る半導体装置は、図１（Ｂ）に示した回路１００において、負
荷１０４と接続された容量素子１０５を、さらに有していても良い。同様に、本発明の一
態様に係る半導体装置は、図１（Ｃ）に示した回路１００において、発光素子１０４ａと
接続された容量素子１０５を、さらに有していても良い。同様に、本発明の一態様に係る
半導体装置は、図１（Ｄ）に示した回路１００において、発光素子１０４ｂと接続された
容量素子１０５を、さらに有していても良い。
図８（Ａ）に示す半導体装置は、図１（Ｂ）に示した回路１００において、負荷１０４と
接続された容量素子１０５を、さらに有している。具体的には、容量素子１０５の一方の
電極が、容量素子１０３の他方の電極、及びトランジスタ１０１のソースまたはドレイン
の一方に、接続されている。容量素子１０５の他方の電極は、配線２６に接続されている
。なお、図８（Ａ）では、回路１００が負荷１０４を有する場合を一例として示している
が、図８（Ａ）において、負荷１０４の代わりに発光素子１０４ａまたは発光素子１０４
ｂが用いられていても良い。
なお、配線２６は、様々な配線と接続させることが可能である。例えば、配線２２、配線
２３、配線２４、または、別の回路１００の配線、走査線、ゲート線、トランジスタのゲ
ートと接続された配線などに接続させることが出来る。これにより、配線の数を減らすこ
とが出来る。
図８（Ｂ）に示す半導体装置は、図８（Ａ）に示した回路１００において、配線２６を配
線２４に接続させた場合の例を示す。なお、図８（Ｂ）では、回路１００が負荷１０４を
有する場合を一例として示しているが、図８（Ｂ）において、負荷１０４の代わりに発光
素子１０４ａまたは発光素子１０４ｂが用いられていても良い。このように接続すること
により、配線２６を減らすことが出来る。
図８（Ｃ）に示す半導体装置は、図８（Ａ）に示した回路１００において、配線２６を配
線２３に接続させた場合の例を示す。なお、図８（Ｃ）では、回路１００が負荷１０４を
有する場合を一例として示しているが、図８（Ｃ）において、負荷１０４の代わりに発光
素子１０４ａまたは発光素子１０４ｂが用いられていても良い。このように接続すること
により、配線２６を減らすことが出来る。
図８（Ｄ）に示す半導体装置は、図８（Ａ）に示した回路１００において、配線２６を配
線２２に接続させた場合の例を示す。なお、図８（Ｄ）では、回路１００が負荷１０４を
有する場合を一例として示しているが、図８（Ｄ）において、負荷１０４の代わりに発光
素子１０４ａまたは発光素子１０４ｂが用いられていても良い。このように接続すること
により、配線２６を減らすことが出来る。
負荷１０４、発光素子１０４ａまたは発光素子１０４ｂに、接続された容量素子１０５を
、回路１００に追加することで、本実施の形態で説明した第３の動作及び第４の動作にお
いて、トランジスタ１０１のソースまたはドレインの一方における電荷の変動を抑えるこ
とができるため、電圧Ｖαを小さくすることができる。よって、ゲートソース間電圧Ｖｇ
ｓを理想的な値、すなわち電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１に近づけることができ、負荷１
０４、発光素子１０４ａまたは発光素子１０４ｂに供給する電流を、電圧Ｖｓｉｇを正確
に反映した値により近づけることができる。
または、容量素子１０５の容量値を適宜調整することにより、期間Ｔ１４における電荷量
Ｑによる電位の変化量を調整することができる。これにより、移動度のばらつきの低減を
、より適切に行うことが出来る。
なお、容量素子１０５の電極の面積は、負荷１０４（発光素子１０４ａ）の電極の面積よ
りも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／３倍以下が好
適である。または、容量素子１０５の容量値は、負荷１０４（発光素子１０４ａ）の容量
値よりも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／３倍以下
が好適である。それらにより、同じレイアウト面積のなかで、最適な動作を行うことが出
来る。ただし、本発明の実施形態の一態様は、これに限定されない。
なお、容量素子１０５の電極の面積と、負荷１０４（発光素子１０４ａ）の電極の面積の
合計は、容量素子１０３の電極の面積よりも大きいことが望ましく、望ましくは２倍以上
、より望ましくは５倍以上が好適である。または、容量素子１０５の容量値と、負荷１０
４（発光素子１０４ａ）の容量値の合計は、容量素子１０３の容量値よりも大きいことが
望ましく、望ましくは２倍以上、より望ましくは５倍以上が好適である。それらにより、
容量素子１０３と、容量素子１０５及び負荷１０４（発光素子１０４ａ）とで、電圧が容
量分割されたときに、容量素子１０３により多くの電圧が加わるようにすることが出来る
。ただし、本発明の実施形態の一態様は、これに限定されない。
なお、容量素子１０５の電極の面積は、容量素子１０２または容量素子１０３の電極の面
積よりも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／３倍以下
が好適である。または、容量素子１０５の容量値は、容量素子１０２または容量素子１０
３の容量値よりも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／
３倍以下が好適である。それらにより、同じレイアウト面積のなかで、最適な動作を行う
ことが出来る。ただし、本発明の実施形態の一態様は、これに限定されない。
また、本発明の一態様に係る半導体装置は、図８（Ａ）乃至図８（Ｄ）に示した回路１０
０に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さらに
有していても良い。
図９（Ａ）乃至図９（Ｄ）に示す半導体装置は、図８（Ａ）乃至図８（Ｄ）に示す回路１
００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２０１と、配線２
２に一定電圧や信号を供給する機能を有する回路２０２と、配線２３に一定電圧や信号を
供給する機能を有する回路２０３と、配線２４に一定電圧や信号を供給する機能を有する
回路２０４とを、それぞれ有する。さらに、図９（Ａ）に示す回路１００は、配線２６に
一定電圧や信号を供給する機能を有する回路２０８を有する。回路２０８の例としては、
電源回路などがある。したがって、配線２６は、所定の電位を、伝えることが出来る機能
、または、供給することが出来る機能を有している。または、配線２６は、容量用配線と
しての機能を有している。なお、配線２６の電位は、一定の電位であることが望ましいが
、本発明の実施形態の一態様は、これに限定されず、パルス信号のように変動してもよい
。
また、図１（Ｂ）乃至図１（Ｄ）、図８（Ｂ）乃至図８（Ｄ）のいずれかの回路１００を
、表示装置の画素として用いても良い。そして、複数の色相にそれぞれ対応した画素が表
示装置に設けられている場合、対応する色相によって、画素が有するトランジスタ１０１
の、チャネル幅とチャネル長の比が、異なっていても良い。同様に、画素が有する容量素
子１０５の容量値も、対応する色相によって、異なっていても良い。
図１０（Ａ）に、図１（Ｂ）に示した回路１００を、表示装置の画素として用いた場合を
一例として示している。図１０（Ａ）では、回路１００（Ｒ）が赤（Ｒ）に対応した画素
に相当し、回路１００（Ｇ）が緑（Ｇ）に対応した画素に相当し、回路１００（Ｂ）が青
（Ｂ）に対応した画素に相当する。本発明の一態様では、回路１００（Ｒ）が有するトラ
ンジスタ１０１（Ｒ）と、回路１００（Ｇ）が有するトランジスタ１０１（Ｇ）と、回路
１００（Ｂ）が有するトランジスタ１０１（Ｂ）との少なくとも一つにおいて、そのチャ
ネル幅とチャネル長の比が他と異なっていても良い。上記構成により、回路１００（Ｒ）
が有する負荷１０４（Ｒ）、回路１００（Ｇ）が有する負荷１０４（Ｇ）、回路１００（
Ｂ）が有する負荷１０４（Ｂ）のそれぞれに供給される電流を異なる値に設定することが
できる。一例としては、第２の色に対応するトランジスタ１０１のチャネル幅とチャネル
長の比は、第１の色に対応するトランジスタ１０１よりも、好ましくは１．２倍以上、よ
り好ましくは、１．５倍以上であることが好適である。そして、第３の色に対応するトラ
ンジスタ１０１のチャネル幅とチャネル長の比は、第１の色に対応するトランジスタ１０
１よりも、好ましくは１．５倍以上、より好ましくは、２倍以上であることが好適である
。ただし、本発明の実施形態の一態様は、これに限定されない。
また、図１０（Ｂ）に、図８（Ａ）に示した回路１００を、表示装置の画素として用いた
場合を一例として示している。図１０（Ｂ）の場合も図１０（Ａ）と同様に、回路１００
（Ｒ）が有するトランジスタ１０１（Ｒ）と、回路１００（Ｇ）が有するトランジスタ１
０１（Ｇ）と、回路１００（Ｂ）が有するトランジスタ１０１（Ｂ）との少なくとも一つ
が、そのチャネル幅とチャネル長の比が他と異なっていても良い。上記構成により、回路
１００（Ｒ）が有する負荷１０４（Ｒ）、回路１００（Ｇ）が有する負荷１０４（Ｇ）、
回路１００（Ｂ）が有する負荷１０４（Ｂ）のそれぞれに供給される電流を異なる値に設
定することができる。
また、図１０（Ｂ）の場合、回路１００（Ｒ）が有する容量素子１０５（Ｒ）と、回路１
００（Ｇ）が有する容量素子１０５（Ｇ）と、回路１００（Ｂ）が有する容量素子１０５
（Ｂ）との少なくとも一つにおいて、その容量値が他と異なっていても良い。一例として
は、第２の色に対応する容量素子１０５の容量値は、第１の色に対応する容量素子１０５
よりも、好ましくは１．２倍以上、より好ましくは、１．５倍以上であることが好適であ
る。そして、第３の色に対応する容量素子１０５の容量値は、第１の色に対応する容量素
子１０５よりも、好ましくは１．５倍以上、より好ましくは、２倍以上であることが好適
である。ただし、本発明の実施形態の一態様は、これに限定されない。
なお、図１０（Ａ）及び図１０（Ｂ）では、回路１００（Ｒ）が負荷１０４（Ｒ）を有し
、回路１００（Ｇ）が負荷１０４（Ｇ）を有し、回路１００（Ｂ）が負荷１０４（Ｂ）を
有する場合を一例として示しているが、図１０（Ａ）または図１０（Ｂ）において、負荷
１０４（Ｒ）、負荷１０４（Ｇ）、または負荷１０４（Ｂ）の代わりに、各色相に対応し
た発光素子１０４ａまたは発光素子１０４ｂが用いられていても良い。
また、図１０（Ｂ）では、図８（Ａ）に示した回路１００を、表示装置の画素として用い
た場合を一例として示しているが、図８（Ｂ）乃至図８（Ｄ）に示した回路１００を、表
示装置の画素として用いても良い。
次いで、図１１（Ａ）に示す回路１００は、本発明の一態様に係る半導体装置である。回
路１００は、スイッチ１１、スイッチ１２、スイッチ１３、スイッチ１４、トランジスタ
１０１、容量素子１０２、容量素子１０３を有する。なお、図１１（Ａ）では、トランジ
スタ１０１がｎチャネル型である場合を一例として示している。図１１（Ａ）は、図１（
Ａ）にスイッチ１４を追加した構成に相当する。したがって、図１（Ａ）などで述べた内
容は、図１１（Ａ）などにも適用することが可能である。
具体的に、図１１（Ａ）では、スイッチ１１は、配線２１と、容量素子１０２の一方の電
極または容量素子１０３の一方の電極との間の導通状態を制御する機能を有する。スイッ
チ１２は、配線２２と、容量素子１０２の他方の電極、又は、トランジスタ１０１のゲー
トとの間の導通状態を制御する機能を有する。スイッチ１３が、トランジスタ１０１のソ
ースまたはドレインの一方、又は、容量素子１０３の他方の電極と、容量素子１０２の一
方の電極、又は、容量素子１０３の一方の電極との間の導通状態を制御する機能を有する
。スイッチ１４が、トランジスタ１０１のソースまたはドレインの一方、又は、容量素子
１０３の他方の電極と、配線２５との間の導通状態を制御する機能を有する。トランジス
タ１０１のソースまたはドレインの他方は、配線２３に接続されている。トランジスタ１
０１のソースまたはドレインの一方及び容量素子１０３の他方の電極は、配線２４に接続
されている。
なお、図１１（Ａ）で示した回路１００は、図１１（Ｂ）に示すように負荷１０４を有し
ていても良い。図１１（Ｂ）に示す回路１００では、負荷１０４が、トランジスタ１０１
のソースまたはドレインの一方、又は、容量素子１０３の他方の電極と、配線２４との間
に接続されている。
図１１（Ｃ）に、負荷１０４として、発光素子１０４ａを用いた場合の、回路１００の構
成を示す。図１１（Ｃ）では、発光素子１０４ａのアノードが、トランジスタ１０１のソ
ースまたはドレインの一方及び容量素子１０３の他方の電極に接続されており、発光素子
１０４ａのカソードが、配線２４に接続されている場合を一例として示している。
また、図１１（Ｄ）に、負荷１０４として、発光素子１０４ｂを用いた場合の、回路１０
０の構成を示す。図１１（Ｄ）では、発光素子１０４ｂのカソードが、トランジスタ１０
１のソースまたはドレインの一方、又は、容量素子１０３の他方の電極に接続されており
、発光素子１０４ｂのアノードが、配線２４に接続されている場合を一例として示してい
る。なお、図１１（Ｄ）では、トランジスタ１０１がｐチャネル型である場合を一例とし
て示している。
また、本発明の一態様に係る半導体装置は、図１１（Ａ）乃至図１１（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図１２（Ａ）乃至図１２（Ｄ）に示す半導体装置は、図１１（Ａ）乃至図１１（Ｄ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２２０と
、配線２２に一定電圧や信号を供給する機能を有する回路２２１と、配線２３に一定電圧
や信号を供給する機能を有する回路２２２と、配線２４に一定電圧や信号を供給する機能
を有する回路２２３と、配線２５に一定電圧や信号を供給する機能を有する回路２２４と
を、それぞれ有する。
具体的に、回路２２０は、配線２１に、電位Ｖｓｉｇを供給する機能を有する。回路２２
０の例としては、ソースドライバ（信号線駆動回路）などがある。したがって、配線２１
は、電位Ｖｓｉｇを、伝えることが出来る機能、または、供給することが出来る機能を有
している。または、配線２１は、映像信号線としての機能を有している。
また、回路２２１は、配線２２に、電位Ｖｉ２を供給する機能を有する。回路２２１の例
としては、電源回路などがある。したがって、配線２２は、電位Ｖｉ２を、伝えることが
出来る機能、または、供給することが出来る機能を有している。または、配線２２は、初
期化用配線としての機能を有している。なお、配線２２の電位は、一定の電位であること
が望ましいが、本発明の実施形態の一態様は、これに限定されず、パルス信号のように変
動してもよい。
また、回路２２２は、配線２３に、電源電位（高電源電位または低電源電位）、例えば、
電位ＶＤＤ、または、電位ＶＳＳを供給する機能を有する。回路２２２の例としては、電
源回路などがある。したがって、配線２３は、電源電位を伝えることが出来る機能、また
は、供給することが出来る機能を有している。または、配線２３は、トランジスタ１０１
に電流を供給することが出来る機能を有している。または、配線２３は、負荷１０４に電
流を供給することが出来る機能を有している。または、配線２３は、電源線としての機能
を有している。または、配線２３は、電流供給線としての機能を有している。なお、配線
２３の電位は、一定の電位であることが望ましいが、本発明の実施形態の一態様は、これ
に限定されず、パルス信号のように変動してもよい。例えば、配線２３の電位は、負荷１
０４に、順バイアス電圧だけでなく、逆バイアス電圧を加えるような電位であってもよい
。
また、回路２２３は、配線２４に、電源電位（低電源電位または高電源電位）、例えば、
電位Ｖｃａｔを供給する機能を有する。回路２２３の例としては、電源回路などがある。
したがって、配線２４は、電源電位を伝えることが出来る機能、または、供給することが
出来る機能を有している。または、配線２４は、負荷１０４に電流を供給することが出来
る機能を有している。または、配線２４は、トランジスタ１０１に電流を供給することが
出来る機能を有している。または、配線２４は、共通線としての機能を有している。また
は、配線２４は、陰極配線としての機能を有している。または、配線２４は、陽極配線と
しての機能を有している。なお、配線２４の電位は、一定の電位であることが望ましいが
、本発明の実施形態の一態様は、これに限定されず、パルス信号のように変動してもよい
。例えば、配線２４の電位は、負荷１０４に、順バイアス電圧だけでなく、逆バイアス電
圧を加えるような電位であってもよい。
また、回路２２４は、配線２５に、電位Ｖｉ１を供給する機能を有する。回路２２４の例
としては、電源回路などがある。したがって、配線２５は、電位Ｖｉ１を、伝えることが
出来る機能、または、供給することが出来る機能を有している。または、配線２５は、初
期化用配線としての機能を有している。なお、配線２５の電位は、一定の電位であること
が望ましいが、本発明の実施形態の一態様は、これに限定されず、パルス信号のように変
動してもよい。
なお、図１２（Ａ）乃至図１２（Ｄ）では、半導体装置が、回路１００に加えて、回路２
２０、回路２２１、回路２２２、回路２２３、及び回路２２４を有する場合を一例として
示しているが、本発明の一態様に係る半導体装置は、必ずしも回路２２０、回路２２１、
回路２２２、回路２２３、及び回路２２４を全て有する必要はなく、そのいずれか一つま
たは複数だけを有していても良い。
なお、図１１及び図１２に示した回路１００は、一例として、スイッチ１１、スイッチ１
２、スイッチ１３、スイッチ１４にトランジスタを用いることができる。
図１１（Ａ）乃至図１１（Ｄ）に示した回路１００において、スイッチ１１としてトラン
ジスタ１１ｔ、スイッチ１２としてトランジスタ１２ｔ、スイッチ１３としてトランジス
タ１３ｔ、及びスイッチ１４としてトランジスタ１４ｔを用いた場合の回路１００の構成
を、図１３（Ａ）乃至図１３（Ｄ）に示す。なお、図１３（Ａ）乃至図１３（Ｄ）では、
トランジスタ１１ｔ、トランジスタ１２ｔ、トランジスタ１３ｔ、及びトランジスタ１４
ｔが全てｎチャネル型である場合を一例として示している。トランジスタ１１ｔ、トラン
ジスタ１２ｔ、トランジスタ１３ｔ、及びトランジスタ１４ｔを全て同じ極性のトランジ
スタとすることで、これらのトランジスタを少ない工程数で製造できる。ただし、本発明
の実施形態の一態様は、これに限定されず、異なる極性のトランジスタを用いることも可
能である。
なお、図１３（Ａ）乃至図１３（Ｄ）において、トランジスタ１１ｔは、ゲートが配線３
１に接続されている。配線３１に供給される電位に従って、トランジスタ１１ｔは導通状
態または非導通状態となる。トランジスタ１２ｔは、ゲートが配線３２に接続されている
。配線３２に供給される電位に従って、トランジスタ１２ｔは導通状態または非導通状態
となる。トランジスタ１３ｔは、ゲートが配線３３に接続されている。配線３３に供給さ
れる電位に従って、トランジスタ１３ｔは導通状態または非導通状態となる。トランジス
タ１４ｔは、ゲートが配線３４に接続されている。配線３４に供給される電位に従って、
トランジスタ１４ｔは導通状態または非導通状態となる。したがって、配線３１乃至配線
３４の電位は、パルス状であり、一定ではないことが望ましいが、本発明の実施形態の一
態様は、これに限定されない。または、配線３１乃至配線３４は、ゲート信号線、選択信
号線、または、スキャン線としての機能を有している。
なお、配線３１乃至配線３４において、その中の少なくとも２本の配線は、互いに接続さ
せることが可能である。または、配線３１乃至配線３４の少なくとも１本は、別の回路１
００の配線３１乃至配線３４の少なくとも１本と接続させることが可能である。
また、本発明の一態様に係る半導体装置は、図１３（Ａ）乃至図１３（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図１４（Ａ）乃至図１４（Ｄ）に示す半導体装置は、図１３（Ａ）乃至図１３（Ｄ）に示
す回路１００に加えて、配線３１に一定電圧や信号を供給する機能を有する回路２３０と
、配線３２に一定電圧や信号を供給する機能を有する回路２３１と、配線３３に一定電圧
や信号を供給する機能を有する回路２３２と、配線３４に一定電圧や信号を供給する機能
を有する回路２３３とを、それぞれ有する。回路２３０、回路２３１、回路２３２、回路
２３３の例としては、ゲートドライバ（走査線駆動回路）などがある。
なお、図１４（Ａ）乃至図１４（Ｄ）では、半導体装置が、回路１００に加えて、回路２
３０、回路２３１、回路２３２、及び回路２３３を有する場合を一例として示しているが
、本発明の一態様に係る半導体装置は、必ずしも回路２３０、回路２３１、回路２３２、
及び回路２３３を全て有する必要はなく、そのいずれか一つまたは複数だけを有していて
も良い。
なお、回路２２０、回路２２１、回路２２２、回路２２３、回路２２４、回路２３０、回
路２３１、回路２３２、回路２３３は、一つの同じ回路であってもよいし、別々の回路で
あってもよい。
また、図１３（Ｃ）に示す回路１００において、トランジスタ１０１、及びトランジスタ
１４ｔがｎチャネル型、トランジスタ１１ｔ、トランジスタ１２ｔ、及びトランジスタ１
３ｔがｐチャネル型である場合の回路１００の構成を図３８（Ａ）に示す。また、図１３
（Ｄ）に示す回路１００において、トランジスタ１０１、及びトランジスタ１４ｔがｐチ
ャネル型、トランジスタ１１ｔ、トランジスタ１２ｔ、及びトランジスタ１３ｔがｎチャ
ネル型である場合の回路１００の構成を図３８（Ｂ）に示す。
また、本発明の一態様に係る半導体装置は、図３８（Ａ）及び図３８（Ｂ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図３８（Ｃ）及び図３８（Ｄ）に示す半導体装置は、図３８（Ａ）及び図３８（Ｂ）に示
す回路１００に加えて、配線３１に一定電圧や信号を供給する機能を有する回路２３０と
、配線３２に一定電圧や信号を供給する機能を有する回路２３１と、配線３３に一定電圧
や信号を供給する機能を有する回路２３２と、配線３４に一定電圧や信号を供給する機能
を有する回路２３３とを、それぞれ有する。
なお、図３８（Ｃ）及び図３８（Ｄ）では、半導体装置が、回路１００に加えて、回路２
３０、回路２３１、回路２３２、及び回路２３３を有する場合を一例として示しているが
、本発明の一態様に係る半導体装置は、必ずしも回路２３０、回路２３１、回路２３２、
及び回路２３３を全て有する必要はなく、そのいずれか一つまたは複数だけを有していて
も良い。
なお、トランジスタ１０１は、電流を流すときには、飽和領域で動作する場合が多い。よ
って、図１３、図１４、及び図３８において、トランジスタ１０１のチャネル長またはゲ
ート長を、トランジスタ１１ｔ、トランジスタ１２ｔ、トランジスタ１３ｔ、及び／また
は、トランジスタ１４ｔよりも長くすることが望ましい。好ましくは、５倍以上、より好
ましくは１０倍以上であることが望ましい。一例としては、トランジスタ１０１のチャネ
ル長またはゲート長は、１０μｍ以上、より好ましくは、２０μｍ以上である。チャネル
長またはゲート長を長くすることにより、飽和領域での特性がフラットになり、キンク効
果を低減することができる。或いは、トランジスタ１０１のチャネル幅またはゲート幅を
、トランジスタ１１ｔ、トランジスタ１２ｔ、トランジスタ１３ｔ、及び／または、トラ
ンジスタ１４ｔよりも長くすることにより、トランジスタ１０１は、飽和領域においても
、多くの電流を流すことができる。好ましくは、５倍以上、より好ましくは１０倍以上で
あることが望ましい。トランジスタ１０１のチャネル幅またはゲート幅は、２０μｍ以上
、より好ましくは、３０μｍ以上である。ただし、本発明の実施形態の一態様は、これに
限定されない。
なお、図１３（Ａ）乃至図１３（Ｄ）と、図３８（Ａ）及び図３８（Ｂ）に示す半導体装
置において、トランジスタ１２ｔ及びトランジスタ１３ｔは、共にそのゲートが一の配線
に接続されていても良い。図１５（Ａ）乃至図１５（Ｄ）に、図１３（Ａ）乃至図１３（
Ｄ）に示す半導体装置において、トランジスタ１２ｔ及びトランジスタ１３ｔのゲートが
、配線３２に接続されている場合を一例として示する。配線３２に供給される電位に従っ
て、トランジスタ１２ｔ及びトランジスタ１３ｔは導通状態または非導通状態となる。
また、本発明の一態様に係る半導体装置は、図１５（Ａ）乃至図１５（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図１６（Ａ）乃至図１６（Ｄ）に示す半導体装置は、図１５（Ａ）乃至図１５（Ｄ）に示
す回路１００に加えて、配線３１に一定電圧や信号を供給する機能を有する回路２３０と
、配線３２に一定電圧や信号を供給する機能を有する回路２３１と、配線３４に一定電圧
や信号を供給する機能を有する回路２３３とを、それぞれ有する。
なお、図１６（Ａ）乃至図１６（Ｄ）では、半導体装置が、回路１００に加えて、回路２
３０、回路２３１、及び回路２３３を有する場合を一例として示しているが、本発明の一
態様に係る半導体装置は、必ずしも回路２３０、回路２３１、及び回路２３３を全て有す
る必要はなく、そのいずれか一つまたは複数だけを有していても良い。
また、図１６（Ｃ）に示す回路１００において、トランジスタ１０１、トランジスタ１１
ｔ、及びトランジスタ１４ｔがｎチャネル型、トランジスタ１２ｔ、及びトランジスタ１
３ｔがｐチャネル型である場合の回路１００の構成を図４２（Ａ）に示す。また、図１６
（Ｄ）に示す回路１００において、トランジスタ１０１、トランジスタ１１ｔ、及びトラ
ンジスタ１４ｔがｐチャネル型、トランジスタ１２ｔ、及びトランジスタ１３ｔがｎチャ
ネル型である場合の回路１００の構成を図４２（Ｂ）に示す。
また、本発明の一態様に係る半導体装置は、図４２（Ａ）及び図４２（Ｂ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図４２（Ｃ）及び図４２（Ｄ）に示す半導体装置は、図４２（Ａ）及び図４２（Ｂ）に示
す回路１００に加えて、配線３１に一定電圧や信号を供給する機能を有する回路２３０と
、配線３２に一定電圧や信号を供給する機能を有する回路２３１と、配線３４に一定電圧
や信号を供給する機能を有する回路２３３とを、それぞれ有する。回路２３０、回路２３
１、回路２３３の例としては、ゲートドライバ（走査線駆動回路）などがある。
なお、図４２（Ｃ）及び図４２（Ｄ）では、半導体装置が、回路１００に加えて、回路２
３０、回路２３１、及び回路２３３を有する場合を一例として示しているが、本発明の一
態様に係る半導体装置は、必ずしも回路２３０、回路２３１、及び回路２３３を全て有す
る必要はなく、そのいずれか一つまたは複数だけを有していても良い。
また、図１３（Ａ）乃至図１３（Ｄ）に示す半導体装置において、隣接する回路１００間
で、あるトランジスタのゲートと別のトランジスタのゲートが接続されていてもよい。例
えば、トランジスタ１１ｔとトランジスタ１４ｔのゲートが接続されていても良い。図３
９に、ｉ列ｊ行目の回路１００（ｉ、ｊ）が有するトランジスタ１１ｔのゲートと、ｉ列
ｊ＋１行目の回路１００（ｉ、ｊ＋１）が有するトランジスタ１４ｔのゲートとが、ｊ行
目の配線３１（ｊ）に接続されている場合を一例として示している。
また、図１５（Ａ）乃至図１５（Ｄ）に示す半導体装置において、隣接する回路１００間
で、あるトランジスタのゲートと別のトランジスタのゲートが接続されていてもよい。例
えば、トランジスタ１１ｔとトランジスタ１４ｔのゲートが接続されていても良い。図４
０に、ｉ列ｊ行目の回路１００（ｉ、ｊ）が有するトランジスタ１１ｔのゲートと、ｉ列
ｊ＋１行目の回路１００（ｉ、ｊ＋１）が有するトランジスタ１４ｔのゲートとが、ｊ行
目の配線３１（ｊ）に接続されている場合を一例として示している。
なお、図３９及び図４０では、ｊ行目の回路１００が有するトランジスタ１１ｔのゲート
と、ｊ＋１行目の回路１００が有するトランジスタ１４ｔのゲートとが、ｊ行目の配線３
１（ｊ）に接続されている場合を一例として示している。しかし、本発明の一態様はこの
構成に限定されず、例えば、図１４（Ａ）乃至図１４（Ｄ）、図３８（Ｃ）及び図３８（
Ｄ）に示す半導体装置において、回路２３０が、ｊ行目の配線３１（ｊ）と、ｊ＋１行目
の配線３４（ｊ＋１）とに、電位の供給を行うようにしても良い。
図４１に、回路２３０から、配線３１及び配線３４に電位の供給を行っている様子を示す
。具体的に、図４１では、回路２３０が有するｊ番目の出力端子ｏｕｔ（ｊ）から出力さ
れる電位が、ｊ行目の配線３１（ｊ）と、ｊ＋１行目の配線３４（ｊ＋１）とに与えられ
る。つまり、これは、例えば、走査線駆動回路と、画素領域との間で、異なる行の配線を
接続させることに相当する。
次いで図１１（Ｃ）に示す回路１００を例に挙げて、本発明の半導体装置の一態様の動作
について説明する。
図１１（Ｃ）に示す回路１００の動作は、主に第１の動作、第２の動作、第３の動作、第
４の動作に分けることができる。ただし、本発明の実施形態の一態様は、これに限定され
ず、新たな動作の追加、或いは、一部の動作の削除も可能である。
なお、図１１（Ｃ）では、図１（Ｃ）の回路に対して、スイッチ１４が追加されているた
め、図６（Ａ）に示す第３の動作（期間Ｔ１３）を削除することが可能である。
図１１（Ｃ）に示す回路１００における、スイッチ１１、スイッチ１２、スイッチ１３、
及びスイッチ１４の動作と、配線２１の電位と、トランジスタ１０１のゲートソース間電
圧（Ｖｇｓ１０１）とを示すタイミングチャートの一例を、図１７（Ａ）に図示する。
まず、期間Ｔ１１において行われる第１の動作について説明する。期間Ｔ１１では、図１
７（Ａ）に示すように、スイッチ１１が非導通状態、スイッチ１２、スイッチ１３、及び
スイッチ１４が導通状態である。よって、期間Ｔ１１では、図１７（Ｂ）に示すように、
容量素子１０２に電圧Ｖｉ２−Ｖｉ１が供給され、発光素子１０４ａのアノードは電位Ｖ
ｉ１となり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は、電圧Ｖｉ２
−Ｖｉ１となる。つまり、トランジスタ１０１、及び、容量素子１０２を、初期化してい
ることとなる。
なお、スイッチ１１は、配線２１の電位が悪影響を及ぼさない場合には、導通状態であっ
てもよい。その場合、スイッチ１４は、非導通状態でもよい。
なお、スイッチ１３は、非導通状態であってもよい。
期間Ｔ１２において行われる第２の動作について説明する。期間Ｔ１２では、図１７（Ａ
）に示すように、スイッチ１１及びスイッチ１４が非導通状態、スイッチ１２及びスイッ
チ１３が導通状態である。スイッチ１１及びスイッチ１４が非導通状態となることで、容
量素子１０２に蓄積されている電荷がトランジスタ１０１を介して放出され、トランジス
タ１０１のソースの電位が上昇する。そして、トランジスタ１０１がオフ状態となると、
容量素子１０２からの電荷の放出が止まる。最終的には、トランジスタ１０１の閾値電圧
Ｖｔｈが容量素子１０２に保持される。よって、期間Ｔ１２では、図１７（Ｃ）に示すよ
うに、容量素子１０２に閾値電圧Ｖｔｈが保持され、発光素子１０４ａのアノードは電位
Ｖｉ２−Ｖｔｈとなり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は、
閾値電圧Ｖｔｈとなる。つまり、トランジスタ１０１のしきい値電圧Ｖｔｈを取得するこ
とができる。
なお、Ｖｇｓ１０１が、トランジスタ１０１のしきい値電圧Ｖｔｈに等しくなるまでには
、非常に長い時間が必要となる場合がある。したがって、Ｖｇｓ１０１は、しきい値電圧
Ｖｔｈまで完全に低下させずに、動作させる場合も多い。つまり、Ｖｇｓ１０１は、しき
い値電圧Ｖｔｈよりも、わずかに大きい値となった状態で、期間Ｔ１２が終了する場合も
多い。つまり、期間Ｔ１２が終了した時点では、Ｖｇｓ１０１は、しきい値電圧に応じた
大きさの電圧になっている、ということも出来る。
なお、第２の動作において、トランジスタ１０１のしきい値電圧Ｖｔｈが正か負かという
ことに関係なく、動作させることができる。これは、トランジスタ１０１がオフ状態とな
るまで、トランジスタ１０１のソース電位が上昇できるからである。つまり、トランジス
タ１０１のゲート電位よりも、トランジスタ１０１のソース電位の方が高くなった状態で
、ようやくトランジスタ１０１がオフし、Ｖｇｓ１０１がＶｔｈとなる、ということが可
能であるからである。したがって、トランジスタ１０１がエンハンスメント型（ノーマリ
オフ型）であっても、デプリーション型（ノーマリオン型）であっても、正常に動作させ
ることができる。
なお、発光素子１０４ａのアノードの電位が高くなったときに、発光素子１０４ａに電流
が流れないようにすることが望ましい。そのためには、発光素子１０４ａに電流が流れな
いように、電位Ｖｉ２を低い値とすることが好適である。ただし、本発明の実施形態の一
態様は、これに限定されない。なお、発光素子１０４ａと直列にスイッチを設けて、それ
をオフ状態にすることにより、発光素子１０４ａに電流が流れないようにすることが可能
であれば、電位Ｖｉ２は、高い値でもよい。
期間Ｔ１３において行われる第３の動作について説明する。期間Ｔ１３では、図１７（Ａ
）に示すように、スイッチ１１及びスイッチ１４が導通状態、スイッチ１２及びスイッチ
１３が非導通状態である。また、配線２１には電位Ｖｓｉｇが供給される。よって、期間
Ｔ１３では、図１８（Ａ）に示すように、容量素子１０２に閾値電圧Ｖｔｈ（またはＶｔ
ｈに応じた大きさの電圧である）が保持され、容量素子１０３に電圧Ｖｓｉｇ−Ｖｉ１が
保持され、発光素子１０４ａのアノードは電位Ｖｉ１となり、トランジスタ１０１のゲー
トの電位は電位Ｖｓｉｇ＋Ｖｔｈとなり、トランジスタ１０１のゲートソース間電圧（Ｖ
ｇｓ１０１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１となる。したがって、電位Ｖｓｉｇを容量
素子１０３に入力することが出来る。または、容量素子１０２の電圧と容量素子１０３の
電圧との和が、トランジスタ１０１のゲートソース間電圧となるようにすることが出来る
。
なお、このとき、スイッチ１４を非導通状態とすることも可能である。
期間Ｔ１４において行われる第４の動作について説明する。期間Ｔ１４では、図１７（Ａ
）に示すように、スイッチ１１、スイッチ１２、スイッチ１３、及びスイッチ１４が非導
通状態である。よって、期間Ｔ１４では、図１８（Ｂ）に示すように、容量素子１０２に
閾値電圧Ｖｔｈが保持され、容量素子１０３に電圧Ｖｓｉｇ−Ｖｉ１が保持され、発光素
子１０４ａのアノードは電位Ｖｅｌとなり、トランジスタ１０１のゲートの電位は電位Ｖ
ｓｉｇ＋Ｖｔｈ＋Ｖｅｌとなり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０
１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１となる。したがって、電位Ｖｓｉｇに応じた大きさ
の電流を発光素子１０４ａに流すことができ、電位Ｖｓｉｇに応じた輝度で発光素子１０
４ａを発光させることができる。
上記第４の動作では、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）を、Ｖ
ｓｉｇ＋Ｖｔｈ−Ｖｉ１とし、トランジスタ１０１の閾値電圧Ｖｔｈを加味した値に設定
することができる。従って、上記構成により、トランジスタ１０１の閾値電圧Ｖｔｈのば
らつきが、発光素子１０４ａに供給する電流値に影響を及ぼすのを防ぐことができる。ま
たは、トランジスタ１０１が劣化して、閾値電圧Ｖｔｈが変化しても、上記変化が発光素
子１０４ａに供給する電流値に影響を及ぼすのを防ぐことができる。よって、表示ムラを
低減でき、質の良い表示を行うことができる。
同様に、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）を、電圧Ｖｓｉｇ＋
Ｖｔｈ−Ｖｉ１とし、Ｖｅｌとは無関係な値に設定することができる。上記構成により、
発光素子１０４ａの電圧電流特性のばらつきが、発光素子１０４ａに供給する電流値に影
響を及ぼすのを防ぐことができる。または、発光素子１０４ａが劣化して、発光素子１０
４ａの電圧電流特性が変化して、Ｖｅｌが変化しても、上記変化が発光素子１０４ａに供
給する電流値に影響を及ぼすのを防ぐことができる。よって、表示ムラを低減でき、質の
良い表示を行うことができる。
なお、第４の動作の一部の期間において、強制的にトランジスタ１０１がオフ状態になる
ことや、発光素子１０４ａに電流が流れないようにして、発光素子１０４ａが発光しない
ような状況にすることも可能である。つまり、非発光期間を設けることも可能である。例
えば、スイッチ１２をオンにすることにより、トランジスタ１０１をオフ状態にすること
が可能である。または、スイッチ１４をオンにすることにより、発光素子１０４ａに電流
が流れないようにすることが可能である。
なお、本発明の一態様に係る半導体装置では、第２の動作において、トランジスタ１０１
のゲートを電位Ｖｉ２に保つ。上記動作により、トランジスタ１０１がノーマリオンであ
っても、すなわち閾値電圧Ｖｔｈがマイナスの値を有していても、トランジスタ１０１に
おいて、ソースの電位がゲートの電位Ｖｉ２よりも高くなるまで容量素子１０２に蓄積さ
れている電荷を放出することができる。よって、本発明の一態様に係る半導体装置では、
トランジスタ１０１がノーマリオンであっても、上記第４の動作において、トランジスタ
１０１の閾値電圧Ｖｔｈを加味した値になるよう、トランジスタ１０１のゲートソース間
電圧（Ｖｇｓ１０１）を設定することができる。
なお、容量素子１０３の容量値は、負荷１０４（発光素子１０４ａ）の寄生容量の容量値
よりも、小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／５倍以下
が好適である。または、容量素子１０３の電極の面積は、負荷１０４（発光素子１０４ａ
）の電極の面積よりも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは
１／５倍以下が好適である。ただし、本発明の実施形態の一態様は、これらに限定されな
い。
なお、容量素子１０２の容量値は、トランジスタ１０１のゲートの寄生容量の容量値より
も、大きいことが望ましく、望ましくは２倍以上、より望ましくは５倍以上が好適である
。または、容量素子１０２の電極の面積は、トランジスタ１０１のチャネルの面積よりも
大きいことが望ましく、望ましくは２倍以上、より望ましくは５倍以上が好適である。ま
たは、容量素子１０２の電極の面積は、トランジスタ１０１のゲート電極の面積よりも大
きいことが望ましく、望ましくは２倍以上、より望ましくは５倍以上が好適である。それ
らにより、電位Ｖｓｉｇが入力されて、容量素子１０２とトランジスタのゲート容量とで
、電圧が容量分割されたときに、容量素子１０２の電圧の減少を低減することが出来る。
ただし、本発明の実施形態の一態様は、これに限定されない。
なお、容量素子１０２の容量値は、容量素子１０３の容量値と、同じ程度の大きさである
か、それよりも、大きいことが望ましい。容量素子１０２の容量値は、容量素子１０３の
容量値と、±２０％以下の違い、より好ましくは±１０％以下の違いであることが好適で
ある。または、容量素子１０２の電極の面積は、容量素子１０３の電極の面積と、同じ程
度の大きさであるか、それよりも、大きいことが望ましい。これらにより、同じレイアウ
ト面積のなかで、最適な動作を行うことが出来る。ただし、本発明の実施形態の一態様は
、これに限定されない。
なお、期間Ｔ１１乃至期間Ｔ１４における、回路１００の概略図を、図１９（Ａ）乃至図
１９（Ｄ）に、それぞれ示す。本発明の一態様に係る半導体装置は、回路１００が、上記
各期間において図１９（Ａ）乃至図１９（Ｄ）に示す構造を取ることができれば良い。よ
って、本発明の一態様に係る半導体装置は、図１１乃至図１６に示した構成を有する回路
１００に限定されるものではない。本発明の一態様に係る半導体装置は、回路１００にお
いて、図１９（Ａ）乃至図１９（Ｄ）に示す構造を取りうるように、スイッチの配置や数
、各種電位の供給を行う配線の数などを、適宜変更することが可能である。
なお、上記第３の動作が行われる期間Ｔ１３の後、上記第４の動作が行われる期間Ｔ１４
の前に、第６の動作が行われる期間Ｔ１６を設けても良い。
図１１（Ｃ）に示す回路１００において、期間Ｔ１６を設けた場合の、スイッチ１１、ス
イッチ１２、スイッチ１３、及びスイッチ１４の動作と、配線２１の電位と、トランジス
タ１０１のゲートソース間電圧（Ｖｇｓ１０１）とを示すタイミングチャートの一例を、
図２０（Ａ）に図示する。
図２０（Ａ）に示すタイミングチャートは、期間Ｔ１３と期間Ｔ１４の間に、期間Ｔ１６
が設けられている点において、図１７（Ａ）に示したタイミングチャートと異なる。
期間Ｔ１６において行われる第６の動作について説明する。期間Ｔ１６では、図２０（Ａ
）に示すように、スイッチ１２が導通状態、スイッチ１１、スイッチ１３、及びスイッチ
１４が非導通状態である。よって、期間Ｔ１６では、図２０（Ｂ）に示すように、トラン
ジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は、電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１
−Ｖαとなる。
第６の動作で、電位Ｖαは、発光素子１０４ａのアノードが電気的に浮遊状態（フローテ
ィング状態）となることで変動する電位である。電位Ｖαは、トランジスタ１０１がオフ
であるならば、発光素子１０４ａの容量値と、容量素子１０２及び容量素子１０３の容量
値の比に応じて、その値が定まる。しかし、電位Ｖｓｉｇの高さによっては、トランジス
タ１０１がオンするので、トランジスタ１０１を介して発光素子１０４ａのアノードに電
荷が流入してしまう。よって、電位Ｖαは、上記静電容量の比によってのみ決まらず、発
光素子１０４ａのアノードに流入する電荷によっても、その値が変化する。
上記電荷量Ｑによって移動度のばらつきを抑える効果が期待できる。以下、この理由につ
いて説明する。
電荷量Ｑは、期間Ｔ１６において、トランジスタ１０１のドレインからソースに流れ込む
電荷量に相当する。よって、電荷量Ｑは、トランジスタ１０１の移動度が大きいほど、大
きくなる。そして、電荷量Ｑが大きくなると、発光素子１０４ａの発光時における、トラ
ンジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）が、小さくなる。すなわち、電荷
量Ｑにより、トランジスタ１０１の移動度が大きいほど、発光素子１０４ａに供給される
電流値が小さくなるように補正がかかり、また、トランジスタ１０１の移動度が小さいほ
ど、発光素子１０４ａに供給される電流値があまり小さくならないように補正がかかる。
したがって、電荷量Ｑにより、移動度のばらつきを抑えることができる。
期間Ｔ１６の後、期間Ｔ１４では、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１
０１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１−Ｖαとなる。よって、トランジスタ１０１の閾
値電圧Ｖｔｈと移動度を加味した値に、ゲートソース間電圧を設定することができる。
また、本発明の一態様に係る半導体装置は、図８と同様に、図１１（Ｂ）に示した回路１
００において、負荷１０４と接続された容量素子１０５を、さらに有していても良い。同
様に、本発明の一態様に係る半導体装置は、図１１（Ｃ）に示した回路１００において、
発光素子１０４ａと接続された容量素子１０５を、さらに有していても良い。同様に、本
発明の一態様に係る半導体装置は、図１１（Ｄ）に示した回路１００において、発光素子
１０４ｂと接続された容量素子１０５を、さらに有していても良い。
図２１（Ａ）に示す半導体装置は、図１１（Ｂ）に示した回路１００において、負荷１０
４と接続された容量素子１０５を、さらに有している。具体的には、容量素子１０５の一
方の電極が、容量素子１０３の他方の電極、及びトランジスタ１０１のソースまたはドレ
インの一方に、接続されている。容量素子１０５の他方の電極は、配線２６に接続されて
いる。なお、図２１（Ａ）では、回路１００が負荷１０４を有する場合を一例として示し
ているが、図２１（Ａ）において、負荷１０４の代わりに発光素子１０４ａまたは発光素
子１０４ｂが用いられていても良い。
なお、配線２６は、様々な配線と接続させることが可能である。例えば、配線２２、配線
２３、配線２４、配線２５、または、別の回路１００の配線、走査線、ゲート線、トラン
ジスタのゲートと接続された配線などに接続させることが出来る。これにより、配線の数
を減らすことが出来る。
図２１（Ｂ）に示す半導体装置は、図２１（Ａ）に示した回路１００において、配線２６
を配線２４に接続させた場合の例を示す。なお、図２１（Ｂ）では、回路１００が負荷１
０４を有する場合を一例として示しているが、図２１（Ｂ）において、負荷１０４の代わ
りに発光素子１０４ａまたは発光素子１０４ｂが用いられていても良い。このように接続
することにより、配線２６を減らすことが出来る。
図２１（Ｃ）に示す半導体装置は、図２１（Ａ）に示した回路１００において、配線２６
を配線２３に接続させた場合の例を示す。なお、図２１（Ｃ）では、回路１００が負荷１
０４を有する場合を一例として示しているが、図２１（Ｃ）において、負荷１０４の代わ
りに発光素子１０４ａまたは発光素子１０４ｂが用いられていても良い。このように接続
することにより、配線２６を減らすことが出来る。
図２１（Ｄ）に示す半導体装置は、図２１（Ａ）に示した回路１００において、配線２６
を配線２２に接続させた場合の例を示す。なお、図２１（Ｄ）では、回路１００が負荷１
０４を有する場合を一例として示しているが、図２１（Ｄ）において、負荷１０４の代わ
りに発光素子１０４ａまたは発光素子１０４ｂが用いられていても良い。このように接続
することにより、配線２６を減らすことが出来る。
図２１（Ｅ）に示す半導体装置は、図２１（Ａ）に示した回路１００において、配線２６
を配線２５に接続させた場合の例を示す。なお、図２１（Ｅ）では、回路１００が負荷１
０４を有する場合を一例として示しているが、図２１（Ｅ）において、負荷１０４の代わ
りに発光素子１０４ａまたは発光素子１０４ｂが用いられていても良い。このように接続
することにより、配線２６を減らすことが出来る。
負荷１０４、発光素子１０４ａまたは発光素子１０４ｂに、並列に接続された容量素子１
０５を、回路１００に追加することで、上記実施の形態で説明した第６の動作及び第４の
動作において、トランジスタ１０１のソースまたはドレインの一方における電荷の変動を
抑えることができるため、電圧Ｖαを小さくすることができる。よって、ゲートソース間
電圧Ｖｇｓを理想的な値、すなわち電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１に近づけることができ
、負荷１０４、発光素子１０４ａまたは発光素子１０４ｂに供給する電流を、電圧Ｖｓｉ
ｇを正確に反映した値により近づけることができる。
または、容量素子１０５の容量値を適宜調整することにより、期間Ｔ１６における電荷量
Ｑによる電位の変化量を調整することができる。これにより、移動度のばらつきの低減を
、より適切に行うことが出来る。
なお、容量素子１０５の電極の面積は、負荷１０４（発光素子１０４ａ）の電極の面積よ
りも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／３倍以下が好
適である。または、容量素子１０５の容量値は、負荷１０４（発光素子１０４ａ）の容量
値よりも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／３倍以下
が好適である。それらにより、同じレイアウト面積のなかで、最適な動作を行うことが出
来る。ただし、本発明の実施形態の一態様は、これに限定されない。
なお、容量素子１０５の電極の面積と、負荷１０４（発光素子１０４ａ）の電極の面積の
合計は、容量素子１０３の電極の面積よりも大きいことが望ましく、望ましくは２倍以上
、より望ましくは５倍以上が好適である。または、容量素子１０５の容量値と、負荷１０
４（発光素子１０４ａ）の容量値の合計は、容量素子１０３の容量値よりも大きいことが
望ましく、望ましくは２倍以上、より望ましくは５倍以上が好適である。それらにより、
容量素子１０３と、容量素子１０５及び負荷１０４（発光素子１０４ａ）とで、電圧が容
量分割されたときに、容量素子１０３により多くの電圧が加わるようにすることが出来る
。ただし、本発明の実施形態の一態様は、これに限定されない。
なお、容量素子１０５の電極の面積は、容量素子１０２または容量素子１０３の電極の面
積よりも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／３倍以下
が好適である。または、容量素子１０５の容量値は、容量素子１０２または容量素子１０
３の容量値よりも小さいことが望ましく、望ましくは１／２倍以下、より望ましくは１／
３倍以下が好適である。それらにより、同じレイアウト面積のなかで、最適な動作を行う
ことが出来る。ただし、本発明の実施形態の一態様は、これに限定されない。
なお、配線２５は、様々な配線と接続させることが可能である。例えば、配線２２、配線
２４、配線２６、または、別の回路１００の配線、走査線、ゲート線、トランジスタのゲ
ートと接続された配線などに接続させることが出来る。これにより、配線の数を減らすこ
とが出来る。
また、本発明の一態様に係る半導体装置は、図２１（Ａ）乃至図２１（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図２２（Ａ）乃至図２２（Ｄ）に示す半導体装置は、図２１（Ａ）乃至図２１（Ｄ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２２０と
、配線２２に一定電圧や信号を供給する機能を有する回路２２１と、配線２３に一定電圧
や信号を供給する機能を有する回路２２２と、配線２４に一定電圧や信号を供給する機能
を有する回路２２３と、配線２５に一定電圧や信号を供給する機能を有する回路２２４と
を、それぞれ有する。さらに、図２２（Ａ）に示す回路１００は、配線２６に一定電圧や
信号を供給する機能を有する回路２２５を有する。
また、図１１（Ｂ）乃至図１１（Ｄ）、図２１（Ｂ）乃至図２１（Ｄ）のいずれかの回路
１００を、表示装置の画素として用いても良い。そして、複数の色相にそれぞれ対応した
画素が表示装置に設けられている場合、対応する色相によって、画素が有するトランジス
タ１０１の、チャネル幅とチャネル長の比が、異なっていても良い。同様に、画素が有す
る容量素子１０５の容量値も、対応する色相によって、異なっていても良い。
図２３（Ａ）に、図１１（Ｂ）に示した回路１００を、表示装置の画素として用いた場合
を一例として示している。図２３（Ａ）では、回路１００（Ｒ）が赤（Ｒ）に対応した画
素に相当し、回路１００（Ｇ）が緑（Ｇ）に対応した画素に相当し、回路１００（Ｂ）が
青（Ｂ）に対応した画素に相当する。本発明の一態様では、回路１００（Ｒ）が有するト
ランジスタ１０１（Ｒ）と、回路１００（Ｇ）が有するトランジスタ１０１（Ｇ）と、回
路１００（Ｂ）が有するトランジスタ１０１（Ｂ）との少なくとも一つにおいて、そのチ
ャネル幅とチャネル長の比が他と異なっていても良い。上記構成により、回路１００（Ｒ
）が有する負荷１０４（Ｒ）、回路１００（Ｇ）が有する負荷１０４（Ｇ）、回路１００
（Ｂ）が有する負荷１０４（Ｂ）のそれぞれに供給される電流を異なる値に設定すること
ができる。
また、図２３（Ｂ）に、図２１（Ａ）に示した回路１００を、表示装置の画素として用い
た場合を一例として示している。図２３（Ｂ）の場合も図２３（Ａ）と同様に、回路１０
０（Ｒ）が有するトランジスタ１０１（Ｒ）と、回路１００（Ｇ）が有するトランジスタ
１０１（Ｇ）と、回路１００（Ｂ）が有するトランジスタ１０１（Ｂ）との少なくとも一
つが、そのチャネル幅とチャネル長の比が他と異なっていても良い。上記構成により、回
路１００（Ｒ）が有する負荷１０４（Ｒ）、回路１００（Ｇ）が有する負荷１０４（Ｇ）
、回路１００（Ｂ）が有する負荷１０４（Ｂ）のそれぞれに供給される電流を異なる値に
設定することができる。
また、図２３（Ｂ）の場合、回路１００（Ｒ）が有する容量素子１０５（Ｒ）と、回路１
００（Ｇ）が有する容量素子１０５（Ｇ）と、回路１００（Ｂ）が有する容量素子１０５
（Ｂ）との少なくとも一つにおいて、その容量値が他と異なっていても良い。
なお、図２３（Ａ）及び図２３（Ｂ）では、回路１００（Ｒ）が負荷１０４（Ｒ）を有し
、回路１００（Ｇ）が負荷１０４（Ｇ）を有し、回路１００（Ｂ）が負荷１０４（Ｂ）を
有する場合を一例として示しているが、図２３（Ａ）または図２３（Ｂ）において、負荷
１０４（Ｒ）、負荷１０４（Ｇ）、または負荷１０４（Ｂ）の代わりに、各色相に対応し
た発光素子１０４ａまたは発光素子１０４ｂが用いられていても良い。
また、図２３（Ｂ）では、図２１（Ａ）に示した回路１００を、表示装置の画素として用
いた場合を一例として示しているが、図２１（Ｂ）乃至図２１（Ｅ）に示した回路１００
を、表示装置の画素として用いても良い。
なお、本実施の形態において、トランジスタ１０１のしきい値電圧などのばらつきを補正
するような動作を行ったが、本発明の実施形態の一態様は、これに限定されない。例えば
、しきい値電圧のばらつきを補正するような動作を行わずに、負荷１０４に電流を供給さ
せて動作させることも可能である。
本実施の形態は、基本原理の一例について述べたものである。したがって、本実施の形態
の一部または全部について、他の実施の形態の一部また全部と、自由に組み合わせたり、
適用することや、置き換えて実施することができる。
（実施の形態２）
本実施の形態では、本発明の一態様に係る半導体装置である、回路１００の構成例につい
て説明する。本実施の形態では、実施の形態１で示した回路に対して、スイッチを追加し
た構成や、駆動方法の一部を変更した場合などについて述べる。したがって、実施の形態
１で述べた内容は、本実施の形態にも適用することが可能である。
図２４（Ａ）乃至図２４（Ｄ）に、回路１００の構成例をそれぞれ示す。図２４（Ａ）乃
至図２４（Ｄ）に示す回路１００は、図１（Ａ）乃至図１（Ｄ）に示した回路１００にス
イッチ９１４を追加した構成に、それぞれ相当する。そして、上記スイッチ９１４は、ト
ランジスタ１０１のソースまたはドレインの他方と、配線２３との間の導通状態を制御す
る機能を有する。または、配線２３から配線２４までの間の導通状態を制御する機能を有
する。または、スイッチ９１４は、容量素子１０３に電流が流れることを防ぐ機能を有す
る。または、スイッチ９１４は、容量素子１０２に電流が流れることを防ぐ機能を有する
。または、スイッチ９１４は、負荷１０４に電流が流れることを防ぐ機能を有する。
また、本発明の一態様に係る半導体装置は、図２４（Ａ）乃至図２４（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図２５（Ａ）乃至図２５（Ｄ）に示す半導体装置は、図２４（Ａ）乃至図２４（Ｄ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２０１と
、配線２２に一定電圧や信号を供給する機能を有する回路２０２と、配線２３に一定電圧
や信号を供給する機能を有する回路２０３と、配線２４に一定電圧や信号を供給する機能
を有する回路２０４とを、それぞれ有する。
なお、図２４及び図２５に示す回路１００は、スイッチ１１、スイッチ１２、スイッチ１
３、スイッチ９１４に、トランジスタを用いることができる。
なお、一例として図８６に示すように、スイッチ９１４がトランジスタ９１４ｔである場
合、そのトランジスタ９１４ｔのゲートは、配線９３２と接続されており、その配線９３
２は、一定電圧や信号を供給する機能を有する回路９２０６と接続されていることが可能
である。その回路９２０６の例としては、ゲートドライバ（走査線駆動回路）などがある
。
なお、配線３１乃至配線３３、配線９３２において、その中の少なくとも２本の配線は、
互いに接続させることが可能である。または、配線３１乃至配線３３、配線９３２の少な
くとも１本は、別の回路１００の配線３１乃至配線３３、配線９３２の少なくとも１本と
接続させることが可能である。
図２４及び図２５に示す回路１００は、図１及び図２に示す回路１００と同様の動作を行
うことができる。ただし、一例としては、図２４及び図２５に示す回路１００では、図５
、図６に示す期間Ｔ１１乃至期間Ｔ１３、及び期間Ｔ１５において、スイッチ９１４は導
通状態であり、期間Ｔ１４においてスイッチ９１４は非導通状態であることが好適である
。これらにより、期間Ｔ１４において、トランジスタ１０１を介して、発光素子１０４ａ
などに、電荷が漏れることを防ぐことが出来る。ただし、本発明の実施形態の一態様は、
これに限定されない。
または、期間Ｔ１３において、スイッチ９１４を非導通状態とすることも可能である。こ
れにより、トランジスタ１０１に電流が流れないので、トランジスタ１０１のゲートやソ
ースなどの、回路１００内の各ノードにおける電位の制御がしやすくなる。
または、期間Ｔ１１において、スイッチ９１４を非導通状態とすることも可能である。こ
れにより、トランジスタ１０１に電流が流れないので、トランジスタ１０１のゲートやソ
ースなどの、回路１００内の各ノードにおける電位の制御がしやすくなる。
または、期間Ｔ１５の一部の期間においても、スイッチ９１４を非導通状態とする。これ
により、発光素子１０４ａなどに電流が流れないようにして、非発光期間を設けることが
出来る。
なお、図２４（Ｂ）及び図２５（Ｂ）に示す回路１００は、図８、図９、図１０（Ｂ）と
同様に、負荷１０４と接続された容量素子１０５を、さらに有していても良い。同様に、
図２４（Ｃ）及び図２５（Ｃ）に示す回路１００は、発光素子１０４ａと接続された容量
素子１０５を、さらに有していても良い。同様に、図２４（Ｄ）及び図２５（Ｄ）に示す
回路１００は、発光素子１０４ｂと接続された容量素子１０５を、さらに有していても良
い。具体的に、容量素子１０５の一方の電極は、容量素子１０３の他方の電極、及びトラ
ンジスタ１０１のソースまたはドレインの一方に、接続される。容量素子１０５の他方の
電極は、別途設けられた配線２６、配線２４、配線２３、或いは配線２２に接続される。
また、図２４（Ｂ）乃至図２４（Ｄ）に示す回路１００、及び、図２５（Ｂ）乃至図２５
（Ｄ）に示す回路１００に上記容量素子１０５を追加した回路の、いずれかを、表示装置
の画素として用いても良い。そして、複数の色相にそれぞれ対応した画素が表示装置に設
けられている場合、対応する色相によって、画素が有するトランジスタ１０１の、チャネ
ル幅とチャネル長の比が、異なっていても良い。
なお、図２４及び図２５とは別の場所に、スイッチ９１４を設けることも可能である。具
体的には、一例としては、配線２３から配線２４までの間の導通状態を制御することが可
能である場所に設けることが出来る。例えば、図２６（Ａ）乃至図２６（Ｄ）に、回路１
００の構成例をそれぞれ示す。図２６（Ａ）乃至図２６（Ｄ）に示す回路１００は、図１
（Ａ）乃至図１（Ｄ）に示した回路１００にスイッチ９１４を追加した構成に、それぞれ
相当する。そして、上記スイッチ９１４は、トランジスタ１０１のソースまたはドレイン
の一方と、容量素子１０３の他方の電極との間の導通状態を制御する機能を有する。さら
に、スイッチ１３が導通状態であるならば、上記スイッチ９１４は、トランジスタ１０１
のソースまたはドレインの一方と、容量素子１０２の一方の電極及び容量素子１０３の一
方の電極との間の導通状態を制御する機能を有する。
また、本発明の一態様に係る半導体装置は、図２６（Ａ）乃至図２６（Ｄ）に示した回路
１００に加えて、回路１００に各種一定電圧や信号を供給する機能を有する回路を、さら
に有していても良い。
図２７（Ａ）乃至図２７（Ｄ）に示す半導体装置は、図２６（Ａ）乃至図２６（Ｄ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２０１と
、配線２２に一定電圧や信号を供給する機能を有する回路２０２と、配線２３に一定電圧
や信号を供給する機能を有する回路２０３と、配線２４に一定電圧や信号を供給する機能
を有する回路２０４とを、それぞれ有する。
なお、図２６及び図２７に示す回路１００は、スイッチ１１、スイッチ１２、スイッチ１
３、スイッチ９１４に、トランジスタを用いることができる。
図２６及び図２７に示す回路１００は、図１、図２、図２４、または、図２５に示す回路
１００と同様の動作を行うことができる。
なお、図２６（Ｂ）及び図２７（Ｂ）に示す回路１００は、図８、図９、図１０（Ｂ）と
同様に、負荷１０４と接続された容量素子１０５を、さらに有していても良い。同様に、
図２６（Ｃ）及び図２７（Ｃ）に示す回路１００は、発光素子１０４ａと接続された容量
素子１０５を、さらに有していても良い。同様に、図２６（Ｄ）及び図２７（Ｄ）に示す
回路１００は、発光素子１０４ｂと接続された容量素子１０５を、さらに有していても良
い。具体的に、容量素子１０５の一方の電極は、容量素子１０３の他方の電極に接続され
る。なおかつ、スイッチ９１４は、容量素子１０５の一方の電極と、トランジスタ１０１
のソースまたはドレインの一方との間の導通状態を制御する。容量素子１０５の他方の電
極は、別途設けられた配線２６、配線２４、配線２３、或いは配線２２に接続される。
また、図２６（Ｂ）乃至図２６（Ｄ）に示す回路１００、及び、図２７（Ｂ）乃至図２７
（Ｄ）に示す回路１００に上記容量素子１０５を追加した回路の、いずれかを、表示装置
の画素として用いても良い。そして、複数の色相にそれぞれ対応した画素が表示装置に設
けられている場合、対応する色相によって、画素が有するトランジスタ１０１の、チャネ
ル幅とチャネル長の比が、異なっていても良い。
なお、図２４、図２５、図２６、図２７とは別の場所に、スイッチ９１４を設けることも
可能である。例えば、図２８（Ａ）乃至図２８（Ｄ）に、回路１００の構成例をそれぞれ
示す。図２８（Ａ）乃至図２８（Ｄ）に示す回路１００は、図１（Ａ）乃至図１（Ｄ）に
示した回路１００にスイッチ９１４を追加した構成に、それぞれ相当する。そして、上記
スイッチ９１４は、トランジスタ１０１のソースまたはドレインの一方と、容量素子１０
３の他方の電極との間の導通状態を制御する機能を有する。さらに、スイッチ１３が導通
状態であるならば、上記スイッチ９１４は、容量素子１０２の一方の電極及び容量素子１
０３の一方の電極と、容量素子１０３の他方の電極との間の導通状態を制御する機能を有
する。
また、本発明の一態様に係る半導体装置は、図２８（Ａ）乃至図２８（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図２９（Ａ）乃至図２９（Ｄ）に示す半導体装置は、図２８（Ａ）乃至図２８（Ｄ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２０１と
、配線２２に一定電圧や信号を供給する機能を有する回路２０２と、配線２３に一定電圧
や信号を供給する機能を有する回路２０３と、配線２４に一定電圧や信号を供給する機能
を有する回路２０４とを、それぞれ有する。
なお、図２８及び図２９に示す回路１００は、スイッチ１１、スイッチ１２、スイッチ１
３、スイッチ９１４に、トランジスタを用いることができる。
図２８及び図２９に示す回路１００は、図１、図２、図２４、図２５、図２６、図２７に
示す回路１００と同様の動作を行うことができる。ただし、一例としては、図２８及び図
２９に示す回路１００では、図５、図６に示す期間Ｔ１１乃至期間Ｔ１３、及び期間Ｔ１
５において、スイッチ９１４は導通状態であり、期間Ｔ１４においてスイッチ９１４は非
導通状態であることが好適である。これらにより、期間Ｔ１４において、トランジスタ１
０１を介して、発光素子１０４ａなどに、電荷が漏れることを防ぐことが出来る。ただし
、本発明の実施形態の一態様は、これに限定されない。
または、期間Ｔ１１において、スイッチ９１４を非導通状態とすることも可能である。こ
れにより、トランジスタ１０１に電流が流れないので、電位の制御がしやすくなる。
または、期間Ｔ１５の一部の期間においても、スイッチ９１４を非導通状態とする。これ
により、発光素子１０４ａなどに電流が流れないようにして、非発光期間を設けることが
出来る。
なお、期間Ｔ１２において、スイッチ９１４を非導通状態とすることも可能である。期間
Ｔ１２において、スイッチ９１４を非導通状態とすることで、期間Ｔ１２において発光素
子１０４ａのアノードを電位Ｖｉ１に保つことができる。よって、期間Ｔ１３を設けずに
、すなわち第３の動作を行わずに、期間Ｔ１２における第２の動作が終了した後、期間Ｔ
１４における第４の動作を行うことができる。
なお、図２８（Ｂ）及び図２９（Ｂ）に示す回路１００は、図８、図９、図１０（Ｂ）な
どと同様に、負荷１０４と接続された容量素子１０５を、さらに有していても良い。同様
に、図２８（Ｃ）及び図２９（Ｃ）に示す回路１００は、発光素子１０４ａと接続された
容量素子１０５を、さらに有していても良い。同様に、図２８（Ｄ）及び図２９（Ｄ）に
示す回路１００は、発光素子１０４ｂと接続された容量素子１０５を、さらに有していて
も良い。具体的に、容量素子１０５の一方の電極は、容量素子１０３の他方の電極に接続
される。なおかつ、スイッチ９１４は、容量素子１０５の一方の電極と、トランジスタ１
０１のソースまたはドレインの一方との間の導通状態を制御する。容量素子１０５の他方
の電極は、別途設けられた配線２６、配線２４、配線２３、或いは配線２２に接続される
。
また、図２８（Ｂ）乃至図２８（Ｄ）に示す回路１００、及び、図２９（Ｂ）乃至図２９
（Ｄ）に示す回路１００に上記容量素子１０５を追加した回路の、いずれかを、表示装置
の画素として用いても良い。そして、複数の色相にそれぞれ対応した画素が表示装置に設
けられている場合、対応する色相によって、画素が有するトランジスタ１０１の、チャネ
ル幅とチャネル長の比が、異なっていても良い。
なお、図２４乃至図２９とは別の場所に、スイッチ９１４を設けることも可能である。例
えば、図３０（Ａ）乃至図３０（Ｄ）に、回路１００の構成例をそれぞれ示す。図３０（
Ａ）乃至図３０（Ｄ）に示す回路１００は、図１（Ａ）乃至図１（Ｄ）に示した回路１０
０にスイッチ９１４を追加した構成に、それぞれ相当する。そして、図３０（Ａ）におい
て上記スイッチ９１４は、トランジスタ１０１のソースまたはドレインの一方及び容量素
子１０３の他方の電極と、配線２４との間の導通状態を制御する機能を有する。図３０（
Ｂ）において上記スイッチ９１４は、トランジスタ１０１のソースまたはドレインの一方
及び容量素子１０３の他方の電極と、負荷１０４との間の導通状態を制御する機能を有す
る。図３０（Ｃ）において上記スイッチ９１４は、トランジスタ１０１のソースまたはド
レインの一方及び容量素子１０３の他方の電極と、発光素子１０４ａのアノードとの間の
導通状態を制御する機能を有する。図３０（Ｄ）において上記スイッチ９１４は、トラン
ジスタ１０１のソースまたはドレインの一方及び容量素子１０３の他方の電極と、発光素
子１０４ｂのカソードとの間の導通状態を制御する機能を有する。
また、本発明の一態様に係る半導体装置は、図３０（Ａ）乃至図３０（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図３１（Ａ）乃至図３１（Ｄ）に示す半導体装置は、図３０（Ａ）乃至図３０（Ｄ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２０１と
、配線２２に一定電圧や信号を供給する機能を有する回路２０２と、配線２３に一定電圧
や信号を供給する機能を有する回路２０３と、配線２４に一定電圧や信号を供給する機能
を有する回路２０４とを、それぞれ有する。
なお、図３０及び図３１に示す回路１００は、スイッチ１１、スイッチ１２、スイッチ１
３、スイッチ９１４に、トランジスタを用いることができる。
図３０及び図３１に示す回路１００は、図１、図２、図２４、図２５、図２６、図２７、
図２８、図２９に示す回路１００と同様の動作を行うことができる。ただし、一例として
は、図３０及び図３１に示す回路１００では、図５、図６に示す期間Ｔ１１、及び期間Ｔ
１３乃至期間Ｔ１５において、スイッチ９１４は導通状態であり、期間Ｔ１２においてス
イッチ９１４は非導通状態であることが好適である。ただし、本発明の実施形態の一態様
は、これに限定されない。これにより、期間Ｔ１２において、スイッチ９１４を非導通状
態とすることで、期間Ｔ１２において発光素子１０４ａのアノードを電位Ｖｉ１に保つこ
とができる。よって、期間Ｔ１３を設けずに、すなわち第３の動作を行わずに、期間Ｔ１
２における第２の動作が終了した後、期間Ｔ１４における第４の動作を行うことができる
。ただし、本発明の実施形態の一態様は、これに限定されない。
または、期間Ｔ１１において、スイッチ９１４を非導通状態とすることも可能である。こ
れにより、発光素子１０４ａなどに電流が流れないため、配線２２の電位Ｖｉ２は、高い
値でもよい。
または、期間Ｔ１２において、スイッチ９１４を非導通状態とすることも可能である。こ
れにより、発光素子１０４ａなどに電流が流れないため、配線２２の電位Ｖｉ２は、高い
値でもよい。
または、期間Ｔ１５の一部の期間においても、スイッチ９１４を非導通状態とする。これ
により、発光素子１０４ａなどに電流が流れないようにして、非発光期間を設けることが
出来る。
なお、図３０（Ｂ）及び図３１（Ｂ）に示す回路１００は、図８、図９、図１０（Ｂ）、
図２１、図２２などと同様に、負荷１０４と接続された容量素子１０５を、さらに有して
いても良い。同様に、図３０（Ｃ）及び図３１（Ｃ）に示す回路１００は、発光素子１０
４ａと接続された容量素子１０５を、さらに有していても良い。同様に、図３０（Ｄ）及
び図３１（Ｄ）に示す回路１００は、発光素子１０４ｂと接続された容量素子１０５を、
さらに有していても良い。具体的に、容量素子１０５の一方の電極は、容量素子１０３の
他方の電極、及びトランジスタ１０１のソースまたはドレインの一方に、接続される。容
量素子１０５の他方の電極は、別途設けられた配線２６、配線２４、配線２３、或いは配
線２２に接続される。
また、図３０（Ｂ）乃至図３０（Ｄ）に示す回路１００、及び、図３１（Ｂ）乃至図３１
（Ｄ）に示す回路１００に上記容量素子１０５を追加した回路の、いずれかを、表示装置
の画素として用いても良い。そして、複数の色相にそれぞれ対応した画素が表示装置に設
けられている場合、対応する色相によって、画素が有するトランジスタ１０１の、チャネ
ル幅とチャネル長の比が、異なっていても良い。
なお、図２４乃至図３１において、図１などに示す回路において、スイッチ９１４を追加
した構成について述べたが、スイッチ９１４を追加するような回路は、図１などに限定さ
れない。図１以外の他の図面に示す回路においても、図２４乃至図３１と同様に、スイッ
チ９１４を追加する構成を用いることが出来る。例えば、図１１の回路のように、スイッ
チ１４が追加された構成において、図２４乃至図３１と同様に、スイッチ９１４を追加す
る回路を構成することが出来る。その場合の一例を、図８７に示す。
次に、図１および図１１などの回路において、図５および図１７などに示す駆動方法とは
異なる駆動方法を用いる場合の一例を示す。なお、このような駆動方法を用いる場合には
、配線２３を列方向の画素間で接続するよりも、行方向の画素間で接続することが望まし
いため、図３４（Ａ）乃至図３４（Ｄ）に、図１（Ａ）乃至図１（Ｄ）に示した回路１０
０の配置例をそれぞれ示す。図３４（Ａ）乃至図３４（Ｄ）では、互いに異なる配線２１
に接続された複数の回路１００が、共通の配線２３に接続されている場合を一例として示
している。つまり、配線２３は、配線２１と交差して設けられている。
図３４（Ｃ）に示す回路１００を例に挙げて、本発明の半導体装置の一態様の動作の一例
について説明する。この動作では、図５（Ｂ）や図１７（Ｂ）における第１の動作におい
て、容量素子１０２に電圧Ｖｉ２−Ｖｉ１が供給され、トランジスタ１０１のゲートソー
ス間電圧（Ｖｇｓ１０１）が電圧Ｖｉ２−Ｖｉ１になるときに、配線２１やスイッチ１４
を介して電位Ｖｉ１が供給されるのではなく、配線２３を介して供給される。したがって
、図５や図１７などで述べた内容を、本発明の半導体装置の一態様に適用することが可能
である。
図３４（Ｃ）に示す回路１００の動作は、主に第１の動作、第２の動作、第３の動作、第
４の動作、第５の動作に分けることができる。ただし、これに限定されず、新たな動作の
追加、或いは、一部の動作の削除も可能である。
まず、期間Ｔ１１において行われる第１の動作について説明する。期間Ｔ１１では、図３
５（Ａ）に示すように、スイッチ１１が非導通状態、スイッチ１２及びスイッチ１３が導
通状態である。また、配線２３には電位Ｖｉ１が供給される。よって、期間Ｔ１１では、
発光素子１０４ａのアノードは電位Ｖｉ１となり、トランジスタ１０１のゲートソース間
電圧（Ｖｇｓ１０１）は、電圧Ｖｉ２−Ｖｉ１となる。つまり、トランジスタ１０１、及
び、容量素子１０２を、初期化していることとなる。
期間Ｔ１２において行われる第２の動作について説明する。期間Ｔ１２では、図３５（Ｂ
）に示すように、スイッチ１１が非導通状態、スイッチ１２及びスイッチ１３が導通状態
である。また、配線２３には電位ＶＤＤが供給される。配線２３に電位ＶＤＤが供給され
ることで、容量素子１０２に蓄積されている電荷がトランジスタ１０１を介して放出され
、トランジスタ１０１のソースの電位が上昇する。そして、トランジスタ１０１がオフ状
態となると、容量素子１０２からの電荷の放出が止まる。最終的には、トランジスタ１０
１の閾値電圧Ｖｔｈが容量素子１０２に保持される。よって、期間Ｔ１２では、容量素子
１０２に閾値電圧Ｖｔｈが保持され、発光素子１０４ａのアノードは電位Ｖｉ２−Ｖｔｈ
となり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は、閾値電圧Ｖｔｈ
となる。つまり、トランジスタ１０１のしきい値電圧Ｖｔｈを取得することができる。
このように、配線２１を用いずに、第１および第２の動作を行うことが出来るため、第１
および第２の動作の期間を長く確保することが出来る。したがって、より正確に、トラン
ジスタ１０１のしきい値電圧を取得することができるため、表示ムラの少ない、綺麗な表
示を行うことが出来る。
期間Ｔ１３において行われる第３の動作について説明する。期間Ｔ１３では、図３５（Ｃ
）に示すように、スイッチ１１及びスイッチ１３が導通状態、スイッチ１２が非導通状態
である。配線２３には、任意の電位が供給されていればよく、例えば、電位ＶＤＤまたは
電位Ｖｉ１が供給される。また、配線２１には電位Ｖｉ３が供給される。電位Ｖｉ３は、
電位Ｖｃａｔと同じ高さでも良いし、電位Ｖｉ２と同じ高さでも良いし、電位Ｖｉ１と同
じ高さでも良い。よって、期間Ｔ１３では、容量素子１０２に閾値電圧Ｖｔｈが保持され
、発光素子１０４ａのアノードは電位Ｖｉ３となり、トランジスタ１０１のゲートの電位
は電位Ｖｉ３＋Ｖｔｈとなり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１
）は、閾値電圧Ｖｔｈとなる。
期間Ｔ１４において行われる第４の動作について説明する。期間Ｔ１４では、図３５（Ｄ
）に示すように、スイッチ１１が導通状態、スイッチ１２及びスイッチ１３が非導通状態
となる。また、配線２１には電位Ｖｓｉｇが供給される。よって、期間Ｔ１４では、容量
素子１０２に閾値電圧Ｖｔｈが保持され、容量素子１０３に電圧Ｖｓｉｇ−Ｖｉ３−Ｖα
が保持され、発光素子１０４ａのアノードは電位Ｖｉ３＋Ｖαとなり、トランジスタ１０
１のゲートの電位は電位Ｖｓｉｇ＋Ｖｔｈとなり、トランジスタ１０１のゲートソース間
電圧（Ｖｇｓ１０１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ３−Ｖαとなる。
期間Ｔ１５において行われる第５の動作について説明する。期間Ｔ１５では、図３６に示
すように、スイッチ１１、スイッチ１２及びスイッチ１３が非導通状態である。よって、
期間Ｔ１５では、容量素子１０２に閾値電圧Ｖｔｈが保持され、容量素子１０３に電圧Ｖ
ｓｉｇ−Ｖｉ３−Ｖαが保持され、発光素子１０４ａのアノードは電位Ｖｅｌとなり、ト
ランジスタ１０１のゲートの電位は電位Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ３−Ｖα＋Ｖｅｌとなり
、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は電圧Ｖｓｉｇ＋Ｖｔｈ−
Ｖｉ３−Ｖαとなる。したがって、電位Ｖｓｉｇに応じた大きさの電流を発光素子１０４
ａに流すことができ、電位Ｖｓｉｇに応じた輝度で発光素子１０４ａを発光させることが
できる。
なお、電位Ｖｅｌは、トランジスタ１０１を介して、発光素子１０４ａに電流を流す際に
生じる電位である。具体的には、電位ＶＤＤと電位Ｖｃａｔの間の電位になる。
上記第５の動作では、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）を、電
圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ３−Ｖαとし、トランジスタ１０１の閾値電圧Ｖｔｈを加味し
た値に設定することができる。従って、上記構成により、トランジスタ１０１の閾値電圧
Ｖｔｈのばらつきが、発光素子１０４ａに供給する電流値に影響を及ぼすのを防ぐことが
できる。または、トランジスタ１０１が劣化して、閾値電圧Ｖｔｈが変化しても、上記変
化が発光素子１０４ａに供給する電流値に影響を及ぼすのを防ぐことができる。よって、
表示ムラを低減でき、質の良い表示を行うことができる。
なお、期間Ｔ１５の一部の期間においても、配線２３の電位を制御することにより、発光
素子１０４ａなどに電流が流れないようにして、非発光期間を設けることが出来る。例え
ば、配線２３の電位が配線２４の電位と等しい場合には、電流が流れないようにすること
が出来る。
なお、図３４、図３５には、スイッチ１４が設けられていないが、これに限定されず、図
１１乃至図２３と同様に、スイッチ１４を設けることが可能である。
なお、図３４、図３５には、スイッチ９１４が設けられていないが、これに限定されず、
図２４乃至図８７と同様に、スイッチ９１４を設けることが可能である。
なお、図３４、図３５では、配線２３の電位を変化させて動作したが、複数の配線を用い
て、電位を制御することも可能である。その場合の一例を示す。したがって、図３４、図
３５、図５、図１７などで述べた内容を、本発明の半導体装置の一態様に適用することが
可能である。図３２（Ａ）乃至図３２（Ｄ）に、回路１００の構成例をそれぞれ示す。図
３２（Ａ）乃至図３２（Ｄ）に示す回路１００は、図１（Ａ）乃至図１（Ｄ）、または、
図３４乃至図３６に示した回路１００にスイッチ８１４及びスイッチ１５を追加し、配線
２３の代わりに配線２３ａ及び配線２３ｂを設けた構成に、それぞれ相当する。そして、
図３２（Ａ）乃至図３２（Ｄ）において上記スイッチ８１４は、トランジスタ１０１のソ
ースまたはドレインの他方と、配線２３ａとの間の導通状態を制御する機能を有する。ま
た、上記スイッチ１５は、トランジスタ１０１のソースまたはドレインの他方と、配線２
３ｂとの間の導通状態を制御する機能を有する。
なお、配線２３ａ、及び／または、配線２３ｂは、配線２１と交差して設けることが可能
であるが、配線２１と交差せずに、平行に設けることも可能である。
また、本発明の一態様に係る半導体装置は、図３２（Ａ）乃至図３２（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図３３（Ａ）乃至図３３（Ｄ）に示す半導体装置は、図３２（Ａ）乃至図３２（Ｄ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２０１と
、配線２２に一定電圧や信号を供給する機能を有する回路２０２と、配線２３ａに一定電
圧や信号を供給する機能を有する回路２０３ａと、配線２３ｂに一定電圧や信号を供給す
る機能を有する回路２０３ｂと、配線２４に一定電圧や信号を供給する機能を有する回路
２０４とを、それぞれ有する。具体的に、回路２０３ａは、配線２３ａに電位Ｖｉ１を供
給する機能を有する。また、回路２０３ｂは、配線２３ｂに電源電位（高電源電位または
低電源電位）、例えば、電位ＶＤＤ、または、電位ＶＳＳを供給する機能を有する。回路
２０３ａおよび回路２０３ｂの例としては、電源回路などがある。
したがって、配線２３ａは、電位Ｖｉ１を、伝えることが出来る機能、または、供給する
ことが出来る機能を有している。または、配線２３ａは、初期化用配線としての機能を有
している。なお、配線２３ａの電位は、一定の電位であることが望ましいが、本発明の実
施形態の一態様は、これに限定されず、パルス信号のように変動してもよい。
したがって、配線２３ｂは、電源電位を伝えることが出来る機能、または、供給すること
が出来る機能を有している。または、配線２３ｂは、トランジスタ１０１に電流を供給す
ることが出来る機能を有している。または、配線２３ｂは、負荷１０４に電流を供給する
ことが出来る機能を有している。または、配線２３ｂは、電源線としての機能を有してい
る。または、配線２３ｂは、電流供給線としての機能を有している。なお、配線２３ｂの
電位は、一定の電位であることが望ましいが、本発明の実施形態の一態様は、これに限定
されず、パルス信号のように変動してもよい。例えば、配線２３ｂの電位は、負荷１０４
に、順バイアス電圧だけでなく、逆バイアス電圧を加えるような電位であってもよい。
なお、図３３（Ａ）乃至図３３（Ｄ）では、半導体装置が、回路１００に加えて、回路２
０１、回路２０２、回路２０３ａ、回路２０３ｂ、及び回路２０４を有する場合を一例と
して示しているが、本発明の一態様に係る半導体装置は、必ずしも回路２０１、回路２０
２、回路２０３ａ、回路２０３ｂ、及び回路２０４を全て有する必要はなく、そのいずれ
か一つまたは複数だけを有していても良い。
なお、図３２及び図３３に示す回路１００は、スイッチ１１、スイッチ１２、スイッチ１
３、スイッチ８１４、スイッチ１５に、トランジスタを用いることができる。
図３２及び図３３に示す回路１００は、図３４乃至図３６に示す回路１００と同様の動作
を行うことができる。ただし、図３２及び図３３に示す回路１００では、期間Ｔ１１にお
いてスイッチ８１４を導通状態、スイッチ１５を非導通状態とする。また、期間Ｔ１２乃
至期間Ｔ１５においてスイッチ８１４を非導通状態、スイッチ１５を導通状態とする。
なお、図３２（Ｂ）及び図３３（Ｂ）に示す回路１００は、図８、図９、図２１、図２２
などと同様、負荷１０４と接続された容量素子１０５を、さらに有していても良い。同様
に、図３２（Ｃ）及び図３３（Ｃ）に示す回路１００は、発光素子１０４ａと接続された
容量素子１０５を、さらに有していても良い。同様に、図３２（Ｄ）及び図３３（Ｄ）に
示す回路１００は、発光素子１０４ｂと接続された容量素子１０５を、さらに有していて
も良い。具体的に、容量素子１０５の一方の電極は、容量素子１０３の他方の電極、及び
トランジスタ１０１のソースまたはドレインの一方に、接続される。容量素子１０５の他
方の電極は、別途設けられた配線２６、配線２４、配線２３、或いは配線２２に接続され
る。
また、図３２（Ｂ）乃至図３２（Ｄ）に示す回路１００、及び、図３３（Ｂ）乃至図３３
（Ｄ）に示す回路１００に上記容量素子１０５を追加した回路の、いずれかを、表示装置
の画素として用いても良い。そして、複数の色相にそれぞれ対応した画素が表示装置に設
けられている場合、対応する色相によって、画素が有するトランジスタ１０１の、チャネ
ル幅とチャネル長の比が、異なっていても良い。
なお、図３２、図３３には、スイッチ１４が設けられていないが、これに限定されず、図
１１乃至図２３と同様に、スイッチ１４を設けることが可能である。
なお、図３２、図３３には、スイッチ９１４が設けられていないが、これに限定されず、
図２４乃至図８７と同様に、スイッチ９１４を設けることが可能である。
本実施の形態は、他の実施の形態の一部または全部について、変更、追加、修正、削除、
応用、上位概念化、又は、下位概念化したものに相当する。したがって、本実施の形態の
一部または全部について、他の実施の形態の一部または全部と自由に組み合わせる、適用
する、或いは置き換えて実施することができる。
（実施の形態３）
本実施の形態では、本発明の一態様に係る半導体装置である、回路１００の構成例につい
て説明する。本実施の形態では、実施の形態１及び２で示した回路に対して、スイッチや
配線などを追加する、接続の一部を変更する、ある配線を別の配線に接続して、配線をま
とめる構成などや、駆動方法の一部を変更した場合などについて述べる。したがって、実
施の形態１及び２で述べた内容は、本実施の形態にも適用することが可能である。
図４３（Ａ）に示す回路１００は、図１１（Ｃ）に示した回路１００と、スイッチ１４の
位置が異なる構成、または、図１（Ｃ）に示した回路１００にスイッチ１４を追加した構
成に相当する。図４３（Ａ）に示す回路１００では、スイッチ１４が、容量素子１０２の
一方の電極、または、容量素子１０３の一方の電極と、配線２５との間の導通状態を制御
する機能を有する。
なお、動作は、図１７乃至図２０と同様である。ただし、図１８（Ａ）では、第４の動作
において、スイッチ１４が導通状態であったが、図４３（Ａ）の場合には、第４の動作に
おいて、スイッチ１４は非導通状態であることが好適である。ただし、本発明の実施形態
の一態様は、これに限定されない。
なお、図４３（Ａ）において、図２４乃至図３１などのように、スイッチ９１４を設ける
ことも可能である。なお、図４３（Ａ）において、図３２、図３３などのように、スイッ
チ８１４、スイッチ１５を設けることも可能である。なお、図４３（Ａ）において、図３
４などのように、配線２３の電位を制御することも可能である。一例として、図４３（Ａ
）において、図３０のようにスイッチ９１４を設けた場合を、図４３（Ｆ）に示す。
また、図８、図９、図２１、図２２などと同様に、図４３（Ａ）に示した回路１００に、
容量素子１０５を追加することが可能である。一例として、図４３（Ｂ）に示す回路１０
０は、図４３（Ａ）に示した回路１００に、容量素子１０５を追加した構成に相当する。
そして、上記容量素子１０５の一方の電極は、容量素子１０３の他方の電極に接続され、
上記容量素子１０５の他方の電極は、配線２６に接続されている。
なお、配線２６は、図８、図２１などと同様、さまざまな配線と接続されることが可能で
ある。例えば、図４３（Ｃ）に示す回路１００は、図４３（Ｂ）に示した回路１００にお
いて、配線２６が配線２５に接続されている例を一例として示している。配線２６は、配
線２５の他にも、配線２４、配線２２、配線２３、ゲート信号線、他の回路１００の配線
など、さまざまな配線と接続させることが可能である。
なお、配線２５は、さまざまな配線と接続されることが可能である。例えば、図４３（Ｄ
）に示す回路１００は、図４３（Ａ）に示した回路１００において、配線２５が配線２４
に接続されている例を示す。
また、図４３（Ｅ）に示す回路１００は、図４３（Ｄ）に示した回路１００に、容量素子
１０５を追加した構成に相当する。そして、上記容量素子１０５の一方の電極は、容量素
子１０３の他方の電極に接続され、上記容量素子１０５の他方の電極は、配線２６に接続
されている。
また、図４４に示す半導体装置は、図４３に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２２に一定電圧や信号を供給する機能
を有する回路２２１、配線２３に一定電圧や信号を供給する機能を有する回路２２２、配
線２４に一定電圧や信号を供給する機能を有する回路２２３、配線２５に一定電圧や信号
を供給する機能を有する回路２２４、配線２６に一定電圧や信号を供給する機能を有する
回路２２５のうち複数の回路を、それぞれ有する。
なお、図４３及び図４４では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図４３及び図４４に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
なお、図４３（Ｄ）と同様、図１１などにおいても、配線２５は、さまざまな配線と接続
されることが可能である。例えば、図４５（Ａ）に示す回路１００は、図１１（Ｃ）に示
した回路１００において、配線２５が配線２４に接続されている。
また、図４５（Ａ）に示した回路１００に対しても、図８、図９、図２１、図２２などと
同様に、容量素子１０５を追加する、或いは配線を接続することが可能である。例えば、
図４５（Ｂ）に示す回路１００は、図４５（Ａ）に示した回路１００に、容量素子１０５
を追加した構成に相当する。そして、上記容量素子１０５の一方の電極は、容量素子１０
３の他方の電極に接続され、上記容量素子１０５の他方の電極は、配線２６に接続されて
いる。なお、配線２５は、配線２４ではなく、配線２６と接続させることも可能である。
なお、配線２６も配線２５も、配線２４と接続させることも可能である。
また、図４５（Ｃ）及び図４５（Ｄ）に示す半導体装置は、図４５（Ａ）及び図４５（Ｂ
）に示す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２
２０、配線２２に一定電圧や信号を供給する機能を有する回路２２１、配線２３に一定電
圧や信号を供給する機能を有する回路２２２、配線２４に一定電圧や信号を供給する機能
を有する回路２２３、配線２６に一定電圧や信号を供給する機能を有する回路２２５のう
ち複数の回路を、それぞれ有する。
なお、図４５では、発光素子１０４ａを用いた場合の回路１００の構成を示しているが、
本発明の一態様に係る半導体装置は、図４５に示した回路１００において、発光素子１０
４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４または発光素子１０４
ｂを有する構成を有していても良い。
なお、図１などに示す回路において、スイッチ１４とスイッチ９１４の一方または両方を
追加して、スイッチ１４とスイッチ９１４の両方のスイッチを設けることが可能である。
つまり、図１１、図３２、図３４、図４３、図４５などにスイッチ９１４を追加する、或
いは、図２４、図２６、図２８、図３０、図３２、図３４などにスイッチ１４を追加する
ことが可能である。例えば、図４６（Ａ）に示す回路１００は、図１１（Ｃ）に示した回
路１００に、スイッチ９１４を追加した構成、または、図２８（Ｃ）に示した回路１００
にスイッチ１４を追加した構成に相当する。図４６（Ａ）に示す回路１００では、スイッ
チ９１４が、トランジスタ１０１のソースまたはドレインの一方と、容量素子１０３の他
方の電極または発光素子１０４ａの陽極との間の導通状態を制御する機能を有する。
なお、図４６（Ａ）において、図４４（Ｄ）、図４５などと同様に、配線２５を他の配線
に接続することが可能である。例えば、図４６（Ａ）に示した回路１００において、配線
２５を配線２４に接続させた場合の例を、図４６（Ｂ）に示す。
また、スイッチ１４を設ける場所は、図４６（Ａ）に限定されず、図４３と同様、他の場
所に設けることも可能である。図４６（Ｃ）に示す回路１００は、図４６（Ａ）に対して
、図４３（Ａ）と同様にスイッチ１４を設けた場合の例であり、スイッチ１４が、容量素
子１０２の一方の電極及び容量素子１０３の一方の電極と、配線２５との間の導通状態を
制御する機能を有している。
また、スイッチ１４に相当するスイッチは、１つだけでなく、複数設けることも可能であ
る。例えば、図４６（Ｄ）に示す回路１００は、スイッチ１４の代わりに、容量素子１０
３の他方の電極及び発光素子１０４ａの陽極と、配線２４との間の導通状態を制御する機
能を有するスイッチ１４ａと、容量素子１０２の一方の電極及び容量素子１０３の一方の
電極と、配線２５との間の導通状態を制御する機能を有するスイッチ１４ｂとを有する点
において、図４６（Ａ）に示した回路１００と構成が異なる。つまり、図４６（Ｄ）は、
スイッチ１４が２カ所に追加されたものであると言える。
また、図４７に示す半導体装置は、図４６に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２２に一定電圧や信号を供給する機能
を有する回路２２１、配線２３に一定電圧や信号を供給する機能を有する回路２２２、配
線２４に一定電圧や信号を供給する機能を有する回路２２３、配線２５に一定電圧や信号
を供給する機能を有する回路２２４のうち複数の回路を、それぞれ有する。
なお、図４６及び図４７では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図４６及び図４７に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
なお、スイッチ１４およびスイッチ９１４を設ける構成は、図４６、図８７だけでなく、
様々な構成を取ることが出来る。この場合の駆動方法は、図５、図６、図１７、図１８、
図２０、図３５、図３６と同様に行うことが出来る。図４８（Ａ）に示す回路１００は、
図４６（Ａ）に示した回路１００と、スイッチ１４の位置が異なる構成に相当する。図４
８（Ａ）に示す回路１００では、スイッチ１４が、トランジスタ１０１のソースまたはド
レインの一方と、配線２５との間の導通状態を制御する機能を有する。
また、図４８（Ａ）でも、図４４（Ｄ）や図４５と同様、配線２５を別の配線と接続する
ことが可能であり、例えば、図４８（Ｂ）に示す回路１００は、図４６（Ａ）に示した回
路１００において、配線２５を配線２４に接続させた場合の例を示す。
また、図４８（Ｃ）及び図４８（Ｄ）に示す半導体装置は、図４８（Ａ）及び図４８（Ｂ
）に示す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２
２０、配線２２に一定電圧や信号を供給する機能を有する回路２２１、配線２３に一定電
圧や信号を供給する機能を有する回路２２２、配線２４に一定電圧や信号を供給する機能
を有する回路２２３、配線２５に一定電圧や信号を供給する機能を有する回路２２４のう
ち複数の回路を、それぞれ有する。
なお、図４８では、発光素子１０４ａを用いた場合の回路１００の構成を示しているが、
本発明の一態様に係る半導体装置は、図４８に示した回路１００において、発光素子１０
４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４または発光素子１０４
ｂを有する構成を有していても良い。
図４９（Ａ）に示す回路１００は、スイッチ１４およびスイッチ９１４を設ける場合の別
の例であり、図１１（Ｃ）に示した回路１００に、スイッチ９１４を追加した構成、また
は、図３０（Ｃ）に示した回路１００にスイッチ１４を追加した構成に相当する。図４９
（Ａ）に示す回路１００では、スイッチ９１４が、トランジスタ１０１のソースまたはド
レインの一方及び容量素子１０３の他方の電極と、発光素子１０４ａの陽極との間の導通
状態を制御する機能を有する。
この場合の駆動方法は、図５、図６、図１７、図１８、図２０、図３５、図３６と同様に
行うことが出来る。駆動方法の一例を、以下に示す。
まず、期間Ｔ１１において行われる第１の動作について説明する。期間Ｔ１１では、スイ
ッチ１１、スイッチ９１４が非導通状態、スイッチ１２、スイッチ１３、及びスイッチ１
４が導通状態である。よって、期間Ｔ１１では、容量素子１０２に電圧Ｖｉ２−Ｖｉ１が
供給され、発光素子１０４ａのアノードは電位Ｖｉ１となり、トランジスタ１０１のゲー
トソース間電圧（Ｖｇｓ１０１）は、電圧Ｖｉ２−Ｖｉ１となる。つまり、トランジスタ
１０１、及び、容量素子１０２を、初期化していることとなる。
なお、スイッチ１１は、配線２１の電位がトランジスタ１０１、及び、容量素子１０２の
初期化に悪影響を及ぼさない場合には、導通状態であってもよい。その場合、スイッチ１
４は、非導通状態でもよい。
なお、スイッチ１３は、非導通状態であってもよい。
なお、スイッチ９１４は、導通状態であってもよい。
期間Ｔ１２において行われる第２の動作について説明する。期間Ｔ１２では、スイッチ１
１、スイッチ１４、スイッチ９１４が非導通状態、スイッチ１２及びスイッチ１３が導通
状態である。スイッチ１１、スイッチ９１４、スイッチ１４が非導通状態となることで、
容量素子１０２に蓄積されている電荷がトランジスタ１０１を介して放出され、トランジ
スタ１０１のソースの電位が上昇する。そして、トランジスタ１０１がオフ状態となると
、容量素子１０２からの電荷の放出が止まる。最終的には、トランジスタ１０１の閾値電
圧Ｖｔｈが容量素子１０２に保持される。よって、期間Ｔ１２では、容量素子１０２に閾
値電圧Ｖｔｈが保持され、発光素子１０４ａのアノードは電位Ｖｉ２−Ｖｔｈとなり、ト
ランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は、閾値電圧Ｖｔｈ（またはＶ
ｔｈに応じた大きさの電圧）となる。つまり、トランジスタ１０１のしきい値電圧Ｖｔｈ
（またはＶｔｈに応じた大きさの電圧）を取得することができる。
なお、第２の動作において、トランジスタ１０１のしきい値電圧Ｖｔｈが正か負かという
ことに関係なく、動作させることができる。これは、トランジスタ１０１がオフ状態とな
るまで、トランジスタ１０１のソース電位が上昇できるからである。つまり、トランジス
タ１０１のゲート電位よりも、トランジスタ１０１のソース電位の方が高くなった状態で
、ようやくトランジスタ１０１がオフし、Ｖｇｓ１０１がＶｔｈとなる、ということが可
能であるからである。したがって、トランジスタ１０１がエンハンスメント型（ノーマリ
オフ型）であっても、デプリーション型（ノーマリオン型）であっても、正常に動作させ
ることができる。
なお、発光素子１０４ａのアノードの電位が高くなったときに、発光素子１０４ａに電流
が流れないようにすることが望ましい。発光素子１０４ａに電流が流れないようにするた
めには、電位Ｖｉ２を低い値とすることが好適である。ただし、スイッチ９１４を非導通
状態にすることにより、発光素子１０４ａに電流が流れないようにすることが可能である
ため、電位Ｖｉ２は、高い値でもよい。
なお、スイッチ９１４は、導通状態であってもよい。
期間Ｔ１３において行われる第３の動作について説明する。期間Ｔ１３では、スイッチ１
１及びスイッチ１４が導通状態、スイッチ１２、スイッチ１３、スイッチ９１４が非導通
状態である。また、配線２１には電位Ｖｓｉｇが供給される。よって、期間Ｔ１３では、
容量素子１０２に閾値電圧Ｖｔｈ（またはＶｔｈに応じた大きさの電圧）が保持され、容
量素子１０３に電圧Ｖｓｉｇ−Ｖｉ１が保持され、発光素子１０４ａのアノードは電位Ｖ
ｉ１となり、トランジスタ１０１のゲートの電位は電位Ｖｓｉｇ＋Ｖｔｈとなり、トラン
ジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１と
なる。したがって、電位Ｖｓｉｇを容量素子１０３に入力することが出来る。または、容
量素子１０２の電圧と容量素子１０３の電圧との和が、トランジスタ１０１のゲートソー
ス間電圧となるようにすることが出来る。
なお、このとき、スイッチ１４を、非導通状態とすることも可能である。
なお、スイッチ９１４は、導通状態であってもよい。
期間Ｔ１４において行われる第４の動作について説明する。期間Ｔ１４では、スイッチ１
１、スイッチ１２、スイッチ１３、及びスイッチ１４が非導通状態であり、スイッチ９１
４は導通状態である。よって、期間Ｔ１４では、容量素子１０２に閾値電圧Ｖｔｈが保持
され、容量素子１０３に電圧Ｖｓｉｇ−Ｖｉ１が保持され、発光素子１０４ａのアノード
は電位Ｖｅｌとなり、トランジスタ１０１のゲートの電位は電位Ｖｓｉｇ＋Ｖｔｈ＋Ｖｅ
ｌとなり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）は電圧Ｖｓｉｇ＋
Ｖｔｈ−Ｖｉ１となる。したがって、電位Ｖｓｉｇに応じた大きさの電流を発光素子１０
４ａに流すことができ、電位Ｖｓｉｇに応じた輝度で発光素子１０４ａを発光させること
ができる。
なお、第４の動作の一部の期間において、強制的にトランジスタ１０１がオフ状態になる
ことや、発光素子１０４ａに電流が流れないようにして、発光素子１０４ａが発光しない
ような状況にすることも可能である。つまり、非発光期間を設けることも可能である。例
えば、スイッチ１２をオンにすることにより、トランジスタ１０１をオフ状態にすること
が可能である。または、スイッチ１４をオンにすることにより、発光素子１０４ａに電流
が流れないようにすることが可能である。または、スイッチ９１４をオフにすることによ
り、発光素子１０４ａに電流が流れないようにすることが可能である。
なお、上記第３の動作が行われる期間Ｔ１３の後、上記第４の動作が行われる期間Ｔ１４
の前に、第６の動作が行われる期間Ｔ１６を設けても良い。
期間Ｔ１６において行われる第６の動作について説明する。期間Ｔ１６では、スイッチ１
２が導通状態、スイッチ１１、スイッチ１３、スイッチ９１４及びスイッチ１４が非導通
状態である。よって、期間Ｔ１６では、トランジスタ１０１のゲートソース間電圧（Ｖｇ
ｓ１０１）は、電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１−Ｖαとなる。
第６の動作で、電位Ｖαは、発光素子１０４ａのアノードが電気的に浮遊状態（フローテ
ィング状態）となることで変動する電位である。電位Ｖαは、トランジスタ１０１がオフ
であるならば、発光素子１０４ａの容量値と、容量素子１０２及び容量素子１０３の容量
値の比に応じて、その値が定まる。しかし、電位Ｖｓｉｇの高さによっては、トランジス
タ１０１がオンするので、トランジスタ１０１を介して発光素子１０４ａのアノードに電
荷が流入してしまう。よって、電位Ｖαは、上記静電容量の比によってのみ決まらず、発
光素子１０４ａのアノードに流入する電荷によっても、その値が変化する。
なお、スイッチ１２とスイッチ１３とは、同じタイミングで、オンオフを制御されること
が可能である。よって、スイッチ１２とスイッチ１３とを同じ極性のトランジスタを用い
て構成した場合、図１５と同様に、トランジスタのゲートを互いに接続させることが可能
である。
また、配線２２や配線２５は、他の様々な配線と接続させることが可能である。例えば、
図４９（Ｂ）に示す回路１００は、図４９（Ａ）に示した回路１００において、配線２５
が配線２４に接続されている場合を示す。
また、図８、図９、図２１、図２２などと同様に、容量素子１０５を追加して設けること
も可能であり、例えば、図４９（Ｃ）に示す回路１００は、図４９（Ａ）に示した回路１
００に、容量素子１０５を追加した構成に相当する。そして、上記容量素子１０５の一方
の電極は、容量素子１０３の他方の電極に接続され、上記容量素子１０５の他方の電極は
、配線２６に接続されている。
また、図４９（Ｃ）とは異なる配置で容量素子１０５を設けた場合の例として、図４９（
Ｄ）に示す回路１００は、図４９（Ａ）に示した回路１００に、容量素子１０５を追加し
た構成に相当する。そして、上記容量素子１０５の一方の電極は、発光素子１０４ａの陽
極に接続され、上記容量素子１０５の他方の電極は、配線２６に接続されている。
また、図５０に示す半導体装置は、図４９に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２２に一定電圧や信号を供給する機能
を有する回路２２１、配線２３に一定電圧や信号を供給する機能を有する回路２２２、配
線２４に一定電圧や信号を供給する機能を有する回路２２３、配線２５に一定電圧や信号
を供給する機能を有する回路２２４、配線２６に一定電圧や信号を供給する機能を有する
回路２２５のうち複数の回路を、それぞれ有する。
なお、図４９及び図５０では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図４９及び図５０に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
なお、図４９（Ｃ）及び図４９（Ｄ）においても、図８、図２１、図４３、図４５、図４
６などと同様に、配線２２、配線２３、配線２４、配線２５、配線２６などは、互いに接
続することが可能である。
なお、図４９では、容量素子１０５を１つ追加した場合を示したが、本発明の実施形態の
一態様は、これに限定されない。容量素子１０５を追加した回路１００において、さらに
多くの容量素子を追加することが可能である。例えば、図５１（Ａ）に示す回路１００は
、図４９（Ａ）に示した回路１００に、容量素子１０５ａ及び容量素子１０５ｂを追加し
た構成に相当する。そして、上記容量素子１０５ａの一方の電極は、容量素子１０３の他
方の電極に接続され、上記容量素子１０５ａの他方の電極は、配線２６に接続されている
。上記容量素子１０５ｂの一方の電極は、発光素子１０４ａの陽極に接続され、上記容量
素子１０５ｂの他方の電極は、配線２７に接続されている。
また、配線２５は、他の配線と接続させることが可能であり、例えば、図５１（Ｂ）に示
す回路１００は、図５０（Ｃ）に示した回路１００において、配線２５を配線２４に接続
した構成に相当する。
また、図５１（Ｃ）に示す回路１００は、図５０（Ｄ）に示した回路１００において、配
線２５を配線２４に接続した構成に相当する。
また、図５１（Ｄ）に示す回路１００は、図５１（Ａ）に示した回路１００において、配
線２５を配線２４に接続した構成に相当する。
また、図５２に示す半導体装置は、図５１に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２２に一定電圧や信号を供給する機能
を有する回路２２１、配線２３に一定電圧や信号を供給する機能を有する回路２２２、配
線２４に一定電圧や信号を供給する機能を有する回路２２３、配線２５に一定電圧や信号
を供給する機能を有する回路２２４、配線２６に一定電圧や信号を供給する機能を有する
回路２２５、配線２７に一定電圧や信号を供給する機能を有する回路２２６のうち複数の
回路を、それぞれ有する。
回路２２６の例としては、電源回路などがある。したがって、配線２７は、所定の電位を
、伝えることが出来る機能、または、供給することが出来る機能を有している。または、
配線２７は、容量用配線としての機能を有している。なお、配線２７の電位は、一定の電
位であることが望ましいが、本発明の実施形態の一態様は、これに限定されず、パルス信
号のように変動してもよい。なお、配線２７は、他の配線と接続させることが可能である
。例えば、配線２５、配線２４、配線２２、配線２６、配線２３、ゲート信号線、他の回
路１００の配線など、さまざまな配線と接続させることが可能である。
なお、図５１及び図５２では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図５１及び図５２に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
なお、これまでに述べた様々な回路において、配線２２は、他の配線と接続させることが
可能である。その結果、配線の数を低減することが可能となる。例えば、配線２２を、配
線２１、配線２３、配線２３ａ、配線２３ｂ、配線２４、配線２５、配線２６、配線２７
などと接続させることが可能である。または、配線２２を、走査線、ゲート線、トランジ
スタのゲートと接続された配線などと接続させることが可能である。一例としては、図５
３（Ａ）に示す回路１００は、図１１（Ｃ）に示した回路１００において、配線２２を配
線２１に接続した構成を示す。
同様に、図５３（Ｂ）に示す回路１００は、図１（Ｃ）に示した回路１００において、配
線２２を配線２１に接続した構成を示す。
また、図８、図９、図２１、図２２などと同様に、容量素子１０５を追加することも可能
である。例えば、図５３（Ｃ）に示す回路１００は、図５３（Ａ）に示した回路１００に
、容量素子１０５を追加した構成、または、図２１（Ａ）に示した回路１００において配
線２２を配線２１に接続した構成に相当する。
また、図４３などにおいても同様に、配線２２を配線２１と接続させることが可能である
。例えば、図５３（Ｄ）に示す回路１００は、図４３（Ｂ）に示した回路１００において
、での配線２２を配線２１と接続した構成となっている。
また、図５４に示す半導体装置は、図５３に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２３に一定電圧や信号を供給する機能
を有する回路２２２、配線２４に一定電圧や信号を供給する機能を有する回路２２３、配
線２５に一定電圧や信号を供給する機能を有する回路２２４、配線２６に一定電圧や信号
を供給する機能を有する回路２２５のうち複数の回路を、それぞれ有する。
なお、図５３及び図５４では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図５３及び図５４に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
なお、ある配線が第１の配線と接続されている場合、第２の配線も第１の配線と接続され
たり、第３の配線と接続されることが可能である。例えば、配線２２が、ある一つの配線
と接続されている場合、配線２５も他の一つの配線と接続されることが可能である。例え
ば、図５５（Ａ）に示す回路１００は、図１１（Ｃ）に示した回路１００において、配線
２２が配線２１に接続され、配線２５が配線２４に接続されている構成、図５４（Ａ）に
示した回路１００において、配線２５が配線２４に接続されている構成、または、図４５
（Ａ）に示した回路１００において、配線２２が配線２１に接続されている構成を示す。
また、図８、図９、図２１、図２２などと同様に、容量素子１０５を追加することも可能
である。例えば、図５５（Ｂ）に示す回路１００は、図５５（Ａ）に示した回路１００に
、容量素子１０５を追加した構成、または、図４５（Ｂ）に示した回路１００において配
線２２が配線２１に接続された構成に相当する。
また、スイッチ１４の位置を変更した場合にも適用することが可能であり、図５５（Ｃ）
に示す回路１００は、図４３（Ｅ）に示した回路１００において、配線２２が配線２１に
接続された構成を示す。
また、図５６に示す半導体装置は、図５５に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２３に一定電圧や信号を供給する機能
を有する回路２２２、配線２４に一定電圧や信号を供給する機能を有する回路２２３、配
線２６に一定電圧や信号を供給する機能を有する回路２２５のうち複数の回路を、それぞ
れ有する。
なお、図５５及び図５６では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図５５及び図５６に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
また、図５７（Ａ）に示す回路１００は、図４６（Ａ）に示した回路１００において、配
線２２が配線２１に接続された例を示す。
また、図５７（Ｂ）に示す回路１００は、図２８（Ｃ）に示した回路１００において、配
線２２が配線２１に接続された例を示す。
また、図８、図９、図２１、図２２などと同様に、スイッチ９１４を追加することも可能
である。例えば、図５７（Ｃ）に示す回路１００は、図５３（Ｃ）に示した回路１００に
、スイッチ９１４を追加した構成に相当する。
また、図５７（Ｄ）に示す回路１００は、図５３（Ｄ）に示した回路１００に、スイッチ
９１４を追加した構成、または、図５７（Ｃ）におけるスイッチ１４の配置を変更した構
成に相当する。
また、図５８に示す半導体装置は、図５７に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２３に一定電圧や信号を供給する機能
を有する回路２２２、配線２４に一定電圧や信号を供給する機能を有する回路２２３、配
線２５に一定電圧や信号を供給する機能を有する回路２２４、配線２６に一定電圧や信号
を供給する機能を有する回路２２５のうち複数の回路を、それぞれ有する。
なお、図５７及び図５８では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図５７及び図５８に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
また、図５９（Ａ）に示す回路１００は、図５７（Ａ）に示した回路１００において、配
線２５を配線２４に接続した場合の構成を示す。
また、図５９（Ｂ）に示す回路１００は、図５７（Ｃ）に示した回路１００において、配
線２５を配線２４に接続した場合の構成を示す。
また、図５９（Ｃ）に示す回路１００は、図５７（Ｄ）に示した回路１００において、配
線２５を配線２４に接続した場合の構成を示す。
また、図６０に示す半導体装置は、図５９に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２３に一定電圧や信号を供給する機能
を有する回路２２２、配線２４に一定電圧や信号を供給する機能を有する回路２２３、配
線２６に一定電圧や信号を供給する機能を有する回路２２５のうち複数の回路を、それぞ
れ有する。
なお、図５９及び図６０では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図５９及び図６０に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
なお、配線２２は、配線２１以外の配線と接続することが可能である。例えば、配線２２
は、配線２４と接続することも可能である。例えば、図６１（Ａ）に示す回路１００は、
図１１（Ｃ）に示した回路１００において、配線２２が配線２４と接続された構成を示す
。
また、図６１（Ｂ）に示す回路１００は、図１（Ｃ）に示した回路１００において、配線
２２が配線２４と接続された構成を示す。
また、図６１（Ｃ）に示す回路１００は、図２１（Ａ）に示した回路１００において、配
線２２が配線２４と接続された構成を示す。
また、図６１（Ｄ）に示す回路１００は、図４３（Ａ）に示した回路１００において、配
線２２が配線２４と接続された構成を示す。
また、図６２に示す半導体装置は、図６１に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２３に一定電圧や信号を供給する機能
を有する回路２２２、配線２４に一定電圧や信号を供給する機能を有する回路２２３、配
線２５に一定電圧や信号を供給する機能を有する回路２２４、配線２６に一定電圧や信号
を供給する機能を有する回路２２５のうち複数の回路を、それぞれ有する。
なお、図６１及び図６２では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図６１及び図６２に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
また、図８、図９、図２１、図２２などと同様に、容量素子１０５を追加することも可能
である。例えば、図６３（Ａ）に示す回路１００は、図６１（Ｂ）に示した回路１００に
、容量素子１０５を追加した構成、または、図８（Ａ）に示した回路１００において、配
線２２を配線２４に接続した構成に相当する。
また、図６３（Ｂ）に示す回路１００は、図４６（Ａ）に示した回路１００において、配
線２２を配線２４に接続した構成に相当する。
また、図６３（Ｃ）に示す回路１００は、図２８（Ｃ）に示した回路１００において、配
線２２を配線２４に接続した構成に相当する。
また、図６３（Ｄ）に示す回路１００は、図６３（Ｃ）に示した回路１００に示した回路
１００に、図８、図９、図２１、図２２などと同様に、容量素子１０５を追加した構成に
相当する。
また、図６４に示す半導体装置は、図６３に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２３に一定電圧や信号を供給する機能
を有する回路２２２、配線２４に一定電圧や信号を供給する機能を有する回路２２３、配
線２５に一定電圧や信号を供給する機能を有する回路２２４、配線２６に一定電圧や信号
を供給する機能を有する回路２２５のうち複数の回路を、それぞれ有する。
なお、図６３及び図６４では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図６３及び図６４に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
また、図６５（Ａ）に示す回路１００は、図６１（Ｄ）に示した回路１００に、スイッチ
９１４を追加した構成に相当する。図６５（Ａ）に示す回路１００では、スイッチ９１４
が、トランジスタ１０１のソースまたはドレインの一方と、容量素子１０３の他方の電極
及び発光素子１０４ａの陽極との間の導通状態を制御する機能を有する。
また、図６５（Ｂ）に示す回路１００は、図６１（Ａ）に示した回路１００において、配
線２５が配線２４に接続された例を示す。
また、図６５（Ｃ）に示す回路１００は、図６１（Ｃ）に示した回路１００において、配
線２５が配線２４に接続された例を示す。
また、図６５（Ｄ）に示す回路１００は、図６１（Ｄ）に示した回路１００において、配
線２５が配線２４に接続された例を示す。
また、図６６に示す半導体装置は、図６５に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２３に一定電圧や信号を供給する機能
を有する回路２２２、配線２４に一定電圧や信号を供給する機能を有する回路２２３、配
線２５に一定電圧や信号を供給する機能を有する回路２２４、配線２６に一定電圧や信号
を供給する機能を有する回路２２５のうち複数の回路を、それぞれ有する。
なお、図６５及び図６６では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図６５及び図６６に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
また、図６７（Ａ）に示す回路１００は、図６５（Ａ）に示した回路１００において、図
８、図９、図２１、図２２などと同様に、容量素子１０５を追加した構成に相当する。
また、図６７（Ｂ）に示す回路１００は、図６５（Ｄ）に示した回路１００において、図
８、図９、図２１、図２２などと同様に、容量素子１０５を追加した構成に相当する。
また、図６７（Ｃ）に示す回路１００は、図６３（Ｃ）に示した回路１００において、図
８、図９、図２１、図２２などと同様に、容量素子１０５を追加した構成に相当する。
また、図６８に示す半導体装置は、図６７に示す回路１００に加えて、配線２１に一定電
圧や信号を供給する機能を有する回路２２０、配線２３に一定電圧や信号を供給する機能
を有する回路２２２、配線２４に一定電圧や信号を供給する機能を有する回路２２３、配
線２５に一定電圧や信号を供給する機能を有する回路２２４、配線２６に一定電圧や信号
を供給する機能を有する回路２２５のうち複数の回路を、それぞれ有する。
なお、図６７及び図６８では、発光素子１０４ａを用いた場合の回路１００の構成を示し
ているが、本発明の一態様に係る半導体装置は、図６７及び図６８に示した回路１００に
おいて、発光素子１０４ａがない構成、或いは、発光素子１０４ａの代わりに負荷１０４
または発光素子１０４ｂを有する構成を有していても良い。
なお、図３２で示す回路１００においても、これまでに述べた図と同様に、スイッチ１４
、スイッチ９１４、容量素子１０５などを追加する事が可能である。または、図３２で示
す回路１００においても、様々な配線を、別の様々な配線に接続させて、配線の数を減ら
すことが可能である。例えば、図６９（Ａ）乃至図６９（Ｄ）に示す回路１００は、図１
１と同様に、図３２（Ａ）乃至図３２（Ｄ）に示した回路１００に、スイッチ１４を追加
した構成に、それぞれ相当する。
また、本発明の一態様に係る半導体装置は、図６９（Ａ）乃至図６９（Ｄ）に示した回路
１００に加えて、回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さ
らに有していても良い。
図７０（Ａ）乃至図７０（Ｄ）に示す半導体装置は、図６９（Ａ）乃至図６９（Ｄ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２２０と
、配線２２に一定電圧や信号を供給する機能を有する回路２２１と、配線２３ａに一定電
圧や信号を供給する機能を有する回路２２２ａと、配線２３ｂに一定電圧や信号を供給す
る機能を有する回路２２２ｂと、配線２４に一定電圧や信号を供給する機能を有する回路
２２３と、配線２５に一定電圧や信号を供給する機能を有する回路２２４とを、それぞれ
有する。
なお、図７０（Ａ）乃至図７０（Ｄ）では、半導体装置が、回路１００に加えて、回路２
２０、回路２２１、回路２２２ａ、回路２２２ｂ、回路２２３、及び回路２２４を有する
場合を一例として示しているが、本発明の一態様に係る半導体装置は、必ずしも回路１０
０に加えて、回路２２０、回路２２１、回路２２２ａ、回路２２２ｂ、回路２２３、及び
回路２２４を全て有する必要はなく、そのいずれか一つまたは複数だけを有していても良
い。
また、図７３（Ａ）に示す回路１００は、図３２（Ｃ）に示す回路１００に、スイッチ９
１４を追加した構成に相当する。そして、スイッチ９１４は、トランジスタ１０１のソー
スまたはドレインの一方と、容量素子１０３の他方の電極及び発光素子１０４ａの陽極と
の間の導通状態を制御する機能を有する。
また、図７３（Ｂ）に示す回路１００は、図６９（Ｃ）に示した回路１００に、スイッチ
９１４を追加した構成に相当する。そして、スイッチ９１４は、トランジスタ１０１のソ
ースまたはドレインの一方と、容量素子１０３の他方の電極及び発光素子１０４ａの陽極
との間の導通状態を制御する機能を有する。
また、本発明の一態様に係る半導体装置は、図７３（Ａ）及び図７３（Ｂ）に示した回路
１００に加えて、回路１００に各種一定電圧や信号を供給する機能を有する回路を、さら
に有していても良い。
図７３（Ｃ）及び図７３（Ｄ）に示す半導体装置は、図７３（Ａ）及び図７３（Ｂ）に示
す回路１００に加えて、配線２１に一定電圧や信号を供給する機能を有する回路２２０と
、配線２２に一定電圧や信号を供給する機能を有する回路２２１と、配線２３ａに一定電
圧や信号を供給する機能を有する回路２２２ａと、配線２３ｂに一定電圧や信号を供給す
る機能を有する回路２２２ｂと、配線２４に一定電圧や信号を供給する機能を有する回路
２２３と、配線２５に一定電圧や信号を供給する機能を有する回路２２４とを、それぞれ
有する。
なお、図７３（Ｃ）及び図７３（Ｄ）では、半導体装置が、回路１００に加えて、回路２
２０、回路２２１、回路２２２ａ、回路２２２ｂ、回路２２３、及び回路２２４を有する
場合を一例として示しているが、本発明の一態様に係る半導体装置は、必ずしも回路１０
０に加えて、回路２２０、回路２２１、回路２２２ａ、回路２２２ｂ、回路２２３、及び
回路２２４を全て有する必要はなく、そのいずれか一つまたは複数だけを有していても良
い。
なお、図３４で示す回路１００においても、これまでに述べた図と同様に、スイッチ１４
、スイッチ９１４、容量素子１０５などを追加する事が可能である。または、図３４で示
す回路１００においても、様々な配線を、別の様々な配線に接続させて、配線の数を減ら
すことが可能である。例えば、図７１（Ａ）乃至図７１（Ｄ）に、図３４（Ａ）乃至図３
４（Ｄ）に示した回路１００の配置例をそれぞれ示す。
図７１（Ｃ）に示す回路１００を例に挙げて、本発明の一態様に係る半導体装置の動作の
一例について説明する。
図７１（Ｃ）に示す回路１００の動作は、主に第１の動作、第２の動作、第３の動作、第
４の動作に分けることができる。ただし、これに限定されず、新たな動作の追加、或いは
、一部の動作の削除も可能である。
まず、期間Ｔ１１において行われる第１の動作について説明する。期間Ｔ１１では、図７
２（Ａ）に示すように、スイッチ１１、スイッチ１３、及びスイッチ１４が非導通状態、
スイッチ１２が導通状態である。また、配線２３には電位Ｖｉ１が供給される。よって、
期間Ｔ１１では、発光素子１０４ａのアノードは電位Ｖｉ１となり、トランジスタ１０１
のゲートソース間電圧（Ｖｇｓ１０１）は、電圧Ｖｉ２−Ｖｉ１となる。
なお、図７２（Ａ）では、スイッチ１１が非導通状態の場合を一例として示しているが、
スイッチ１１は導通状態であっても良い。また、図７２（Ａ）では、スイッチ１４が非導
通状態の場合を一例として示しているが、スイッチ１４は導通状態であっても良い。この
場合、配線２５には電位Ｖｉ３が供給されるものとする。そして、発光素子１０４ａのア
ノードは電位Ｖｉ３となり、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）
は、電圧Ｖｉ２−Ｖｉ３となる。また、スイッチ１３が導通状態であってもよい。
期間Ｔ１２において行われる第２の動作について説明する。期間Ｔ１２では、図７２（Ｂ
）に示すように、スイッチ１１及びスイッチ１４が非導通状態、スイッチ１２及びスイッ
チ１３が導通状態となる。また、配線２３には電位ＶＤＤ、または、電位Ｖｉ１よりは高
い電位が供給される。配線２３に電位ＶＤＤが供給されることで、容量素子１０２に蓄積
されている電荷が放出され、最終的には、トランジスタ１０１の閾値電圧Ｖｔｈが容量素
子１０２に保持される。よって、期間Ｔ１２では、容量素子１０２に閾値電圧Ｖｔｈが保
持され、発光素子１０４ａのアノードは電位Ｖｉ２−Ｖｔｈとなり、トランジスタ１０１
のゲートソース間電圧（Ｖｇｓ１０１）は、閾値電圧Ｖｔｈとなる。
期間Ｔ１３において行われる第３の動作について説明する。期間Ｔ１３では、図７２（Ｃ
）に示すように、スイッチ１１及びスイッチ１４が導通状態、スイッチ１２及びスイッチ
１３が非導通状態となる。また、配線２１には電位Ｖｓｉｇが供給され、配線２３には電
位ＶＤＤが供給され、配線２５には電位Ｖｉ３が供給される。よって、期間Ｔ１３では、
容量素子１０２に閾値電圧Ｖｔｈが保持され、容量素子１０３に電圧Ｖｓｉｇ−Ｖｉ３が
保持され、発光素子１０４ａのアノードは電位Ｖｉ３となり、トランジスタ１０１のゲー
トの電位は電位Ｖｓｉｇ＋Ｖｔｈとなり、トランジスタ１０１のゲートソース間電圧（Ｖ
ｇｓ１０１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ３となる。また、スイッチ１４が非導通状態
であってもよい。
期間Ｔ１４において行われる第４の動作について説明する。期間Ｔ１４では、図７２（Ｄ
）に示すように、スイッチ１１、スイッチ１２、スイッチ１３、及びスイッチ１４が非導
通状態となる。また、配線２３には電位ＶＤＤが供給される。よって、期間Ｔ１４では、
容量素子１０２に閾値電圧Ｖｔｈが保持され、容量素子１０３に電圧Ｖｓｉｇ−Ｖｉ３が
保持され、発光素子１０４ａのアノードは電位Ｖｅｌとなり、トランジスタ１０１のゲー
トの電位は電位Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ３＋Ｖｅｌとなり、トランジスタ１０１のゲート
ソース間電圧（Ｖｇｓ１０１）は電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ３となる。
なお、電位Ｖｅｌは、トランジスタ１０１を介して、発光素子１０４ａに電流を流す際に
設定される電位である。具体的には、電位ＶＤＤと電位Ｖｃａｔの間の電位に設定される
こととなる。
上記第４の動作では、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）を、電
圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ３とし、トランジスタ１０１の閾値電圧Ｖｔｈを加味した値に
設定することができる。従って、上記構成により、トランジスタ１０１の閾値電圧Ｖｔｈ
のばらつきが、発光素子１０４ａに供給する電流値に影響を及ぼすのを防ぐことができる
。または、トランジスタ１０１が劣化して、閾値電圧Ｖｔｈが変化しても、上記変化が発
光素子１０４ａに供給する電流値に影響を及ぼすのを防ぐことができる。よって、表示ム
ラを低減でき、質の良い表示を行うことができる。
なお、本発明の一態様に係る半導体装置では、第２の動作において、トランジスタ１０１
のゲートを電位Ｖｉ２に保つ。上記動作により、トランジスタ１０１がノーマリオンであ
っても、すなわち閾値電圧Ｖｔｈがマイナスの値を有していても、トランジスタ１０１に
おいて、ソースの電位がゲートの電位Ｖｉ２よりも高くなるまで容量素子１０２に蓄積さ
れている電荷を放出することができる。よって、本発明の一態様に係る半導体装置では、
トランジスタ１０１がノーマリオンであっても、上記第４の動作において、トランジスタ
１０１の閾値電圧Ｖｔｈを加味した値になるよう、トランジスタ１０１のゲートソース間
電圧（Ｖｇｓ１０１）を設定することができる。
本実施の形態は、ある配線を、他の様々な配線、例えば、配線２１、配線２２、配線２３
、配線２４、配線２５、配線２６、配線２７、または、別の回路１００の配線、走査線、
ゲート線、トランジスタのゲートと接続された配線などに接続させた場合について示した
。これにより、配線の数を減らすことが出来る。または、ある回路１００に、別のスイッ
チや別の素子、例えば、スイッチ９１４、スイッチ８１４、スイッチ１４、容量素子１０
５などを追加した構成について示した。つまり、本実施の形態は、他の実施の形態の一部
または全部について、変更、追加、修正、削除、応用、上位概念化、又は、下位概念化し
たものに相当する。したがって、本実施の形態の一部または全部について、他の実施の形
態の一部または全部と自由に組み合わせる、適用する、或いは置き換えて実施することが
できる。
（実施の形態４）
図７４乃至図７６に、本発明の一態様に係る半導体装置における、各種配線の配置例を示
す。
図７４（Ａ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１及び一の配線２３を共有している。また、ｉ＋１列ｊ行
目の回路１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）
が、一の配線２１及び一の配線２３を共有している。
図７４（Ｂ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ＋１列ｊ行目の回路１
００（ｉ＋１、ｊ）が、一の配線２３を共有している。また、ｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線
２３を共有している。
図７４（Ｃ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ＋１列ｊ行目の回路１
００（ｉ＋１、ｊ）が、一の配線２３を共有している。また、ｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線
２３を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回
路１００（ｉ、ｊ＋１）が、一の配線２３を共有している。また、ｉ＋１列ｊ行目の回路
１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の
配線２３を共有している。そして、これらの配線２３は、互いに接続されている。
図７４（Ｄ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）、ｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）、及びｉ＋１列ｊ＋１行
目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２３を共有している。そして、配線２３
は、配線２１と並んで配置されている。
図７４（Ｅ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）、ｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）、及びｉ＋１列ｊ＋１行
目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２３を共有している。そして、配線２３
は、配線２１と交差するように配置されている。
図７４（Ｆ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）、ｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）、及びｉ＋１列ｊ＋１行
目の回路１００（ｉ＋１、ｊ＋１）が、２つの配線２３を共有している。そして、上記２
つの配線２３は、交差するように配置されており、互いに接続されている。
図７５（Ａ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１、一の配線２２、及び一の配線２３を共有している。ま
た、ｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（
ｉ＋１、ｊ＋１）が、一の配線２１、一の配線２２、及び一の配線２３を共有している。
図７５（Ｂ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１及び一の配線２２を共有している。また、ｉ＋１列ｊ行
目の回路１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）
が、一の配線２１及び一の配線２２を共有している。また、ｉ列ｊ行目の回路１００（ｉ
、ｊ）及びｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）が、一の配線２３を共有している
。また、ｉ列ｊ＋１行目の回路１００（ｉ、ｊ＋１）及びｉ＋１列ｊ＋１行目の回路１０
０（ｉ＋１、ｊ＋１）が、一の配線２３を共有している。
図７５（Ｃ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１及び一の配線２３を共有している。また、ｉ＋１列ｊ行
目の回路１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）
が、一の配線２１及び一の配線２３を共有している。また、ｉ列ｊ行目の回路１００（ｉ
、ｊ）及びｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）が、一の配線２２を共有している
。また、ｉ列ｊ＋１行目の回路１００（ｉ、ｊ＋１）及びｉ＋１列ｊ＋１行目の回路１０
０（ｉ＋１、ｊ＋１）が、一の配線２２を共有している。
図７５（Ｄ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ＋１列ｊ行目の回路１
００（ｉ＋１、ｊ）が、一の配線２２及び一の配線２３を共有している。また、ｉ列ｊ＋
１行目の回路１００（ｉ、ｊ＋１）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋
１）が、一の配線２２及び一の配線２３を共有している。
図７５（Ｅ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１及び一の配線２３を共有している。また、ｉ＋１列ｊ行
目の回路１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）
が、一の配線２１及び一の配線２３を共有している。また、ｉ列ｊ行目の回路１００（ｉ
、ｊ）及びｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）が、一の配線２２及び一の配線２
３を共有している。また、ｉ列ｊ＋１行目の回路１００（ｉ、ｊ＋１）及びｉ＋１列ｊ＋
１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２２及び一の配線２３を共有してい
る。そして、これらの配線２３は、互いに接続されている。
図７６（Ａ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１及び一の配線２２を共有している。また、ｉ＋１列ｊ行
目の回路１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）
が、一の配線２１及び一の配線２２を共有している。また、ｉ列ｊ行目の回路１００（ｉ
、ｊ）、ｉ列ｊ＋１行目の回路１００（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ
＋１、ｊ）、及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２３
を共有している。そして、配線２３は、配線２１及び配線２２と並んで配置されている。
図７６（Ｂ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１及び一の配線２３を共有している。また、ｉ＋１列ｊ行
目の回路１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）
が、一の配線２１及び一の配線２３を共有している。また、ｉ列ｊ行目の回路１００（ｉ
、ｊ）、ｉ列ｊ＋１行目の回路１００（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ
＋１、ｊ）、及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２２
を共有している。そして、配線２２は、配線２１及び配線２３と並んで配置されている。
図７６（Ｃ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）、ｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）、及びｉ＋１列ｊ＋１行
目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２２及び一の配線２３を共有している。
そして、配線２２及び配線２３は、配線２１と並んで配置されている。
図７６（Ｄ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）、ｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）、及びｉ＋１列ｊ＋１行
目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２２及び一の配線２３を共有している。
そして、配線２２及び配線２３は、配線２１と交差するように配置されている。
図７６（Ｅ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００（
ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２１
を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）、ｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）、及びｉ＋１列ｊ＋１行
目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２２及び一の配線２３を共有している。
そして、配線２２は、配線２１と交差するように配置されている。また、配線２３は、配
線２１と並んで配置されている。
図７６（Ｆ） では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１０
０（ｉ、ｊ＋１）が、一の配線２１を共有している。また、ｉ＋１列ｊ行目の回路１００
（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２
１を共有している。また、ｉ列ｊ行目の回路１００（ｉ、ｊ）、ｉ列ｊ＋１行目の回路１
００（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ＋１、ｊ）、及びｉ＋１列ｊ＋１
行目の回路１００（ｉ＋１、ｊ＋１）が、一の配線２２及び一の配線２３を共有している
。そして、配線２３は、配線２１と交差するように配置されている。また、配線２２は、
配線２１と並んで配置されている。
図７６（Ｇ）では、ｉ列ｊ行目の回路１００（ｉ、ｊ）及びｉ列ｊ＋１行目の回路１００
（ｉ、ｊ＋１）が、一の配線２１及び一の配線２２を共有している。また、ｉ＋１列ｊ行
目の回路１００（ｉ＋１、ｊ）及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）
が、一の配線２１及び一の配線２２を共有している。また、ｉ列ｊ行目の回路１００（ｉ
、ｊ）、ｉ列ｊ＋１行目の回路１００（ｉ、ｊ＋１）、ｉ＋１列ｊ行目の回路１００（ｉ
＋１、ｊ）、及びｉ＋１列ｊ＋１行目の回路１００（ｉ＋１、ｊ＋１）が、２つの配線２
３を共有している。そして、上記２つの配線２３は、交差するように配置されており、互
いに接続されている。
本実施の形態は、他の実施の形態の一部または全部について、変更、追加、修正、削除、
応用、上位概念化、又は、下位概念化したものに相当する。したがって、本実施の形態の
一部または全部について、他の実施の形態の一部または全部と自由に組み合わせる、適用
する、或いは置き換えて実施することができる。
（実施の形態５）
図１３（Ａ）に示した回路１００の上面図を、一例として図７７に示す。
図７７において、半導体膜３００は、トランジスタ１１ｔの活性層、容量素子１０２の一
方の電極、容量素子１０３の一方の電極、トランジスタ１３ｔの活性層、トランジスタ１
４ｔの活性層、トランジスタ１０１の活性層として、機能する。半導体膜３０１は、トラ
ンジスタ１２ｔの活性層として機能する。導電膜３０２は、容量素子１０２の他方の電極
として機能する。導電膜３０３は、容量素子１０３の他方の電極として機能する。導電膜
３０４は、トランジスタ１３ｔのゲートとして機能する。
導電膜３０５は、配線２２と、トランジスタ１２ｔのソースまたはドレインの一方とに接
続されている。導電膜３０６は、トランジスタ１２ｔのソースまたはドレインの他方と、
導電膜３０２とに接続されている。導電膜３０７は、導電膜３０４と、配線３３とに接続
されている。導電膜３０８は、導電膜３０３と、トランジスタ１０１のソースまたはドレ
インの一方と、トランジスタ１３ｔのソースまたはドレインの一方と、トランジスタ１４
ｔのソースまたはドレインの一方とに接続されている。導電膜３０９は、トランジスタ１
４ｔのソースまたはドレインの他方と、配線２５とに接続されている。
なお、図１３（Ｂ）の場合は、導電膜３０８に接続されるように負荷１０４を設ければよ
い。また、図１３（Ｃ）の場合は、導電膜３０８に接続されるように発光素子１０４ａの
陽極を設ければよい。また、図１３（Ｄ）の場合は、導電膜３０８に接続されるように発
光素子１０４ｂの陰極を設ければよい。
次いで、図１３（Ａ）に示した回路１００の上面図を、一例として図７８に示す。
図７８において、半導体膜３２０は、トランジスタ１１ｔの活性層として機能する。半導
体膜３２１は、トランジスタ１２ｔの活性層として機能する。半導体膜３２２は、トラン
ジスタ１３ｔの活性層として機能する。半導体膜３２３は、トランジスタ１４ｔの活性層
として機能する。半導体膜３３３は、トランジスタ１０１の活性層として機能する。
導電膜３２４は、容量素子１０２の他方の電極、及びトランジスタ１０１のゲートとして
機能する。導電膜３２５は、容量素子１０３の他方の電極として機能する。導電膜３２６
は、トランジスタ１３ｔのゲートとして機能する。
導電膜３２７は、容量素子１０２の一方の電極、及び容量素子１０３の一方の電極として
機能し、トランジスタ１１ｔのソースまたはドレインの一方に接続されている。導電膜３
２８は、配線２２と、トランジスタ１２ｔのソースまたはドレインの一方とに接続されて
いる。導電膜３２９は、トランジスタ１２ｔのソースまたはドレインの他方と、導電膜３
２４とに接続されている。導電膜３３０は、導電膜３２６と、配線３３とに接続されてい
る。導電膜３３１は、導電膜３２５と、トランジスタ１０１のソースまたはドレインの一
方と、トランジスタ１３ｔのソースまたはドレインの一方と、トランジスタ１４ｔのソー
スまたはドレインの一方とに接続されている。導電膜３３２は、トランジスタ１４ｔのソ
ースまたはドレインの他方と、配線２５とに接続されている。
なお、図１３（Ｂ）の場合は、導電膜３３１に接続されるように負荷１０４を設ければよ
い。また、図１３（Ｃ）の場合は、導電膜３３１に接続されるように発光素子１０４ａの
陽極を設ければよい。また、図１３（Ｄ）の場合は、導電膜３３１に接続されるように発
光素子１０４ｂの陰極を設ければよい。
また、図７８の破線Ａ１−Ａ２における断面図の一例を、図８０（Ａ）に示す。図７８の
破線Ｂ１−Ｂ２における断面図の一例を、図８０（Ｂ）に示す。図８０では、基板８００
上に絶縁膜８０１が形成されており、絶縁膜８０１上に配線３１、導電膜３２４、及び導
電膜３２５が形成されている。また、配線３１、導電膜３２４、及び導電膜３２５上には
絶縁膜８０２が形成されている。
絶縁膜８０２上において導電膜３２５と重なる位置に、導電膜３２７が形成されている。
導電膜３２５と、絶縁膜８０２と、導電膜３２７とが重なる部分が、容量素子１０３とし
て機能する。絶縁膜８０２上において導電膜３２４と重なる位置に、導電膜３２７が形成
されている。導電膜３２４と、絶縁膜８０２と、導電膜３２７とが重なる部分が、容量素
子１０２として機能する。絶縁膜８０２上において導電膜３２４と重なる位置に、半導体
膜３３３が形成されている。半導体膜３３３上には配線２３及び導電膜３３１が形成され
ている。
そして、絶縁膜８０２と、その上に位置する導電膜３２７、半導体膜３３３、配線２３、
及び導電膜３３１を覆うように、絶縁膜８０３が形成されている。
次いで、図１３（Ａ）に示した回路１００の上面図を、一例として図７９に示す。図７９
は、配線２３のうち、半導体膜３３３と重なる部分の形状と、導電膜３３１のうち、半導
体膜３３３と重なる部分の形状とが、図７８に示した上面図と異なる。具体的には、図７
８では、配線２３のうち半導体膜３３３と重なる部分が、Ｕ字形状を有している。そして
、導電膜３３１のうち半導体膜３３３と重なる部分が、配線２３によって部分的に囲われ
るように、配線２３のＵ字形状の曲部内側に位置する。図７９では、導電膜３３１のうち
半導体膜３３３と重なる部分が、Ｕ字形状を有している。そして、配線２３のうち半導体
膜３３３と重なる部分が、導電膜３３１によって部分的に囲われるように、導電膜３３１
のＵ字形状の曲部内側に位置する。
トランジスタ１０１のソースまたはドレインに接する導電膜や配線がＵ字形状を有してい
る場合、半導体膜３３３の面積が小さくても、大きなチャネル幅を確保することができる
。よって、半導体膜３３３の面積を小さく抑えつつも、オン電流を高めることができる。
なお、様々な基板を用いて、トランジスタを形成することが出来る。基板の種類は、特定
のものに限定されることはない。その基板の一例としては、半導体基板（例えば単結晶基
板又はシリコン基板）、ＳＯＩ基板、ガラス基板、石英基板、プラスチック基板、金属基
板、ステンレス・スチル基板、ステンレス・スチル・ホイルを有する基板、タングステン
基板、タングステン・ホイルを有する基板、可撓性基板、貼り合わせフィルム、繊維状の
材料を含む紙、又は基材フィルムなどがある。ガラス基板の一例としては、バリウムホウ
ケイ酸ガラス、アルミノホウケイ酸ガラス、又はソーダライムガラスなどがある。可撓性
基板の一例としては、ポリエチレンテレフタレート（ＰＥＴ）、ポリエチレンナフタレー
ト（ＰＥＮ）、ポリエーテルサルフォン（ＰＥＳ）に代表されるプラスチック、又はアク
リル等の可撓性を有する合成樹脂などがある。貼り合わせフィルムの一例としては、ポリ
プロピレン、ポリエステル、ビニル、ポリフッ化ビニル、又は塩化ビニルなどがある。基
材フィルムの一例としては、ポリエステル、ポリアミド、ポリイミド、無機蒸着フィルム
、又は紙類などがある。特に、半導体基板、単結晶基板、又はＳＯＩ基板などを用いてト
ランジスタを製造することによって、特性、サイズ、又は形状などのばらつきが少なく、
電流能力が高く、サイズの小さいトランジスタを製造することができる。このようなトラ
ンジスタによって回路を構成すると、回路の低消費電力化、又は回路の高集積化を図るこ
とができる。
なお、ある基板を用いてトランジスタを形成し、その後、別の基板にトランジスタを転置
し、別の基板上にトランジスタを配置してもよい。トランジスタが転置される基板の一例
としては、上述したトランジスタを形成することが可能な基板に加え、紙基板、セロファ
ン基板、石材基板、木材基板、布基板（天然繊維（絹、綿、麻）、合成繊維（ナイロン、
ポリウレタン、ポリエステル）若しくは再生繊維（アセテート、キュプラ、レーヨン、再
生ポリエステル）などを含む）、皮革基板、又はゴム基板などがある。これらの基板を用
いることにより、特性のよいトランジスタの形成、消費電力の小さいトランジスタの形成
、壊れにくい装置の製造、耐熱性の付与、軽量化、又は薄型化を図ることができる。
本実施の形態は、他の実施の形態の一部または全部について、変更、追加、修正、削除、
応用、上位概念化、又は、下位概念化したものに相当する。したがって、本実施の形態の
一部または全部について、他の実施の形態の一部または全部と自由に組み合わせる、適用
する、或いは置き換えて実施することができる。
（実施の形態６）
本実施の形態では、本発明の一態様に係る半導体装置において用いられる、トランジスタ
の具体的な構成の一例について説明する。
図８１（Ａ）に示すトランジスタは、半導体膜５０１と、半導体膜５０１上の絶縁膜５０
２と、絶縁膜５０２を間に挟んで半導体膜５０１と重なる位置に設けられた、ゲートとし
て機能する電極５０３と、半導体膜５０１に接する導電膜５０４及び導電膜５０５とを有
する。そして、半導体膜５０１は、チャネル形成領域として機能する第１の領域５０６と
、ソースまたはドレインとして機能する第２の領域５０７及び第２の領域５０８とを有す
る。第２の領域５０７及び第２の領域５０８は、第１の領域５０６を間に挟んでいる。な
お、図８１（Ａ）では、半導体膜５０１が、第１の領域５０６と第２の領域５０７及び第
２の領域５０８との間に、ＬＤＤ領域として機能する第３の領域５０９及び第３の領域５
１０を有している場合を一例として示している。
なお、図８１（Ａ）では、薄膜の半導体膜５０１を有するトランジスタを一例として示し
ているが、本発明の一態様では、バルクの半導体基板にチャネル形成領域を有したトラン
ジスタを用いていても良い。薄膜の半導体膜としては、例えば、非晶質半導体、多結晶半
導体、単結晶半導体などを用いることができる。また、半導体膜５０１は、シリコン、ゲ
ルマニウム、シリコンゲルマニウム、酸化物半導体など、各種の半導体を用いることがで
きる。
図８１（Ｂ）に示すトランジスタは、第１の酸化絶縁膜５２０ａ、第２の酸化絶縁膜５２
０ｂ、及び第３の酸化絶縁膜５２０ｃを有する絶縁膜５２０上に設けられている。
第１の酸化絶縁膜５２０ａ及び第３の酸化絶縁膜５２０ｃは、加熱により一部の酸素が脱
離する酸化絶縁膜を用いて形成する。加熱により一部の酸素が脱離する酸化絶縁膜として
は、化学量論的組成を満たす酸素よりも多くの酸素を含む絶縁膜を用いることが好ましい
。第１の酸化絶縁膜５２０ａ及び第３の酸化絶縁膜５２０ｃとして、酸化シリコン、酸化
窒化シリコン、窒化酸化シリコン、酸化ガリウム、酸化ハフニウム、酸化イットリウム等
を用いることができる。
第２の酸化絶縁膜５２０ｂは、酸素の拡散を防ぐ酸化絶縁膜で形成する。第２の酸化絶縁
膜５２０ｂの一例としては、酸化アルミニウム、酸化窒化アルミニウム等がある。なお、
酸化アルミニウムは、化学量論的組成を満たす酸素を含む酸化アルミニウム、または化学
量論的組成を満たす酸素よりも多くの酸素を含む酸化アルミニウム（ＡｌＯｘ、ｘは３／
２以上）とすることが好ましい。また、酸化窒化アルミニウムは、化学量論的組成を満た
す酸素を含む酸化アルミニウムの一部の酸素が窒素で置換されている。
そして、トランジスタは、半導体膜５２１と、半導体膜５２１上の絶縁膜５２２と、絶縁
膜５２２を間に挟んで半導体膜５２１と重なる位置に設けられた、ゲートとして機能する
電極５２３と、半導体膜５２１に接する導電膜５２４及び導電膜５２５とを有する。半導
体膜５２１は、電極５２３と重なり、少なくとも一部がチャネル形成領域として機能する
第１の領域５２６と、ソースまたはドレインとして機能し、第１の領域５２６を挟む第２
の領域５５０及び第２の領域５５１とを有している。
半導体膜５２１には、例えば、非晶質半導体、多結晶半導体、単結晶半導体などを用いる
ことができる。また、半導体膜５２１には、シリコン、ゲルマニウム、シリコンゲルマニ
ウム、酸化物半導体など、各種の半導体を用いることができる。
トランジスタは、電極５２３の側部に、絶縁膜を有するサイドウォール５２７が設けられ
ており、電極５２３の上部に、絶縁膜５２８が設けられている。そして、導電膜５２４及
び導電膜５２５は、その一部がサイドウォール５２７に接している。導電膜５２４及び導
電膜５２５は必ずしもサイドウォール５２７に接している必要は無いが、サイドウォール
５２７に接するように導電膜５２４及び導電膜５２５を形成することで、導電膜５２４及
び導電膜５２５の位置が多少ずれて形成されたとしても、導電膜５２４及び導電膜５２５
と半導体膜５２１との接する面積が、変動するのを防ぐことができる。よって、導電膜５
２４及び導電膜５２５の位置がずれることによる、トランジスタのオン電流の変動を防ぐ
ことができる。
なお、電極５２３の上部に位置する絶縁膜５２８は必ずしも設ける必要は無いが、絶縁膜
５２８を設けることで、導電膜５２４及び導電膜５２５の位置がずれて形成され、電極５
２３の上部にかかっても、導電膜５２４及び導電膜５２５と電極５２３が導通するのを防
ぐことができる。
絶縁膜５２０では、下層に位置する第３の酸化絶縁膜５２０ｃ上に、第１の酸化絶縁膜５
２０ａと、第２の酸化絶縁膜５２０ｂとが順に積層するように設けられている。そして、
第１の酸化絶縁膜５２０ａ及び第２の酸化絶縁膜５２０ｂには開口部５２９が設けられて
おり、上記開口部５２９には、トランジスタが有する半導体膜５２１が設けられている。
そして、第１の酸化絶縁膜５２０ａは、半導体膜５２１の端部に接するように、半導体膜
５２１の周囲に設けられている。また、第２の酸化絶縁膜５２０ｂは、第１の酸化絶縁膜
５２０ａを間に挟んで半導体膜５２１の周囲に設けられている。第３の酸化絶縁膜５２０
ｃは、半導体膜５２１の下部に設けられている。
なお、半導体膜５２１が酸化物半導体である場合、上記構成の絶縁膜５２０を用いること
により、加熱により第１の酸化絶縁膜５２０ａから放出された酸素が、第２の酸化絶縁膜
５２０ｂを通過するのを抑制することができるので、上記酸素が第１の領域５２６におけ
る半導体膜５２１の端部に効率よく供給される。また、第３の酸化絶縁膜５２０ｃから放
出された酸素は、半導体膜５２１の下部に供給される。なお、酸化物半導体をチャネル形
成領域に有するトランジスタは、半導体膜５２１を所望の形状にエッチングするためのエ
ッチング処理、半導体膜５２１の端部の減圧雰囲気における暴露等により、半導体膜５２
１の端部において酸素の脱離による酸素欠損が形成されやすい。そして、酸素欠損はキャ
リアの移動経路となるため、半導体膜５２１の端部に酸素欠損が形成されると、寄生チャ
ネルが生じ、それによりトランジスタのオフ電流が高まる。しかし、上記構成により、第
１の領域５２６における半導体膜５２１の端部に酸素欠損が形成されるのを防ぎ、オフ電
流を低減させることができる。
なお、「加熱により一部の酸素が脱離する」とは、ＴＤＳ（Ｔｈｅｒｍａｌ Ｄｅｓｏｒ
ｐｔｉｏｎ Ｓｐｅｃｔｒｏｓｃｏｐｙ：昇温脱離ガス分光法）分析にて、酸素原子に換
算しての酸素の放出量が１．０×１０１８ａｔｏｍｓ／ｃｍ３以上、好ましくは３．０×
１０２０ａｔｏｍｓ／ｃｍ３以上であることをいう。
以下、ＴＤＳ分析にて、酸素原子に換算しての酸素の脱離量の測定方法について説明する
。
ＴＤＳ分析したときの気体の脱離量は、スペクトルの積分値に比例する。このため、絶縁
膜のスペクトルの積分値と、標準試料の基準値に対する比とにより、気体の放出量を計算
することができる。標準試料の基準値とは、所定の原子を含む試料の、スペクトルの積分
値に対する原子の密度の割合である。
例えば、標準試料である所定の密度の水素を含むシリコンウェハのＴＤＳ分析結果、及び
絶縁膜のＴＤＳ分析結果から、絶縁膜の酸素分子の脱離量（ＮＯ２）は、下記の式１で求
めることができる。質量数３２のものとしてＣＨ３ＯＨがあるが、絶縁膜中に存在する可
能性は低い。よって、ＴＤＳ分析で得られる質量数３２で検出されるスペクトルの全ては
、酸素分子由来であると仮定する。また、酸素原子の同位体である質量数１７の酸素原子
及び質量数１８の酸素原子を含む酸素分子についても、自然界における存在比率が極微量
であるため、存在しないものと仮定する。
ＮＯ２＝ＮＨ２／ＳＨ２×ＳＯ２×α （式１）
ＮＨ２は、標準試料から脱離した水素分子を密度で換算した値である。ＳＨ２は、標準試
料をＴＤＳ分析したときのスペクトルの積分値である。標準試料の基準値は、ＮＨ２／Ｓ
Ｈ２とする。ＳＯ２は、絶縁膜をＴＤＳ分析したときのスペクトルの積分値である。αは
、ＴＤＳ分析におけるスペクトル強度に影響する係数である。式１の詳細に関しては、特
開平６−２７５６９７公報を参照する。なお、上記絶縁膜の酸素の脱離量は、電子科学株
式会社製の昇温脱離分析装置ＥＭＤ−ＷＡ１０００Ｓ／Ｗを用い、標準試料として１×１
０１６ａｔｏｍｓ／ｃｍ２の水素原子を含むシリコンウェハを用いて測定する。
また、ＴＤＳ分析において、一部の酸素は酸素原子として検出される。酸素分子と酸素原
子の比率は、酸素分子のイオン化率から算出することができる。なお、上述のαは酸素分
子のイオン化率を含むため、酸素分子の放出量を評価することで、酸素原子の脱離量につ
いても見積もることができる。
なお、ＮＯ２は酸素分子の脱離量である。絶縁膜においては、酸素原子に換算したときの
酸素の放出量は、酸素分子の脱離量の２倍となる。
上記構成において、加熱により酸素放出される絶縁膜は、酸素が過剰な酸化シリコン（Ｓ
ｉＯＸ（Ｘ＞２））であってもよい。酸素が過剰な酸化シリコン（ＳｉＯＸ（Ｘ＞２））
とは、シリコン原子数の２倍より多い酸素原子を単位体積当たりに含むものである。単位
体積当たりのシリコン原子数及び酸素原子数は、ラザフォード後方散乱法により測定した
値である。
図８１（Ｃ）に示すトランジスタは、第１の酸化絶縁膜５３０ａ及び第２の酸化絶縁膜５
３０ｂを有する絶縁膜５３０上に設けられている。
第１の酸化絶縁膜５３０ａは、加熱により一部の酸素が脱離する酸化絶縁膜を用いて形成
する。加熱により一部の酸素が脱離する酸化絶縁膜としては、化学量論的組成を満たす酸
素よりも多くの酸素を含む絶縁膜を用いることが好ましい。第１の酸化絶縁膜５３０ａと
して、酸化シリコン、酸化窒化シリコン、窒化酸化シリコン、酸化ガリウム、酸化ハフニ
ウム、酸化イットリウム等を用いることができる。
第２の酸化絶縁膜５３０ｂは、酸素の拡散を防ぐ酸化絶縁膜で形成する。第２の酸化絶縁
膜５３０ｂの一例としては、酸化アルミニウム、酸化窒化アルミニウム等がある。なお、
酸化アルミニウムは、化学量論的組成を満たす酸素を含む酸化アルミニウム、または化学
量論的組成を満たす酸素よりも多くの酸素を含む酸化アルミニウム（ＡｌＯｘ、ｘは３／
２以上）とすることが好ましい。また、酸化窒化アルミニウムは、化学量論的組成を満た
す酸素を含む酸化アルミニウムの一部の酸素が窒素で置換されている。
トランジスタは、絶縁膜５３０上に位置する半導体膜５３１と、半導体膜５３１上の絶縁
膜５３２と、絶縁膜５３２を間に挟んで半導体膜５３１と重なる位置に設けられた、ゲー
トとして機能する電極５３３と、半導体膜５３１に接続された導電膜５３４及び導電膜５
３５とを有する。半導体膜５３１は、電極５３３と重なり、少なくとも一部がチャネル形
成領域として機能する第１の領域５３６と、ソースまたはドレインとして機能し、第１の
領域５３６を挟む第２の領域５３７及び第２の領域５３８とを有している。
半導体膜５３１には、例えば、非晶質半導体、多結晶半導体、単結晶半導体などを用いる
ことができる。また、半導体膜５３１には、シリコン、ゲルマニウム、シリコンゲルマニ
ウム、酸化物半導体など、各種の半導体を用いることができる。
そして、トランジスタは、電極５３３の側部に、絶縁膜を有するサイドウォール５３９が
設けられており、電極５３３の上部に、絶縁膜５４０が設けられている。そして、導電膜
５３４及び導電膜５３５は、その一部がサイドウォール５３９に接している。導電膜５３
４及び導電膜５３５は必ずしもサイドウォール５３９に接している必要は無いが、サイド
ウォール５３９に接するように導電膜５３４及び導電膜５３５を形成することで、導電膜
５３４及び導電膜５３５の位置が多少ずれて形成されたとしても、導電膜５３４及び導電
膜５３５と半導体膜５３１との接する面積が、変動するのを防ぐことができる。よって、
導電膜５３４及び導電膜５３５の位置がずれることによる、トランジスタのオン電流の変
動を防ぐことができる。
なお、電極５３３の上部に位置する絶縁膜５４０は必ずしも設ける必要は無いが、絶縁膜
５４０を設けることで、導電膜５３４及び導電膜５３５の位置がずれて形成され、電極５
３３の上部にかかっても、導電膜５３４及び導電膜５３５と電極５３３が導通するのを防
ぐことができる。
そして、絶縁膜５３０は、第１の酸化絶縁膜５３０ａの周囲に第２の酸化絶縁膜５３０ｂ
が設けられている。そして、半導体膜５３１は、第１の領域５３６において上記第１の酸
化絶縁膜５３０ａに接し、第２の領域５３７及び第２の領域５３８において第１の酸化絶
縁膜５３０ａ及び第２の酸化絶縁膜５３０ｂに接する。
なお、半導体膜５３１が酸化物半導体である場合、上記構成により、加熱により第１の酸
化絶縁膜５３０ａから放出された酸素が、第２の酸化絶縁膜５３０ｂを通過するのを抑制
することができるので、上記酸素が第１の領域５３６における半導体膜５３１の端部に効
率よく供給される。なお、酸化物半導体をチャネル形成領域に有するトランジスタは、半
導体膜５３１を所望の形状にエッチングするためのエッチング処理、半導体膜５３１の端
部の減圧雰囲気における暴露等により、半導体膜５３１の端部において酸素の脱離による
酸素欠損が形成されやすい。そして、酸素欠損はキャリアの移動経路となるため、半導体
膜５３１の端部に酸素欠損が形成されると、寄生チャネルが生じ、それによりトランジス
タのオフ電流が高まる。しかし、本発明の一態様では、上記構成により、第１の領域５３
６における半導体膜５３１の端部に酸素欠損が形成されるのを防ぎ、オフ電流を低減させ
ることができる。
なお、電子供与体（ドナー）となる水分または水素などの不純物が低減され、なおかつ酸
素欠損が低減されることにより高純度化された酸化物半導体（ｐｕｒｉｆｉｅｄ Ｏｘｉ
ｄｅ Ｓｅｍｉｃｏｎｄｕｃｔｏｒ）は、ｉ型（真性半導体）又はｉ型に限りなく近い。
そのため、上記酸化物半導体を用いたトランジスタは、オフ電流が著しく低いという特性
を有する。また、酸化物半導体のバンドギャップは、２ｅＶ以上、好ましくは２．５ｅＶ
以上、より好ましくは３ｅＶ以上である。水分または水素などの不純物濃度が十分に低減
され、なおかつ酸素欠損が低減されることにより高純度化された酸化物半導体膜を用いる
ことにより、トランジスタのオフ電流を下げることができる。
具体的に、高純度化された酸化物半導体膜をチャネル形成領域に用いたトランジスタのオ
フ電流が低いことは、いろいろな実験により証明できる。例えば、チャネル幅が１×１０
６μｍでチャネル長が１０μｍの素子であっても、ソース電極とドレイン電極間の電圧（
ドレイン電圧）が１Ｖから１０Ｖの範囲において、オフ電流が、半導体パラメータアナラ
イザの測定限界以下、すなわち１×１０−１３Ａ以下という特性を得ることができる。こ
の場合、トランジスタのチャネル幅で規格化したオフ電流は、１００ｚＡ／μｍ以下であ
ることが分かる。また、容量素子とトランジスタとを接続して、容量素子に流入または容
量素子から流出する電荷を当該トランジスタで制御する回路を用いて、オフ電流の測定を
行った。当該測定では、高純度化された酸化物半導体膜を上記トランジスタのチャネル形
成領域に用い、容量素子の単位時間あたりの電荷量の推移から当該トランジスタのオフ電
流を測定した。その結果、トランジスタのソース電極とドレイン電極間の電圧が３Ｖの場
合に、数十ｙＡ／μｍという、さらに低いオフ電流が得られることが分かった。従って、
高純度化された酸化物半導体膜をチャネル形成領域に用いたトランジスタは、オフ電流が
、結晶性を有するシリコンを用いたトランジスタに比べて著しく低い。
なお、酸化物半導体としては、好ましくはＩｎまたはＺｎを含有する酸化物を用いるとよ
く、さらに好ましくは、Ｉｎ及びＧａを含有する酸化物、またはＩｎ及びＺｎを含有する
酸化物を用いるとよい。酸化物半導体膜をｉ型（真性）とするため、後に説明する脱水化
または脱水素化は有効である。また、酸化物半導体を用いたトランジスタの電気特性のば
らつきを低減するためのスタビライザーとして、それらに加えてガリウム（Ｇａ）を含む
ことが好ましい。また、スタビライザーとしてスズ（Ｓｎ）を含むことが好ましい。また
、スタビライザーとしてハフニウム（Ｈｆ）を含むことが好ましい。また、スタビライザ
ーとしてアルミニウム（Ａｌ）を含むことが好ましい。また、スタビライザーとしてジル
コニウム（Ｚｒ）を含むことが好ましい。
また、他のスタビライザーとして、ランタノイドである、ランタン（Ｌａ）、セリウム（
Ｃｅ）、プラセオジム（Ｐｒ）、ネオジム（Ｎｄ）、サマリウム（Ｓｍ）、ユウロピウム
（Ｅｕ）、ガドリニウム（Ｇｄ）、テルビウム（Ｔｂ）、ジスプロシウム（Ｄｙ）、ホル
ミウム（Ｈｏ）、エルビウム（Ｅｒ）、ツリウム（Ｔｍ）、イッテルビウム（Ｙｂ）、ル
テチウム（Ｌｕ）のいずれか一種または複数種を含んでいてもよい。
例えば、酸化物半導体として、酸化インジウム、酸化スズ、酸化亜鉛、二元系金属の酸化
物であるＩｎ−Ｚｎ系酸化物、Ｓｎ−Ｚｎ系酸化物、Ａｌ−Ｚｎ系酸化物、Ｚｎ−Ｍｇ系
酸化物、Ｓｎ−Ｍｇ系酸化物、Ｉｎ−Ｍｇ系酸化物、Ｉｎ−Ｇａ系酸化物、三元系金属の
酸化物であるＩｎ−Ｇａ−Ｚｎ系酸化物（ＩＧＺＯとも表記する）、Ｉｎ−Ａｌ−Ｚｎ系
酸化物、Ｉｎ−Ｓｎ−Ｚｎ系酸化物、Ｓｎ−Ｇａ−Ｚｎ系酸化物、Ａｌ−Ｇａ−Ｚｎ系酸
化物、Ｓｎ−Ａｌ−Ｚｎ系酸化物、Ｉｎ−Ｈｆ−Ｚｎ系酸化物、Ｉｎ−Ｌａ−Ｚｎ系酸化
物、Ｉｎ−Ｃｅ−Ｚｎ系酸化物、Ｉｎ−Ｐｒ−Ｚｎ系酸化物、Ｉｎ−Ｎｄ−Ｚｎ系酸化物
、Ｉｎ−Ｓｍ−Ｚｎ系酸化物、Ｉｎ−Ｅｕ−Ｚｎ系酸化物、Ｉｎ−Ｇｄ−Ｚｎ系酸化物、
Ｉｎ−Ｔｂ−Ｚｎ系酸化物、Ｉｎ−Ｄｙ−Ｚｎ系酸化物、Ｉｎ−Ｈｏ−Ｚｎ系酸化物、Ｉ
ｎ−Ｅｒ−Ｚｎ系酸化物、Ｉｎ−Ｔｍ−Ｚｎ系酸化物、Ｉｎ−Ｙｂ−Ｚｎ系酸化物、Ｉｎ
−Ｌｕ−Ｚｎ系酸化物、四元系金属の酸化物であるＩｎ−Ｓｎ−Ｇａ−Ｚｎ系酸化物、Ｉ
ｎ−Ｈｆ−Ｇａ−Ｚｎ系酸化物、Ｉｎ−Ａｌ−Ｇａ−Ｚｎ系酸化物、Ｉｎ−Ｓｎ−Ａｌ−
Ｚｎ系酸化物、Ｉｎ−Ｓｎ−Ｈｆ−Ｚｎ系酸化物、Ｉｎ−Ｈｆ−Ａｌ−Ｚｎ系酸化物を用
いることができる。また、上記酸化物半導体は、珪素を含んでいてもよい。
なお、例えば、Ｉｎ−Ｇａ−Ｚｎ系酸化物とは、ＩｎとＧａとＺｎを含む酸化物という意
味であり、ＩｎとＧａとＺｎの比率は問わない。また、ＩｎとＧａとＺｎ以外の金属元素
を含んでいてもよい。Ｉｎ−Ｇａ−Ｚｎ系酸化物は、無電界時の抵抗が十分に高くオフ電
流を十分に小さくすることが可能であり、また、移動度も高い。
酸化物半導体膜は、単結晶、多結晶（ポリクリスタルともいう）または非晶質などの状態
を採る。酸化物半導体膜は、ＣＡＡＣ−ＯＳ（Ｃ Ａｘｉｓ Ａｌｉｇｎｅｄ Ｃｒｙｓ
ｔａｌｌｉｎｅ Ｏｘｉｄｅ Ｓｅｍｉｃｏｎｄｕｃｔｏｒ）膜であることが好ましい。
ＣＡＡＣ−ＯＳ膜は、完全な単結晶ではなく、完全な非晶質でもない。ＣＡＡＣ−ＯＳ膜
は、非晶質相に数ｎｍから数十ｎｍの結晶部を有する結晶−非晶質混相構造の酸化物半導
体膜である。なお、透過型電子顕微鏡（ＴＥＭ：Ｔｒａｎｓｍｉｓｓｉｏｎ Ｅｌｅｃｔ
ｒｏｎ Ｍｉｃｒｏｓｃｏｐｅ）によるＣＡＡＣ−ＯＳ膜に含まれる非晶質部と結晶部と
の境界は明確ではない。また、ＣＡＡＣ−ＯＳ膜には粒界（グレインバウンダリーともい
う。）は確認できない。ＣＡＡＣ−ＯＳ膜が粒界を有さないため、粒界に起因する電子移
動度の低下が起こりにくい。
ＣＡＡＣ−ＯＳ膜に含まれる結晶部は、ｃ軸がＣＡＡＣ−ＯＳ膜の被形成面の法線ベクト
ルまたは表面の法線ベクトルに平行な方向に揃い、かつａｂ面に垂直な方向から見て三角
形状または六角形状の原子配列を有し、ｃ軸に垂直な方向から見て金属原子が層状または
金属原子と酸素原子とが層状に配列している。なお、結晶部どうしは、それぞれａ軸およ
びｂ軸の向きが異なっていてもよい。本明細書において、単に垂直と記載する場合、８５
°以上９５°以下の範囲も含まれることとする。また、単に平行と記載する場合、−５°
以上５°以下の範囲も含まれることとする。
なお、ＣＡＡＣ−ＯＳ膜中の、非晶質部および結晶部の占める割合が均一でなくてもよい
。例えば、ＣＡＡＣ−ＯＳ膜の表面側から結晶成長させる場合、ＣＡＡＣ−ＯＳ膜の表面
の近傍は結晶部の占める割合が高くなり、被形成面の近傍は非晶質部の占める割合が高く
なることがある。また、ＣＡＡＣ−ＯＳ膜へ不純物を添加することにより、当該不純物添
加領域において結晶部が非晶質化することもある。
ＣＡＡＣ−ＯＳ膜に含まれる結晶部のｃ軸は、ＣＡＡＣ−ＯＳ膜の被形成面の法線ベクト
ルまたは表面の法線ベクトルに平行な方向に揃うため、ＣＡＡＣ−ＯＳ膜の形状（被形成
面の断面形状または表面の断面形状）によって、結晶部どうしのｃ軸の方向が異なること
がある。なお、結晶部のｃ軸の方向は、ＣＡＡＣ−ＯＳ膜が形成されたときの被形成面の
法線ベクトルまたは表面の法線ベクトルに平行な方向となる。結晶部は、成膜時または成
膜後に加熱処理などの結晶化処理を行うことで形成される。
ＣＡＡＣ−ＯＳ膜を用いることで、可視光や紫外光の照射によるトランジスタの電気的特
性の変動が低減されるため、信頼性の高いトランジスタを得ることができる。
ＣＡＡＣ−ＯＳ膜は、例えば、多結晶である酸化物半導体スパッタリング用ターゲットを
用い、スパッタリング法によって成膜する。当該スパッタリング用ターゲットにイオンが
衝突すると、スパッタリング用ターゲットに含まれる結晶領域がａ−ｂ面から劈開し、ａ
−ｂ面に平行な面を有する平板状またはペレット状のスパッタリング粒子として剥離する
ことがある。この場合、当該平板状のスパッタリング粒子が、結晶状態を維持したまま基
板に到達することで、ＣＡＡＣ−ＯＳ膜を成膜することができる。
また、ＣＡＡＣ−ＯＳ膜を成膜するために、以下の条件を適用することが好ましい。
成膜時の不純物混入を低減することで、不純物によって結晶状態が崩れることを抑制でき
る。例えば、処理室内に存在する不純物濃度（水素、水、二酸化炭素および窒素など）を
低減すればよい。また、成膜ガス中の不純物濃度を低減すればよい。具体的には、露点が
−８０℃以下、好ましくは−１００℃以下である成膜ガスを用いる。
また、成膜時の基板加熱温度を高めることで、基板到達後にスパッタリング粒子のマイグ
レーションが起こる。具体的には、基板加熱温度を１００℃以上７４０℃以下、好ましく
は２００℃以上５００℃以下として成膜する。成膜時の基板加熱温度を高めることで、平
板状のスパッタリング粒子が基板に到達した場合、基板上でマイグレーションが起こり、
スパッタリング粒子の平らな面が基板に付着する。
また、成膜ガス中の酸素割合を高め、電力を最適化することで成膜時のプラズマダメージ
を軽減すると好ましい。成膜ガス中の酸素割合は、３０体積％以上、好ましくは１００体
積％とする。
スパッタリング用ターゲットの一例として、Ｉｎ−Ｇａ−Ｚｎ−Ｏ化合物ターゲットにつ
いて以下に示す。
ＩｎＯＸ粉末、ＧａＯＹ粉末およびＺｎＯＺ粉末を所定のｍｏｌ数で混合し、加圧処理後
、１０００℃以上１５００℃以下の温度で加熱処理をすることで多結晶であるＩｎ−Ｇａ
−Ｚｎ−Ｏ化合物ターゲットとする。なお、Ｘ、ＹおよびＺは任意の正数である。ここで
、所定のｍｏｌ数比は、例えば、ＩｎＯＸ粉末、ＧａＯＹ粉末およびＺｎＯＺ粉末が、２
：２：１、８：４：３、３：１：１、１：１：１、４：２：３または３：１：２である。
なお、粉末の種類、およびその混合するｍｏｌ数比は、作製するスパッタリング用ターゲ
ットによって適宜変更すればよい。
なお、例えば、酸化物半導体膜は、Ｉｎ（インジウム）、Ｇａ（ガリウム）、及びＺｎ（
亜鉛）を含むターゲットを用いたスパッタ法により形成することができる。Ｉｎ−Ｇａ−
Ｚｎ系酸化物半導体膜をスパッタリング法で成膜する場合、好ましくは、原子数比がＩｎ
：Ｇａ：Ｚｎ＝１：１：１、４：２：３、３：１：２、１：１：２、２：１：３、または
３：１：４で示されるＩｎ−Ｇａ−Ｚｎ系酸化物のターゲットを用いる。前述の原子数比
を有するＩｎ−Ｇａ−Ｚｎ系酸化物のターゲットを用いて酸化物半導体膜を成膜すること
で、多結晶またはＣＡＡＣ−ＯＳが形成されやすくなる。また、Ｉｎ、Ｇａ、及びＺｎを
含むターゲットの相対密度は９０％以上１００％以下、好ましくは９５％以上１００％未
満である。相対密度の高いターゲットを用いることにより、成膜した酸化物半導体膜は緻
密な膜となる。
なお、酸化物半導体としてＩｎ−Ｚｎ系酸化物の材料を用いる場合、用いるターゲット中
の金属元素の原子数比は、Ｉｎ：Ｚｎ＝５０：１〜１：２（モル数比に換算するとＩｎ２
Ｏ３：ＺｎＯ＝２５：１〜１：４）、好ましくはＩｎ：Ｚｎ＝２０：１〜１：１（モル数
比に換算するとＩｎ２Ｏ３：ＺｎＯ＝１０：１〜１：２）、さらに好ましくはＩｎ：Ｚｎ
＝１５：１〜１．５：１（モル数比に換算するとＩｎ２Ｏ３：ＺｎＯ＝１５：２〜３：４
）とする。例えば、Ｉｎ−Ｚｎ系酸化物である酸化物半導体膜の形成に用いるターゲット
は、原子数比がＩｎ：Ｚｎ：Ｏ＝Ｘ：Ｙ：Ｚのとき、Ｚ＞１．５Ｘ＋Ｙとする。Ｚｎの比
率を上記範囲に収めることで、移動度の向上を実現することができる。
そして、具体的に酸化物半導体膜は、減圧状態に保持された処理室内に基板を保持し、処
理室内の残留水分を除去しつつ水素及び水分が除去されたスパッタガスを導入し、上記タ
ーゲットを用いて形成すればよい。成膜時に、基板温度を１００℃以上６００℃以下、好
ましくは２００℃以上４００℃以下としても良い。基板を加熱しながら成膜することによ
り、成膜した酸化物半導体膜に含まれる不純物濃度を低減することができる。また、スパ
ッタリングによる損傷が軽減される。処理室内の残留水分を除去するためには、吸着型の
真空ポンプを用いることが好ましい。例えば、クライオポンプ、イオンポンプ、チタンサ
ブリメーションポンプを用いることが好ましい。また、排気手段としては、ターボポンプ
にコールドトラップを加えたものであってもよい。クライオポンプを用いて処理室を排気
すると、例えば、水素原子、水（Ｈ２Ｏ）など水素原子を含む化合物（より好ましくは炭
素原子を含む化合物も）等が排気されるため、当該処理室で成膜した酸化物半導体膜に含
まれる不純物の濃度を低減できる。
なお、スパッタ等で成膜された酸化物半導体膜中には、不純物としての水分または水素（
水酸基を含む）が多量に含まれていることがある。水分または水素はドナー準位を形成し
やすいため、酸化物半導体にとっては不純物である。そこで、本発明の一態様では、酸化
物半導体膜中の水分または水素などの不純物を低減（脱水化または脱水素化）するために
、酸化物半導体膜に対して、減圧雰囲気下、窒素や希ガスなどの不活性ガス雰囲気下、酸
素ガス雰囲気下、または超乾燥エア（ＣＲＤＳ（キャビティリングダウンレーザー分光法
）方式の露点計を用いて測定した場合の水分量が２０ｐｐｍ（露点換算で−５５℃）以下
、好ましくは１ｐｐｍ以下、好ましくは１０ｐｐｂ以下の空気）雰囲気下で、加熱処理を
施す。
酸化物半導体膜に加熱処理を施すことで、酸化物半導体膜中の水分または水素を脱離させ
ることができる。具体的には、２５０℃以上７５０℃以下、好ましくは４００℃以上基板
の歪み点未満の温度で加熱処理を行えば良い。例えば、５００℃、３分間以上６分間以下
程度で行えばよい。加熱処理にＲＴＡ法を用いれば、短時間に脱水化または脱水素化が行
えるため、ガラス基板の歪点を超える温度でも処理することができる。
なお、上記加熱処理により、酸化物半導体膜から酸素が脱離し、酸化物半導体膜内に酸素
欠損が形成される場合がある。よって、本発明の一態様では、酸化物半導体膜と接するゲ
ート絶縁膜などの絶縁膜として、酸素を含む絶縁膜を用いる。そして、酸素を含む絶縁膜
を形成した後、加熱処理を施すことで、上記絶縁膜から酸化物半導体膜に酸素が供与され
るようにする。上記構成により、ドナーとなる酸素欠損を低減し、酸化物半導体膜に含ま
れる酸化物半導体の、化学量論的組成を満たすことができる。半導体膜には化学量論的組
成を超える量の酸素が含まれていることが好ましい。その結果、酸化物半導体膜をｉ型に
近づけることができ、酸素欠損によるトランジスタの電気特性のばらつきを軽減し、電気
特性の向上を実現することができる。
なお、酸素を酸化物半導体膜に供与するための加熱処理は、窒素、超乾燥空気、または希
ガス（アルゴン、ヘリウムなど）の雰囲気下において、好ましくは２００℃以上４００℃
以下、例えば２５０℃以上３５０℃以下）で行う。上記ガスは、水の含有量が２０ｐｐｍ
以下、好ましくは１ｐｐｍ以下、より好ましくは１０ｐｐｂ以下であることが望ましい。
図８２（Ａ）に示すトランジスタは、チャネルエッチ構造の、ボトムゲート型である。
そして、図８２（Ａ）に示すトランジスタは、絶縁表面上に形成されたゲート電極６０２
と、ゲート電極６０２上のゲート絶縁膜６０３と、ゲート絶縁膜６０３上においてゲート
電極６０２と重なっている半導体膜６０４と、半導体膜６０４上に形成された導電膜６０
５、導電膜６０６とを有する。さらに、トランジスタは、半導体膜６０４、導電膜６０５
及び導電膜６０６上に形成された絶縁膜６０７を、その構成要素に含めても良い。
なお、図８２（Ａ）に示したトランジスタは、半導体膜６０４と重なる位置において絶縁
膜６０７上に形成されたバックゲート電極を、更に有していても良い。
図８２（Ｂ）に示すトランジスタは、チャネル保護構造の、ボトムゲート型である。
そして、図８２（Ｂ）に示すトランジスタは、絶縁表面上に形成されたゲート電極６１２
と、ゲート電極６１２上のゲート絶縁膜６１３と、ゲート絶縁膜６１３上においてゲート
電極６１２と重なっている半導体膜６１４と、半導体膜６１４上に形成されたチャネル保
護膜６１８と、半導体膜６１４上に形成された導電膜６１５、導電膜６１６とを有する。
さらに、トランジスタは、チャネル保護膜６１８、導電膜６１５及び導電膜６１６上に形
成された絶縁膜６１７を、その構成要素に含めても良い。
なお、図８２（Ｂ）に示したトランジスタは、半導体膜６１４と重なる位置において絶縁
膜６１７上に形成されたバックゲート電極を、更に有していても良い。
チャネル保護膜６１８を設けることによって、半導体膜６１４のチャネル形成領域となる
部分に対する、後の工程における、エッチング時のプラズマやエッチング剤による膜減り
などのダメージを防ぐことができる。従ってトランジスタの信頼性を向上させることがで
きる。
図８２（Ｃ）に示すトランジスタは、ボトムコンタクト構造の、ボトムゲート型である。
そして、図８２（Ｃ）に示すトランジスタは、絶縁表面上に形成されたゲート電極６２２
と、ゲート電極６２２上のゲート絶縁膜６２３と、ゲート絶縁膜６２３上の導電膜６２５
、導電膜６２６と、ゲート絶縁膜６２３上においてゲート電極６２２と重なっており、な
おかつ導電膜６２５、導電膜６２６上に形成された半導体膜６２４とを有する。さらに、
トランジスタは、導電膜６２５、導電膜６２６、及び半導体膜６２４上に形成された絶縁
膜６２７を、その構成要素に含めても良い。
なお、図８２（Ｃ）に示したトランジスタは、半導体膜６２４と重なる位置において絶縁
膜６２７上に形成されたバックゲート電極を、更に有していても良い。
図８２（Ｄ）に示すトランジスタは、ボトムコンタクト構造の、トップゲート型である。
そして、図８２（Ｄ）に示すトランジスタは、絶縁表面上に形成された導電膜６４５、導
電膜６４６と、導電膜６４５、導電膜６４６上に形成された半導体膜６４４と、半導体膜
６４４、導電膜６４５及び導電膜６４６上に形成されたゲート絶縁膜６４３と、ゲート絶
縁膜６４３上において半導体膜６４４と重なっているゲート電極６４２とを有する。さら
に、トランジスタは、ゲート電極６４２上に形成された絶縁膜６４７を、その構成要素に
含めても良い。
本実施の形態は、他の実施の形態の一部または全部について、変更、追加、修正、削除、
応用、上位概念化、又は、下位概念化したものに相当する。したがって、本実施の形態の
一部または全部について、他の実施の形態の一部または全部と自由に組み合わせる、適用
する、或いは置き換えて実施することができる。
（実施の形態７）
本実施の形態では、本発明の半導体装置の一態様の一つである発光装置を例に挙げ、その
外観について図８３を用いて説明する。図８３（Ａ）は、第１の基板上に形成されたトラ
ンジスタ及び発光素子を、第１の基板と第２の基板の間にシール材で封止したパネルの上
面図であり、図８３（Ｂ）は、図８３（Ａ）のＡ−Ａ’における断面図に相当する。
第１の基板４００１上に設けられた画素部４００２と、回路４００３と、回路４００４と
を囲むように、シール材４０２０が設けられている。また画素部４００２、回路４００３
及び回路４００４の上に、第２の基板４００６が設けられている。よって画素部４００２
、回路４００３及び回路４００４は、第１の基板４００１と第２の基板４００６の間にお
いて、シール材４０２０により、充填材４００７と共に密封されている。
また第１の基板４００１上に設けられた画素部４００２、画素部４００２への信号の供給
を行う回路４００３及び回路４００４は、それぞれトランジスタを複数有している。図８
３（Ｂ）では、回路４００３に含まれるトランジスタ４００８と、画素部４００２に含ま
れるトランジスタ４００９及びトランジスタ４０１０とを一例として示している。
また発光素子４０１１は、トランジスタ４００９のソースまたはドレインと接続されてい
る配線４０１７の一部を、その画素電極として用いている。また発光素子４０１１は、画
素電極の他に対向電極４０１２と発光層４０１３を有している。なお発光素子４０１１の
構成は、本実施の形態に示した構成に限定されない。発光素子４０１１から取り出す光の
方向や、トランジスタ４００９の極性などに合わせて、発光素子４０１１の構成は適宜変
えることができる。
また回路４００３、回路４００４または画素部４００２に与えられる各種信号及び電圧は
、図８３（Ｂ）に示す断面図では図示されていないが、引き出し配線４０１４及び４０１
５を介して、接続端子４０１６から供給されている。
本実施の形態では、接続端子４０１６が、発光素子４０１１が有する対向電極４０１２と
同じ導電膜から形成されている。また、引き出し配線４０１４は、配線４０１７と同じ導
電膜から形成されている。また引き出し配線４０１５は、トランジスタ４００９、トラン
ジスタ４０１０、トランジスタ４００８がそれぞれ有するゲート電極と、同じ導電膜から
形成されている。
接続端子４０１６は、ＦＰＣ４０１８が有する端子と、異方性導電膜４０１９を介して電
気的に接続されている。
なお、第１の基板４００１、第２の基板４００６として、ガラス、金属（代表的にはステ
ンレス）、セラミックス、プラスチックを用いることができる。但し、発光素子４０１１
からの光の取り出し方向に位置する第２の基板４００６は、透光性を有していなければな
らない。よって第２の基板４００６は、ガラス板、プラスチック板、ポリエステルフィル
ムまたはアクリルフィルムのような透光性を有する材料を用いることが望ましい。
また、充填材４００７としては窒素やアルゴンなどの不活性な気体の他に、紫外線硬化樹
脂または熱硬化樹脂を用いることができる。本実施の形態では充填材４００７として窒素
を用いる例を示している。
本実施の形態は、他の実施の形態の一部または全部について、変更、追加、修正、削除、
応用、上位概念化、又は、下位概念化したものに相当する。したがって、本実施の形態の
一部または全部について、他の実施の形態の一部または全部と自由に組み合わせる、適用
する、或いは置き換えて実施することができる。
（実施の形態８）
本発明の一態様に係る回路１００は、表示装置の画素部に用いることができる。或いは、
本発明の一態様に係る回路１００は、表示装置の駆動回路に用いることができる。
図８４（Ａ）は、本発明の一態様に係る半導体装置の一つに相当する、表示装置のブロッ
ク図である。図８４（Ａ）に示す表示装置は、画素部７００と、駆動回路７０１と、駆動
回路７０２とを有する。画素部７００には、画素として機能する回路１００が複数設けら
れている。駆動回路７０１及び駆動回路７０２は、各回路１００に、各種の一定電圧や信
号を供給する機能を有する。
図８４（Ｂ）は、本発明の一態様に係る半導体装置の一つに相当する、表示装置のブロッ
ク図である。図８４（Ｂ）に示す表示装置は、画素部７１１と、駆動回路７１０とを有す
る。駆動回路７１０には、電流源として機能する回路１００が複数設けられている。回路
１００から出力された電流は、画素部７１１が有する画素（ｐｉｘｅｌ）に供給される。
本実施の形態は、他の実施の形態の一部または全部について、変更、追加、修正、削除、
応用、上位概念化、又は、下位概念化したものに相当する。したがって、本実施の形態の
一部または全部について、他の実施の形態の一部または全部と自由に組み合わせる、適用
する、或いは置き換えて実施することができる。
（実施の形態９）
本発明の一態様に係る半導体装置は、表示機器、パーソナルコンピュータ、記録媒体を備
えた画像再生装置（代表的にはＤＶＤ：Ｄｉｇｉｔａｌ Ｖｅｒｓａｔｉｌｅ Ｄｉｓｃ
等の記録媒体を再生し、その画像を表示しうるディスプレイを有する装置）に用いること
ができる。その他に、本発明の一態様に係る半導体装置を用いることができる電子機器と
して、携帯電話、携帯型を含むゲーム機、携帯情報端末、電子書籍、ビデオカメラ、デジ
タルスチルカメラなどのカメラ、ゴーグル型ディスプレイ（ヘッドマウントディスプレイ
）、ナビゲーションシステム、音響再生装置（カーオーディオ、デジタルオーディオプレ
イヤー等）、複写機、ファクシミリ、プリンター、プリンター複合機、現金自動預け入れ
払い機（ＡＴＭ）、自動販売機などが挙げられる。これら電子機器の具体例を図８５、図
９１に示す。
図８５（Ａ）は携帯型ゲーム機であり、筐体５００１、筐体５００２、表示部５００３、
表示部５００４、マイクロフォン５００５、スピーカー５００６、操作キー５００７、ス
タイラス５００８等を有する。本発明の一態様に係る半導体装置は、携帯型ゲーム機の駆
動を制御するための集積回路、または表示部５００３、表示部５００４に用いることがで
きる。なお、図８５（Ａ）に示した携帯型ゲーム機は、２つの表示部５００３と表示部５
００４とを有しているが、携帯型ゲーム機が有する表示部の数は、これに限定されない。
図８５（Ｂ）は表示機器であり、筐体５２０１、表示部５２０２、支持台５２０３等を有
する。本発明の一態様に係る半導体装置は、表示機器の駆動を制御するための集積回路、
または表示部５２０２に用いることができる。なお、表示機器には、パーソナルコンピュ
ータ用、ＴＶ放送受信用、広告表示用などの全ての情報表示用表示機器が含まれる。
図８５（Ｃ）はノート型パーソナルコンピュータであり、筐体５４０１、表示部５４０２
、キーボード５４０３、ポインティングデバイス５４０４等を有する。本発明の一態様に
係る半導体装置は、ノート型パーソナルコンピュータの駆動を制御するための集積回路、
または表示部５４０２に用いることができる。
図８５（Ｄ）は携帯情報端末であり、筐体５６０１、表示部５６０２、操作キー５６０３
等を有する。図８５（Ｄ）に示す携帯情報端末は、モデムが筐体５６０１に内蔵されてい
ても良い。本発明の一態様に係る半導体装置は、携帯情報端末の駆動を制御するための集
積回路、または表示部５６０２に用いることができる。
図８５（Ｅ）は携帯電話であり、筐体５８０１、表示部５８０２、音声入力部５８０３、
音声出力部５８０４、操作キー５８０５、受光部５８０６等を有する。受光部５８０６に
おいて受信した光を電気信号に変換することで、外部の画像を取り込むことができる。本
発明の一態様に係る半導体装置は、携帯電話の駆動を制御するための集積回路、または表
示部５８０２に用いることができる。
図８５（Ｆ）は携帯情報端末であり、第１筐体５９０１、第２筐体５９０２、第１表示部
５９０３、第２表示部５９０４、接続部５９０５、操作キー５９０６等を有する。第１表
示部５９０３は第１筐体５９０１に設けられており、第２表示部５９０４は第２筐体５９
０２に設けられている。そして、第１筐体５９０１と第２筐体５９０２とは、接続部５９
０５により接続されており、第１筐体５９０１と第２筐体５９０２の間の角度は、接続部
５９０５により変更できる。第１表示部５９０３における映像を、接続部５９０５におけ
る第１筐体５９０１と第２筐体５９０２との間の角度に従って、切り替える構成としても
良い。本発明の一態様に係る半導体装置は、携帯情報端末の駆動を制御するための集積回
路、または第１表示部５９０３、第２表示部５９０４に用いることができる。また、第１
表示部５９０３及び第２表示部５９０４の少なくとも一方に、位置入力装置としての機能
が付加された表示装置を用いるようにしても良い。なお、位置入力装置としての機能は、
表示装置にタッチパネルを設けることで付加することができる。或いは、位置入力装置と
しての機能は、フォトセンサとも呼ばれる光電変換素子を表示装置の画素部に設けること
でも、付加することができる。
次に、図９１を参照して、本発明に係る携帯電話の構成例について説明する。
表示パネル９００５０１はハウジング９００５３０に脱着自在に組み込まれる。ハウジン
グ９００５３０は表示パネル９００５０１のサイズに合わせて、形状や寸法を適宜変更す
ることができる。表示パネル９００５０１を固定したハウジング９００５３０はプリント
基板９００５３１に嵌入されモジュールとして組み立てられる。
また、表示パネル９００５０１、タッチパネル、ＦＰＣ、プリント基板、フレーム、放熱
板、光学フィルム、偏光板、位相差板、プリズムシート、拡散板、バックライト、導光板
、ＬＥＤ、ＣＦＬ、フロントライト、コントローラ、ドライバ回路、または、信号処理回
路、などを設けて、表示モジュールとすることができる。また、表示パネル９００５０１
の対向基板（封止基板）に、タッチパネル機能を持たせるようにすることも可能である。
表示パネル９００５０１はＦＰＣ９００５１３を介してプリント基板９００５３１に接続
される。プリント基板９００５３１には、スピーカー９００５３２、マイクロフォン９０
０５３３、送受信回路９００５３４、ＣＰＵ及びコントローラなどを含む信号処理回路９
００５３５が形成されている。このようなモジュールと、入力手段９００５３６、バッテ
リー９００５３７を組み合わせ、筐体９００５３９に収納する。表示パネル９００５０１
の画素部は筐体９００５３９に形成された開口窓から視認できように配置する。
表示パネル９００５０１は、画素部と一部の周辺駆動回路（複数の駆動回路のうち動作周
波数の低い駆動回路）を基板上にＴＦＴを用いて一体形成し、一部の周辺駆動回路（複数
の駆動回路のうち動作周波数の高い駆動回路）をＩＣチップ上に形成し、そのＩＣチップ
をＣＯＧ（Ｃｈｉｐ Ｏｎ Ｇｌａｓｓ）で表示パネル９００５０１に実装しても良い。
あるいは、そのＩＣチップをＴＡＢ（Ｔａｐｅ Ａｕｔｏｍａｔｅｄ Ｂｏｎｄｉｎｇ）
やプリント基板を用いてガラス基板と接続してもよい。このような構成とすることで、表
示装置の低消費電力化を図り、携帯電話機の一回の充電による使用時間を長くすることが
できる。また、携帯電話機の低コスト化を図ることができる。
本実施の形態は、他の実施の形態の一部または全部について、変更、追加、修正、削除、
応用、上位概念化、又は、下位概念化したものに相当する。したがって、本実施の形態の
一部または全部について、他の実施の形態の一部または全部と自由に組み合わせる、適用
する、或いは置き換えて実施することができる。
なお、ある一つの実施の形態において述べる図または文章において、その一部分を取り出
して、発明の一態様を構成することは可能である。したがって、ある部分を述べる図また
は文章が記載されている場合、その一部分の図または文章を取り出した内容も、発明の一
態様として開示されているものであり、発明の一態様を構成することが可能であるものと
する。そのため、例えば、能動素子（トランジスタ、ダイオードなど）、配線、受動素子
（容量素子、抵抗素子など）、導電層、絶縁層、半導体層、有機材料、無機材料、部品、
装置、動作方法、製造方法などが単数又は複数記載された図面または文章において、その
一部分を取り出して、発明の一態様を構成することが可能であるものとする。例えば、Ｎ
個（Ｎは整数）の回路素子（トランジスタ、容量素子等）を有して構成される回路図から
、Ｍ個（Ｍは整数で、Ｍ＜Ｎ）の回路素子（トランジスタ、容量素子等）を抜き出して、
発明の一態様を構成することは可能である。別の例としては、Ｎ個（Ｎは整数）の層を有
して構成される断面図から、Ｍ個（Ｍは整数で、Ｍ＜Ｎ）の層を抜き出して、発明の一態
様を構成することは可能である。さらに別の例としては、Ｎ個（Ｎは整数）の要素を有し
て構成されるフローチャートから、Ｍ個（Ｍは整数で、Ｍ＜Ｎ）の要素を抜き出して、発
明の一態様を構成することは可能である。
なお、ある一つの実施の形態において述べる図または文章において、少なくとも一つの具
体例が記載される場合、その具体例の上位概念を導き出すことは、当業者であれば容易に
理解される。したがって、ある一つの実施の形態において述べる図または文章において、
少なくとも一つの具体例が記載される場合、その具体例の上位概念も、発明の一態様とし
て開示されているものであり、発明の一態様を構成することが可能である。
なお、少なくとも図に記載した内容（図の中の一部でもよい）は、発明の一態様として開
示されているものであり、発明の一態様を構成することが可能である。したがって、ある
内容について、図に記載されていれば、文章を用いて述べていなくても、その内容は、発
明の一態様として開示されているものであり、発明の一態様を構成することが可能である
。同様に、図の一部を取り出した図についても、発明の一態様として開示されているもの
であり、発明の一態様を構成することが可能である。
（実施の形態１０）
図４９（Ａ）において、一例として、スイッチ１１、スイッチ１２、スイッチ１３、スイ
ッチ１４、スイッチ９１４に、トランジスタを用いた場合の、回路１００の構成を、図８
８（Ａ）に示す。
図８８（Ａ）に示す回路１００では、スイッチ１１としてトランジスタ１１ｔを用い、ス
イッチ１２としてトランジスタ１２ｔを用い、スイッチ１３としてトランジスタ１３ｔを
用い、スイッチ１４としてトランジスタ１４ｔを用い、スイッチ９１４としてトランジス
タ９１４ｔを用いている。
なお、図８８（Ａ）では、トランジスタ１１ｔ、トランジスタ１２ｔ、トランジスタ１３
ｔ、トランジスタ１４ｔ、及びトランジスタ９１４ｔが全てｎチャネル型である場合を一
例として示している。トランジスタ１１ｔ、トランジスタ１２ｔ、トランジスタ１３ｔ、
トランジスタ１４ｔ、及びトランジスタ９１４ｔを全て同じ極性のトランジスタとするこ
とで、これらのトランジスタを少ない工程数で製造できる。ただし、本発明の実施形態の
一態様は、これに限定されず、異なる極性のトランジスタを用いることも可能である。
また、図８８（Ａ）では、トランジスタ１１ｔは、ゲートが配線３１に接続されている。
配線３１に供給される電位に従って、トランジスタ１１ｔは導通状態または非導通状態と
なる。トランジスタ１２ｔは、ゲートが配線３２に接続されている。配線３２に供給され
る電位に従って、トランジスタ１２ｔは導通状態または非導通状態となる。トランジスタ
１３ｔは、ゲートが配線３２に接続されている。配線３２に供給される電位に従って、ト
ランジスタ１３ｔは導通状態または非導通状態となる。トランジスタ１４ｔは、ゲートが
配線３４に接続されている。配線３４に供給される電位に従って、トランジスタ１４ｔは
導通状態または非導通状態となる。したがって、配線３１、配線３２、及び配線３４の電
位は、パルス状であり、一定ではないことが望ましいが、本発明の実施形態の一態様は、
これに限定されない。または、配線３１、配線３２、及び配線３４は、ゲート信号線、選
択信号線、または、スキャン線としての機能を有している。
なお、図８８（Ａ）では、トランジスタ１２ｔのゲートと、トランジスタ１３ｔのゲート
とが、共に配線３２に接続されている場合を例示している。本発明の一態様では、トラン
ジスタ１２ｔのゲートが配線３２に接続され、トランジスタ１３ｔのゲートが、配線３３
に接続されていても良い。
また、配線３１、配線３２、及び配線３４において、その中の少なくとも２本の配線は、
互いに接続させることが可能である。または、配線３１、配線３２、及び配線３４の少な
くとも１本は、別の回路１００の配線３１、配線３２、及び配線３４の少なくとも１本と
接続させることが可能である。
また、本発明の一態様に係る半導体装置は、図８８（Ａ）に示した回路１００に加えて、
回路１００に各種の一定電圧や信号を供給する機能を有する回路を、さらに有していても
良い。
次いで、電位Ｖｓｉｇに応じた輝度で発光素子１０４ａを発光させる期間Ｔ１４における
、トランジスタ１０１のゲートソース間電圧（Ｖｇｓ１０１）の値を、シミュレーション
により求めた。シミュレーションでは、図８８（Ａ）に示した回路１００を用いた。
図８８（Ｂ）は、シミュレーションにおける、図８８（Ａ）に示した回路１００が有する
各配線の電位のタイミングチャートである。具体的に、図８８（Ｂ）では、配線２１の電
位と、配線３４の電位と、配線３２の電位と、配線３１の電位と、配線９３２の電位の時
間変化を示す。なお、図８８（Ｂ）では、配線３４、配線３２、配線３１、配線９３２に
は、ハイレベルの電位ＧＶＤＤまたはローレベルの電位ＧＶＳＳが与えられる。
なお、シミュレーションは、配線２２における電位Ｖｉ２の値が互いに異なる、条件Ａま
たは条件Ｂを用いて行った。具体的に、条件Ａと条件Ｂにおける各配線の電位の値を下記
の表１に示す。なお、表１では、配線２４の電位Ｖｃａｔを０Ｖとし、電位Ｖｓｉｇ、電
位Ｖｉ１、電位ＶＤＤ、電位Ｖｉ２、電位ＧＶＤＤ、電位ＧＶＳＳの値を、電位Ｖｃａｔ
との電位差で示している。
また、シミュレーションにおける各トランジスタのチャネル長Ｌとチャネル幅Ｗの比は、
トランジスタ１０１ではＬ／Ｗ＝１０μｍ／１０μｍ、トランジスタ１２ｔ及びトランジ
スタ１３ｔではＬ／Ｗ＝６μｍ／５μｍ、トランジスタ１１ｔ、トランジスタ１４ｔ、及
びトランジスタ９１４ｔではＬ／Ｗ＝６μｍ／９μｍとした。そして、図８８（Ａ）に示
した回路１００が有する全てのトランジスタにおいて、半導体膜とソース電極またはドレ
イン電極とが接している領域を領域Ａとすると、領域Ａとゲート電極とが重なる領域にお
ける、チャネル長方向の長さ（Ｌｏｖ）を、２．０μｍとした。
図８８（Ｂ）に示した期間Ｔ１４では、トランジスタ１０１のゲートソース間電圧（Ｖｇ
ｓ１０１）は、電圧Ｖｓｉｇ＋Ｖｔｈ−Ｖｉ１となる。よって、図８８（Ａ）に示した回
路１００において、Ｖｇｓ１０１−Ｖｔｈ＝Ｖｓｉｇ−Ｖｉ１となるため、Ｖｇｓ１０１
−Ｖｔｈは、理想的には、閾値電圧Ｖｔｈの値に関わらず一定の値を有する。
図８９に、条件Ａを用いた場合における、シミュレーションにより得られたＶｇｓ１０１
−Ｖｔｈの値を示す。図８９では、横軸が閾値電圧Ｖｔｈ（Ｖ）、縦軸がＶｇｓ１０１−
Ｖｔｈ（Ｖ）の値を示す。図８９では、閾値電圧Ｖｔｈの値を変化させても、Ｖｇｓ１０
１−Ｖｔｈの値がほぼ均一であり、そのばらつきは１０％〜１５％程度に抑えられている
ことが分かる。
図９０に、条件Ｂを用いた場合における、シミュレーションにより得られたＶｇｓ１０１
−Ｖｔｈの値を示す。図９０では、横軸が閾値電圧Ｖｔｈ（Ｖ）、縦軸がＶｇｓ１０１−
Ｖｔｈ（Ｖ）の値を示す。図９０では、閾値電圧Ｖｔｈの値が正の値を有する場合だと、
Ｖｇｓ１０１−Ｖｔｈの値はほぼ均一である。しかし、閾値電圧Ｖｔｈの値が負の値を有
する場合、閾値電圧Ｖｔｈが負の方向に大きくなるほど、Ｖｇｓ１０１−Ｖｔｈの値が大
きくなっており、Ｖｇｓ１０１−Ｖｔｈの値が閾値電圧Ｖｔｈの値に依存していることが
分かる。
上記シミュレーションの結果から、本発明の一態様に係る半導体装置では、トランジスタ
１０１がノーマリオンであっても、すなわち閾値電圧Ｖｔｈがマイナスの値を有していて
も、トランジスタ１０１の閾値電圧Ｖｔｈを加味した値になるよう、トランジスタ１０１
のゲートソース間電圧（Ｖｇｓ１０１）を設定することができることが証明された。
本実施の形態は、他の実施の形態の一部または全部について、変更、追加、修正、削除、
応用、上位概念化、又は、下位概念化したものに相当する。したがって、本実施の形態の
一部または全部について、他の実施の形態の一部または全部と自由に組み合わせる、適用
する、或いは置き換えて実施することができる。
１１ スイッチ
１１ｔ トランジスタ
１２ スイッチ
１２ｔ トランジスタ
１３ スイッチ
１３ｔ トランジスタ
１４ スイッチ
１４ａ スイッチ
１４ｂ スイッチ
１４ｔ トランジスタ
１５ スイッチ
２１ 配線
２２ 配線
２３ 配線
２３ａ 配線
２３ｂ 配線
２４ 配線
２５ 配線
２６ 配線
２７ 配線
３１ 配線
３２ 配線
３３ 配線
３４ 配線
１００ 回路
１０１ トランジスタ
１０２ 容量素子
１０３ 容量素子
１０４ 負荷
１０４ａ 発光素子
１０４ｂ 発光素子
１０５ 容量素子
１０５ａ 容量素子
１０５ｂ 容量素子
２０１ 回路
２０２ 回路
２０３ 回路
２０３ａ 回路
２０３ｂ 回路
２０４ 回路
２０５ 回路
２０６ 回路
２０７ 回路
２０８ 回路
２２０ 回路
２２１ 回路
２２２ 回路
２２２ａ 回路
２２２ｂ 回路
２２３ 回路
２２４ 回路
２２５ 回路
２２６ 回路
２３０ 回路
２３１ 回路
２３２ 回路
２３３ 回路
３００ 半導体膜
３０１ 半導体膜
３０２ 導電膜
３０３ 導電膜
３０４ 導電膜
３０５ 導電膜
３０６ 導電膜
３０７ 導電膜
３０８ 導電膜
３０９ 導電膜
３２０ 半導体膜
３２１ 半導体膜
３２２ 半導体膜
３２３ 半導体膜
３２４ 導電膜
３２５ 導電膜
３２６ 導電膜
３２７ 導電膜
３２８ 導電膜
３２９ 導電膜
３３０ 導電膜
３３１ 導電膜
３３２ 導電膜
３３３ 半導体膜
５０１ 半導体膜
５０２ 絶縁膜
５０３ 電極
５０４ 導電膜
５０５ 導電膜
５０６ 第１の領域
５０７ 第２の領域
５０８ 第２の領域
５０９ 第３の領域
５１０ 第３の領域
５２０ 絶縁膜
５２０ａ 第１の酸化絶縁膜
５２０ｂ 第２の酸化絶縁膜
５２０ｃ 第３の酸化絶縁膜
５２１ 半導体膜
５２２ 絶縁膜
５２３ 電極
５２４ 導電膜
５２５ 導電膜
５２６ 第１の領域
５２７ サイドウォール
５２８ 絶縁膜
５２９ 開口部
５３０ 絶縁膜
５３０ａ 第１の酸化絶縁膜
５３０ｂ 第２の酸化絶縁膜
５３１ 半導体膜
５３２ 絶縁膜
５３３ 電極
５３４ 導電膜
５３５ 導電膜
５３６ 第１の領域
５３７ 第２の領域
５３８ 第２の領域
５３９ サイドウォール
５４０ 絶縁膜
５５０ 第２の領域
５５１ 第２の領域
６０２ ゲート電極
６０３ ゲート絶縁膜
６０４ 半導体膜
６０５ 導電膜
６０６ 導電膜
６０７ 絶縁膜
６１２ ゲート電極
６１３ ゲート絶縁膜
６１４ 半導体膜
６１５ 導電膜
６１６ 導電膜
６１７ 絶縁膜
６１８ チャネル保護膜
６２２ ゲート電極
６２３ ゲート絶縁膜
６２４ 半導体膜
６２５ 導電膜
６２６ 導電膜
６２７ 絶縁膜
６４２ ゲート電極
６４３ ゲート絶縁膜
６４４ 半導体膜
６４５ 導電膜
６４６ 導電膜
６４７ 絶縁膜
７００ 画素部
７０１ 駆動回路
７０２ 駆動回路
７１０ 駆動回路
７１１ 画素部
８００ 基板
８０１ 絶縁膜
８０２ 絶縁膜
８０３ 絶縁膜
８１４ スイッチ
９１４ スイッチ
９１４ｔ トランジスタ
９３２ 配線
４００１ 基板
４００２ 画素部
４００３ 回路
４００４ 回路
４００６ 基板
４００７ 充填材
４００８ トランジスタ
４００９ トランジスタ
４０１０ トランジスタ
４０１１ 発光素子
４０１２ 対向電極
４０１３ 発光層
４０１４ 配線
４０１５ 配線
４０１６ 接続端子
４０１７ 配線
４０１８ ＦＰＣ
４０１９ 異方性導電膜
４０２０ シール材
５００１ 筐体
５００２ 筐体
５００３ 表示部
５００４ 表示部
５００５ マイクロフォン
５００６ スピーカー
５００７ 操作キー
５００８ スタイラス
５２０１ 筐体
５２０２ 表示部
５２０３ 支持台
５４０１ 筐体
５４０２ 表示部
５４０３ キーボード
５４０４ ポインティングデバイス
５６０１ 筐体
５６０２ 表示部
５６０３ 操作キー
５８０１ 筐体
５８０２ 表示部
５８０３ 音声入力部
５８０４ 音声出力部
５８０５ 操作キー
５８０６ 受光部
５９０１ 筐体
５９０２ 筐体
５９０３ 表示部
５９０４ 表示部
５９０５ 接続部
５９０６ 操作キー
９２０６ 回路
９００５０１ 表示パネル
９００５１３ ＦＰＣ
９００５３０ ハウジング
９００５３１ プリント基板
９００５３２ スピーカー
９００５３３ マイクロフォン
９００５３４ 送受信回路
９００５３５ 信号処理回路
９００５３６ 入力手段
９００５３７ バッテリー
９００５３９ 筐体

Claims (3)

  1. 発光素子と、第１のトランジスタと、第２のトランジスタと、容量素子と、を有し、
    前記第１のトランジスタは、前記発光素子に供給される電流を制御する機能を有し、
    前記第１のトランジスタは、第１の半導体膜にチャネル形成領域を有し、
    前記第２のトランジスタは、前記第１の半導体膜にチャネル形成領域を有し、
    前記第１のトランジスタのゲート電極としての機能を有する導電膜は、前記容量素子の第１の電極としての機能を有し、
    前記第１の半導体膜は、前記容量素子の第２の電極としての機能を有する発光装置。
  2. 請求項１において、前記第１のトランジスタ及び前記第２のトランジスタは、同じ導電型を有する発光装置。
  3. 請求項１または請求項２において、前記第１の半導体膜は、酸化物半導体を含む発光装置。
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