JP2016157705A - 回路基板及びこれを搭載する電子装置 - Google Patents
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Abstract
【課題】
電磁雑音の発生を抑制する回路基板及びこれを搭載する電子装置を提供することを目的とする。
【解決手段】
複数の層からなり、前記複数の層の一部あるいは全部の層間を接続するスルーホールを有し、前記スルーホールと接続された各層の接続端部は、前記スルーホールの中心軸を中心とした円周上において、角度がずらされた位置に設けられていることを特徴とする回路基板及びこれを搭載した電子装置。
【選択図】 図1
電磁雑音の発生を抑制する回路基板及びこれを搭載する電子装置を提供することを目的とする。
【解決手段】
複数の層からなり、前記複数の層の一部あるいは全部の層間を接続するスルーホールを有し、前記スルーホールと接続された各層の接続端部は、前記スルーホールの中心軸を中心とした円周上において、角度がずらされた位置に設けられていることを特徴とする回路基板及びこれを搭載した電子装置。
【選択図】 図1
Description
本発明は、回路基板及びこれを搭載する電子装置に関する。
本技術分野の背景技術として、特開2007−250697号公報(特許文献1)がある。この公報には、「スルーホールと、基板内のパターンとを部分的に細くした配線で接続するサーマルランドを用いることで、配線基板の組み立て時に熱抵抗の低下を防ぎ均一な半田付けを可能とし、接続信頼性の高い配線基板及び該配線基板を備えた電子機器を実現する」と記載されている。
前記特許文献1には、回路基板におけるスルーホールの構造が記載されている。しかし、特許文献1のスルーホールは、半田付け時の熱拡散を抑制するため、配線あるいはいわゆるベタパターンへの接続時には、導体の一部を削除し、細い線状パターンで接続するいわゆるサーマルランドの構造をとる。
スルーホールと配線パターンを接続するパターンは、従来各層間で同一方向(基板に対し垂直線上から見て重なる位置関係)としていたため、同一方向を流れる電流が発生する磁束の結合によりインダクタンスを低減することができなかった。
そこで、本発明は、電磁雑音の発生を抑制する回路基板及びこれを搭載する電子装置を提供することを目的とする。
上記課題を解決するために、例えば特許請求の範囲に記載の構成を採用する。
一例を挙げるならば、複数の層からなる回路基板であって、前記複数の層の一部あるいは全部の層間を接続するスルーホールを有し、前記スルーホールと接続された各層の接続端部は、前記スルーホールの中心軸を中心とした円周上において、角度がずらされた位置に設けられていることを特徴とする。
一例を挙げるならば、複数の層からなる回路基板であって、前記複数の層の一部あるいは全部の層間を接続するスルーホールを有し、前記スルーホールと接続された各層の接続端部は、前記スルーホールの中心軸を中心とした円周上において、角度がずらされた位置に設けられていることを特徴とする。
本発明によれば、電磁雑音の発生を抑制する回路基板及びこれを搭載する電子装置を提供することができる。
以下、実施例について図面を用いて説明する。なお、図面において、同一符号は、同一または相当部分を示す。また、本発明は、図示例に限定されるものではない。
まずはじめに図4を用いて従来のスルーホールの代表的な構造を説明する。第1層の接続パターン11、12、13、14と、第2層の接続パターン21、22、23、24は、それぞれ隣接する層間で電磁結合を有するため、並列接続によるインダクタンス低減効果が小さくなり、結果として合成インダクタンスは小さくならないため、低ノイズ化が実現できない。
まずはじめに図4を用いて従来のスルーホールの代表的な構造を説明する。第1層の接続パターン11、12、13、14と、第2層の接続パターン21、22、23、24は、それぞれ隣接する層間で電磁結合を有するため、並列接続によるインダクタンス低減効果が小さくなり、結果として合成インダクタンスは小さくならないため、低ノイズ化が実現できない。
図1は、本発明の実施の形態による低ノイズスルーホールの構成図の例である。図1においてスルーホール中心導体1は、第1層の配線パターン10と接続パターン11、12、13、14を介して接続されている。また、スルーホール中心導体1は、第2層の配線パターン20と接続パターン21、22、23、24を介して接続されて構成される。
図1に示すように、第1層の接続パターンは中心導体1を中心として放射状に90度ずつずれるようにして設けられている。なお、第2層の接続パターンも第1層と同様の構成を有している。
そして、隣接する第1層および、第2層間の接続パターンは、中心導体1を中心として相対的に角度をずらして設けられている。図1では、一例として45度ずらした構成としている。このように第1層と第2層とにおけるスルーホール中心導体1との接続パターンについて、各層間で角度をずらすことによって、インダクタンスを低減させることができる。
すなわち、図2に示すとおり、第1層の接続パターン11、12、13、14のインダクタンスをそれぞれL11、L12、L13、L14とし、第2層の接続パターン21、22、23、24のインダクタンスをそれぞれL21、L22、L23、L24とするとき、スルーホールの中心導体1から、第1層のパターン10、第2層のパターン20への合成インダクタンスは、L11、L12、L13、L14およびL21、L22、L23、L24の並列インダクタンスとなる。
図3は、第1層の接続パターン11、12、13、14と第2層の接続パターン21、22、23、24の相対的角度θに対する合成インダクタンスの関係を示したグラフである。図3に示すように、スルーホール中心導体1を中心とした第1層の接続パターンと第2層の接続パターンとの平面上の角度ずれがθ=45度の時に最も合成インダクタンスが小さい値となり、電磁ノイズを抑制できる。
本実施例では、2層構造の回路基板の構成について説明したが、2層以上の複数層においても本発明の原理を適用可能である。
以上のことから、本発明によれば、電磁雑音の発生を抑制する回路基板及びこれを搭載する電子装置を提供することができる。
1 スルーホール中心導体
10 第1層パターン
11、12、13、14 第1層スルーホール接続パターン
20 第2層パターン
21、22、23、24 第2層スルーホール接続パターン
10 第1層パターン
11、12、13、14 第1層スルーホール接続パターン
20 第2層パターン
21、22、23、24 第2層スルーホール接続パターン
Claims (4)
- 複数の層からなる回路基板であって、
前記複数の層の一部あるいは全部の層間を接続するスルーホールを有し、
前記スルーホールと接続された各層の接続端部は、前記スルーホールの中心軸を中心とした円周上において、角度がずらされた位置に設けられていることを特徴とする回路基板。 - 請求項1に記載の回路基板であって、
前記スルーホールと接続された各層の接続端部は、各層における同一平面上において放射状に複数設けられていることを特徴とする回路基板。 - 請求項1に記載の回路基板であって、
前記スルーホールと接続された各層の接続端部間のずれ角度は45度であることを特徴とする回路基板。 - 請求項1〜3のいずれか1項に記載の回路基板を搭載したことを特徴とする電子装置。
Priority Applications (2)
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Application Number | Priority Date | Filing Date | Title |
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JP2013104633A JP2016157705A (ja) | 2013-05-17 | 2013-05-17 | 回路基板及びこれを搭載する電子装置 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2013104633A Pending JP2016157705A (ja) | 2013-05-17 | 2013-05-17 | 回路基板及びこれを搭載する電子装置 |
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CN109743874B (zh) * | 2018-12-26 | 2020-11-27 | 苏州浪潮智能科技有限公司 | 一种bga芯片摆放位置的实现方法及系统 |
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2013
- 2013-05-17 JP JP2013104633A patent/JP2016157705A/ja active Pending
-
2014
- 2014-05-12 WO PCT/JP2014/062549 patent/WO2014185363A1/ja active Application Filing
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