JP2014075578A - ブロック共重合体のエッチング - Google Patents

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Abstract

【課題】自己組織化ブロック共重合体材料の良好なドライエッチングを提供する。
【解決手段】互いに異なるエッチング耐性を有する少なくとも2つのポリマー成分24,25を含む自己組織化ブロック共重合体層21を基板23上に形成する工程と、ほぼアッシングガスから生成したプラズマを使用した、前記自己組織化ブロック共重合体層21の第1プラズマエッチングと、純粋な不活性ガスまたは複数の不活性ガスの混合物から生成したプラズマを使用して第1ポリマー相25を選択的に除去する、前記自己組織化ブロック共重合体層21の第2プラズマエッチングとをそれぞれ少なくとも1回実施する工程とを含む。
【選択図】図2

Description

本発明は、ナノリソグラフィ、例えば半導体集積回路やナノ電気機械システムを製造するためのナノリソグラフィに関する。具体的には、自己組織化したブロック共重合体材料をエッチングする方法に関する。
半導体の製造において、より高いコンポーネント密度と、集積回路やナノ電気機械システムにおいて例えばナノスケールのような小さい構造を達成することに対するニーズが存在する。通常、半導体デバイスを製造するリソグラフィ技術は、レジスト層の上にデバイス構造のパターンを適用し、レジスト層のパターンによって露出した基板を選択的にエッチング除去することを含む。更なる処理工程では、エッチング領域内で他の材料を堆積させ、例えば集積回路を形成できる。
従来のフォトリソグラフィでは、パターンマスクが光により感光性ポリマーレジストに投影される。しかし、このアプローチの解像度は、回折によって本質的に制限される。代替として、例えば電子ビームリソグラフィ、イオンビームリソグラフィまたはX線リソグラフィにおいて、放射線質(radiative quality)が異なるエネルギーの波によって好適なレジスト層にパターンを転写することもできる。しかし、このようなリソグラフィ法を用いて、許容できるコストと工業的に許容できるスループットでナノスケールの構造を製造することは依然として難しい。
ブロック共重合体の誘導自己組織化(Directed Self Assembly:DSA)は、ナノリソグラフィに対する新興の(emergent)代替アプローチである。ブロック共重合体は、共有結合で互いに接続された化学的に異なるポリマーブロックからなる。化学的に異なる複数のポリマーブロックは、ミクロ相分離を経て、異種のポリマー鎖間での反発力によって動かされ、その結果、周期的ナノ構造においてアニーリング後に均質なドメインが形成される。例えば、かかる周期構造は、六方充填された(hexagonally packed)シリンダ(cylinder)、球、ジャイロイド構造(gyroid structure)または板状構造(lammelae)を含んでもよい。形成される構造の種類は、異なるポリマーのブロック長の比を調整することによって制御可能である。しかし、ブロック共重合体材料は、配向制御技術によって制限されない場合には、ランダム配向と弱い長距離秩序を特徴付けることができる。このような技術、例えばグラフォエピタキシ(graphoepitaxy)や化学エピタキシは、ブロック共重合体材料におけるドメインの形成を選択的に誘導する(direct)。下位の基板の上でレジスト層として使用可能なパターン化ギャップ構造が、後に続く一ポリマーの選択的除去を通じて形成され、これにより5nmから50nmのスケールでの特徴パターニング(feature patterning)が可能となる。
DSAでは、基板の上でプレパターン(pre-pattern)を適用してもよい。そして、ブロック共重合体材料がその上で適用された場合、ブロック共重合体材料の配向を誘導できる。このプレパターンを使用して、周波数逓倍(multiplication)を達成し、例えば、プレパターンより空間周波数が大きいクロスバー構造のパターンや線パターンを作り出すことができ、これにより最終印刷構造のピッチが増加する。それゆえ、14nmより小さいパターン形状(feature)を有する高度な縮小パターニングをDSAによって達成できる。さらに、DSAを使用し、例えばプレパターンを縮小(shrink)および修正(rectify)することにより、元の印刷において欠陥を修復して均一性を向上させることができる。例えばEUVリソグラフィと組み合わせて、臨界寸法(CD)内の局所的な変化により課される制限を克服できるところ、これは例えば小さいコンタクトの形状を製造するのに有利なことがある。
一ポリマー種をエッチングにより選択的に除去する場合、当該技術分野で既知のDSA BCPエッチング法に従って、アルゴン−酸素(Ar/O)プラズマを使用できる。ポリマー成分間でのより高い選択比を達成するために、例えば、ポリスチレン−ブロック−ポリメチルメタクリレート(PS−b−PMMA)ブロック共重合体中でほぼ影響を受けないポリスチレン構造を残しつつポリメチルメタクリレート(PMMA)を効率的に除去するために、Ar/Oガスの混合物中でO濃度を低下させることが知られている。例えば、ほぼ純粋なバイアスなしのArプラズマの場合、最大8のPS/PMMA選択比を達成できる。Ar/Oプラズマ中に10%のOを導入すると、選択比は例えば2まで低下する可能性がある。残念なことに、例えばアルゴンエッチング後のPS−b−PMMA BCP層の写真の複製(reproduction)を示す図4のように、酸素を追加しないアルゴンプラズマは許容できるPMMAエッチングを生成できないことも知られている。
例えばCHFやSiClを使用してポリスチレンの上に保護カバー層を設けてエッチング選択比(specificity)を向上させることが当該技術分野で知られている。例えば、国際特許出願(WO2012/031818)では、第1の選択的エッチングを使用してポリマードメインの1つの厚さを低下させ、平坦化層をブロック共重合体材料の上に堆積させ、厚さが低下したポリマードメインの上にキャップが残るように順にエッチング除去している。これらのキャップは、エッチングの最終段階中に、下位の材料を保護している。
本発明の実施形態の目的は、自己組織化ブロック共重合体材料の良好なドライエッチングを提供することである。
高いエッチング選択性、例えば、少なくとも第1ポリマーと第2ポリマーとの間の比1〜3が達成されることは、本発明の実施形態の利点である。一ポリマーの高さの低下が、残りのポリマーをエッチング除去する際に充分に小さいか、さらにほぼ低下しない状態が維持されることは、本発明の実施形態の更なる利点である。例えば、ポリスチレン/pmmaブロック共重合体材料の場合、PMMAポリマーブロックをエッチング除去する際に、PS−b−PMMA層内でのポリスチレンパターンの低下が充分に小さいか、さらにほぼ低下しない状態が維持されることは、本発明の実施形態の利点である。
従来のAr/Oエッチングと比較して、ブロック共重合体層内で組織化したパターンがエッチングされる際に真っ直ぐな断面(straight profile)を維持することは、本発明の実施形態の利点である。従来のAr/Oエッチングと比較して、PS−b−PMMA層内のポリスチレンポリマーブロックパターンが、PMMAポリマーブロックをエッチング除去する際に真っ直ぐな断面を維持することは、本発明の実施形態の更なる利点である。エッチングファセット(faceting)の量が、例えば従来のAr/Oエッチングと比較して低くなるまで低下してもよいことは、本発明に係る実施形態の利点である。
ポリスチレン材料が受ける影響が充分に小さいか、更には影響を受けない状態としつつ、PS−b−PMMAブロック共重合体からPMMAが効率的に除去されることは、本発明の実施形態の利点である。したがって、残りのパターン転写のためにポリスチレン構造の高さができるだけ大きく維持されることは、本発明の実施形態の利点である。
上記目的は、本発明に係る方法とデバイスによって達成される。
本発明は、ブロック共重合体のリソグラフィのための方法であって、
互いに異なるエッチング耐性を有する少なくとも2つのポリマー成分を含む自己組織化したブロック共重合体層であって、前記少なくとも2つのポリマー成分のミクロ相分離によって形成された共重合体パターン構造を有する自己組織化ブロック共重合体層を、基板の上で取得する工程と、
アッシングガスを含むガスから生成したプラズマを使用した、前記自己組織化ブロック共重合体層の第1プラズマエッチング、および、ほぼ純粋な不活性ガスまたは複数の不活性ガスの混合物から生成したプラズマを使用して第1ポリマー相を選択的に除去する、前記自己組織化ブロック共重合体層の第2プラズマエッチングをそれぞれ少なくとも1回適用する(apply)工程とを含む方法に関する。
前記第2プラズマエッチングを適用する工程は、
第1プラズマエッチングのプラズマエッチングスパッタリング電力(power)以下のプラズマエッチングスパッタリング電力で実施し、かつ/または、
第1プラズマエッチングのプラズマエッチングガス圧力以下のプラズマエッチングガス圧力で実施してもよい。
アッシングガスは、酸素でもよい。
第1プラズマエッチング工程は、第2プラズマエッチング工程を実施する前に少なくとも1回実施してもよい。
第2プラズマエッチング工程は、第1プラズマエッチング工程を実施する前に少なくとも1回実施してもよい。
前記第1プラズマエッチングと前記第2プラズマエッチングを実施する工程は、前記第1プラズマエッチングと前記第2プラズマエッチングを交互に少なくとも1回繰り返すことを含んでもよい。
前記ほぼ純粋な不活性ガスは、アルゴンでもよい。
前記層の第1プラズマエッチングを実施する前記工程は、アルゴン−酸素ガス混合物から生成したプラズマを使用することを含んでもよい。
さらに、方法は、前記共重合体パターン構造を配列させるための複数のガイドを有するプレマスクパターン(pre-mask pattern)を前記基板の上に設ける工程を含んでもよい。
前記共重合体パターン構造は、ブロック共重合体層をアニールすることによって形成してもよい。
前記ブロック共重合体は、互いに共有結合した2種類のポリマー鎖を有するジブロック共重合体を含んでもよい。
前記ジブロック共重合体は、ポリスチレン−ポリイソブテン、ポリスチレン−イソプレン、ポリジメチルシロキサン−ポリイソブテン、ポリスチレン−ポリエチレンオキシド、ポリスチレン−ポリプロピレンオキシド、ポリエチレンオキシド−ポリ(シアノビフェニルオキシ)ヘキシルメタクリレート、ポリスチレン−ポリメチルメタクリレート、ポリスチレン−ポリメタクリル酸、ポリエチレンオキシド−ポリビニルピリジン、ポリスチレン−ポリビニルピリジンまたはポリイソプレン−ポリヒドロキシスチレンを含んでもよい。
前記ブロック共重合体は、2種類のポリマー鎖A,BがA−B−A状に結合し、または3種類のポリマー鎖A,B,CがA−B−C状に結合したトリブロック共重合体を含んでもよい。
ブロック共重合体層から前記第1ポリマー成分をエッチング除去した後に残る1つまたは複数のポリマー成分をレジストマスクとして使用して、基板をエッチングする工程を更に含んでもよい。
本発明は、基板の上に設けられたポリマーパターン構造を備えた、部分的に製造された集積回路であって、
前記ポリマーパターン構造は、ブロック共重合体層であり、
少なくとも1つのポリマー成分はエッチング除去されており、
前記ポリマーパターンは50nm未満、有利には20nm未満、より有利には16nm未満のハーフピッチを有する集積回路にも関する。
本発明の特定かつ好ましい態様について、添付の独立請求項と従属請求項に記載している。従属請求項からの特徴は、独立請求項の特徴および他の従属請求項の特徴と、適切にかつ単に請求項に記載されただけでないものとして組み合わせてもよい。
本発明のこれらの態様および他の態様は、以下で説明する実施形態から明らかとなり、実施形態を参照して明瞭となるであろう。
本発明の実施形態に係る例示的な方法を示す。 本発明の実施形態に係る方法に使用するための、自己組織化ジブロック共重合体層を示す。 本発明の実施形態に係る方法を使用して1つのポリマー成分をエッチング除去した後の自己組織化ジブロック共重合体層を示す。 本発明の実施形態に係る例示的な方法のArスパッタリング工程中での保護層の形成について示す。 純粋なアルゴンプラズマを用いてエッチングした後のブロック共重合体層の写真の複製を示す。 先行技術のAr/O混合物のプラズマエッチングの単一工程により得られたPS−b−PMMA層の写真を示す。 先行技術のAr/O混合物のプラズマエッチングの単一工程を使用してエッチングされたPS−b−PMMA層を示す。 本発明の実施形態に係る方法によってエッチングされたPS−b−PMMA層を示す。 本発明の実施形態に係る方法を使用してエッチングされたPS−b−PMMA層の更なる例を示す。 Ar/Oエッチングに続いてソフトArスパッタリングを適用する有利な方法の一例を、従来の(Ar/O)エッチングプロセスと比較して示しており、本発明に係る有利な実施形態の特徴を示す。
図面は概略的に過ぎず、非限定的である。図面では、説明目的のためにいくつかのエレメントの大きさが誇張され、また、スケール通り描かれていないことがある。
請求項におけるいかなる参照符号も、範囲を限定するものとして解釈されるべきではない。
異なる図面において、同一の参照符号は同一または類似のエレメントを指す。
特定の実施形態に関して、特定の図面を参照しつつ本発明について説明するが、本発明はこれに限定されず、請求項によってのみ限定される。記載された図面は、単に概略的であって非限定的である。図面では、説明目的のためにいくつかのエレメントの大きさが誇張され、また、スケール通り描かれていないことがある。寸法および相対寸法は、本発明の実施化のための実際の縮小と対応していない。
説明および請求項での用語「第1」「第2」などは、類似のエレメントを区別するために使用しており、必ずしも時間的に、空間的に、序列でまたは他のいずれかの方法でシーケンスを表すために使用しているのではない。こうして使用した用語は、好適な状況下で交換可能であり、本明細書で説明した本発明の実施形態は、本明細書で説明または図示したものとは別のシーケンスで動作可能であると理解すべきである。
さらに、説明および請求項での用語「上(top)」「下(under)」などは、説明目的で使用しており、必ずしも相対的な位置を記述するためには使用しているのではない。こうして使用した用語は、好適な状況下で交換可能であって、本明細書で説明した本発明の実施形態は、本明細書で説明または図示したものとは別の向きで動作可能であると理解すべきである。
請求項で使用する用語「備える、有する、含む(comprising)」は、それ以降に列挙された手段に限定されるように解釈すべきでない。それは、他のエレメントまたは工程を除外しない。記述した特徴、整数、工程またはコンポーネントの存在は、参照したように特定するよう解釈する必要があるが、1つ以上の他の特徴、整数、工程もしくはコンポーネント、またはこれらのグループの存在または追加を除外しない。したがって、「手段AとBとを備えたデバイス」という表現の範囲を、コンポーネントAとBだけからなるデバイスに限定すべきでない。それは、本発明に関して、AとBが、関連するデバイスのコンポーネントであることを意味するに過ぎない。
この明細書を通じて「一実施形態(one embodimentまたはan embodiment)」が意味するのは、当該実施形態と関連して説明される特定の特徴、構造または特性は、本発明の少なくとも一つの実施形態に含まれるということである。したがって、この明細書を通じてさまざまな場所で現れるフレーズ「一実施形態で」は、必ずしもすべてが同じ実施形態を参照するわけではないが、参照してもよい。さらに、特定の特徴、構造または特性は、この開示から当業者にとって明らかなように、1つ以上の実施形態において、任意の好適な方法で組み合わせることができる。
同様に、本発明の例示的な実施形態の説明において、本発明の種々の特徴は、開示を簡素化し、1つ以上の種々の発明の態様の理解を支援する目的で、単一の実施形態、図面、またはその説明の中に一緒にグループ化されることがあると認識すべきである。しかし、この開示の方法は、請求項に記載の発明が、各請求項に明確に記載されたものより多くの特徴を必要とするという意図を反映していると解釈すべきではない。むしろ、以下の請求項に反映されているように、発明の態様は、先に開示された単一の実施形態のすべての特徴より少なくなる。したがって、詳細な説明に続く請求項は、この詳細な説明中に明確に包含され、各請求項は、この発明の別々の実施形態としてそれ自身で成立する。
さらに、本明細書で説明されるいくつかの実施形態は、他の実施形態に含まれるいくつかの特徴は含むが他の特徴は含まず、当業者が理解することになるように、異なる実施形態の特徴の組み合わせは、本発明の範囲内であって、異なる実施形態を形成することが意図されている。例えば、以下の請求項において、請求項記載の実施形態のいずれもが、任意の組み合わせで使用可能である。
本明細書でされる説明において、多くの具体的詳細が記載される。しかし、本発明の実施形態は、これらの具体的詳細なしに実践できることが理解される。他の例では、周知の方法、構造および技術は、この説明の理解を不明瞭にしないために、詳細には示されていない。
本発明の実施形態で、「ブロック共重合体」は、化学的に異なる2つ以上のポリマーブロック、例えばジブロック、トリブロック、スター、くし型(comb)または制御された構造を有する他のポリマーを有するポリマーを指す。通常、ブロックは、親水性または疎水性の度合いなどのさまざまな化学特性を有しうる。通常、ブロックは、ある温度範囲にわたって互いに非混和性を有するか部分的にのみ混和性を有し、例えば分離したミクロ相ドメインを形成でき、これにより自己組織化が可能となる。自己組織化は、異なるポリマーブロック間の化学的差異、例えば親和性/疎水性の不均衡を基礎とすることができる。かかるブロック共重合体は、当該技術分野で既知の方法、例えば原子移動ラジカル重合、可逆的付加フラグメンテーション連鎖移動重合、ニトロキシド媒介重合、ホウ素媒介重合または触媒的連鎖移動重合によって得ることができる。
本発明の実施形態で、「アニーリング」は、ブロック共重合体材料中のミクロ相分離によって構造の自己組織化を可能にするプロセスを指す。
本発明の実施形態で、「アッシングガス」(ashing gas)は、フォトレジストを除去するための既知の任意のガスを指し、例えばO、CO、SO、NO、NO、N/OまたはH/Nガスの混合物であるが、これに限定されることはない。このようなアッシングガスは、不活性(例えばAr)搬送ガス/希釈剤と混合できる。
第1の態様で、本発明は、ブロック共重合体のリソグラフィのための方法に関する。この方法は、自己組織化したブロック共重合体層を有する基板を取得する工程を含む。この自己組織化共重合体層は、互いに異なるエッチング耐性を有する少なくとも2つのポリマー成分を含む。さらに、自己組織化ブロック共重合体層は、少なくとも2つのポリマー成分のミクロ相分離によって生成した共重合体パターン構造を有する。方法はさらに、少なくともアッシングガスを含むガスから生成したプラズマを使用した前記自己組織化ブロック共重合体層の第1プラズマエッチング14と、ほぼ純粋な不活性ガスまたは不活性ガスの混合物から生成したプラズマを使用した前記自己組織化ブロック共重合体層の第2プラズマエッチング16とをそれぞれ少なくとも一度適用して、第1ポリマー相を選択的に除去することを含む。第2プラズマエッチングは、本明細書にてソフトスパッタリング工程とも呼ぶ。第2プラズマエッチング中に反応性ガスは使用しない。それゆえ、ほぼ純粋な不活性ガスまたは不活性ガスの混合物の存在下でのエッチングはスパッタリング工程である。プラズマエッチング工程での順序は、第1プラズマエッチングに続いて第2プラズマエッチングを実施するか、第2プラズマエッチングに続いて第1プラズマエッチングを実施するか、のいずれかが可能であるが、少なくともアッシングガスを含むガスから生成したプラズマを使用したプラズマエッチング工程でエッチングプロセスを開始することが有利なことが判ってきた。したがって、エッチング工程の順序は、図1に示したものが有利であろうが、幾つかの実施形態では逆の順序でもよく、即ち有利には、第1エッチング工程14の前に第2エッチング工程16をまず実施してもよい。第1プラズマエッチングは、第2プラズマエッチングのプラズマエッチングスパッタリング電力が第1プラズマエッチングのプラズマエッチングスパッタリング電力以下であるように、かつ/または、第2プラズマエッチングのプラズマエッチングガス圧力が、第1プラズマエッチングのプラズマエッチングガス圧力以下であるように実施する。
エッチング工程のいずれにおいても成長ガス(deposition gas)(例えばC含有ガス)を使用しないことに留意されたい。
例示的に、本発明の実施形態はこれに限定されないが、このエッチング方法について、標準の工程と選択的な工程を示す図1を参照して説明することになる。
図1を参照すると、本発明の実施形態に係るブロック共重合体のリソグラフィ、例えば上側にブロック共重合体層が設けられた基板のエッチングのための例示的な方法10について示されている。かかる方法は、集積回路の分野において、例えばトランジスタの大きさと間隔とを低下させる手段および/または小型の形状で欠陥を修正する手段として有用であり得る。したがって、本発明の実施形態に係る方法を利用することによって、集積回路にて、100nmより小さい形状、例えば50nmより小さい形状、一例で20nmより小さい形状、例えば16nmより小さい形状、または14nmより小さい形状、または10nmより小さい形状、一例では5nmより小さい形状を達成できる。
この方法10は、基板、例えばシリコン基板のような半導体基板、または二酸化珪素基板の上で自己組織化ブロック共重合体層を取得する工程12を含む。この基板はまた、積層構造、例えばシリコン−絶縁体−シリコン構造でもよく、および/または前段の処理工程により内部に設けられる構造を有してもよい。自己組織化ブロック共重合体層は、互いに異なるエッチング耐性を有する少なくとも2つのポリマー成分を含む。例えば、共有結合により鎖末端で接続された化学的に異なる2つ以上のホモポリマーブロックからなるポリマー組成物を、ハケ塗り、圧延、吹きつけ、インクジェットの利用またはスピンコートにより基板の上にコーティングできる。ポリマー組成物は、接着剤、接着促進剤および/または溶媒といった添加物をさらに含んでもよい。例えば、自己組織化ブロック共重合体層は、互いに共有結合した2種類のポリマー鎖を含むジブロック共重合体から形成されてもよい。例えばかかるジブロック共重合体は、ポリスチレン−ポリイソブテン、ポリスチレン−イソプレン、ポリジメチルシロキサン−ポリイソブテン、ポリスチレン−ポリエチレンオキシド、ポリスチレン−ポリプロピレンオキシド、ポリエチレンオキシド−ポリ(シアノビフェニルオキシ)ヘキシルメタクリレート、ポリスチレン−ポリメタクリル酸、ポリエチレンオキシド−ポリビニルピリジン、ポリスチレン−ポリビニルピリジンまたはポリイソプレン−ポリヒドロキシスチレンを含んでもよい。好ましくは、かかるジブロック共重合体は、ポリメチルメタクリレート(PMMA)鎖に共有結合したポリスチレン(PS)鎖を有してもよい。ポリスチレンとPMMAは、アルゴンプラズマを用いたドライエッチングに対して有利なエッチング耐性比を有する。代替として、自己組織化ブロック共重合体層は、例えば2種類のポリマー鎖A,BがA−B−A状に結合し、3種類のポリマー鎖A,B,CがA−B−C状に結合したトリブロック共重合体組成物から形成できる。
さらに、自己組織化ブロック共重合体層は、少なくとも2つのポリマー成分のミクロ相分離によって形成される共重合体パターン構造を有する。例えば、基板の上にコーティングされたポリマー組成物を例えばガラス転移温度または溶融温度より高い温度でアニールすることができ、その間に、ポリマー組成物の成分は自己組織化して構造化されたドメインとなりえ、これにより共重合体パターン構造が形成される。例えば、熱アニーリングは、組成物の少なくとも1つのポリマー成分のガラス転移温度または溶融温度の低い方の値を超える温度で使用できる。アニーリング時間は、自己組織化を可能にするよう選択でき、0.01時間〜300時間、好ましくは0.1時間〜24時間でもよい。
ブロック共重合体の各ブロックの全鎖長と分子量を適切に選択することによって、例えば、当該技術分野で知られたフローリーハギンズ(Flory Huggins)パラメータを適切に選択することによって、この共重合体パターン構造の形態を調整し、例えば板状構造(lamellae)、シリンダ、球をブロック共重合体層内に作り出すことができる。ブロック共重合体の分子量は、例えばブロックの末端間距離が所望のパターンの最小形状と同等となる(commensurate)ように選択できる。好ましい分子量として、200g/mol〜1000000g/mol、例えば、2000g/mol〜100000g/molが可能である。
本発明に係る実施形態で、方法10は、基板の上にプレマスクパターンを設ける工程18を含んでもよい。かかるプレマスクパターンは、共重合体パターン構造を配列させるための複数のガイドを有してもよい。この複数のガイドは、物理的または化学的特性の局所的な違い、例えば親水性の局所的な違いによって形成できる。プレマスクは、当技術分野で知られた方法で作成できる。例えば、グラフォエピタキシ法を使用して、基板の上にレリーフ構造を刻むことができ、その結果、形成された低空間周波数パターンを使用して高空間周波数のブロック共重合体パターンを規律し(constrain)、配列させることができる。同様に、化学エピタキシ法を使用して、親水性といった化学的特性の局所的な差がBCP内のポリマー成分の選択的な(preferential)配列をパターンに沿って誘導するようなパターンを、基板の上に設けることができる。したがって、共重合体パターン構造の配列は、プレマスクパターンに対する1つの相成分の選択的な引力(attraction)を基礎としてもよく、例えば、親水性/疎水性の違いといった相成分の異なる化学的特性を基礎としてもよい。これにより、共重合体パターン構造、例えば基板の近傍でのプレマスクパターンの空間周波数逓倍において、プレマスクパターンの複製(replication)が得られる。必要に応じて、ブロック共重合体層の上部を、例えば基板から除去された側部から開始して、例えば、均一で選択的なエッチング、カッティングまたは研磨工程によって除去し、このパターンの複製がプレマスクから外れうる領域を除去できる。例えば図2は、基板、例えばシリコン基板23の上に設けられた層22に層状共重合体パターン構造がレジストとして設けられた(registered)状態でのアニール後のブロックポリマー層21を示す。層22は、プレマスクパターンを含んでもよい。さらに、層22は、中立層(neutral layer:NUL)を含んでもよい。中立層は、例えば、約50%のポリスチレンと約50%のPMMAの混合物でもよい。プレマスク22’を作成する方法は、論文(”Comparison of Directed Self-Assembly Integrations” by Somervell et al. published at SPIE Advanced Lithography, February 2012)に記載されているように当業者に知られており、例えば作成できる。プレマスクパターン22’と中立層22’’を例示的に図2,3に示している。例えば、ブロックポリマー層21は、第1ポリマー成分、例えばポリスチレン24のブロックドメインと、第2ポリマー成分、例えばPMMA25のブロックドメインを交互に含んでもよい。図3は、第2ポリマー成分、例えばPMMA25をエッチング除去した後のブロックポリマー層21を示す。
さらに、方法10は、第1プラズマエッチング14と第2プラズマエッチング16をそれぞれ少なくとも1回実施することを含む。第1プラズマエッチングと第2プラズマエッチングのいずれか一方を最初のエッチング工程として実施し、他方のプラズマエッチング工程を続けて実施できることに留意すべきである。第1プラズマエッチング14は、アッシングガスから生成したプラズマを使用した、自己組織化ブロック共重合体層のプラズマエッチングである。かかるアッシングガスは、任意の適切なアッシングガスであってよい。使用可能なアッシングガスの一例は酸素である。いくつかの実施形態では、あまりに高速で発生するアッシングを防止するために、アッシングガスは、50%未満の濃度、有利には20%未満の濃度、さらに有利には10%未満の濃度で存在してもよい。一例では、不活性ガスと酸素の混合物、例えば第2プラズマエッチング16で使用するのと同じ不活性ガスと酸素の混合物からこの第1プラズマを生成させることができる。例えば、第1プラズマは、95%のアルゴンと5%の酸素とから生成させることができる。明らかなことだが、このような混合物は、有意な態様でエッチングに影響を与えないことが知られている少量の他の元素または分子の痕跡(trace)を含有してもよい。第1プラズマエッチング14は、反応性イオンエッチング工程を含んでもよい。
第2プラズマエッチング16は、ほぼ純粋な不活性ガスから生成したプラズマを使用して第1ポリマー相を選択的に除去する、自己組織化ブロック共重合体層のプラズマエッチングである。「ほぼ純粋」は、ガスの混合物が、無視できる量の不純物のみを含むことを指しており、優先的に(preferentially)純粋であるが、かかる混合物は、有意な態様でプラズマエッチングに影響を与えないことが知られているような少量の他の元素または分子の痕跡を含有してもよいと理解すべきである。「不活性ガス」は、ブロック共重合体材料およびその構成物質と化学反応を引き起こさないか、無視できる程度に引き起こすガスを指す。例えば、希ガスや窒素は、有機化合物と反応できず、または弱く反応するだけである。この第2プラズマエッチング16は、スパッタリング工程を含んでもよい。例えば、アルゴン(Ar)プラズマを使用して、1つのポリマー成分、例えばPMMAに相当する材料を、ポリスチレン内に形成された共重合体パターン構造といった他のポリマー成分を適切な位置に(in place)残しつつ、選択的に除去できる。共重合体が2つより多い成分を含む場合、この不活性ガスを用いたエッチングに対するエッチング耐性は、例えば、第1成分を充分にエッチング除去し、第2成分をより低度にエッチング除去し、第3成分をさらに影響を受けない状態とするエッチングによって3次元構造を形成できるように、3成分で異なってもよい。
例えば、ポリスチレン−ブロック−ポリ(メチルメタクリレート)層(PS−b−PMMA)の場合、アルゴンプラズマは、ポリスチレンパターン構造を破壊することなくPMMAを除去できる。例えば、アルゴンプラズマを用いたバイアスなしでのドライエッチング工程は、PMMA対PSの選択比で、例えば8を達成できる。
前述の通り、最初のエッチング工程は、第1プラズマエッチング工程または第2プラズマエッチング工程のいずれでもよく、これらの工程は、繰り返し、交互に実施できる。第1プラズマエッチングを実施する工程14と第2プラズマエッチングを実施する工程16は、少なくとも一度、例えばポリマー相に相当するほぼすべての材料が除去されるまで繰り返すことができる。例えば、ArプラズマとAr/Oプラズマの切り替えは、ポリスチレン構造の真っ直ぐな断面を維持しつつ、ほぼすべてのPMMA材料を除去するまでに、数サイクル、例えば2サイクルまたは10サイクル未満を必要とすることがある。エッチング14と16を一度実施すれば充分である場合もあるが、これらの工程を複数サイクル繰り返すことが有利であろう。これは、厚いPMMA層を使用する場合には特に有利である。例として、本実施例で説明しているArスパッタリング工程の間に実施される、ポリスチレンの上側での保護層の形成を図4に示している。
この第1プラズマエッチング14が、例えばPS−b−PMMA層内で第2エッチング工程16により生じたエッチング残渣を除去でき、ポリスチレンの上にスパッタリングされ、または再堆積した不揮発性PMMAエッチング残渣を酸素エッチング工程14により揮発性材料に変質させ、続けて効率的に除去できることは、本発明の少なくともいくつかの実施形態の利点である。特定のエッチングが低下し、例えば、残りのポリマー成分、例えばポリスチレンによって形成されるポリマーパターンがエッチング後により良好に保存されることは、例えばAr/O混合プラズマを用いた単一工程のエッチングと比較した場合の、本発明の実施形態に係る二段階エッチング14,16または16,14の更なる利点である。例えば図5を参照すると、純粋なアルゴンガスを用いて得られる第2プラズマエッチング工程16後のPS−b−PMMA層の写真が示されており、ポリスチレンの上に蓄積したエッチング残渣30を示している。アルゴンエッチング単独で高い選択比を得ることができるが、例えば高解像度の半導体製造においてはエッジやコーナーの正確な規定(definition)が有利であると考えられるため、これらの残渣は好ましくない。
さらに、簡単にするためにPS−b−PMMAエッチングの例を考えると、第2プラズマエッチング工程16で生成した、ポリスチレンの上でスパッタリングされ再堆積したPMMAは、自己マスク効果(self-masking effect)を有することができ、これによりポリスチレンに対するエッチング低減層として機能する。このエッチング低減層は、第1プラズマエッチング工程14中に、シーケンス16,14で続けて除去される。それゆえ、本発明の実施形態に係る方法10によって、より急峻なパターンの傾斜プロファイルと、微細スケール構造のより良好な保存を達成できる。一例として、図6は、Ar/Oエッチング工程の単一工程を使用した先行技術のエッチング方法によって得られたPS−b−PMMA層の写真を示している。図から判るように、ポリスチレンは減少し、パターンの傾斜プロファイルは悪化している。
比較のため、図7は、先行技術の方法を使用してエッチングされた、Ar/Oプラズマへの21sの曝露によるPS−b−PMMA層を示している。図8は、14−16−14の連続した処理工程、即ちAr/Oプラズマへ10s、Arプラズマへ10s、Ar/Oプラズマへ10sの曝露することによる、本発明に係る方法でエッチングされた同様の層を示す。図から判るように、図8の層は、同じプロファイル高さについて急峻なエッジとはっきりした(sharp)形状のより良好な規定を示しており、ポリスチレン中にエッチングは生じていない(後述するように、図10でも見られる)。
さらに、本発明に係る実施形態で、方法10は、ブロック共重合体層から前記第1ポリマー成分、例えばPMMA材料をエッチング除去した後に残るポリマー成分(1つまたは複数の)、例えばポリスチレン中に形成されるパターンをリソグラフィレジストマスクとして使用して、基板をエッチングする工程を含んでもよい。
第2の態様で、本発明は、例えば図3に示すように、基板23の上に設けられたポリマーパターン構造24を備え、少なくとも部分的に製造された集積回路40に関する。このポリマーパターン構造は、本発明の第1の態様に係る方法で、ブロック共重合体層21の少なくとも1つのポリマー成分25をエッチング除去することにより得られる。通常、このような構造は、少なくとも1つのポリマー成分(25)がエッチング除去されるようなブロック共重合体層を含み、前記ポリマーパターンは、50nm未満、有利には20nm未満、より有利には16nm未満のハーフピッチを有する。
本発明の実施形態はこれに限定されることはないが、例示的に、本発明の一実施形態に従ってpmmaをエッチングするためのソフトアルゴンスパッタリングとアルゴン/酸素スパッタリングの組合せを使用して得られた結果の考察を以下に示す。
この例で使用した、PMMAと中立層のエッチングが最適化された誘導自己組織化の試料は、化学エピタキシフローを用いて調製した。厚さ30nmのブロック共重合体(PS−b−PMMA)膜を中立層の上にコーティングし、アニールした。中立層(8nm)は、ポリスチレンとPMMAの混合物であった。ブロック共重合体は、窒化シリコン基板の上のオプト(opt)で、架橋ポリスチレン(PS)のガイドストライプ(guiding stripe)を用いて自己配列させた。アニール後、ブロック共重合体は、ハーフピッチ14nmの層状PMMA/PS 線/空間構造を形成した。
別の実施例では、共にアルゴンと酸素の混合物を使用したエッチング工程の組合せを実施し、その後、ソフトArスパッタリング工程を適用した。Ar/Oプラズマ(14)でのエッチング工程は、850sccm Ar/60sccm O、75mTから150mTのプラズマエッチングガス圧力、70Wから300Wのプラズマエッチングスパッタリング電力で実施した。ソフトArスパッタリング工程とも呼ばれる第2エッチング工程(16)は、約850sccmのAr流量、70mTから150mTのプラズマエッチングガス圧力、約70Wから300Wのプラズマエッチングスパッタリング電力で実施した。アルゴン/酸素エッチング工程で10秒から20秒のタイミングを、アルゴンソフトスパッタリング工程で10秒から20秒のタイミングを適用した。当該工程を交互に繰り返した。ソフトアルゴンスパッタリングを適用することによって、ポリスチレン高さはエッチングされない状態を維持し、表面はより滑らかであることが判った。有利なことに、ソフトArスパッタリングは、70Wのプラズマエッチングスパッタリング電力と約70mTのプラズマエッチングガス圧力で達成できる。36nm低下した連続的なアルゴン/酸素エッチングと比較して、ポリスチレンは4nmだけ低下した。図9は、上記のエッチングプロセスの結果の走査型電子顕微鏡像を示す。
更なる例として、本発明の実施形態はこれに限定されないが、上記スパッタリングエッチングプロセスを使用して得られた結果の一例を示す。この例では、まず、アルゴン/酸素エッチング工程を実施し、その後、アルゴンスパッタリング工程を実施する。図10の左側に、第1エッチング工程の結果を上面図と断面図で示しており、図10の右側に、追加の第2エッチング工程の結果を上面図と断面図で示している。エッチング工程について使用した条件は、第1エッチング工程では、75mT、100Wで850 Ar/60 Oのアルゴンと酸素の混合物での10sのエッチングであり、第2エッチング工程では70mT、電力75Wでの20sのスパッタリングである。これらの工程(最後の工程は、ソフトアルゴンスパッタリング工程の典型例である)とそのシーケンスにより良好なエッチングプロセスが得られ、ポリスチレン内でエッチングは生じない。

Claims (15)

  1. ブロック共重合体のリソグラフィのための方法であって、
    互いに異なるエッチング耐性を有する少なくとも2つのポリマー成分を含む自己組織化ブロック共重合体層であって、前記少なくとも2つのポリマー成分のミクロ相分離によって形成された共重合体パターン構造を有する自己組織化ブロック共重合体層を、基板の上で取得する工程(12)と、
    アッシングガスを含むガスから生成したプラズマを使用した、前記自己組織化ブロック共重合体層の第1プラズマエッチング(14)、および、ほぼ純粋な不活性ガスまたは複数の不活性ガスの混合物から生成したプラズマを使用して第1ポリマー相を選択的に除去する、前記自己組織化ブロック共重合体層の第2プラズマエッチング(16)をそれぞれ少なくとも1回適用する工程とを含む方法(10)。
  2. 前記第2プラズマエッチング(16)を適用する工程は、
    第1プラズマエッチング(14)のプラズマエッチングスパッタリング電力以下のプラズマエッチングスパッタリング電力で実施し、かつ/または、
    第1プラズマエッチング(14)のプラズマエッチングガス圧力以下のプラズマエッチングガス圧力で実施する、請求項1に記載の方法(10)。
  3. アッシングガスは、酸素である、請求項1または2に記載の方法(10)。
  4. 第1プラズマエッチング工程(14)は、第2プラズマエッチング工程(16)を適用する前に少なくとも1回適用する、請求項1〜3のいずれかに記載の方法。
  5. 第2プラズマエッチング工程(16)は、第1プラズマエッチング工程(14)を実施する前に少なくとも1回実施する、請求項1〜3のいずれかに記載の方法。
  6. 前記第1プラズマエッチング(14)と前記第2プラズマエッチング(16)を実施する工程は、前記第1プラズマエッチング(14)と前記第2プラズマエッチング(16)を交互に少なくとも1回繰り返すことを含む、請求項1〜5のいずれかに記載の方法。
  7. 前記ほぼ純粋な不活性ガスは、アルゴンである、請求項1〜6のいずれかに記載の方法。
  8. 前記層の第1プラズマエッチングを実施する前記工程(16)は、アルゴン−酸素ガス混合物から生成したプラズマを使用することを含む、請求項1〜7のいずれかに記載の方法。
  9. 前記共重合体パターン構造を配列させるための複数のガイドを有するプレマスクパターンを前記基板の上に設ける工程(18)をさらに含む、請求項1〜8のいずれかに記載の方法。
  10. 前記共重合体パターン構造は、ブロック共重合体層をアニールすることによって形成する、請求項1〜9のいずれかに記載の方法。
  11. 前記ブロック共重合体は、互いに共有結合した2種類のポリマー鎖を有するジブロック共重合体を含む、請求項1〜10のいずれかに記載の方法。
  12. 前記ジブロック共重合体は、ポリスチレン−ポリイソブテン、ポリスチレン−イソプレン、ポリジメチルシロキサン−ポリイソブテン、ポリスチレン−ポリエチレンオキシド、ポリスチレン−ポリプロピレンオキシド、ポリエチレンオキシド−ポリ(シアノビフェニルオキシ)ヘキシルメタクリレート、ポリスチレン−ポリメチルメタクリレート、ポリスチレン−ポリメタクリル酸、ポリエチレンオキシド−ポリビニルピリジン、ポリスチレン−ポリビニルピリジンまたはポリイソプレン−ポリヒドロキシスチレンを含む、請求項11に記載の方法。
  13. 前記ブロック共重合体は、2種類のポリマー鎖A,BがA−B−A状に結合し、または3種類のポリマー鎖A,B,CがA−B−C状に結合したトリブロック共重合体を含む、請求項1〜10のいずれかに記載の方法。
  14. ブロック共重合体層から前記第1ポリマー成分をエッチング除去した後に残る1つまたは複数のポリマー成分をレジストマスクとして使用して、基板をエッチングする工程を更に含む、請求項1〜13のいずれかに記載の方法。
  15. 基板(23)の上に設けられたポリマーパターン構造(24)を備えた、部分的に製造された集積回路(40)であって、
    前記ポリマーパターン構造は、ブロック共重合体層であり、
    少なくとも1つのポリマー成分(25)は、エッチング除去されており、
    前記ポリマーパターンは、50nm未満、有利には20nm未満、より有利には16nm未満のハーフピッチを有する集積回路。
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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016111115A (ja) * 2014-12-04 2016-06-20 東京エレクトロン株式会社 基板処理方法、プログラム、コンピュータ記憶媒体及び基板処理システム
WO2017132238A1 (en) * 2016-01-27 2017-08-03 Tokyo Electron Limited A plasma treatment method to meet line edge roughness and other integration objectives
JP2018530149A (ja) * 2015-09-11 2018-10-11 コミサリヤ・ア・レネルジ・アトミク・エ・オ・エネルジ・アルテルナテイブ ブロックコポリマーの選択的エッチング方法
WO2020161879A1 (ja) * 2019-02-08 2020-08-13 株式会社 日立ハイテクノロジーズ ドライエッチング方法及びドライエッチング装置

Families Citing this family (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9050621B2 (en) * 2013-01-24 2015-06-09 Corning Incorporated Surface nanofabrication methods using self-assembled polymer nanomasks
US9666447B2 (en) * 2014-10-28 2017-05-30 Tokyo Electron Limited Method for selectivity enhancement during dry plasma etching
EP3062334B1 (en) 2015-02-27 2020-08-05 IMEC vzw Method for patterning an underlying layer
US9646883B2 (en) 2015-06-12 2017-05-09 International Business Machines Corporation Chemoepitaxy etch trim using a self aligned hard mask for metal line to via
US9768059B1 (en) 2016-04-07 2017-09-19 International Business Machines Corporation High-chi block copolymers for interconnect structures by directed self-assembly
CN108231984A (zh) * 2018-01-31 2018-06-29 华南理工大学 一种相分离手段实现的钙钛矿图案化膜片及其制作方法
WO2020040178A1 (ja) * 2018-08-23 2020-02-27 東京エレクトロン株式会社 基板処理方法及び基板処理システム
KR20220125776A (ko) 2021-03-07 2022-09-14 오영운 돼지갈비 포의 가공 및 분류방법

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003258296A (ja) * 2001-12-28 2003-09-12 Toshiba Corp 発光素子およびその製造方法
JP2011228713A (ja) * 2010-04-22 2011-11-10 Commissariat A L'energie Atomique Et Aux Energies Alternatives 2つの自己整合型独立ゲートを有するメモリの製作
JP2012078828A (ja) * 2010-10-04 2012-04-19 Rohm & Haas Electronic Materials Llc 下層組成物および下層を像形成する方法
JP2012178428A (ja) * 2011-02-25 2012-09-13 Toshiba Corp パターンデータ生成装置、パターンデータ生成方法、及びパターン形成方法

Family Cites Families (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TW576864B (en) * 2001-12-28 2004-02-21 Toshiba Corp Method for manufacturing a light-emitting device
US7449414B2 (en) * 2006-08-07 2008-11-11 Tokyo Electron Limited Method of treating a mask layer prior to performing an etching process
WO2010096363A2 (en) 2009-02-19 2010-08-26 Arkema Inc. Nanofabrication method
JP5300799B2 (ja) * 2010-07-28 2013-09-25 株式会社東芝 パターン形成方法及びポリマーアロイ下地材料
US8382997B2 (en) * 2010-08-16 2013-02-26 Tokyo Electron Limited Method for high aspect ratio patterning in a spin-on layer
WO2012031818A2 (en) 2010-09-09 2012-03-15 Asml Netherlands B.V. Lithography using self-assembled polymers
US8551877B2 (en) * 2012-03-07 2013-10-08 Tokyo Electron Limited Sidewall and chamfer protection during hard mask removal for interconnect patterning

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003258296A (ja) * 2001-12-28 2003-09-12 Toshiba Corp 発光素子およびその製造方法
JP2011228713A (ja) * 2010-04-22 2011-11-10 Commissariat A L'energie Atomique Et Aux Energies Alternatives 2つの自己整合型独立ゲートを有するメモリの製作
JP2012078828A (ja) * 2010-10-04 2012-04-19 Rohm & Haas Electronic Materials Llc 下層組成物および下層を像形成する方法
JP2012178428A (ja) * 2011-02-25 2012-09-13 Toshiba Corp パターンデータ生成装置、パターンデータ生成方法、及びパターン形成方法

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016111115A (ja) * 2014-12-04 2016-06-20 東京エレクトロン株式会社 基板処理方法、プログラム、コンピュータ記憶媒体及び基板処理システム
JP2018530149A (ja) * 2015-09-11 2018-10-11 コミサリヤ・ア・レネルジ・アトミク・エ・オ・エネルジ・アルテルナテイブ ブロックコポリマーの選択的エッチング方法
WO2017132238A1 (en) * 2016-01-27 2017-08-03 Tokyo Electron Limited A plasma treatment method to meet line edge roughness and other integration objectives
US9978563B2 (en) 2016-01-27 2018-05-22 Tokyo Electron Limited Plasma treatment method to meet line edge roughness and other integration objectives
WO2020161879A1 (ja) * 2019-02-08 2020-08-13 株式会社 日立ハイテクノロジーズ ドライエッチング方法及びドライエッチング装置
KR20200098386A (ko) 2019-02-08 2020-08-20 주식회사 히타치하이테크 드라이 에칭 방법 및 드라이 에칭 장치
JPWO2020161879A1 (ja) * 2019-02-08 2021-02-18 株式会社日立ハイテク ドライエッチング方法及びドライエッチング装置

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