JP2013131790A - 非可逆回路素子 - Google Patents
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Abstract
【解決手段】永久磁石41と、該永久磁石41により直流磁界が印加されるマイクロ波用磁性体32と、該マイクロ波用磁性体32に、互いに電気的に絶縁状態で交差して配置された少なくとも二つの中心電極と、整合用容量素子C1,C2と、中心電極、整合用容量素子C1,C2を接続するための配線導体21〜26が表面に形成された回路基板20とを備えた非可逆回路素子。回路基板20の表面に形成された少なくとも一つの配線導体21と対向する浮き導体27が回路基板20の内部に形成されており、少なくとも一つの配線導体21と浮き導体27との間に容量が形成されている。
【選択図】図2
Description
永久磁石と、
前記永久磁石により直流磁界が印加されるマイクロ波用磁性体と、
前記マイクロ波用磁性体に、互いに電気的に絶縁状態で交差して配置された少なくとも二つの中心電極と、
整合用容量素子と、
前記中心電極、前記整合用容量素子を接続するための配線導体が表面に形成された回路基板と、
を備え、
前記回路基板の表面に形成された少なくとも一つの配線導体と対向する浮き導体が前記回路基板の内部に形成されており、前記少なくとも一つの配線導体と前記浮き導体との間に容量が形成されていること、
を特徴とする。
永久磁石と、
前記永久磁石により直流磁界が印加されるマイクロ波用磁性体と、
前記マイクロ波用磁性体に、互いに電気的に絶縁状態で交差して配置された少なくとも二つの中心電極と、
整合用容量素子と、
前記中心電極、前記整合用容量電極を接続するための配線導体が表面及び内部に形成された回路基板と、
を備え、
前記回路基板の表面に形成された少なくとも一つの配線導体と前記回路基板の内部に形成された少なくとも一つの配線導体との間に浮き導体が形成されており、前記二つの配線導体と前記浮き導体との間に容量が形成されていること、
を特徴とする。
永久磁石と、
前記永久磁石により直流磁界が印加されるマイクロ波用磁性体と、
前記マイクロ波用磁性体に、互いに電気的に絶縁状態で交差して配置された少なくとも二つの中心電極と、
整合用容量素子と、
前記中心電極、前記整合用容量電極を接続するための配線導体が表面及び内部に形成された回路基板と、
を備え、
前記回路基板の表面に形成された少なくとも一つの配線導体と前記回路基板の内部に形成された少なくとも一つの配線導体とが互いに対向して容量が形成されていること、
を特徴とする。
が設計値よりも太くなるとそのインダクタンス値が小さくなり、同時に配線導体と浮き導体又は他の配線導体との間に形成される容量値は大きくなる。配線導体のインダクタンス値が小さくなるとアイソレーションの中心周波数は高くなり、容量値が大きくなるとアイソレーションの中心周波数は低くなる。
第1実施例である2ポート型アイソレータは図1(A)に示す基本的な等価回路にて構成されている。即ち、図示しない永久磁石により直流磁界が印加されるフェライト32と、該フェライト32に互いに電気的に絶縁状態で交差して配置された第1中心電極35(インダクタンスL1)及び第2中心電極36(インダクタンスL2)とを備えている。第1中心電極35は、一端が入力ポートP1に接続され、他端が出力ポートP2に接続されている。第2中心電極36は、一端が出力ポートP2に接続され、他端がグランドポートP3に接続されている。入力ポートP1と出力ポートP2との間に終端抵抗Rが第1中心電極35と並列に接続され、入力ポートP1と出力ポートP2との間に整合用コンデンサC1が接続され、出力ポートP2とグランドポートP3との間に整合用コンデンサC2が接続されている。
目36i、中継用電極36j、3ターン目36kがフェライト32の表面にそれぞれ形成されている。3ターン目36kの下端部はフェライト32の下面に形成した接続用電極36lに接続されている。
Lx=Lx1+Lx2
Cx=Cx1・Cx2/(Cx1+Cx2)
第2実施例である2ポート型アイソレータは、図7及び図8に示すように、回路基板20の上面に形成した配線導体22と対向する配線導体21’を回路基板20の内部に形成したものであり、内部の配線導体21’はビアホール導体29e,29fを介して上面の配線導体21と接続されている。即ち、内部の配線導体21’は第1中心電極35の一端(入力ポートP1)とコンデンサC1とを接続している。本第2実施例の他の構成は前記第1実施例と同様である。
りである。
第3実施例である2ポート型アイソレータは、図9に示すように、回路基板20の上面に形成した配線導体22と内部に形成した配線導体21との間に浮き導体28を形成したものである。他の構成は前記第1実施例と同様である。配線導体21,22がインダクタンスLx1,Lx2を有し、配線導体22と浮き導体28との間に容量Cx1が形成され、配線導体21と浮き導体28との間に容量Cx2が形成されることになる。インダクタンスLx1,Lx2及び容量Cx(Cx1,Cx2)の作用効果は前記第1実施例で説明したとおりである。
なお、本発明に係る非可逆回路素子は前記実施例に限定するものではなく、その要旨の範囲内で種々に変更することができる。
21,22…配線導体
27,28…浮き導体
30…フェライト・磁石素子
32…フェライト
35…第1中心電極
36…第2中心電極
41…永久磁石
P1…入力ポート
P2…出力ポート
P3…グランドポート
R…終端抵抗
C1,C2…コンデンサ
Claims (6)
- 永久磁石と、
前記永久磁石により直流磁界が印加されるマイクロ波用磁性体と、
前記マイクロ波用磁性体に、互いに電気的に絶縁状態で交差して配置された少なくとも二つの中心電極と、
整合用容量素子と、
前記中心電極、前記整合用容量素子を接続するための配線導体が表面に形成された回路基板と、
を備え、
前記回路基板の表面に形成された少なくとも一つの配線導体と対向する浮き導体が前記回路基板の内部に形成されており、前記少なくとも一つの配線導体と前記浮き導体との間に容量が形成されていること、
を特徴とする非可逆回路素子。 - 永久磁石と、
前記永久磁石により直流磁界が印加されるマイクロ波用磁性体と、
前記マイクロ波用磁性体に、互いに電気的に絶縁状態で交差して配置された少なくとも二つの中心電極と、
整合用容量素子と、
前記中心電極、前記整合用容量電極を接続するための配線導体が表面及び内部に形成された回路基板と、
を備え、
前記回路基板の表面に形成された少なくとも一つの配線導体と前記回路基板の内部に形成された少なくとも一つの配線導体との間に浮き導体が形成されており、前記二つの配線導体と前記浮き導体との間に容量が形成されていること、
を特徴とする非可逆回路素子。 - 前記マイクロ波用磁性体に、互いに電気的に絶縁状態で交差して配置された第1中心電極と第2中心電極とを備え、
前記第1中心電極は、一端が入力ポートに接続され、他端が出力ポートに接続され、
前記第2中心電極は、一端が出力ポートに接続され、他端がグランドポートに接続され、
前記入力ポートと前記出力ポートとの間に終端抵抗が接続され、
前記整合用容量素子は前記入力ポートを前記入力ポートとの間に接続されており、
前記配線導体と前記浮き導体との間に形成された容量は前記入力ポートと前記出力ポートとの間に接続されていること、
を特徴とする請求項1又は請求項2に記載の非可逆回路素子。 - 前記浮き導体の幅が前記配線導体の幅よりも大きいこと、を特徴とする請求項1ないし請求項3のいずれかに記載の非可逆回路素子。
- 永久磁石と、
前記永久磁石により直流磁界が印加されるマイクロ波用磁性体と、
前記マイクロ波用磁性体に、互いに電気的に絶縁状態で交差して配置された少なくとも二つの中心電極と、
整合用容量素子と、
前記中心電極、前記整合用容量電極を接続するための配線導体が表面及び内部に形成された回路基板と、
を備え、
前記回路基板の表面に形成された少なくとも一つの配線導体と前記回路基板の内部に形成された少なくとも一つの配線導体とが互いに対向して容量が形成されていること、
を特徴とする非可逆回路素子。 - 前記マイクロ波用磁性体に、互いに電気的に絶縁状態で交差して配置された第1中心電極と第2中心電極とを備え、
前記第1中心電極は、一端が入力ポートに接続され、他端が出力ポートに接続され、
前記第2中心電極は、一端が出力ポートに接続され、他端がグランドポートに接続され、
前記入力ポートと前記出力ポートとの間に終端抵抗が接続され、
前記整合用容量素子は前記入力ポートを前記入力ポートとの間に接続されており、
回路基板の表面及び内部に形成された前記配線導体の間に形成された容量は前記入力ポートと前記出力ポートとの間に接続されていること、
を特徴とする請求項5に記載の非可逆回路素子。
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JP2011277770A JP5799794B2 (ja) | 2011-12-20 | 2011-12-20 | 非可逆回路素子 |
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JP5799794B2 JP5799794B2 (ja) | 2015-10-28 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2000332422A (ja) * | 1999-05-20 | 2000-11-30 | Sony Corp | 多層回路基板及びその製造方法 |
JP2004193904A (ja) * | 2002-12-10 | 2004-07-08 | Murata Mfg Co Ltd | 2ポート型アイソレータ、2ポート型アイソレータの製造方法および通信装置 |
JP2011146987A (ja) * | 2010-01-15 | 2011-07-28 | Murata Mfg Co Ltd | 非可逆回路素子 |
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2011
- 2011-12-20 JP JP2011277770A patent/JP5799794B2/ja not_active Expired - Fee Related
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