JP2011102879A - 画素回路、表示装置および検査方法 - Google Patents
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Abstract
【解決手段】信号線DTCに基準信号電圧Vrefが設定されている期間に、駆動トランジスタ10Cのゲート・ソース間電圧を駆動トランジスタ10Cの閾値電圧以上として保持容量10Bに基準信号電圧Vrefと基準電源電圧Vref_rの差電圧を充電する。と共に、前記駆動トランジスタ10Cのソースの電圧を基準電源電圧Vref_rに設定することで前記発光素子への印加電圧をその閾値電圧以下とする。その後、前記発光素子10Eへの印加電圧をその閾値電圧以下に維持したまま、前記保持容量10Bに前記駆動トランジスタ10Cの閾値電圧に相当する電圧を保持し、信号線DTCに表示信号電圧が設定されている期間に、前記サンプリングトランジスタ10Aを導通させ前記信号電圧をサンプリングし、保持容量の保持していた閾値電圧に前記信号電圧を重畳する。
【選択図】図2
Description
Vgs_10C=Vref−Vref_r>Vth_10C・・・・・・1
Vgs_11C=Vref−Vref_r>Vth_11C・・・・・・2
VEE+Vth_10E>Vref_r・・・・・・3
VEE+Vth_11E>Vref_r ・・・・・・4
Vs_10C=Vref−Vth_10C・・・・・・5
Vs_11C=Vref−Vth_11C・・・・・・6
となる。従って、保持容量10B、11Bには、Vth_10C、Vth_11Cがそれぞれ保持される。
VEE+Vth_10E>Vs_10C・・・・・・7
VEE+Vth_11E>Vs_11C・・・・・・8
を満足する必要がある。
VEE+Vth_10E+Vth_10C>Vref・・・・・・9
Vs_10C=Vref−Vth_10C+(Vsig0−Vref)xCap_10E/(Cap_10B+Cap_10E)+VEExCap_10B/(Cap_10B+Cap_10E)
={Cap_10Bx(VEE+Vref)+Cap_10ExVsig0}/(Cap_10B+Cap_10E)−Vth_10C
となり、ゲ−ト電極−ソ−ス電極間の電圧は、
Vgs_10C=Cap_10B/(Cap_10B+Cap_10E)(Vsig0−VEE−Vref)+Vth_10C
となる。
Vs_11C=Vref−Vth_11C+(Vsig0−Vref)xCap_11E/(Cap_11B+Cap_11E)+VEExCap_11B/(Cap_11B+Cap_11E)
となり、ゲ−ト電極−ソ−ス電極間の電圧は、
Vgs_11C=Cap_11B/(Cap_11B+Cap_11E)x(Vsig0−VEE−Vref)+Vth_11C
となる。
Ids0=β/2{Cap_10B/(Cap_10B+Cap_10E)x(Vsig0−VEE−Vref)}2
Ids1=β/2{Cap_11B/(Cap_11B+Cap_11E)x(Vsig1−VEE−Vref)}2
となり、Vthの項は補正され、駆動電流のばらつきを抑えることができる。
Claims (8)
- 一端が信号線に接続され、第1走査線によってオンオフされるサンプリングトランジスタと、
このサンプリングトランジスタの他端にゲートが接続され、ドレインが第1電源に接続される駆動トランジスタと、
この駆動トランジスタのソースと第2電源との間に接続され、前記駆動トランジスタに流れる電流によって駆動される発光素子と、
前記駆動トランジスタのゲート・ソース間に接続される保持容量と、
前記駆動トランジスタのソースと基準電位線の間に配置され、第2走査線によってオンオフされるスイッチングトランジスタと、
を含み、
前記信号線に基準信号電圧が設定されている期間に、前記サンプリングトランジスタと前記スイッチングトランジスタを導通させ、前記駆動トランジスタのゲート・ソース間電圧を前記駆動トランジスタの閾値電圧以上とした状態で前記保持容量に基準信号電圧と基準電位の差電圧を充電すると共に、前記駆動トランジスタのソースの電圧を基準電位に設定することで前記発光素子への印加電圧をその閾値電圧以下とし、
その後、前記信号線に基準信号電圧が設定されている期間に、前記サンプリングトランジスタと前記スイッチングトランジスタを導通させるとともに、前記スイッチングトランジスタをオフにすることで、前記発光素子への印加電圧をその閾値電圧以下に維持したまま、前記保持容量に前記駆動トランジスタの閾値電圧に相当する電圧を保持し、
前記信号線に表示信号電圧が設定されている期間に、前記サンプリングトランジスタを導通させ前記信号電圧をサンプリングし、前記保持容量の保持していた閾値電圧に前記信号電圧を重畳する、
画素回路。 - 複数の画素をマトリクス状に配置した表示装置であって、
複数の信号線と、
この複数の信号線を駆動する信号線駆動回路と、
複数の第1走査線と、
この第1走査線を駆動する第1走査線駆動回路と、
複数の第2走査線と、
この第2走査線を駆動する第2走査線駆動回路と、
基準電位が供給される基準電位線と、
を含み、
各画素は、
一端が信号線に接続され、第1走査線によってオンオフされるサンプリングトランジスタと、
このサンプリングトランジスタの他端にゲートが接続され、ドレインが第1電源に接続される駆動トランジスタと、
この駆動トランジスタのソースと第2電源との間に接続され、前記駆動トランジスタに流れる電流によって駆動される発光素子と、
前記駆動トランジスタのゲート・ソース間に接続される保持容量と、
前記駆動トランジスタのソースと基準電位線の間に配置され、第2走査線によってオンオフされるスイッチングトランジスタと、
を含み、
前記信号線に基準信号電圧が設定されている期間に、前記サンプリングトランジスタと前記スイッチングトランジスタを導通させ、前記駆動トランジスタのゲート・ソース間電圧を前記駆動トランジスタの閾値電圧以上とした状態で前記保持容量に基準信号電圧と基準電位の差電圧を充電すると共に、前記駆動トランジスタのソースの電圧を基準電位に設定することで前記発光素子への印加電圧をその閾値電圧以下とし、
その後、前記信号線に基準信号電圧が設定されている期間に、前記サンプリングトランジスタと前記スイッチングトランジスタを導通させるとともに、前記スイッチングトランジスタをオフにすることで、前記発光素子への印加電圧をその閾値電圧以下に維持したまま、前記保持容量に前記駆動トランジスタの閾値電圧に相当する電圧を保持し、
前記信号線に表示信号電圧が設定されている期間に、前記サンプリングトランジスタを導通させ前記信号電圧をサンプリングし、前記保持容量の保持していた閾値電圧に前記信号電圧を重畳する、
表示装置。 - 請求項2に記載の表示装置であって、
前記基準電位線は、2行の画素に共通であって画素の2行毎に行方向に配置されている表示装置。 - 請求項2に記載の表示装置であって、
前記基準電位線は、2列の画素に共通であって画素の2列毎に列方向に配置されている表示装置。 - 請求項2〜4のいずれか1つに記載の表示装置であって、
前記画素が配列される表示領域の外部において、前記基準電位線をまとめて接続している表示装置。 - 請求項5に記載の表示装置であって、
前記基準電位線に接続されるプローブポイントであって、少なくとも前記発光素子の形成前に、プローブにより外部からポイント可能プローブポイントを有する表示装置。 - 請求項2〜6に記載の表示装置であって、
前記第2走査線は、2行の画素に共通であって画素の2行毎に行方向に配置されている表示装置。 - 請求項2〜7に記載の表示装置についての検査方法であって、
前記発光素子の形成前において、基準電位線にプローブを接続し、各画素における前記サンプリングトランジスタ、スイッチングトランジスタのオンオフを制御して、基準電位線から流れ出る電流を検出することで、駆動トランジスタの電流−電圧特性を測定する表示装置の検査方法。
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