JP2011035559A5 - 差動増幅器回路 - Google Patents

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  1. 正転入力端子及び反転入力端子に接続されたＮＭＯＳトランジスタ対と、
    前記正転入力端子及び前記反転入力端子に接続されたＰＭＯＳトランジスタ対と、
    出力回路部
    とを備え、
    前記ＰＭＯＳトランジスタ対は、第１及び第２ＰＭＯＳトランジスタで構成され、
    前記ＮＭＯＳトランジスタ対は、Ｐウェルを形成せずにチャンネル領域がＰ型基板中に形成されたディプレッション型のＮＭＯＳトランジスタである第１及び第２ノンドープ型ＮＭＯＳトランジスタで構成され、
    前記出力回路部は、前記第１及び第２ノンドープ型ＮＭＯＳトランジスタに接続されたフォールディッドカスコード型の第１カレントミラーを含み、前記第１カレントミラーから出力される電流に応答して出力電圧を生成する
    差動増幅器回路。
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