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  1. 通信受信機と共に動作するプリプロセッサであり、
    通信路を介して送信される入力信号を受け取るように動作する入力と、
    前記入力信号に基づき前記通信路の少なくとも１つの特徴を推定するように動作する通信路推定器と、
    前記少なくとも１つの推定された特徴に従って前記入力信号を調整するように動作する信号調整器と、
    前記調整された信号を前記通信受信機に提供する出力と
    を備えるプリプロセッサ。
  2. 前記信号調整器が時間領域フィルタを備える請求項１に記載のプリプロセッサ。
  3. 前記通信路推定器の出力に基づき前記時間領域フィルタの１つまたは複数の係数を決定するように動作する係数計算器
    をさらに備える請求項２に記載のプリプロセッサ。
  4. 前記信号調整器が周波数領域の前記入力信号を調整する請求項１に記載のプリプロセッサ。
  5. 前記信号調整器が、
    前記入力信号と前記通信路推定器の出力を合成するように動作する合成器
    を備える請求項４に記載のプリプロセッサ。
  6. 前記合成器が、
    最大比合成器（ＭＲＣ）、
    ゼロフォーシング合成器、および
    最小平均二乗誤差合成器
    からなるグループの中から選択される請求項５に記載のプリプロセッサ。
  7. 前記通信路推定器が前記合成器の出力に従って前記少なくとも１つの特徴を推定する請求項５または６に記載のプリプロセッサ。
  8. 前記信号調整器がさらに前方誤り訂正（ＦＥＣ）ユニットを備える請求項７に記載のプリプロセッサ。
  9. 前記信号調整器がさらに変調ユニットを備え、前記通信路推定器が、
    復調され、再変調された前記合成器の出力、および
    復調され、ＦＥＣ復号され、ＦＥＣ再符号化され、再変調された前記合成器の出力
    からなるグループの中から選択される出力で駆動される請求項５から８のいずれか１項に記載のプリプロセッサ。
  10. 前記通信受信機がＲＦ／ＰＨＹ／ＭＡＣ受信機であり、使用に際して１つまたは複数のアンテナと前記通信受信機の間で動作するプリプロセッサである請求項１〜９のいずれか１項に記載のプリプロセッサ。
  11. 前記プリプロセッサが１つまたは複数のＲＦ回路から前記入力信号を受け取り、前記通信受信機に出力信号を再送信するブリッジとして動作する請求項１〜１０のいずれか１項に記載のプリプロセッサ。
  12. 前記通信受信機の取得回路を迂回するように動作する請求項１〜１１のいずれか１項に記載のプリプロセッサ。
  13. 前記プリプロセッサがＰＨＹモジュールとして動作する請求項１から９のいずれか１項に記載のプリプロセッサ。
  14. 前記通信受信機のＰＨＹモジュールを迂回するように動作する請求項１３に記載のプリプロセッサ。
  15. 前記プリプロセッサがＩＥＥＥ８０２．１１準拠の受信機と共に動作する請求項１〜１４のいずれか１項に記載のプリプロセッサ。
  16. 前記入力信号が実質的に調整なしで前記入力から前記出力に渡されるバイパスモードを有する請求項１〜１５のいずれか１項に記載のプリプロセッサ。
  17. 異なる長さの２つの自己相関を利用する取得回路
    をさらに備える請求項１〜１６のいずれか１項に記載のプリプロセッサ。
  18. 前記通信受信機に提供される前記調整された信号に含めるための少なくとも１つのプリアンブルを格納するデータ記憶装置、
    少なくとも１つのプリアンブルと任意選択でいくつかのデータシンボルが前記入力から前記出力に渡される手段、
    前記通信受信機に提供される前記調整された信号に含めるためのプリアンブルをフィルタリングするフィルタ、および
    前記プリアンブルの一部が、前記調整された信号に含める前に調整され、または削除される手段
    のうちの少なくとも１つをさらに備える請求項１〜１７のいずれか１項に記載のプリプロセッサ。
  19. 前記出力が、
    ・前記入力信号が前記入力によって検出される場合、短いプリアンブル、
    ・前記入力信号のタイミングが取得されるとすぐに、長いプリアンブル、
    ・繰り返し出力される前記短いプリアンブル、次いで、前記入力信号の前記タイミングが取得されるとすぐに、前記長いプリアンブル、および
    ・繰り返し出力される前記短いプリアンブルの一部、次いで、前記入力信号の前記タイミングが取得されるとすぐに、前記長いプリアンブル
    のうちの少なくとも１つを出力する請求項１〜１８のいずれか１項に記載のプリプロセッサ。
  20. 前記プリプロセッサがＩＥＥＥ８０２．１１ＲＦ回路からのステータス信号および制御信号を処理し、前記出力が前記処理されたステータス信号および制御信号を出力する請求項１〜１９のいずれか１項に記載のプリプロセッサ。
  21. 前記入力が複数の入力信号を受け取るように動作する請求項１〜２０のいずれか１項に記載のプリプロセッサ。
  22. 前記複数の入力信号の中から入力信号を選択するように動作する選択器を備える請求項２１に記載のプリプロセッサ。
  23. １つまたは複数のＲＦ回路を備えるプリプロセッサ、
    使用に際して１つまたは複数のアンテナと前記通信受信機の間で動作するプリプロセッサ、および
    使用に際して１つまたは複数のＲＦ回路と前記通信受信機の間で動作するプリプロセッサ
    からなるグループの中から選択される請求項２１または２２に記載のプリプロセッサ。
  24. 前記信号調整器が前記通信受信機の所定の機能に従って前記入力信号を調整するように構成されている請求項１〜２３のいずれか１項に記載のプリプロセッサ。
  25. 前記通信受信機が動作する通信路の範囲を広げるように構成されている請求項１〜２４のいずれか１項に記載のプリプロセッサ。
  26. 少なくとも１つのプリプロセッサ対応ノードを備える通信システムであって、
    請求項１から２５のいずれか１項に記載のプリプロセッサと、
    前記プリプロセッサから調整された信号を受け取る通信受信機と
    を備える通信システム。
  27. 前記通信システムがＩＥＥＥ８０２．１１ネットワークであり、
    カバレージクラスを増大させることによりプリプロセッサ対応ノードにおける遅延を補償する遅延補償器、
    ＩＥＥＥ８０２．１１ＭＡＣ／ＰＨＹのＳＩＦＳ時間を低減することによりプリプロセッサ対応ノードにおける遅延を補償する遅延補償器、
    ＳＩＦＳ時間をＰＩＦＳ時間まで増大させることによりプリプロセッサ対応ノードにおける遅延を補償する遅延補償器、
    前記通信路から受け取られる前記入力信号のデータ転送速度より高いデータ転送速度で前記プリプロセッサから信号を出力することによりプリプロセッサ対応ノードにおける遅延を補償する遅延補償器、および
    ＩＥＥＥ８０２．１１ＭＡＣ／ＰＨＹのＣＣＡ信号を早くアサートすることによりプリプロセッサ対応ノードにおける遅延を補償する遅延補償器
    からなるグループの中から選択される遅延補償器を備える請求項２６に記載の通信システム。
  28. 通信受信機に提供するための信号を前処理する方法であって、
    通信路を介して送信される入力信号を受け取ること、
    前記入力信号に基づき前記通信路の少なくとも１つの特徴を推定すること、
    前記少なくとも１つの推定された特徴と前記通信受信機の所定の機能に従って前記入力信号を調整すること、および
    前記調整された信号を前記通信受信機に提供すること
    を含む方法。
  29. 機械可読記録媒体に記録された機械可読プログラムコードであり、前記プログラムコートが実行されるデータ処理装置の動作を、
    通信路を介して送信される入力信号を受け取ること、
    前記入力信号に基づき前記通信路の少なくとも１つの特徴を推定すること、
    前記少なくとも１つの推定された特徴と前記通信受信機の所定の機能に従って前記入力信号を調整すること、および
    前記調整された信号を前記通信受信機に提供すること
    を含む、通信受信機に提供するための信号を前処理する方法を実行するように制御する前記プログラムコードを含むコンピュータプログラム製品。
  30. 機械可読プログラムコードが実行されるデータ処理装置の動作を、
    通信路を介して送信される入力信号を受け取ること、
    前記入力信号に基づき前記通信路の少なくとも１つの特徴を推定すること、
    前記少なくとも１つの推定された特徴と前記通信受信機の所定の機能に従って前記入力信号を調整すること、および
    前記通信受信機の前記調整された信号を提供すること
    を含む、通信受信機に提供するための信号を前処理する方法を実行するように制御する前記プログラムコードを含むコンピュータプログラム。
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