JP2010016249A - 半導体装置の製造方法、及び半導体装置 - Google Patents
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Abstract
【解決手段】第1コンタクト金属4が埋め込まれた第1層間膜8と、第1層間膜8上に形成されるとともに溝を有する第2層間膜12と、溝に埋め込まれるとともに溝上で突出した金属配線2と、金属配線2上に形成されたハードマスク膜7と、第2層間膜12上のハードマスク膜7及び金属配線2の側壁に形成されたサイドウォール3と、ハードマスク膜7及びサイドウォール3を含む第2層間膜12上に形成された第3層間膜6と、第3層間膜6、第2層間膜12、及び第1層間膜8に形成されるとともにサイドウォール3間にて第1コンタクト金属4に通ずる下穴と、下穴内に形成された第2コンタクト金属1と、を備える。
【選択図】図1
Description
2 ビット線
3 サイドウォール(シリコン窒化膜)
4 セルコンタクト金属(第1コンタクト金属)
5 ワード線(ゲート電極)
6 容量コンタクト層間膜(第3層間膜、容量コンタクト金属層間絶縁膜)
7 ハードマスク膜(シリコン窒化膜)
8 コンタクト層間膜(第1層間膜、コンタクト金属層間絶縁膜)
9 ビットコンタクト金属
10 ビット線用溝
11 メタル(積層膜)
12 溝配線層間膜(第2層間膜、溝配線層間絶縁膜)
20 ビット線上層配線部
30 ビット線溝配線部
40 2ビット領域
41 1ビット領域
42 チャネル長
Claims (12)
- 第1コンタクト金属が埋め込まれた第1層間膜上に溝を有する第2層間膜を形成する工程と、
前記溝を含む前記第2層間膜上に金属配線となるメタルを成膜する工程と、
前記メタル上にハードマスク膜を成膜する工程と、
前記ハードマスク膜及び前記メタルをエッチングすることにより、前記溝に埋め込まれるとともに前記溝上で突出した金属配線を形成する工程と、
前記第2層間膜上の前記ハードマスク膜及び前記金属配線の側壁にサイドウォールを形成する工程と、
を含むことを特徴とする半導体装置の製造方法。 - 前記ハードマスク膜及び前記サイドウォールを含む前記第2層間膜上に第3層間膜を形成する工程と、
前記第3層間膜、前記第2層間膜、及び前記第1層間膜を選択的にエッチングすることにより、前記サイドウォール間にて前記第1コンタクト金属に通ずる下穴を形成する工程と、
前記下穴内に第2コンタクト金属を形成する工程と、
を含むことを特徴とする請求項1記載の半導体装置の製造方法。 - 前記第2層間膜を形成する工程では、前記溝の幅が前記金属配線の前記溝上で突出した部分の幅よりも狭くなるように前記第2層間膜を形成することを特徴とする請求項1又は2記載の半導体装置の製造方法。
- 前記メタルを成膜する工程では、前記第2層間膜上の部分の前記メタルの厚さが前記溝の深さよりも薄くなるように前記メタルを成膜することを特徴とする請求項1乃至3のいずれか一に記載の半導体装置の製造方法。
- 前記金属配線は、DRAMのビット線であることを特徴とする請求項1乃至4のいずれか一に記載の半導体装置の製造方法。
- 第1コンタクト金属が埋め込まれた第1層間膜と、
前記第1層間膜上に形成されるとともに溝を有する第2層間膜と、
前記溝に埋め込まれるとともに前記溝上で突出した金属配線と、
前記金属配線上に形成されたハードマスク膜と、
前記第2層間膜上の前記ハードマスク膜及び前記金属配線の側壁に形成されたサイドウォールと、
を備えることを特徴とする半導体装置。 - 前記ハードマスク膜及び前記サイドウォールを含む前記第2層間膜上に形成された第3層間膜と、
前記第3層間膜、前記第2層間膜、及び前記第1層間膜に形成されるとともに前記サイドウォール間にて前記第1コンタクト金属に通ずる下穴と、
前記下穴内に形成された第2コンタクト金属と、
を備えることを特徴とする請求項6記載の半導体装置。 - 前記金属配線は、前記溝内の幅が前記溝上で突出した部分の幅よりも狭くなるように形成されていることを特徴とする請求項6又は7記載の半導体装置。
- 前記金属配線は、前記溝上で突出した部分の厚さが前記溝の深さよりも薄くなるように形成されていることを特徴とする請求項6乃至8のいずれか一に記載の半導体装置。
- 前記サイドウォールは、前記第1層間膜、前記第2層間膜、及び前記第3層間膜とエッチング選択比が異なる絶縁体よりなることを特徴とする請求項7乃至9のいずれか一に記載の半導体装置。
- 前記サイドウォールは、前記第1層間膜、前記第2層間膜、及び前記第3層間膜よりも誘電率の高い絶縁膜であることを特徴とする請求項7乃至10のいずれか一に記載の半導体装置。
- 前記金属配線は、DRAMのビット線であることを特徴とする請求項6乃至11のいずれか一に記載の半導体装置。
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