JP2009104605A - メモリアクセス動作を改善するための、バンクを用いたヒストグラム生成 - Google Patents
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Abstract
【解決手段】 各バンクには同じアドレスラインが設けられているが、アドレス制御ロジックによって連続するRMWサイクルはそれぞれ異なるバンクが処理するように保証されているので、前のRMWサイクルがあるバンクでまだ実行されている間であっても、別のRMWサイクルを別のバンクで開始することができる。RMWサイクルの開始をラップアラウンド方式で交互にずらすことまたは段階的にすることによって、各ヒストグラムビンは複数のバンクにわたることになるが、利用されるバンクの数が1つである場合よりも試験を高速に行うことができる。ヒストグラムデータを取得すると、特定のビンに対応付けられる各バンクのメモリ領域を加算して、そのビンの合計カウントを算出する。
【選択図】 図2A
Description
Claims (10)
- ヒストグラムデータを収集する場合に段階的なリード/モディファイ/ライト(RMW)サイクルを可能とする装置であって、
それぞれが共通のアドレス入力を有する複数のメモリバンクと、
前記複数のメモリバンクのそれぞれに接合されており、連続するクロックサイクル毎に前記複数のメモリバンクのうち一の異なるメモリバンクがRMWサイクルを開始するように、前記複数のメモリバンクのそれぞれに対して交互制御コマンドを生成する、バンク制御論理回路と
を備える装置。 - 前記複数のメモリバンクは、2つ以上の個別のメモリを有する
請求項1に記載の装置。 - 前記複数のメモリバンクは、単一のパッケージ内に含まれている
請求項1に記載の装置。 - 各メモリバンクの同じアドレスに格納されているカウントを加算して特定のビンのカウントを得て、この加算処理をアドレス毎に繰り返して全てのビンのカウントを算出する加算器論理回路
をさらに備える、請求項1に記載の装置。 - 請求項1に記載の装置を備える
試験サイト。 - 請求項5に記載の試験サイトを備える
試験システム。 - ヒストグラムデータを収集する場合に段階的なリード/モディファイ/ライト(RMW)サイクルを可能とする方法であって、
メモリをそれぞれが共通のアドレス入力を有する複数のメモリバンクに分割することと、
連続するクロックサイクル毎に前記複数のメモリバンクのうち一の異なるメモリバンクがRMWサイクルを開始するように、前記複数のメモリバンクのそれぞれに対して交互制御コマンドを生成することと
を含む方法。 - 複数の個別のメモリを利用して前記複数のメモリバンクを形成すること
をさらに含む、請求項7に記載の方法。 - 複数のメモリバンクを含む単一のメモリパッケージを利用すること
をさらに含む、請求項7に記載の方法。 - 各メモリバンクの同じアドレスに格納されているカウントを加算して特定のビンのカウントを得て、全てのビンのカウントを算出するべくこの加算処理をアドレス毎に繰り返すこと
をさらに含む、請求項7に記載の方法。
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