JP2009042611A - アクティブマトリックス型表示装置 - Google Patents
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Abstract
【解決手段】 隣接する第一画素と第二画素が、データ信号ラインS(i)を共用するとともに、第一画素が第一走査信号ラインに第一スイッチング素子を介して接続され、第二画素が第二走査信号ラインに第二スイッチング素子を介して接続されているアクティブマトリックス型表示装置であって、第一画素への本書き込み時に第二画素の仮書き込みを実行させるとともに、第一画素への本書き込み後に第二画素の本書き込みを実行させる駆動手段と、第一走査信号ラインと第一画素との間で生じる第一寄生容量Cgs1と、第二走査信号ラインと第二画素との間で生じる第二寄生容量Cgs2とを備え、第二寄生容量Cgs2が、第一寄生容量Cgs1よりも容量が大きくなるように構成する。
【選択図】 図4
Description
ΔVFa=Vgh・Cgs1/(Clc+Ccs)
ΔVR=Vgh・Cgs2/(Clc+Ccs)
ΔVFb=ΔVR・Cpp/(Clc+Ccs)
ΔVFa=Vgh・Cgs2/(Clc+Ccs)
ΔVR=Vgh・Cgs1/(Clc+Ccs)
ΔVFb=ΔVR・Cpp/(Clc+Ccs)
[{Vgh・Cgs1/(Clc+Ccs)}+{Vgh・Cgs2/(Clc+Ccs)}・{Cpp/(Clc+Ccs)}]/[Vgh・Cgs2/(Clc+Ccs)]=1
の関係を満たすようにすることが好ましく、
Cgs1=Cgs2−Cpp・Cgs2/(Clc+Ccs)
とすればよい。
つまり、非反転シフト駆動の場合には、Cgs1よりもCgs2を比較的大きくすれば、先書込画素Pfと後書込画素Prとで発生するフリッカ現象を同じように低減させることができ、画質を向上させることができる。
[{Vgh・Cgs2/(Clc+Ccs)}+{Vgh・Cgs1/(Clc+Ccs)}・{Cpp/(Clc+Ccs)}]/[Vgh・Cgs1/(Clc+Ccs)]=1
の関係を満たすようにすることが好ましく、これを満たすためには、
Cgs2=Cgs1−Cpp・Cgs1/(Clc+Ccs)
とすればよい。
つまり、上下反転シフト駆動の場合には、Cgs2よりもCgs1を比較的大きくすれば、先書込画素Pfと後書込画素Prとで発生するフリッカ現象を同じように低減させることができ、画質を向上させることができる。
W2=W1・{1+Cpp・Cgs1/(Clc+Ccs)}
とすればよい。
W1=W2・{1+Cpp・Cgs2/(Clc+Ccs)}
とすればよい。
10:液晶表示部
11:ドライバ回路
12:Vcom回路
S(i):データ信号ライン(i=1,2,3,・・・,x)
G(j):走査信号ライン(j=1,2,3,・・・,y)
P(i,j):画素
pix:画素電極
Clc:液晶容量
Ccs:補助容量
Cgs1,Cgs2:寄生容量
Cpp:画素間寄生容量
Claims (6)
- データ信号ラインを挟んで所定方向に隣接する第一画素と第二画素が、前記データ信号ラインを共用するとともに、前記第一画素が第一走査信号ラインに第一スイッチング素子を介して接続され、前記第二画素が第二走査信号ラインに第二スイッチング素子を介して接続されているアクティブマトリックス型表示装置であって、
前記第一画素への本書き込み時に前記第二画素の仮書き込みを実行させるとともに、前記第一画素への本書き込み後に前記第二画素の本書き込みを実行させる駆動手段と、
前記第一走査信号ラインと前記第一画素との間で生じる第一寄生容量と、
前記第二走査信号ラインと前記第二画素との間で生じる第二寄生容量と、を備え、
前記第二寄生容量は、前記第一寄生容量よりも容量が大きく構成されていることを特徴とするアクティブマトリックス型表示装置。 - データ信号ラインを挟んで所定方向に隣接する第一画素と第二画素が、前記データ信号ラインを共用するとともに、前記第一画素が第一走査信号ラインに第一スイッチング素子を介して接続され、前記第二画素が第二走査信号ラインに第二スイッチング素子を介して接続されているアクティブマトリックス型表示装置であって、
前記第一画素と前記第二画素とを同時にデータ書き込みオンにした後、前記第一画素がデータ書き込みオフで前記第二画素がデータ書き込みオンになるように駆動する駆動手段と、
前記第一走査信号ラインと前記第一画素との間で生じる第一寄生容量と、
前記第二走査信号ラインと前記第二画素との間で生じる第二寄生容量と、を備え、
前記第二寄生容量は、前記第一寄生容量よりも容量が大きく構成されていることを特徴とするアクティブマトリックス型表示装置。 - 前記第一画素の方向とは逆の方向に、データ信号ラインを挟むことなく前記第二画素と隣接する第三画素を備え、
前記第三画素は、前記第一走査信号ラインに接続され、
前記第二画素と前記第三画素との間に存在する画素間寄生容量をCppとし、前記第一画素及び前記第二画素の液晶容量をそれぞれClcとし、前記第一画素及び前記第二画素の補助容量をそれぞれCcsとしたときに、
前記第一寄生容量Cgs1と前記第二寄生容量Cgs2との関係が、
Cgs1=Cgs2−Cpp・Cgs2/(Clc+Ccs)
となっていることを特徴とする請求項1または2に記載のアクティブマトリックス型表示装置。 - 前記第三画素は、前記第一画素と同一構成になっていることを特徴とする請求項3記載のアクティブマトリックス型表示装置。
- 所定方向に第一の後書込画素と第一の先書込画素が隣接して配置され、
前記第一の先書込画素とは逆の方向に、第一のデータ信号ラインを挟んで前記第一の後書込画素に隣接する第二の先書込画素が配置され、
前記第一の後書込画素とは逆の方向に、第二のデータ信号ラインを挟んで前記第一の先書込画素に隣接する第二の後書込画素が配置され、
前記第一の後書込画素と前記第二の先書込画素が前記第一のデータ信号ラインを共用し、
前記第一の先書込画素と前記第二の後書込画素が前記第二のデータ信号ラインを共用し、
前記各先書込画素が第一の走査信号ラインに接続され、前記各後書込画素が第二の走査信号ラインに接続されているアクティブマトリックス型表示装置であって、
前記第一の後書込画素と前記第二の走査信号ラインとの間の第二の寄生容量が、前記第一の先書込画素と前記第一の走査信号ラインとの間の第一の寄生容量よりも容量が大きく構成されていることを特徴とするアクティブマトリックス型表示装置。 - 前記第一の後書込画素と前記第一の先書込画素との間の第三の寄生容量をCppとし、
前記第一の後書込画素及び前記第一の先書込画素の液晶容量をそれぞれClcとし、
前記第一の後書込画素及び前記第一の先書込画素の補助容量をそれぞれCcsとしたときに、
前記第一の寄生容量Cgs1と前記第二の寄生容量Cgs2との関係を、
Cgs1=Cgs2−Cpp・Cgs2/(Clc+Ccs)
としたことを特徴とする請求項5記載のアクティブマトリックス型表示装置。
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JP2007209073A JP5228396B2 (ja) | 2007-08-10 | 2007-08-10 | アクティブマトリックス型表示装置 |
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2011074291A1 (ja) * | 2009-12-14 | 2011-06-23 | シャープ株式会社 | 画素回路、表示装置、および、表示装置の駆動方法 |
CN102854680A (zh) * | 2012-09-25 | 2013-01-02 | 南京中电熊猫液晶显示科技有限公司 | 一种高透光率透明显示装置 |
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JPH10171412A (ja) * | 1996-12-09 | 1998-06-26 | Nec Corp | アクティブマトリクス型液晶表示装置 |
JPH10206869A (ja) * | 1997-01-24 | 1998-08-07 | Nec Corp | 液晶表示装置 |
JP2005309437A (ja) * | 2004-04-19 | 2005-11-04 | Samsung Electronics Co Ltd | 表示装置及びその駆動方法 |
-
2007
- 2007-08-10 JP JP2007209073A patent/JP5228396B2/ja not_active Expired - Fee Related
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CN102854680A (zh) * | 2012-09-25 | 2013-01-02 | 南京中电熊猫液晶显示科技有限公司 | 一种高透光率透明显示装置 |
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