JP5194628B2 - アクティブマトリックス型表示装置 - Google Patents
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Description
ΔVFa=Vgh・Cgs/(Clc+Ccs1)
ΔVR=Vgh・Cgs/(Clc+Ccs2)
ΔVFb=ΔVR・Cpp/(Clc+Ccs1)
ΔVFa=Vgh・Cgs/(Clc+Ccs2)
ΔVR=Vgh・Cgs/(Clc+Ccs1)
ΔVFb=ΔVR・Cpp/(Clc+Ccs2)
[{Vgh・Cgs/(Clc+Ccs1)}+{Vgh・Cgs/(Clc+Ccs2)}・{Cpp/(Clc+Ccs1)}]/[Vgh・Cgs/(Clc+Ccs2)]=1
の関係を満たすようにすることが好ましく、これを満たすためには、
Ccs1=Cpp+Ccs2
とすればよい。
[{Vgh・Cgs/(Clc+Ccs2)}+{Vgh・Cgs/(Clc+Ccs1)}・{Cpp/(Clc+Ccs2)}]/[Vgh・Cgs/(Clc+Ccs1)]=1
の関係を満たすようにすることが好ましく、これを満たすためには、
Ccs2=Cpp+Ccs1
とすればよい。
10:液晶表示部
11:ドライバ回路
12:Vcom回路
S(i):データ信号ライン(i=1,2,3,・・・,x)
G(j):走査信号ライン(j=1,2,3,・・・,y)
P(i,j):画素
pix:画素電極
Clc:液晶容量
Ccs1,Ccs2:補助容量
Cgs:寄生容量
Cpp:画素間寄生容量
Claims (5)
- データ信号ラインを挟んで所定方向に隣接する第一の先書き込み画素と第一の後書き込み画素とが、前記データ信号ラインを共用するとともにそれぞれ異なる走査信号ラインにスイッチング素子を介して接続されており、
前記第一の先書き込み画素への第1のデータの書き込み時に前記第一の後書き込み画素への前記第1のデータの書き込みを実行させるとともに、前記第一の先書き込み画素への前記第1のデータの書き込み後に前記第一の後書き込み画素への第2のデータの書き込みを実行させる駆動手段と、
前記第一の先書き込み画素に対応した第一補助容量と、
前記第一の後書き込み画素に対応した第二補助容量と、
を備え、
前記第一補助容量は、前記第二補助容量よりも容量が大きく構成されている、
ことを特徴とするアクティブマトリックス型表示装置。 - 前記第一の後書込画素に対し、前記所定方向に沿って、前記第一の先書込画素とは逆の側に、前記第一の後書込画素に隣接する第二の先書込画素を備え、
前記第一補助容量は、前記第一の後書込画素と前記第二の先書込画素との間に存在する画素間寄生容量を前記第二補助容量に加えた容量に等しいことを特徴とする請求項1記載のアクティブマトリックス型表示装置。 - 前記第二の先書込画素は、前記第一の先書き込み画素と共通の走査信号ラインに接続されていることを特徴とする請求項2記載のアクティブマトリックス型表示装置。
- 所定方向に沿って第一の後書込画素と第一の先書込画素とが互いに隣接して配置され、
前記第一の後書込画素に対し、前記所定方向に沿って、前記第一の先書込画素とは逆の側に、第一のデータ信号ラインを挟んで前記第一の後書込画素に隣接する第二の先書込画素が配置され、
前記第一の先書込画素に対し、前記所定方向に沿って、前記第一の後書込画素とは逆の側に、第二のデータ信号ラインを挟んで前記第一の先書込画素に隣接する第二の後書込画素が配置され、
前記第一の後書込画素と前記第二の先書込画素とが前記第一のデータ信号ラインを共用し、
前記第一の先書込画素と前記第二の後書込画素とが前記第二のデータ信号ラインを共用し、
前記各先書込画素が第一の走査信号ラインに接続され、前記各後書込画素が第二の走査信号ラインに接続され、
前記各先書込画素への第1のデータの書き込み時に前記各後書込画素への前記第1のデータの書き込みを実行させるとともに、前記各先書込画素への前記第1のデータの書き込み後に前記各後書込画素への第2のデータの書き込みを実行させる駆動手段を有し、
前記各先書込画素の補助容量の大きさが等しく形成されているとともに、前記各後書込画素の補助容量の大きさが等しく形成され、
前記各先書込画素の補助容量は、前記各後書込画素の補助容量よりも容量が大きく構成されている、
ことを特徴とするアクティブマトリックス型表示装置。 - 前記第一の先書込画素の補助容量は、前記第一の後書込画素と前記第一の先書込画素との間に存在する画素間寄生容量を、前記第一の後書込画素の補助容量に加えた容量に等しいことを特徴とする請求項4記載のアクティブマトリックス型表示装置。
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JP2007209022A JP5194628B2 (ja) | 2007-08-10 | 2007-08-10 | アクティブマトリックス型表示装置 |
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JP2009042608A JP2009042608A (ja) | 2009-02-26 |
JP5194628B2 true JP5194628B2 (ja) | 2013-05-08 |
Family
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JP2007209022A Expired - Fee Related JP5194628B2 (ja) | 2007-08-10 | 2007-08-10 | アクティブマトリックス型表示装置 |
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- 2007-08-10 JP JP2007209022A patent/JP5194628B2/ja not_active Expired - Fee Related
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