JP5228396B2 - アクティブマトリックス型表示装置 - Google Patents
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Description
ΔVFa=Vgh・Cgs1/(Clc+Ccs)
ΔVR=Vgh・Cgs2/(Clc+Ccs)
ΔVFb=ΔVR・Cpp/(Clc+Ccs)
ΔVFa=Vgh・Cgs2/(Clc+Ccs)
ΔVR=Vgh・Cgs1/(Clc+Ccs)
ΔVFb=ΔVR・Cpp/(Clc+Ccs)
[{Vgh・Cgs1/(Clc+Ccs)}+{Vgh・Cgs2/(Clc+Ccs)}・{Cpp/(Clc+Ccs)}]/[Vgh・Cgs2/(Clc+Ccs)]=1
の関係を満たすようにすることが好ましく、
Cgs1=Cgs2−Cpp・Cgs2/(Clc+Ccs)
とすればよい。
つまり、非反転シフト駆動の場合には、Cgs1よりもCgs2を比較的大きくすれば、先書込画素Pfと後書込画素Prとで発生するフリッカ現象を同じように低減させることができ、画質を向上させることができる。
[{Vgh・Cgs2/(Clc+Ccs)}+{Vgh・Cgs1/(Clc+Ccs)}・{Cpp/(Clc+Ccs)}]/[Vgh・Cgs1/(Clc+Ccs)]=1
の関係を満たすようにすることが好ましく、これを満たすためには、
Cgs2=Cgs1−Cpp・Cgs1/(Clc+Ccs)
とすればよい。
つまり、上下反転シフト駆動の場合には、Cgs2よりもCgs1を比較的大きくすれば、先書込画素Pfと後書込画素Prとで発生するフリッカ現象を同じように低減させることができ、画質を向上させることができる。
W2=W1・{1+Cpp・Cgs1/(Clc+Ccs)}
とすればよい。
W1=W2・{1+Cpp・Cgs2/(Clc+Ccs)}
とすればよい。
10:液晶表示部
11:ドライバ回路
12:Vcom回路
S(i):データ信号ライン(i=1,2,3,・・・,x)
G(j):走査信号ライン(j=1,2,3,・・・,y)
P(i,j):画素
pix:画素電極
Clc:液晶容量
Ccs:補助容量
Cgs1,Cgs2:寄生容量
Cpp:画素間寄生容量
Claims (3)
- データ信号ラインを挟んで所定方向に隣接する第一の先書込画素と第一の後書込画素とが、前記データ信号ラインを共用するとともに、前記第一の先書込画素が第一走査信号ラインに第一スイッチング素子を介して接続され、前記第一の後書込画素が第二走査信号ラインに第二スイッチング素子を介して接続されており、
前記第一の先書込画素への第1のデータの書込時に前記第一の後書込画素への前記第1のデータの書込を実行させるとともに、前記第一の先書込画素への前記第1のデータの書込後に前記第一の後書込画素への第2のデータの書込を実行させる駆動手段と、
前記第一走査信号ラインと前記第一の先書込画素との間で生じる第一寄生容量と、
前記第二走査信号ラインと前記第一の後書込画素との間で生じる第二寄生容量と、
を備え、
前記第一の後書込画素に対し、前記所定方向に沿って、前記第一の先書込画素とは逆の側に、前記第一の後書込画素に隣接する第二の先書込画素を有し、
前記第二の先書込画素は、前記第一走査信号ラインに接続され、
前記第一の後書込画素と前記第二の先書込画素との間に存在する画素間寄生容量をCppとし、前記第一の先書込画素及び前記第一の後書込画素の液晶容量をそれぞれClcとし、前記第第一の先書込画素及び前記第一の後書込画素の補助容量をそれぞれCcsとしたときに、
前記第一寄生容量Cgs1と前記第二寄生容量Cgs2との関係が、
Cgs1=Cgs2−Cpp・Cgs2/(Clc+Ccs)
となっている、
ことを特徴とするアクティブマトリックス型表示装置。 - データ信号ラインを挟んで所定方向に隣接する第一の先書込画素と第一の後書込画素とが、前記データ信号ラインを共用するとともに、前記第一の先書込画素が第一走査信号ラインに第一スイッチング素子を介して接続され、前記第一の後書込画素が第二走査信号ラインに第二スイッチング素子を介して接続されており、
前記第一の先書込画素と前記第一の後書込画素とを同時にデータ書込オンにした後、前記第一の先書込画素がデータ書込オフで前記第一の後書込画素がデータ書込オンになるように駆動する駆動手段と、
前記第一走査信号ラインと前記第一の先書込画素との間で生じる第一寄生容量と、
前記第二走査信号ラインと前記第一の後書込画素との間で生じる第二寄生容量と、
を備え、
前記第一の後書込画素に対し、前記所定方向に沿って、前記第一の先書込画素とは逆の側に、前記第一の後書込画素に隣接する第二の先書込画素を有し、
前記第二の先書込画素は、前記第一走査信号ラインに接続され、
前記第一の後書込画素と前記第二の先書込画素との間に存在する画素間寄生容量をCppとし、前記第一の先書込画素及び前記第一の後書込画素の液晶容量をそれぞれClcとし、前記第第一の先書込画素及び前記第一の後書込画素の補助容量をそれぞれCcsとしたときに、
前記第一寄生容量Cgs1と前記第二寄生容量Cgs2との関係が、
Cgs1=Cgs2−Cpp・Cgs2/(Clc+Ccs)
となっている、
ことを特徴とするアクティブマトリックス型表示装置。 - 所定方向に沿って第一の後書込画素と第一の先書込画素とが互いに隣接して配置され、
前記第一の後書込画素に対し、前記所定方向に沿って、前記第一の先書込画素とは逆の側に、第一のデータ信号ラインを挟んで前記第一の後書込画素に隣接する第二の先書込画素が配置され、
前記第一の先書込画素に対し、前記所定方向に沿って、前記第一の後書込画素とは逆の側に、第二のデータ信号ラインを挟んで前記第一の先書込画素に隣接する第二の後書込画素が配置され、
前記第一の後書込画素と前記第二の先書込画素とが前記第一のデータ信号ラインを共用し、
前記第一の先書込画素と前記第二の後書込画素とが前記第二のデータ信号ラインを共用し、
前記各先書込画素が第一の走査信号ラインに接続され、前記各後書込画素が第二の走査信号ラインに接続され、
前記各先書込画素への第1のデータの書込時に前記各後書込画素への前記第1のデータの書込を実行させるとともに、前記各先書込画素への前記第1のデータの書込後に前記各後書込画素への第2のデータの書込を実行させる駆動手段を有し、
前記第一の後書込画素と前記第一の先書込画素との間の第三の寄生容量をCppとし、
前記第一の後書込画素及び前記第一の先書込画素の液晶容量をそれぞれClcとし、
前記第一の後書込画素及び前記第一の先書込画素の補助容量をそれぞれCcsとしたときに、
前記第一の寄生容量Cgs1と前記第二の寄生容量Cgs2との関係を、
Cgs1=Cgs2−Cpp・Cgs2/(Clc+Ccs)
とした、
ことを特徴とするアクティブマトリックス型表示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2007209073A JP5228396B2 (ja) | 2007-08-10 | 2007-08-10 | アクティブマトリックス型表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2007209073A JP5228396B2 (ja) | 2007-08-10 | 2007-08-10 | アクティブマトリックス型表示装置 |
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JP2009042611A JP2009042611A (ja) | 2009-02-26 |
JP5228396B2 true JP5228396B2 (ja) | 2013-07-03 |
Family
ID=40443383
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2007209073A Expired - Fee Related JP5228396B2 (ja) | 2007-08-10 | 2007-08-10 | アクティブマトリックス型表示装置 |
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