JP2008099182A - デジタルフィルタ装置 - Google Patents
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Abstract
【解決手段】デジタルフィルタ装置100は、ピーク値制御回路8が、第1のゲイン乗算値g0と第2のゲイン乗算値とを比較し、ゲイン乗算値がゼロになるタイミングまたは初めて最もゼロに近くなるタイミングで、第2の係数レジスタ7から新たなフィルタ係数をフィルタ係数に代えて第1の係数レジスタ2に格納させ、第1のゲイン乗算値の符号と第2のゲイン乗算値の符号とが同じ場合は、第1のゲイン乗算値と第2のゲイン乗算値のうちゼロに近い方をゲイン乗算器4に適用するタイミングで、第2の係数レジスタ7から新たなフィルタ係数をフィルタ係数に代えて第1の係数レジス2タに格納させる。IIR型デジタルフィルタ3は、第1の係数レジスタ2に格納されたフィルタ係数をフィルタリングに用いる。
【選択図】図1
Description
2、202 第1の係数レジスタ
3 IIR型デジタルフィルタ
3a、203a 第1の加算器
3b、203b 第1の乗算器
3c、203c 第1の遅延回路
3d、203d 第2の乗算器
3e、203e 第2の遅延回路
3f、203f 第3の乗算器
3g 第3の遅延回路
3h 第4の乗算器
3i 第4の遅延回路
3j 第5の乗算器
4、204 ゲイン乗算器
5、205 第2の加算器
6、206 第2のゲインレジスタ
7、207 第2の係数レジスタ
8、208 ピーク値制御回路
100、200 デジタルフィルタ装置
100a、200a 入力端子
100b、200b 出力端子
203 FIR型デジタルフィルタ
Claims (5)
- 入力端子に入力されたデジタル音声信号をフィルタリングし、出力端子から出力デジタル信号を出力するデジタルフィルタ装置であって、
前記出力デジタル信号のゲイン特性を調整するため設定された第1のゲイン乗算値を格納する第1のゲインレジスタと、
前記ゲイン乗算値に対応して設定された複数のフィルタ係数を格納する第1の係数レジスタと、
信号を演算しその和を出力する第1の加算器、前記入力端子を介して入力された前記デジタル音声信号に前記第1の係数レジスタに格納されたフィルタ係数に対応した係数を乗算し、前記第1の加算器に出力する第1の乗算器、前記入力端子を介して入力された前記デジタル音声信号を遅延させた信号を出力する第1の遅延回路、前記第1の遅延回路から出力された信号に前記第1の係数レジスタに格納されたフィルタ係数に対応した係数を乗算し、前記第1の加算器に出力する第2の乗算器、第1の加算器の出力信号を遅延させた信号を出力する第2の遅延回路、および前記第2の遅延回路から出力された信号に前記第1の係数レジスタに格納されたフィルタ係数に対応した係数を乗算し、前記第1の加算器に出力する第3の乗算器、を少なくとも有するIIR型デジタルフィルタと、
前記第1の加算器から出力された信号に、ゲイン乗算値を乗算するゲイン乗算器と、
前記デジタル音声信号と前記ゲイン乗算器から出力された信号とを加算し、前記出力端子に出力する第2の加算器と、
新たに設定された第2のゲイン乗算値を格納する第2のゲインレジスタと、
前記第2のゲイン乗算値に対応して設定された新たな複数のフィルタ係数を格納する第2の係数レジスタと、
前記第1の係数レジスタおよび前記第2の係数レジスタを制御するとともに、前記ゲイン乗算器に適用される前記ゲイン乗算値を前記第1のゲイン乗算値から前記第2のゲイン乗算値に推移させることにより、前記出力デジタル信号のピーク値を調整するピーク値制御回路と、を備え、
前記ピーク値制御回路は、
前記第1のゲイン乗算値と前記第2のゲイン乗算値とを比較し、
前記第1のゲイン乗算値の符号と前記第2のゲイン乗算値の符号とが異なる場合は、前記ゲイン乗算器に適用されるゲイン乗算値を前記第1のゲイン乗算値から前記第2のゲイン乗算値に推移させる過程でその値がゼロになるタイミングまたは初めて最もゼロに近くなるタイミングで、前記第2の係数レジスタから前記新たなフィルタ係数を前記フィルタ係数に代えて前記第1の係数レジスタに格納させ、
前記第1のゲイン乗算値の符号と前記第2のゲイン乗算値の符号とが同じ場合は、前記第1のゲイン乗算値と前記第2のゲイン乗算値のうちゼロに近い方を前記ゲイン乗算器に適用するタイミングで、前記第2の係数レジスタから前記新たなフィルタ係数を前記フィルタ係数に代えて前記第1の係数レジスタに格納させる
ことを特徴とするデジタルフィルタ装置。 - 前記IIR型デジタルフィルタがピーキングフィルタとして機能するように、前記フィルタ係数が選択されている
ことを特徴とする請求項1に記載のデジタルフィルタ装置。 - 前記IIR型デジタルフィルタがノッチフィルタとして機能するように、前記フィルタ係数が選択されている
ことを特徴とする請求項1に記載のデジタルフィルタ装置。 - 前記IIR型デジタルフィルタがシェルビングフィルタとして機能するように、前記フィルタ係数が選択されている
ことを特徴とする請求項1に記載のデジタルフィルタ装置。 - 入力端子に入力されたデジタル音声信号をフィルタリングし、出力端子から出力デジタル信号を出力するデジタルフィルタ装置であって、
前記出力デジタル信号のゲイン特性を調整するため設定された第1のゲイン乗算値を格納する第1のゲインレジスタと、
前記ゲイン乗算値に対応して設定された複数のフィルタ係数を格納する第1の係数レジスタと、
信号を演算しその和を出力する第1の加算器、前記入力端子を介して入力された前記デジタル音声信号に前記第1の係数レジスタから取得されたフィルタ係数を乗算し、前記第1の加算器に出力する第1の乗算器、前記入力端子を介して入力された前記デジタル音声信号を遅延させた信号を出力する第1の遅延回路、前記第1の遅延回路から出力された信号に前記第1の係数レジスタから取得されたフィルタ係数を乗算し、前記第1の加算器に出力する第2の乗算器、を少なくとも有するFIR型デジタルフィルタと、
前記第1の加算器から出力された信号に、ゲイン乗算値を乗算するゲイン乗算器と、
前記デジタル音声信号と前記ゲイン乗算器から出力された信号とを加算し、前記出力端子に出力する第2の加算器と、
新たに設定された第2のゲイン乗算値を格納する第2のゲインレジスタと、
前記第2のゲイン乗算値に対応して設定された新たな複数のフィルタ係数を格納する第2の係数レジスタと、
前記第1の係数レジスタおよび前記第2の係数レジスタを制御するとともに、前記ゲイン乗算器に適用される前記ゲイン乗算値を前記第1のゲイン乗算値から前記第2のゲイン乗算値に推移させることにより、前記出力デジタル信号のピーク値を調整するピーク値制御回路と、を備え、
前記ピーク値制御回路は、
前記第1のゲイン乗算値と前記第2のゲイン乗算値とを比較し、
前記第1のゲイン乗算値の符号と前記第2のゲイン乗算値の符号とが異なる場合は、前記ゲイン乗算器に適用されるゲイン乗算値を前記第1のゲイン乗算値から前記第2のゲイン乗算値に推移させる過程でその値がゼロになるタイミングまたは初めて最もゼロに近くなるタイミングで、前記第2の係数レジスタから前記新たなフィルタ係数を前記フィルタ係数に代えて前記第1の係数レジスタに格納させ、
前記第1のゲイン乗算値の符号と前記第2のゲイン乗算値の符号とが同じ場合は、前記第1のゲイン乗算値と前記第2のゲイン乗算値のうちゼロに近い方を前記ゲイン乗算器に適用するタイミングで、前記第2の係数レジスタから前記新たなフィルタ係数を前記フィルタ係数に代えて前記第1の係数レジスタに格納させる
ことを特徴とするデジタルフィルタ装置。
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