JP2006145789A - 光素子アレイ、光導波路アレイ、それを用いた光電複合装置および電子機器 - Google Patents

光素子アレイ、光導波路アレイ、それを用いた光電複合装置および電子機器 Download PDF

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Abstract

【課題】例えば複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで光導波路の端部が延伸方向に順次ずれて形成される光導波路アレイの、複数の光導波路の端部に対応して配置された複数個の光素子を有する光素子アレイにおいて、隣接する光素子間における素子本体部（発光部、受光部）や電極の間隔をより大きくする。
【解決手段】光導波路の延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に並ぶ複数個の光素子１０について、一個毎に、素子本体部１０ｂおよび電極１０ａの位置を逆とする。素子本体部１０ｂおよび電極１０ａの位置を全て同じとする場合に比べて、隣接する光素子１０間における素子本体部１０ｂや電極１０ａの間隔を大きくできる。これにより、電極のショート不良を良好に防止でき、またレンズ径を大きくして光束を大きくし、レンズ間の結合効率を上げることができる。
【選択図】 図９

Description

この発明は、光素子アレイ、光導波路アレイ、それを用いた光電複合装置および電子機器に関する。詳しくは、この発明は、例えば複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで光導波路の端部が延伸方向に順次ずれて形成される光導波路アレイの、複数の光導波路の端部に対応して配置された複数個の光素子を有するものであって、光素子は延伸方向に素子本体部と電極とが並べて配置され、延伸方向と直交する方向に並ぶ複数個の光素子は一個毎に素子本体部および電極の位置が逆とされることによって、隣接する光素子間における素子本体部の間隔および電極の間隔をより大きくできるようにした光素子アレイ等に係るものである。
従来、ＬＳＩ等の半導体チップ間の信号伝送は、基板配線を介した電気信号によりなされている。しかし、昨今のＭＰＵ(Micro Processing Unit)の高機能化に伴い、半導体チップ間にて必要とされるデータ授受量は著しく増大し、結果として様々な高周波問題が浮上している。
それらの代表的なものとして、ＲＣ(Register and Capacitor)信号遅延、インピーダンスミスマッチング、ＥＭＣ(ElectroMagnetic Compatibility)／ＥＭＩ(ElectroMagnetic Interference)、クロストーク等がある。従来、これらの問題を解決するため、配線位置の最適化、新素材開発などが行われてきた。
しかし近年、上述の配線位置の最適化、新素材開発等の効果は物理的限界に阻まれつつあり、今後システムの高機能化を実現するためには、単純な半導体チップの実装を前提としたボード構造そのものを見直す必要が生じてきている。例えば、以下に簡単に説明する、マルチチップモジュール（ＭＣＭ）化による微細配線結合、各種半導体チップのポリイミド樹脂などを用いた配線の二次元的な封止、一体化による電気配線結合、基板貼り合わせによる半導体チップの三次元結合などが開発されている。
・ＭＣＭ化による微細配線結合
高機能チップを、セラミック・シリコンなどの精密実装基板上に実装し、マザーボード（多層プリント基板）上では形成不可能である微細配線結合を実現する。これによって、配線の狭ピッチ化が可能となり、バス幅を拡げることでデータ授受量が飛躍的に増大する。
・各種半導体チップの封止、一体化による電気配線結合
各種半導体チップをポリイミド樹脂などを用いて二次元的に封止し、一体化し、その一体化された基板上にて微細配線結合を行う。これによって、配線の狭ピッチ化が可能となり、バス幅を拡げることでデータ授受量が飛躍的に増大する。
・半導体チップの三次元結合
各種半導体チップに貫通電極を設け、それぞれを貼り合わせることで積層構造とする。これによって、異種半導体チップ間の結線が物理的に短絡化され、結果として信号遅延などの問題が回避される。ただし、積層化による発熱量増加、半導体チップ間の熱応力などの問題が生じる。
また、信号授受の高速化および大容量化を実現するために、光配線による光伝送結合技術が開発されている（例えば、非特許文献１、非特許文献２参照）。半導体チップ間の信号伝送を光信号で行うことで、電気配線におけるようなＲＣ遅延の問題はなく、伝送速度を大幅に向上させることができる。また、半導体チップ間の信号伝送を光信号で行うことで、電磁波に関する対策を全く必要とせず、比較的自由な配線設計が可能となる。
半導体チップ間に対応する光配線技術には種々の方式がある。例えば、以下に簡単に説明する、アクティブインターポーザ方式、自由空間伝送方式、光コネクタ接続方式、光導波路埋め込み方式、表面実装方式などがある。
・アクティブインターポーザ方式（非特許文献１のｐ．１２５、図７参照）
これは、プリント配線基板（ボード）上に光導波路が実装されている。光素子は、トランシーバーモジュールの裏面に実装され、光導波路の４５°全反射ミラーに対し、精密に位置決めされている。利点としては、既存のプリント配線基板の実装構造上に展開できることが挙げられる。また、懸案点としては、構造が大掛かりなため、コストが高いこと、光軸合わせが困難であること、また電気伝送経路の短縮が困難であり、高周波伝送に不向きであることが挙げられる。
・自由空間伝送方式（非特許文献１のｐ．１２３、図５参照）
これは、プリント配線基板の裏面に光配線基板（石英）を実装し、伝送基板内において光をジグザグに反射させ、信号を伝播させる。光素子アレイ＋自由空間伝送により、原理的には数千レベルの多チャンネル化が可能である。また、光軸合わせを容易にするため、数枚のレンズを組み合わせたハイブリッド光学系を構成している。利点としては、原理的には数千チャネルの多重伝送が可能であること、またハイブリッド光学系を構成しているため、光軸合わせが容易であることが挙げられる。また、懸案点としては、光配線基板が高価であること、反射による信号伝播のため、波形が乱れ易く、伝播損失が大きいこと、また新規開発技術が数多く盛り込まれているため、信頼性に関する実績がほとんど無いことが挙げられる。
・光コネクタ接続方式（非特許文献１のｐ．１２２、図４参照）
これは、ＬＳＩチップの周囲に小型光コネクタを配置し、ＬＳＩチップを実装した後、自由に光路を設定できる光伝送モジュールシステムである。利点としては、コネクタにより精度が保証されており、コストのかかる光軸合わせ工程が不要であること、光ファイバーを用いているため、プリント配線基板間などの中距離伝送が可能であること、また既存のプリント配線基板の実装構造上に展開できることが挙げられる。また、懸案点としては、コネクタモジュールの小型化に限界があり、半導体チップとコネクタ間における電気配線の短縮化が困難であること、高周波伝送用としては不向きであること、伝送媒体として光ファイバーを採用しているため、多バス化に限界が有ること、また構成部品数が多く、バス当たりのコストダウンが困難であることが挙げられる。
・光導波路埋め込み方式（非特許文献１のｐ１２４、図６参照）
これは、光導波路をプリント配線基板に埋め込み、既存のプリント配線基板の実装構造の形態を維持しながら光配線を設ける方法である。光路結合にマイクロレンズを採用し、光軸ズレ許容量を一般実装精度レベルまで緩和させている。利点としては、発光素子をＬＳＩチップの裏面に直接実装しているため、ＬＳＩチップと発光素子間の電気配線経路を極限まで短くできること、またコリメート光結合により、一般実装精度での光軸合わせが可能であることが挙げられる。また、懸案点としては、光配線をプリント配線基板内に設けるため、プリント配線基板の製造やコストダウンが困難であること、光素子の放熱対策が不明であること、またプリント配線基板が脆弱であるため、レンズと光導波路間の光結合損失が変動する可能性が有ることが挙げられる。
・表面実装方式（非特許文献２参照）
これは、光素子を、ＬＳＩチップの裏面に直接貼り付けて機能させ、また、光導波路をプリント配線基板上に直接実装する方式である。既存のプリント配線基板の構造をそのまま維持し、光配線の併設が可能である。利点としては、発光素子をＬＳＩチップの裏面に直接実装しているため、ＬＳＩチップと発光素子間の電気配線経路を極限まで短くできること、構造がシンプルであり、コストダウンが可能であること、また既存のプリント配線基板の実装構造上に展開できることが挙げられる。また、懸案点としては、光素子をＬＳＩチップに直接貼り付けるため、専用のＬＳＩチップの開発が必要であること、また光素子が高温のＬＳＩチップに直接貼り付けられているため、光素子の高温劣化が懸念されることが挙げられる。
上述した各方式は、以下の第１〜第５の理由により、現状では決定力に欠けるものである。
第１に、既存のプリント配線基板の実装構造をそのまま利用できる構造ではないこと。すなわち、プリント配線基板上に光経路を直接積層する構造は、ベースとなるプリント配線基板自体が脆弱であるため、光軸ズレ等の問題が生じて現実的ではない。一方、これまで培われてきたプリント配線基板の構造に変更を加えると、性能、信頼性、高周波性能の確認などに膨大な労力を要する。従って、埋め込み型光導波路など、既存のプリント配線基板を流用できないシステム構造は望ましくない。
第２に、既存の実装プロセスをそのまま利用できる構造ではないこと。一般に、光導波路などの光モジュールは高温プロセスに弱い。上述したようなプリント配線基板と光配線部が一体化した方式では、光モジュールが、はんだリフロー、アンダーフィル樹脂封止などの高温プロセスに曝されることになり、現実には実施が困難である。また、高温プロセスを考慮した材料や部品を採用しなくてはならず、大きな制約条件となる。
第３に、大掛かりな構造物を排除した構造ではないこと。すなわち、プリント配線基板の剛性が低いため、大掛かりな部品による光路構造は、外部応力により光軸ズレを引き起こし易い。従って、上述したようなアクティブインターポーザ方式によるポスト構造は、避けるべきである。
第４に、高密度化が可能な光配線構造ではないこと。すなわち、プリント配線基板上の半導体チップ間の光配線に特化すると、高密度化が不可能な光ファイバーは採用すべきではないと考えられる。光ファイバーを用いた光コネクタ接続方式などは、装置間通信に向けたシステムとして限定されたものとなる。
第５に、ＬＳＩチップ−光素子間の配線長を短くできる構造ではないこと。すなわち、ＬＳＩチップ−光素子間の電気配線長を短絡化できない構造では、高周波信号が光素子に到達する前に劣化し、光変換の効果がなくなる。従って、この距離を短くできるシステム構造を構築する必要がある。
そこで、本出願人は、先に、発光素子アレイ、受光素子アレイなどの光素子アレイが裏面に実装されるインターポーザがＩＣソケットに固定されると共に、光素子アレイに対向するように光導波路アレイがＩＣソケットに配置される、ＩＣソケットをベースとした光結合法を提案した。
また、本出願人は、この光結合法で用いることができる光導波路アレイの高密度化技術を提案している（特許文献１参照）。この技術に係る光導波路アレイは、複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで光導波路の端部が延伸方向に順次ずれて形成されるものである。このような光導波路アレイにより、光干渉や素子発熱によるクロストークの影響を避けるためのピッチで各光素子を配置しつつ、光導波路の配列ピッチを小さくできる。
日経エレクトロニクス、"光配線との遭遇"２００１年１２月３日の１２２頁〜１２５頁、図４〜図７ NTT R&D, vol.48, no.3, pp.271-280 (1999) 特開２００４−１９８５７９号公報
上述した光導波路アレイの高密度化技術により、１００μｍ以上の素子ピッチを保ちながら導波路ピッチを１０μｍ程度まで狭めることが可能となった。
この技術によりさらに集積度を上げることができるが、それについては下記の制約を受ける。
１．熱クロストーク
隣接する素子の発光熱が伝わり、高周波特性が低下する。一般に、発光素子間隔を約１００μｍ確保すれば問題ないとされている。
２．電極間隔
光素子をフリップチップ実装するため、電極にははんだバンプが設けられる。バンプサイズの微小化が進んでいるが、信頼性、量産性を考慮すると、そのサイズはφ５０μｍ以上となることが好ましい。また、バンプピッチはバンプサイズの約２倍の１００μｍ以上が好ましい。それ以下であると、隣接バンプが溶解時に結合し、ショート不良となる。
３．レンズ径と光束
素子の発光面、受光面にはレンズが貼り付けられるが、そのレンズ径は素子間隔以下の径となる。この場合、レンズを通す光速は実装によるずれを考慮し、実装許容誤差を引いた値となる。光束は、レンズ間の結合効率を上げるため、できるだけ大きくする必要がある。すなわち、素子間隔をより大きくする必要がある。
この発明の目的は、隣接する光素子間における素子本体部（発光部、受光部）および電極の間隔をより大きくできる光素子アレイ等を提供することにある。
この発明に係る光素子アレイは、行列状に配置された複数個の光素子を有し、一の方向に並ぶ所定個数の光素子のそれぞれは、一の方向と直交する他の方向に順次所定間隔だけずれて配置され、所定間隔は他の方向に並ぶ光素子の間隔を上記所定個数で割った値とされる光素子アレイであって、光素子には、一の方向に素子本体部と電極とが並べて配置され、他の方向に並ぶ複数の光素子は一個毎に素子本体部および電極の位置が逆とされるものである。
また、この発明に係る光素子アレイは、複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで光導波路の端部が延伸方向に順次ずれて形成される光導波路アレイの複数の光導波路の端部に対応して配置された複数個の光素子を有する光素子アレイであって、光素子には、延伸方向に素子本体部と電極とが並べて配置され、延伸方向と直交する方向に並ぶ複数個の光素子は一個毎に素子本体部および電極の位置が逆とされるものである。
また、この発明に係る光導波路アレイは、複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで光導波路の端部が延伸方向に順次ずれて形成される光導波路アレイであって、延伸方向と直交する方向に所定本の間隔毎に存在する各光導波路の端部は、隣接する上記所定本の間隔毎に存在する光導波路の端部に対して、延伸方向に所定距離だけずれているものである。
また、この発明に係る光電複合装置は、ＩＣソケットと、光素子アレイが裏面に実装され、ＩＣソケットに固定されるインターポーザと、光素子アレイに対向するようにＩＣソケットに設置される光導波路アレイとを備える光電複合装置であって、光導波路アレイは、複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで光導波路の端部が延伸方向にずれて形成され、光素子アレイは、上述した構成とされているものである。
また、この発明に係る電子機器は、複数の電子部品からなる電子機器であって、この複数の電子部品に含まれる第１の電子部品と第２の電子部品との間で光信号を用いた信号伝送を行うための上述した光電複合装置が設けられるものである。
この発明においては、ＩＣソケットに、電子部品、例えば半導体チップが実装されると共に光素子アレイが裏面に実装されたインターポーザ（基板）が固定される。また、このＩＣソケットに、光素子アレイに対向するように光導波路アレイが配置される。
光導波路アレイには複数本の光導波路が延伸方向と直交する方向に並べて配置されている。この複数本の光導波路は所定単位の繰り返しでその端部が延伸方向にずれて形成されている。そして、延伸方向と直交する方向に所定本の間隔毎に存在する各光導波路の端部は、隣接する上記所定本の間隔毎に存在する光導波路の端部に対して、延伸方向に所定距離だけずれている。この所定距離は、延伸方向と直交する方向に隣接して並ぶ２つの光素子における素子本体部（発光部または受光部）の延伸方向の距離に対応している。
光素子アレイには複数本の光導波路の端部に対応して複数個の光素子が配置されている。この場合、複数個の光素子は行列状に配置されており、延伸方向（一の方向）に並ぶ所定個数の光素子のそれぞれは、この延伸方向（一の方向）と直交する方向（他の方向）に順次所定間隔だけずれて配置されている。この所定間隔は、延伸方向と直交する方向に並ぶ光素子の間隔を所定個数で割った値とされる。光素子には、光導波路の延伸方向に、素子本体部と電極とが並べて配置されている。そして、光導波路の延伸方向（一の方向）と直交する方向（他の方向）に並ぶ複数個の光素子は一個毎に素子本体部および電極の位置が逆とされている。
このように、延伸方向と直交する方向に並ぶ複数個の光素子は一個毎に素子本体部および電極の位置が逆とされており、従って隣接する光素子間における素子本体部の間隔および電極の間隔を大きくでき、従って電極に設けられるはんだバンプが溶解時に隣接するはんだバンプに結合するショート不良を良好に防止でき、また素子本体部に対応して貼り付けられるレンズ径を大きくし、それに伴って光束を大きくし、レンズ間の結合効率を上げることができる。
なお、延伸方向と直交する方向に並ぶ複数個の光素子のうち一個おきの光素子は、隣接する光素子との間で素子本体部同士の間隔が広がるように、延伸方向に所定距離だけシフトされるようにしてもよい。これにより、光素子間における素子本体部の間隔をさらに大きくできる。
この発明によれば、光素子アレイが、例えば複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで光導波路の端部が延伸方向に順次ずれて形成される光導波路アレイの、複数の光導波路の端部に対応して配置された複数個の光素子を有するものであって、光素子は延伸方向に素子本体部と電極とが並べて配置され、延伸方向と直交する方向に並ぶ複数個の光素子は一個毎に素子本体部および電極の位置が逆とされるものであり、隣接する光素子間における素子本体部の間隔および電極の間隔をより大きくでき、従って電極に設けられるはんだバンプが溶解時に隣接するはんだバンプに結合するショート不良を良好に防止でき、また素子本体部に対応して貼り付けられるレンズ径を大きくし、それに伴って光束を大きくし、レンズ間の結合効率を上げることができる。
図１は、この発明が適用された光電複合装置１００の概略断面図を示している。
この光電複合装置１００は、プリント配線基板（マザーボード）１０１上に実装されるＩＣソケット１０２ａ，１０２ｂと、これらＩＣソケット１０２ａ，１０２ｂに設置されるレンズ一体型の光導波路アレイ１０３とを有している。ＩＣソケット１０２ａ，１０２ｂは、それぞれ、十字型の溝状の凹部１０２ｄを持つ凹凸構造とされている。ＩＣソケット１０２ａ，１０２ｂは、従来周知のように、例えば、絶縁性樹脂、例えばガラス入りＰＥＳ（ポリエチレンスルフィド）樹脂、ガラス入りＰＥＴ（ポリエチレンテレフタレート）樹脂などを用い、凹凸構造を有する金型を用いて形成される。
光導波路アレイ１０３は、後述するように、複数チャネル分の光導波路を備えている。この光導波路アレイ１０３は、ＩＣソケット１０２ａとＩＣソケット１０２ｂとの間に架け渡されている。この光導波路アレイ１０３の両端部は、それぞれ、ＩＣソケット１０２ａ，１０２ｂの溝状の凹部１０２ｄに配置される。この光導波路アレイ１０３は、後述するようにコア層を上下のクラッド層で挟んだ構造とされているが、上側のクラッド層と一体的にレンズ１０４が形成されている。
また、光電複合装置１００は、ＩＣソケット１０２ａ，１０２ｂの凸面上にそれぞれ固定されるインターポーザ（基板）１０５ａ，１０５ｂを有している。インターポーザ１０５ａの裏面には光素子としての発光素子アレイ１０６および受光素子アレイ１０７が実装されており、その表面には半導体チップ１０８ａ、例えばＣＰＵが実装されている。この場合、発光素子アレイ１０６および受光素子アレイ１０７は、インターポーザ１０５ａの内部を介して、半導体チップ１０８ａに接続されている。なお、半導体チップ１０８ａの上面にはヒートシンクとしてのアルミニウム製のフィン１０９が設置されている。
同様に、インターポーザ１０５ｂの裏面には光素子としての発光素子アレイ１０６および受光素子アレイ１０７が実装されており、その表面には半導体チップ１０８ｂが実装されている。この場合、発光素子アレイ１０６および受光素子アレイ１０７は、インターポーザ１０５ｂの内部を介して、半導体チップ１０８ｂに接続されている。
発光素子アレイ１０６は、発光素子、例えば面発光レーザが複数個配列された構成となっている。また、受光素子アレイ１０７は、受光素子、例えばＰＩＮフォトダイオードが複数個配列された構成となっている。上述した光導波路アレイ１０３は、上述した発光素子アレイ１０６の各発光素子、および受光素子アレイ１０７の各受光素子に、それぞれ、各チャネルの光導波路が対向するように設置される。ここで、発光素子は、光導波路に入射する光信号を発光する。受光素子は光導波路から出射された光信号を受光する。
次に、上述した光電複合装置１００におけるインターポーザ１０５ａ，１０５ｂ、および光導波路アレイ１０３の位置決め機構について説明する。
インターポーザ１０５ａ，１０５ｂは、その裏面に下方に向かって植立された位置決め用ピン１１１を有している。この位置決め用ピン１１１は、例えばインターポーザ１０５ａ，１０５ｂの裏面に設けられた金属パッド（図１には図示せず）にはんだ付されることで、当該インターポーザ１０５ａ，１０５ｂの裏面に取り付けられている。この位置決め用ピン１１１は、後述する光導波路アレイ１０３に形成されている位置決め用貫通穴１１３を通過できる第１の径の先端部１１１ｔと、その位置決め用貫通穴１１３を通過できない第２の径の基部１１１ｂとからなっている。基部１１１ｂがインターポーザ１０５ａ，１０５ｂにはんだ付されている。
また、ＩＣソケット１０２ａ，１０２ｂの凹部１０２ｄの底面に、上述したインターポーザ１０５ａ，１０５ｂの位置決め用ピン１１１を挿入するための位置決め用穴１１２を有している。この位置決め用穴１１２の径は、位置決め用ピン１１１の先端部１１１ｔの径より若干小さく形成されている。例えば、位置決め用ピン１１１の先端部１１１ｔの直径が２．１mm（φ＝２．１mm）であるとき、位置決め用穴１１２の直径は２．０mm（φ＝２．０mm）とされる。これにより、位置決め用ピン１１１の先端部１１１ｔが位置決め用穴１１２に挿入される際には、位置決め用穴１１２の樹脂変形によって圧入状態となり、位置決め後のガタが抑制される。
また、光導波路アレイ１０３は、両端部に、上述したインターポーザ１０５ａ，１０５ｂの位置決め用ピン１１１を通すための位置決め用貫通穴１１３を有している。この位置決め用貫通穴１１３の径は、上述した位置決め用穴１１２の径と同様に、位置決め用ピン１１１の先端部１１１ｔの径より若干小さく形成されている。例えば、位置決め用ピン１１１の先端部１１１ｔの直径が２．１mm（φ＝２．１mm）であるとき、位置決め用貫通穴１１３の直径は２．０mm（φ＝２．０mm）とされる。これにより、位置決め用ピン１１１の先端部１１１ｔが位置決め用貫通穴１１３を通る際には、位置決め用貫通穴１１３の樹脂変形によって圧入状態となり、位置決め後のガタが抑制される。
インターポーザ１０５ａ，１０５ｂ、および光導波路アレイ１０３の位置決めは、上述したインターポーザ１０５ａ，１０５ｂの位置決め用ピン１１１が、光導波路アレイ１０３の位置決め用貫通穴１１３を貫通してＩＣソケット１０２ａ，１０２ｂの位置決め用穴１１２に挿入されることで行われる。
この場合、位置決め用ピン１１１の基部１１１ｂおよび先端部１１１ｔの境界の段差部分で光導波路アレイ１０３はＩＣソケット１０２ａ，１０２ｂの面に押圧された状態となる。これにより、光導波路アレイ１０３がＩＣソケットの面から浮き上がることを防止でき、各光導波路の光入射面や光出射面が傾くことによる光量損失を回避できる。
なお、詳細説明は省略するが、インターポーザ１０５ａ，１０５ｂは、それぞれ、例えばその四隅にＩＣソケット１０２ａ，１０２ｂ側への付勢力が与えられ、ＩＣソケット１０２ａ，１０２ｂに押し付けられた状態で、当該ＩＣチケット１０２ａ，１０２ｂ上に固定される。
図２は、上述した光電複合装置１００の概略斜視図を示している。なお、この図２においては、プリント配線基板１０１およびアルミニウム製のフィン１０９の図示は省略している。
次に、上述した光電複合装置１００を構成する各部材について、さらに詳細に説明する。図３Ａ，Ｂは、ＩＣソケット１０２（ＩＣソケット１０２ａ，１０２ｂのそれぞれに対応）の構成を示している。図３Ａは、ＩＣソケット１０２を表面側から見た概略斜視図であり、図３ＢはＩＣソケット１０２を裏面側から見た概略斜視図である。
ＩＣソケット１０２の表面側は、図３Ａに示すように、十字型の溝状の凹部１０２ｄを持つ凹凸構造とされている。凹部１０２ｄの深さは、光導波路アレイ１０３の厚さよりも大きくされ、実装時に、光導波路アレイ１０３と、発光素子アレイ１０６および受光素子アレイ１０７との間に空間が形成されるようになされる。
このＩＣソケット１０２の凸面には、この凸面上に固定されるインターポーザ１０５ａ，１０５ｂ（図１参照）の裏面に設けられた電極パッド１５１との電気的接触をとるための、棒状、板バネ状、渦巻き状などの電極ピン１２１が複数個設けられている。なお、図３Ａには、棒状の電極ピン１２１を示している。
また、このＩＣソケット１０２の裏面には、図３Ｂに示すように、プリント配線基板１０１（図１参照）上の電極との電気的接続をとるための、例えばはんだバンプ等の電極コンタクト１２２が複数個設けられている。この電極コンタクト１２２は、上述の凸面に設けられている電極ピン１２１とＩＣソケット１０２内で電気的に接続されている。
また、このＩＣソケット１０２の凹部１０２ｄの底面には、図３Ａに示すように、上述したインターポーザ１０５ａ，１０５ｂの裏面に設けられた位置決め用ピン１１１を挿入するための位置決め用穴１１２が設けられている。後述するように、インターポーザ１０５ａ，１０５ｂの裏面には、それぞれ８本の位置決め用ピン１１１が設けられているので、位置決め用穴１１２も８個設けられている。なお、図３Ａには、４個のみ示されている。
なお、このＩＣソケット１０２には、十字型の溝状の凹部１０２ｄを利用して、最大４方向から４本の光導波路アレイ１０３（図１参照）を設置できるようになっている。そのため、上述した８個の位置決め用穴１１２のうち、それぞれの方向に対応した２個ずつの位置決め用穴１１２は、それぞれの方向から設置される光導波路アレイ１０３に対応した２本の位置決め用ピン１１１を挿入するために用いられる。
図４Ａ，Ｂは、インターポーザ１０５（インターポーザ１０５ａ，１０５ｂのそれぞれに対応）の構成を示している。図４Ａは、インターポーザ１０５を表面側から見た概略斜視図であり、図４Ｂはインターポーザ１０５を裏面側から見た概略斜視図である。
インターポーザ１０５の表面には、図４Ａに示すように、半導体チップ１０８（半導体チップ１０８ａ，１０８ｂに相当）が実装されている。なお、実装される半導体チップの個数は１個に限られるものではない。また、このインターポーザ１０５の裏面には、図４Ｂに示すように、発光素子アレイ１０６および受光素子アレイ１０７が実装されている。上述したように、インターポーザ１０５には最大４方向から４本の光導波路アレイ１０３を設置できるようになっているので、このインターポーザ１０５の裏面には、それぞれの方向から設置される光導波路アレイ１０３に対応して、４組の発光素子アレイ１０６および受光素子アレイ１０７が実装されている。これら発光素子アレイ１０６および受光素子アレイ１０７は、インターポーザ１０５を介して、半導体チップ１０８に接続されている。
また、このインターポーザ１０５の裏面には、図４Ｂに示すように、上述したＩＣソケット１０２の凸面に設けられた電極ピン１２１（図３参照）との電気的接触をとるための電極パッド１５１が複数個設けられている。
また、このインターポーザ１０５の裏面には、図４Ｂに示すように、金属製の位置決め用ピン１１１が下方に向かって植立されている。この位置決め用ピン１１１は、上述したＩＣソケット１０２に設けられた８個の位置決め用穴１１２に対応して、８本設けられている。
図５Ａ，Ｂは、光導波路アレイ１０３の構成を示している。図５Ａは、光導波路アレイ１０３を表面側から見た概略斜視図であり、図５Ｂは、光導波路アレイ１０３の概略平面図である。
光導波路アレイ１０３の、両端部には、それぞれ、上述したインターポーザ１０５（インターポーザ１０５ａ，１０５ｂ）の位置決め用ピン１１１（図４参照）を通すための位置決め用貫通穴１１３が設けられている。各端部には、位置決め用貫通穴１１３として、第１の穴１１３ｐおよび第２の穴１１３ｑが、幅方向に所定の間隔を空けて設けられている。
ここで、第１の穴１１３ｐは丸穴とされる。例えば、位置決め用ピン１１１の先端部１１１ｔの直径が２．１mmであるとき、この第１の穴１１３ｐはその直径が２．０mmとされる。また、第２の穴１１３ｑは、長径方向が光導波路アレイ１０３の幅方向と一致するように形成された長穴とされる。例えば、位置決め用ピン１１１の先端部１１１ｔの直径が２．１mmであるとき、この第２の穴１１３ｑはその短径が２．０mmとされ、その長径が３．０mmとされる。
この光導波路アレイ１０３の第１の穴１１３ｐにインターポーザ１０５の第１の位置決め用ピン１１１を貫通させるだけでなく、この光導波路アレイ１０３の第２の穴１１３ｑにインターポーザ１０５の第２の位置決め用ピン１１１を貫通させることで、光導波路アレイ１０３の周り止めを行うことができる。また、第２の穴１１３ｑを長穴とすることで、インターポーザ１０５の第１、第２の位置決め用ピン１１１，１１１の幅方向の位置ずれを吸収できる。
次に、図６Ａ〜Ｅを参照して、光導波路アレイ１０３、発光素子アレイ１０６および受光素子アレイ１０７の詳細構成について説明する。
図６Ｃは光導波路アレイ１０３を表面側から見た斜視図、図６Ｄは光導波路アレイ１０３を横方向（長手方向）に切った断面図、図６Ｅは光導波路アレイ１０３を縦方向（幅方向）に切った断面図である。図６Ｃは光導波路アレイ１０３の片方の端部のみを示しているが、もう片方の端部も同様に構成されている。
光導波路アレイ１０３は、基本的には、コア層１３１を、上下のクラッド層１３２，１３３で挟み込んだ構造とされている。この場合、コア層１３１の屈折率がクラッド層１３２，１３３の屈折率より高くされることで、光導波路が構成される。例えば、コア層１３１の材料としてＵＶ硬化光学用樹脂（例えば、屈折率は１．６）が使用され、クラッド層１３２，１３３の材料として光学用射出成型樹脂（例えば、屈折率は１．５）が使用される。
コア層１３１には、複数チャネルの光導波路、つまり複数本の送信用光導波路１３５および複数本の受信用光導波路１３６が形成されている。なお、他方の端部では、送信用光導波路１３５は受信用光導波路１３６となり、受信用光導波路１３６は送信用光導波路１３５となる。この場合、送信用光導波路１３５および受信用光導波路１３６は、光導波路アレイ１０３の幅方向、つまり光導波路の延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に、交互に並べて配置されている。複数本の送信用導波路１３５の端部は、複数本の受信用導波路１３６の端部より、光導波路アレイ１０３の端部側に位置するようにされている。
また、光導波路アレイ１０３の幅方向に並ぶ複数本の送信用光導波路１３５の端部（光入射部）１３５ａは、所定本、本実施の形態では５本の繰り返しで、Ｘ方向に順次ずれるようにされている。また、所定本の間隔毎に存在する各導波路１３５の端部１３５ａは、隣接する所定本の間隔毎に存在する光導波路１３５の端部１３５ａに対して、Ｘ方向に所定距離ｄ1だけずれている。この所定距離ｄ1は、後述する、発光素子アレイ１０６のＹ方向に隣接して並ぶ２つの発光素子１６１における発光部１６１ｂのＸ方向の距離に対応している。
同様に、光導波路アレイ１０３の幅方向に並ぶ複数本の受信用光導波路１３６の端部（光入射部）１３６ａは、所定本、本実施の形態では５本の繰り返しで、Ｘ方向に順次ずれるようにされている。また、所定本の間隔毎に存在する各導波路１３６の端部１３６ａは、隣接する所定本の間隔毎に存在する光導波路１３６の端部１３６ａに対して、Ｘ方向に所定距離ｄ2だけずれている。この所定距離ｄ2は、後述する、受光素子アレイ１０７のＹ方向に隣接して並ぶ２つの受光素子１６３における受光部１６３ｂのＸ方向の距離に対応している。
送信用光導波路１３５の端部１３５ａは４５゜ミラー面とされている。これにより、発光素子アレイ１０６の発光素子で発生された光信号をこの端部１３５ａで光導波路１３５の長手方向側に反射させることができ、当該光信号を効率よく送信できる。また、受信用光導波路１３６の端部１３６ａも４５゜ミラー面とされている。これにより、光導波路１３６で伝送されてきた光信号をこの端部１３６ａで受光素子アレイ１０７の受光素子側に反射させることができ、当該光信号を効率よく受信できる。
また、各送信用光導波路１３５の端部１３５ａおよび各受信用光導波路１３６の端部１３６ａにそれぞれ対応して、上側のクラッド層１３２と一体的にレンズ１０４が形成されている。この場合、送信用光導波路１３５の端部１３５ａに対応したレンズ１０４は、発光素子アレイ１０６の発光素子側からの平行光を当該端部１３５ａに集光する集光レンズの働きをする。一方、受信用光導波路１３６の端部１３６ａに対応したレンズ１０４は、当該端部１３６ａからの発散光を平行光にするコリメートレンズの働きをする。
また、光導波路アレイ１０３の端部において、上側のクラッド層１３２の両側および前側が下方に延長され、両側面および前面に所定の高さの壁板１３７が形成されている。このように壁板１３７が形成されることで、光導波路アレイ１０３がＩＣソケット１０２ａ，１０２ｂの面に押し付けられた状態でも、光導波路１３５，１３６の部分は、ＩＣソケット１０２ａ，１０２ｂの面から浮いた状態に置かれ、破損などを良好に回避できる。
なお、位置決め用貫通穴１１３としての第１の穴１１３ｐおよび第２の穴１１３ｑは、上側のクラッド層１３２に形成される。
図６Ａは、発光素子アレイ１０６およびそれに装着されるレンズアレイ１４１（図１には図示せず）を示している。発光素子アレイ１０６は、上述した光導波路アレイ１０３の複数本の送信用光導波路１３５の端部１３５ａに対応して、複数個の発光素子１６１が配置されている。この場合、複数個の発光素子１６１は行列状に配置されており、光導波路１３５の延伸方向（Ｘ方向）に並ぶ所定個数、本実施の形態では５個の発光素子１６１のそれぞれは、この延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に順次所定間隔ｄ3だけずれて配置されている。この所定間隔ｄ3は、Ｙ方向に並ぶ発光素子１６１の間隔を所定個数、本実施の形態では５で割った値とされる。なお、この所定間隔ｄ3は、各送信用光導波路１３５のＹ方向のピッチと一致している。
各発光素子１６１には、Ｘ方向に、素子本体部としての発光部１６１ｂと電極１６１ａとが並べて配置されている。そして、Ｙ方向に並ぶ複数個、本実施の形態では３個の発光素子１６１は一個毎に発光部１６１ｂおよび電極１６１ａの位置が逆とされている。すなわち、Ｙ方向に、発光部１６１ｂおよび電極１６１ａが交互に並んだ状態とされている。ここで、発光素子１６１は例えば面発光レーザであって、発光部１６１ｂから裏面（下面）側に光信号としてのレーザ光が出射される。
また、レンズアレイ１４１には、発光素子アレイ１０６の複数個の発光素子１６１にそれぞれ対応した複数個のレンズ１４２が形成されている。このレンズ１４２は、発光部１６１ｂからの発散光を平行光にするコリメートレンズの働きをする。
図６Ｂは、受光素子アレイ１０７およびそれに装着されるレンズアレイ１４３（図１には図示せず）を示している。受光素子アレイ１０７は、上述した光導波路アレイ１０３の複数本の受信用光導波路１３６の端部１３６ａに対応して、複数個の受光素子１６３が配置されている。この場合、複数個の受光素子１６３は行列状に配置されており、光導波路１３６の延伸方向（Ｘ方向）に並ぶ所定個数、本実施の形態では５個の受光素子１６３のそれぞれは、この延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に順次所定間隔ｄ3だけずれて配置されている。この所定間隔ｄ3は、Ｙ方向に並ぶ受光素子１６３の間隔を所定個数、本実施の形態では５で割った値とされる。なお、この所定間隔ｄ3は、各受信用光導波路１３６のＹ方向のピッチと一致している。
各受光素子１６３には、Ｘ方向に、素子本体部としての受光部１６３ｂと電極１６３ａとが並べて配置されている。そして、Ｙ方向に並ぶ複数個、本実施の形態では３個の受光素子１６３は一個毎に受光部１６３ｂおよび電極１６３ａの位置が逆とされている。すなわち、Ｙ方向に、受光部１６３ｂおよび電極１６３ａが交互に並んだ状態とされている。ここで、受光素子１６３は例えばＰＩＮフォトダイオードであって、裏面（下面）側から受光部１６３ｂに光信号としてのレーザ光が入射される。
また、レンズアレイ１４３には、受光素子アレイ１０７の複数個の受光素子１６３にそれぞれ対応した複数個のレンズ１４４が形成されている。このレンズ１４４は、光導波路アレイ１０３の受信用光導波路１３６側からの平行光を受光素子１６３の受光部１６３ｂに集光する集光レンズの働きをする。
次に、図１に示す光電複合装置１００の製造方法の一例について説明する。
まず、プリント配線基板１０１上に、ＩＣソケット１０２ａ，１０２ｂを実装する。この場合、プリント配線基板１０１上の電極とＩＣソケット１０２ａ，１０２ｂの裏面の電極コンタクト１２２とを位置合わせして、プリント配線基板１０１上の電極とＩＣソケット１０２ａ，１０２ｂとが電気的に接続されるように実装する。なお、プリント配線基板１０１上には、予めその他の電子部品などの実装および電気配線を行っておく。
次に、ＩＣソケット１０２ａ，１０２ｂに光導波路アレイ１０３を設置し、これらＩＣソケット１０２ａ，１０２ｂ間に光導波路アレイ１０３が架け渡された状態とする。この場合、光導波路アレイ１０３の両端部は、それぞれ、ＩＣソケット１０２ａ，１０２ｂの溝状の凹部１０２ｄに配置される。この場合、ＩＣソケット１０２ａ，１０２ｂに設置される光導波路アレイ１０３の長さが、これらＩＣソケット１０２ａ，１０２ｂの距離より長いことが望ましい。これにより、光導波路アレイ１０３を撓ませた状態で固定でき、ＩＣソケット１０２ａ，１０２ｂのプリント配線基板１０１上における位置決め誤差を吸収できる。
次に、ＩＣソケット１０２ａの凸面上にインターポーザ１０５ａを固定する。この場合、インターポーザ１０５ａの裏面に設けられている８本の位置決め用ピン１１１の先端部１１１ｔが、ＩＣソケット１０２ａの凹部１０２ｄの底面に設けられた位置決め用穴１１２に挿入されることで、インターポーザ１０５ａの位置決めが行われる。なおこの場合、光導波路アレイ１０３に対応した２本の位置決め用ピン１１１は、当該光導波路アレイ１０３の位置決め用貫通穴１１３（第１の穴１１３ｐ、第２の穴１１３ｑ）を通された後に、位置決め用穴１１２に挿入される。これにより、光導波路アレイ１０３の位置決めも同時に行われる。
なお、このようにＩＣソケット１０２ａの凸面上にインターポーザ１０５ａが固定されるとき、このインターポーザ１０５ａには、例えばその四隅にＩＣソケット１０２ａ側への付勢力が与えられ、当該インターポーザ１０５ａはＩＣソケット１０２ａに押し付けられた状態とされる。
次に、インターポーザ１０５ａの表面に実装されている半導体チップ１０８ａの上面に、アルミニウム製のフィン１０９を設置する。これにより、半導体チップ１０８ａで発生される熱をフィン１０９を通して効率的に放熱できるようになる。
次に、ＩＣソケット１０２ｂの凸面上にインターポーザ１０５ｂを固定する。この場合、インターポーザ１０５ｂの裏面に設けられている８本の位置決め用ピン１１１の先端部１１１ｔが、ＩＣソケット１０２ｂの凹部１０２ｄの底面に設けられた位置決め用穴１１２に挿入されることで、インターポーザ１０５ｂの位置決めが行われる。なおこの場合、光導波路アレイ１０３に対応した２本の位置決め用ピン１１１は、当該光導波路アレイ１０３の位置決め用貫通穴１１３（第１の穴１１３ｐ、第２の穴１１３ｑ）を通された後に、位置決め用穴１１２に挿入される。これにより、光導波路アレイ１０３の位置決めも同時に行われる。
なお、このようにＩＣソケット１０２ｂの凸面上にインターポーザ１０５ｂが固定されるとき、このインターポーザ１０５ｂには例えばその四隅にＩＣソケット１０２ｂ側への付勢力が与えられ、当該インターポーザ１０５ｂはＩＣソケット１０２ｂに押し付けられた状態とされる。
図７は、光素子（発光素子アレイ１０６、受光素子アレイ１０７）の実装構造を概略的に示している。ここでは、インターポーザ１０５ａの裏面側には発光素子アレイ１０６のみを示し、逆にインターポーザ１０５ｂの裏面側には受光素子アレイ１０７のみを示している。この図７において、図１、図６と対応する部分には同一符号を付し、適宜その説明を省略する。
インターポーザ１０５ａの表面側には半導体チップ１０８ａが実装されている。この場合、インターポーザ１０５ａの表面の電極パッド１５２ａと半導体チップ１０８ａの下面の電極パッド１８１ａとの間にはんだ１５４ａが介在され、半導体チップ１０８ａはインターポーザ１０５ａの表面にはんだ付される。このインターポーザ１０５ａの裏面には発光素子アレイ１０６が実装されている。この場合、インターポーザ１０５ａの裏面の電極パッド１５３ａと発光素子アレイ１０６の上面の電極１６１ａとの間にはんだ１５５ａが介在され、発光素子アレイ１０６はインターポーザ１０５ａの裏面にはんだ付される。なお、この発光素子アレイ１０６の下面にレンズアレイ１４１が装着されている。
また、インターポーザ１０５ｂの表面には半導体チップ１０８ｂが実装されている。この場合、インターポーザ１０５ｂの表面の電極パッド１５２ｂと半導体チップ１０８ｂの下面の電極パッド１８１ｂとの間にはんだ１５４ｂが介在され、半導体チップ１０８ｂはインターポーザ１０５ｂの表面にはんだ付される。このインターポーザ１０５ｂの裏面には受光素子アレイ１０７が実装されている。この場合、インターポーザ１０５ｂの裏面の電極パッド１５３ｂと受光素子アレイ１０７の上面の電極１６３ａとの間にはんだ１５５ｂが介在され、受光素子アレイ１０７はインターポーザ１０５ｂの裏面にはんだ付される。なお、この受光素子アレイ１０７の下面にレンズアレイ１４３が装着されている。
上述した光電複合装置１００（図１、図６、図７参照）の動作を説明する。
ＩＣソケット１０２ａ側で、半導体チップ１０８ａからの電気信号はインターポーザ１０５ａの内部を通ってその裏面に実装された発光素子アレイ１０６の発光素子（例えば面発光レーザ）１６１に供給され、この発光素子１６１の発光部１６１ｂからは電気信号に対応して強度変調された光信号が発生される。
この発光素子１６１からの光信号は発光素子アレイ１０６に装着されたレンズアレイ１４１のレンズ１４２により発散光から平行光とされる。この平行光は光導波路アレイ１０３の上面側のクラッド層１３２と一体的に形成されたレンズ１０４により送信用光導波路１３５の端部（４５゜ミラー面）１３５ａに集光され、光導波路１３５の長手方向側に反射される。これにより、ＩＣソケット１０２ａ側の発光素子アレイ１０６の発光素子１６１で発生された光信号は、送信用光導波路１３５を通じて、ＩＣソケット１０２ｂ側に送信される。
ＩＣソケット１０２ｂ側で、受信用光導波路１３６（ＩＣソケット１０２ａ側では送信用光導波路１３５）を通じて送られてくる光信号は、端部（４５゜ミラー面）１３６ａで受光素子アレイ１０７の受光素子１６３側に反射される。この反射された光信号は光導波路アレイ１０３の上面側のクラッド層１３２と一体的に形成されたレンズ１０４により発散光から平行光とされる。この平行光は受光素子アレイ１０７に装着されたレンズアレイ１４３のレンズ１４４で集光されて受光素子（例えばフォトダイオード）１６３の受光部１６３ｂに入射される。
そして、その光信号は受光部１６３ｂで電気信号に変換される。この電気信号は、インターポーザ１０５ｂの内部を通ってその表面に実装された半導体チップ１０８ｂに供給される。これにより、ＩＣソケット１０２ａ側のインターポーザ１０５ａに実装された半導体チップ１０８ａからの電気信号が、ＩＣソケット１０２ｂ側のインターポーザ１０５ｂに実装された半導体チップ１０８ｂに供給される。
なお、説明は省略するが、ＩＣソケット１０２ｂ側の半導体チップ１０８ｂからＩＣソケット１０２ａ側の半導体チップ１０８ａにも、同様にして電気信号が供給される。
上述した光電複合装置１００によれば、プリント配線基板１０１に実装されたＩＣソケット１０２ａ，１０２ｂに光導波路アレイ１０３を設置するものであり、既存のプリント配線基板１０１の実装構造をそのまま利用でき、従ってプリント配線基板１０１上にＩＣソケットを設置できる領域を設ければ、その他の一般の電気配線は従来通りのプロセスで形成できる。
また、上述した光電複合装置１００によれば、プリント配線基板１０１にＩＣソケット１０２ａ，１０２ｂを固定し、さらにはんだリフロー、アンダーフィル樹脂封止などの高温プロセスを含む、全ての実装プロセスを完了した後、当該ＩＣソケット１０２ａ，１０２ｂに光導波路アレイ１０３を設置すればよいので、光導波路アレイ１０３が高温プロセスに弱いものであっても、高温によるダメージをこうむることなく実装できる。
また、上述した光電複合装置１００によれば、プリント配線基板１０１と比較して剛性の高い樹脂で作製できるＩＣソケット１０２ａ，１０２ｂ上で、発光素子アレイ１０６および受光素子アレイ１０７と、光導波路アレイ１０３との光結合を行うものであり、光結合に必要とされる実装精度を容易に確保できる。例えば、現状のモールド技術により数μｍオーダーの組立て精度を確保でき、従って光バスの高密度化が可能となる。
また、上述した光電複合装置１００によれば、半導体チップ１０８ａ，１０８ｂと、発光素子アレイ１０６および受光素子アレイ１０７とを、インターポーザ１０５ａ，１０５ｂを介して近接した状態で設置できるので、それらの間の配線長を短くでき、従って電気信号のノイズ対策、クロストーク対策も容易となり、光変調速度を向上させることができる。
また、上述した光電複合装置１００によれば、プリント配線基板１０１に実装されたＩＣソケット１０２ａ，１０２ｂに光導波路アレイ１０３を設置するものであり、プリント配線基板１０１の高密度配線とその設計の自由度を確保しながら、光配線システムを安価かつ高い自由度でプリント配線基板１０１上に展開できる。
また、上述した光電複合装置１００によれば、ＩＣソケット１０２ａ，１０２ｂの凸面上にインターポーザ１０５ａ，１０５ｂが固定され、光導波路アレイ１０３は溝状の凹部１０２ｄに配置され、またインターポーザ１０５ａ，１０５ｂの裏面に、光導波路アレイ１０３に対向した位置に、発光素子アレイ１０６および受光素子アレイ１０７が実装されており、光導波路アレイ１０３と、発光素子アレイ１０６および受光素子アレイ１０７との間に空間が形成されているので、インターポーザ１０５ａ，１０５ｂの表面に実装された半導体チップ１０８ａ，１０８ｂの発熱による光導波路アレイ１０３の破壊を良好に防止できる。
また、上述した光電複合装置１００によれば、インターポーザ１０５ａ，１０５ｂの裏面に設けられた位置決め用ピン１１１が、光導波路アレイ１０３の位置決め用貫通穴１１３を貫通してＩＣソケット１０２ａ，１０２ｂの位置決め用穴１１２に挿入されることで、インターポーザ１０５ａ，１０５ｂと光導波路アレイ１０３の位置決めを同時に行うものであり、インターポーザ１０５ａ，１０５ｂと光導波路アレイ１０３との間の相対位置決め精度を高めることができる。これにより、発光素子アレイ１０６、受光素子アレイ１０７における隣接する素子間のスペースを小さくでき、同じ面積に配する素子数を増やすことができ、チャネル数を増加できる。あるいは、素子数が同じであるとき、発光素子アレイ１０６、受光素子アレイ１０７の各素子に対応したレンズの径を大きくして光量損失を軽減でき、低消費電力化を図ることができる。
また、上述した光電複合装置１００によれば、インターポーザ１０５ａ，１０５ｂの位置決め用ピン１１１の先端部１１１ｔが光導波路アレイ１０３の位置決め用貫通穴１１３を通る際には、この位置決め用貫通穴１１３の樹脂変形によって圧入状態となるものであり、位置決め後の光導波路アレイ１０３のガタを良好に抑制できる。
また、上述した光電複合装置１００によれば、光導波路アレイ１０３には位置決め用貫通穴１１３として、丸穴である第１の穴１１３ｐ、および長径方向が光導波路アレイ１０３の幅方向と一致するように形成された長穴である第２の穴１１３ｑが設けられている。そのため、第１の穴１１３ｐにインターポーザ１０５ａ，１０５ｂの第１の位置決め用ピン１１１を貫通させるだけでなく、第２の穴１１３ｑにインターポーザ１０５ａ，１０５ｂの第２の位置決め用ピン１１１を貫通させることで、光導波路アレイ１０３の周り止めを行うことができる。また、第２の穴１１３ｑが長穴であることから、インターポーザ１０５ａ，１０５ｂの第１、第２の位置決め用ピン１１１，１１１の幅方向の位置ずれを良好に吸収できる。
また、上述した光電複合装置１００によれば、インターポーザ１０５ａ，１０５ｂの位置決め用ピン１１１の基部１１１ｂおよび先端部１１１ｔの境界の段差部分で光導波路アレイ１０３をＩＣソケット１０２ａ，１０２ｂの面に押圧するものであり、光導波路アレイ１０３がＩＣソケット１０２ａ，１０２ｂの面から浮き上がることを防止でき、送信用光導波路１３５、受信用光導波路１３６の端部１３５ａ，１３６ａである４５゜ミラー面が傾くことによる光量損失を良好に回避できる。
また、上述した光電複合装置１００によれば、発光素子アレイ１０６の発光素子１６１は送信用光導波路１３５の延伸方向（Ｘ方向）に発光部１６１ｂと電極１６１ａとが並べて配置され、この延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に並ぶ複数個の発光素子１６１は一個毎に発光部１６１ｂおよび電極１６１ａの位置が逆とされている。同様に、受光素子アレイ１０７の受光素子１６３は受信用光導波路１３６の延伸方向（Ｘ方向）に受光部１６３ｂと電極１６３ａとが並べて配置され、この延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に並ぶ複数個の受光素子１６３は一個毎に受光部１６３ｂおよび電極１６３ａの位置が逆とされている。したがって、隣接する光素子（発光素子１６１、受光素子１６３）の間における、素子本体部（発光部１６１ｂ、受光部１６３ｂ）や電極（電極１６１ａ、電極１６３ａ）の間隔をより大きくできる。
ここで、本実施の形態において素子本体部の間隔や電極の間隔をより大きくできることについて説明する。
図８は、比較例を示している。この比較例においては、光導波路の延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に並ぶ複数個の光素子１０は、素子本体部１０ｂおよび電極１０ａの位置が全て同じとされている。この場合、例えば、Ｙ方向の光素子１０の間隔が２００μｍとされ、Ｘ方向の光素子１０の間隔が３００μとされ、またＸ方向に並ぶ光素子１０のＹ方向へのずれの間隔ｄ3は４０μｍとされている。この場合、隣接する光素子１０の間における素子本体部１０ｂの最小間隔Ｄ１は２００μｍとなり、また電極１０ａの最小間隔Ｄ２は２００μｍとなる。
図９は、本実施の形態に対応した例を示している。この例においては、光導波路の延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に並ぶ複数個の光素子１０は、一個毎に、素子本体部１０ｂおよび電極１０ａの位置が逆とされている。この場合も、例えば、Ｙ方向の光素子１０の間隔が２００μｍとされ、Ｘ方向の光素子１０の間隔が３００μとされ、またＸ方向に並ぶ光素子１０のＹ方向へのずれの間隔ｄ3は４０μｍとされている。この場合、一個の光素子１０における素子本体部１０ｂと電極１０ａとの間隔が例えば１００μｍであるとき、隣接する光素子１０の間における素子本体部１０ｂの最小間隔Ｄ１は２２３μｍとなり、また電極１０ａの最小間隔Ｄ２は２２３μｍとなる。したがって、図８に示す比較例に比べて、素子本体部１０ｂや電極１０ａの間隔を大きくできる。
このように本実施の形態によれば、電極１０ａの間隔を大きくできるので、電極１０ａに設けられるはんだバンプが溶解時に隣接するはんだバンプに結合するショート不良を良好に防止できる。また、電極１０ａの間隔を大きくできるので、素子本体部１０ｂに対応して貼り付けられるレンズ径を大きくでき、それにより光束を大きくでき、レンズ間の結合効率を上げることができる。例えば、図８の比較例の場合にはレンズ２０の径はφ２００μｍが限度であるが、本実施の形態によれば、図９に示すように、レンズ２０の径をφ２２３μｍまで大きくできる。
なお、上述実施の形態においては、光導波路１３５，１３６の延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に並ぶ複数個の光素子１０（発光素子１６１、受光素子１６３）は、素子本体部１０ｂ（発光部１６１ｂ、受光部１６３ｂ）および電極１０ａ（電極１６１ａ、電極１６３ａ）が直線上に位置するようになっている（図６、図９参照）。しかし、図１０に示すように、延伸方向（Ｘ方向）と直交する方向（Ｙ方向）に並ぶ複数個の光素子１０のうち一個おきの光素子１０を、隣接する光素子１０との間で素子本体部１０ｂ同士の間隔が広がるように、延伸方向（Ｘ）に所定距離だけシフトしてもよい。これにより、素子本体部１０ｂの間隔をさらに大きくできる。例えば、一個おきの光素子１０を延伸方向に例えば２６μｍだけシフトするとき、隣接する光素子１０の間における素子本体部１０ｂの最小間隔Ｄ１は２３６μｍとなり、レンズ２０の径をφ２３６μｍまで大きくできる。
次に、上述した光電複合装置１００（図１参照）を実際に適用し得る電子機器の一例を簡単に説明する。
図１１は、コンピュータシステム２００の構成を示している。このコンピュータシステム２００は、ＣＰＵ(Central Processing Unit)２０１と、メモリコントローラとしてのノースブリッジ２０２と、ＤＲＡＭ(Dynamic Random Access Memory)２０３と、Ｉ／Ｏコントローラとしてのサウスブリッジ２０４と、バス２０５と、ネットワークインタフェース（ネットワークＩ／Ｆ）２０６と、記憶装置２０７と、その他の入出力装置（Ｉ／Ｏ装置）２０８とを備えている。
ノースブリッジ２０２は、光配線２１１を介してＣＰＵ２０１に接続されている。また、サウスブリッジ２０４は、光配線２１２を介してノースブリッジ２０２に接続されていると共に、さらに光配線２１１を介してＣＰＵ２０１に接続されている。また、ＤＲＡＭ２０３は、光配線２１３を介してノースブリッジ２０２に接続されている。ＣＰＵ２０１は、ＯＳ(Operating System)およびアプリケーションプログラムに基づいて各部を制御する。ノースブリッジ２０２は、メモリ２０３へのアクセスを統括制御する。
バス２０５は電気配線２１４を介してサウスブリッジ２０４に接続されている。また、ネットワークインタフェース２０６、記憶装置２０７およびその他のＩ／Ｏ装置２０８は、それぞれ、バス２０５に接続されている。記憶装置２０７は、ＨＤＤ(Hard Disk Drive)、ＤＶＤ(Digital Versatile Disk)ドライブ、ＣＤ(Compact Disc)ドライブなどである。Ｉ／Ｏ装置２０８は、ビデオ入出力装置、シリアルやパラレルのインタフェースなどである。
図１２は、光配線２１０（光配線２１１〜２１３のそれぞれに対応している）の構成例を示している。この光配線２１０は、Ｎチャネル分の光伝送系２２０-1〜２２０-Nを有している。光伝送系２２０-1〜２２０-Nのそれぞれは、第１の回路（第１の電子部品）から第２の回路（第２の電子部品）に光信号を伝送する第１の伝送系２２１と、第２の回路から第１の回路に光信号を伝送する第２の伝送系２２２とからなっている。
第１の伝送系２２１は、パラレル／シリアル変換器（Ｐ／Ｓ変換器）２２１ａ、ドライバアンプ２２１ｂ、発光素子としての半導体レーザ２２１ｃ、光導波路２２１ｄ、受光素子としてのフォトダイオード２２１ｅ、トランスインピーダンスアンプ（ＴＩＡ）２２１ｆ、Ｉ／Ｖ変換アンプ（ＩＶＡ）２２１ｇおよびシリアル／パラレル変換器（Ｓ／Ｐ変換器）２２１ｈを備えている。この場合、Ｐ／Ｓ変換器２２１ａ、ドライバアンプ２２１ｂおよび半導体レーザ２２１ｃは第１の回路側に配置され、フォトダイオード２２１ｅ、ＴＩＡ２２１ｆ、ＩＶＡ２２１ｇおよびＳ／Ｐ変換器２２１ｈは第２の回路側に配置され、光導波路２２１ｄは第１の回路と第２回路の間に配置される。
同様に、第２の伝送系２２１は、Ｐ／Ｓ変換器２２２ａ、ドライバアンプ２２２ｂ、半導体レーザ２２２ｃ、光導波路２２２ｄ、フォトダイオード２２２ｅ、ＴＩＡ２２２ｆ、ＩＶＡ２２２ｇおよびＳ／Ｐ変換器２２２ｈを備えている。この場合、Ｐ／Ｓ変換器２２２ａ、ドライバアンプ２２２ｂおよび半導体レーザ２２２ｃは第２の回路側に配置され、フォトダイオード２２２ｅ、ＴＩＡ２２２ｆ、ＩＶＡ２２２ｇおよびＳ／Ｐ変換器２２２ｈは第１の回路側に配置され、光導波路２２２ｄは第２の回路と第１回路の間に配置される。
ここで、Ｓ／Ｐ変換器２２１ａ，２２２ａは、それぞれ、伝送すべきデータ、例えばｂ0〜ｂ7の８ビットパラレルデータをシリアルデータに変換する。ドライバアンプ２２１ｂ，２２２ｂは、それぞれ、Ｓ／Ｐ変換器２２１ａ，２２２ａで得られたシリアルデータに基づいて半導体レーザ２２１ｃ，２２２ｃを駆動し、この半導体レーザ２２１ｃ，２２２ｃからシリアルデータに対応した光信号を発生させる。ＴＩＡ２２１ｆ，２２２ｆは、それぞれ、フォトダイオード２２１ｅ，２２２ｅからの光電変換による電流信号を、後続のＩ／Ｖ変換アンプ２２１ｇ，２２２ｇに供給する際に、インピーダンスマッチングをとる。ＩＶＡ２２１ｇ，２２２ｇは、それぞれ、ＴＩＡ２２１ｆ，２２２ｆの出力信号である電流信号を電圧信号に変換する。Ｓ／Ｐ変換器２２１ｈ，２２２ｈは、それぞれ、ＩＶＡ２２１ｇ，２２２ｇの出力信号である、伝送されてきたシリアルデータをパラレルデータに変換する。
第１の回路から第２の回路にデータを伝送する際の動作について説明する。第１の回路側では、伝送すべき８ビットのパラレルデータはＰ／Ｓ変換器２２１ａでシリアルデータに変換され、このシリアルデータはドライバアンプ２２１ｂに供給される。このドライバアンプ２２１ｂにより半導体レーザ２２１ｃが駆動され、この半導体レーザ２２１cからはシリアルデータに対応した光信号が発生される。そして、この光信号が光導波路２２１ｄを通って第２の回路側に伝送される。
第２の回路側では、光導波路２２１ｄで伝送されてきた光信号がフォトダイオード２２１ｅに照射される。このフォトダイオード２２１ｅからの光電変換による電流信号は、インピーダンスマッチング用のＴＩＡ２２１ｆを介してＩＶＡ２２１ｇに供給され、電圧信号に変換される。そして、このＩＶＡ２２１ｇの出力信号である、伝送されてきたシリアルデータはＳ／Ｐ変換器２２１ｈでパラレルデータに変換される。
このようにして、第１の回路から第２の回路にデータの伝送が行われる。なお、詳細説明は省略するが、第２の回路から第１の回路にデータを伝送する際の動作についても同様に行われる。図１２に示す光配線２１０では、Ｎチャネル分の光伝送系２２０-1〜２２０-Nを有しているので、Ｎチャネル分のデータ送受信を並行して行うことができる。
上述したコンピュータシステム２００においては、図示しないプリント配線基板（マザーボード）上に、上述した電子部品としてのＣＰＵ２０１、ノースブリッジ２０２、ＤＲＡＭ２０３、サウスブリッジ２０４およびバス２０５をそれぞれ構成する半導体チップが実装される。この場合、ＣＰＵ２０１、ノースブリッジ２０２、ＤＲＡＭ２０３およびサウスブリッジ２０４の部分に、図１に示す光電複合装置１００を適用でき、ＣＰＵ２０１とノースブリッジ２０２の間、ＤＲＡＭ２０３とノースブリッジ２０２の間、ノースブリッジ２０２とサウスブリッジ２０４の間で、光信号を用いた信号伝送を良好に行うことができる。
図１３は、ゲーム機３００の構成を示している。このゲーム機３００は、ゲームアプリケーションプログラム等の各種アプリケーションプログラムに基づいて信号処理や内部構成要素の制御を行うメインＣＰＵ３０１と、画像処理を行うグラフィックプロセッサ（ＧＰ）３０２と、インターネット等のネットワークとのインタフェースを行うためのネットワークインタフェース（ネットワークＩ／Ｆ）３０３と、インタフェース処理を行うＩＯプロセッサ（ＩＯＰ）３０４と、ＤＶＤやＣＤ等の光ディスク３０５の読み出し制御や当該読み出されたデータのデコードを行う光ディスク制御部３０６と、メインＣＰＵ３０１に接続されるメインメモリとしてのＤＲＡＭ３０７と、ＩＯプロセッサ３０４が実行する命令やデータを保持するためのＩＯＰメモリ３０８と、主にオペレーティングシステム用のプログラムが格納されたＯＳ−ＲＯＭ３０９と、音声信号処理を行うサウンドプロセッサユニット（ＳＰＵ）３１０と、圧縮波形データを格納するサウンドバッファ３１１とを基本構成として備えている。
メインＣＰＵ３０１とネットワークＩ／Ｆ３０３は、光配線３１２により接続されている。メインＣＰＵ３０１とグラフィックプロセッサ３０２は、光配線３１３により接続されている。メインＣＰＵ３０１とＩＯプロセッサ３０４は、ＳＢＵＳ３１４により接続されている。ＩＯプロセッサ３０４と、光ディスク制御部３０６、ＯＳ−ＲＯＭ３０９およびサウンドプロセッサユニット３１０は、ＳＳＢＵＳ３１５により接続されている。
メインＣＰＵ３０１は、ＯＳ−ＲＯＭ３０９に格納されたプログラムや、光ディスク３０５から読み出されてＤＲＡＭ３０７にロードされたり、通信ネットワークを介してダウンロードされた、各種のゲームアプリケーションプログラム等を実行する。グラフィックプロセッサ３０２は、例えばビデオゲームにおけるレンダリング処理等を行い、ビデオ信号をディスプレイに出力する。
ＩＯプロセッサ３０４には、コントローラ（図示せず）が接続されるコントローラポート３２１、メモリカード（図示せず）が装填されるメモリカードスロット３２２、ＵＳＢ接続端子３２３およびＩＥＥＥ１３９４接続端子３２４が接続されている。これにより、ＩＯプロセッサ３０４は、コントローラポート３２１を介して接続されたコントローラ、メモリカードスロット３２２を介して接続されたメモリカード、ＵＳＢ接続端子３２３を介して接続された図示しない携帯電話機やパーソナルコンピュータとの間でデータの送受や、プロトコル変換等を行う。
サウンドプロセッサユニット３１０は、サウンドバッファ３１１に格納されている圧縮波形データを、メインＣＰＵ３０１からの命令に基づいて所定のサンプリング周波数で再生することなどにより、様々なサウンドを合成し、オーディオ信号をスピーカに出力する。
なお、光配線３１２，３１３は、それぞれ、上述の図１２に示すように構成されており、メインＣＰＵ３０１とネットワークＩ／Ｆ３０３の間、およびメインＣＰＵ３０１とグラフィックプロセッサ３０２の間では、光信号によってデータの送受信が行われる。
上述したゲーム機３００においては、図示しないプリント配線基板（マザーボード）上に、上述したメインＣＰＵ３０１等の基本構成電子部品としての半導体チップが実装される。
この場合、メインＣＰＵ３０１、グラフィックプロセッサ３０２およびネットワークＩ／Ｆ３０３の部分に、図１に示す光電複合装置１００を適用でき、メインＣＰＵ３０１とネットワークＩ／Ｆ３０３の間、メインＣＰＵ３０１とグラフィックプロセッサ３０２の間で、光信号を用いた信号伝送を良好に行うことができる。
図１４は、サーバ４００の構成を示している。このサーバ４００は、ＣＰＵ４０１，４０２と、チップセット４０３と、ネットワークインタフェース（ネットワークＩ／Ｆ）４０４と、メモリ４０５と、ＰＣＩブリッジ４０６と、ルータ４０７とを基本構成として備えている。
チップセット４０３には、光配線４１１，４１２を介してＣＰＵ４０１，４０２が接続されていると共に、光配線４１３を介して、ネットワークＩ／Ｆ４０４が接続されている。また、チップセット４０３には、電気配線により、メモリ４０５、ＰＣＩブリッジ４０６およびルータ４０７が接続されている。ネットワークＩ／Ｆ４０４は、ネットワークとのインタフェースを行う。チップセット４０３は、ＣＰＵ４０１，４０２、ネットワークＩ／Ｆ４０４、メモリ４０５およびＰＣＩブリッジ４０６などを制御する。
ＰＣＩブリッジ４０６には、ＰＣＩバス４１４を介して、記憶装置などのＰＣＩデバイス４１５〜４１６が接続されている。ルータ４０７は、例えば、スイッチカード４２１およびラインカード４２２〜４２５から構成されている。ラインカード４２２〜４２５は、パケットの前処理を行うプロセッサであり、スイッチカード４２１はパケットの行き先をアドレスに従い切り替えるスイッチである。
なお、光配線４１１〜４１３は、それぞれ、上述の図１２に示すように構成されており、ＣＰＵ４０１，４０１とチップセット４０３の間、およびチップセット４０３とネットワークＩ／Ｆ４０４の間では、光信号によってデータの送受信が行われる。
上述したサーバ４００においては、図示しないプリント配線基板（マザーボード）上に、上述したメインＣＰＵ４０１，４０２、チップセット４０３等の基本構成電子部品としての半導体チップが実装される。
この場合、ＣＰＵ４０１，４０１、チップセット４０３、ネットワークＩ／Ｆ４０４の部分に、図１に示す光電複合装置１００を適用でき、ＣＰＵ４０１，４０１とチップセット４０３の間、およびチップセット４０３とネットワークＩ／Ｆ４０４の間で、光信号を用いた信号伝送を良好に行うことができる。
この発明は、隣接する光素子間における素子本体部の間隔および電極の間隔をより大きくできるようにした光素子アレイ等に係るものであり、例えばＬＳＩ等の半導体チップ間の光信号伝送に適用できる。
実施の形態としての光電複合装置の概略断面図である。 実施の形態としての光電複合装置の概略斜視図である。 ＩＣソケットの構成を示す概略斜視図である。 インターポーザの構成を示す概略斜視図である。 光導波路アレイの構成を示す概略斜視図および概略平面図である。 光導波路アレイ、発光素子アレイおよび受光素子アレイの詳細構成を示す図である。 光素子の実装構造を示す概略断面図である。 光素子アレイにおける各光素子の配置（比較例）を示す図である。 実施の形態の光素子アレイにおける各光素子の配置を示す図である。 光素子アレイにおける各光素子の配置（変形例）を示す図である。 コンピュータシステムの構成を示すブロック図である。 光配線の構成例を説明するための図である。 ゲーム機の構成を示すブロック図である。 サーバの構成を示すブロック図である。
符号の説明
１０・・・光素子、１０ａ・・・電極、１０ｂ・・・素子本体部、２０・・・レンズ、１００・・・光電複合装置、１０１・・・プリント配線基板、１０２，１０２ａ，１０２ｂ・・・ＩＣソケット、１０２ｄ・・・凹部、１０３・・・光導波路アレイ、１０４・・・レンズ、１０５，１０５ａ，１０５ｂ・・・インターポーザ、１０６・・・発光素子アレイ、１０７・・・受光素子アレイ、１０８，１０８ａ，１０８ｂ・・・半導体チップ、１０９・・・フィン、１１１・・・位置決め用ピン、１１１ｂ・・・基部、１１１ｔ・・・先端部、１１２・・・位置決め用穴、１１３・・・位置決め用貫通穴、１１３ｐ・・・第１の穴、１１３ｑ・・・第２の穴、１３１・・・コア層、１３２，１３３・・・クラッド層、１３５・・・送信用光導波路、１３５ａ・・・送信用光導波路の端部（４５゜ミラー面）、１３６・・・受信用光導波路、１３６ａ・・・受信用光導波路の端部（４５゜ミラー面）、１３７・・・壁板、１４１，１４３・・・レンズアレイ、１４２，１４４・・・レンズ、１６１・・・発光素子、１６１ａ・・・電極、１６１ｂ・・・発光部、１６３・・・受光素子、１６３ａ・・・電極、１６３ｂ・・・受光部、２００・・・コンピュータシステム、２１０・・・光配線、３００・・・ゲーム機、４００・・・サーバ

Claims (7)

  1. 行列状に配置された複数個の光素子を有し、
    一の方向に並ぶ所定個数の光素子のそれぞれは、上記一の方向と直交する他の方向に順次所定間隔だけずれて配置され、
    上記所定間隔は上記他の方向に並ぶ光素子の間隔を上記所定個数で割った値とされる光素子アレイであって、
    上記光素子には、上記一の方向に素子本体部と電極とが並べて配置され、
    上記他の方向に並ぶ複数の光素子は一個毎に上記素子本体部および上記電極の位置が逆とされる
    ことを特徴とする光素子アレイ。
  2. 上記他の方向に並ぶ複数個の光素子のうち一個おきの光素子は、隣接する光素子との間で上記素子本体部同士の間隔が広がるように、上記一の方向に所定距離だけシフトされる
    ことを特徴とする請求項１に記載の光素子アレイ。
  3. 複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで上記光導波路の端部が延伸方向に順次ずれて形成される光導波路アレイの上記複数の光導波路の端部に対応して配置された複数個の光素子を有する光素子アレイであって、
    上記光素子には、上記延伸方向に素子本体部と電極とが並べて配置され、
    上記延伸方向と直交する方向に並ぶ複数個の光素子は一個毎に上記素子本体部および上記電極の位置が逆とされる
    ことを特徴とする光素子アレイ。
  4. 上記延伸方向と直交する方向に並ぶ複数個の光素子のうち一個おきの光素子は、隣接する光素子との間で上記素子本体部同士の間隔が広がるように、上記延伸方向に所定距離だけシフトされる
    ことを特徴とする請求項３に記載の光素子アレイ。
  5. 複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで上記光導波路の端部が延伸方向に順次ずれて形成される光導波路アレイであって、
    上記延伸方向と直交する方向に上記所定本の間隔毎に存在する各光導波路の端部は、隣接する上記所定本の間隔毎に存在する光導波路の端部に対して、上記延伸方向に所定距離だけずれている
    ことを特徴とする光導波路アレイ。
  6. ＩＣソケットと、
    光素子アレイが裏面に実装され、上記ＩＣソケットに固定されるインターポーザと、
    上記光素子アレイに対向するように上記ＩＣソケットに設置される光導波路アレイとを備える光電複合装置であって、
    上記光導波路アレイは、複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで上記光導波路の端部が延伸方向にずれて形成され、
    上記光素子アレイは、上記複数本の光導波路の端部に対応して配置された複数個の光素子を有し、
    上記光素子には、上記延伸方向に素子本体部と電極とが並べて配置され、
    上記延伸方向と直交する方向に並ぶ複数個の光素子は一個毎に上記素子本体部および上記電極の位置が逆とされる
    ことを特徴とする光電複合装置。
  7. 複数の電子部品からなる電子機器であって、
    上記複数の電子部品に含まれる第１の電子部品と第２の電子部品との間で光信号を用いた信号伝送を行うための光電複合装置が設けられ、
    上記光電複合装置は、
    ＩＣソケットと、
    電子部品が表面に実装されると共に光素子アレイが裏面に実装され、上記ＩＣソケットに固定されるインターポーザと、
    上記光素子アレイに対向するように上記ＩＣソケットに設置される光導波路アレイとを備え、
    上記光導波路アレイは、複数本の光導波路が延伸方向と直交する方向に並べて配置され、所定本単位の繰り返しで上記光導波路の端部が延伸方向にずれて形成され、
    上記光素子アレイは、上記複数本の光導波路の端部に対応して配置された複数個の光素子を有し、
    上記光素子には、上記延伸方向に素子本体部と電極とが並べて配置され、
    上記延伸方向と直交する方向に並ぶ複数個の光素子は一個毎に上記素子本体部および上記電極の位置が逆とされる
    ことを特徴とする電子機器。
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