JP2006129197A - 高出力差動増幅器 - Google Patents
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Abstract
【解決手段】基本トランジスタセルをN段(Nは2以上の整数)並列接続してなる第1の増幅器11および第2の増幅器12を有し、第1の増幅器11のエミッタ端子および第2の増幅器12のエミッタ端子を互いに接続して仮想接地点6を設け、第1の増幅器11のベース端子および第2の増幅器12のベース端子にそれぞれ逆位相となる信号を入力することにより、第1の増幅器11のコレクタ端子および第2の増幅器12のコレクタ端子から増幅された信号を出力する高出力差動増幅器において、第1の増幅器11および第2の増幅器12の対応する段の基本トランジスタセルのエミッタ電極同士を接続して1対ごとの仮想接地点6a〜6fを設け、1対ごとの仮想接地点6a〜6fを互いに接続したものである。
【選択図】図1
Description
本発明の高出力差動増幅器は、基本トランジスタセルのエミッタ電極同士を1対ごとに仮想接地点として接続することを特徴としており、小型で利得が高く、高い出力が得られる高出力差動増幅器を得ることができ、特に、高周波信号の増幅に対して有効に働く。
本願発明の技術的特徴を明確にするために、まず始めに、基本的な高出力差動増幅器の構成について説明する。図4は、基本的な高出力差動増幅器の構成図である。この高出力差動増幅器は、ベース端子1a、1b、エミッタ端子2、コレクタ端子3a、3b、第1の増幅器11、および第2の増幅器12で構成される。
実施の形態1では、1対の差動で動作する基本トランジスタセルごとにエミッタ電極同士をそれぞれの仮想接地点として接続することにより、利得の低下を抑えた高出力差動増幅器について説明した。本実施の形態2では、ベースおよびコレクタに接続された線路による利得の低下を小さくする場合について説明する。具体的には、本実施の形態2における高出力差動増幅器は、個々の基本トランジスタからの出力位相をそろえることにより、差動増幅器全体としての利得低下を防ぐものである。
実施の形態1または2では、第1の増幅器11と第2の増幅器12を1対として構成した基本差動増幅器について説明した。本実施の形態3では、このような基本差動増幅器を並列接続する場合について説明する。このような構成においても、同様の効果が得られる。
Claims (4)
- 基本トランジスタセルをN段(Nは2以上の整数)並列接続してなる第1の増幅器および第2の増幅器を有し、N段の基本トランジスタセルのそれぞれのエミッタ電極を集結した端子である前記第1の増幅器のエミッタ端子および前記第2の増幅器のエミッタ端子を互いに接続して仮想接地点を設け、N段の基本トランジスタセルのそれぞれのベース電極を集結した端子である前記第1の増幅器のベース端子および前記第2の増幅器のベース端子にそれぞれ逆位相となる信号を入力することにより、N段の基本トランジスタセルのそれぞれのコレクタ電極を集結した端子である前記第1の増幅器のコレクタ端子および前記第2の増幅器のコレクタ端子から増幅された信号を出力する高出力差動増幅器において、
前記第1の増幅器および前記第2の増幅器の対応する段の基本トランジスタセルのエミッタ電極同士を接続して1対ごとの仮想接地点を設け、前記1対ごとの仮想接地点を互いに接続したことを特徴とする高出力差動増幅器。 - 請求項1に記載の高出力差動増幅器において、
前記第1の増幅器および前記第2の増幅器は、それぞれのベース端子からそれぞれのコレクタ端子に至るまでの電気長が、N段のいずれの基本トランジスタセルを介した場合にも同一となるように、N段からなる基本トランジスタセルを並列接続したことを特徴とする高出力差動増幅器。 - 請求項2に記載の高出力差動増幅器において、
前記第1の増幅器および前記第2の増幅器は、基本トランジスタセルをN段並列接続する際に、隣り合う基本トランジスタセルのベース電極間を結ぶ線路の電気長と、隣り合う基本トランジスタセルのコレクタ電極間を結ぶ線路の電気長とが等しくなるように、N段の基本トランジスタセルを直線上に配置し、1段目の基本トランジスタセル側にそれぞれの前記ベース端子を配置し、N段目の基本トランジスタセル側にそれぞれの前記コレクタ端子を配置したことを特徴とする高出力差動増幅器。 - 請求項2または3に記載の高出力差動増幅器を入力端子と出力端子との間でM段(Mは2以上の整数)並列接続してなる高出力差動増幅器において、
前記入力端子から前記出力端子に至るまでの電気長が、M段のいずれの高出力差動増幅器を介した場合にも同一となるように、M段からなる高出力差動増幅器を並列接続したことを特徴とする高出力差動増幅器。
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