JP2005309839A - 制御装置 - Google Patents
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Abstract
【解決手段】 ダウンロードイネーブル信号を受信したダウンロード制御回路51は、第1コマンドレジスタ61の読み出し用コマンドセット及びアドレスレジスタ53にセットされたアドレスにより、外部シリアルフラッシュROM30のデータを読み出し、データレジスタ54に一時的に記憶する。そして、第2コマンドレジスタ62の書き込み用コマンドセット、アドレスレジスタ53にセットされたアドレス及びデータレジスタ54に一時的に記憶されたデータにより、内部フラッシュROM10にデータを書き込む。
【選択図】 図1
Description
(1)本実施形態では、CPUを介さずダウンロード制御回路の専用回路で外部シリアルフラッシュROMに記憶された初期データをフラッシュROMに複写するように書き込むので、ダウンロードのスピードが速い。動作プログラムを書き込むためのアップデート用プログラムを記憶したマスクROMを別途設ける必要もなく、制御装置100の回路面積の増大を抑制することができる。つまり、シリアル内部フラッシュROM10及びフラッシュROM30へアクセスするのに必要なコマンドセットのみ用意すればよい。また、内部フラッシュROM10単体の状態で予め初期データを書き込んでおいてこれを実装するなどの作業も不要であることから、製造コストの増大も抑制できる。
(2)本実施形態では、ダウンロード制御回路の専用回路で外部シリアルフラッシュROMに記憶された初期データをフラッシュROMに複写するように書き込むので、初期データをフラッシュROMに書き込む際、初期データを供給する外部のホストコンピュータを不要とすることができる。
(3)本実施形態では、内部フラッシュROM10への書き込み動作を維持するためにフリップフロップ52が設けられ、書き込み時間の管理はカウンタ55が行っているため、内部フラッシュROM10へのデータの書き込み中に次の書き込みデータを外部シリアルフラッシュROM30から読み出しておくことができるため、ダウンロードの時間を短縮できる。
(4)本実施形態では、内部フラッシュROM10に予め初期データを記憶しておく必要がないため、例えば制御装置100に一体的に集積することも可能であり、この場合には周辺機器全体としての回路面積を低減することができる。
20 マイコン(CPU)
30 外部シリアルフラッシュROM
40 外部インタフェース
50 ダウンロード回路
51 ダウンロード制御回路
52 フリップフロップ
53 アドレスレジスタ
54 データレジスタ
55 カウンタ。
61 第1コマンドレジスタ
62 第2コマンドレジスタ
70 内部インタフェース
100 制御装置
Claims (7)
- マイコンに所定の動作制御を行わせる動作プログラムを記憶するための電気的に書換え可能な内部不揮発性メモリと、
前記内部不揮発性メモリとの入出力を制御する内部インタフェースと、
外部不揮発性メモリとの入出力を制御する外部インタフェースと、
外部からの指示により、前記外部インタフェースを介して前記外部不揮発性メモリに記憶されたデータを所定のアドレス単位で読み出し、前記内部インタフェースを介して前記内部不揮発性メモリに前記所定のアドレス単位で前記データを書き込む繰り返し動作を制御するダウンロード回路と、を備え、
外部からの前記指示により前記ダウンロード回路が動作中は、前記マイコンはスリープ状態となり、前記内部インタフェースは前記内部不揮発性メモリと前記マイコンとの接続を切断することを特徴とする制御装置。 - 請求項1に記載の制御装置において、
前記ダウンロード回路は、前記内部不揮発性メモリに前記データを書き込み中の状態を維持するためのフリップフロップと、前記内部不揮発性メモリへのデータの書き込み時間を管理するカウンタと、を有することを特徴とする制御装置。 - 請求項1に記載の制御装置において、
前記外部シリアルメモリに記憶されたデータを読み出すためのコマンドセットを記憶した内部不揮発性の第1コマンドレジスタを有することを特徴とする制御装置。 - 請求項1に記載の制御装置において、
前記内部不揮発性メモリに前記データを書き込むためのコマンドセットを記憶する第2コマンドレジスタを有することを特徴とする制御装置。 - 請求項1〜4のいずれか1項に記載の制御装置において、
前記ダウンロード回路が動作していないときに外部との信号のやり取りに使用する通常端子を備え、
前記外部不揮発性メモリと前記外部インタフェースとの間の少なくとも一部の外部端子は、前記通常端子の一部又は全部であることを特徴とする制御装置。 - 請求項5に記載の制御装置において、
前記外部不揮発性メモリに電源を供給する端子を有することを特徴とする制御装置。 - 請求項5に記載の制御装置において、
前記外部不揮発性メモリは、シリアルメモリであることを特徴とする制御装置。
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