JPH0520050A - 情報記憶装置 - Google Patents
情報記憶装置Info
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- JPH0520050A JPH0520050A JP17130091A JP17130091A JPH0520050A JP H0520050 A JPH0520050 A JP H0520050A JP 17130091 A JP17130091 A JP 17130091A JP 17130091 A JP17130091 A JP 17130091A JP H0520050 A JPH0520050 A JP H0520050A
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- Japan
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- memory
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Abstract
(57)【要約】
【構成】 外部コンピュータ１０から出力されたバージ
ョンアップ指令信号がコマンド解析部７にて検出された
とき、スイッチ８がプログラムメモリ３とメモリ制御部
６とを接続するように切り換わる。そして、メモリ制御
部６が、プログラムメモリ３に記憶されているデータを
消去し、外部コンピュータ１０から供給されたバージョ
ンアップ用のデータを書き込むもの。 【効果】 紫外線発光装置およびＲＯＭライタ等の特殊
な装置を使用することなく、プログラムメモリ３のデー
タの書き換えができる。また、バージョンアップの際
に、プログラムメモリ３を取り外す必要がないので、バ
ージョンアップを容易に、かつプログラムメモリ３周辺
の部品を損傷することなく行い得る。
ョンアップ指令信号がコマンド解析部７にて検出された
とき、スイッチ８がプログラムメモリ３とメモリ制御部
６とを接続するように切り換わる。そして、メモリ制御
部６が、プログラムメモリ３に記憶されているデータを
消去し、外部コンピュータ１０から供給されたバージョ
ンアップ用のデータを書き込むもの。 【効果】 紫外線発光装置およびＲＯＭライタ等の特殊
な装置を使用することなく、プログラムメモリ３のデー
タの書き換えができる。また、バージョンアップの際
に、プログラムメモリ３を取り外す必要がないので、バ
ージョンアップを容易に、かつプログラムメモリ３周辺
の部品を損傷することなく行い得る。
Description
【０００１】
【産業上の利用分野】本発明は、電気的に書き換え可能
な不揮発性の記憶装置を備え、この記憶装置のバージョ
ンアップを行い得る情報記憶装置に関するものである。
な不揮発性の記憶装置を備え、この記憶装置のバージョ
ンアップを行い得る情報記憶装置に関するものである。
【０００２】
【従来の技術】従来の情報記憶装置は、制御装置の動作
プログラムを記憶する記憶装置を内蔵している。この記
憶装置であるプログラムメモリとしは、紫外線により記
憶内容を消去して再書き込み可能なＥＰＲＯＭ（Electr
ochemical Programmable ROM)が多用されている。この
ような情報記憶装置において、プログラムメモリの記憶
内容を書き換えて更新するバージョンアップを行う場合
は、上記のＥＰＲＯＭを装置から取り出し、このＥＰＲ
ＯＭに紫外線を照射して記憶内容を消去した後、バージ
ョンアップ用のプログラムの書き込みを行い、再び装置
の所定位置に取り付けるという作業を行っている。
プログラムを記憶する記憶装置を内蔵している。この記
憶装置であるプログラムメモリとしは、紫外線により記
憶内容を消去して再書き込み可能なＥＰＲＯＭ（Electr
ochemical Programmable ROM)が多用されている。この
ような情報記憶装置において、プログラムメモリの記憶
内容を書き換えて更新するバージョンアップを行う場合
は、上記のＥＰＲＯＭを装置から取り出し、このＥＰＲ
ＯＭに紫外線を照射して記憶内容を消去した後、バージ
ョンアップ用のプログラムの書き込みを行い、再び装置
の所定位置に取り付けるという作業を行っている。
【０００３】
【発明が解決しようとする課題】ところが、上記従来の
情報記憶装置では、バージョンアップを行う際に、ＥＰ
ＲＯＭの記憶内容を消去するための紫外線発光装置およ
びＲＯＭライタ等の装置が必要である上、人手作業によ
りＥＰＲＯＭの取り外しと取り付けとを行うため、この
作業の際に、ＥＰＲＯＭ周辺の他の部品を損傷する虞が
あるという問題点を有している。
情報記憶装置では、バージョンアップを行う際に、ＥＰ
ＲＯＭの記憶内容を消去するための紫外線発光装置およ
びＲＯＭライタ等の装置が必要である上、人手作業によ
りＥＰＲＯＭの取り外しと取り付けとを行うため、この
作業の際に、ＥＰＲＯＭ周辺の他の部品を損傷する虞が
あるという問題点を有している。
【０００４】
【課題を解決するための手段】本発明の情報記憶装置
は、上記の課題を解決するめに、電気的に書き換え可能
な不揮発性の記憶装置、例えばＥＥＰＲＯＭ（Electric
ally Erasable Programmable ROM) と、この記憶装置に
記憶されているデータに基づいて制御動作を行う主制御
手段、例えばＣＰＵと、上記の記憶装置を主制御手段ま
たは記憶装置制御手段と接続する切り換え動作を行い、
信号検出手段にてバージョンアップ指令信号が検出され
たときに、記憶装置が記憶装置制御手段と接続されるよ
うに切り換え動作を行う切換え手段と、バージョンアッ
プ用データ供給手段、例えば外部コンピュータから出力
されるバージョンアップ指令信号の検出動作を行う信号
検出手段と、この信号検出手段にてバージョンアップ指
令信号が検出されたときに、記憶装置に記憶されている
データの消去を行うと共に、バージョンアップ用データ
供給手段から供給されたバージョンアップ用のデータを
記憶装置に書き込む記憶装置制御手段とを備えているこ
とを特徴としている。
は、上記の課題を解決するめに、電気的に書き換え可能
な不揮発性の記憶装置、例えばＥＥＰＲＯＭ（Electric
ally Erasable Programmable ROM) と、この記憶装置に
記憶されているデータに基づいて制御動作を行う主制御
手段、例えばＣＰＵと、上記の記憶装置を主制御手段ま
たは記憶装置制御手段と接続する切り換え動作を行い、
信号検出手段にてバージョンアップ指令信号が検出され
たときに、記憶装置が記憶装置制御手段と接続されるよ
うに切り換え動作を行う切換え手段と、バージョンアッ
プ用データ供給手段、例えば外部コンピュータから出力
されるバージョンアップ指令信号の検出動作を行う信号
検出手段と、この信号検出手段にてバージョンアップ指
令信号が検出されたときに、記憶装置に記憶されている
データの消去を行うと共に、バージョンアップ用データ
供給手段から供給されたバージョンアップ用のデータを
記憶装置に書き込む記憶装置制御手段とを備えているこ
とを特徴としている。
【０００５】
【作用】上記の構成によれば、バージョンアップ用デー
タ供給手段から出力されたバージョンアップ指令信号が
信号検出手段に検出されると、切換え手段は、記憶装置
が記憶装置制御手段と接続されるように切り換わり、記
憶装置制御手段は、記憶装置に記憶されているデータの
消去を行う。そして、記憶装置制御手段は、バージョン
アップ用データ供給手段からバージョンアップ用のデー
タが供給されると、このデータを記憶装置に書き込む。
これによって、装置のバージョンアップを行うことがで
きる。
タ供給手段から出力されたバージョンアップ指令信号が
信号検出手段に検出されると、切換え手段は、記憶装置
が記憶装置制御手段と接続されるように切り換わり、記
憶装置制御手段は、記憶装置に記憶されているデータの
消去を行う。そして、記憶装置制御手段は、バージョン
アップ用データ供給手段からバージョンアップ用のデー
タが供給されると、このデータを記憶装置に書き込む。
これによって、装置のバージョンアップを行うことがで
きる。
【０００６】
【実施例】本発明の一実施例を図１および図２に基づい
て以下に説明する。図１に示すように、本発明の情報記
憶装置１は、主制御手段としてのＣＰＵ２、このＣＰＵ
２の動作プログラムを記憶する記憶装置としてのプログ
ラムメモリ３、ＣＰＵ２によって制御される信号処理部
４、インターフェイス制御部５、記憶装置制御手段とし
てのメモリ制御部６、信号検出手段としてのコマンド解
析部７、切換え手段としてのスイッチ８およびスイッチ
９を備えている。
て以下に説明する。図１に示すように、本発明の情報記
憶装置１は、主制御手段としてのＣＰＵ２、このＣＰＵ
２の動作プログラムを記憶する記憶装置としてのプログ
ラムメモリ３、ＣＰＵ２によって制御される信号処理部
４、インターフェイス制御部５、記憶装置制御手段とし
てのメモリ制御部６、信号検出手段としてのコマンド解
析部７、切換え手段としてのスイッチ８およびスイッチ
９を備えている。
【０００７】上記のプログラムメモリ３としては、電気
的に書き換え可能で不揮発性の例えばＥＥＰＲＯＭ（El
ectrically Erasable Programmable ROM) が使用されて
いる。このプログラムメモリ３は、スイッチ８を介して
ＣＰＵ２およびメモリ制御部６と接続されている。
的に書き換え可能で不揮発性の例えばＥＥＰＲＯＭ（El
ectrically Erasable Programmable ROM) が使用されて
いる。このプログラムメモリ３は、スイッチ８を介して
ＣＰＵ２およびメモリ制御部６と接続されている。
【０００８】インターフェイス制御部５は、スイッチ９
を介してＣＰＵ２およびメモリ制御部６と接続され、給
電路Ｌ4 を介して信号処理部４と接続され、給電路Ｌ3
を介してバージョンアップ用データ供給手段としての外
部コンピュータ１０と接続されている。
を介してＣＰＵ２およびメモリ制御部６と接続され、給
電路Ｌ4 を介して信号処理部４と接続され、給電路Ｌ3
を介してバージョンアップ用データ供給手段としての外
部コンピュータ１０と接続されている。
【０００９】メモリ制御部６は、給電路Ｌ2 ・Ｌ3 を介
して、外部コンピュータ１０の出力信号を入力するよう
になっている。また、メモリ制御部６は、給電路Ｌ5 を
介してコマンド解析部７と接続され、コマンド解析部７
にてバージョンアップコマンドが検出されたときに、プ
ログラムメモリ３に記憶されているデータを消去すると
共に、外部コンピュータ１０から供給されたバージョン
アップ用のデータをプログラムメモリ３に書き込むよう
になっている。
して、外部コンピュータ１０の出力信号を入力するよう
になっている。また、メモリ制御部６は、給電路Ｌ5 を
介してコマンド解析部７と接続され、コマンド解析部７
にてバージョンアップコマンドが検出されたときに、プ
ログラムメモリ３に記憶されているデータを消去すると
共に、外部コンピュータ１０から供給されたバージョン
アップ用のデータをプログラムメモリ３に書き込むよう
になっている。
【００１０】スイッチ８・９は、コマンド解析部７によ
って制御され、スイッチ８は、プログラムメモリ３がＣ
ＰＵ２またはメモリ制御部６と接続されるように切り換
え動作を行い、スイッチ９は、インターフェイス制御部
５がＣＰＵ２またはメモリ制御部６と接続されるように
切り換え動作を行うものとなっている。
って制御され、スイッチ８は、プログラムメモリ３がＣ
ＰＵ２またはメモリ制御部６と接続されるように切り換
え動作を行い、スイッチ９は、インターフェイス制御部
５がＣＰＵ２またはメモリ制御部６と接続されるように
切り換え動作を行うものとなっている。
【００１１】コマンド解析部７は、給電路Ｌ1 ・Ｌ3 を
介して、外部コンピュータ１０の出力信号を入力し、外
部コンピュータ１０から給電路Ｌ3 に出力される信号を
監視している。そして、外部コンピュータ１０から出力
されたバージョンアップ指令信号としてのバージョンア
ップコマンドを検出したときに、インターフェイス制御
部５がメモリ制御部６と接続されるようにスイッチ９を
制御すると共に、給電路Ｌ3 がメモリ制御部６と接続さ
れるようにスイッチ８を制御する。一方、それ以外のコ
マンド、例えば、ＲＥＡＤ系コマンドおよびＷＲＩＴＥ
系コマンド等のコマンドを検出したときには、プログラ
ムメモリ３とインターフェイス制御部５とがＣＰＵ２と
接続されるようにスイッチ８・９を制御するようになっ
ている。
介して、外部コンピュータ１０の出力信号を入力し、外
部コンピュータ１０から給電路Ｌ3 に出力される信号を
監視している。そして、外部コンピュータ１０から出力
されたバージョンアップ指令信号としてのバージョンア
ップコマンドを検出したときに、インターフェイス制御
部５がメモリ制御部６と接続されるようにスイッチ９を
制御すると共に、給電路Ｌ3 がメモリ制御部６と接続さ
れるようにスイッチ８を制御する。一方、それ以外のコ
マンド、例えば、ＲＥＡＤ系コマンドおよびＷＲＩＴＥ
系コマンド等のコマンドを検出したときには、プログラ
ムメモリ３とインターフェイス制御部５とがＣＰＵ２と
接続されるようにスイッチ８・９を制御するようになっ
ている。
【００１２】尚、上記のバージョンアップコマンド、リ
ード系コマンドおよびライト系コマンド等のコマンド
は、それぞれの目的でオペレータによって外部コンピュ
ータ１０が操作されたときに、外部コンピュータ１０か
ら給電路Ｌ3 へ出力されるものである。
ード系コマンドおよびライト系コマンド等のコマンド
は、それぞれの目的でオペレータによって外部コンピュ
ータ１０が操作されたときに、外部コンピュータ１０か
ら給電路Ｌ3 へ出力されるものである。
【００１３】給電路Ｌ3 に接続されている外部コンピュ
ータ１０は、オペレータの操作によって情報記憶装置１
に情報を記憶させ、また情報記憶装置１から情報を出力
させるものである。また、後述の動作によって、情報記
憶装置１にバージョンアップ用のデータを供給するよう
になっている。
ータ１０は、オペレータの操作によって情報記憶装置１
に情報を記憶させ、また情報記憶装置１から情報を出力
させるものである。また、後述の動作によって、情報記
憶装置１にバージョンアップ用のデータを供給するよう
になっている。
【００１４】上記の構成において、情報記憶装置１にお
けるプログラムメモリ３のバージョンアップは、情報記
憶装置１の通常動作において受け付け得るコマンドが、
例えば、ＲＥＡＤ、ＷＲＩＴＥおよびＲＥＷＩＮＤの３
個のコマンドである場合に、さらに、データを消去する
ＥＲＡＳＥコマンドも受け付け得るようにする場合に行
われる。このときの情報記憶装置１の動作を図２のフロ
ーチャートに基づいて以下に説明する。
けるプログラムメモリ３のバージョンアップは、情報記
憶装置１の通常動作において受け付け得るコマンドが、
例えば、ＲＥＡＤ、ＷＲＩＴＥおよびＲＥＷＩＮＤの３
個のコマンドである場合に、さらに、データを消去する
ＥＲＡＳＥコマンドも受け付け得るようにする場合に行
われる。このときの情報記憶装置１の動作を図２のフロ
ーチャートに基づいて以下に説明する。
【００１５】オペレータの操作によって外部コンピュー
タ１０から給電路Ｌ3 にバージョンアップコマンドが出
力され、このコマンドがコマンド解析部７にて検出され
ると（Ｓ１）、コマンド解析部７の出力信号により、ス
イッチ８・９がバージョンアップ動作側に切り換えられ
る（Ｓ２）。即ち、インターフェイス制御部５がメモリ
制御部６と接続されるようにスイッチ９が切り換えら
れ、プログラムメモリ３がメモリ制御部６と接続される
ようにスイッチ８が切り換えられる。これにより、ＣＰ
Ｕ２から独立した、プログラムメモリ３、インターフェ
イス制御部５、メモリ制御部６、コマンド解析部７およ
び外部コンピュータ１０からなるバージョンアップ用の
回路が構成される。その後、コマンド解析部７は、バー
ジョンアップコマンドの検出を示す信号を給電路Ｌ5 を
介してメモリ制御部６に出力する。
タ１０から給電路Ｌ3 にバージョンアップコマンドが出
力され、このコマンドがコマンド解析部７にて検出され
ると（Ｓ１）、コマンド解析部７の出力信号により、ス
イッチ８・９がバージョンアップ動作側に切り換えられ
る（Ｓ２）。即ち、インターフェイス制御部５がメモリ
制御部６と接続されるようにスイッチ９が切り換えら
れ、プログラムメモリ３がメモリ制御部６と接続される
ようにスイッチ８が切り換えられる。これにより、ＣＰ
Ｕ２から独立した、プログラムメモリ３、インターフェ
イス制御部５、メモリ制御部６、コマンド解析部７およ
び外部コンピュータ１０からなるバージョンアップ用の
回路が構成される。その後、コマンド解析部７は、バー
ジョンアップコマンドの検出を示す信号を給電路Ｌ5 を
介してメモリ制御部６に出力する。
【００１６】この信号を入力したメモリ制御部６は、プ
ログラムメモリ３をＷＲＩＴＥモードにし、０番地から
最終番地までのアドレスデータを消去していく（Ｓ
３）。このとき同時に、メモリ制御部６は、インターフ
ェイス制御部５にプログラムメモリ３の記憶データ消去
中を示す信号を出力する。この信号を入力したインター
フェイス制御部５は、給電路Ｌ3 を介して、外部コンピ
ュータ１０にプログラムメモリ３の記憶データ消去中を
示す信号を出力する（Ｓ４）。これにより、外部コンピ
ュータ１０はプログラムメモリ３の記憶データが消去さ
れるまで待機する。
ログラムメモリ３をＷＲＩＴＥモードにし、０番地から
最終番地までのアドレスデータを消去していく（Ｓ
３）。このとき同時に、メモリ制御部６は、インターフ
ェイス制御部５にプログラムメモリ３の記憶データ消去
中を示す信号を出力する。この信号を入力したインター
フェイス制御部５は、給電路Ｌ3 を介して、外部コンピ
ュータ１０にプログラムメモリ３の記憶データ消去中を
示す信号を出力する（Ｓ４）。これにより、外部コンピ
ュータ１０はプログラムメモリ３の記憶データが消去さ
れるまで待機する。
【００１７】その後、プログラムメモリ３の記憶データ
の消去が完了すると（Ｓ５）、メモリ制御部６は、イン
ターフェイス制御部５に、プログラムメモリ３の消去完
了を示す信号を出力し、次に、バージョンアップしたプ
ログラムメモリ３のデータをインターフェイス制御部５
に要求する信号を出力する。これにより、インターフェ
イス制御部５は、外部コンピュータ１０に対してデータ
の受け付け可能な状態を示す信号を出力し（Ｓ６）、外
部コンピュータ１０から、バージョンアップ用のデータ
が出力される。
の消去が完了すると（Ｓ５）、メモリ制御部６は、イン
ターフェイス制御部５に、プログラムメモリ３の消去完
了を示す信号を出力し、次に、バージョンアップしたプ
ログラムメモリ３のデータをインターフェイス制御部５
に要求する信号を出力する。これにより、インターフェ
イス制御部５は、外部コンピュータ１０に対してデータ
の受け付け可能な状態を示す信号を出力し（Ｓ６）、外
部コンピュータ１０から、バージョンアップ用のデータ
が出力される。
【００１８】外部コンピュータ１０から出力されたバー
ジョンアップ用のデータは、給電路Ｌ3 ・Ｌ2 を介して
メモリ制御部６に入力され、メモリ制御部６は、入力さ
れたデータをプログラムメモリ３におけるアドレスの０
番地から最終番地までに書き込んでいく（Ｓ７）。
ジョンアップ用のデータは、給電路Ｌ3 ・Ｌ2 を介して
メモリ制御部６に入力され、メモリ制御部６は、入力さ
れたデータをプログラムメモリ３におけるアドレスの０
番地から最終番地までに書き込んでいく（Ｓ７）。
【００１９】その後、プログラムメモリ３へのデータの
書き込みが終了すると（Ｓ８）、メモリ制御部６はイン
ターフェイス制御部５にデータの書き込み完了を示す信
号を出力し、インターフェイス制御部５は、給電路Ｌ3
を通じて外部コンピュータ１０にデータの書き込み完了
を示す信号を出力する（Ｓ９）。
書き込みが終了すると（Ｓ８）、メモリ制御部６はイン
ターフェイス制御部５にデータの書き込み完了を示す信
号を出力し、インターフェイス制御部５は、給電路Ｌ3
を通じて外部コンピュータ１０にデータの書き込み完了
を示す信号を出力する（Ｓ９）。
【００２０】その後、メモリ制御部６は、コマンド解析
部７にバージョンアップ完了を示す信号を出力し、この
信号を入力したコマンド解析部７により、スイッチ８・
９が通常動作側に切り換えられる（Ｓ１０）。即ち、プ
ログラムメモリ３およびインターフェイス制御部５がＣ
ＰＵ２と接続されるように切り換えられる。これによっ
て、情報記憶装置１のバージョンアップが完了する。
部７にバージョンアップ完了を示す信号を出力し、この
信号を入力したコマンド解析部７により、スイッチ８・
９が通常動作側に切り換えられる（Ｓ１０）。即ち、プ
ログラムメモリ３およびインターフェイス制御部５がＣ
ＰＵ２と接続されるように切り換えられる。これによっ
て、情報記憶装置１のバージョンアップが完了する。
【００２１】
【発明の効果】本発明の情報記憶装置は、以上のよう
に、電気的に書き換え可能な不揮発性の記憶装置と、こ
の記憶装置に記憶されているデータに基づいて制御動作
を行う主制御手段と、上記の記憶装置を主制御手段また
は記憶装置制御手段と接続する切り換え動作を行い、信
号検出手段にてバージョンアップ指令信号が検出された
ときに、記憶装置が記憶装置制御手段と接続されるよう
に切り換え動作を行う切換え手段と、バージョンアップ
用データ供給手段から出力されるバージョンアップ指令
信号の検出動作を行う信号検出手段と、この信号検出手
段にてバージョンアップ指令信号が検出されたときに、
記憶装置に記憶されているデータの消去を行うと共に、
バージョンアップ用データ供給手段から供給されたバー
ジョンアップ用のデータを記憶装置に書き込む記憶装置
制御手段とを備えている構成である。
に、電気的に書き換え可能な不揮発性の記憶装置と、こ
の記憶装置に記憶されているデータに基づいて制御動作
を行う主制御手段と、上記の記憶装置を主制御手段また
は記憶装置制御手段と接続する切り換え動作を行い、信
号検出手段にてバージョンアップ指令信号が検出された
ときに、記憶装置が記憶装置制御手段と接続されるよう
に切り換え動作を行う切換え手段と、バージョンアップ
用データ供給手段から出力されるバージョンアップ指令
信号の検出動作を行う信号検出手段と、この信号検出手
段にてバージョンアップ指令信号が検出されたときに、
記憶装置に記憶されているデータの消去を行うと共に、
バージョンアップ用データ供給手段から供給されたバー
ジョンアップ用のデータを記憶装置に書き込む記憶装置
制御手段とを備えている構成である。
【００２２】これにより、紫外線発光装置およびＲＯＭ
ライタ等の特殊な装置を使用することなく、記憶装置の
データを書き換えることができる。また、バージョンア
ップの際に、記憶装置を取り外す必要がないので、バー
ジョンアップを容易に、かつ記憶装置周辺の部品を損傷
することなく行うことができるとう効果を奏する。
ライタ等の特殊な装置を使用することなく、記憶装置の
データを書き換えることができる。また、バージョンア
ップの際に、記憶装置を取り外す必要がないので、バー
ジョンアップを容易に、かつ記憶装置周辺の部品を損傷
することなく行うことができるとう効果を奏する。
【図１】本発明の一実施例を示す情報記憶装置のブロッ
ク図である。
ク図である。
【図２】図１に示した情報記憶装置におけるバージョン
アップの際の動作を示すフローチャートである。
アップの際の動作を示すフローチャートである。
１ 情報記憶装置 ３ プログラムメモリ（記憶装置） ５ インターフェイス制御部 ６ メモリ制御部（記憶装置制御手段） ７ コマンド解析部（信号検出手段） ８ スイッチ（切換え手段） ９ スイッチ １０ 外部コンピュータ（バージョンアップ用データ
供給手段）
供給手段）
Claims (1)
- 【特許請求の範囲】 【請求項１】電気的に書き換え可能な不揮発性の記憶装
置と、 この記憶装置に記憶されているデータに基づいて制御動
作を行う主制御手段と、 上記の記憶装置を主制御手段または記憶装置制御手段と
接続する切り換え動作を行い、信号検出手段にてバージ
ョンアップ指令信号が検出されたときに、記憶装置が記
憶装置制御手段と接続されるように切り換え動作を行う
切換え手段と、 バージョンアップ用データ供給手段から出力されるバー
ジョンアップ指令信号の検出動作を行う信号検出手段
と、 この信号検出手段にてバージョンアップ指令信号が検出
されたときに、記憶装置に記憶されているデータの消去
を行うと共に、バージョンアップ用データ供給手段から
供給されたバージョンアップ用のデータを記憶装置に書
き込む記憶装置制御手段とを備えていることを特徴とす
る情報記憶装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17130091A JPH0520050A (ja) | 1991-07-11 | 1991-07-11 | 情報記憶装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17130091A JPH0520050A (ja) | 1991-07-11 | 1991-07-11 | 情報記憶装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0520050A true JPH0520050A (ja) | 1993-01-29 |
Family
ID=15920733
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17130091A Pending JPH0520050A (ja) | 1991-07-11 | 1991-07-11 | 情報記憶装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0520050A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005309839A (ja) * | 2004-04-22 | 2005-11-04 | Sanyo Electric Co Ltd | 制御装置 |
| KR100694939B1 (ko) * | 2003-10-17 | 2007-03-14 | 교세라 가부시키가이샤 | 정보 처리 장치 |
| JP2017151956A (ja) * | 2016-02-23 | 2017-08-31 | ザ・ボーイング・カンパニーＴｈｅ Ｂｏｅｉｎｇ Ｃｏｍｐａｎｙ | ソフトウェアの通信のためのシステムおよび方法 |
-
1991
- 1991-07-11 JP JP17130091A patent/JPH0520050A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100694939B1 (ko) * | 2003-10-17 | 2007-03-14 | 교세라 가부시키가이샤 | 정보 처리 장치 |
| JP2005309839A (ja) * | 2004-04-22 | 2005-11-04 | Sanyo Electric Co Ltd | 制御装置 |
| US7788454B2 (en) | 2004-04-22 | 2010-08-31 | Sanyo Electric Co., Ltd. | Controller including electrically rewritable nonvolatile memory |
| JP2017151956A (ja) * | 2016-02-23 | 2017-08-31 | ザ・ボーイング・カンパニーＴｈｅ Ｂｏｅｉｎｇ Ｃｏｍｐａｎｙ | ソフトウェアの通信のためのシステムおよび方法 |
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