JP2004228260A - 半導体装置及びその製造方法 - Google Patents
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Abstract
【課題】半導体装置の放熱特性を向上させることが可能な技術を提供する。
【解決手段】タブの半導体チップと、このタブの周囲に列状に配置され封止体外に露出して外部端子となるリードとを電気的に接続した半導体装置において、隣接するリードの列と列との間に放熱部を配置し、この放熱部とタブとを熱的に接続する。また、その製造方法において、タブに半導体チップを搭載する工程と、前記半導体チップのパッドとリードとをボンディングする工程と、前記タブと熱的に接続され隣接するリードの列と列との間に配置された放熱部の底面を露出させて封止体を形成する工程とを有する。本発明によれば、半導体装置の底面外周部に放熱部を配置することができるので、放熱面積が増加するため、半導体装置の放熱特性が向上し、特性の変化・作動停止或いは装置破壊等の発生を防止することができる。加えて、半導体装置を実装する基板の配線の引き回しが容易になる。
【選択図】 図5
【解決手段】タブの半導体チップと、このタブの周囲に列状に配置され封止体外に露出して外部端子となるリードとを電気的に接続した半導体装置において、隣接するリードの列と列との間に放熱部を配置し、この放熱部とタブとを熱的に接続する。また、その製造方法において、タブに半導体チップを搭載する工程と、前記半導体チップのパッドとリードとをボンディングする工程と、前記タブと熱的に接続され隣接するリードの列と列との間に配置された放熱部の底面を露出させて封止体を形成する工程とを有する。本発明によれば、半導体装置の底面外周部に放熱部を配置することができるので、放熱面積が増加するため、半導体装置の放熱特性が向上し、特性の変化・作動停止或いは装置破壊等の発生を防止することができる。加えて、半導体装置を実装する基板の配線の引き回しが容易になる。
【選択図】 図5
Description
【0001】
【発明の属する技術分野】
本発明は、半導体装置及びその製造方法に関し、特に、半導体装置の放熱特性の向上に適用して有効な技術に関するものである。
【0002】
【従来の技術】
半導体装置では、単結晶シリコン等のウェハに設けられた複数の素子形成領域に、半導体素子或いは配線パターンを一括して形成した後に、夫々の素子形成領域を個々の半導体チップとして分離された個々の半導体チップが、例えばベース基板或いはリードフレームに固定するダイボンディング及びワイヤボンディング等の実装工程及び樹脂封止等の封止工程を経て半導体装置として完成する。
【0003】
同一の半導体チップであっても、その目的用途に応じて種々の実装形態が採用されており、半導体装置として、製造が比較的容易で低コストであることから、樹脂を用いた封止体によって半導体チップを覆い、封止体から延在するリードを外部端子とするQFP型等の半導体装置が広く用いられていたが、このリードが封止体側面から延在しているために、実装状態では、リードと配線基板との接続領域が半導体装置の周囲に必要となる。
【0004】
このため、半導体装置周囲の前記接続領域の面積を縮小して電子装置を小型化するために、前記封止体の底面外周部にてリード底面を封止体から露出させて半導体装置の外部端子とする底面端子型の半導体装置が考えられた。底面端子型の半導体装置としては、QFN(Quad Flat Non−lead)型或いはSON(Small Outline Non−lead)型等の半導体装置が知られている。
【0005】
【特許文献1】
特開平9−162327号公報
【特許文献2】
特開2001−267484号公報
【0006】
前記特許文献1,2にはこうした底面端子型の半導体装置について開示されている。
【0007】
図1及び図2はQFN型半導体装置を示す底面図及び縦断面図である。QFN型の半導体装置では、単結晶シリコン等の半導体基板に所定の素子を形成した半導体チップ1を、レジン又は銀ペースト等の接合剤2によってタブ3に固定し、タブ3の4周囲に列状に配置されているリード4の内端と半導体チップ1のパッドとをボンディングワイヤ5によって電気的に接続し、半導体チップ1、タブ3、リード4、ボンディングワイヤ5は、例えばエポキシ樹脂にフィラを混入させた封止樹脂を用いた封止体6によってリード4の底面を露出させた状態で封止してある。
【0008】
【発明が解決しようとする課題】
半導体装置では、微細化が進むことによって集積度が向上し、より多くの回路を搭載することが可能となり、搭載された回路によって、半導体装置に発生する熱も増加し、半導体装置の高速化が発生する熱を更に増加させている。こうして増加した発熱によって半導体装置の温度が上昇すると、半導体装置に特性の変化が生じ、更に温度が上昇した場合には、熱暴走による作動停止或いは装置破壊等の事態が生じる。
【0009】
このため、図3及び図4に底面図及び縦断面図を示すQFN型半導体装置では、リード4の底面に加えてタブ3の底面を封止体6から露出させて、タブ3の底面から半導体チップ1が発生した熱の放出を促進させることが考えられている。こうしたタブを露出させる半導体装置については、前記特許文献2にも記載されている。
【0010】
しかし、半導体装置の高性能化に伴い発熱量が増加する傾向にあるにもかかわらず、半導体装置の小型化によって放熱特性の向上が難しくなるため、更なる対策が必要とされている。本発明の課題は、これらの問題点を解決し、半導体装置の放熱特性を向上させることが可能な技術を提供することにある。
本発明の前記ならびにその他の課題と新規な特徴は、本明細書の記述及び添付図面によって明らかになるであろう。
【0011】
【課題を解決するための手段】
本願において開示される発明のうち、代表的なものの概要を簡単に説明すれば、下記のとおりである。
タブの半導体チップと、このタブの周囲に列状に配置され封止体外に露出して外部端子となるリードとを電気的に接続した半導体装置において、隣接するリードの列と列との間に放熱部を配置し、この放熱部とタブとを熱的に接続する。
【0012】
また、その製造方法において、タブに半導体チップを搭載する工程と、前記半導体チップのパッドとリードとをボンディングする工程と、前記タブと熱的に接続され隣接するリードの列と列との間に配置された放熱部の底面を露出させて封止体を形成する工程とを有する。
【0013】
上述した本発明によれば、半導体装置の底面外周部に放熱部を配置することができるので、放熱面積が増加し半導体装置の放熱特性を向上させて、発熱による特性の変化・作動停止或いは装置破壊等の発生を防止することができる。加えて、半導体装置を実装する基板の配線の引き回しが容易になる。
【0014】
以下、本発明の実施の形態を説明する。
なお、実施の形態を説明するための全図において、同一機能を有するものは同一符号を付け、その繰り返しの説明は省略する。
【0015】
【発明の実施の形態】
(実施の形態1)
図5は本発明の一実施の形態であるQFN型半導体装置を示す底面図であり、図6は図5中のa−a線に沿った縦断面図であり、図7は図5中のb−b線に沿った縦断面図である。
【0016】
本実施の形態の半導体装置は機器のドライバに用いられる20ピンのものであり、単結晶シリコン等の半導体基板に所定の素子を形成した半導体チップ1を、レジン又は銀ペースト等の接合剤2によってタブ3に固定し、半導体チップ1のパッドとリード4の内端とをボンディングワイヤ5によって電気的に接続してある。
【0017】
リード4はタブ3の4周囲に列状に配置されているが、隣接するリード4の列と列との間は従来の半導体装置では利用されていなかった。このスペースがタブ3の四隅と隣接している点に着目し、本実施の形態ではこのスペースに放熱部7を配置し、この放熱部7とタブ3の四隅とを一体に形成して熱的に接続して、半導体チップからタブに伝わった熱の放熱特性を向上させてある。
【0018】
半導体チップ1、タブ3、リード4、ボンディングワイヤ5、放熱部7は、例えばエポキシ樹脂にフィラを混入させた封止樹脂を用いた封止体6によって封止されるが、タブ3の底面及びリード4の底面に加えて放熱部7の底面を露出させた状態で封止する。
【0019】
また、図8は本発明の一実施の形態の変形例となる半導体装置を示す底面図である。この例では前述したものよりも多ピン化されており、隣接するリード4の列と列との間のスペースに配置した放熱部7に加えて、列状に配置された夫々のリード4とリード4との間にも放熱部8を配置し、この放熱部8とタブ3の四辺とを一体に形成して熱的に接続し、リード4及びその近傍を除く半導体装置の底面全面から放熱が行なわれる構成として、半導体チップ1からタブ3に伝わった熱の放熱特性を更に向上させてある。
【0020】
電子装置の小型化・薄型化によって、筐体内部が各種部品及び基板等によって大部分が占められているため空間が少なく、加えて内部に滞留する空気の移動が難しくなっている。このため、半導体装置の放熱としては半導体装置の上面から内部空間への放熱経路よりも、半導体装置の底面から半導体装置が実装された基板を通って外部に熱を放出する放熱経路が重視されることとなる。
【0021】
従って、本実施の形態の底面に放熱部7,8を有する半導体装置では、放熱部7,8を前記基板の金属配線等に熱的に接続することによって放熱面積が増大し、半導体装置に発生した熱を効率よく放出することが可能になる。
【0022】
加えて、タブ3の配置されている半導体装置の中央部では、タブ3の露出部分に接続した前記金属配線等をリード4と接続した金属配線間を引き出さなければならなくなる或いはタブ3と接続するビアホールを設ける必要があるのに対して、本実施の形態の放熱部7,8の配置されているのは半導体装置の外周部であるため、放熱部7,8と接続した前記金属配線等の取り回しが容易である。
【0023】
なお、タブ3の露出部分と前記金属配線等との接続が困難な場合には、前記金属配線等とタブ3とは接続せずに、前記金属配線等と放熱部7,8とを接続する構成としてよい。この場合には、タブ3上げ等によりタブ3の底面を封止体6に封入して封止体6から露出させない構成とすれば、タブ3と封止体6との界面が封止体6外に連絡しなくなることから、この界面からの水分の浸入を防止することができるので、耐湿性が向上する。
【0024】
続いて、本実施の形態の半導体装置の製造方法について説明する。ここでは、放熱部7はタブ3或いはリード4と同様に処理が行なわれるものとする。本実施の形態の半導体装置は、図9に示すように、個々の半導体装置に用いられるタブ3、リード4及び放熱部7の組が縦横に連続して複数組形成されダムバー9或いはタイバー10によって一体化されたリードフレームを用いている。
【0025】
リードフレームとしては、例えばFe−Ni系合金或いはCu系合金等からなり、半導体チップ1が搭載されるタブ3の四辺に沿って複数のリード4の列が夫々配置されており、タブ3はリード4の間に設けられた放熱部7に接続されてフレームに支持されている。このように、放熱部7はリードフレームの加工によって、タブ3と一体に形成されるため、放熱部7を設けることによってコスト或いは工程を増加させることはない。
【0026】
そして、先ず図10に示すように、このリードフレームのタブ3に夫々半導体チップ1をレジン又は銀ペースト等の接合剤2によって固定し、図11に示すように、半導体チップ1のパッドとリード4の内端とをボンディングワイヤ5によって接続し、半導体チップ1をリードフレームに実装する。
【0027】
次に、図12に示すように、半導体チップ1を実装したリードフレームを、金型11及び金型12に挟み込み、金型11のキャビデイ内に半導体チップ1、タブ3、リード4、ボンディングワイヤ5を収容して、封止樹脂を注入して封止体6を形成する。この時、タブ3の下面は金型に密着させているため、封止樹脂が付着せずに封止体6の底面にタブ3、リード4及び放熱部7の底面が露出することとなる。この後、図13に示すようにダムバー9或いはタイバー10をパンチ13或いはブレードによって切断し、個々の半導体装置に個片化する。
【0028】
以上、本発明を、前記実施の形態に基づき具体的に説明したが、本発明は、前記実施の形態に限定されるものではなく、その要旨を逸脱しない範囲において種々変更可能であることは勿論である。
【0029】
【発明の効果】
本願において開示される発明のうち代表的なものによって得られる効果を簡単に説明すれば、下記のとおりである。
(1)本発明によれば、半導体装置の底面外周部に放熱部を配置することができるという効果がある。
(2)本発明によれば、上記効果(1)により、放熱面積が増加し半導体装置の放熱特性を向上させることができるという効果がある。
(3)本発明によれば、上記効果(2)により、発熱による温度上昇に起因して、半導体装置に特性の変化が生じる、或いは熱暴走による作動停止或いは装置破壊等の発生を防止することができるという効果がある。
(4)本発明によれば、上記効果(1)により、半導体装置を実装する基板の配線の引き回しが容易になるという効果がある。
【図面の簡単な説明】
【図1】従来の半導体装置を示す底面図である。
【図2】従来の半導体装置を示す縦断面図である。
【図3】従来の半導体装置を示す底面図である。
【図4】従来の半導体装置を示す縦断面図である。
【図5】本発明の一実施の形態である半導体装置を示す底面図である。
【図6】図5中のa−a線に沿った縦断面図である。
【図7】図5中のb−b線に沿った縦断面図である。
【図8】本発明の一実施の形態である半導体装置の変形例を示す底面図である。
【図9】本発明の一実施の形態である半導体装置の製造に用いられるリードフレームを示す平面図である。
【図10】本発明の一実施の形態である半導体装置を工程毎に示す縦断面図である。
【図11】本発明の一実施の形態である半導体装置を工程毎に示す縦断面図である。
【図12】本発明の一実施の形態である半導体装置を工程毎に示す縦断面図である。
【図13】本発明の一実施の形態である半導体装置を工程毎に示す縦断面図である。
【符号の説明】
1…半導体チップ、2…接合剤、3…タブ、4…リード、5…ボンディングワイヤ、6…封止体、7,8…放熱部、9…ダムバー、10…タイバー、11,12…金型、13…パンチ。
【発明の属する技術分野】
本発明は、半導体装置及びその製造方法に関し、特に、半導体装置の放熱特性の向上に適用して有効な技術に関するものである。
【0002】
【従来の技術】
半導体装置では、単結晶シリコン等のウェハに設けられた複数の素子形成領域に、半導体素子或いは配線パターンを一括して形成した後に、夫々の素子形成領域を個々の半導体チップとして分離された個々の半導体チップが、例えばベース基板或いはリードフレームに固定するダイボンディング及びワイヤボンディング等の実装工程及び樹脂封止等の封止工程を経て半導体装置として完成する。
【0003】
同一の半導体チップであっても、その目的用途に応じて種々の実装形態が採用されており、半導体装置として、製造が比較的容易で低コストであることから、樹脂を用いた封止体によって半導体チップを覆い、封止体から延在するリードを外部端子とするQFP型等の半導体装置が広く用いられていたが、このリードが封止体側面から延在しているために、実装状態では、リードと配線基板との接続領域が半導体装置の周囲に必要となる。
【0004】
このため、半導体装置周囲の前記接続領域の面積を縮小して電子装置を小型化するために、前記封止体の底面外周部にてリード底面を封止体から露出させて半導体装置の外部端子とする底面端子型の半導体装置が考えられた。底面端子型の半導体装置としては、QFN(Quad Flat Non−lead)型或いはSON(Small Outline Non−lead)型等の半導体装置が知られている。
【0005】
【特許文献1】
特開平9−162327号公報
【特許文献2】
特開2001−267484号公報
【0006】
前記特許文献1,2にはこうした底面端子型の半導体装置について開示されている。
【0007】
図1及び図2はQFN型半導体装置を示す底面図及び縦断面図である。QFN型の半導体装置では、単結晶シリコン等の半導体基板に所定の素子を形成した半導体チップ1を、レジン又は銀ペースト等の接合剤2によってタブ3に固定し、タブ3の4周囲に列状に配置されているリード4の内端と半導体チップ1のパッドとをボンディングワイヤ5によって電気的に接続し、半導体チップ1、タブ3、リード4、ボンディングワイヤ5は、例えばエポキシ樹脂にフィラを混入させた封止樹脂を用いた封止体6によってリード4の底面を露出させた状態で封止してある。
【0008】
【発明が解決しようとする課題】
半導体装置では、微細化が進むことによって集積度が向上し、より多くの回路を搭載することが可能となり、搭載された回路によって、半導体装置に発生する熱も増加し、半導体装置の高速化が発生する熱を更に増加させている。こうして増加した発熱によって半導体装置の温度が上昇すると、半導体装置に特性の変化が生じ、更に温度が上昇した場合には、熱暴走による作動停止或いは装置破壊等の事態が生じる。
【0009】
このため、図3及び図4に底面図及び縦断面図を示すQFN型半導体装置では、リード4の底面に加えてタブ3の底面を封止体6から露出させて、タブ3の底面から半導体チップ1が発生した熱の放出を促進させることが考えられている。こうしたタブを露出させる半導体装置については、前記特許文献2にも記載されている。
【0010】
しかし、半導体装置の高性能化に伴い発熱量が増加する傾向にあるにもかかわらず、半導体装置の小型化によって放熱特性の向上が難しくなるため、更なる対策が必要とされている。本発明の課題は、これらの問題点を解決し、半導体装置の放熱特性を向上させることが可能な技術を提供することにある。
本発明の前記ならびにその他の課題と新規な特徴は、本明細書の記述及び添付図面によって明らかになるであろう。
【0011】
【課題を解決するための手段】
本願において開示される発明のうち、代表的なものの概要を簡単に説明すれば、下記のとおりである。
タブの半導体チップと、このタブの周囲に列状に配置され封止体外に露出して外部端子となるリードとを電気的に接続した半導体装置において、隣接するリードの列と列との間に放熱部を配置し、この放熱部とタブとを熱的に接続する。
【0012】
また、その製造方法において、タブに半導体チップを搭載する工程と、前記半導体チップのパッドとリードとをボンディングする工程と、前記タブと熱的に接続され隣接するリードの列と列との間に配置された放熱部の底面を露出させて封止体を形成する工程とを有する。
【0013】
上述した本発明によれば、半導体装置の底面外周部に放熱部を配置することができるので、放熱面積が増加し半導体装置の放熱特性を向上させて、発熱による特性の変化・作動停止或いは装置破壊等の発生を防止することができる。加えて、半導体装置を実装する基板の配線の引き回しが容易になる。
【0014】
以下、本発明の実施の形態を説明する。
なお、実施の形態を説明するための全図において、同一機能を有するものは同一符号を付け、その繰り返しの説明は省略する。
【0015】
【発明の実施の形態】
(実施の形態1)
図5は本発明の一実施の形態であるQFN型半導体装置を示す底面図であり、図6は図5中のa−a線に沿った縦断面図であり、図7は図5中のb−b線に沿った縦断面図である。
【0016】
本実施の形態の半導体装置は機器のドライバに用いられる20ピンのものであり、単結晶シリコン等の半導体基板に所定の素子を形成した半導体チップ1を、レジン又は銀ペースト等の接合剤2によってタブ3に固定し、半導体チップ1のパッドとリード4の内端とをボンディングワイヤ5によって電気的に接続してある。
【0017】
リード4はタブ3の4周囲に列状に配置されているが、隣接するリード4の列と列との間は従来の半導体装置では利用されていなかった。このスペースがタブ3の四隅と隣接している点に着目し、本実施の形態ではこのスペースに放熱部7を配置し、この放熱部7とタブ3の四隅とを一体に形成して熱的に接続して、半導体チップからタブに伝わった熱の放熱特性を向上させてある。
【0018】
半導体チップ1、タブ3、リード4、ボンディングワイヤ5、放熱部7は、例えばエポキシ樹脂にフィラを混入させた封止樹脂を用いた封止体6によって封止されるが、タブ3の底面及びリード4の底面に加えて放熱部7の底面を露出させた状態で封止する。
【0019】
また、図8は本発明の一実施の形態の変形例となる半導体装置を示す底面図である。この例では前述したものよりも多ピン化されており、隣接するリード4の列と列との間のスペースに配置した放熱部7に加えて、列状に配置された夫々のリード4とリード4との間にも放熱部8を配置し、この放熱部8とタブ3の四辺とを一体に形成して熱的に接続し、リード4及びその近傍を除く半導体装置の底面全面から放熱が行なわれる構成として、半導体チップ1からタブ3に伝わった熱の放熱特性を更に向上させてある。
【0020】
電子装置の小型化・薄型化によって、筐体内部が各種部品及び基板等によって大部分が占められているため空間が少なく、加えて内部に滞留する空気の移動が難しくなっている。このため、半導体装置の放熱としては半導体装置の上面から内部空間への放熱経路よりも、半導体装置の底面から半導体装置が実装された基板を通って外部に熱を放出する放熱経路が重視されることとなる。
【0021】
従って、本実施の形態の底面に放熱部7,8を有する半導体装置では、放熱部7,8を前記基板の金属配線等に熱的に接続することによって放熱面積が増大し、半導体装置に発生した熱を効率よく放出することが可能になる。
【0022】
加えて、タブ3の配置されている半導体装置の中央部では、タブ3の露出部分に接続した前記金属配線等をリード4と接続した金属配線間を引き出さなければならなくなる或いはタブ3と接続するビアホールを設ける必要があるのに対して、本実施の形態の放熱部7,8の配置されているのは半導体装置の外周部であるため、放熱部7,8と接続した前記金属配線等の取り回しが容易である。
【0023】
なお、タブ3の露出部分と前記金属配線等との接続が困難な場合には、前記金属配線等とタブ3とは接続せずに、前記金属配線等と放熱部7,8とを接続する構成としてよい。この場合には、タブ3上げ等によりタブ3の底面を封止体6に封入して封止体6から露出させない構成とすれば、タブ3と封止体6との界面が封止体6外に連絡しなくなることから、この界面からの水分の浸入を防止することができるので、耐湿性が向上する。
【0024】
続いて、本実施の形態の半導体装置の製造方法について説明する。ここでは、放熱部7はタブ3或いはリード4と同様に処理が行なわれるものとする。本実施の形態の半導体装置は、図9に示すように、個々の半導体装置に用いられるタブ3、リード4及び放熱部7の組が縦横に連続して複数組形成されダムバー9或いはタイバー10によって一体化されたリードフレームを用いている。
【0025】
リードフレームとしては、例えばFe−Ni系合金或いはCu系合金等からなり、半導体チップ1が搭載されるタブ3の四辺に沿って複数のリード4の列が夫々配置されており、タブ3はリード4の間に設けられた放熱部7に接続されてフレームに支持されている。このように、放熱部7はリードフレームの加工によって、タブ3と一体に形成されるため、放熱部7を設けることによってコスト或いは工程を増加させることはない。
【0026】
そして、先ず図10に示すように、このリードフレームのタブ3に夫々半導体チップ1をレジン又は銀ペースト等の接合剤2によって固定し、図11に示すように、半導体チップ1のパッドとリード4の内端とをボンディングワイヤ5によって接続し、半導体チップ1をリードフレームに実装する。
【0027】
次に、図12に示すように、半導体チップ1を実装したリードフレームを、金型11及び金型12に挟み込み、金型11のキャビデイ内に半導体チップ1、タブ3、リード4、ボンディングワイヤ5を収容して、封止樹脂を注入して封止体6を形成する。この時、タブ3の下面は金型に密着させているため、封止樹脂が付着せずに封止体6の底面にタブ3、リード4及び放熱部7の底面が露出することとなる。この後、図13に示すようにダムバー9或いはタイバー10をパンチ13或いはブレードによって切断し、個々の半導体装置に個片化する。
【0028】
以上、本発明を、前記実施の形態に基づき具体的に説明したが、本発明は、前記実施の形態に限定されるものではなく、その要旨を逸脱しない範囲において種々変更可能であることは勿論である。
【0029】
【発明の効果】
本願において開示される発明のうち代表的なものによって得られる効果を簡単に説明すれば、下記のとおりである。
(1)本発明によれば、半導体装置の底面外周部に放熱部を配置することができるという効果がある。
(2)本発明によれば、上記効果(1)により、放熱面積が増加し半導体装置の放熱特性を向上させることができるという効果がある。
(3)本発明によれば、上記効果(2)により、発熱による温度上昇に起因して、半導体装置に特性の変化が生じる、或いは熱暴走による作動停止或いは装置破壊等の発生を防止することができるという効果がある。
(4)本発明によれば、上記効果(1)により、半導体装置を実装する基板の配線の引き回しが容易になるという効果がある。
【図面の簡単な説明】
【図1】従来の半導体装置を示す底面図である。
【図2】従来の半導体装置を示す縦断面図である。
【図3】従来の半導体装置を示す底面図である。
【図4】従来の半導体装置を示す縦断面図である。
【図5】本発明の一実施の形態である半導体装置を示す底面図である。
【図6】図5中のa−a線に沿った縦断面図である。
【図7】図5中のb−b線に沿った縦断面図である。
【図8】本発明の一実施の形態である半導体装置の変形例を示す底面図である。
【図9】本発明の一実施の形態である半導体装置の製造に用いられるリードフレームを示す平面図である。
【図10】本発明の一実施の形態である半導体装置を工程毎に示す縦断面図である。
【図11】本発明の一実施の形態である半導体装置を工程毎に示す縦断面図である。
【図12】本発明の一実施の形態である半導体装置を工程毎に示す縦断面図である。
【図13】本発明の一実施の形態である半導体装置を工程毎に示す縦断面図である。
【符号の説明】
1…半導体チップ、2…接合剤、3…タブ、4…リード、5…ボンディングワイヤ、6…封止体、7,8…放熱部、9…ダムバー、10…タイバー、11,12…金型、13…パンチ。
Claims (5)
- タブの半導体チップと、このタブの周囲に列状に配置され封止体外に露出して外部端子となるリードとを電気的に接続した半導体装置において、
隣接するリードの列と列との間に放熱部を配置し、この放熱部とタブとを熱的に接続したことを特徴とする半導体装置。 - 前記放熱部が半導体装置の底面に露出することを特徴とする請求項1に記載の半導体装置。
- 前記列状に配置された夫々のリードとリードとの間に放熱部を配置し、この放熱部とタブとを熱的に接続したことを特徴とする請求項1又は請求項2に記載の半導体装置。
- 前記半導体装置がQFN型の半導体装置であることを特徴とする請求項1乃至請求項3の何れか一項に記載の半導体装置。
- タブの半導体チップ搭載領域に搭載した半導体チップと、このタブの周囲に配置され封止体外に露出して外部端子となるリードとを電気的に接続する半導体装置の製造方法において、
タブに半導体チップを搭載する工程と、
前記半導体チップのパッドとリードとをボンディングする工程と、
前記タブと熱的に接続され隣接するリードの列と列との間に配置された放熱部の底面を露出させて封止体を形成する工程とを有することを特徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003012990A JP2004228260A (ja) | 2003-01-22 | 2003-01-22 | 半導体装置及びその製造方法 |
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Application Number | Priority Date | Filing Date | Title |
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JP2003012990A JP2004228260A (ja) | 2003-01-22 | 2003-01-22 | 半導体装置及びその製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2004228260A true JP2004228260A (ja) | 2004-08-12 |
Family
ID=32901436
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003012990A Pending JP2004228260A (ja) | 2003-01-22 | 2003-01-22 | 半導体装置及びその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2004228260A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN112117196A (zh) * | 2019-06-21 | 2020-12-22 | 罗姆股份有限公司 | 半导体装置及半导体装置的安装构造 |
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- 2003-01-22 JP JP2003012990A patent/JP2004228260A/ja active Pending
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---|---|---|---|---|
CN112117196A (zh) * | 2019-06-21 | 2020-12-22 | 罗姆股份有限公司 | 半导体装置及半导体装置的安装构造 |
JP2021002587A (ja) * | 2019-06-21 | 2021-01-07 | ローム株式会社 | 半導体装置、および、半導体装置の実装構造 |
JP7368055B2 (ja) | 2019-06-21 | 2023-10-24 | ローム株式会社 | 半導体装置、および、半導体装置の実装構造 |
US11842951B2 (en) | 2019-06-21 | 2023-12-12 | Rohm Co., Ltd. | Semiconductor device for improving heat dissipation and mounting structure thereof |
CN112117196B (zh) * | 2019-06-21 | 2024-03-12 | 罗姆股份有限公司 | 安装构造 |
US12087675B2 (en) | 2019-06-21 | 2024-09-10 | Rohm Co., Ltd. | Semiconductor device and mounting structure thereof |
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