JP2004221491A - 固体撮像装置,およびその製造方法 - Google Patents

固体撮像装置,およびその製造方法 Download PDF

Info

Publication number
JP2004221491A
JP2004221491A JP2003009998A JP2003009998A JP2004221491A JP 2004221491 A JP2004221491 A JP 2004221491A JP 2003009998 A JP2003009998 A JP 2003009998A JP 2003009998 A JP2003009998 A JP 2003009998A JP 2004221491 A JP2004221491 A JP 2004221491A
Authority
JP
Japan
Prior art keywords
solid
state imaging
semiconductor substrate
imaging device
oxygen
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2003009998A
Other languages
English (en)
Other versions
JP4288406B2 (ja
Inventor
Satoshi Suzuki
智 鈴木
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nikon Corp
Original Assignee
Nikon Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nikon Corp filed Critical Nikon Corp
Priority to JP2003009998A priority Critical patent/JP4288406B2/ja
Publication of JP2004221491A publication Critical patent/JP2004221491A/ja
Application granted granted Critical
Publication of JP4288406B2 publication Critical patent/JP4288406B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Landscapes

  • Solid State Image Pick-Up Elements (AREA)

Abstract

【課題】本発明は、IG(イントリンシックゲッタリング)技術を適用した固体撮像装置において、歩留まりおよびゲッタリング能力の双方に相関する製造条件の選定と、これら製造条件の適正範囲を細かく提示することを目的とする。
【解決手段】本発明の固体撮像装置は、半導体基板と、半導体基板の主表面に存在する厚さ7.0μm以上20.0μm以下の無欠陥層と、無欠陥層に形成されて入射光に応じた信号電荷を生成する複数の単位画素と、無欠陥層の下に酸素析出物が析出してなる領域とを備え、表面深さ20〜100μmにおける酸素析出物の平均密度は単位立方センチメートル当たり1.0E10個以上であることを特徴とする。
【選択図】 図1

Description

【0001】
【発明の属する技術分野】
本発明は、固体撮像装置およびその製造方法に関する。
【0002】
【従来の技術】
従来、固体撮像装置の半導体ウェハ内において、金属汚染によって暗電流が発生することが知られている。
特に、半導体ウェハにエピタキシャル層を形成した場合、エピタキシャル成長ガスに含まれる重金属や、プロセス装置(ガス配管など)の重金属に晒されることにより、比較的大量の金属に汚染される。
【0003】
この種の金属汚染を除去するため、ウェハ内部に微小欠陥を設け、この微小欠陥に金属汚染を捕捉するイントリンシックゲッタリング(IG)技術が従来から知られている。
非特許文献1の第362頁右欄1行目によれば、安定したゲッタリング能力を得るため、この微小欠陥の密度は5E9cm−3以上を必要とする。
【0004】
【非特許文献1】
電子通信学会編”LSIハンドブック”第1版第1刷,
361頁〜364頁,オーム社発行
【0005】
【発明が解決しようとする課題】
上述した非特許文献1に示されるように、IG技術の欠陥密度(すなわち酸素析出物の密度)は5E9cm−3以上であることが一般に知られている。
しかしながら、この条件を満たすように固体撮像装置を製造した場合、歩留まりの向上に限界が生じる。
特に、近年に製造されるようになった高感度(高S/N)の固体撮像装置では、この歩留まりの低下が顕著である。これは、受光領域に残留する僅かな金属汚染から発生した暗電流が、出力画像信号の画像ノイズとして顕著に現れるからである。
【0006】
そこで、本発明者は、ゲッタリング性能と歩留まりの双方に影響を及ぼす製造条件を新たに選別し、これら製造条件を実験を通して詳細に規定することにより、さらに歩留まりを高めることに成功した。
【0007】
本発明は、このゲッタリング性能および歩留まりの双方に相関する製造条件の提示と、これら製造条件の適正範囲を詳細に提示することを目的とする。
【0008】
【課題を解決するための手段】
以下、本発明について説明する。
【0009】
《請求項1》
請求項1の固体撮像装置は、半導体基板と、半導体基板の主表面に存在する厚さ7.0μm以上20.0μm以下の無欠陥層と、無欠陥層に形成されて入射光に応じた信号電荷を生成する複数の単位画素と、無欠陥層の下に酸素析出物が析出してなる領域とを備える。この酸素析出物の平均密度は、表面深さ20〜100μmにおいて単位立方センチメートル当たり1.0E10個以上であることを特徴とする。
【0010】
《請求項2》
請求項2の固体撮像装置は、請求項1に記載の固体撮像装置において、主表面から深さ20〜100μmにおける酸素析出物の平均密度は単位立方センチメートル当たり2.1E10個未満であることを特徴とする。
【0011】
《請求項3》
請求項3の固体撮像装置は、請求項1または請求項2に記載の固体撮像装置において、半導体基板の主表面とは反対の面(裏面)にポリシリコン膜が形成されることを特徴とする。
【0012】
《請求項4》
請求項4の固体撮像装置は、請求項1ないし請求項3のいずれか1項に記載の固体撮像装置において、エピタキシャル層を半導体基板の主表面に形成する。このエピタキシャル層により、無欠陥層の厚さは、7.0μm以上20.0μm以下に調整される。
【0013】
《請求項5》
請求項5に記載の発明は、入射光に応じて信号電荷を生成する単位画素を半導体基板の主表面に複数有する固体撮像装置の製造方法であって、次の工程を含む。
・半導体基板の裏面にポリシリコン膜を形成する工程
・半導体基板の主表面側から、酸素、窒素、および炭素からなる群の少なくとも一種をイオン注入にて埋め込む工程
・半導体基板の表面近傍の酸素を熱により外拡散させて、酸素濃度が概略5E17cm−3以下と低濃度な無酸素層を主表面に形成する工程
・半導体基板に熱処理を施して酸素析出物による微小欠陥を成長させて表面深さ20〜100μmにおける酸素析出物の平均密度を単位立方センチメートル当たり1.0E10個以上2.1E10個未満にする工程
・半導体基板の主表面にエピタキシャル層を形成して無欠陥層の厚さを7.0μm以上20.0μm以下に調整する工程
・エピタキシャル層に単位画素を形成する工程
【0014】
【発明の実施の形態】
以下、図面に基づいて本発明にかかる実施形態を説明する。
【0015】
《第1の実施形態》
図1は、第1の実施形態における固体撮像装置21の断面図である。
図1において、半導体基板20の主表面側には、エピタキシャル層22aおよび無酸素層22bからなる無欠陥層22が、7.0μm以上20.0μm以下の厚さに形成される。
【0016】
このエピタキシャル層22aには、固体撮像装置21の回路素子領域(入射光に応じて信号電荷を生成する複数の単位画素24など)が形成される。
この無酸素層22bの下には、酸素析出物の微小欠陥を含む酸素析出物領域23が存在する。主表面から深さ20〜100μmの範囲において、この酸素析出物(すなわち微小欠陥)の平均密度は、単位立方センチメートル当たり1.0E10個以上2.1E10個未満である。
また、半導体基板20の裏面には、厚さ1.0μm〜1.5μmのポリシリコン層25が形成される。
【0017】
[第1の実施形態の製造工程]
上述した構成の固体撮像装置21は、例えば、次の工程により製造することができる。
【0018】
(1)半導体基板20の裏面側にポリシリコン層25を形成する。
(2)半導体基板20を、1000℃〜1200℃で高温処理し、半導体基板20の表面近傍に含まれる酸素を外拡散させ、無酸素層22bを形成する。この無酸素層22bの厚さは、高温処理の処理時間によって調整する。
(3)続いて、半導体基板20を400℃〜800℃で低温処理し、酸素析出物領域23となる領域に酸素を析出させる。この酸素析出物が微小欠陥の成長核となる。
(4)次に、半導体基板20の主表面側に、エピタキシャル成長法を使用してエピタキシャル層22aを形成する。
(5)エピタキシャル層22aの成長温度あるいは別のアニール処理により、半導体基板20を900℃〜1100℃で中温処理する。このとき、酸素析出物を成長核として微小欠陥が成長する。このとき、ポリシリコン層25による弾性ひずみが微小欠陥に作用することにより、微小欠陥をより大きく成長させることができる。
この微小欠陥は、ゲッタリング中心として機能し、エピタキシャル層22aに含まれる金属汚染を有効に捕捉する。
(6)エピタキシャル層22aに、単位画素24などの回路素子領域を形成し、固体撮像装置21を完成する。
【0019】
[本発明者によるIG技術の不良解析]
従来、IG技術の歩留まり低下は、酸素析出物が半導体ウェハの機械的強度を低下させ、熱応力の影響を受けやすくなるためと考えられてきた。(例えば、津屋秀樹著『超LSIプロセス制御工学』第219頁〜第221頁)。
したがって、従来は半導体ウェハの機械的強度を保つ観点からIG技術の歩留まり改善が検討され、機械的強度を余裕をもって保てる範囲に製造条件が最適化されてきた。
【0020】
今回、本発明者は、図1に示す固体撮像装置21について不良解析を鋭意行った。その結果、従来よりも直接的な不良原因を突き止めるに至った。
すなわち、不良品の殆どは、酸素析出物領域23内の微小欠陥によって発生した転移網が、局所的に半導体表面に突き抜けていた。
【0021】
この新しい不良原因の解明結果から、本発明者は、微小欠陥から発生した転移網が表面に突き抜けないよう、無欠陥層22の厚さを最適にコントロールすることを考えた。その結果、従来の製造条件(すなわち機械的強度を最適にコントロールするもの)よりも一段と直接的に歩留まりを改善することに成功した。
以下、具体的な製造条件における数値の根拠について説明する。
【0022】
[歩留まり改善の実験結果]
まず、本発明者は、『無欠陥層22の厚さ』および『酸素析出物領域23の酸素析出物密度』を変更しながら固体撮像装置21の製造実験を行い、不良品の発生状況を調べた。
図2は、この実験結果を示す図である。なお、図2に示す酸素析出物密度(微小欠陥の個数)は、三井鉱山(株)製の測定器M0401を用いて試料の表面深さ150μmまでの酸素析出物密度を測定し、これを無欠陥層22の厚さによらない測定値とするため、表面深さ20〜100の平均密度に換算した値である。
【0023】
この図2の実験結果から分かるように、無欠陥層22の厚さ7μmを境界値として、不良品の発生状況が劇的に変化した。すなわち、無欠陥層22の厚さを7μm以上にすることによって、固体撮像装置21の歩留まりが急激に改善されることが分かった。
【0024】
これは、無欠陥層22の厚さを7μm以上に確保することにより、転移網の突き抜けを抑止できるためと考えられる。(なお、一段と歩留まりを改善するには、無欠陥層22の厚さを11μm〜15μmの範囲内にすることが好ましい。)
【0025】
さらに、図2の実験結果により、酸素析出物密度が2.1E10cm−3以上になると、無欠陥層22の厚さにかかわらずに歩留まりが低下することも分かった。この結果から、酸素析出物密度は2.1E10cm−3未満(好ましくは、1.9E10cm−3以下、更に好ましくは1.7E10cm−3以下)にすることが好ましい。
【0026】
ところで、無欠陥層22を厚くするほど、転移網の突き抜けを抑止できるため、歩留まり改善の効果が確実になる。しかし、無欠陥層22が極端に厚くなると、単位画素24と酸素析出物領域23との距離がかけ離れるため、ゲッタリング能力の低下が懸念される。
そこで、ゲッタリング能力を維持する観点から、無欠陥層22の厚さ上限を規定すべきである。この場合の厚さ上限は、製造プロセスにおける熱処理温度と、金属汚染の拡散係数から、金属汚染の拡散距離を求めることによって計算することができる。一般に金属汚染の原因物質が主に鉄であることから、この厚さ上限は20μmとなる。
【0027】
[ゲッタリング能力の実験結果]
続いて、本発明者は、無欠陥層22の厚さを15μmにした状態で、酸素析出物密度を変更して製造実験を行い、ゲッタリング能力(固体撮像装置21の暗電流出力)の変化を調べた。
図3は、この実験結果を示す図である。なお、図3に示す酸素析出物密度は、図2に示す酸素析出物密度と同様の方法で測定している。
【0028】
この図3の実験結果からは、酸素析出物密度が1.0E10cm−3以上になると、暗電流が劇的に低下することが分かる。
この結果から、上記のように無欠陥層22を厚くした場合、十分なゲッタリング効果を得るために、酸素析出物密度を1.0E10cm−3以上に引き上げる必要が生じる。
【0029】
[ポリシリコン層25による歩留まり改善効果]
従来、半導体基板の裏面にポリシリコンなどの膜形成を行うことにより、偏析ゲッタリング効果を生じることが知られている(例えば非特許文献1の第360頁)。
しかしながら、従来は、このポリシリコン層25による歩留まり改善効果については知られていなかった。
【0030】
本発明者は、上述した実験に際して、ポリシリコン層25を裏面に形成した場合に歩留まりが改善することを突き止めた。具体的な理由については不明であるが、ポリシリコン層25によって微小欠陥が大きくまとまって成長することにより、転移網の発生状況が変化し、局所的な表面突き抜けを抑止するものと想像される。
【0031】
[無酸素層22bによる歩留まり改善効果]
通常、無酸素層22bを形成せずに、エピタキシャル層22aを形成した場合、半導体基板20からエピタキシャル層22aへ酸素が移動し、エピタキシャル層22a内に微小欠陥が発生してしまう。このような状態では、無欠陥層22の厚さが実質的に薄くなり、上述した歩留まり改善効果が低下する。
【0032】
しかしながら、本実施形態では、エピタキシャル層22aを形成する前に、半導体基板20を高温処理して、無酸素層22bを形成する。そのため、その後にエピタキシャル層22aを形成しても、エピタキシャル層22aへ放出される酸素が極めて少なく、エピタキシャル層22aをほぼ無欠陥に保つことが可能となる。
すなわち、本実施形態では、無酸素層22bを形成することによって、歩留まり改善の効果が一段と確実になる。
次に、別の実施形態について説明する。
【0033】
《第2の実施形態》
図4は、第2の実施形態における固体撮像装置21aの断面図である。
この固体撮像装置21aの構造上の特徴は、微小欠陥の分布密度にピークを有する酸素析出物層23aを無酸素層22bの下に形成した点である。主表面から深さ20〜100μmの範囲において、この酸素析出物(すなわち微小欠陥)の平均密度は、単位立方センチメートル当たり1.0E10個以上2.1E10個未満に調整される。
なお、その他の構造については、第1の実施形態(図1)と同様であるため、ここでの説明を省略する。
【0034】
[第2の実施形態の製造工程]
図5および図6は、固体撮像装置21aの製造工程を示す図である。以下、図5および図6に沿って、固体撮像装置21aの製造工程を説明する。
【0035】
(1)半導体基板20の裏面側にポリシリコン層25を形成する(図5A参照)。
(2)半導体基板20の主表面側から、酸素、窒素、および炭素からなる群の少なくとも一種を、酸素析出物領域23aとなる領域に、イオン注入法などを用いて埋め込む。これらの元素は、酸素析出を加速する効果を発揮する(図5B参照)。
(3) 半導体基板20を、1000℃〜1200℃で高温処理し、半導体基板20の表面近傍に含まれる酸素を外拡散させ、無酸素層22bを形成する。この無酸素層22bの厚さは、高温処理の処理時間によって調整する。
(4)続いて、半導体基板20を400℃〜800℃で低温処理する。このとき、予め埋め込んであった元素(酸素、窒素、または炭素など)は酸素析出を加速し、酸素析出物が集中した酸素析出物領域23aが形成される。この酸素析出物は、微小欠陥の成長核となる(図5C参照)。
(5)次に、半導体基板20の主表面側に、エピタキシャル成長法を使用してエピタキシャル層22aを形成する(図6D参照)。
(6)エピタキシャル層22aの成長温度あるいは別のアニール処理により、半導体基板20を900℃〜1100℃で中温処理する。このとき、酸素析出物を成長核として微小欠陥が成長する。このとき、ポリシリコン層25による弾性ひずみが微小欠陥に作用することにより、微小欠陥をより大きく成長させることができる。
この微小欠陥は、ゲッタリング中心として機能し、エピタキシャル層22aに含まれる金属汚染を有効に捕捉する。
(7)エピタキシャル層22aに、単位画素24などの回路素子領域を形成し、固体撮像装置21aを完成する(図6E参照)。
【0036】
[第2の実施形態の効果]
第2の実施形態においても、無欠陥層22の厚さを7.0μm以上20.0μm以下としているため、転移網の表面突き抜けを有効に防止し、固体撮像装置21aの歩留まりが確実に改善する。
【0037】
さらに、単位画素24と近い距離に、高密度の酸素析出物(微小欠陥)を集中分布させているため、単位画素24の金属汚染に対して高いゲッタリング能力が発揮される。その結果、暗電流の極めて少ない高感度(つまり高S/N)の固体撮像装置21aが完成する。
【0038】
特に、第2の実施形態では、高密度に酸素析出物が集中する領域23aを形成しながらも、無欠陥層22の厚さを所定幅に安定して維持することが可能である。これは、無酸素層22bおよびエピタキシャル層22aを段階的に形成することにより、無欠陥層22中に微小欠陥が取り込まれにくいからである。
次に、別の実施形態について説明する。
【0039】
《第3の実施形態》
図7は、第3の実施形態における固体撮像装置11の断面図である。
この固体撮像装置11の構造上の特徴は、無酸素層12aの厚さを7.0μm以上20.0μm以下として、エピタキシャル層を省いた点である。このような無酸素層12aの厚さは、半導体基板20の熱処理条件により調整することができる。
なお、その他の構造については、第1の実施形態(図1)と同様であるため、ここでの説明を省略する。
このような構造では、無酸素層12aの厚さにより、転移網の表面突き抜けを有効に防止し、固体撮像装置11の歩留まりを改善することが可能になる。
【0040】
【発明の効果】
本発明では、IG技術の不良原因が転移網の突き抜けであることを突き止め、『無欠陥層の厚さ』と『酸素析出物濃度』の両方を厳密に規定することにより、歩留まり改善と暗電流改善を両立できることを示した。
したがって、本発明で規定する構造に従って、固体撮像装置を構成することにより、高感度(つまり高S/N)の固体撮像装置を高い歩留まり率で製造することが可能になる。
【図面の簡単な説明】
【図1】第1の実施形態における固体撮像装置21の断面図である。
【図2】『無欠陥層22の厚さ』および『酸素析出物領域23の酸素析出物密度』を変更しながら固体撮像装置21の製造実験を行い、不良品の発生状況を調べた実験結果である。
【図3】酸素析出物密度と暗電流出力との関係を調べた実験結果である。
【図4】第2の実施形態における固体撮像装置21aの断面図である。
【図5】固体撮像装置21aの製造工程(1/2)を示す図である。
【図6】固体撮像装置21aの製造工程(2/2)を示す図である。
【図7】第3の実施形態における固体撮像装置11の断面図である。
【符号の説明】
20 半導体基板
21,21a,11 固体撮像装置
22 無欠陥層
22a エピタキシャル層
22b,12b 無酸素層
23,23a 酸素析出物領域
25 ポリシリコン層

Claims (5)

  1. 半導体基板と、
    前記半導体基板の主表面に存在する厚さ7.0μm以上20.0μm以下の無欠陥層と、
    前記無欠陥層に形成され、入射光に応じて信号電荷を生成する複数の単位画素と、
    前記無欠陥層の下に酸素析出物が析出した領域とを備え、
    表面深さ20〜100μmにおける前記酸素析出物の平均密度は単位立方センチメートル当たり1.0E10個以上である
    ことを特徴とする固体撮像装置。
  2. 請求項1に記載の固体撮像装置において、
    前記主表面から深さ20〜100μmにおける前記酸素析出物の平均密度は単位立方センチメートル当たり2.1E10個未満である
    ことを特徴とする固体撮像装置。
  3. 請求項1または請求項2に記載の固体撮像装置において、
    前記半導体基板の前記主表面とは反対の面(裏面)にポリシリコン膜が形成される
    ことを特徴とする固体撮像装置。
  4. 請求項1ないし請求項3のいずれか1項に記載の固体撮像装置において、
    エピタキシャル層を前記半導体基板の前記主表面に形成することにより、前記無欠陥層の厚さを7.0μm以上20.0μm以下に調整した
    ことを特徴とする固体撮像装置。
  5. 入射光に応じて信号電荷を生成する単位画素を半導体基板の主表面に複数有する固体撮像装置の製造方法であって、
    前記半導体基板の裏面にポリシリコン膜を形成する工程と、
    前記半導体基板の前記主表面側から、酸素、窒素、および炭素からなる群の少なくとも一種をイオン注入にて埋め込む工程と、
    前記半導体基板の表面近傍の酸素を熱により外拡散させ、前記主表面に無酸素層を形成する工程と、
    前記半導体基板に熱処理を施して酸素析出物による微小欠陥を成長させ、表面深さ20〜100μmにおける前記酸素析出物の平均密度を単位立方センチメートル当たり1.0E10個以上2.1E10個未満にする工程と、
    前記半導体基板の前記主表面にエピタキシャル層を形成して無欠陥層の厚さを7.0μm以上20.0μm以下に調整する工程と、
    前記エピタキシャル層に前記単位画素を形成する工程と
    を有する固体撮像装置の製造方法。
JP2003009998A 2003-01-17 2003-01-17 固体撮像装置の製造方法 Expired - Lifetime JP4288406B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2003009998A JP4288406B2 (ja) 2003-01-17 2003-01-17 固体撮像装置の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2003009998A JP4288406B2 (ja) 2003-01-17 2003-01-17 固体撮像装置の製造方法

Publications (2)

Publication Number Publication Date
JP2004221491A true JP2004221491A (ja) 2004-08-05
JP4288406B2 JP4288406B2 (ja) 2009-07-01

Family

ID=32899329

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2003009998A Expired - Lifetime JP4288406B2 (ja) 2003-01-17 2003-01-17 固体撮像装置の製造方法

Country Status (1)

Country Link
JP (1) JP4288406B2 (ja)

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006073580A (ja) * 2004-08-31 2006-03-16 Sumco Corp シリコンエピタキシャルウェーハ及びその製造方法
EP1670061A2 (en) * 2004-12-10 2006-06-14 Canon Kabushiki Kaisha Semiconductor substrate for solid-state image pickup device and producing method therefor
JP2007273959A (ja) * 2006-03-06 2007-10-18 Matsushita Electric Ind Co Ltd 光検出素子及びその製造方法
WO2013057887A1 (ja) * 2011-10-20 2013-04-25 信越半導体株式会社 エピタキシャルウエーハ及びその製造方法
JP2014099481A (ja) * 2012-11-13 2014-05-29 Sumco Corp エピタキシャルシリコンウェーハの製造方法、エピタキシャルシリコンウェーハ、および固体撮像素子の製造方法

Cited By (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006073580A (ja) * 2004-08-31 2006-03-16 Sumco Corp シリコンエピタキシャルウェーハ及びその製造方法
EP1670061A2 (en) * 2004-12-10 2006-06-14 Canon Kabushiki Kaisha Semiconductor substrate for solid-state image pickup device and producing method therefor
JP2006165462A (ja) * 2004-12-10 2006-06-22 Canon Inc 固体撮像装置用の半導体基板とその製造方法
JP4667030B2 (ja) * 2004-12-10 2011-04-06 キヤノン株式会社 固体撮像装置用の半導体基板とその製造方法
EP1670061A3 (en) * 2004-12-10 2011-05-04 Canon Kabushiki Kaisha Semiconductor substrate for solid-state image pickup device and producing method therefor
JP2007273959A (ja) * 2006-03-06 2007-10-18 Matsushita Electric Ind Co Ltd 光検出素子及びその製造方法
WO2013057887A1 (ja) * 2011-10-20 2013-04-25 信越半導体株式会社 エピタキシャルウエーハ及びその製造方法
JP2013089858A (ja) * 2011-10-20 2013-05-13 Shin Etsu Handotai Co Ltd エピタキシャルウエーハ及びその製造方法
US9425345B2 (en) 2011-10-20 2016-08-23 Shin-Etsu Handotai Co., Ltd. Epitaxial wafer and manufacturing method thereof
JP2014099481A (ja) * 2012-11-13 2014-05-29 Sumco Corp エピタキシャルシリコンウェーハの製造方法、エピタキシャルシリコンウェーハ、および固体撮像素子の製造方法

Also Published As

Publication number Publication date
JP4288406B2 (ja) 2009-07-01

Similar Documents

Publication Publication Date Title
Kimerling et al. The electrical properties of stacking faults and precipitates in heat‐treated dislocation‐free Czochralski silicon
CN101713098B (zh) 硅晶片及其制造方法
TWI567791B (zh) A semiconductor epitaxial wafer and a method for manufacturing the same, and a method for manufacturing the solid-state photographic element
JP4405082B2 (ja) 内部ゲッタリング性の改良された熱アニーリングされたウエハ
TW201107544A (en) Anneal wafer, method for manufacturing anneal wafer, and method for manufacturing device
JPS6031231A (ja) 半導体基体の製造方法
CN103534792A (zh) 制造半导体器件的方法和半导体器件
JP3381816B2 (ja) 半導体基板の製造方法
Liu et al. Interstitial iron concentrations across multicrystalline silicon wafers via photoluminescence imaging
TWI276161B (en) Ideal oxygen precipitating silicon wafers with nitrogen/carbon stabilized oxygen precipitate nucleation centers and process for making the same
JP2007273959A (ja) 光検出素子及びその製造方法
JP2004221491A (ja) 固体撮像装置,およびその製造方法
JP2005340348A (ja) Simox基板の製造方法及び該方法により得られるsimox基板
JPS6031232A (ja) 半導体基体の製造方法
US8659023B2 (en) Monocrystalline substrate including lattice matching atoms in a near surface region and a monocrystalline layer disposed on the substrate
JP6801682B2 (ja) 半導体エピタキシャルウェーハの製造方法及び半導体デバイスの製造方法
JP2011253978A (ja) エピタキシャル基板およびその製造方法
JP2003188176A (ja) シリコンウェーハおよびシリコンウェーハの製造方法
JP2019004034A (ja) エピタキシャル成長用の半導体ウェーハの製造方法、エピタキシャル成長用の半導体ウェーハ、および半導体エピタキシャルウェーハの製造方法
JPH05235005A (ja) 半導体基板及びその製造方法
JPS6120337A (ja) 半導体装置の製造方法
JP2007173328A (ja) 半導体基板、その製造方法、半導体デバイスおよびその製造方法
JP2006005125A (ja) 半導体装置の製造方法
JPS60136218A (ja) 半導体装置およびその製造方法
JPH023539B2 (ja)

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20050912

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20080827

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20080909

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20081107

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20081209

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20090202

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20090303

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20090316

R150 Certificate of patent or registration of utility model

Ref document number: 4288406

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120410

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120410

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20150410

Year of fee payment: 6

S531 Written request for registration of change of domicile

Free format text: JAPANESE INTERMEDIATE CODE: R313531

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20150410

Year of fee payment: 6

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20150410

Year of fee payment: 6

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250