JP2003510971A - 多重化送信システムにおけるブラインド・レート検出 - Google Patents

多重化送信システムにおけるブラインド・レート検出

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Abstract

(57)【要約】 通信システムにおける固定長のフレーム内にデータが多重化される。データは、第１のビット数を有する第１のトランスポート・チャネルを送信するステップと、前記第１のトランスポート・チャネルに係る、第２のビット数を有する第１の誤り検出ビットを送信するステップと、第３のビット数を有する第２のトランスポート・チャネルを送信するステップと、第４のビット数を有する第３のトランスポート・チャネルを送信するステップと、第５のビット数を有する制御チャネルを選択的に送信するステップとを有することで送信される。そして、前記制御チャネルは、前記第１の誤り検出ビットの送信後で、前記第３のトランスポート・チャネルの送信前に送信され、前記制御チャネルが前記フレームの一部として送信されるときには、前記第１、第２、第３、第４、第５のビット数の和が前記固定ビット長に等しく、前記制御チャネルが前記フレームの一部として送信されないときには、前記第１、第２、第３、第４のビット数の和が前記固定ビット長に等しいことを特徴とする。

Description

【発明の詳細な説明】
【０００１】 （背景） 本発明は、無線通信に関し、特に、無線通信システムのフレーム内のトランス
ポート・チャネルおよび制御チャネルのフォーマットに関する。
【０００２】 無線通信システムは従来より、送信フレーム内のデータ・チャネルおよび制御
チャネル多重化（multiplex）する。例えば、広帯域符号分割多元接続（Ｗ−Ｃ
ＤＭＡ）のための標準規格である第三世代パートナーシップ・プロジェクト（３
ＧＰＰ）では、固定長の送信フレーム内の異なる３つのデータ・チャネル（例え
ばトランスポート・チャネル）を多重化する。図１は、３ＧＰＰ標準規格に従う
従来のフレームフォーマットを示す図である。図示のように、フレーム１００は
、第１のトランスポート・チャネルに関するデータを保持する第１のフィールド
Ａ １０５を含む。フレーム１００は追加的に、第２のトランスポート・チャネ
ルおよび第３のトランスポート・チャネルに関する情報をそれぞれ伝送するため
の第２のフィールドＢ １１５およびフィールドＣ １２０を含む。一般に、Ａフ
ィールド１０５は重要な情報（例えば、音声符号化の場合には明瞭な音声を再生
するために最も重要な情報）を伝送するので、巡回冗長検査（ＣＲＣ）ビット１
１０が第１のフィールドＡ １０５に追加的に付加され、第１のトランスポート
・チャネルに係る誤り検出機能を有する。Ｂフィールド１１５およびＣフィール
ド１２０により伝送される情報は一般にそれほど重要ではないため、これらのフ
ィールドにはＣＲＣビットは付加されない。
【０００３】 図１に示すフレーム１００内の各フレームは、単一の固定されたフレーム１０
０内の開始位置および終了位置を有するように設計されうる。そうすると各フィ
ールドの位置の特定やデコードが容易になる。この場合、各フィールドの長さは
、対応するトランスポート・チャネルに関する最大予想ビットレートに対応でき
る十分な長さを有していなければならない。しかし、フィールド位置が固定され
ていると、トランスポート・チャネルがむだなデータを出力してフレーム１００
内の関係するフィールドを埋めるという非効率な方法でシステム容量を使ってし
まうことになる。
【０００４】 可変長フィールドを使用する（例えば、有効データトラヒックにある程度適応
するために、Ａ，Ｂ，および／または、Ｃフィールドの長さを増減する）ことで
、固定フィールド位置により生じうる非効率を軽減することができる。例えば、
Ａフィールド１０５の長さをあらかじめ定められた複数種類の長さのいずれかに
度々設定することができ、それによって可変レートで情報を送信することが可能
になる。受信したＡフィールド１０５の実際の長さを求めるために、「ブライン
ド・レート検出（blind rate detection）」とよばれる処理が用いられる。この
方法によれば、フレームに特別に挿入されるレート情報を必要とせずに実際のデ
ータレートが求められる。あるブラインド・レート検出処理においては、受信機
は所定の複数の長さ候補のいずれかの長さ（例えば最小のもの）に仮定する。仮
定した長さを用いてＡフィールド１０５が復号化（デコード）され、そのＣＲＣ
フィールド１１０（Ａフィールド１０５の直後に規定される必要がある）が判定
される。ＣＲＣフィールド１１０が誤りが検出されなかったことを示す場合には
、仮定した長さは正しいと推定される。逆に誤りが検出された場合には、所定の
複数の長さ候補から別の長さ（例えば次に長いもの）が仮定され、ＣＲＣフィー
ルド１１０が誤りを示さなくなるまで処理が繰り返される。ＣＲＣフィールド１
１０が誤りを示さなくなった時点で、Ａフィールド１０５は正しくデコードされ
たと推定され、その長さは最後の仮定した長さであることがわかる。
【０００５】 先述したとおり、Ｂフィールド１１５およびＣフィールド１２０にはＣＲＣビ
ットは付加されないのが一般的である。３ＧＰＰ標準規格により定義されるよう
に、フレーム１００は既知の長さであるから、Ｂフィールド１１５およびＣフィ
ールド１２０の長さはＡフィールド１０５の長さに対応して設定されなければな
らない。一般には、Ａフィールド１０５の所定の複数の長さ候補の各々に対して
、Ｂフィールド１１５およびＣフィールド１２０それぞれの長さが同様にあらか
じめ定められる。したがって、Ｂフィールド１１５およびＣフィールド１２０の
開始位置はもちろんのこと、長さがいったん判ってしまえば、Ａフィールド１０
５の長さも判る。
【０００６】 上記したＡフィールド１０５、Ｂフィールド１１５、Ｃフィールド１２０に加
え、フレーム１００において可変長制御チャネルＤＣＣＨが送信される場合があ
る。これはたまにしか送信されないものであるので、ＤＣＣＨフィールドが常に
含まれるフレームフォーマットを規定するのではむだが多いであろう。そのため
、ＤＣＣＨフィールドがＣフィールド１２０からビットを「盗用する（steel）
」ことを認める方法でフレームフォーマットが規定される。しかし、ＤＣＣＨフ
ィールドはその長さを変化させることも可能である。このことは、Ｃフィールド
から何ビット「盗用」したのか分からなくなるという問題を生じうる。
【０００７】 図２に示すように、フレーム２００の終端部に、Ｃフィールド２０１から「盗
用」したビットで形成されるＤＣＣＨフィールド２０３（関連するＣＲＣフィー
ルドを含む）を位置させることが提案されている。Ａフィールド１０５、Ｂフィ
ールド１１５は上記と同様の方法で求められる。Ｃフィールド２０１の長さを求
めるためにはＤＣＣＨフィールド２０３の長さを知ることが必要である。上記提
案においては、これは、とりうるＤＣＣＨの長さのうちのいずれか（例えば最小
のＤＣＣＨの長さ）を仮定し、フレーム２００の終端からＤＣＣＨフィールド２
０３をデコードすることによって行われる。このことが図２において逆向きの矢
印２０５によって示されている。デコードの結果、ＤＣＣＨのＣＲＣフィールド
よりまったく誤りが検出されなかった場合には、ＤＣＣＨフィールド２０３の仮
定した長さが正しいと推定される。誤りが検出された場合には、異なるＤＣＣＨ
の長さが仮定され、ＤＣＣＨフィールド２０３が正しくデコードされるまで、ま
たは、ＤＣＣＨフィールド２０３のデコードに失敗してＤＣＣＨフィールド２０
３がフレーム２００に存在しない（すなわち、Ｃフィールド２０１からビットが
まったく盗用されていない）ことを示すまで、処理が繰り返される。ＤＣＣＨフ
ィールド２０３の長さがいったん判れば、Ｃフィールドの長さも求められる。
【０００８】 この提案された解決策は多くの問題を呈する。まず、逆向きにビットを送信し
受信するフォーマットを実現することは困難である。また、提案されたフォーマ
ットは他のフォーマットと大きく異なる。これはまったく新しい種類の多重化の
標準化を必要とすることになろう。
【０００９】 （概要） したがって本発明は、固定長のフレームに可変長のＤＣＣＨフィールドを間欠
的に含めることのできる多重化技術を提供することを目的とする。
【００１０】 本発明の一側面によれば、通信システムにおける固定長のフレーム内にデータ
が多重化される。これは、第１のビット数を有する第１のトランスポート・チャ
ネルを送信するステップと、前記第１のトランスポート・チャネルに係る、第２
のビット数を有する第１の誤り検出ビットを送信するステップと、第３のビット
数を有する第２のトランスポート・チャネルを送信するステップと、第４のビッ
ト数を有する第３のトランスポート・チャネルを送信するステップと、第５のビ
ット数を有する制御チャネルを選択的に送信するステップとを有することで達成
される。さらに、前記制御チャネルは、前記第１の誤り検出ビットの送信後で、
前記第３のトランスポート・チャネルの送信前に送信され、前記制御チャネルが
前記フレームの一部として送信されるときには、前記第１、第２、第３、第４、
第５のビット数の和が前記固定ビット長に等しく、前記制御チャネルが前記フレ
ームの一部として送信されないときには、前記第１、第２、第３、第４のビット
数の和が前記固定ビット長に等しいことを特徴とする。
【００１１】 本発明の別の側面によれば、前記制御チャネルは、前記第１の誤り検出ビット
と前記第２のトランスポート・チャネルとの間で送信される。あるいは、前記制
御チャネルは、前記第２のトランスポート・チャネルと前記第３のトランスポー
ト・チャネルとの間で送信される。
【００１２】 本発明の別の側面によれば、前記第５のビット数のビットには前記制御チャネ
ルに係る誤り検出ビットが更に含まれる。
【００１３】 本発明の更に別の側面によれば、通信システムにおける固定ビット長のフレー
ムとして受信した多重化データがデコードされる。これは、前記フレームに含ま
れる第１のトランスポート・チャネルの第１の長さを求め、当該第１のトランス
ポート・チャネルをデコードするステップと、前記第１の長さの関数である第２
の長さを有する第２のビット・グループをデコードするステップと、前記第２の
ビット・グループに当該第２のビット・グループに係る誤り検出ビットが含まれ
ているか否かを判定するステップとを有することで達成される。そして、前記第
２のビット・グループに係る誤り検出ビットが前記フレームに含まれているとき
は、前記第１および第２の長さの関数である第２のトランスポート・チャネルの
第３の長さおよび開始位置を求め、当該第２のトランスポート・チャネルをデコ
ードする。他方、前記第２のビット・グループに係る誤り検出ビットが前記フレ
ームに含まれていないときには、デコードした当該第２のビット・グループを、
デコードされた前記第２のトランスポート・チャネルとして用いる。さらに、前
記第１のトランスポート・チャネルをデコードする前記ステップ、および、前記
第２のビット・グループをデコードする前記ステップは、同一の方向に行われる
ことを特徴とする。
【００１４】 本発明の別の側面によれば、前記第１のトランスポート・チャネルのデコード
後で、前記第２のビット・グループのデコード前に、前記第１の長さのみの関数
である第４の長さを有する第３のトランスポート・チャネルがデコードされる。
【００１５】 あるいは、前記第３のトランスポート・チャネルは、前記第１のトランスポー
ト・チャネルおよび前記第２のビット・グループの両方のデコード後にデコード
される。かかる実施形態では、前記第３のトランスポート・チャネルは、前記第
１の長さのみの関数である第４の長さを有する。
【００１６】 あるいは、前記第３のトランスポート・チャネルは、前記第１および第２の長
さの両方の関数である第４の長さを有する。
【００１７】 本発明の更に別の実施形態においては、通信システムにおける固定ビット長の
フレーム内にデータを多重化する方法であって、合わせて第１のビット数を有す
る１または２以上のトランスポート・チャネルの第１のグループを送信するステ
ップと、前記第１のグループの１または２以上のトランスポート・チャネルに係
る、第２のビット数を有する第１の誤り検出ビットを送信するステップと、合わ
せて第３のビット数を有する１または２以上のトランスポート・チャネルの第２
のグループを送信するステップと、合わせて第４のビット数を有する１または２
以上のトランスポート・チャネルの第３のグループを送信するステップと、第５
のビット数を有する制御チャネルを選択的に送信するステップとを有し、前記制
御チャネルは、前記第１のグループおよび前記第１の誤り検出ビットの送信後で
、前記第３のグループの送信後に送信され、前記制御チャネルが前記フレームの
一部として送信されるときには、前記第１、第２、第３、第４、第５のビット数
の和が前記固定ビット長に等しく、前記制御チャネルが前記フレームの一部とし
て送信されないときには、前記第１、第２、第３、第４のビット数の和が前記固
定ビット長に等しいことを特徴とする。
【００１８】 本発明の更に他の実施形態においては、通信システムにおける固定長のフレー
ムとして受信した多重化データがデコードされる。これは、前記フレームに含ま
れる１または２以上のトランスポート・チャネルの第１のグループの第１の長さ
を求め、当該第１のグループをデコードするステップと、前記第１の長さの関数
である第２の長さを有する第２のビット・グループをデコードするステップと、
前記第２のビット・グループに当該第２のビット・グループに係る誤り検出ビッ
トが含まれているか否かを判定するステップとを有することで達成される。前記
第２のビット・グループに係る誤り検出ビットが前記フレームに含まれていると
きは、前記第１および第２の長さの関数である１または２以上のトランスポート
・チャネルの第２のグループの第３の長さおよび開始位置を求め、当該第２のグ
ループがデコードされる。一方、前記第２のビット・グループに当該第２のビッ
ト・グループに係る誤り検出ビットが前記フレームに含まれていないときには、
デコードした当該第２のビット・グループが、デコードされた前記第２のグルー
プとして用いられる。この場合、前記第１のグループをデコードする前記ステッ
プ、および、前記第２のビット・グループをデコードする前記ステップは、同一
の方向に行われることを特徴とする。
【００１９】 （詳細な説明） 以下、図面を参照して本発明のさまざまな特徴を説明する。図中、同様の構成
要素には同一の参照符号を付してある。多数の実施形態を開示するが、発明の理
解の助けとなるように、コンピュータシステムの構成要素によって実行される動
作（例えば、ビットおよび／またはビット・フィールドをさまざまな配列で生成
すること）のシーケンスの観点から、発明を多面的に説明する。各実施形態にお
いて、専用の回路（例えば、特別の機能を実行するためのディスクリート論理ゲ
ート結合型）によって、１または２以上のプロセッサにより実行されるプログラ
ム命令によって、あるいは両方の組み合わせによって、さまざまな動作が行われ
うることが認識されよう。本発明はさらに、以下に開示する技術をプロセッサに
実行させる好適なコンピュータ命令セットを、あらゆる形態のコンピュータ読取
り可能な記憶媒体に記憶することですべて実現されうると考えられる。したがっ
て、本発明のさまざまな側面が多くの異なる形態で実現され、かかるすべての形
態が本発明の範囲に含まれると考えられる。本発明のさまざまな側面の各々に対
するあらゆる実施形態が、以下に説明する動作を実行するように構成された「ロ
ジック手段」として本発明の範囲に関係してくる。
【００２０】 図３は、本発明の第１の実施形態における多重化フォーマットのブロック図で
ある。同図中、フレーム３００は、従来技術と同様、Ａフィールド１０５および
ＣＲＣフィールド１１０を有する。Ａフィールド１０５は可変長フィールドであ
り、その長さは上記したように求められる。すなわち、１または２以上のとりう
る長さを仮定し、ＣＲＣフィールド１１０が誤りがないことを示すこときの仮定
を求めることにより行われる。フレーム３００はさらに、Ｂフィールド３０３お
よびＣフィールド３０５を含む。また、可変長のＤＣＣＨ＋ＣＲＣフィールド３
０１をフレーム３００に含めることが可能である（ただし必要ではない）。ＤＣ
ＣＨ＋ＣＲＣフィールド３０１が存在しないときは、Ｂフィールド３０３および
Ｃフィールド３０５はその順序で、ＣＲＣフィールド１１０の直後に配される。
この場合、Ｂフィールド３０３およびＣフィールド３０５はＡフィールド１０５
の長さから求められる。Ａフィールド１０５の長さがいったん判れば、Ｂフィー
ルド３０３およびＣフィールド３０５それぞれの長さが同様に判る。
【００２１】 本発明の一側面によれば、ＤＣＣＨ＋ＣＲＣフィールド３０１がフレーム３０
０に含められるときは、ＤＣＣＨ＋ＣＲＣフィールド３０１は、ＣＲＣフィール
ド１１０の後で、かつ、Ｂフィールド３０３の前の位置にのみ配置される。フレ
ーム３００は、図４に示すような工程を（例えば、プログラムされたプロセッサ
によって）実行することでデコードすることができる。まず、Ａフィールド１０
５の長さを仮定する（ステップ４０１）。この仮定した長さを用いて、フレーム
３００の開始位置に配置されていることが分かっているＡフィールド１０５のデ
コードを試みる（ステップ４０３）。そして、ＣＲＣフィールド１１０がデコー
ド処理中に誤りが生じたことを示しているか否かを判断する（ステップ４０５）
。誤りが生じた場合には、Ａフィールド１０５に対する新たな長さを仮定し（ス
テップ４０７）、デコード処理（ステップ４０３）を繰り返す。
【００２２】 最終的にはＡフィールド１０５に対する正しい長さが仮定され、誤りが生じて
いないことが判断ブロック４０５で判断されることになる。そうすると、Ａフィ
ールド１０５をデコードして、ここでその長さを知ることができる。次に、ＤＣ
ＣＨ＋ＣＲＣフィールド３０１が存在するかどうかを調べ、存在する場合にはそ
の長さを求めなければならない。これは、ＤＣＣＨ＋ＣＲＣフィールド３０１の
第１の（例えば、０ではない最小の）長さを仮定することで行われる（ステップ
４０９）。この仮定した長さを用いて、ＣＲＣフィールド１１０の直後のビット
をデコードする（ステップ４１１）。その後、ＤＣＣＨのＣＲＣフィールドがデ
コード処理中に誤りが生じたことを示しているか否かを判断する（ステップ４１
５）。誤りが生じた場合には、ＤＣＣＨ＋ＣＲＣフィールド３０１のとりうる長
さ候補が残っているか否かの判断を行う（ステップ４１５）。残っている場合に
は、それらとりうる長さ候補のうちの次の候補の長さを新たに仮定して（ステッ
プ４１７）、デコード処理（ステップ４１１）を繰り返す。
【００２３】 ＤＣＣＨ＋ＣＲＣフィールド３０１が存在するときは、その実際の長さが最終
的に仮定され、デコード処理中に誤りが生じない結果となる（判断ブロック４１
３から“ＮＯ”の経路を進む）。この場合には、Ａフィールド１０５およびＤＣ
ＣＨ＋ＣＲＣフィールド３０１の実際の長さが判ることになり、Ｂフィールド３
０３、Ｃフィールド３０５の開始位置のみならずそれぞれの長さもが求められる
（ステップ４１９）。このステップの実行において、ＤＣＣＨ＋ＣＲＣフィール
ド３０１（存在する場合）がビットを盗用したのはＢフィールド３０３からなの
かＣフィールド３０５からなのかを知ることが必要であることに注意しなければ
ならない。これは、多くの方法がある中のいずれかで共通化できる。例えば、Ｂ
フィールド３０３の長さが、その通常の長さ（Ａフィールド１０５の長さによっ
て規定される場合の長さ）から盗用されたビット数を減じた長さで与えられるよ
うに、ＤＣＣＨ＋ＣＲＣフィールドのビットのすべてをＢフィールド３０３から
盗用することを必要とする方法。別の方法として、ＤＣＣＨ＋ＣＲＣフィールド
３０１のいくつかのビットをＢフィールド３０３から盗用し、残りのビットをＣ
フィールド３０５から盗用する、という方法もある。
【００２４】 判断ブロック４１５において、ＤＣＣＨ＋ＣＲＣフィールド３０１が存在しな
い場合には、結局とりうるすべてのゼロでない長さ候補が仮定され不成功に終わ
ることになる（判断ブロック４１５から“ＹＥＳ”の経路を進む）。この場合、
Ａフィールド１０５の実際の長さが判り、ＤＣＣＨ＋ＣＲＣフィールド３０１は
存在しないので、その長さは無関係になる。したがって、Ｂフィールド３０３お
よびＣフィールド３０５の開始位置のみならずそれぞれの長さを、Ａフィールド
１０５の長さから求めることができる（ステップ４２１）。
【００２５】 ＢフィールドおよびＣフィールドの長さおよび開始位置がいったん判れば、そ
れぞれ公知の手法を用いてデコードすることができる（ステップ４２３，４２５
）。
【００２６】 本発明の別の実施形態によるフレーム５００は、図５に示すような多重化フォ
ーマットを有する。ここで、フレーム５００は、従来と同様にＡフィールド１０
５およびＣＲＣフィールド１１０を有する。Ａフィールド１０５は可変長フィー
ルドであり、その長さは上記したような方法で求められる。すなわち、１または
２以上のとりうる長さを仮定し、ＣＲＣフィールド１１０が誤りがないことを示
すこときの仮定を求めることにより行われる。フレーム５００はさらに、Ｂフィ
ールド５０１およびＣフィールド５０５を含む。また、可変長のＤＣＣＨ＋ＣＲ
Ｃフィールド５０３をフレーム５００に含めることが可能である（ただし必要で
はない）。ＤＣＣＨ＋ＣＲＣフィールド５０３が存在しないときは、Ｂフィール
ド５０１およびＣフィールド５０５はその順序で、ＣＲＣフィールド１１０の直
後の配される。この場合、Ｂフィールド５０１およびＣフィールド５０５の長さ
はＡフィールド１０５の長さから求められる。Ａフィールド１０５の長さがいっ
たん判れば、Ｂフィールド５０１およびＣフィールド３０５それぞれの長さが同
様に判る。
【００２７】 本発明の一側面によれば、ＤＣＣＨ＋ＣＲＣフィールド５０３がフレーム５０
０に含められるときは、ＤＣＣＨ＋ＣＲＣフィールド５０３は、Ｂフィールド５
０１の後で、かつ、Ｃフィールド５０５の前の位置にのみ配置される。フレーム
５００は、図６に示すような工程を（例えば、プログラムされたプロセッサによ
って）実行することでデコードすることができる。まず、Ａフィールド１０５の
長さを仮定する（ステップ６０１）。この仮定した長さを用いて、フレーム５０
０の開始位置に配置されていることが分かっているＡフィールド１０５のデコー
ドを試みる（ステップ６０３）。そして、ＣＲＣフィールド１１０がデコード処
理中に誤りが生じたことを示しているか否かを判断する（ステップ６０５）。誤
りが生じた場合には、Ａフィールド１０５に対する新たな長さを仮定し（ステッ
プ６０７）、デコード処理（ステップ６０３）を繰り返す。
【００２８】 最終的にはＡフィールド１０５に対する正しい長さが仮定され、誤りが生じて
いないことが判断ブロック６０５で判断されることになる。そうすると、Ａフィ
ールド１０５をデコードして、ここでその長さを知ることができる。Ａフィール
ド１０５の長さが判ると、Ｂフィールド５０１の長さも判る（すなわち、Ａフィ
ールド１０５の長さの各候補に対応するＢフィールド５０１の長さもあらかじめ
規定されている。）（ステップ６０９）。Ｂフィールド５０１はＡフィールド１
０５の直後にあることも分かっているので、Ｂフィールド５０１はただちにデコ
ードされる（ステップ６１１）。
【００２９】 次に、ＤＣＣＨ＋ＣＲＣフィールド５０３が存在するかどうかを調べ、存在す
る場合にはその長さを求めなければならない。これは、ＤＣＣＨ＋ＣＲＣフィー
ルド５０３の第１の（例えば、０ではない最小の）長さを仮定することで行われ
る（ステップ６１３）。この仮定した長さを用いて、Ｂフィールド５０１の直後
のビットをデコードする（ステップ６１５）。その後、ＤＣＣＨのＣＲＣフィー
ルドがデコード処理中に誤りが生じたことを示しているか否かを判断する（ステ
ップ６１７）。誤りが生じた場合には、ＤＣＣＨ＋ＣＲＣフィールド５０３のと
りうる長さ候補が残っているか否かの判断を行う（ステップ６１９）。残ってい
る場合には、それらとりうる長さ候補のうちの次の候補の長さを新たに仮定して
（ステップ６２１）、デコード処理（ステップ６１５）を繰り返す。
【００３０】 ＤＣＣＨ＋ＣＲＣフィールド５０３が存在するときは、その実際の長さが最終
的に仮定され、デコード処理中に誤りが生じない結果となる（判断ブロック６１
７から“ＮＯ”の経路を進む）。この場合には、Ａフィールド１０５、Ｂフィー
ルド５０１、そしてＤＣＣＨ＋ＣＲＣフィールド５０３の実際の長さが判ること
になり、Ｃフィールド５０５の開始位置のみならずその長さもが求められる（ス
テップ６２３）。このステップの実行において留意すべきことは、デコードにあ
たりＤＣＣＨ＋ＣＲＣフィールド５０３がＣフィールド５０５からビットを盗用
することを要するということである。
【００３１】 判断ブロック６１９において、ＤＣＣＨ＋ＣＲＣフィールド５０３が存在しな
い場合には、結局とりうるすべてのゼロでない長さ候補が仮定され不成功に終わ
ることになる（判断ブロック６１９から“ＹＥＳ”の経路を進む）。この場合、
Ａフィールド１０５およびＢフィールド５０１の実際の長さが判り、ＤＣＣＨ＋
ＣＲＣフィールド５０３は存在しないので、その長さは無関係になる。したがっ
て、Ｃフィールド５０５の開始位置のみならずその長さを、Ａフィールド１０５
およびＢフィールド５０１の長さに基づいて求めることができる（ステップ６２
５）。
【００３２】 Ｃフィールド５０５の長さおよび開始位置がいったん判れば、公知の手法を用
いてデコードすることができる（ステップ６２７）。
【００３３】 上述した実施形態のそれぞれに適用可能な技術的事項についていくつか説明す
る。まず、レート・マッチングを適用する場合には、使用されるレートまたは多
重化とは関係なく、レート・マッチング位置がすべて等しくなるべきである。具
体的には、レート・マッチングは、データのフィールド長が実チャネルに整合可
能にすることが望まれるときに、いくつかのビットをパンクチャ（pucture）し
、あるいは、いくつかのビットを反復する（すなわちパディングとして用いる）
ための符号化の後に使用される。トランスポート・チャネルが異なる長さを仮定
できるときに、レート・マッチングは、送信データ長を増減して実チャネルのサ
イズに整合させる必要がある。上述したブラインド・レート検出の手法において
は、送信フォーマットに関係なく、同一のビットが反復されるべきであり（パデ
ィングの場合）、同一のビットがパンクチャされるべきである。例えば、反復さ
れ（パディングの場合）、または、除去される（パンクチャする場合）のがビッ
ト番号３であるとした場合には、これがトランスポート・チャネルのとりうる各
々の長さに対する場合に適用されるべきである。このことは上記の仮定したデコ
ードを行うことを確実にするであろう。
【００３４】 さらに、ＤＣＣＨ＋ＣＲＣフィールド３０１，５０３が送信されず、ＤＣＣＨ
＋ＣＲＣフィールド３０１，５０３およびＢフィールド３０３またはＣフィール
ド５０５が同一の符号、同一のレート・マッチングで符号化されたときは、予想
するＣＲＣが検出されない場合にＤＣＣＨのデコードを終えることができ、これ
は、既知の長さの次のフィールド（図３のフォーマットを用いる場合にはＢフィ
ールド３０３、図５のフォーマットを用いる場合にはＣフィールド５０５）が替
わってデコードされることを意味する。このように、Ｂフィールド３０３または
Ｃフィールド５０５を替わりにデコードするのに特別なステップは必要ないので
、効率よく処理を行うことができる。
【００３５】 本発明は、従来の技術に対して多くの利点を提供する。例えば、レートを検出
するためのいくらかのデコード処理ループを必要とせずに、可変位置フォーマッ
トに対するブラインド・レート検出を実現することが可能である。また、通常の
ビット順序が使用されるので、レート・マッチング手法における特別の処理が必
要ない。さらに、Ｃフィールドの長さ、Ｂフィールドの長さ、またはＣおよびＢ
フィールドを結合した長さ、までの任意のビット数を盗用することが可能である
。
【００３６】 以上、特定の実施形態を参照して本発明を説明した。ただし、上述した好適な
実施形態とは異なる形態でも発明を実現できることは明らかであろう。これは本
発明の主旨から逸脱することなくなされうる。
【００３７】 例えば、Ａ，Ｂ，Ｃのフィールドで示される３つのトランスポート・チャネル
だけを含む実施形態により本発明を説明したが、ここに開示した発明思想は、規
定したフレームが３以上のフィールドを有する他の実施形態にも適用されうるこ
とが理解されよう。より一般的には、フレームは、１または２以上のトランスポ
ート・チャネルの第１のグループ（上述の実施形態におけるＡフィールド１０５
で示した１のトランスポート・チャネルに対応する）；１または２以上のトラン
スポート・チャネルの第２のグループ（Ｂフィールド３０３，５０１で示した１
のトランスポート・チャネルに対応する）；そして、１または２以上のトランス
ポート・チャネルの第３のグループ（Ｃフィールド３０５，５０５で示した１の
トランスポート・チャネルに対応する）、を含むと考えることができる。第１の
グループ内のトランスポート・チャネルは互いにすべて同じ長さである必要はな
い。第２のグループ内のトランスポート・チャネルも互いにすべて同じ長さであ
る必要はない。第３のグループ内のトランスポート・チャネルも互いにすべて同
じ長さである必要はない。第１のグループを形成するトランスポート・チャネル
間には、誤り検出ビット（例えばＣＲＣビット）の１または２以上のグループを
配置することもできる。第１のグループ内の各トランスポート・チャネルが自身
の誤り検出ビットのグループを有する必要はない。
【００３８】 本発明をより一般化して表現すると、ＤＣＣＨ＋ＣＲＣフィールドが存在する
とき、そのＤＣＣＨ＋ＣＲＣフィールドは、第１のグループおよび関係する誤り
検出ビットの任意のグループの両方の後であって、１または２以上のトランスポ
ート・チャネルの第３のグループの前の、任意の位置に配置することができる。
これらの状況の下でブラインド・レート検出を行う場合、上述の実施形態の概要
は次のようになる。まず、１または２以上のトランスポート・チャネルの第１の
グループの長さを求める。これは、第１のグループを形成する１または２以上の
トランスポート・チャネルの、異なる長さを仮定することを含み、そして、例え
ば、１または２以上の誤り検出ビットのグループに基づいて、上記仮定が正しい
か否かを判断する。第１のグループの長さが求められると、制御チャネル（ＤＣ
ＣＨ＋ＣＲＣ）が存在する場合で、その制御チャネルが１または２以上のトラン
スポート・チャネルの第２のグループの直前にないときは、第２のグループの長
さもここで判る。制御チャネル（ＤＣＣＨ＋ＣＲＣ）の位置がどこにあっても、
その制御チャネルが存在しているかぎりその開始位置は予測できる（第２のグル
ープの前か後）ので、とりうる長さが仮定され、上述したような関係するＣＲＣ
フィールドにより誤りの有無を判断する。ＤＣＣＨ＋ＣＲＣフィールドの長さ（
長さ０となる可能性を含み、この場合は存在しないことを意味する）がいったん
判れば、トランスポート・チャネルの残りのグループの長さのみならず開始位置
も判り、これらのトランスポート・チャネルを上述の如くデコードすることがで
きる（ＤＣＣＨ＋ＣＲＣフィールドを含むデコードしたフィールドの長さを、フ
レームの全長から減じるとトランスポート・チャネルの残りのグループの長さが
判る。）。
【００３９】 したがって、好適な実施形態はあくまで説明のためのものであって、限定的に
捉えるべきではない。本発明の範囲は上述の説明からではなく請求の範囲によっ
て定められ、あらゆる改変、均等物がその請求の範囲に含まれる。
【図面の簡単な説明】
【図１】 従来のフレームフォーマットのブロック図である。
【図２】 フレーム２００の終端部にＤＣＣＨフィールドが位置する、従来のフレームフ
ォーマットのブロック図である。
【図３】 本発明の一実施形態による多重化フォーマットのブロック図である。
【図４】 本発明によるフレームをデコードする工程を示すフローチャートである。
【図５】 本発明の他の実施形態による多重化フォーマットのブロック図である。
【図６】 本発明の他の実施形態によるフレームをデコードする工程を示すフローチャー
トである。
───────────────────────────────────────────────────── フロントページの続き (81)指定国 ＥＰ(ＡＴ，ＢＥ，ＣＨ，ＣＹ， ＤＥ，ＤＫ，ＥＳ，ＦＩ，ＦＲ，ＧＢ，ＧＲ，ＩＥ，Ｉ Ｔ，ＬＵ，ＭＣ，ＮＬ，ＰＴ，ＳＥ)，ＯＡ(ＢＦ，ＢＪ ，ＣＦ，ＣＧ，ＣＩ，ＣＭ，ＧＡ，ＧＮ，ＧＷ，ＭＬ， ＭＲ，ＮＥ，ＳＮ，ＴＤ，ＴＧ)，ＡＰ(ＧＨ，ＧＭ，Ｋ Ｅ，ＬＳ，ＭＷ，ＭＺ，ＳＤ，ＳＬ，ＳＺ，ＴＺ，ＵＧ ，ＺＷ)，ＥＡ(ＡＭ，ＡＺ，ＢＹ，ＫＧ，ＫＺ，ＭＤ， ＲＵ，ＴＪ，ＴＭ)，ＡＥ，ＡＧ，ＡＬ，ＡＭ，ＡＴ， ＡＵ，ＡＺ，ＢＡ，ＢＢ，ＢＧ，ＢＲ，ＢＹ，ＢＺ，Ｃ Ａ，ＣＨ，ＣＮ，ＣＲ，ＣＵ，ＣＺ，ＤＥ，ＤＫ，ＤＭ ，ＤＺ，ＥＥ，ＥＳ，ＦＩ，ＧＢ，ＧＤ，ＧＥ，ＧＨ， ＧＭ，ＨＲ，ＨＵ，ＩＤ，ＩＬ，ＩＮ，ＩＳ，ＪＰ，Ｋ Ｅ，ＫＧ，ＫＰ，ＫＲ，ＫＺ，ＬＣ，ＬＫ，ＬＲ，ＬＳ ，ＬＴ，ＬＵ，ＬＶ，ＭＡ，ＭＤ，ＭＧ，ＭＫ，ＭＮ， ＭＷ，ＭＸ，ＭＺ，ＮＯ，ＮＺ，ＰＬ，ＰＴ，ＲＯ，Ｒ Ｕ，ＳＤ，ＳＥ，ＳＧ，ＳＩ，ＳＫ，ＳＬ，ＴＪ，ＴＭ ，ＴＲ，ＴＴ，ＴＺ，ＵＡ，ＵＧ，ＵＺ，ＶＮ，ＹＵ， ＺＡ，ＺＷ Ｆターム(参考） 5K028 BB04 KK01 MM09 MM12 5K067 AA23 BB04 CC10 DD27 DD51 EE02 HH21 HH25

Claims (36)

    【特許請求の範囲】
  1. 【請求項１】 通信システムにおける固定ビット長のフレーム内にデータを
    多重化する方法であって、 第１のビット数を有する第１のトランスポート・チャネルを送信するステップ
    と、 前記第１のトランスポート・チャネルに係る、第２のビット数を有する第１の
    誤り検出ビットを送信するステップと、 第３のビット数を有する第２のトランスポート・チャネルを送信するステップ
    と、 第４のビット数を有する第３のトランスポート・チャネルを送信するステップ
    と、 第５のビット数を有する制御チャネルを選択的に送信するステップと、 を有し、 前記制御チャネルは、前記第１の誤り検出ビットの送信後で、前記第３のトラ
    ンスポート・チャネルの送信前に送信され、 前記制御チャネルが前記フレームの一部として送信されるときには、前記第１
    、第２、第３、第４、第５のビット数の和が前記固定ビット長に等しく、 前記制御チャネルが前記フレームの一部として送信されないときには、前記第
    １、第２、第３、第４のビット数の和が前記固定ビット長に等しい、 ことを特徴とする方法。
  2. 【請求項２】 前記制御チャネルは、前記第１の誤り検出ビットと前記第２
    のトランスポート・チャネルとの間で送信されることを特徴とする請求項１に記
    載の方法。
  3. 【請求項３】 前記制御チャネルは、前記第２のトランスポート・チャネル
    と前記第３のトランスポート・チャネルとの間で送信されることを特徴とする請
    求項１に記載の方法。
  4. 【請求項４】 前記第５のビット数のビットには前記制御チャネルに係る誤
    り検出ビットが更に含まれることを特徴とする請求項１に記載の方法。
  5. 【請求項５】 通信システムにおける固定ビット長のフレームとして受信し
    た多重化データをデコードする方法であって、 前記フレームに含まれる第１のトランスポート・チャネルの第１の長さを求め
    、当該第１のトランスポート・チャネルをデコードするステップと、 前記第１の長さの関数である第２の長さを有する第２のビット・グループをデ
    コードするステップと、 前記第２のビット・グループに当該第２のビット・グループに係る誤り検出ビ
    ットが含まれているか否かを判定するステップと、 前記第２のビット・グループに係る誤り検出ビットが前記フレームに含まれて
    いるときに、前記第１および第２の長さの関数である第２のトランスポート・チ
    ャネルの第３の長さおよび開始位置を求め、当該第２のトランスポート・チャネ
    ルをデコードするステップと、 前記第２のビット・グループに係る誤り検出ビットが前記フレームに含まれて
    いないときに、デコードした当該第２のビット・グループを、デコードされた前
    記第２のトランスポート・チャネルとして用いるステップと、 を有し、 前記第１のトランスポート・チャネルをデコードする前記ステップ、および、
    前記第２のビット・グループをデコードする前記ステップは、同一の方向に行わ
    れることを特徴とする方法。
  6. 【請求項６】 前記第１のトランスポート・チャネルのデコード後で、前記
    第２のビット・グループのデコード前に、前記第１の長さのみの関数である第４
    の長さを有する第３のトランスポート・チャネルをデコードするステップを更に
    有することを特徴とする請求項５に記載の方法。
  7. 【請求項７】 前記第１のトランスポート・チャネルおよび前記第２のビッ
    ト・グループの両方のデコード後に、第３のトランスポート・チャネルをデコー
    ドするステップを更に有することを特徴とする請求項５に記載の方法。
  8. 【請求項８】 前記第３のトランスポート・チャネルは、前記第１の長さの
    みの関数である第４の長さを有することを特徴とする請求項７に記載の方法。
  9. 【請求項９】 前記第３のトランスポート・チャネルは、前記第１および第
    ２の長さの両方の関数である第４の長さを有することを特徴とする請求項７に記
    載の方法。
  10. 【請求項１０】 通信システムにおける固定ビット長のフレーム内にデータ
    を多重化する方法であって、 合わせて第１のビット数を有する１または２以上のトランスポート・チャネル
    の第１のグループを送信するステップと、 前記第１のグループの１または２以上のトランスポート・チャネルに係る、第
    ２のビット数を有する第１の誤り検出ビットを送信するステップと、 合わせて第３のビット数を有する１または２以上のトランスポート・チャネル
    の第２のグループを送信するステップと、 合わせて第４のビット数を有する１または２以上のトランスポート・チャネル
    の第３のグループを送信するステップと、 第５のビット数を有する制御チャネルを選択的に送信するステップと、 を有し、 前記制御チャネルは、前記第１のグループおよび前記第１の誤り検出ビットの
    送信後で、前記第３のグループの送信後に送信され、 前記制御チャネルが前記フレームの一部として送信されるときには、前記第１
    、第２、第３、第４、第５のビット数の和が前記固定ビット長に等しく、 前記制御チャネルが前記フレームの一部として送信されないときには、前記第
    １、第２、第３、第４のビット数の和が前記固定ビット長に等しい、 ことを特徴とする方法。
  11. 【請求項１１】 前記制御チャネルは、前記第１の誤り検出ビットと前記第
    ２のグループとの間で送信されることを特徴とする請求項１０に記載の方法。
  12. 【請求項１２】 前記制御チャネルは、前記第２のグループと前記第３のグ
    ループとの間で送信されることを特徴とする請求項１０に記載の方法。
  13. 【請求項１３】 前記第５のビット数のビットには前記制御チャネルに係る
    誤り検出ビットが更に含まれることを特徴とする請求項１０に記載の方法。
  14. 【請求項１４】 通信システムにおける固定長のフレームとして受信した多
    重化データをデコードする方法であって、 前記フレームに含まれる１または２以上のトランスポート・チャネルの第１の
    グループの第１の長さを求め、当該第１のグループをデコードするステップと、 前記第１の長さの関数である第２の長さを有する第２のビット・グループをデ
    コードするステップと、 前記第２のビット・グループに当該第２のビット・グループに係る誤り検出ビ
    ットが含まれているか否かを判定するステップと、 前記第２のビット・グループに係る誤り検出ビットが前記フレームに含まれて
    いるときに、前記第１および第２の長さの関数である１または２以上のトランス
    ポート・チャネルの第２のグループの第３の長さおよび開始位置を求め、当該第
    ２のグループをデコードするステップと、 前記第２のビット・グループに当該第２のビット・グループに係る誤り検出ビ
    ットが前記フレームに含まれていないときに、デコードした当該第２のビット・
    グループを、デコードされた前記第２のグループとして用いるステップと、 を有し、 前記第１のグループをデコードする前記ステップ、および、前記第２のビット
    ・グループをデコードする前記ステップは、同一の方向に行われることを特徴と
    する方法。
  15. 【請求項１５】 前記第１のグループのデコード後で、前記第２のビット・
    グループのデコード前に、前記第１の長さのみの関数である第４の長さを有する
    、１または２以上のトランスポート・チャネルの第３のグループをデコードする
    ステップを更に有することを特徴とする請求項１４に記載の方法。
  16. 【請求項１６】 前記第１のグループおよび前記第２のビット・グループの
    両方のデコード後に、前記第３のグループをデコードするステップを更に有する
    ことを特徴とする請求項１４に記載の方法。
  17. 【請求項１７】 前記第３のグループは、前記第１の長さのみの関数である
    第４の長さを有することを特徴とする請求項１６に記載の方法。
  18. 【請求項１８】 前記第３のグループは、前記第１および第２の長さの両方
    の関数である第４の長さを有することを特徴とする請求項１６に記載の方法。
  19. 【請求項１９】 通信システムにおける固定ビット長のフレーム内にデータ
    を多重化する装置であって、 第１のビット数を有する第１のトランスポート・チャネルを送信するように構
    成されたロジック手段と、 前記第１のトランスポート・チャネルに係る、第２のビット数を有する第１の
    誤り検出ビットを送信するように構成されたロジック手段と、 第３のビット数を有する第２のトランスポート・チャネルを送信するように構
    成されたロジック手段と、 第４のビット数を有する第３のトランスポート・チャネルを送信するように構
    成されたロジック手段と、 第５のビット数を有する制御チャネルを選択的に送信するように構成されたロ
    ジック手段と、 を備え、 前記制御チャネルは、前記第１の誤り検出ビットの送信後で、前記第３のトラ
    ンスポート・チャネルの送信前に送信され、 前記制御チャネルが前記フレームの一部として送信されるときには、前記第１
    、第２、第３、第４、第５のビット数の和が前記固定ビット長に等しく、 前記制御チャネルが前記フレームの一部として送信されないときには、前記第
    １、第２、第３、第４のビット数の和が前記固定ビット長に等しい、 ことを特徴とする装置。
  20. 【請求項２０】 前記制御チャネルは、前記第１の誤り検出ビットと前記第
    ２のトランスポート・チャネルとの間で送信されることを特徴とする請求項１９
    に記載の装置。
  21. 【請求項２１】 前記制御チャネルは、前記第２のトランスポート・チャネ
    ルと前記第３のトランスポート・チャネルとの間で送信されることを特徴とする
    請求項１９に記載の装置。
  22. 【請求項２２】 前記第５のビット数のビットには前記制御チャネルに係る
    誤り検出ビットが更に含まれることを特徴とする請求項１９に記載の装置。
  23. 【請求項２３】 通信システムにおける固定ビット長のフレームとして受信
    した多重化データをデコードする装置であって、 前記フレームに含まれる第１のトランスポート・チャネルの第１の長さを求め
    、当該第１のトランスポート・チャネルをデコードするように構成された第１の
    デコード・ロジック手段と、 前記第１の長さの関数である第２の長さを有する第２のビット・グループをデ
    コードするように構成された第２のデコード・ロジック手段と、 前記第２のビット・グループに当該第２のビット・グループに係る誤り検出ビ
    ットが含まれているか否かを判定するように構成された判定ロジック手段と、 前記第２のビット・グループに係る誤り検出ビットが前記フレームに含まれて
    いるときに、前記第１および第２の長さの関数である第２のトランスポート・チ
    ャネルの第３の長さおよび開始位置を求め、当該第２のトランスポート・チャネ
    ルをデコードする第１の処理を行うように構成されたロジック手段と、 前記第２のビット・グループに係る誤り検出ビットが前記フレームに含まれて
    いないときに、デコードした当該第２のビット・グループを、デコードされた前
    記第２のトランスポート・チャネルとして用いる第２の処理を行うように構成さ
    れたロジック手段と、 を備え、 前記第１のトランスポート・チャネルおよび前記第２のビット・グループは、
    同一の方向にデコードされることを特徴とする装置。
  24. 【請求項２４】 前記第１のトランスポート・チャネルのデコード後で、前
    記第２のビット・グループのデコード前に、前記第１の長さのみの関数である第
    ４の長さを有する第３のトランスポート・チャネルをデコードする第３の処理を
    行うように構成されたロジック手段を更に備えることを特徴とする請求項２３に
    記載の装置。
  25. 【請求項２５】 前記第１のトランスポート・チャネルおよび前記第２のビ
    ット・グループの両方がデコードされた後に、第３のトランスポート・チャネル
    をデコードする第３の処理を行うように構成されたロジック手段を更に備えるこ
    とを特徴とする請求項２３に記載の装置。
  26. 【請求項２６】 前記第３のトランスポート・チャネルは、前記第１の長さ
    のみの関数である第４の長さを有することを特徴とする請求項２５に記載の装置
    。
  27. 【請求項２７】 前記第３のトランスポート・チャネルは、前記第１および
    第２の長さの両方の関数である第４の長さを有することを特徴とする請求項２５
    に記載の装置。
  28. 【請求項２８】 通信システムにおける固定ビット長のフレーム内にデータ
    を多重化する装置であって、 合わせて第１のビット数を有する１または２以上のトランスポート・チャネル
    の第１のグループを送信するように構成されたロジック手段と、 前記第１のグループの１または２以上のトランスポート・チャネルに係る、第
    ２のビット数を有する第１の誤り検出ビットを送信するように構成されたロジッ
    ク手段と、 合わせて第３のビット数を有する１または２以上のトランスポート・チャネル
    の第２のグループを送信するように構成されたロジック手段と、 合わせて第４のビット数を有する１または２以上のトランスポート・チャネル
    の第３のグループを送信するように構成されたロジック手段と、 第５のビット数を有する制御チャネルを選択的に送信するように構成されたロ
    ジック手段と、 を備え、 前記制御チャネルは、前記第１のグループおよび前記第１の誤り検出ビットの
    送信後で、前記第３のグループの送信後に送信され、 前記制御チャネルが前記フレームの一部として送信されるときには、前記第１
    、第２、第３、第４、第５のビット数の和が前記固定ビット長に等しく、 前記制御チャネルが前記フレームの一部として送信されないときには、前記第
    １、第２、第３、第４のビット数の和が前記固定ビット長に等しい、 ことを特徴とする装置。
  29. 【請求項２９】 前記制御チャネルは、前記第１の誤り検出ビットと前記第
    ２のグループとの間で送信されることを特徴とする請求項２８に記載の装置。
  30. 【請求項３０】 前記制御チャネルは、前記第２のグループと前記第３のグ
    ループとの間で送信されることを特徴とする請求項２８に記載の装置。
  31. 【請求項３１】 前記第５のビット数のビットには前記制御チャネルに係る
    誤り検出ビットが更に含まれることを特徴とする請求項２８に記載の装置。
  32. 【請求項３２】 通信システムにおける固定長のフレームとして受信した多
    重化データをデコードする装置であって、 前記フレームに含まれる１または２以上のトランスポート・チャネルの第１の
    グループの第１の長さを求め、当該第１のグループをデコードするように構成さ
    れた第１のデコード・ロジック手段と、 前記第１の長さの関数である第２の長さを有する第２のビット・グループをデ
    コードするように構成された第２のデコード・ロジック手段と、 前記第２のビット・グループに当該第２のビット・グループに係る誤り検出ビ
    ットが含まれているか否かを判定するように構成された判定ロジック手段と、 前記第２のビット・グループに係る誤り検出ビットが前記フレームに含まれて
    いるときに、前記第１および第２の長さの関数である１または２以上のトランス
    ポート・チャネルの第２のグループの第３の長さおよび開始位置を求め、当該第
    ２のグループをデコードする第１の処理を行うように構成されたロジック手段と
    、 前記第２のビット・グループに当該第２のビット・グループに係る誤り検出ビ
    ットが前記フレームに含まれていないときに、デコードした当該第２のビット・
    グループを、デコードされた前記第２のグループとして用いる第２の処理を行う
    ように構成されたロジック手段と、 を備え、 前記第１のグループおよび前記第２のビット・グループは、同一の方向にデコ
    ードされることを特徴とする装置。
  33. 【請求項３３】 前記第１のグループがデコードされた後で、前記第２のビ
    ット・グループがデコードされる前に、前記第１の長さのみの関数である第４の
    長さを有する、１または２以上のトランスポート・チャネルの第３のグループを
    デコードする第３の処理を行うように構成されたロジック手段を更に備えること
    を特徴とする請求項３２に記載の装置。
  34. 【請求項３４】 前記第１のグループおよび前記第２のビット・グループの
    両方がデコードされた後に、前記第３のグループをデコードする第３の処理を行
    うように構成されたロジック手段を更に備えることを特徴とする請求項３２に記
    載の装置。
  35. 【請求項３５】 前記第３のグループは、前記第１の長さのみの関数である
    第４の長さを有することを特徴とする請求項３４に記載の装置。
  36. 【請求項３６】 前記第３のグループは、前記第１および第２の長さの両方
    の関数である第４の長さを有することを特徴とする請求項３４に記載の装置。
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