JP2003158187A - バッテリー電圧検出回路 - Google Patents

バッテリー電圧検出回路

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健 益子
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Abstract

(57)【要約】 【課題】 構造上多結晶シリコン膜抵抗体と半導体基板
間に構成される寄生容量を無くし、電池電圧の確実な検
出を可能なバッテリー電圧検出回路を提供する。 【解決手段】 多結晶シリコン膜抵抗体1直下の半導体
基板3に、ウエル6の様な半導体基板に対し絶縁する層
を設け、その電位を多結晶シリコン膜抵抗体1上の電位
や電池の検出動作に影響しない安定した電位とする。こ
れにより、構造上構成される寄生容量8をなくし、電池
電圧の確実な検出を可能とする。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】この発明は、直列に2個以上
接続された電池の各電池の電圧を監視するバッテリー電
圧検出回路に関する。
【0002】
【従来の技術】直列に少なくとも2個以上接続された電
池の各電池の電圧を監視する従来のバッテリー電圧検出
回路としては、図2に示す回路ブロック図のように、分
圧回路,電圧検出回路,制御回路で構成されるバッテリ
ー電圧検出回路が知られている。バッテリー電圧検出回
路に使う分圧回路としては、低コストで低消費電流を実
現するために、シート抵抗値の高い多結晶シリコン膜抵
抗体を用いるのが一般的である。
【0003】従来の多結晶シリコン膜抵抗体は、図3の
構造断面図に示すように、半導体基板3の表面に絶縁膜
2を形成した上に多結晶シリコン膜抵抗体1を形成する
構成とすることで実現している。
【0004】
【発明が解決しようとする課題】図3に示すような従来
の多結晶シリコン膜抵抗体は、半導体基板3がN型の場
合には半導体基板3を最高の電位に、半導体基板3がP
型の場合には半導体基板3を最低の電位にする必要があ
る。従って、図2に示すバッテリー電圧検出回路におい
ては、それぞれバッテリー電圧検出回路の電源であるV
DD端子電圧、バッテリー電圧検出回路のコモンである
VSS端子電圧を基板電圧供給端子4に印加する。
【0005】しかし、図3に示す多結晶シリコン膜抵抗
体では、構造上絶縁膜2を介し多結晶シリコン膜抵抗体
1と半導体基板3との間に、寄生容量8が付加してしま
うため、図2に示すバッテリー電圧検出回路において、
電池21,22の電圧が一定でも、電源であるVDD端
子あるいはコモンであるVSS端子の電圧変動がある
と、寄生容量8により多結晶シリコン膜抵抗体で構成さ
れる分圧回路23,24の出力電圧を変動させ、これに
電圧検出回路25,26が反応し、誤検出や誤解除を出
力してしまうという問題があった。
【0006】
【課題を解決するための手段】そこで、本発明は従来の
このような問題を解決するため、バッテリー電圧検出回
路の分圧回路に使用される多結晶シリコン膜抵抗体にお
いて、絶縁膜をはさんで多結晶シリコン膜抵抗体と反対
側の半導体基板上に、半導体基板に対し絶縁される層で
あるウエルを設ける。更に、ウエルの電位を多結晶シリ
コン膜抵抗体上と同じ電位あるいは安定した電位とす
る。これにより、半導体基板と多結晶シリコン膜抵抗体
の間の寄生容量を無くし、電源であるVDD端子あるい
はコモンであるVSS端子の電圧変動により、誤検出や
誤解除をしてしまう問題を解決するものである。
【0007】
【発明の実施の形態】
【0008】
【実施例1】図1は本発明での実施例の多結晶シリコン
膜抵抗体の構造断面図である。図2は本発明での実施例
のバッテリー電圧検出回路の回路ブロック図である。以
下にこの発明の実施例を図1,2に基づいて説明する。
【0009】まず本実施例のバッテリー電圧検出回路の
構成を、図2を使って説明する。直列に接続された電池
21,22のそれぞれに分圧回路23,24が接続さ
れ、それぞれ分圧された電圧を電圧検出回路25,26
で監視し、それぞれの電圧検出結果を、制御回路27を
介して出力することで、電池の電圧が所定の電圧でなく
なったことを検出している。
【0010】次に、バッテリー電圧検出回路の分圧回路
23,24に使われる多結晶シリコン膜抵抗体の構成を
図1により説明する。半導体基板3は一般にN型またはP
型があり、それぞれ回路で使われる最高の電位または最
低の電位とする必要がある。そのため、半導体基板3の
電位から絶縁するために薄い絶縁膜2を形成し、その上
に多結晶シリコン膜抵抗体1を形成する構成としてい
る。半導体基板3の最高の電位および最低の電位は、図
2のバッテリー電圧検出回路の場合、電源VDD端子お
よびコモンVSS端子となる。
【0011】次に、本発明の実施例について、具体的に
説明する。バッテリー電圧検出回路である図2に使われ
ている分圧回路23,24および電圧検出回路25,2
6は、それぞれの電池21,22の負側電極を基準とす
る。これにより、それぞれ検出する電池の変化以外の影
響をキャンセルしている。しかし、一般に分圧回路2
3,24に使われる多結晶シリコン膜抵抗体は、抵抗値
を高くし消費電流を小さくするために大きな面積を要す
る。また、絶縁膜2はコストアップを考えるとあまり厚
くできない。従って、半導体基板3と多結晶シリコン膜
抵抗体1の間に問題となる寄生容量が構成されてしま
う。そのため、電源VDD電圧またはコモンVSS電圧
が変動すると、寄生容量により多結晶シリコン膜抵抗体
で構成される分圧回路23,24の電圧を変動させるた
め、電源VDDまたはコモンVSSの電圧変動が影響し
てしまう。本発明は多結晶シリコン膜抵抗体の構成断面
図1に示すように、半導体基板3がN型の場合はP型の不
純物層であるウエル6、半導体基板3がP型の場合はN型
の不純物層であるウエル6を、絶縁膜2をはさんで多結
晶シリコン膜抵抗体1と反対側の半導体基板3上に形成
する。更に、分圧回路23の多結晶シリコン膜抵抗体の
場合はウエル電圧供給端子7を電池21の負側電極に接
続、分圧回路24の多結晶シリコン膜抵抗体の場合はウ
エル電圧供給端子7を電池22の負側電極に接続する。
これにより、半導体基板3と多結晶シリコン膜抵抗体1
の間に構成される寄生容量を殆ど無くし、バッテリー電
圧検出回路においてそれぞれ検出する電池の変化以外の
影響をキャンセルすることが可能となる。
【0012】尚、バッテリー電圧検出回路図2の分圧回
路23,24で使用している抵抗数の制限はなく、また
各抵抗にそれぞれウエルを設けなければならない制限も
ない。又、複数の抵抗に対して1つのウエルを設けても
同様の効果があることは明白である。更に、抵抗の種類
は多結晶シリコン膜抵抗体以外のものを用いても本発明
にかかる効果を奏する事ができる。
【0013】又、多結晶シリコン膜抵抗体の構成断面図
1のウエル6の電位は、各電池の負側電極に接続してい
るが、各電池の正側電極に接続しても同様に適応でき
る。
【0014】又、多結晶シリコン膜抵抗体の構成断面図
1のウエル6の電位を、多結晶シリコン膜抵抗体の取出
し端子に接続しても同様に適応できる。
【0015】又、多結晶シリコン膜抵抗体の構成断面図
1のウエル6の電位を、電池の検出動作に影響しないよ
うな電圧源に接続しても同様に適応できる。
【0016】又、バッテリー電圧検出回路図2に使われ
ている電圧検出回路25は、電池21の負電極側である
Sense2端子を基準としているが、電池21の正電
極側であるSense1端子を基準としても同様であ
り、電圧検出回路26は、電池22の負電極側であるS
ense3端子を基準としているが、電池22の正電極
側であるSense2端子を基準としても同様に適応で
きる。
【0017】又、バッテリー電圧検出回路図2で検出し
ている電池の数は、電池21と電池22の2個である
が、3個以上の構成であっても同様に適応できる。
【0018】
【発明の効果】本発明は以上に説明した様に、バッテリ
ー電圧検出において、バッテリー電圧検出回路の電源で
あるVDD端子電圧あるいはコモンであるVSS端子電
圧の変動などの影響を無くし、電池電圧の確実な検出が
可能となるという効果がある。
【図面の簡単な説明】
【図1】本発明に係る多結晶シリコン膜抵抗体の構造断
面を示した図である。
【図2】本発明で適応されるバッテリー電圧検出回路の
ブロックを示した図である。
【図3】従来の多結晶シリコン膜抵抗体の構造断面を示
した図である。
【符号の説明】
1 多結晶シリコン膜抵抗体 2 絶縁膜 3 半導体基板 4 基板電圧供給端子 5 多結晶シリコン膜抵抗体取出し端子 6 ウエル 7 ウエル電圧供給端子 8 寄生容量 21,22 電池 23,34 分圧回路 25,26 電圧検出回路 27 制御回路

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】 直列に2個以上接続された電池の電圧を
    監視するバッテリー電圧検出回路において、 前記電池の電圧を所定の比率で分割する分圧回路と、 前記分圧回路で分圧された電圧を監視する電圧検出回路
    と、 前記電圧検出回路から出力された電圧検出結果を出力す
    る制御回路と、を備えており、 前記分圧回路は、半導体基板上の絶縁層上に載置された
    抵抗体を有し、前記抵抗体の下層の半導体基板中には、
    前記半導体基板とは異なる型の不純物層が設けられてお
    り、前記不純物層の電位が、安定した電源の電位に接続
    されていることを特徴とするバッテリー電圧検出回路。
  2. 【請求項2】 前記分圧回路の前記抵抗体の下層の前記
    半導体基板上に設けられた前記不純物層の電位が、前記
    抵抗体の一部の電位に接続されていることを特徴とする
    請求項1に記載のバッテリー電圧検出回路。
  3. 【請求項3】 前記抵抗体が、多結晶シリコン膜抵抗体
    から成ることを特徴とする請求項1又は2に記載のバッ
    テリー電圧検出回路。
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