JP2003037080A - 半導体素子用の金属配線の後処理方法 - Google Patents

半導体素子用の金属配線の後処理方法

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JP2003037080A JP2002187600A JP2002187600A JP2003037080A JP 2003037080 A JP2003037080 A JP 2003037080A JP 2002187600 A JP2002187600 A JP 2002187600A JP 2002187600 A JP2002187600 A JP 2002187600A JP 2003037080 A JP2003037080 A JP 2003037080A
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Abstract

(57)【要約】 【課題】 本発明はアルミニウム酸化膜を金属配線
の保護層として使用することによって金属配線の信頼度
を増進させることができる半導体素子用の金属配線の後
処理方法を提供する。 【解決手段】 本発明は基板上に任意のパターンで形成
された金属配線を後処理する方法において、蒸着工程を
遂行して金属配線が形成された基板の全面に所定の厚さ
のアルミニウムを形成する工程と、所定の工程条件下で
プラズマ処理を遂行することによって、アルミニウムを
アルミニウム酸化膜でなされた下部障壁層に変化させる
工程と、及び蒸着工程を遂行して下部障壁層の上部全面
にわたり層間絶縁層を形成する工程とを含む半導体素子
用の金属配線の後処理方法を提供する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明はアルミニウム酸化膜
を金属配線の保護層として使用することによって金属配
線の信頼度を増進させることができる半導体素子用の金
属配線の後処理方法に関するものである。
【0002】
【従来の技術】公知のように、半導体素子を製造するこ
とにおいては多様な形態の金属配線(例えば、アルミニ
ウム合金等)を形成するためのパターニング工程を必要
とするが、アルミニウム合金を任意のパターンで蝕刻し
て金属配線を形成する典型的な蝕刻工程としてはプラズ
マを利用する乾燥式蝕刻工程などがある。
【0003】一方、基板上に形成された金属配線は時定
数などを補償することができるように後処理工程を通じ
て金属配線間誘電体(Inter Metal Dielectric:IMD)に
より埋めたてされるが、このような金属誘電体としては
比較的に誘電率が低いフッ素ドーピングシリコングラス
(Fluorine doped Silicon Glass:FSG)が主に利用され
ている。
【0004】他の一方、フッ素ドーピングシリコングラ
ス(FSG)の主成分であるフッ素(F)は腐食性ガスとして
金属と接触する場合に金属蝕刻(Metal Etching)を誘発
させる。したがって、誘電率を下げるためにフッ素成分
を増加させれば深刻な金属腐食の現象が生じるようにな
り、これによって半導体素子の信頼性が低下される問題
がある。
【0005】したがって、従来には金属配線上にFSGを
塗布する前に保護膜(FSGの下部層)として、一例として
図1から図3に図示したように、TEOS酸化膜またはHDP
USG(High Density Plasma Undoped Silicon Glass)を使
用している。
【0006】図1から図3は従来方法によって金属配線
の後処理工程を遂行する過程を図示した工程順序図であ
る。図1を参照すれば、基板102上に任意のパターンを
有する金属配線104を形成する。一例として図2に示す
ように、時定数を減らすために金属配線間誘電体(IMD)
材料としてFSGを形成する前に、所定の厚さの保護膜106
を形成する。この時、保護膜106としてTEOS酸化膜また
はHDP USGが使用されている。
【0007】続いて、蒸着工程を遂行することにより、
一例として図3に図示されたように、保護膜106の上部
全面にわたりフッ素ドーピングシリコングラス(FSG)108
を形成することによって、基板102上に形成された金属
配線104に対する後処理を完了し、このように形成され
たFSGを通じて時定数遅延を補償するようになる。
【0008】
【発明が解決しようとする課題】しかし、前述したよう
に従来方法は保護膜として使用されるTEOS酸化膜または
HDP USGの絶縁性が多少落ちるという問題があり、FSGに
含有されたフッ素(F)の拡散を確実に遮断できないため
に金属配線が腐食されることにより配線の信頼度を低下
させる問題があって、異質物質(TEOS酸化膜またはHDP U
SGと金属物質)間のストレスに起因する配線の信頼度低
下の問題がある。
【0009】
【課題を解決するための手段】本発明は前記した従来技
術の問題点を解決するためのものであり、前記目的を達
成するための本発明の一形態は、基板上に任意のパター
ンで形成された金属配線を後処理する方法において、蒸
着工程を遂行して前記金属配線が形成された基板の全面
に所定の厚さのアルミニウムを形成する工程と、所定の
工程条件下でプラズマ処理を遂行することによって、前
記アルミニウムをアルミニウム酸化膜でなされた下部障
壁層に変化させる工程と、及び蒸着工程を遂行して前記
下部障壁層の上部全面にわたり層間絶縁層を形成する工
程とを含む半導体素子用の金属配線の後処理方法を提供
する。
【0010】前記目的を達成するための本発明に係る他
の形態は、基板上に任意のパターンで形成された金属配
線を後処理する方法において、蒸着工程を遂行して前記
金属配線が形成された基板の全面に所定の厚さのアルミ
ニウム酸化膜でなされた下部障壁層を形成する工程と、
及び蒸着工程を遂行して前記下部障壁層の上部全面にわ
たり層間絶縁層を形成する工程とを含む半導体素子用の
金属配線の後処理方法を提供する。
【0011】本発明の前記及びその他の目的と色々な長
所はこの技術分野に熟練された人々により添付された図
面を参照して下記に記述される本発明の望ましい実施例
からさらに明確にされる。
【0012】
【発明の実施の形態】以下、添付された図面を参照して
本発明の望ましい実施例に対して詳細に説明する。ま
ず、本発明の核心技術の要旨は、金属配線の保護層でTE
OS酸化膜またはHDPUSGを使用する前述した従来技術とは
異なり、絶縁性が優秀でフッ素の拡散を確実に抑制する
ことのできる金属配線と類似系列の物質であるアルミニ
ウム酸化膜(Al)を使用するということで、この
ような技術的手段を通じて本発明で目的とするところを
容易に達成することができる。
【0013】図4から図6は本発明による金属配線の後
処理のために金属配線が形成されたウェーハ上に後続工
程を遂行する過程を図示した工程順序図である。図4を
参照すれば、基板202上に任意のパターンを有する金属
配線204を形成する。一例として図5に示すように、時
定数を減らすためにIMD材料としてFSGを形成する前に、
化学気相蒸着(CVD)または物理気相蒸着(PVD)の方法で金
属配線204の上部全面にわたり下部障壁物質としてAlを
所定の厚さ(例えば、80ないし150Å程度、望まし
くは100Å)程度を蒸着する。
【0014】続いて、所定の工程条件下でOまたはN
Oでプラズマ処理を遂行することによって下部障壁物
質(Al)をアルミニウム酸化膜(Al)でなされた下
部障壁層206に変化させる。
【0015】この時、金属配線204上に形成されるアル
ミニウム酸化膜(Al)は、TEOS酸化膜またはHDP
USGに比べて、絶縁性が優秀で、後続する工程を通じて
下部障壁層206上に形成される層間絶縁層208に含有され
たフッ素(F)の拡散を確実に抑制することができ、金属
配線204とのストレスを誘発させない。
【0016】次に、蒸着工程を遂行することにより、一
例として図6に示すように、下部障壁層206の上部全面
にわたりフッ素ドーピングシリコングラス(FSG)208を形
成することによって、基板202上に形成された金属配線2
04に対する後処理を完了し、このように形成されたFSG
を通じてRC遅延を補償するようになる。
【0017】一方、本実施例ではアルミニウム(Al)を蒸
着した後にプラズマ処理を通じて金属配線の上部に下部
障壁層として機能するアルミニウム酸化膜(Al)
を形成するものとして説明したが、本発明は必ずこれに
限定されるものではなく、化学気相蒸着方法を通じて金
属配線上に直接アルミニウム酸化膜(Al)を形成
することができ、このような方法を通じて実質的に同一
な結果を得ることができる。
【0018】
【発明の効果】以上、説明したように本発明によれば、
金属配線の保護層としてTEOS酸化膜またはHDP USGを使
用する前述した従来技術とは異なり、絶縁性が優秀でフ
ッ素の拡散を確実に抑制することができて金属配線と類
似系列の物質であるアルミニウム酸化膜(Al)を
金属配線の保護のための下部障壁層として使用すること
によって、絶縁性の確保はもちろんフッ素の拡散を確実
に抑制することができ、金属配線とのストレスを減少さ
せることができるために金属配線の信頼度を効果的に増
進させることができる。
【0019】以上では本発明を実施例によって詳細に説
明したが、本発明は実施例によって限定されず、本発明
が属する技術分野において通常の知識を有するものであ
れば本発明の思想と精神を離れることなく、本発明を修
正または変更できるであろう。
【図面の簡単な説明】
【図1】従来方法による金属配線の後処理工程の一工程
を示す工程順序図である
【図2】従来方法による金属配線の後処理工程の一工程
を示す工程順序図である
【図3】従来方法による金属配線の後処理工程の一工程
を示す工程順序図である
【図4】本発明による金属配線の後処理の、金属配線の
形成されたウェーハ上に対する後続工程の一工程を図す
工程順序図である
【図5】本発明による金属配線の後処理の、金属配線の
形成されたウェーハ上に対する後続工程の一工程を図す
工程順序図である
【図6】本発明による金属配線の後処理の、金属配線の
形成されたウェーハ上に対する後続工程の一工程を図す
工程順序図である
【符号の説明】
102、202 基板 104、204 金属配線 106 保護膜 108 フッ素ドーピングシリコングラス 206 保護層 208 層間絶縁層
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 FI テーマコート゛(参考) H01L 21/88 A Fターム(参考) 4M104 BB02 DD86 DD89 EE05 EE16 HH20 5F033 HH08 PP06 PP15 QQ89 RR03 RR11 SS11 XX18 XX19 XX24 XX28 5F058 BD01 BD04 BD05 BD06 BF73 BJ02

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】 基板上に任意のパターンで形成された金
    属配線を後処理する方法において、 蒸着工程を遂行して前記金属配線が形成された基板の全
    面に所定の厚さのアルミニウムを形成する工程と、 所定の工程条件下でプラズマ処理を遂行することによっ
    て、前記アルミニウムをアルミニウム酸化膜でなされた
    下部障壁層に変化させる工程と、及び蒸着工程を遂行し
    て前記下部障壁層の上部全面にわたり層間絶縁層を形成
    する工程とを含むことを特徴とする半導体素子用の金属
    配線の後処理方法。
  2. 【請求項2】 前記アルミニウムの厚さは、80ないし
    150Åの範囲を有することを特徴とする請求項1に記
    載の半導体素子用の金属配線の後処理方法。
  3. 【請求項3】 前記プラズマ処理は、OまたはN
    を使用することを特徴とする請求項1に記載の半導体素
    子用の金属配線の後処理方法。
  4. 【請求項4】 基板上に任意のパターンで形成された金
    属配線を後処理する方法において、 蒸着工程を遂行して前記金属配線が形成された基板の全
    面に所定の厚さのアルミニウム酸化膜でなされた下部障
    壁層を形成する工程と、及び蒸着工程を遂行して前記下
    部障壁層の上部全面にわたり層間絶縁層を形成する工程
    とを含むことを特徴とする半導体素子用の金属配線の後
    処理方法。
JP2002187600A 2001-06-27 2002-06-27 半導体素子用の金属配線の後処理方法 Pending JP2003037080A (ja)

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KR20080062022A (ko) * 2006-12-29 2008-07-03 동부일렉트로닉스 주식회사 플래쉬 기억 소자의 형성 방법

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5943549A (ja) * 1982-09-03 1984-03-10 Fujitsu Ltd アルミニウム配線層の形成方法
KR0121862B1 (ko) * 1990-11-13 1997-11-11 문정환 금속배선 형성방법
KR0155847B1 (ko) * 1995-07-13 1998-12-01 김광호 반도체소자 배선형성방법
KR20010027379A (ko) * 1999-09-13 2001-04-06 윤종용 금속배선 보호막을 구비하는 반도체 장치 및 그 제조방법
JP2001168101A (ja) * 1999-11-29 2001-06-22 Texas Instr Inc <Ti> 窒化アルミニウム障壁を形成する方法
US6503330B1 (en) * 1999-12-22 2003-01-07 Genus, Inc. Apparatus and method to achieve continuous interface and ultrathin film during atomic layer deposition
KR100371932B1 (ko) * 2000-12-22 2003-02-11 주승기 알루미늄막 또는 산화알루미늄막의 형성방법
US6596133B1 (en) * 2001-06-14 2003-07-22 Cvc Products, Inc. Method and system for physically-assisted chemical-vapor deposition

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