JP2002526804A - 低誘電率反射防止被膜に用いるシリコンカーバイドの堆積 - Google Patents
低誘電率反射防止被膜に用いるシリコンカーバイドの堆積Info
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Abstract
Description
プロセス形態のもと、有機シラン類を用いて低誘電率(低κ)である低κ反射防
止膜として用いられるシリコンカーバイドフィルムを生成するための低温法に関
する。
年にわたって見られてきた。この成功の進展の一つのキーは、集積回路(IC)装
置のデバイス間を連結する導電路を与える多層間接続技術である。形態の寸法縮
小は、現在は1/4サブミクロンあるいはより小さい範囲であり、超大規模集積
(VLSI)や極超大規模集積(ULSI)技術における、水平相互接続(通常、ライン
と呼ぶ)と垂直相互接続(通常、コンタクトあるいはバイアと呼ばれ、コンタク
トは下部層基板上のデバイスに伸び、一方バイアはM1,M2などの下部金属層に
伸びる)により、特に相互連結線の間の静電結合の減少という重要性が増してき
た。更に集積回路における半導体デバイスのスピードを更にあげるために、低抵
抗を有する導電性材料、及び近接する金属線間の静電容量を減らすために低κ(
誘電率7.0未満)の絶縁体を用いることが必要となってきた。低κ材料の必要
性はフォトリソグラフィに用いられるバリア層、エッチストップ、反射防止被膜
へと拡張している。しかし、通常のバリア層、エッチストップ、反射防止被膜材
料は、7.0よりかなり高い誘電率を有し、このため、殆ど誘電率を減少させる
ことのない結合絶縁体となっている。このように、低κ基板におけるバリア層、
エッチストップ、反射防止被膜のためのより良い材料が必要とされている。
えば、より精密度の高いパターンエッチングのためのフォトリソグラフィプロセ
スの改良への努力がなされている。フォトリソグラフィは光パターニングと、通
常は有機ポリマー(フォトレジスト材料)を用い、基板表面に精細規模のパター
ンを現像して集積回路を作る技術である。通常フォトレジスト材料には、たとえ
ば、ナフトキノンジアジド類がある。大抵の場合、基板をフォトリソグラフィに
より適切に加工するために、また不必要なパターンニングを避けるために、パタ
ーニングされる層の高い反射率は、光線の反射を減らすように改善されねばなら
ない。反射率は普通、公知の基準のパーセンテージとして表示される。たとえば
、生のシリコンは100%の数値を有する。下部層からの不要な反射は反射され
てフォトレジストに到り、望ましくない部分でフォトレジストを露光する。あら
ゆる、不必要な露光により形成するよう意図したライン、バイア及びその他の形
状が歪んでしまう。ダマシン構造における反射率によって、以下に論じるように
、よりよいフォトリソグラフィプロセスに対する必要性が増してきている。
不正確となってしまっている。誘電層はフォトレジストを露光するために用いる
紫外線に対して勿論透明である。このように、ダマシン構造における誘電体の多
層レベルでの利用は、不必要な反射を増加することになる。そのため、反射防止
被膜(ARC)がエッチングされる層の上に堆積される。ここでARCは薄い犠牲層で
あって、下置層より小さい反射率を持ち、下部層をエッチングするために用いる
化学薬品と同一あるいは類似の化学薬品によってエッチングされる。このARCはU
LSI回路に望まれる増加した電流密度を導くように、より向上した形状寸法と精
度がより緻密なスペースに入るように、不要な反射を減らすか除去している。
れているように、有機物でも無機物でもよい。有機ARCは薄膜化ポリイミド、ポ
リスルホン、その他材料であり、一般に無機材料より高価であり、より複雑な加
工を要する。無機ARC類には、窒化シリコン、酸窒化シリコン、α-炭素、窒化チ
タニウム、シリコンカーバイド、非晶性シリコンなどがある。本発明より以前は
、無機ARC類は通常高いκ値を特徴としていて、低κ構造とは適合しないもので
あった。高κARCの使用は、別の低κ層の積み重ねに高κ材料を付け加えている
際の低κ材料への変化の利点を部分的に否定している。ある用途においては、高
κARCは基板から除くことが出来るが、その除去のために処理が複雑になってし
まう。有機ARC類を用いることは可能であるが一般にかなり高価であり、追加の
加工工程を要する。
ジティブフォトレジストを有する基板の代表例を示している。ポジティブフォト
レジストは光に露光した部分に現像され、一方ネガティブフォトレジストは光露
光されない部分に現像される。集積回路10は、コンタクト、バイア、ライン、
トレンチのような形状11を有する下部基板12を含んでいる。本発明では、「
基板」の語を一つの下部材料を意味するものとして使用する。そして、バリア層
のようなその時問題とされる層の下に置かれた一連の下部層を示すときにも用い
る。バリア層13はこの基板の上に堆積されてもよい、ついでそれに誘電層14
が堆積される。この誘電層は非ドープシリコンガラス(USG)として知られる非
ドープニ酸化シリコン、フッ素ドープシリコンガラス(FSG)あるいはその他低
κ材料でもよい。本実施例では、ARC15を誘電体上に堆積し、ついで、フォトレ
ジスト層19を堆積した。
kは低κ誘電体のκと区別すること),及び該ARCの厚さ(t)を調整すること
によっていかなる反射光波長をも減少あるいは除去することであり、すなわち、
位相相殺と反射光吸収を作り出すことであるである。通常要求されるn,k,tの値
は、下部層の厚さと性質に依存し、それぞれの特別な用途に応じて調整する必要
がある。正/負レジスト光学リソグラフィモデルv.4.05のようなコンピューター
シミュレーションプログラムでは、n,k,tの値の効果、特定の層の反射率がシミ
ュレートされている。その結果を分析し、実際に試験を行い、走査型電子顕微鏡
(SEM)技術で結果を再検討する。様々な、n,k,tの値の組み合わせが選択され、
その用途における反射光が減少する。これらn,k,tの値はそれぞれの用途、それ
ぞれの基板の厚さに依存するので、適切な選択は時間のかかることであるし、厄
介なことである。更に、その選択は下部層の狭い厚さ範囲にのみにしか適用でき
ない可能性があり、基板から基板への堆積プロセスの繰り返しにおけるさらなる
問題の原因となり得る。第2図は、リソグラフィプロセスの模式図であり、公言
23が紫外線光などの光を光のパターンを決定するパターンニングされたテンプ
レート(マスク)21を通して放射し、そのパターンがフォトレジスト層19に投
影され、最後にはパターンニングされた基板が得られる。通常この光によって、
例えば紫外線が露光されたとき、その露光部分25内のフォトレジスト層が、有
機溶媒への溶解する。こうして、未露光部分を失わずに、露光部分はその露光部
分を浸漬、あるいはその他の除去方法によって除去される。
る基板の模式的図示である。フォトレジストの残り部分は除去され、その形状は
適切なレベルにエッチングされ、その基板は、ライナー、誘電体、導電体あるい
はその他の層の堆積などの、次のプロセスのために準備される。
密度を持ち、より精度の高いパターンエッチングが得られるように改善されてい
る。このように、現在いろいろな新しいプロセスが開発されている。たとえば、
回路形成の従来方法では、導電体の被覆層を堆積し、形状をパターンニングする
ようにその導電体をエッチングし、ついで誘電体材料でその形状を充填していた
。増加した回路密度で強調すべきことは、誘電体層を堆積したり、形状を形成す
るために誘電体層をエッチングすることや、バイア、ライナー、その他の形状を
形成するために、形状を導電体で充填することによって、そのプロセスが幾分逆
戻りしたということである。時流は、ダマシン構造を用いる方向である。デュア
ルダマシン構造では、誘電層は多層基板におけるコンタクト/バイア及び相互接
続ラインのいずれをも決定するようにエッチングされる。ついで、決定されたパ
ターンに金属が充填され、余分な金属はすべて、化学機械研磨(CMP)のような
平面化プロセスでその構造の表面から除去される。
力なスキームが、ダマシン構造を現像するために用いられ、そこでは、ライン/
トレンチがバイア/コンタクトと、同時に充填される。「カウンタボア」スキー
ムでは、集積回路10は、一つの下部基板12を含み、これはその上に堆積され
た一連の層を含んでもよいし、その中に形状11が形成されていてもよい。バリ
ア層13は該基板の上に堆積され、ついで誘電層14が堆積される。通常Ta、Ta
N、Ti、TiNあるいはその他の材料であるライナー22は必要なこともある。誘電層
は非ドープシリコンガラス(USG)として知られている非ドープニ酸化シリコン
、また、フッ素ドープシリコンガラス(FSG)あるいはその他低κ材料でもよい
。α―C、α−FC、パリレン、AF4、BCB、PAE、酸窒化物、あるいはシリコンカー
バイドなどの低κエッチストップ16は、該誘電層14上に、約200Åから約
1000Åの厚さに堆積される。各エッチストップ材料は通常、エッチングされ
る誘電層にくらべて、遅いエッチングレートを有し、エッチングプロセスにおい
て、あらかじめ決定した深さに達することを保証できる、幾分かの自由度を持つ
ものである。ある優れた特徴を有するエッチングプロセスでは、こういったエッ
チストップ材は不要である。他の誘電層18は、エッチストップ16の上に、約
5、000Åから約10、000Åの厚さに堆積される。ARC15は第1図のARC
15のように、誘電層18の上に堆積され、ついでフォトレジスト層(図示せず
)が第1図に示したフォトレジスト層19のよう堆積される。フォトレジスト層
は露光され、在来のフォトリソグラフィにより、バイア/コンタクト20a用のパ
ターンを形成する。これらの層はフッ素、炭素、酸素イオンを用いるような在来
のエッチプロセスを用いて、エッチングされ、バイア/コンタクト20aが形成さ
れる、ついでフォトレジスト層が除去される。その他のフォトレジスト層が堆積
され、ライン/トレンチ20bをパターニングするように露光され、その層がエ
ッチングされ、ライン/トレンチ20bが形成される、ついでフォトレジスト層
が除去される。更に導電性材料20が、バイア/コンタクト20aとライン/トレン
チ20bの両方に同時に堆積される。一度導電性材料20がその形状に充填た時
に、次の一連の層を形成するときに、銅のような導電体の拡散を防ぐように、も
う1つのバリア層24を堆積してもよい。
メントコンタクト(SAC)である。このSAC法は、誘電層18の堆積の前に、エッチ
ストップ16の上にフォトレジスト層を堆積する以外はカウンタボアスキームと
同様である。エッチストップ16はエッチングされて、バイア/コンタクト20a
用のパターンが作られる。フォトレジスト層は除去され、ついで誘電層18とAR
C15がエッチ層の上に堆積され、ついで、ARC15の上に他のフォトレジスト層
が堆積される。フォトレジストは露光され、ライン/トレンチ20b用のパター
ンを形成し、バイア/コンタクト20aとライン/トレンチ20bの両方が同時に
エッチングされ、フォトレジスト層は除去される。導電性材料20、必要なら次
いで別のバリア層24が堆積される。これらの構造はデュアルダマシン構造の典
型的なものであって、特殊な用途のためには、以下に述べるような他のものがよ
り適切であるかも知れない。
させる要求が高まってきた。このような構造の以前は、エッチングされる層は典
型的には、露光する光に対して不透明な単一金属層上にあった。従って、下部層
からの不必要なフォトレジスト露光はフォトレジストの下の単一金属層にほぼ限
られていた。しかし、ダマシン構造やその他の構造に対しては、導電層の上に多
数の層が用いられ、多階層パターンニングが行われている。誘電層と導電層付近
のその他の層は露光する光を比較的透し、従ってより高いレベルからの反射によ
って上層のフォトリソグラフィプロセスが妨げられることになる。たとえば、ラ
インやバイア/コンタクトは基板において、異なったレベルにわたっている。異
なったレベルにある、異なった形状のからの反射光は、異なった反射光パターン
をフォトレジスト層に戻す結果となり、修正しない限り、上記のようなフォトレ
ジスト上に不必要な露光を引き起こすかもしれない。
使用、複雑なデュアルダマシン構造、新方法、新材料などが、向上したARC特性
を与えるために要求されている。窒化シリコン、酸窒化シリコンはARCのための
典型的材料であったが、比較的高い誘電率(7.0以上の誘電率)を持ち、相互
接続ラインの間で著しく電気静電結合を増加させる。電気静電結合はクロストー
ク及び/又は抵抗−容量(RC)遅延、すなわち貯蔵エネルギーを発散するに要す
る時間をもたらし、そしてこれはデバイス全体の性能を低下させる。更に、窒化
シリコン、酸窒化シリコンは本発明の材料に比較して、かなり拡散抵抗が低い。
力を認めているものもいた。しかし、本発明者の知見では、SiCを用いる適切なAR
C、バリア層、エッチストップを考え、開発したという資料は全くなかった。Foo
teらの米国特許番号5,710,067などには、ARCの形成についてシリコンカーバイド
に着目あるいは示唆している資料もある。本発明者の知見では、従来方法を用い
て製造されたシリコンカーバイドは、低κ構造における、新しいプロセスの要求
に効果的にマッチするものではなかった。たとえば、Ogawaらの米国特許番号5,5
91,566で開示された化学方法は、本発明に参考資料として包含されているが、シ
リコン、炭素、水素を原料として使用している。この、かなり従来的方法ではUL
SI目的、特にダマシン構造において重要であり、望まれる低いκよりも、高いκ
を与えるている。他の例としては、Careyらの米国特許番号5,360,491は本発明に
参考資料として包含されているが、β-SiCと呼ばれる結晶性シリコンカーバイド
への転換を要求している。
の米国特許番号4,532,150では、Endoは特殊な組成のSixC1-xについて言及してい
る、ここでxは基板表面上に製造されるSiCに対するもので0.2ないし0.9の正
の数である。Endoはバリア層、エッチストップあるいはARCとしてのSiCを開示し
ていない。その実施例におけるプロセスパラメーターは本発明の好適な、最も好
適なパラメーターを下回っている。本発明に参考資料として包含されているLabo
daの米国特許番号5,465,680は、CVDチャンバ内におけるSiCフィルムを開示して
いるが、約600℃以下の低温での製造には失敗している。他の例としては、本
発明に参考資料として包含されているBolzらの米国特許番号5,238,866では、メ
タン、シラン、ホスフィンを用い、血液となじみのよい医療分野用の水素化シリ
コンカーバイド被膜を創った。しかし、これらの引用例には、以下のプロセス形
態を有するSiCのバリア層、エッチストップあるいは低κARCとしての利用はまっ
たく含まれていない。
シン構造や、それぞれの用途に適切な数値のための実験を必要としないでn,k,値
及びSiC層の厚さを設定されたSiC材料、のためのシリコンカーバイドを用いる改
良されたプロセスが必要とされている。
いて、IC用途に適したARCを形成するのに有用な、シリコンカーバイドを堆積す
るプロセスを提供するものである。本材料は更に、バリア層、あるいはエッチン
グストップとしても利用でき、銅のような高拡散性導電体を用いる、複雑なダマ
シン構造にも利用できる。一定のプロセスパラメーターのもとでは、様々な厚さ
の下部層の上に一定の厚さのシリコンカーバイドを用いてもよい。通常は所定の
反射率を得るために、各下部層の厚さに対してシリコンカーバイドARCの厚さの
調整が必要であるのに対して、該シリコンカーバイドARCでは所定の反射率を得
るために、その厚さは下部層の厚さにほとんどに依存しない。基板の上にシリコ
ンカーバイド反射防止被膜を形成するための、好適なプロセスの手順は、シリコ
ン、炭素、希ガスをプロセスチャンバの反応域に導入し、反応域にプラズマを発
生させ、該シリコンと該炭素をプラズマの存在下に反応させシリコンカーバイド
を形成し、チャンバ内の基板上にシリコンカーバイド反射防止被膜を堆積させる
ことを備える。本発明の他の態様は、基板上に堆積された誘電層、及び約7.0
より小さい、より好ましくは6.0あるいはそれ以下の誘電率を有するシリコン
カーバイド反射防止被膜を備えるシリコンカーバイド反射防止被膜を有する基板
を含む。
できるように、上記に簡単に要約した本発明のより特別な説明が、付帯した図面
に例示したような実施例を参照することによって与えられる。
その範囲を制限するものとは考えないるべきではない、というのは、本発明はそ
の他の同等に有効な実施を含むものであるからである。
るSiC材料を提供する。この材料は、バリア層及び/又は、エッチストップとして
用いられ、特に導電材料として高拡散性の銅を用いるIC用のバリア層及び/又は
、エッチストップとしても用いられる。本発明はSiCの製造に必要ないかなるそ
の他の炭素源、あるいは水素源とは無関係であり、酸素が実質的量に存在しない
状態でシリコンとしての有機シランと炭素源を用いることを含むプロセス形態を
提供する。このプロセス形態は、また、ヘリウムあるいはアルゴンのような希ガ
スの存在を含み、一定の温度、圧力、本発明のSiCを製造するためのプラズマ励
起気相堆積チャンバにおける出力を含む。この特殊なSiC材料は特にダマシン構
造のような複雑な構造に有用だろう。
に説明するように、多くの目的に用いられる得る。第1表は本発明のSiCの少な
くともARC、バリア層、エッチストップなどの3種の利用の望ましい態様を示し
た。
れた用途ごとの調整や変更を必要としないでこの被膜が多目的用途に用いられる
ための望ましい性質には、その他の数値は選択できるにせよ、このARCが約5%
以下の低い反射率を得るための、吸収率「k」とARCの厚さ「t」とが結合した
適切な屈折率「n」とともに、上記のような低κ範囲が含まれるだろう。 この
SiCを製造するプロセスは工業生産の一貫性のための安定性と再現性がなければ
ならない。
き誘電体と銅のような導電体の間でバリア層としても機能し得る。このように、
バリア特性は、そのような場面で重要であろう。層間の接着は、層間剥離を抑え
、ある場合には、層間の容量や抵抗を減少させるために重要である。このARCが
バリアとして用いられるとき、その材料はアニ−ル温度、たとえば400℃−4
50℃で、基板での実質的な拡散があってはならない。「実質的にない」拡散の
語は機能的用語であって、その層への実際の拡散が、バリア層やエッチストップ
として機能する層の能力に影響するよりも小さいということを意味している。た
とえば、本発明の該SiCはその拡散を約250Åに抑えている。銅の拡散は望ま
しい電流、電圧通路を阻害し、クロストークの一因となる。形状の縮小のために
、上述のように、誘電率が低いほど、好ましくは7.0より小さいと、クロスト
ークや、デバイスの全体的性能を低下させるRC遅延の可能性は低くなる。
(誘電率は7.0に等しいかあるいはそれより大きい)、のそれより低い誘電率
を有する材料であると定義する。低誘電率値に関してはその「有効」誘電率をい
い、これは多階層の基板の合成誘電率である。有効誘電率は層の厚さ、層の誘電
率、形状間の空間、形状の寸法のような因子に基づいている。Avant社の「Rafae
l」のような、市販のソフトウエアは、予測有効誘電率を計算するのに使用でき
る。たとえば、低κ誘電層の数値は通常約2.7である。あるSiNは約7.0のκ
値を持つ。このSiN材料を低κ材料とともに用いると、その合成物の有効κ値は
増加し、低κ誘電材料を用いることによるいくつかの利点は帳消しになる。これ
にくらべて、本発明のκ値が5より小さい、好ましくは約4.2のSiCの使用に
よって、すでに得られている低κ材料を用いて得られた以上の利益が得られる。
合成物の構造に対して、望ましい有効誘電率値は約5.0あるいはそれ以下、最
も好ましくは3.0あるいはそれ以下である。
2つの用途を持つARCやエッチストップとして機能するので、USG、FSG、あるい
は他の低κ誘電材料に比較して、20対1、あるいはそれより大きいエッチ選択
率を有し、適切なエッチストップ性能をも持つことは有利なことである。更に、
該材料はすなわち分子崩壊が電流の有害な通過を引き起こす電圧傾斜である2MV
のあるいはそれ以上の高い破壊電圧を持つべきである。このSiCは更に、その層
を通る低い漏電性能をも持つべきで、すなわち、この材料に容量的に流れる低い
漂遊直流を有する。
ズマチャンバのような所定のチャンバ内、あるいは集積クラスターツールアレン
ジメントのようなある系中で、この材料の堆積がその場で実行出来るということ
が望ましい特徴である。この点は、酸化に対して迅速に反応する銅導電体につい
ては重要なことである。
材料を得る200mmウエハ堆積反応器で用いられた、本発明のプロセスパラメ
ーターを示す。好適な実施例では、シリコンと炭素はシラン系化合物のような普
通の化合物から誘導された。しかし炭素はメタンのような、その他の化合物で補
うことも出来た。制限する訳ではないが、適切なシラン系化合物にはメチルシラ
ン(CH3SiH3),ヂメチルシラン((CH3) 2 SiH2 )、トリメチルシラン ((CH3 ) 3
SiH)、ジエチルシラン ((C2H5) 2 SiH2)、プロピルシラン (C3H8SiH3)、ビニル
メチルシラン ((CH2=CH)CH3SiH2)、1,1,2,2−テトラメチルジシラン(HSi
(CH3) 2-Si(CH3) 2H)、ヘキサメチルジシラン((CH3) 3Si-Si(CH3) 3)、1,1,
2,2,3、3−ヘキサメチルトリシラン (H(CH3) 2Si-Si(CH3) 2-SiH(CH3) 2)
、1,1,2,3,3−ペンタメチルトリシラン(H(CH3)2Si-SiH(CH3) -SiH(CH3 ) 2)、 その他のシラン関連化合物が含まれ得る。本発明の目的に対する、ここ
で用いる「有機シラン」の語はほかに指示しない限り、先のリストに含まれるよ
うな、少なくとも結合した1個の炭素原子を有するいかなるシランベース化合物
をも含む。第2表で用いられた化合物は、トリメチルシランとメチルシランであ
った。他のガスも用い得たが、ヘリウムあるいはアルゴンといった希ガスの存在
が、そのプロセスの安定化の助けになったようである。
トップと同様ARCの第1表の性質の少なくともいくつかに適合するSiC材料を提供
し得ることを発見した。このプロセス形態を用いた、該SiCは約7.0未満、好
ましくは6.0未満の低い誘電率を持つ。ここに記述した該SiCの性質で重要な
ことは、より薄い層を堆積させることができることである。本発明の有効基体誘
電率は約5.0あるいはそれ以下であろう。この有効誘電率は、上述した窒化シ
リコンとは対照的に、好適な銅ベースのICの要求に適合している。ARCの上部層
として、一実施例における該SiCは、SiCのARC厚さを調整する必要なく、下置き
誘電体層の厚さの幅広い範囲で使用可能である。また、ダマシン構造において、
本発明の該SiCは、通常のフォトリソグラフィにおいて、上層ARC層なしに、エッ
チストップとARCの組み合わせとして用いられる得る。この特殊なSiC材料はまた
、低κ、エッチストップ材料として使用するのに好適である。低κ材料はここで
は、窒化シリコンの誘電率(7.0あるいはそれ以上の誘電率)より低い誘電率
を有する材料として定義される。低κエッチストップ材料はここでは窒化シリコ
ンより低い誘電率を有し、かつ誘電材料に対しての相対的酸素対エッチ選択率が
20対1あるいはそれ以上である材料として定義される。この比率によりエッチ
ングプロセスを通して、高度のコントロールが可能となり、ダマシン構造のよう
な特に複雑な構造をエッチングする際に特に有用である。更に、本発明の該SiC
材料は銅に対する高い拡散抵抗を有し、試験データは銅拡散限度は約200ない
し250Åであることを示している。ある実施例では、第15図、第16図に示
すように、このARCは、エッチストップなしでARCとしての機能を果たすバリア層
であってもよい。
に、トリメチルシランやメチルシランのようなシリコン源を、プラズマ反応器へ
、すなわちトリメチルシランやメチルシランをこの技術の当業者にとっては公知
の「シャワーヘッド」であるガス分散要素と基板の間の、そのチャンバ内の反応
域に供給する。 代表的市販品であるSanta Clara, California のApplied Mater
ials社によって製造されたようなプラズマ励起化学気相堆積(PECVD)チャンバ
に対し、約30ないし500基準立方センチメーター(sccm)のシリコン源
の流量が用いられた。この市販のPECVDチャンバの構造と操作はよく知られてい
て、本発明のプロセス形態にとって説明は不要である。この炭素はトリメチルシ
ランやメチルシランから誘導され、その他炭素源とは無関係である。反応は反応
域に導入される実質的酸素源なしに起こる。シリコン源及び炭素源とともに、ヘ
リウムやアルゴンのような希ガスが約100ないし2000sccmの流量でチ
ャンバ内へと流される。チャンバ内圧力は約3ないし10Torrに保たれる。単一
の13.56MHz RF電源が出力密度約0.67−1.55watt/ cm2で約300な
いし700ワットを、シランべ−スガスの入ったチャンバ内にプラズマを形成す
るよう陽極、陰極へ印加する。基板表面温度は、SiCの堆積の間中、約200−
400℃に維持される。「シャワーヘッド」などのガス分散要素からのガス分散
は約300ないし600milsの間の空間距離で基板に対して分散される。
、トリメチルシランやメチルシランの流量は、約50〜200sccmに調整さ
れ、ヘリウムやアルゴン流量は約200〜1000sccmに、室内圧力は約6
〜10Torr、そのRF電力は、出力密度約0.88〜1.33watts/cm2で約400
〜600ワットに、基板表面温度は約300〜400℃に、シャワーヘッドと基
体間隔は約300〜400milsに調整される。
容れられているシリコンカーバイドの特性と異なっている。これらのパラメータ
ーにおいては、以下に述べるように、また第5図に示したように、第6図に示し
た従前のSiCとは別のある種の異なった結合構造が、本発明の該SiCには起こって
いる。チャートはフーリエ変換赤外分光チャート(FTIR)であるが、結合構造を
示す標準的実験室試験の一つであって、この技術の当業者にとっては公知のもの
であろうから説明は不要だろう。各波数における各種ピークは構造特有のもので
、このグラフは、特別な格子間結合構造を示すものである。
ラメーター範囲で、トリメチルシランを用いた堆積によって、CH2/CH3,SiH, SiC
H3 ,Si-(CH2)n 及びSiCを含む結合構造が得られた。第6図はシランとメタンを用
いた、従来のSiC材料についての比較結果を示している。そこには、見れば判る
ようにSi-(CH2)nに対応するピークがなく、SiCH3のピークすらも顕著に現れてい
ない。本発明の該SiCは、従来公知のSiC堆積より、よりよいARC/バリア層/エッ
チストップ性能をもたらすといった、予期しなかったような結果を得てきた。こ
れら特性によって、このSiCはここに開示するような多様な機能に用いられ得る
。
果の一つのグラフであり、標準的な633nm波長の光の露光を与えて、異なる
材料でのそれらの屈折率と誘電率の関係を比較している。このx軸は上記したよ
うな屈折率nを示している。x軸の低い数値は好ましく、よりよい光学的性質と
透光性を与える。y軸は誘電率を示している。y軸の低い数値は「低κ」基板積
層を作るのにふさわしい。たとえば、典型的SiN は約2.0のn値を有し、7
.3の誘電率を有し、低κ用途には向いていない。現状での最先端技術のARCはD
ARCTMであって、酸窒化シリコンの一つのタイプであるが、その誘電率は約8.5
〜9.0、248nm波長の露光で約2.2のn値を持つ。本発明の好適なSiCは約
4.2の誘電率を有する。
用いた試験結果に対応するSiC#1は、上述のように、メタン/エタン/プロパン
を別々に、それと2原子水素をシランとともに用いている。このSiCは約2.4の
n値を有し、誘電率は約7.8であり、低κ装置の堆積には望ましいものではな
い。この従来型SiCのプロセスパラメーターを変化させて得た内部試験結果では
、ここに述べたような本発明の薬品に変えて得られたような結果を得ることはつ
いに出来なかった。
、誘電率は約5.1で、これは上記従来プロセスで製造されたSiC#1よりはるか
によい。上述の第2表に記した最適パラメーターを用いて作ったSiC#3はよりよ
い光学的性能を与え、すなわち、第6図の633nmの露光波長で約1.9のn
値、約4.2の誘電率を生み出す。従って、光学的性質と抵抗率的に、本発明の
該SiCは低κ構造について現在強調されているものに好適であり、バリア層、エ
ッチストップと同様ARCとして利用出来る。重要なことは、本発明の該SiCは従来
の高κSiCとくらべて、層の堆積の低κ性能を保つためにフォトレジストが露光
され、エッチングされた基板の層から除去する必要がないので、より少ないプロ
セスステップですむことである。
8nmの露光を用い吸収率kと屈折率nとを対比させたグラフで、本発明の該Si
Cのn及びk値は酸窒化シリコンARCに比べて調整できることを示している。酸窒
化シリコンARCは約70oの急な傾斜を持ち、約9の高い誘電率や、nの僅かな変
化に対してkの急速な増加のために、n、kのいずれもコントロールすることが
困難になっている。比較のために本発明の約4.5の誘電率を持つSiCはグラフ上
約35°のより平坦な上向きの傾斜の曲線を示し、これはグラフ上nの増加は、
それに応じた僅かなkの増加を生むもので、よりコントロールしやすいプロセス
であることを示している。高い吸収率は不要な反射をよりよく吸収することから
好適なものであるが、高い吸収率を得るためには、上向きの線の傾斜が示すよう
に、誘電率は増加する。 このように、特に望ましい実施のためには、好適な光
学的特性と誘電率との間には, 一定のバランスがある。 実験を通して、本発明
者らは、本発明の該SiCについて適切な数値は、すなわち相対的に低い誘電率を
持ち、安定なプロセス形態であり、第8図の露光波長248nmでnが約2.2
、kが約0.4であるこのSiCは最適なものの1つであると確信している。この
グラフにおいて、この露光波長248nmでのnとkの間の関係は直線的に見え
る。そして、ここに開示したプロセスパラメーターを用いた下記の式によって近
似される。
囲で変化し、一般には約0.3〜約1.0の範囲である。上式は本発明の該SiCの
nとkの特性を代表するもので、他の露光波長に対する変換は容易である。第8
図のx軸の値のところから始まる該SiCのn,k関係の傾斜は、約20°〜約60°
で変化し、ここでは傾斜は約35°として示している。
SiCはほぼ同じn,k値を有することである。別の言い方をすれば、本発明の該SiC
を使用すれば、酸窒化シリコンARCの光学的性質に近く、かつ誘電率を50%減
らせるということである。低κ堆積層において、その差は重要である。
の模式図である。誘電層60はコンタクト62を有し、それは銅材料でもよい。
約500Åの厚さのSiCのバリア層64はコンタクト62及び、誘電層60の上
に堆積される。厚さ約5000ÅのUSG層などの誘電層66は、バリア層の上に
堆積される。エッチストップ68もまた約500Åの厚さのSiC材料であり、誘
電USG層の上に堆積され、更にもう1つの誘電層70を堆積させる、これは厚さ約
7000ÅのUSG材料でよい。この実施例では、厚さ約600ÅのSiCのARC72
を、先のUSG層の上に堆積する。ついで、フォトレジスト層74を堆積する。図1
から図3に示したように、フォトレジストはマスクを通して露光され、不要な部
分を洗い落とす。層はエッチングされて、形状が作られ、更に、ライナー、バリ
ア、導電層などの層が堆積される。その厚さ、層の数、配置は変えることができ
、本実施例は一例である。
ュータシミュレーションプログラムを用い、層の厚さの異なった組み合わせに対
して目的の反射率値を示した反射率等高線のシミュレーショングラフである。
隣接する層の厚さに対する一つの層の厚さの反射率への影響を描いた反射率地形
図となる。第10図は、各等高線は最低2%反射率、最高16%反射率までを、
2%の増分ごとに描いたものである。この図で、x軸は下部層の厚さ、すなわち
第9図の誘電層70の厚さである。y軸はARCとして用いたSiCの厚さであり、第
9図のARC72に対応する。低誘電率を得る目的は、この例ではフォトレジスト
層とARC間の、フォトレジスト界面での、基板からの不要な反射を最小限とする
ことである。理想的反射率の値は0%であるが、技術者はフォトリソグラフィプ
ロセスの再現性を保証するのに好適である、約5%以下の目標値に対し約7%以
下の反射率が商業的に受け入れられる結論である事がわかった。いくつかの実施
例では10%反射率が許容される一方、10%反射率は基板における現行の形状
寸法、密度について、典型的には現実的限界である。このように、もし下部層の
厚さが判っていてx軸上に選択されるならば、それに対応するy軸上の好適なARC
の厚さは、5%以下といった選ばれた反射率より低い反射率のARCを定めること
によって予測することが出来る。例えば、第10図の範囲76に示した厚さ約6
500Åないし約6750Åの誘電層が5%以下の反射率基準に合致するには約
200ÅのARCが必要と予測されるだろう。しかし、そのような狭い範囲の誘電
体堆積は、安定した生産をするには困難かもしれないし、層間回路の電気的絶縁
にたいするデバイス要求には適合しないかも知れない。更にその200Å層は、
もしたとえば、銅がエッチング後にARCに堆積されるとすれば、銅に対するバリ
ア層としては不十分かもしれない。このように光学的には、ARC層は充分なもの
であるが、上記したようなその他の特徴も考慮する必要があるかもしれない。こ
のような形状で、500Å厚いARCはこのグラフの誘電層厚さの範囲に亘って5
%未満の反射率となる。逆に、もし誘電層厚さが注意深く制御されるならば、そ
のARC層の厚さは更に可変又は最小化され得る。たとえば、誘電層厚さ約660
0Åプラスマイナス100Å、あるいは1.5%ならARCの厚さ50Å以上が得
られるだろうし、5%以下の反射率の光学パラメーターに適合できる。そして、
本発明のARCは、バリア層、エッチストップ、ARCを提供する多目的材料としての
要求を満たし、また単一ARC厚さが一定の反射率のための多層誘電層の厚さに関
する光学的要求に適合し得るものである。
の厚さを有する層は、誘電層厚さの全スペクトルに亘って最低の反射率の一つを
示す。重要なことには、本発明者らは本発明のSiCの独自な特性により、下部層
の厚さとは実質的無関係にARCが堆積できるということを発見したということが
ある。その範囲は、約500Åから約1000Å又はそれ以上、好適な厚さは約
600Åであり、予測反射率は約2%以下で、好適とされる5%範囲を下回る。
この発見は、ARC層のn、k及びt特性を、用途ごとに下部層の特定な厚さに対
し通常調整を要することと対照的である。すなわち、本発明のSiCの使用すれば
、ARCはその下部層の厚さに関係なく単に約600Åの一定の堆積でよいという
ことである。このグラフは、特殊な用途において有用であるとされた際に、その
他の適当な範囲についても有用に分析されるだろう。
積がエッチングされ、その形状が導電性材料で充填されると、ある種のプロセス
方法では、基板表面の上層を研磨して、過剰な導電性材料を除去し、上層を平面
化し、もし次の堆積を行うのならそれに備える。この分野ではよく知られらてい
るように通常、基板は化学機械研磨(ケミカルメカニカルポリシング:CMP)プ
ロセスによりポリシングされる。このCMPプロセスは、たとえばCMPプロセスが下
置き研磨抵抗層にぶつかるように、異なった材料における研磨速度の差を利用し
て研磨の限界を定める。本発明で、SiCのARC72はポリッシュストップとして使
用できる。このSiCのARCの低κ値のゆえに、ARCが通常は基板上に残り有効低κ
基板を維持するために除去する必要はない。このように、導電性材料が、このAR
Cの上に堆積されその形状を充填する。CMPプロセスはまた、SiC上の余分な導電
性材料あるいはその他材料を除去するのに用いられる。プロセスがSiCのARCにぶ
つかり、CMPプロセスが研磨速度の差を決定すると、CMPプロセスは停止される。
プロセスである。湿分は基板の回路を腐食するので、ある層には湿分抵抗性が必
要である。たとえば、もしSiCのARCをポリッシュストップとして使用し、更に上
部層として使用するのなら、SiCのARCは吸湿防止剤として機能するのが望ましい
。
堆積した、パターンニングされたフォトレジスト層74の断面を示している。第
11図は第9図に示した実施例のフォトリソグラフィの結果を示し、ARCはこの
フォトレジスト層堆積やフォトリソグラフィ処理に先立つ、基板の最上層として
考えられる。フォトレジスト層74中の線80の幅は約1/4ミクロンで、形状の
現状寸法を表している。本発明のSiCのARC72では、フォトレジスト層74のフ
ォトリソグラフィパターンニングが水平な直線82を形成したのであり、これは
ULSIにおける縮小された形状寸法に対して重要である。形状におけるフォト
リソグラフィパターンニングは均一で、直線的な、四角な側84を持っていた。
すなわち不要な光反射からの定常波効果のない、完全に露光された底部86と隅
に於ける丸い「基礎」が実質的にない四角な隅88であった。線間のフォトレジ
ストの幅90の最小、最大値の変化は5%以下であり、処理に対する標準的な許
容範囲内である。線から線への再現性も示してある。このパターンニングされた
フォトレジスト層の均一性は、上述の酸窒化シリコンARCなど、その他のARC材料
と異なり、本発明のSiCのARCが小型形状で低κ値を維持したフォトリソグラフィ
処理された基板を製造できることを示している。
ている。グラフをみれば、湿度試験結果の上の線は露光前のもので、露光後の湿
度試験結果の下方線から離れていることがわかる。この試験結果は、本発明のSi
CはCMPプロセスを通じて、吸湿防止剤として作用すること、そしてこれは吸湿防
止剤の様態を充分に満たしていることを示している。湿分レベルは特に、H-OHピ
ークである波数1640において注目され、これは実質的にまったく湿分を吸収
していないものと同じである。
する層間の本発明の該SiCの特性におけるARCとしての作用、ここでは誘電層66
と70の間のエッチストップ68に依存して行ったものである。その層と数は第
9図に示した配置に対応するが、違いはフォトレジスト層74の下にARC72が
ないことである。この実施例では、SiCエッチストップ68上の誘電層70の厚
さは、誘電層66と70の間のSiCエッチストップ68の厚さと関連して、目標
とされる反射率となるよう調整される。誘電層66の厚さは一定に保たれる。フ
ォトレジスト層74は上記のように露光される。バリア層64は約500Åでよ
い。しかし、基板は上部誘電層70の下にあるSiCエッチストップ68の反射及
び吸収性に依存する。このように、この二つの層の厚さは一定の目標とする反射
率に対して相互依存する。第14図に示したようにこのSiCエッチストップの厚
さの適切な選択によりこの配置は適正なものとなる。第14図は第13図の実施
例の反射率地図であり、エッチストップ68に対比した、上層誘電層70の厚さ
を示している。y軸は誘電層70の厚さであり、x軸はSiCエッチストップ68
の厚さである。これらの軸は第10図の反射率地図に比べると逆になっている。
それはこの実施例で、最上部層が誘電層70であるからである。第10図の議論
と同様に、その適切な厚さはたとえば約5%未満など所定の反射率比に対して選
べる。たとえば、エッチストップの厚さ約150Åプラスマイナス50Åは、第
14図にグラフで示した誘電層70に対するすべての要求を光学的に満足させ、
約5%未満の反射率を有する。しかし、150ÅのSiC層は銅のバリア層として
機能するには薄く、望ましくない。そのような、エッチング処理での制御因子、
バリア特性などの各因子は最終的にはエッチストップに対する適正な厚さや反射
防止被膜の光学的特性のために、別の厚さが必要かどうかを決めてもよい。
300Å厚さの最上部誘電層とともに使用することができる。この帯域では反射
率パターンは繰り返すので、図示されなかった他の厚さの層が用いられ、第14
図及び他の類似した図に示した厚さは商業的実施例で用いられる典型的なもので
ある。もし、例えば6%といったより高いレベルの反射率が許容されるなら、約
720Å厚さのエッチストップは第14図におけるグラフ化した厚さのすべてに
ついての反射率に対する光学的要求を満たすだろう。逆に、もし誘電層厚さが最
初に選ばれ、その結果としてエッチストップ厚さが決められたら、たとえば僅か
な許容範囲で、約6600Å厚さあるいは約7400Å厚さの誘電層は、反射率
が約5%以下の、厚さが約100Åないし約350Åのエッチストップとなるだ
ろう。形状の等高線を使い,他の値を決定してもよい。重要なことは、これらの
例は、エッチストップの厚さ、及びエッチストップに隣接する誘電層の厚さは、
SiCがARCとして機能するとき、目的の、あるいは選択された反射率に対する誘電
層の間にあるとき、互いに関連して考慮さるべきであるということである。
の誘電層の厚さに比較した、エッチストップの厚さを示している。ここでは、エ
ッチストップ68の下にある誘電層66は、目的の反射率のために、エッチスト
ップ68の厚さに関連して調整されている。ここで、誘電層70は、7000Å
といった厚さであり、一方、エッチストップ68と誘電層66の厚さは、特定の
反射率に対して決定される。第15図には、エッチストップ68は誘電層66に
対して上方層であるから、そのエッチストップ厚さはy軸上に表わされ、誘電層
66の厚さはx軸上に表わされる。たとえば、500ÅのSiCエッチストップに
ついては、反射率約5%以下を維持するには誘電層66の厚さは約4600Åな
いし約5400Åになるはずである。しかし誘電層66の厚さは、誘電層70の
異なる厚さに対して変えることができる。このように、種々のプロセス要求を満
たし、しかも約5%以下の、目標とする反射率を総合的に満足させる各誘電層の
厚さを見出すためには、反復解が必要となるかもしれない。
ア層64をARCとして用いている。あるプロセスにおいては、第9図の実施例の
上層ARC72は第13図に示したように使用しなくてもよい。更にその他のプロ
セスでは、第13図のエッチストップ68も第16図に示すように、使用しなく
てもよい。もし、エッチストップがなくなれば、基板処理はステップが少なくな
るため、そのスループットは増加し、基板のより低い有効誘電率が得られるだろ
う。エッチストップをなくす困難さは、通常の誘電層に、望ましくないエッチン
グを起さないようにするための、エッチングプロセスの再現性と、エッチングの
タイミングである。しかし、もしプロセスがうまく特性化され、充分に制御でき
るならば、エッチストップは不要となるだろう。層とその数は第9図及び第13
図に示した配列に対応するがフォトレジスト74の下にARC72がなく、エッチ
ストップ68もない、という違いがある。この実施例では、誘電層66の厚さは
、第2の誘電層のないことを補って増加し、回路は電気的に絶縁されるように約
10,000Åないし約12,000Åになるだろう。誘電層66の厚さは誘電
層66と誘電層60の間のSiCバリア層64の厚さとの関連で、目標とする反
射率に対して調整される。フォトレジスト74は上述のように露光される。しか
し、基板は誘電層66の下のSiCバリア層64の反射及び吸収特性に依存し、
二つの層の厚さは、選ばれた厚さ及び所望の反射率に、相互依存、無関係、付随
的などである。このSiCバリア層の厚さを適正に選択すると、第17図に示し
たように、この配列は適切なものとなる。
いた、SiCバリア層64に対比した誘電層66の厚さを示している。第17図
には誘電層66がこのバリア層の上にあるので、y軸は誘電層の厚さを、x軸は
バリア層の厚さを示している。回路を電気的に絶縁する誘電層の能力などのその
他パラメーターを考慮するので、誘電層の厚さは最初に選択され、バリア層の厚
さは、定められた反射率に対してこのグラフから決定される。ARCとして用い
られるSiCバリア層の好適な厚さは、本実施例では、エッチストップを挟まず
、約700Åないし約800Åである。この好適な厚さは、誘電層のグラフ化し
た厚さのすべてについて、予測した約5%あるいはそれ以下の、反射率を生む。
このように、本実施例においても、本発明の該SiCは誘電層の厚さに事実上無
関係なARC光学的結果を与える。
74の下にSiCARC72を付加したものである。第9図のエッチストップ6
8は第18図の実施例では用いられていない。そして、誘電層66は通常第9図
の分離誘電層より厚い。このSiCバリア層64は約500Åの厚さであるが、
その厚さは可変である。下記第19図に示すように、SiCのARC72の厚さ
が適切に選択されている時は、誘電層66の厚さはフォトレジスト層74の反射
率に大きな影響を与えることなく、変化させられ得る。しかし、誘電層66通常
約10,000Åないし約12,000Åの厚さとなる。
Cの下の誘電層の厚さに比較した、ARCの厚さを示している。第19図には、こ
のARC72の厚さがx軸上に示され、誘電層66の厚さがy軸上に示されている。
この反射率地図は、約520Åあるいはそれ以上の厚さのARCについては、グラ
フ化された誘電層66のいかなる厚さにおいても、約5%あるいはそれ以下の反
射率となることを示している。このSiCのARCの好適な厚さは約600Åである。
このパターンは他の反射率地図におけるように繰り返し、他の酸化物、及び/又
はSiC層の厚さが外挿によって決定される。ここで論議したその他の実施例と同
様に、本発明者らは本発明の該SiCの独自の性質について、特に目標とされる反射
率を得るために、隣接する層の厚さに事実上無関係に、ARCは堆積できるという
ことを見出した。ここで、本発明の該SiCを用いることで、約5%あるいはそれ
以下の目標の反射率を得るために、ARCは下部層の厚さに無関係に約600Åの
堆積厚さである。このグラフは、特殊な用途において有用であるとされた際に、
その他の適当な範囲について解析されるだろう。
接層から拡散を受けやすいく、該SiCはできるだけ拡散抵抗性でもあることが好
ましい。第20図は試験片の拡散試験の結果を示し、その下側の曲線は銅含量を
示し、本発明の該SiCのARCの銅への拡散抵抗を示している。この試験片は銅の2
00Åの層を持つある基板で、その銅の上にSiCの800Åの層が堆積されてい
て、そのSiCの上に酸化物の1000Åの層が堆積されている。y軸から見てみる
と、第20図は、酸化物の1000Å層の表面から0Åで、1立方センチメート
ルあたり原子約3×1017個(atoms/cc)の数値46をとり、この値は、銅の拡
散が著しくなる前の酸化層を通り、800ÅSiC層へ至るまでの合計深さ約15
70Åの間で約1×1016(atoms/cc)の値48にまで低下する。この銅の拡散
レベルは続く230Åの間に対数的に上昇し、銅から銅バリア界面までの間に約
3×1021(atoms/c)の値50になる。界面から200Åから約250Å内で
、銅の濃度はほぼ4桁、すなわち1/10,000にまで減少する。銅の拡散におけるこ
の減少は、本発明の該SiC材料の有効性を示すものである。
内で基板の位置決めをする基板ホルダ、及び真空システムを有する基板加工シス
テムを提供する。この加工システムは、真空チャンバの反応域に連結し、シラン
ベースの化合物、不活性ガスを供給するガス/液体供給システム、反応域でプラ
ズマを発生するためのガス供給システムに結合したRF発生器等を更に備える。加
工システムは、プラズマ反応器をコントロールするためのコンピュータ、ガス配
給システム、RF発生器、コントローラーに結合したメモリーを更に備え、該メモ
リは、シランベース化合物のプラズマで低誘電率のフィルムを堆積させるための
プロセスステップを選択する、コンピュータで読み取り可能なプログラムコード
などの媒体を備える。
ッチストップを堆積すること、別の誘電層を堆積すること、シランベース化合物
のキャッピングパッシベーション層を任意に堆積することといったプロセスステ
ップを選択するための、コンピュータで読み取り可能なプログラムコードを更に
備える。
て決定される本発明の基本的範囲を離れることなくその他の具体例や更なる具体
例を案出することができる。更に、特に特許請求の範囲を含めたこの明細書にお
いて、「備える」、「該」等の文言又はこれらの変形の文言の使用については、
言及された事項が列挙事項を少なくとも含んでいるという意味であり、特に別途
指摘しない限り列挙事項のうち複数の事項を含み得るという意味である。また、
方法については請求項を含めてあらゆる開示において論理的順序を示しているが
、特に別途指摘しない限り開示の論理的順序には制約されないものである。
様子を示す。
いろいろな指数値に調整できることを示している。
式図である。
ニングされたフォトレジスト層を示している。
である。
体層の厚さを示している。
さと比較した、エッチストップの厚さを示している。
替例である。
に比較した、バリア層の上方にある誘電層の厚さを示している。
RCを付加したものである。
RCの厚さを示している
。
Claims (66)
- 【請求項1】 シリコンカーバイド反射防止被膜を有する基板であって、 (a)該基板上に堆積された誘電層と、 (b)7.0より小さい誘電率を有する該シリコンカーバイド反射防止被膜と を備える基板。
- 【請求項 2】 該基板が約5以下の有効誘電率を有する請求項1に記載の
基板。 - 【請求項3】 該シリコンカーバイド反射防止被膜が、銅との界面からの銅
の拡散を界面から約300Å以下の範囲で約3桁まで抑えるものである請求項1
に記載の基板。 - 【請求項4】 シリコン源及び炭素源としての有機シランの流量を約30〜
約500sccm、希ガスの流量を約100〜約2000sccmで与えるステ
ップと、チャンバ内温度と基板表面温度が約200〜約400℃、約3〜約10
Torrの内部圧力にあるチャンバ内で、RF電源で約0.67〜約1.55ワ
ット/cm2の電力密度を該チャンバ内の陽極と陰極に供給して該シリコンと炭
素を反応させるステップとを備えるプロセスにより、該シリコンカーバイド反射
防止被膜が該チャンバを有するプラズマ反応器内で生成される請求項1に記載の
基板。 - 【請求項5】 該シリコンカーバイド反射防止被膜が吸収率と、屈折率と、
膜厚とを有し、更に、該率の組み合わせと該膜厚の組み合わせにより、該反射防
止被膜に隣接する誘電層の厚さに実質的に依存しない、約7%あるいはそれ以下
の反射率を有する反射防止被膜が基板に与えられる請求項1に記載の基板。 - 【請求項6】 (a)基板上に堆積された1つのバリア層と、 (b)該バリア層上に堆積された第1の誘電層と、 (c)該第1の誘電層上に堆積された1つのエッチストップと、 (d)該エッチストップに上に堆積された第2の誘電層と を更に備え、該シリコンカーバイド反射防止被膜は第2の誘電層上に堆積されて
いる請求項1に記載の基板。 - 【請求項7】 該シリコンカーバイド反射防止被膜の厚さは、反射率が約7
%以下になるように選択される請求項6に記載の基板。 - 【請求項8】 第2の誘電層が約5000〜約10,000Åの厚さの場合
に該シリコンカーバイド反射防止被膜の厚さが約7%以下の反射率を生ずるよう
に選択された厚さにある請求項7に記載の基板。 - 【請求項9】 該バリア層と、エッチストップと、反射防止被膜とが、7.
0より小さい誘電率を有するシリコンカーバイドを含む請求項8に記載の基板。 - 【請求項10】 (a)該基板上に堆積された1つのバリア層と、 (b)該バリア層上に堆積された第1の誘電層と、 (c)該第1の誘電層上に堆積された該シリコンカーバイド反射防止被膜と、 (d)該シリコンカーバイド反射防止被膜上に堆積された第2の誘電層と を更に備える請求項1に記載の基板。
- 【請求項11】 約7%以下の反射率になる厚さを有するように該反射防止
被膜が選択される請求項10に記載の基板。 - 【請求項12】 反射防止被膜を有する基板であって、 (a)上に堆積された1つのバリア層と、 (b)ア層上に堆積された第1の誘電層と、 (c)の誘電層上に堆積された1つのエッチストップと、 (d)エッチストップに上に堆積された第2の誘電層と、 (e)誘電層の厚さが約5000Å〜10,000Åである場合に、約7%以下
の反射率を生ずるように厚さが選択される反射防止被膜と を備える基板。 - 【請求項13】 該反射防止被膜が7.0より小さい誘電率を有する請求項 12に記載の基板。
- 【請求項14】 該反射防止被膜がシリコンカーバイドを含む請求項12に
記載の基板。 - 【請求項15】 該シリコンカーバイドが、有機シランから得られ、該有機
シランとは別の炭素あるいは水素源には依存しない請求項14に記載の基板。 - 【請求項16】 シリコン源及び炭素源としての有機シランの流量を約30
〜約500sccm、希ガスの流量を約100〜約2000sccmで与えるス
テップと、チャンバ内温度と基板表面温度が約200〜約400℃、約3〜約1
0Torrの内部圧力にあるチャンバ内で、RF電源により約0.67〜約1.
55ワット/cm2の電力密度を該チャンバ内の陽極と陰極に供給し、該シリコ
ンと炭素を反応させるステップとを備えるプロセスにより、該シリコンカーバイ
ドを含む反射防止被膜が、該チャンバを有するプラズマ反応器で生成される請求
項14に記載の基板。 - 【請求項17】 該基板が5以下の有効誘電率を有する請求項12に記載の
基板。 - 【請求項18】 反射防止被膜を有する基板であって、 (a)該バリア層上に堆積された第1の誘電層と、 (b)該第1の誘電層上に堆積されたシリコンカーバイド反射防止被膜と、 (c)該シリコンカーバイド反射防止被膜上に堆積された第2の誘電層と を備える基板。
- 【請求項19】 該シリコンカーバイド反射防止被膜が7.0より小さい誘
電率を有する請求項18に記載の基板。 - 【請求項20】 該第2の誘電層の下の該シリコンカーバイド反射防止被膜
が、第2の誘電層を通して約7%以下の反射率を生じる請求項19に記載の基板
。 - 【請求項21】 該シリコンカーバイドが有機シランから得られ、該有機シ
ランとは別の炭素あるいは水素源には依存しない請求項18に記載の基板。 - 【請求項22】 該シリコンカーバイドが有機シランから得られ、該有機シ
ランとは別の水素源には依存しない請求項21に記載の基板。 - 【請求項23】 シリコン源及び炭素源としての有機シランの流量を約30
〜約500sccm、希ガスの流量を約100〜約2000sccmの間で与え
るステップと、チャンバ内温度と基板表面温度が約200〜約400℃、約3〜
約10Torrの内部圧力にあるチャンバ内で、RF電源が約0.67〜約1.
55ワット/cm2の電力密度を該チャンバ内の陽極と陰極に供給し、該シリコ
ンと炭素を反応させるステップとを備えるプロセスにより、該シリコンカーバイ
ドが、該チャンバを有するプラズマ反応器内で生成される請求項18に記載の基
板。 - 【請求項24】 基板上にシリコンカーバイド反射防止被膜を形成する方法
であって、 (a)シリコン、炭素、希ガスをチャンバ内に導入することと、 (b)該チャンバ内にプラズマを発生させることと、 (c)該シリコンと該炭素を該プラズマの存在下に反応させてシリコンカーバイ
ドを形成することと、 (d)チャンバ内の該基板上に低誘電率のシリコンカーバイド反射防止被膜を堆
積させることと を備える方法。 - 【請求項25】 該シリコンが、シランを備える請求項24に記載の方法。
- 【請求項26】 該シリコンと炭素が共通の有機シランから誘導され、他の
炭素源には依存しない請求項24に記載の方法。 - 【請求項27】 該シリコンと炭素が共通の有機シランから誘導され、該プ
ラズマの存在下に該シリコンと該炭素を反応させて他の水素源の存在に依存せず
にシリコンカーバイドを形成させる請求項24に記載の方法。 - 【請求項28】 該シリコンと炭素が共通の有機シランから誘導され、該プ
ラズマの存在下に該シリコンと該炭素を反応させ、他の炭素源の存在には依存せ
ずにシリコンカーバイドを形成させる請求項24の方法。 - 【請求項29】 該シリコンカーバイド反射防止被膜が、吸収率、屈折率、
及び膜厚を有し、更に該率の組み合わせと膜厚により、該反射防止被膜に隣接す
る1つの誘電層の層厚さに実質的に依存しない、約7%以下の反射率を有する反
射防止被膜が基板に与えられる請求項24に記載の方法。 - 【請求項30】 該基板がダマシン構造を備える請求項29に記載の方法。
- 【請求項31】 約7%以下の該反射率が、該誘電層の厚さが約5000Å
〜約10,000Åである場合に生じる請求項29に記載の方法。 - 【請求項32】 該低誘電率が、7.0より小さい請求項24に記載の方法
。 - 【請求項33】 該シリコンカーバイド反射防止被膜の下の下部層が約50
00Å〜約10,000Åの厚さである場合に約7%以下の反射率を生ずるよう
に選択された厚さの反射防止被膜を選択することを更に備える請求項24に記載
の方法。 - 【請求項34】 (a)該基板上にバリア層を堆積することと、 (b)該バリア層上に第1の誘電層を堆積することと、 (c)該第1の誘電層上にエッチストップを堆積することと、 (d)該エッチストップ上に第2の誘電層を堆積することと、 (e)該第2の誘電層上にシリコンカーバイド反射防止被膜を堆積することと を更に備える請求項24に記載の方法。
- 【請求項35】 反射率が7%以下となるように反射防止被膜を選択するこ
とを更に備える請求項34に記載の方法。 - 【請求項36】 該第2の誘電層が約5000Å〜約10,000Åの厚さ
の場合に約7%以下の反射率となるように選択された厚さの反射防止被膜を選択
することを更に備える請求項35に記載の方法。 - 【請求項37】 該第2の誘電層がシリコンガラス材料を備える請求項36
に記載の方法。 - 【請求項38】 該バリア層、エッチストップ、及び反射防止被膜が7.0
より小さい誘電率を有するシリコンカーバイドを備える請求項34に記載の方法
。 - 【請求項39】 (b)該基板上にバリア層を堆積することと、 (c)該バリア層上に第1の誘電層を堆積することと、 (d)該第1の誘電層上にシリコンカーバイド反射防止被膜を堆積することと、 (e)該シリコンカーバイド反射防止被膜上に第2の誘電層を堆積する ことと を更に備える請求項24に記載の方法。
- 【請求項40】 7%以下の反射率を有する反射防止被膜を選択することを
更に備える請求項39に記載の方法。 - 【請求項41】 該反射防止被膜が7.0より小さい誘電率を有する請求項
40に記載の方法。 - 【請求項42】 該シリコンカーバイド反射防止被膜を約100〜450℃
の間の温度で堆積することを更に備える請求項24に記載の方法。 - 【請求項43】 該シリコンカーバイド反射防止被膜を約300〜400℃
の間の温度で堆積することを更に備える請求項24に記載の方法。 - 【請求項44】 約5より大きくない有効誘電率を有する基板を生成するこ
とを更に備える請求項24に記載の方法。 - 【請求項45】 銅界面からの銅の拡散を、界面から約300Å以下の範囲
で約3桁まで抑えるシリコンカーバイド反射防止被膜を生成することを更に備え
る請求項24に記載の方法。 - 【請求項46】 該シリコンと該炭素を反応させることが、約6〜10To
rrの間のチャンバ内圧を維持しつつ該シリコンと該炭素を反応させることを備
える請求項24に記載の方法。 - 【請求項47】 該シリコンと該炭素を反応させることが、約0.67〜約
1.55ワット/cm2の電力密度を該チャンバ内の陽極と陰極に供給するRF電
源を用いて該シリコンと該炭素を反応させることを含む請求項24に記載の方法
。 - 【請求項48】 該シリコン供給することが、シラン流量を約10〜約10
00sccmにすることを含み、更に、希ガスを供給することが、ヘリウム又はアル
ゴンを約50〜約5000sccmの流量で供給することを含む請求項24に記載の
方法。 - 【請求項49】 該シリコン、該炭素、該希ガス供給することが、該シリコ
ン、炭素源としての有機シリコンを約30〜約500sccmの間の流量で、希ガス
を約100〜約2000sccmの間の流量で、それぞれ供給することを含み、また
、チャンバ内温度と基板表面温度が約200〜約400℃、約3〜約10Tor
rの内部圧力範囲のチャンバ内で、RF電源で約0.67〜約1.55ワット/
cm2の電力密度を該チャンバ内の陽極と陰極に供給し、該シリコンと炭素を反
応させることを更に含む請求項24に記載の方法。 - 【請求項50】 目的の反射率のために、該第2の誘電層の厚さが、第1と
第2の誘電層の間のシリコンカーバイド反射防止被膜の厚さに関連して決められ
る請求項18に記載の基板。 - 【請求項51】 目的の反射率のために、該第1の誘電層の厚さが、第1と
第2の誘電層の間のシリコンカーバイド反射防止被膜の厚さに関連して決められ
る請求項18に記載の基板。 - 【請求項52】 目的の反射率のために、該第1の誘電層の厚さと、該第1
と第2の誘電層の間の該シリコンカーバイド反射防止被膜の厚さとを調整するこ
とを更に備える請求項39に記載の方法。 - 【請求項53】 目的の反射率のために、該第2の誘電層の厚さ、及び該第
1と第2の誘電層の間の該シリコンカーバイド反射防止被膜の厚さを調整するこ
とを更に備える請求項39に記載の方法。 - 【請求項54】 該反射防止被膜がバリア層を備える請求項24に記載の方
法。 - 【請求項55】 シリコンカーバイド反射防止被膜を有する基板であって、
(a)該基板上に堆積された誘電層と、 (b)48nmの露光波長に対して、kを吸収率、nを屈折率として、式k/0
.65+1.57=nの関係となるような、屈折率に関連する吸収率を有するシ
リコンカーバイド反射防止被膜と を備える基板。 - 【請求項56】 該kが約0.3〜1.0にある請求項55に記載の基板。
- 【請求項57】 該シリコンカーバイド反射防止被膜が7.0より小さい誘
電率を有する請求項55に記載の基板。 - 【請求項58】 該基板が約5以下の電率を有する請求項55に記載の基板
。 - 【請求項59】 有機シランを約30〜500sccmの間の流量でシリコン源
及び炭素源として供給し、また希ガスを約100〜2000sccmの間の流量で供
給するプロセスにより、該シリコンカーバイド反射防止被膜が生成される請求項
55に記載の基板。 - 【請求項60】 該シリコンカーバイド反射防止被膜が膜厚を有し、吸収率
及び屈折率の組み合わせと膜厚によって、該反射防止被膜に隣接する1つの誘電
層の厚さに実質的に依存せず、約7%以下の反射率を有する反射防止被膜が基板
に提供される請求項55に記載の基板。 - 【請求項61】 (a)上に堆積された1つのバリア層と、 (b)バリア層上に堆積された第1の誘電層と、 (c)第1の誘電層上に堆積された1つのエッチストップと、 (d)エッチストップに上に堆積された第2の誘電層と を更に備え、該シリコンカーバイド反射防止被膜は第2の誘電層上に堆積される
請求項55に記載の基板。 - 【請求項62】 (a)上に堆積された1つのバリア層と、 (b)バリア層上に堆積された第1の誘電層と、 (c)該第1の誘電層上に堆積された該シリコンカーバイド反射防止被膜と、 (d)該シリコンカーバイド反射防止被膜に上に堆積された第2の誘電層と を更に備える請求項55に記載の基板。
- 【請求項63】 (a)該基板上に堆積された1つのバリア層と、 (b)該バリア層上に堆積された第1の誘電層と を備え、該シリコンカーバイド反射防止被膜は該バリア層を更に備える請求項5
5に記載の基板。 - 【請求項64】 (a)該基板上に堆積された1つのバリア層と、 (b)該バリア層上に堆積された第1の誘電層と を更に備え、該シリコンカーバイド反射防止被膜は第1の誘電層上に堆積される
請求項55に記載の基板。 - 【請求項65】 (a)反射防止被膜を備えるバリア層を、基板に隣接して堆積すことと、 (b)該バリア層上に第1の誘電層を堆積することと、 (c)該第1の誘電層に隣接してフォトレジスト層を堆積することと を更に備える請求項24に記載の方法。
- 【請求項66】 (a)該基板に隣接してバリア層を堆積することと、 (b)該バリア層に隣接して第1の誘電層を堆積することと、 (c)該第1の誘電層に隣接して該反射防止被膜を堆積することと、 (d)該反射防止被膜に隣接してフォトレジスト層を堆積することと を更に備える請求項24に記載の方法。
Applications Claiming Priority (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US09/165,248 US20030089992A1 (en) | 1998-10-01 | 1998-10-01 | Silicon carbide deposition for use as a barrier layer and an etch stop |
US09/165,248 | 1998-10-01 | ||
US09/219,945 US6635583B2 (en) | 1998-10-01 | 1998-12-23 | Silicon carbide deposition for use as a low-dielectric constant anti-reflective coating |
US09/219,945 | 1998-12-23 | ||
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US09/270,039 US6974766B1 (en) | 1998-10-01 | 1999-03-16 | In situ deposition of a low κ dielectric layer, barrier layer, etch stop, and anti-reflective coating for damascene application |
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Publications (2)
Publication Number | Publication Date |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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Country Status (1)
Country | Link |
---|---|
JP (1) | JP4763131B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2002110644A (ja) * | 2000-09-28 | 2002-04-12 | Nec Corp | エッチング方法 |
JPWO2009153857A1 (ja) * | 2008-06-17 | 2011-11-24 | 富士通株式会社 | 半導体装置及びその製造方法 |
WO2017057233A1 (ja) * | 2015-09-30 | 2017-04-06 | 株式会社ニコン | 光学部材、チャンバ、及び光源装置 |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0851072A (ja) * | 1991-12-30 | 1996-02-20 | Sony Corp | レジストパターン形成方法および反射防止膜形成方法 |
JPH08250594A (ja) * | 1995-02-02 | 1996-09-27 | Dow Corning Corp | 炭化ケイ素の金属拡散障壁層 |
JPH08316233A (ja) * | 1994-06-21 | 1996-11-29 | Toshiba Corp | 半導体装置の製造方法 |
JPH10261707A (ja) * | 1997-03-18 | 1998-09-29 | Sony Corp | 半導体装置の製造方法 |
EP0880166A2 (en) * | 1997-05-07 | 1998-11-25 | Applied Materials, Inc. | Method and apparatus for depositing an etch stop layer |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3309572B2 (ja) * | 1994-05-31 | 2002-07-29 | ソニー株式会社 | 多層配線形成方法 |
JP3750231B2 (ja) * | 1996-11-20 | 2006-03-01 | ソニー株式会社 | 積層配線の形成方法 |
JP3150095B2 (ja) * | 1996-12-12 | 2001-03-26 | 日本電気株式会社 | 多層配線構造の製造方法 |
-
1999
- 1999-09-27 JP JP2000574964A patent/JP4763131B2/ja not_active Expired - Lifetime
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0851072A (ja) * | 1991-12-30 | 1996-02-20 | Sony Corp | レジストパターン形成方法および反射防止膜形成方法 |
JPH08316233A (ja) * | 1994-06-21 | 1996-11-29 | Toshiba Corp | 半導体装置の製造方法 |
JPH08250594A (ja) * | 1995-02-02 | 1996-09-27 | Dow Corning Corp | 炭化ケイ素の金属拡散障壁層 |
JPH10261707A (ja) * | 1997-03-18 | 1998-09-29 | Sony Corp | 半導体装置の製造方法 |
EP0880166A2 (en) * | 1997-05-07 | 1998-11-25 | Applied Materials, Inc. | Method and apparatus for depositing an etch stop layer |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2002110644A (ja) * | 2000-09-28 | 2002-04-12 | Nec Corp | エッチング方法 |
JPWO2009153857A1 (ja) * | 2008-06-17 | 2011-11-24 | 富士通株式会社 | 半導体装置及びその製造方法 |
WO2017057233A1 (ja) * | 2015-09-30 | 2017-04-06 | 株式会社ニコン | 光学部材、チャンバ、及び光源装置 |
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Publication number | Publication date |
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JP4763131B2 (ja) | 2011-08-31 |
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