JP2002134556A - 半導体実装構造 - Google Patents
半導体実装構造Info
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- JP2002134556A JP2002134556A JP2000321320A JP2000321320A JP2002134556A JP 2002134556 A JP2002134556 A JP 2002134556A JP 2000321320 A JP2000321320 A JP 2000321320A JP 2000321320 A JP2000321320 A JP 2000321320A JP 2002134556 A JP2002134556 A JP 2002134556A
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- chip
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Abstract
半導体実装構造の提供。 【解決手段】 ICチップ1上の回路が書き込まれた領
域3にバンプ4を形成し、実装基板5と機械的に接続す
ることにより、実装後のICチップ取り外し時にICチ
ップが外力により破損し、内部の回路や情報を判読不可
能とする。
Description
き込まれた情報の、再使用および、複製を防止する半導
体素子の実装構造に関する。
すことによって再使用され、または半導体チップ上の回
路パターンを読み取ることにより複製し、または改ざん
することが可能であった。
導体チップ接続装置において、従来は、半導体チップ
と、実装用基板の電気的接続および、機械的接続のうち
のいずれか、あるいは両方を目的とするものであった。
は半導体チップの電気的接続を目的とするパッド上に形
成されるものであり、半導体チップを取り外そうとする
外力によっては、回路として半導体チップ上に描き込ま
れた情報を、破壊することなく半導体チップを取り外す
ことが可能であった。
は半導体カードや磁気カード等の読み取り装置、および
書き込み装置、個人識別装置など、装置内に備えられた
情報によって、その機能が実現される装置は、その情報
の複製、改ざん等により、装置の機能の一部、または全
部が損なわれる可能性がある。
に内蔵される、半導体チップに回路パターンとして書き
込まれるが、従来の方法では、これら半導体チップを半
導体チップ上の情報を破壊することなく、半導体チップ
を実装用基板から取り外すことが可能であり、半導体チ
ップの再使用、または半導体チップ上の情報の複製、お
よび改ざん等が比較的容易に可能であり、不正利用によ
る損害が発生する可能性が存在する。これらを防止する
ためには、半導体チップまたは実装用基板などに、あら
かじめ特別な装置を具備する必要があり、そのことによ
り、装置の体積、重量が増加し、コストが上昇する。
に防止し、複雑な装置を用いず、装置の体積、重量等の
増加を伴わない方法が求められている。
半導体チップの実装工程と同時に実施でき、特別な装置
を具備する必要がない。
の回路の上部に、半導体チップ接続装置を設けることに
よって、半導体チップを取り外すために加えられた外力
が半導体チップ上の回路層にその外力が伝えられること
により、半導体チップ上の回路層を破壊することによっ
て、半導体チップの再使用および、半導体チップ上の情
報の複製および、改ざんを不可能にするものである。
ップのアクティブ領域にバンプを形成し、回路基板に実
装後、機械的に半導体チップを除去すると、半導体チッ
プが破壊し、チップ内部の回路パターン情報の解読やチ
ップ内部に書き込まれたデータの漏洩を防止することが
できる。
プのアクティブ領域と非アクティブ領域の両方にバンプ
を形成し、回路基板に実装することにより、半導体チッ
プの情報に関する機密を保持することが出来る。
態を図に基づき説明する。図1、図2は半導体チップの平
面図である。図3は半導体チップが実装用基板上に実装
された状態で、図2中のI-I断面図である。
おいて、その回路層3のうちの一部、もしくは全部を覆
うように、1つまたは複数のバンプ状接続部を電気的接
続のためのパッド上のバンプ状接続部と同時に、同様の
方法により作製し、実装用基板6と接続することによ
り、取り外そうとする物理的な外力が加えられた場合
に、バンプ4の存在によって半導体チップ1上の回路層3
に外力が伝えられ、半導体チップ上1の回路領域3が図4
に示すように破壊されることにより、再使用および、複
製、改ざんが不可能になる。
から利用されている、バンプ2と同じ材料により作成す
ることにより、同時に作成することが可能であり、特別
な手法を用いることなく作成することができ、専用の設
備等を必要としない。
によって溶解することが困難な貴金属等によって作成す
ることにより、化学的な処理等の化学的外力が加えられ
た場合にも、半導体チップ1を取り外すことが困難にな
り、また、その化学的外力により、半導体チップ1の回
路層3は腐食などによって破壊される。
る。
-I断面図である。
えた場合の状態を示した断面図である。
Claims (2)
- 【請求項1】 半導体チップと実装用基板からなり、前
記半導体チップを前記実装用基板上から取り外すための
外力によって、半導体チップ上の回路を破壊することを
特徴とした半導体実装構造。 - 【請求項2】 半導体チップのアクティブ領域にバンプ
を有し、実装用基板上に前記チップを実装する半導体実
装構造。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000321320A JP2002134556A (ja) | 2000-10-20 | 2000-10-20 | 半導体実装構造 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000321320A JP2002134556A (ja) | 2000-10-20 | 2000-10-20 | 半導体実装構造 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2002134556A true JP2002134556A (ja) | 2002-05-10 |
Family
ID=18799465
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000321320A Pending JP2002134556A (ja) | 2000-10-20 | 2000-10-20 | 半導体実装構造 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2002134556A (ja) |
-
2000
- 2000-10-20 JP JP2000321320A patent/JP2002134556A/ja active Pending
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