JP2002116730A - プラズマディスプレイの駆動方法 - Google Patents
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Abstract
ルスの幅も狭くてもアドレス放電が確実に発生するプラ
ズマディスプレイの駆動方法の実現。 【解決手段】 プラズマディスプレイの駆動方法であっ
て、1表示画面に相当する1表示フレームは複数のサブ
フレームを備え、点灯するサブフレームを組み合わせて
階調表示を行い、各サブフレームは、リセット期間と、
リセット期間の後表示セルの壁電荷を表示データに応じ
た状態に設定するアドレス期間と、点灯セルを選択的に
発光させるサステイン期間とを備え、リセット期間には
第1の電極と第2の電極間に、時間の経過と共に電圧が
変化する信号を印加するプラズマディスプレイの駆動方
法において、リセット期間に第1と第2の電極間に印加
されるリセット電圧差と、アドレス期間に第1と第2の
電極間に印加されるアドレス電圧差は、各サブフレーム
毎に任意に設定される。
Description
レイの駆動方法に関し、特に各表示フレームを複数のサ
ブフレームで構成し、点灯するサブフレームの組合せに
より階調表示するプラズマディスプレイの駆動方法に関
する。
自己発光型であるので視認性がよく、薄型で大画面表示
及び高速表示が可能であることから、CRTに替わる表
示装置として注目されている。図1は、PD装置の基本
構成を示す図である。
パネル(PDP)10では、X電極(第1の電極:サス
テイン電極)X1、X2、…とY電極(第2の電極:ス
キャン電極)Y1、Y2、…とを隣接して交互に配置
し、X及びY電極に垂直な方向にアドレス電極(第3の
電極)A1、A2、…を配置する。X電極とY電極の組
み、すなわち、X1とY1、X2 とY2、…の間に表示
ラインが形成され、各表示ラインとアドレス電極が交差
する部分に表示セル(以下、単にセルと称する。)が形
成される。
続され、同じ駆動信号が印加される。Y電極はそれぞれ
Yスキャンドライバ12に接続され、後述するアドレス
動作時には順次スキャンパルスが印加されるが、それ以
外の時にはYサステイン回路13により同じ駆動信号が
印加される。アドレス電極は、アドレスドライバ11に
接続され、アドレス動作時にはスキャンパルスに同期し
て、点灯セルと非点灯セルを選択するアドレス信号が印
加されるが、それ以外の時には同じ駆動信号が印加され
る。制御回路15は、上記の各部を制御する信号を出力
する。
を説明するためのフレームの構成を示す図である。プラ
ズマディスプレイの放電は、オン又はオフの2値の状態
しかとれないため、発光の回数を変えて階調を表現す
る。そのため、図2に示すように、1画面の表示に相当
する1フレームを、複数個のサブフレームに分割する。
各サブフレームは、リセット期間、アドレス期間、及び
サステイン期間より構成される。リセット期間では、前
のサブフィールドでの点灯状態にかかわらず、すべての
セルを均一な状態、例えば、壁電荷を消去した状態や壁
電荷が一様に形成されている状態にするための動作が行
われる。アドレス期間では、表示データに応じてセルの
オンやオフの状態を決定するために、選択的な放電(ア
ドレス放電)が行われ、オン状態のセルに次のサステイ
ン動作で放電して発光するのに必要な壁電荷が形成され
る。サステイン期間は、アドレス期間にオン状態に設定
されたセルで繰り返し放電を行わせ、発光させる。サス
テイン期間の長さ、つまり発光回数はそれぞれのサブフ
ィールドで異なっており、例えば、各サブフレームの発
光回数の比率を、1:2:4:8…という具合に設定
し、各セル毎に階調に応じて発光させるサブフレームを
組み合わせれば、階調表示が行える。
来の駆動方法の例を示す波形図である。図示のように、
リセット期間では、X電極に放電開始電圧以上の高い電
圧Vw、例えば300Vのパルスを印加する。このパル
スの印加によって、前のサブフィールドの点灯状態にか
かわらず、すべてのセルで放電が発生し、壁電荷が形成
される。次にこのパルスを取り去ると、壁電荷自体の電
圧によって再度放電を開始するが、電極間には電位差が
ないため、放電によって発生した空間電荷は中和して壁
電荷のない均一な状態が実現できる。アドレス期間にお
いては、Y電極にスキャンパルスを順次印加し、その表
示ラインの点灯させるセルのアドレス電極にはアドレス
パルス(アドレス信号)を印加して放電を行う。この放
電はX電極側にも広がり、X電極とY電極間には壁電荷
が形成される。このスキャンをすべての表示ラインに渡
って実行する。アドレス期間においては、アドレスパル
スを印加したセルでは放電が発生し、アドレスパルスを
印加しないセルでは放電が発生しないことが必要であ
り、アドレスパルスの電圧は各種の誤差要因を考慮して
決定される。次に、サステイン期間において、X電極と
Y電極に、電圧Vs(約170V)のサステインパルス
を繰り返し印加する。サステインパルスが印加される
と、アドレス期間に壁電荷が形成されたセルは、サステ
インパルスの電圧に壁電荷の電圧が重畳されて放電開始
電圧以上となり放電を開始する。アドレス期間に壁電荷
が形成されなかったセルは放電しない。なお、ほとんど
の電荷は中和するが、多少のイオンや準安定原子は放電
空間内に留まる。次のアドレス放電でこの残った電荷を
利用して、アドレス放電を確実に発生させるための種火
として作用させることも行われている。これは、一般的
に種火効果又はプライミング効果と呼ばれている。
で開示している従来の駆動方法の他の例を示す図であ
る。この駆動方法は、リセットパルスを電圧が緩やかに
変化する鈍波とすることで、微弱なリセット放電を生じ
させ、リセット放電によるコントラストの低下を抑制す
ることができる。なお、特開2000-75835号公報は、リセ
ット期間の終了時にX電極とY電極間に印加する電圧に
より蓄積される壁電荷を任意の量とすることが可能で、
Y電極に印加される鈍波波形の電圧を、アドレス時にス
キャンパルスが印加されない時の電圧とスキャンパルス
の電圧との間の任意の電圧とすることで、安定したアド
レス放電が行えることを開示している。
的な構成と動作であるが、各種の変形例が提案されてい
る。例えば、図2のフレーム構成で、同じ発光回数のサ
ブフィールドを複数個設けて、動画表示がスムーズにな
るようにすることが行われている。また、1フレームの
最初のサブフィールドでのみ書込み放電を伴うリセット
動作を行い、それ以降のサブフィールドのリセット動作
では書込み放電を行わない場合もある。更に、全セルで
リセットを行わず、前のサブフィールドで点灯したセル
のみリセットを行う場合もある。更に、リセット動作で
均一な壁電荷を残し、アドレス動作では非点灯セルを選
択して壁電荷を消去する消去アドレス法が行われる場合
もある。更に、リセットパルスを取り去った後のX電極
とY電極間に電位差を与えることにより、所望の電荷を
残して、アドレス動作時に利用する場合もある。更に、
本出願人は、特許第2801893号で、X電極とY電
極の間のすべてのスリット、すなわち、各Y電極と両側
のX電極との間で表示ラインを形成することにより、X
電極とY電極の本数を変えずに表示ライン数を2倍にす
るALIS方式と呼ばれるプラズマディスプレイ装置を
開示している。
には各種の変形例があるが、本願発明はそのいずれにも
適用可能である。プラズマディスプレイ装置は、CRT
を凌ぐ高画質が要求されている。高画質の要素として
は、高精細、高階調性、高輝度化、高コントラストなど
がある。高精細にするには、画素ピッチを細かくして表
示ライン数及び表示セル数を増加させる必要があり、上
記のALIS方式は高精細化を低コストで実現する構成
である。高コントラストにするには、リセットパルスな
どの画像に関係しない放電の強度や回数を減少させる。
ールドの個数を増加させて、表現できる階調数を増加さ
せる必要があるが、これにはリセット期間やアドレス期
間に要する時間を短縮するか、サステイン放電の周期を
短縮する必要がある。また、高輝度にするには、1回の
サステイン放電の強度を増加させることでも可能である
が、これは螢光体の劣化を招くという問題があり、他の
方法としては、フレーム内のサステイン放電の回数を増
加させる方法がある。サステイン放電の回数を増加させ
るには、上記のように、サステイン放電の周期を短縮す
るか、リセット期間やアドレス期間に要する時間を短縮
してサステイン期間の割合を増加させるかである。しか
し、サステイン動作周期の短縮は、現状の構成ではサス
テイン放電を安定して発生させる上で限界がある。そこ
で、高階調化及び高輝度化の観点から、リセット期間や
アドレス期間に要する時間の短縮が望まれている。特
に、アドレス期間は、スキャンパルスを順次印加するた
めリセット期間に比べて長く、スキャンパルスを狭くで
きれば時間短縮の効果が大きい。
極間の電圧は、アドレスパルスの電圧とスキャンパルス
の電圧の差(或いは、それにリセット期間に形成された
壁電荷による実効的な電圧を加えた電圧)であり、この
実効電圧が放電閾値電圧を超えると放電する。この時の
実効電圧と放電閾値電圧との差が大きいとアドレス放電
を開始するまでの遅れが小さくなるので、スキャンパル
スの幅を狭くすることができ、差が小さいとアドレス放
電を開始するまでの遅れが大きくなるので、スキャンパ
ルスの幅を広くする必要がある。すなわち、アドレス動
作におけるアドレス電極とY電極間の実効電圧とスキャ
ンパルスの幅は、トレードオフの関係にある。従って、
狭いスキャンパルスで動作させる1つの方法は、アドレ
スパルスとスキャンパルスの電圧差を大きくすることで
ある。
差要因を考慮して、アドレスパルスが印加されたセルで
はアドレス放電が発生し、アドレスパルスが印加されな
いセルではアドレス放電が発生しないように決定する必
要がある。具体的には、アドレスパルスの電圧を各セル
に印加される実効電圧のばらつき以上に設定し、アドレ
スパルスの電圧の1/2が印加された時に放電閾値電圧
になるように、スキャンパルスの電圧(及びリセット期
間に形成された壁電荷による実効的な電圧)を決定して
いる。スキャンパルスは、アドレスパルスとの差電圧が
問題であり、アドレスパルスが正極性であるとするとス
キャンパルスは負極性である。前述のように差電圧を大
きくするためには、例えば、スキャンパルスの電圧を低
下させる必要があるが、この場合にはYスキャンドライ
バの耐圧の問題が生じる。
に有効な壁電荷を残し、この残留壁電荷による電圧を利
用してアドレスパルスとスキャンパルスの電圧差を実効
的に高くすることも有効である。以上説明したような点
を考慮して、アドレスパルスの電圧、スキャンパルスの
電圧と幅、及びリセット期間に残留させる壁電荷を、表
示データに応じたアドレス放電が確実に発生するように
スキャンパルスの幅を決定している。
装置では、階調を表現するために、図2に示すようなサ
ブフレーム構成を有し、各セル毎に表示レベルに応じて
発光させるサブフレームを選択している。アドレスパル
スの電圧、スキャンパルスの電圧と幅、及びリセット期
間に残留させる壁電荷は、一般的にはこれらの条件はす
べてのサブフレームで同じであった。
件を各サブフレームで同一とした場合、サブフレームに
よってアドレス放電の発生の遅れが異なる。このアドレ
ス放電発生の遅れは、プライミング効果の不足によって
発生し、アドレス放電を発生しにくくする。前述のよう
に、放電により発生した電荷は壁電荷となったり中和す
るが、多少のイオンや準安定原子は放電空間内に留ま
り、プライミング効果を提供する。放電空間内の電荷は
放電の強度に応じて発生し、徐々に中和して消滅する。
そのため、大きな重みのサブフレームが点灯した場合に
は、サステイン放電が多数回行われるので大きなプライ
ミング効果を生じるが、小さな重みのサブフレームが点
灯した場合には、サステイン放電が行われる回数が少な
いので、発生するプライミング効果は小さい。また、プ
ライミング効果は放電後に時間の経過と共に徐々に減少
する。そのため、例えば、暗い表示が続く場合には、各
フレームで小さな重みのサブフレームのみが点灯するの
で、そのサブフレームによるプライミング効果が小さい
上、次のフレームまで点灯するサブフレームがないた
め、プライミング効果が減少して、次のフレームでその
サブフレームのアドレス期間にはプライミング効果が非
常に小さくなってしまい、アドレス放電が発生しにくく
なる。
ス動作が行えるように、アドレスパルスの電圧、スキャ
ンパルスの電圧と幅、及びリセット期間に残留させる壁
電荷などの条件を決定していた。サブフレーム毎の差は
アドレス動作時の実効電圧のばらつきを増大させるの
で、その分アドレスパルスの電圧を大きくするか、スキ
ャンパルスの幅を広くして許容範囲を広げていた。しか
し、アドレスパルスの電圧を高くする場合には耐圧の高
いアドレスドライバを使用する必要があり、コスト増加
という問題を生じる。一方、スキャンパルスの幅を広く
した場合には、アドレス期間が増加するという問題を生
じる。
すると共にスキャンパルスの幅も狭くするという両方の
条件を満たす方法は従来行われていなかった。本発明
は、アドレスパルスの電圧が低く且つスキャンパルスの
幅も狭くてもアドレス動作のための放電が確実に発生す
るプラズマディスプレイの駆動方法を実現することを目
的とする。
プレイの駆動方法は、リセット期間に壁電荷を残すよう
に第1の電極(X電極)と第2の電極(Y電極)間に印
加される電圧に差を設ける駆動方法であり、上記目的を
実現するため、リセット期間に第1の電極と第2の電極
間に印加されるリセット電圧差と、アドレス期間に第1
の電極と第2の電極間に印加されるアドレス電圧差は、
各サブフレーム毎に任意に設定され、リセット電圧差及
びアドレス電圧差の少なくとも一方は、少なくとも1つ
のサブフレームで異なる。
に印加されるリセット電圧差は、リセット期間に残す壁
電荷に関係する。また、アドレス電圧差と壁電荷による
電圧を合わせた電圧が、アドレス動作時に第1の電極と
第2の電極間に印加される実効電圧である。本発明によ
れば、アドレス期間に第1の電極と第2の電極間に印加
されるアドレス電圧差又はリセット期間に残す壁電荷又
はその両方(すなわち実効電圧)が、サブフレーム毎に
最適な量に設定される。従って、これまで考慮していた
サブフレームによるアドレス放電の遅れを考慮する必要
がなくなり、すべてのサブフレームでスキャンパルスの
幅を同じように狭くでき、アドレス期間に要する時間を
短縮できる。
期間の長いサブフレームよりサステイン期間の短いサブ
フレームにおいて大きくする。また、表示フレームが全
面でリセット放電を行うフレームリセット期間をフレー
ムの最初に備える場合には、アドレス動作時の実効電圧
は、フレームリセット期間に近いサブフレームよりフレ
ームリセット期間から遠いサブフレームにおいて大きく
する。
キャンパルスの幅も、各サブフレーム毎に設定するよう
にしてもよい。本発明の駆動方法は、リセット期間に第
1の電極と第2の電極間に印加する鈍波パルスの終了時
の電圧を変えて所望の壁電荷を残す方法である。終了時
の電圧を変えるには、この鈍波パルスを発生する回路が
時間の経過と共に出力電圧が変化する回路であり、その
駆動時間を制御することにより実現される。
レーム構成を示す図である。図示のように、1フレーム
では、サブフレーム1(SF1)、SF2、…、SF6
の6個のサブフレームが順番に配置され、各サブフレー
ムのサステイン期間はSF1、SF2、…、SF6の順
に長くなる。
ける駆動波形を示す図であり、サブフレームに応じてサ
ステイン期間の長さ(すなわちサステインパルス数)が
異なると共に、ΔVadd−ΔVhが任意に設定され
る。図示のように、各SFのリセット期間は、リセット
期間(書込み)とリセット期間(電荷調整)の2つの期
間に分けられる。リセット期間(書込み)では、X電極
に徐々に電圧が低下する鈍波パルスを、Y電極に徐々に
電圧が増加する鈍波パルスを印加してリセット放電を発
生させている。リセット放電により、X電極側には正の
電荷が蓄積され、Y電極側には負の電荷が蓄積される。
しかし、鈍波パルスによる放電は小さく、リセット放電
による不要な発光量を小さくできるという利点がある。
しかし、鈍波パルスによるリセット放電で生じるプライ
ミング効果は非常に小さく、十分なプライミング効果が
得られない。そのため、後のアドレス期間におけるアド
レス放電ではサステイン放電による生じるプライミング
効果が重要になる。
極に所定の電圧(ここではサステインパルスの正側と同
じ電圧)を印加し、Y電極に徐々に電圧が低下する鈍波
パルスを印加して前のリセット期間(書込み)で蓄積さ
れた壁電荷を減少させる。この時、X電極印加する電圧
はY電極に印加する電圧より高く、その間の電圧差はΔ
Vhである。前述の特開2000-75835号公報に開示されて
いるように、この電圧差ΔVhと残留する壁電荷の量の
間には所定の関係があり、電圧差ΔVhを小さくすると
壁電荷の量が増加する。なお、リセット期間(電荷調
整)では、リセット期間(書込み)で蓄積された壁電荷
を減少させるので、リセット期間(書込み)のリセット
放電の強度も、リセット期間(電荷調整)の終了後に残
留する壁電荷に関係する。リセット放電の強度は、リセ
ット期間(書込み)のX電極とY電極間の電圧に関係す
る。いずれにしろ、リセット期間(電荷調整)の終了後
には、図7に示すように、Y電極上には負の電荷が、X
電極及びアドレス電極上には正の電荷が蓄積される。蓄
積される電荷の量は、ΔVhが小さければ大きくなり、
またリセット期間(書込み)のX電極とY電極間の電圧
が大きくなると大きくなる。
定の電圧(サステインパルスの正側と同じ電圧)よりΔ
Vx高い電圧を印加し、Y電極にサステインパルスの中
間電圧を印加した上で、幅Tsのスキャンパルスを順次
印加する。スキャンパルスを印加した時のX電極とY電
極間の電圧差はΔVaddである。スキャンパルスの電
圧は、リセット期間(電荷調整)の最後にY電極に印加
された鈍波パルスの電圧よりΔVα低い。また、スキャ
ンパルスの印加に同期してアドレス電極にアドレスパル
スを印加する。ここで、アドレス放電時にX電極とY電
極の間に印加される実効電圧は、ΔVaddに壁電荷に
よる電圧を重畳した電圧である。上記のように壁電荷に
よる電圧はΔVhに関係するので、アドレス放電時にX
電極とY電極の間に印加される実効電圧は、ΔVadd
−ΔVhに関係する。すなわち、ΔVadd−ΔVhが
大きいほど、アドレス放電が発生しやすい。後のサステ
イン期間は、従来と同様であり、説明は省略する。
一部は放電空間内に留まり、プライミング効果を提供す
る。第1実施例では、上記のようにリセット期間(書込
み)のリセット放電によるプライミング効果が小さいの
で、主としてサステイン放電によるプライミング効果が
問題になる。大きな重みのサブフレームが点灯した場合
には、サステイン放電が多数回行われるので大きなプラ
イミング効果を生じる。従って、大きな重みのサブフレ
ームが点灯する場合には、隣接する小さな重みのサブフ
レームにもプライミング効果を与えるだけでなく、次の
フレームの大きな重みのサブフレームまでプライミング
効果が持続するので、プライミング効果は問題にならな
い。これに対して、小さな重みのサブフレームのみが点
灯する場合にはプライミング効果が小さく、次のフレー
ムの小さな重みのサブフレームが点灯するまでには、プ
ライミング効果は非常に小さくなる。そのため、プライ
ミング効果の減少が問題になるのは小さな重みのサブフ
レームである。
ムSF1やSF2などにおけるΔVadd−ΔVhを、
大きな重みのサブフレームSF5やSF6などにおける
ΔVadd−ΔVhより大きくしてアドレス放電を発生
しやすくしている。また、リセット期間(書込み)のX
電極とY電極間の電圧を大きくすることもある。これに
より、たとえ小さな重みのサブフレームのみが点灯して
プライミング効果が小さい場合でも、確実にアドレス放
電が発生する。
調整)にX電極に印加する電圧とアドレス期間にX電極
に印加する電圧の差ΔVxと、リセット期間(電荷調
整)の終了時にY電極に印加する電圧(鈍波の終了時の
電圧)とアドレス期間にY電極に印加するスキャンパル
スの電圧の差ΔVαの和は、ΔVadd−ΔVhに等し
い、すなわち、ΔVadd−ΔVh=ΔVx+ΔVαで
ある。ΔVadd−ΔVhを増加させる場合、ΔVxを
増加させても、ΔVαを増加させても同様の効果が得ら
れた。なお、アドレス動作時にアドレス電極に残留させ
る壁電荷の量は、ΔVxとΔVαの分配比によって制御
できる。
とリセット期間(電荷調整)において、電極に鈍波パル
スを印加する必要があり、しかも鈍波パルスの印加終了
時の電圧をサブフレームに応じて変える必要がある。図
8は、このような鈍波パルスを発生するための鈍波発生
回路の回路構成とその動作を示す図である。図8の
(A)に示すように、第1のFETのドレインを第1の
電源端子に接続し、ゲートを制御部に接続し、ソースを
抵抗とダイオードを介して出力に接続する。出力はY電
極に接続され、Y電極はX電極との間でパネル容量を形
成する。また、Y電極、すなわち出力は、ダイオードと
抵抗と第2FETを介して第2の電源端子に接続されて
いる。第1の電源は正の鈍波波形の目標電圧より若干大
きい電圧の電圧源であり、第2の電源は負の鈍波波形の
目標より若干低い電圧の電圧源である。正の鈍波パルス
を印加する時には、制御部からは第2のFETをオフ状
態にする信号を出力した状態で、第1のFETをオン状
態にするパルスが印加される。制御部はこのパルスの幅
を自由に設定可能である。出力は、抵抗とパネル容量が
遅延回路を形成のためFETがオン状態になると徐々に
増加する。出力が所望の電圧に到達した時点で、制御部
が第1のFETのゲートに印加するパルスの出力を停止
すると、出力は所望の電圧で維持される。例えば、図8
の(B)に示すように、V1の電圧で停止するのであれ
ば、制御部はt1の幅のパルスを出力し、V2の電圧で
停止するのであれば、制御部はt2の幅のパルスを出力
する。このようにして、正の鈍波パルスの終了時の電圧
を任意に設定できる。負の鈍波パルスを印加する時に
は、第2のFETのを上記と同様に駆動する。このよう
にして、図6のY電極に印加する2つの鈍波パルスを組
み合わせた信号が生成できる。
成を示す図である。第2実施例のフレーム構成では、フ
レームの中央から順に重みの大きなサブフレームを配置
すると共に、フレームの最初にフレームリセット期間を
設けた。このフレームリセット期間は、前のサブフレー
ムが終了した状態にかかわらず、全面(全セル)でリセ
ット放電を発生させる期間で、従来の全面書込みパルス
を使用しても鈍波パルスを使用してもよい。このリセッ
ト放電により、プライミングが形成される。
駆動波形を示す図であり、図6の第1実施例の駆動波形
と異なるのはリセット期間(書込み)に、急激に変化す
るパルスを印加している点である。このようなパルスを
印加しても同様にリセット放電が発生する。後の動作は
は第1実施例と同じであるが、第2実施例では、フレー
ムリセット期間から離れたサブフレームSF4やSF2
におけるΔVadd−ΔVh又はリセット期間(書込
み)のX電極とY電極間の電圧を、他のサブフレームS
F1やSF6などにおけるΔVadd−ΔVhより大き
くしてアドレス放電を発生しやすくしている。これによ
り、たとえフレームリセット期間から離れたサブフレー
ムでプライミング効果が小さい場合でも、確実にアドレ
ス放電が発生する。
サブフレームに応じてアドレス時の実効電圧が最適な状
態に設定されるので、動作マージンが大きくなり、スキ
ャンパルス幅を狭くしてアドレス期間を短くできる。こ
れにより、プラズマディスプレイ装置の階調性及び輝度
を一層改善できる。
ロック図である。
めのフレーム構成を示す図である。
示す波形図である。
別の例を示す波形図である。
ある。
極の壁電荷を示す図である。
作を示す図である。
ある。
Claims (5)
- 【請求項1】 交互に隣接して配置した第1の電極と第
2の電極と、前記第1及び第2の電極と交差するように
配置された第3の電極とを備え、前記第1及び第2の電
極と前記第3の電極との交差部分に表示セルが形成され
るプラズマディスプレイの駆動方法であって、 1表示画面に相当する1表示フレームは複数のサブフレ
ームを備え、点灯するサブフレームを組み合わせて階調
表示を行い、 各サブフレームは、 表示セルの壁電荷分布を初期化するリセット期間と、 該リセット期間の後、前記表示セルの壁電荷を表示デー
タに応じた状態に設定するアドレス期間と、 該アドレス動作で設定された前記表示セルの状態に応じ
て、点灯セルを選択的に発光させるサステイン期間とを
備え、 前記リセット期間に前記第1の電極と前記第2の電極間
に印加されるリセット電圧差と、前記アドレス期間に前
記第1の電極と前記第2の電極間に印加されるアドレス
電圧差は、各サブフレーム毎に任意に設定され、表示フ
レーム内に、前記リセット電圧差及び前記アドレス電圧
差の少なくとも一方が異なる複数のサブフレームを備え
ることを特徴とするプラズマディスプレイの駆動方法。 - 【請求項2】 請求項1に記載のプラズマディスプレイ
の駆動方法であって、前記リセット電圧差及び前記アド
レス電圧差の少なくとも一方は、前記サステイン期間の
長いサブフレームより前記サステイン期間の短いサブフ
レームにおいて大きいプラズマディスプレイの駆動方
法。 - 【請求項3】 請求項1に記載のプラズマディスプレイ
の駆動方法であって、各表示フレームは、前のフレーム
の終了状態にかかわらず全面でリセット放電を行うフレ
ームリセット期間を当該フレームの最初に備え、 前記リセット電圧差及び前記アドレス電圧差の少なくと
も一方は、前記フレームリセット期間に近いサブフレー
ムより前記フレームリセット期間から遠いサブフレーム
において大きいプラズマディスプレイの駆動方法。 - 【請求項4】 請求項1に記載のプラズマディスプレイ
の駆動方法であって、前記アドレス期間には、前記第2
の電極には順次スキャンパルスが印加されると共に、前
記第3の電極には前記スキャンパルスに同期して表示デ
ータに対応する信号が印加され、 前記スキャンパルスのパルス幅は、各サブフレーム毎に
任意に設定され、 前記リセット電圧差及び前記アドレス電圧差は、各サブ
フレーム毎に前記スキャンパルスのパルス幅に応じて任
意に設定されるプラズマディスプレイの駆動方法。 - 【請求項5】 請求項1に記載のプラズマディスプレイ
の駆動方法であって、前記リセット期間に前記第1の電
極と前記第2の電極間に印加する信号は時間の経過と共
に電圧が変化する信号であり、該信号は時間の経過と共
に出力電圧が変化する回路の駆動時間を制御することに
より実現されるプラズマディスプレイの駆動方法。
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