JP2002083918A - リードフレーム及び半導体装置 - Google Patents
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Abstract
離、および外部に露呈するサポートバーのバリを可及的
に防止することが可能なリードフレームおよび半導体装
置を提供する。 【解決手段】 半導体チップ搭載部2bをマトリックス
状に複数個集合して単位フレーム集合体7を構成し、単
位フレーム集合体7をリードフレームベース5Bに設け
て成り、半導体チップを各単位フレーム2の半導体チッ
プ搭載部2b表面に搭載し、単位フレーム集合体7全域
を樹脂封止して樹脂封止体8を形成した後、樹脂封止体
8を切断することによって製造される半導体装置であっ
て、少なくとも前記切断される部位が各単位フレーム裏
面側を除去して薄肉に形成して成るサポートバー2s
と、リードフレームベース5Bの厚さより薄肉に形成し
て成るタイバー6と、リードフレームベース5Bの厚さ
より薄肉に形成して成る境界部6oと、を具えるリード
フレーム。
Description
て製造される半導体装置を構成するリードフレーム、お
よび該リードフレームを用いた半導体装置に関する。
搭載し、樹脂封止して成る樹脂封止型の半導体装置にお
いては、小型化、高密度化の要請から、図8(a)に示す
ように、樹脂パッケージ104pの側面からリード10
2rが突出することなく、半導体装置100の裏面10
0tにリード102rが露呈する、いわゆるSON(Sm
all Outline Non-leaded package)やQFN(Quad
Flat Non-leaded package)と呼ばれるタイプの半
導体装置が注目されている。
を使用した半導体装置において、複数個を一括して樹脂
封止する製造方法であるMAP(Mold Array Process)
と呼ばれる製造方法が採用され、半導体装置の製造が行
われており、前述したSONやQFNなどのリードフレ
ームを使用した半導体装置にもこのMAPを適用しよう
とする動きがある。以下に例を示す。
を単位フレーム102のタブ102b上に搭載するとと
もに単位フレーム102のリード102rにボンディン
グワイヤ103を介して電気的に接続し、全体を樹脂封
止することによって構成されている。
に示すように、リードフレーム105に形成され、矩形
の平面形状を呈している。
あるタブ102bが形成され、タブ102bより角部に
向かって延在するサポートバー102sによって該タブ
102bが支持され、各辺よりタブ102bを囲む態様
でリード102rが形成されている。
レーム102をタイバー106を用いて連結してマトリ
ックス状に構成した単位フレーム集合体107が形成さ
れている。
フレーム105の長手方向(図の左右方向)へ複数形成
される。
て説明する。
単位フレーム集合体107の各単位フレーム102のタ
ブ102b上に半導体チップ109を接着剤又は接着テ
ープを用いて搭載し、半導体チップ109の電極109
dとリード102rとをボンディングワイヤ103を介
して電気的に接続する。(図8(a)参照)以下、上記M
AP法による製造工程である。
ム集合体107とガイドレール105gの一部を含んで
108線内を封止樹脂104によって樹脂封止し、樹脂
封止体108を成形する。
ー(図示せず)により、矢印に示す如く、各単位フレー
ム102の境界であるタイバー106、ガイドレール1
05gに沿って、切断し、各々の半導体装置100へ分
離する。
括して樹脂封止できるため樹脂封止工程が簡略化できる
とともに、外形サイズが同じであれば、ひとつの樹脂封
止金型で多品種に対応でき、従来と比較して大幅なコス
トダウンが図れるという利点がある。
うにMAP法をリードフレームを使用した半導体装置に
適用した場合には、以下に示す問題がある。
半導体装置100へ分離する際に、ダイシングソーによ
り樹脂封止体108とリードフレーム105のタイバー
106およびリード102rとを同時に切断するが、リ
ードフレーム105と樹脂封止体108とは材質が異な
り硬度等に関係する切断力が異なるので、切断時に切断
抵抗が変化し、切断箇所における封止樹脂体108とリ
ードフレーム105との切断抵抗による変形量の差異が
原因となり、図8(b)に示すように、切断方向(矢印方
向)に向かって封止樹脂104とリードフレーム105
との境界部分に剥離104hが生じるという問題があ
る。
形状をなす樹脂パッケージ104pの角部に位置し露呈
するので、切断に際して切断方向(矢印方向)に向かって
バリ102sbが発生し、外観不良並びに寸法不良とな
るばかりでなく、接合不良なども引き起こしてしまい、
さらに、バリ102sbを除去する工程が必要である。
このような理由から、MAP法をリードフレームを使用
した半導体装置に適用し、量産することは非常に困難で
あった。
樹脂との剥離、および外部に露呈するサポートバーのバ
リを可及的に防止することが可能な、リードフレームお
よび半導体装置の提供を目的とする。
く、本発明の請求項1に関わるリードフレームは、矩形
の平面形状を呈し、かつ半導体チップ搭載部を有すると
ともに各辺に半導体チップ搭載部を囲む態様でリードが
形成され、半導体チップ搭載部から角部に向けて延在す
るサポートバーを具える単位フレームを、マトリックス
状に複数個集合して単位フレーム集合体を構成し、単位
フレーム集合体をリードフレームベースに設けて成り、
半導体チップを各単位フレームの半導体チップ搭載部表
面に搭載し、単位フレーム集合体全域を樹脂封止して樹
脂封止体を形成した後、単位フレーム集合体において各
単位フレームを互いに連結しているタイバーおよび単位
フレーム集合体とリードフレームベースとの境界部に沿
って、サポートバーの一部を含み樹脂封止体を切断する
ことによって各々の半導体装置を製造するように構成さ
れたリードフレームであって、少なくとも前記切断され
る部位が各単位フレーム裏面側を除去して薄肉に形成し
て成るサポートバーと、リードフレームベースの厚さよ
り薄肉に形成して成るタイバーと、リードフレームベー
スの厚さより薄肉に形成して成る境界部と、を具える。
は、請求項1に記載のリードフレームにおいて、リード
における単位フレーム表面側に非貫通孔が形成される。
は、請求項2に記載のリードフレームにおいて、サポー
トバーは、分岐して前記タイバーに結合され、製造され
る半導体装置の角部以外の場所から露呈するように形成
される。
は、請求項3に記載のリードフレームにおいて、サポー
トバーは、封止樹脂が充填される貫通孔が設けられる。
請求項4に記載のリードフレームにおいて、前記貫通孔
は、サポートバーの分岐域からサポートバーと半導体チ
ップ搭載部との境界域に至る領域に形成される長孔であ
ることを特徴としている。
矩形の平面形状を呈し、かつ半導体チップ搭載部を有す
るとともに各辺に半導体チップ搭載部を囲む態様でリー
ドが形成され、半導体チップ搭載部から角部に向けて延
在するサポートバーを具える単位フレームを、マトリッ
クス状に複数個集合して単位フレーム集合体を構成し、
単位フレーム集合体をリードフレームベースに設けて成
り、半導体チップを各単位フレームの半導体チップ搭載
部表面に搭載し、単位フレーム集合体全域を樹脂封止し
て樹脂封止体を形成した後、単位フレーム集合体におい
て各単位フレームを互いに連結しているタイバーおよび
単位フレーム集合体とリードフレームベースとの境界部
に沿って、サポートバーの一部を含み樹脂封止体を切断
することによって各々の半導体装置を製造するように構
成されたリードフレームを用いて製造される半導体装置
であって、リードフレームが、少なくとも前記切断され
る部位が各単位フレーム裏面側を除去して薄肉に形成し
て成るサポートバーと、リードフレームベースの厚さよ
り薄肉に形成して成るタイバーと、リードフレームベー
スの厚さより薄肉に形成して成る境界部と、を具える。
請求項6に記載の半導体装置において、リードフレーム
のリードにおける単位フレーム表面側に非貫通孔が形成
される。
請求項7に記載の半導体装置において、リードフレーム
のサポートバーは、分岐してタイバーに結合され、製造
される半導体装置の角部以外の場所から露呈するように
形成される。
請求項8に記載の半導体装置において、リードフレーム
のサポートバーは、封止樹脂が充填される貫通孔が設け
られる。
は、請求項9に記載の半導体装置において、前記貫通孔
は、サポートバーの分岐域からサポートバーと半導体チ
ップ搭載部との境界域に至る領域に形成される長孔であ
ることを特徴としている。
て、本発明を詳細に説明する。
図1に、および半導体装置の実施例を図2に示す。
レーム2のタブ2b上に搭載するとともに単位フレーム
2のリード2rにボンディングワイヤ3を介して電気的
に接続し、全体を樹脂封止することによって構成されて
いる。
line Non-leaded package)或いはQFN(Quad Fla
t Non-leaded package)と呼ばれるタイプの四角形の
平面形状を有する半導体装置であり、樹脂パッケージ4
pの裏面4prにリード2rが露呈する。
示すように、リードフレーム5に形成され、矩形の平面
形状を呈している。
あるタブ2bが形成され、タブ2bより角部に向かって
延在するサポートバー2sによって該タブ2bが支持さ
れ、各辺よりタブ2bを囲む態様でリード2rが形成さ
れている。
5Bに、複数の単位フレーム2をタイバー6を用いて連
結しマトリックス状に構成した単位フレーム集合体7が
形成されている。
ーム5の長手方向(図の左右方向)へ複数形成される。
単位フレーム2毎に上記のリードパターンを形成して構
成され、各単位フレーム2は単位フレーム集合体7内に
おいて互いに同じ幅を有するタイバー6によって結合さ
れ、且つ区分けされている。
下、半導体チップ9搭載面を表面、搭載面の裏面を裏面
と称す)から見た図3(a)、その断面図である図3(d)
に示すように、タブ2bへの結合部から対角線方向に隣
接する別の単位フレーム2への結合部2kの手前まで、
裏面側をコイニング加工、或いはハーフエッチングを行
って除去することによってリードフレームベース5Bの
厚さより薄肉に形成されている。
(b)、図3(c)に示すように、隣接するタイバー6への
結合部2kを除いて、裏面側をコイニング加工、或いは
ハーフエッチングを行って除去することによってリード
フレームベース5Bの厚さより薄肉に形成されている。
は、図1に示すように、単位フレーム集合体7の外周部
に位置する単位フレーム2を結合して、詳しくは単位フ
レーム2のリード2rを結合して、タイバー6と同じ幅
を有する外周タイバー6o(境界部)が単位フレーム集合
体7の四方を囲んで成形される。
示すように、裏面側をコイニング加工、或いはハーフエ
ッチングを行って除去することによってリードフレーム
ベース5Bの厚さより薄肉に形成されている。
数のスリット5s(切り欠き部)が間隔をおいて形成さ
れ、さらに、複数のスリット5sの外方域はリードフレ
ームベース5Bとなっており、外周タイバー6oとリー
ドフレームベース5Bは複数の幅狭な連結片5rによっ
て結合されている。
法について簡単に説明する。
状或いは短冊状の銅系の導電性材料よりなる金属薄板を
準備する。
ードフレームベース5Bに、上述の所定のリードパター
ンを有する単位フレーム2を複数個集合してマトリック
ス状に構成した単位フレーム集合体7をスタンピング或
いはエッチングにより成形することによって、リードフ
レーム5が完成する。
sは、タブ2bへの結合部から対角線方向に隣接する別
の単位フレーム2への結合部2kの手前まで、裏面側を
除去することによってリードフレームベース5Bの厚さ
より薄肉に形成する。
6への結合部2kを除いて裏面側を除去することによっ
てリードフレームベース5Bの厚さより薄肉に形成し、
また、外周タイバー6oは、裏面側を除去することによ
ってリードフレームベース5Bの厚さより薄肉に形成す
る。
半導体装置1の製造方法について説明する。
リードフレーム5の単位フレーム集合体7における各単
位フレーム2のタブ2b上に半導体チップ9を銀ペース
ト等の接着剤(図示せず)や接着テープ(図示せず)を
用いて搭載する。(図2参照) 次に、半導体チップ9の電極9dとリード2rを、金線
等のボンディングワイヤ3を用いてワイヤボンディング
することによって電気的に接続する。
単位フレーム集合体7上にマトリックス状に搭載した複
数の半導体チップ9を覆って、図示した線F内(図1参
照)をエポキシ等の樹脂によって一括して樹脂封止し、
樹脂封止体8を形成する。
うに、単位フレーム2間の境界に相当するタイバー6、
および単位フレーム2とリードフレームベース5Bの境
界に相当する外周タイバー6oに沿って、サポートバー
2sの一部を含み前記樹脂封止体8をダイシングソー
(図示せず)等のツールによってダイシングし(リード
フレーム5の切断箇所を図3(a)で二点鎖線で示す、
サポートバー2sの切断箇所は2scである)、各々の
半導体装置1へ分離することによって、半導体装置1が
完成する。(図4(c)、図2参照) なお、上述したサポートバー2s、タイバー6および外
周タイバー6oの薄肉化工程は、リードフレーム5の形
状形成と同時に行っても良いし、別々に行っても良い。
体装置1への切断に際して、切断箇所に相当するタイバ
ー6、サポートバー2sおよび外周タイバー6oが薄肉
に形成されているので切断抵抗が低下し、タイバー6、
サポートバー2sおよび外周タイバー6oと封止樹脂4
との切断抵抗の違いが減少し、切断箇所におけるリード
2rからの封止樹脂4の剥離、およびサポートバー2s
からの封止樹脂4の剥離が防止されるリードフレームが
得られる。
置1への切断に際して、切断箇所に相当するタイバー
6、サポートバー2sおよび外周タイバー6oが薄肉に
形成されているので切断抵抗が低下し、タイバー6、サ
ポートバー2sおよび外周タイバー6oと封止樹脂4と
の切断抵抗の違いが減少し、切断箇所におけるリード2
rからの封止樹脂4の剥離、およびサポートバー2sか
らの封止樹脂4の剥離が防止される。
が可能となり、高品質の半導体装置が得られる。
照して説明する。
ドフレーム25を表面から見た一部拡大図の図5(a)に
示すように、リード22rの半導体チップ搭載面側のボ
ンディング部22rbを除く中央域に非貫通穴22ra
を形成する。
すように、樹脂パッケージ24pの角部以外の場所から
露呈するように二股に分岐してタイバー26に連結する
ように成形するとともに、分岐する箇所に幅広部22s
hを設け、該幅広部22shに貫通孔22saを穿孔す
る。
(a)、図5(b)に示すように、裏面側をコイニング加
工、或いはハーフエッチングを行って除去することによ
ってリードフレームベース5Bの厚さより薄肉に形成さ
れている。
(c)に示すように、裏面側をコイニング加工、或いはハ
ーフエッチングを行って除去することによってリードフ
レームベース5Bの厚さより薄肉に形成されている。
レーム25の切断箇所は二点鎖線で示す領域であり、サ
ポートバー22sの切断部位は22scである。
バー26および外周タイバー6oの薄肉化工程およびリ
ード22rへの非貫通穴22raの形成工程は、リード
フレームの形状形成と同時に行っても良いし、別々に行
っても良い。
広部、或いは貫通孔の位置と数は上記以外にも適宜選択
可能である。
一の実施例と同様であるので、同一符号を付して説明を
省略する。
半導体装置によれば、各半導体装置への切断に際して、
切断箇所に相当するタイバー26、サポートバー22s
および外周タイバー6oが薄肉に形成されているので切
断抵抗が低下し、タイバー26、サポートバー22sお
よび外周タイバー6oと封止樹脂4との切断抵抗の違い
が減少し、切断箇所におけるリード22rからの封止樹
脂4の剥離、およびサポートバー22sからの封止樹脂
4の剥離が防止される。
リード22rの非貫通穴22ra内に充填されるので、
リード22rと封止樹脂4との結合性が強化される。
に設けられる貫通孔22saにも充填されるので、サポ
ートバー22sと封止樹脂4との結合性が強化され、切
断工程における封止樹脂4の単位フレームからの剥離防
止効果が更に向上する。
ージ24pの角部以外の場所から露呈するように二股に
分岐してタイバー26に連結するように成形されるの
で、サポートバー22sのタイバー26との連結部が単
位フレームの角部から外れて位置し、図6に示すよう
に、サポートバー22sは矩形の平面形状をなす樹脂パ
ッケージ24pの角部以外の場所から露呈し、切断工程
におけるサポートバー22sのバリの発生が防止され、
バリ取りの作業が不要である。
が可能となり、高精度でしかも高品質の半導体装置が得
られる。
ード22rの半導体チップ搭載面側のボンディング部2
2rbを除く中央域に非貫通穴22raを形成し、同時
に、サポートバー22sを、樹脂パッケージ24pの角
部以外の場所から露呈するように二股に分岐してタイバ
ー26に連結するように成形するとともに、分岐する箇
所に幅広部22shを設け、該幅広部22shに貫通孔
22saを穿孔する構成を例示した。
ドに非貫通穴を設ける、サポートバーを樹脂パッケージ
の角部以外の場所から露呈するように二股に分岐する、
サポートバーが分岐する箇所に幅広部を設ける、サポー
トバーに貫通孔を穿孔する等は、それぞれ別々に適用で
きるものであり、或いは各々組み合わせて適用してもよ
い。
て説明する。
る以外の構成は第ニ実施例と同様であるので、同一符号
を付して説明を省略する。
ドフレーム35を表面から見た一部拡大図の図10(a)
に示すように、サポートバー32sを、第ニ実施例であ
る図6同様に、樹脂パッケージ24pの角部以外の場所
から露呈するように二股に分岐してタイバー26に連結
するように成形する。
手方向に沿って上記二股の分岐域32bよりサポートバ
ー32sとタブ3bとの境界領域のタブ境界域32k
(境界域)に至る領域に長形の長貫通孔32sa(長孔)が
穿孔されている。
長貫通孔32saは、タブ3bから離れて形成されるほ
ど樹脂パッケージ24pの角部における封止樹脂4の切
断による剥離が増加する傾向を有している。
チップ9の下面に対向するタブ3bの領域に長貫通孔3
2saが形成される場合には、半導体チップ9の接合の
際に使用されるペーストが長貫通孔32sa内に漏出し
てしまうという現象が生じるため、該領域に長貫通孔3
2saを形成することは好適ではない。
を半導体チップ9の下面に対向するタブ3bの領域に形
成せず、サポートバー32sにおける二股の分岐域32
bよりタブ3bに近接したタブ境界域32k(境界域)に
至る領域に形成することにより、樹脂パッケージ24p
の角部における封止樹脂4の切断による剥離の増加、お
よび長貫通孔32sa内へのペーストの漏出という問題
が解決できるものである。
の外周部は、図10(b)に示すように、裏面側をコイニ
ング加工、或いはハーフエッチングを行って除去するこ
とによってリードフレームベース5Bの厚さより薄肉に
形成されている。
ー32s、タブ3bの外周部、および外周タイバー6o
の薄肉化工程、およびサポートバー32sの長貫通孔3
2sa、およびリード22rへの非貫通穴22raの形
成工程は、リードフレームの形状形成と同時に行っても
良いし、別々に行っても良い。
半導体装置によれば、各半導体装置への切断に際して、
切断箇所に相当するタイバー26、サポートバー32s
および外周タイバー6oが薄肉に形成されているので切
断抵抗が低下し、タイバー26、サポートバー32sお
よび外周タイバー6oと封止樹脂4との切断抵抗の違い
が減少し、切断箇所におけるリード22rからの封止樹
脂4の剥離、およびサポートバー32sからの封止樹脂
4の剥離が防止される。
分岐域32bよりタブ3bとの境界域32kに至る領域
に長貫通孔32saが穿孔されているので、サポートバ
ー32sにおける強度が低減され、サポートバー32s
がタブ3bに連続して形成されることから生じる切断抵
抗がさらに低下し、封止樹脂4の剥離防止効果がさらに
高まる構成である。
されるので、長貫通孔32saが丸孔であると孔径が小
さ過ぎて十分な封止樹脂4の剥離防止効果は得られない
が、長貫通孔32saの形状は長形であれば単なる長方
形等、前述の形状以外種々採用し得るものである。
に穿孔される長貫通孔32saにも充填され、しかも、
長貫通孔32saは長形であるので幅狭なサポートバー
32sにおいてもより大きな開口面積を有することがで
き、より多量の封止樹脂4が貫通孔32sa内に流入す
ることが可能であり、封止樹脂4とサポートバー32s
との結合性が強化され、切断工程における封止樹脂4の
単位フレーム2からの剥離防止効果が更に向上する。
リード22rの非貫通穴22ra内に充填されるので、
リード22rと封止樹脂4との結合性が強化される。
ケージ24pの角部以外の場所から露呈するように二股
に分岐してタイバー26に連結するように成形されるの
で、サポートバー32sのタイバー26との連結部が単
位フレーム2の角部から外れて位置し、図6に示すよう
に、サポートバー22sは矩形の平面形状をなす樹脂パ
ッケージ24pの角部以外の場所から露呈し、切断工程
における樹脂パッケージ24pの角部のサポートバー3
2sのバリの発生が防止され、バリ取りの作業が不要で
ある。
が可能となり、高精度でしかも高品質の半導体装置が得
られる。
sに設けられる貫通孔は長形の長貫通孔32saとした
が、サポートバー22sの長手方向である二股の分岐域
32bよりタブ境界域32kに至る領域に孔が穿孔され
ていることが肝要であり、例えば複数の孔が、穿孔され
ていてもよい。
図7に示す。
ース5B間に位置する境界部6o'は、図7(b)に示す
ように、裏面側をコイニング加工、或いはハーフエッチ
ングを行って除去することによってリードフレームベー
ス5Bの厚さより薄肉に形成されている。
レーム集合体7の外方部が連続した板材で構成される以
外、リードフレーム5との構成の差異はないので、同一
の符号を付して説明を省略する。
5'を用いた半導体装置は、前述した第一実施例と同じ
効果が得られる。
例の構成を適用すれば、第ニ、三実施例と同じ効果が得
られる。
裏面側を除去して薄肉化した例を示したが、薄肉化する
のは表面側を加工してもよいし、或いは両面を加工して
もよい。
図11に示す。
り、第一実施例と同一の構成は同一の符号を付して説明
を省略する。
体7、およびその外周部を囲んで位置する外周タイバー
6o、さらにその外方域に外周タイバー6oに対し対称
に単位リードフレーム2のダミーのリードパターン、す
なわち、ダミーリード52r、ダミーサポートバー52
s、ダミータイバー56が形成されている。
ムベース5B間には第一実施例と同じくスリット55s
が形成されている。
ポートバー2sと同様に、裏面側をコイニング加工、或
いはハーフエッチングを行って除去することによって、
リードフレームベース5Bの厚さより薄肉に形成されて
いる。
と同様に、裏面側をコイニング加工、或いはハーフエッ
チングを行って除去することによって、リードフレーム
ベース5Bの厚さより薄肉に形成されている。
されることなくリード2rと同じ厚さを有している。
実施例のリードフレームを用いた半導体装置によれば、
前述の第一実施例の効果に加え、ダイシングソー等によ
ってダイシングされる外周タイバー6oにおいて、外周
タイバー6oに隣接する内方域と外方域とが対称な形状
を呈しているため、ダイシングに際して外周タイバー6
oの内方側と外方側とから受ける切断抵抗が可及的に等
しくなり、切断抵抗がバランスされた外周タイバー6o
の切断が可能になりダイシング工程が円滑に行われる。
の構成に適用すれば、第ニ、三実施例においても外周タ
イバーのダイシング工程が円滑に行われるという効果を
得られる。
ドフレームのタイバー、サポートバー、外周タイバー、
ダミータイバー、ダミーサポートバーは裏面側を除去し
て薄肉化した例を示したが、薄肉化するのは表面側を加
工してもよいし、或いは両面を加工してもよい。
リードとの電気的接続をワイヤボンディング法で行った
が、フリップチップ接続を適用してもよい。
の母材として、銅系の導電性材料よりなる金属薄板を使
用したが、鉄系合金等、導電性材料であればその他の材
料が使用できることは当然である。
に関わるリードフレームは、矩形の平面形状を呈し、か
つ半導体チップ搭載部を有するとともに各辺に半導体チ
ップ搭載部を囲む態様でリードが形成され、半導体チッ
プ搭載部から角部に向けて延在するサポートバーを具え
る単位フレームを、マトリックス状に複数個集合して単
位フレーム集合体を構成し、単位フレーム集合体をリー
ドフレームベースに設けて成り、半導体チップを各単位
フレームの半導体チップ搭載部表面に搭載し、単位フレ
ーム集合体全域を樹脂封止して樹脂封止体を形成した
後、単位フレーム集合体において各単位フレームを互い
に連結しているタイバーおよび単位フレーム集合体とリ
ードフレームベースとの境界部に沿って、サポートバー
の一部を含み樹脂封止体を切断することによって各々の
半導体装置を製造するように構成されたリードフレーム
であって、少なくとも前記切断される部位が各単位フレ
ーム裏面側を除去して薄肉に形成して成るサポートバー
と、リードフレームベースの厚さより薄肉に形成して成
るタイバーと、リードフレームベースの厚さより薄肉に
形成して成る境界部と、を具える。
に際して、切断箇所に相当するタイバー、サポートバー
および外周タイバーが薄肉に形成されているので切断抵
抗が低下し、タイバー、サポートバーおよび外周タイバ
ーと封止樹脂との切断抵抗の違いが減少し、切断箇所に
おけるリードからの封止樹脂の剥離、およびサポートバ
ーからの封止樹脂の剥離が防止される半導体装置を製造
できるリードフレームが得られる。
は、請求項1に記載のリードフレームにおいて、リード
における単位フレーム表面側に非貫通孔が形成される。
による効果に加えて、樹脂封止工程において封止樹脂が
リードの非貫通穴内にも充填され、リードと封止樹脂と
の結合性が強化され、封止樹脂の単位フレームからの剥
離防止効果が更に向上するリードフレームが得られ、封
止樹脂の剥離が防止される半導体装置を製造できる。
は、請求項2に記載のリードフレームにおいて、サポー
トバーは、分岐して前記タイバーに結合され、製造され
る半導体装置の角部以外の場所から露呈するように形成
される。
による効果に加えて、サポートバーが分離され、樹脂パ
ッケージの角部以外の部分から露呈するように成形され
るので、切断工程におけるサポートバーのバリの発生が
防止され、バリ取りの作業が不要である。
が可能となり、高精度でしかも高品質の半導体装置が製
造できるリードフレームが得られる。
は、請求項3に記載のリードフレームにおいて、サポー
トバーは、封止樹脂が充填される貫通孔が設けられる。
による効果に加えて、封止樹脂がサポートバーに設けら
れる貫通孔にも充填されるので、サポートバーと封止樹
脂との結合性が強化され、封止樹脂の単位フレームから
の剥離防止効果が更に向上するリードフレームが得ら
れ、封止樹脂の剥離が防止される半導体装置を製造でき
る。
請求項4に記載のリードフレームにおいて、前記貫通孔
は、サポートバーの分岐域からサポートバーと半導体チ
ップ搭載部との境界域に至る領域に形成される長孔であ
ることを特徴としている。
による効果に加えて、前記貫通孔はサポートバーの分岐
域からサポートバーと半導体チップ搭載部との境界域に
至る領域に形成される長孔であるので、サポートバーの
強度が低減され、個々の半導体装置へ切断する際の切断
抵抗が低下し、封止樹脂の単位フレームからの剥離防止
効果が更に向上する。
樹脂が貫通孔により多く充填されるので、サポートバー
と封止樹脂との結合性がより強化される。
離防止効果が更に向上するリードフレームが得られ、封
止樹脂の剥離が防止される半導体装置を製造できる。
矩形の平面形状を呈し、かつ半導体チップ搭載部を有す
るとともに各辺に半導体チップ搭載部を囲む態様でリー
ドが形成され、半導体チップ搭載部から角部に向けて延
在するサポートバーを具える単位フレームを、マトリッ
クス状に複数個集合して単位フレーム集合体を構成し、
単位フレーム集合体をリードフレームベースに設けて成
り、半導体チップを各単位フレームの半導体チップ搭載
部表面に搭載し、単位フレーム集合体全域を樹脂封止し
て樹脂封止体を形成した後、単位フレーム集合体におい
て各単位フレームを互いに連結しているタイバーおよび
単位フレーム集合体とリードフレームベースとの境界部
に沿って、サポートバーの一部を含み樹脂封止体を切断
することによって各々の半導体装置を製造するように構
成されたリードフレームを用いて製造される半導体装置
であって、リードフレームが、少なくとも前記切断され
る部位が各単位フレーム裏面側を除去して薄肉に形成し
て成るサポートバーと、リードフレームベースの厚さよ
り薄肉に形成して成るタイバーと、リードフレームベー
スの厚さより薄肉に形成して成る境界部と、を具える。
に際して、切断箇所に相当するタイバー、サポートバー
および外周タイバーが薄肉に形成されているので切断抵
抗が低下し、タイバー、サポートバーおよび外周タイバ
ーと封止樹脂との切断抵抗の違いが減少し、切断箇所に
おけるリードフレームからの封止樹脂の剥離が防止され
る。
が可能となり、高品質の半導体装置が得られる。
請求項6に記載の半導体装置において、リードフレーム
のリードにおける単位フレーム表面側に非貫通孔が形成
される。
による効果に加えて、樹脂封止工程において封止樹脂が
リードの非貫通穴内にも充填され、リードと封止樹脂と
の結合性が強化され、封止樹脂の単位フレームからの剥
離防止効果が更に向上する。
が可能となり、高品質の半導体装置が得られる。
請求項7に記載の半導体装置において、リードフレーム
のサポートバーは、分岐してタイバーに結合され、製造
される半導体装置の角部以外の場所から露呈するように
形成される。
による効果に加えて、サポートバーが矩形の平面形状を
なす樹脂パッケージの角部以外から露呈するので、切断
工程におけるサポートバーのバリの発生が防止され、バ
リ取りの作業が不要である。
が可能となり、高精度でしかも高品質の半導体装置が得
られる。
請求項8に記載の半導体装置において、リードフレーム
のサポートバーは、封止樹脂が充填される貫通孔が設け
られる。
による効果に加えて、封止樹脂がサポートバーに設けら
れる貫通孔にも充填されるので、サポートバーと封止樹
脂との結合性が強化され、封止樹脂の単位フレームから
の剥離防止効果が更に向上する。
が可能となり、高精度でしかも高品質の半導体装置が得
られる。
は、請求項9に記載の半導体装置において、前記貫通孔
は、サポートバーの分岐域からサポートバーと半導体チ
ップ搭載部との境界域に至る領域に形成される長孔であ
ることを特徴としている。
による効果に加えて、前記貫通孔はサポートバーの分岐
域からサポートバーと半導体チップ搭載部との境界域に
至る領域に形成される長孔であるので、サポートバーの
強度が低減され、個々の半導体装置へ切断する際の切断
抵抗が低下し、封止樹脂の単位フレームからの剥離防止
効果が更に向上する。
樹脂が貫通孔により多く充填されるので、サポートバー
と封止樹脂との結合性がより強化される。
が可能となり、高精度でしかも高品質の半導体装置が得
られる。
ムの実施例を示す平面図、およびA−A線断面図。
実施例を示す概念的断面図、および斜視図。
の平面図、b−b線断面図、c−c線断面図、d−d線
断面図。
置の実施例の製造方法を示す概念的な横断面図。
ームの第二実施例を示す表面から見た一部拡大平面図、
b−b線断面図、c−c線断面図。
斜視図。
ムの第四実施例を示す平面図、およびA'−A'線断面
図。
的断面図、および斜視図。
ームの第三実施例を示す表面から見た一部拡大平面図、
f−f線断面図。
を示す平面図。
Claims (10)
- 【請求項1】 矩形の平面形状を呈し、かつ半導体チッ
プ搭載部を有するとともに各辺に前記半導体チップ搭載
部を囲む態様でリードが形成され、前記半導体チップ搭
載部から角部に向けて延在するサポートバーを具える単
位フレームを、マトリックス状に複数個集合して単位フ
レーム集合体を構成し、前記単位フレーム集合体をリー
ドフレームベースに設けて成り、半導体チップを前記各
単位フレームの半導体チップ搭載部表面に搭載し、前記
単位フレーム集合体全域を樹脂封止して樹脂封止体を形
成した後、前記単位フレーム集合体において各単位フレ
ームを互いに連結しているタイバーおよび前記単位フレ
ーム集合体と前記リードフレームベースとの境界部に沿
って、前記サポートバーの一部を含み前記樹脂封止体を
切断することによって各々の半導体装置を製造するよう
に構成されたリードフレームであって、 少なくとも前記切断される部位が各単位フレーム裏面側
を除去して薄肉に形成して成る前記サポートバーと、 前記リードフレームベースの厚さより薄肉に形成して成
る前記タイバーと、 前記リードフレームベースの厚さより薄肉に形成して成
る前記境界部と、 を具えることを特徴とするリードフレーム。 - 【請求項2】 前記リードにおける前記単位フレーム表
面側に非貫通孔が形成されることを特徴とする請求項1
に記載のリードフレーム。 - 【請求項3】 前記サポートバーは、分岐して前記タイ
バーに結合され、製造される前記半導体装置の角部以外
の場所から露呈するように形成されることを特徴とする
請求項2に記載のリードフレーム。 - 【請求項4】 前記サポートバーは、封止樹脂が充填さ
れる貫通孔が設けられることを特徴とする請求項3に記
載のリードフレーム。 - 【請求項5】 前記貫通孔は、前記サポートバーの分岐
域から前記サポートバーと前記半導体チップ搭載部との
境界域に至る領域に形成される長孔であることを特徴と
する請求項4に記載のリードフレーム。 - 【請求項6】 矩形の平面形状を呈し、かつ半導体チッ
プ搭載部を有するとともに各辺に前記半導体チップ搭載
部を囲む態様でリードが形成され、前記半導体チップ搭
載部から角部に向けて延在するサポートバーを具える単
位フレームを、マトリックス状に複数個集合して単位フ
レーム集合体を構成し、前記単位フレーム集合体をリー
ドフレームベースに設けて成り、半導体チップを前記各
単位フレームの半導体チップ搭載部表面に搭載し、前記
単位フレーム集合体全域を樹脂封止して樹脂封止体を形
成した後、前記単位フレーム集合体において各単位フレ
ームを互いに連結しているタイバーおよび前記単位フレ
ーム集合体と前記リードフレームベースとの境界部に沿
って、前記サポートバーの一部を含み前記樹脂封止体を
切断することによって各々の半導体装置を製造するよう
に構成されたリードフレームを用いて製造される半導体
装置であって、前記リードフレームが、少なくとも前記
切断される部位が各単位フレーム裏面側を除去して薄肉
に形成して成る前記サポートバーと、 前記リードフレームベースの厚さより薄肉に形成して成
る前記タイバーと、 前記リードフレームベースの厚さより薄肉に形成して成
る前記境界部と、 を具えることを特徴とする半導体装置。 - 【請求項7】 前記リードフレームの前記リードにおけ
る前記単位フレーム表面側に非貫通孔が形成されること
を特徴とする請求項6に記載の半導体装置。 - 【請求項8】 前記リードフレームの前記サポートバー
は、分岐して前記タイバーに結合され、製造される前記
半導体装置の角部以外の場所から露呈するように形成さ
れることを特徴とする請求項7に記載の半導体装置。 - 【請求項9】 前記リードフレームの前記サポートバー
は、封止樹脂が充填される貫通孔が設けられることを特
徴とする請求項8に記載の半導体装置。 - 【請求項10】 前記リードフレームの前記サポートバ
ーにおける貫通孔は、前記サポートバーの分岐域から前
記サポートバーと前記半導体チップ搭載部との境界域に
至る領域に形成される長孔であることを特徴とする請求
項9に記載の半導体装置。
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US10/024,827 US6700186B2 (en) | 2000-12-21 | 2001-12-17 | Lead frame for a semiconductor device, a semiconductor device made from the lead frame, and a method of making a semiconductor device |
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Country Status (1)
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---|---|
JP (1) | JP3547704B2 (ja) |
Cited By (30)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2004214233A (ja) * | 2002-12-26 | 2004-07-29 | Renesas Technology Corp | 半導体装置およびその製造方法 |
JP2004228167A (ja) * | 2003-01-20 | 2004-08-12 | Sanyo Electric Co Ltd | リードフレーム及びそれを用いた半導体装置 |
US6835600B2 (en) | 2001-02-15 | 2004-12-28 | Matsushita Electric Industrial Co., Ltd | Lead frame and method for fabricating resin-encapsulated semiconductor device using the same |
JP2006261525A (ja) * | 2005-03-18 | 2006-09-28 | Disco Abrasive Syst Ltd | パッケージ基板 |
JP2008182175A (ja) * | 2006-12-27 | 2008-08-07 | Denso Corp | モールドパッケージの製造方法 |
JP2008300504A (ja) * | 2007-05-30 | 2008-12-11 | Nec Electronics Corp | リードフレームおよびその製造方法、半導体装置およびその製造方法 |
JP2009088412A (ja) * | 2007-10-02 | 2009-04-23 | Renesas Technology Corp | 半導体装置の製造方法 |
JP2009158978A (ja) * | 2009-04-10 | 2009-07-16 | Renesas Technology Corp | 半導体装置の製造方法 |
JP2009188149A (ja) * | 2008-02-06 | 2009-08-20 | Sanyo Electric Co Ltd | 回路装置およびその製造方法 |
JP2009206529A (ja) * | 2004-12-16 | 2009-09-10 | Seoul Semiconductor Co Ltd | ヒートシンク支持リングを有するリードフレーム、それを使用した発光ダイオードパッケージ製造方法及びそれを用いて製造した発光ダイオードパッケージ |
JP2009302591A (ja) * | 2009-09-30 | 2009-12-24 | Renesas Technology Corp | 半導体装置 |
JP2010040595A (ja) * | 2008-07-31 | 2010-02-18 | Mitsui High Tec Inc | リードフレーム及びその製造方法並びに半導体装置及びその製造方法 |
WO2010053133A1 (ja) * | 2008-11-07 | 2010-05-14 | 凸版印刷株式会社 | リードフレーム及びその製造方法及びそれを用いた半導体発光装置 |
JP2010135718A (ja) * | 2008-11-07 | 2010-06-17 | Toppan Printing Co Ltd | Led発光素子用リードフレーム及びその製造方法及びそれを用いたled発光素子 |
WO2010098500A1 (ja) * | 2009-02-27 | 2010-09-02 | 三洋電機株式会社 | 半導体装置及びその製造方法 |
JP2010199491A (ja) * | 2009-02-27 | 2010-09-09 | Sanyo Electric Co Ltd | 半導体装置及びその製造方法 |
JP2010238946A (ja) * | 2009-03-31 | 2010-10-21 | Sanyo Electric Co Ltd | 半導体装置及びその製造方法 |
US7833833B2 (en) | 2003-11-27 | 2010-11-16 | Renesas Electronics Corporation | Method of manufacturing a semiconductor device |
JP2010272565A (ja) * | 2009-05-19 | 2010-12-02 | Toppan Printing Co Ltd | リードフレーム及びその製造方法及びそれを用いた半導体発光装置 |
JP2010283246A (ja) * | 2009-06-08 | 2010-12-16 | Mitsui High Tec Inc | リードフレーム及び半導体装置 |
JP2011077367A (ja) * | 2009-09-30 | 2011-04-14 | Toppan Printing Co Ltd | Led発光素子用リードフレーム |
CN101355073B (zh) * | 2007-07-23 | 2012-12-05 | 国家半导体公司 | 引线框面板 |
JP2013051324A (ja) * | 2011-08-31 | 2013-03-14 | Shindengen Electric Mfg Co Ltd | リードフレーム、半導体装置及びその製造方法 |
US8829685B2 (en) | 2009-03-31 | 2014-09-09 | Semiconductor Components Industries, Llc | Circuit device having funnel shaped lead and method for manufacturing the same |
US8841692B2 (en) | 2008-11-07 | 2014-09-23 | Toppan Printing Co., Ltd. | Lead frame, its manufacturing method, and semiconductor light emitting device using the same |
US9214412B2 (en) | 2013-07-01 | 2015-12-15 | Renesas Electronics Corporation | Semiconductor device |
JP2016027614A (ja) * | 2014-07-07 | 2016-02-18 | ローム株式会社 | 電子装置およびその実装構造 |
JP2018113433A (ja) * | 2017-01-12 | 2018-07-19 | 株式会社三井ハイテック | リードフレーム |
JP2018157222A (ja) * | 2013-04-16 | 2018-10-04 | ローム株式会社 | 半導体装置 |
US10312171B2 (en) | 2013-04-16 | 2019-06-04 | Rohm Co., Ltd. | Semiconductor device |
-
2000
- 2000-12-21 JP JP2000388711A patent/JP3547704B2/ja not_active Expired - Fee Related
Cited By (45)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6835600B2 (en) | 2001-02-15 | 2004-12-28 | Matsushita Electric Industrial Co., Ltd | Lead frame and method for fabricating resin-encapsulated semiconductor device using the same |
JP2004214233A (ja) * | 2002-12-26 | 2004-07-29 | Renesas Technology Corp | 半導体装置およびその製造方法 |
JP2004228167A (ja) * | 2003-01-20 | 2004-08-12 | Sanyo Electric Co Ltd | リードフレーム及びそれを用いた半導体装置 |
US8592961B2 (en) | 2003-11-27 | 2013-11-26 | Renesas Electronics Corporation | Method of manufacturing a semiconductor device |
US8513785B2 (en) | 2003-11-27 | 2013-08-20 | Renesas Electronics Corporation | Method of manufacturing a semiconductor device |
US8053875B2 (en) | 2003-11-27 | 2011-11-08 | Renesas Electronics Corporation | Method of manufacturing a semiconductor device |
US7833833B2 (en) | 2003-11-27 | 2010-11-16 | Renesas Electronics Corporation | Method of manufacturing a semiconductor device |
US10998288B2 (en) | 2003-11-27 | 2021-05-04 | Renesas Electronics Corporation | Method of manufacturing a semiconductor device |
US9024419B2 (en) | 2003-11-27 | 2015-05-05 | Renesas Electronics Corporation | Method of manufacturing semiconductor device |
US9425165B2 (en) | 2003-11-27 | 2016-08-23 | Renesas Electronics Corporation | Method of manufacturing semiconductor device |
US10249595B2 (en) | 2003-11-27 | 2019-04-02 | Renesas Electronics Corporation | Method of manufacturing a semiconductor device |
US9806035B2 (en) | 2003-11-27 | 2017-10-31 | Renesas Electronics Corporation | Semiconductor device |
JP2009206529A (ja) * | 2004-12-16 | 2009-09-10 | Seoul Semiconductor Co Ltd | ヒートシンク支持リングを有するリードフレーム、それを使用した発光ダイオードパッケージ製造方法及びそれを用いて製造した発光ダイオードパッケージ |
JP2006261525A (ja) * | 2005-03-18 | 2006-09-28 | Disco Abrasive Syst Ltd | パッケージ基板 |
JP2008182175A (ja) * | 2006-12-27 | 2008-08-07 | Denso Corp | モールドパッケージの製造方法 |
KR101002056B1 (ko) | 2007-05-30 | 2010-12-17 | 히타치 케이블 프레시전 가부시키가이샤 | 리드 프레임 및 그의 제조방법, 반도체 장치 및 그의제조방법 |
TWI383483B (zh) * | 2007-05-30 | 2013-01-21 | Renesas Electronics Corp | 導線架及其製造方法、與半導體裝置及其製造方法 |
JP2008300504A (ja) * | 2007-05-30 | 2008-12-11 | Nec Electronics Corp | リードフレームおよびその製造方法、半導体装置およびその製造方法 |
CN101355073B (zh) * | 2007-07-23 | 2012-12-05 | 国家半导体公司 | 引线框面板 |
JP2009088412A (ja) * | 2007-10-02 | 2009-04-23 | Renesas Technology Corp | 半導体装置の製造方法 |
JP2009188149A (ja) * | 2008-02-06 | 2009-08-20 | Sanyo Electric Co Ltd | 回路装置およびその製造方法 |
KR101132529B1 (ko) * | 2008-02-06 | 2012-04-02 | 산요 세미컨덕터 컴퍼니 리미티드 | 회로 장치 및 그 제조 방법 |
JP2010040595A (ja) * | 2008-07-31 | 2010-02-18 | Mitsui High Tec Inc | リードフレーム及びその製造方法並びに半導体装置及びその製造方法 |
JP2010135718A (ja) * | 2008-11-07 | 2010-06-17 | Toppan Printing Co Ltd | Led発光素子用リードフレーム及びその製造方法及びそれを用いたled発光素子 |
WO2010053133A1 (ja) * | 2008-11-07 | 2010-05-14 | 凸版印刷株式会社 | リードフレーム及びその製造方法及びそれを用いた半導体発光装置 |
US8841692B2 (en) | 2008-11-07 | 2014-09-23 | Toppan Printing Co., Ltd. | Lead frame, its manufacturing method, and semiconductor light emitting device using the same |
JP2010199491A (ja) * | 2009-02-27 | 2010-09-09 | Sanyo Electric Co Ltd | 半導体装置及びその製造方法 |
WO2010098500A1 (ja) * | 2009-02-27 | 2010-09-02 | 三洋電機株式会社 | 半導体装置及びその製造方法 |
US8692370B2 (en) | 2009-02-27 | 2014-04-08 | Semiconductor Components Industries, Llc | Semiconductor device with copper wire ball-bonded to electrode pad including buffer layer |
JP2010238946A (ja) * | 2009-03-31 | 2010-10-21 | Sanyo Electric Co Ltd | 半導体装置及びその製造方法 |
US8829685B2 (en) | 2009-03-31 | 2014-09-09 | Semiconductor Components Industries, Llc | Circuit device having funnel shaped lead and method for manufacturing the same |
JP4566266B2 (ja) * | 2009-04-10 | 2010-10-20 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
JP2009158978A (ja) * | 2009-04-10 | 2009-07-16 | Renesas Technology Corp | 半導体装置の製造方法 |
JP2010272565A (ja) * | 2009-05-19 | 2010-12-02 | Toppan Printing Co Ltd | リードフレーム及びその製造方法及びそれを用いた半導体発光装置 |
JP2010283246A (ja) * | 2009-06-08 | 2010-12-16 | Mitsui High Tec Inc | リードフレーム及び半導体装置 |
JP2011077367A (ja) * | 2009-09-30 | 2011-04-14 | Toppan Printing Co Ltd | Led発光素子用リードフレーム |
JP4535513B2 (ja) * | 2009-09-30 | 2010-09-01 | ルネサスエレクトロニクス株式会社 | 半導体装置 |
JP2009302591A (ja) * | 2009-09-30 | 2009-12-24 | Renesas Technology Corp | 半導体装置 |
JP2013051324A (ja) * | 2011-08-31 | 2013-03-14 | Shindengen Electric Mfg Co Ltd | リードフレーム、半導体装置及びその製造方法 |
JP2018157222A (ja) * | 2013-04-16 | 2018-10-04 | ローム株式会社 | 半導体装置 |
US10312171B2 (en) | 2013-04-16 | 2019-06-04 | Rohm Co., Ltd. | Semiconductor device |
US9362238B2 (en) | 2013-07-01 | 2016-06-07 | Renesas Electronics Corporation | Semiconductor device |
US9214412B2 (en) | 2013-07-01 | 2015-12-15 | Renesas Electronics Corporation | Semiconductor device |
JP2016027614A (ja) * | 2014-07-07 | 2016-02-18 | ローム株式会社 | 電子装置およびその実装構造 |
JP2018113433A (ja) * | 2017-01-12 | 2018-07-19 | 株式会社三井ハイテック | リードフレーム |
Also Published As
Publication number | Publication date |
---|---|
JP3547704B2 (ja) | 2004-07-28 |
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