JP2001322893A - シリコンエピタキシャルウェーハの製造方法 - Google Patents
シリコンエピタキシャルウェーハの製造方法Info
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- 238000000034 method Methods 0.000 title claims abstract description 41
- 229910052710 silicon Inorganic materials 0.000 title claims abstract description 27
- 239000010703 silicon Substances 0.000 title claims abstract description 27
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 title claims abstract description 26
- 238000010438 heat treatment Methods 0.000 claims abstract description 64
- 239000000758 substrate Substances 0.000 claims abstract description 55
- 238000001816 cooling Methods 0.000 claims abstract description 6
- 238000004519 manufacturing process Methods 0.000 claims description 10
- 229910052760 oxygen Inorganic materials 0.000 abstract description 47
- 239000001301 oxygen Substances 0.000 abstract description 42
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 abstract description 41
- 239000013078 crystal Substances 0.000 abstract description 16
- 230000008021 deposition Effects 0.000 abstract description 2
- 230000001747 exhibiting effect Effects 0.000 abstract description 2
- 239000002244 precipitate Substances 0.000 description 46
- 235000012431 wafers Nutrition 0.000 description 31
- 238000001556 precipitation Methods 0.000 description 23
- 230000000694 effects Effects 0.000 description 13
- 238000003325 tomography Methods 0.000 description 7
- 239000012298 atmosphere Substances 0.000 description 6
- 230000000052 comparative effect Effects 0.000 description 6
- 229910052787 antimony Inorganic materials 0.000 description 4
- 239000012299 nitrogen atmosphere Substances 0.000 description 4
- 238000004151 rapid thermal annealing Methods 0.000 description 4
- 238000005247 gettering Methods 0.000 description 3
- 229910052785 arsenic Inorganic materials 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 2
- 238000002425 crystallisation Methods 0.000 description 2
- 230000008025 crystallization Effects 0.000 description 2
- 238000002474 experimental method Methods 0.000 description 2
- 239000001257 hydrogen Substances 0.000 description 2
- 229910052739 hydrogen Inorganic materials 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 1
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 1
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 238000000137 annealing Methods 0.000 description 1
- WATWJIUSRGPENY-UHFFFAOYSA-N antimony atom Chemical compound [Sb] WATWJIUSRGPENY-UHFFFAOYSA-N 0.000 description 1
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 1
- 125000004429 atom Chemical group 0.000 description 1
- 229910052796 boron Inorganic materials 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 238000011109 contamination Methods 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 229910001385 heavy metal Inorganic materials 0.000 description 1
- 150000002431 hydrogen Chemical group 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 229910052751 metal Inorganic materials 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 230000001590 oxidative effect Effects 0.000 description 1
- 150000002926 oxygen Chemical class 0.000 description 1
- 229910052698 phosphorus Inorganic materials 0.000 description 1
- 239000011574 phosphorus Substances 0.000 description 1
- 238000002360 preparation method Methods 0.000 description 1
- 230000002035 prolonged effect Effects 0.000 description 1
- 238000011160 research Methods 0.000 description 1
- 229920006395 saturated elastomer Polymers 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 150000003376 silicon Chemical class 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 238000007711 solidification Methods 0.000 description 1
- 230000008023 solidification Effects 0.000 description 1
- 238000001947 vapour-phase growth Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/322—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/322—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections
- H01L21/3221—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections of silicon bodies, e.g. for gettering
- H01L21/3225—Thermally inducing defects using oxygen present in the silicon body for intrinsic gettering
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- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
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Abstract
となく安定したIG能力を発揮し、デバイスプロセスの
初期段階から優れたIG能力を有するエピタキシャルウ
ェーハを製造することができ、特に、N+基板の酸素析
出が進行しにくいという問題点に起因するN/N+エピ
ウェーハのIG不足を簡便に解消することができるシリ
コンエピタキシャルウェーハの製造方法を提供する。 【解決手段】 エピタキシャル成長用のシリコン基板に
対し、1200℃〜1350℃の温度で1〜120秒の
RTA(急速加熱・急速冷却熱処理)を行い、さらに9
00℃〜1050℃の温度で2〜20時間の熱処理を行
った後、前記シリコンウェーハの表面にエピタキシャル
層を形成するようにした。
Description
結晶熱履歴に影響されることなく安定したIG能力を発
揮し、デバイスプロセスの初期段階から優れたIG能力
を有するエピタキシャルウェーハを製造することができ
る方法に関する。
シリコン単結晶を用いて作製されたシリコンウェーハに
は、5〜10×1017atoms/cm3程度の格子間酸素が不
純物として含まれる。この格子間酸素は、引き上げ工程
中の固化してから室温まで冷却されるまでの熱履歴(以
下、結晶熱履歴と記す)の間に過飽和状態となるために
析出して、酸素析出核(シリコン酸化物の微小析出物)
が形成される。
が施されると、この酸素析出核が成長することにより酸
素析出が進行して、酸素析出物やそれに起因する転位等
の微小欠陥が発生する。この酸素析出物がウェーハ表面
のデバイス活性層に存在するとデバイス特性を劣化させ
るが、ウェーハ内部に存在する場合は重金属不純物を捕
獲するサイトとして有効になりIG(Internal Getteri
ng)と呼ばれる効果が得られ、デバイス特性や歩留まり
を向上させる。このような観点から、CZウェーハ中の
酸素析出の制御が重要な課題であり、古くから研究が盛
んに行われている。
欠陥化するために、CZウェーハ上に気相成長によって
シリコン単結晶層(以下、エピタキシャル層またはエピ
層と呼ぶことがある。)を堆積させたエピタキシャルウ
ェーハ(以下、エピウェーハと呼ぶことがある。)が使
用される場合がある。このエピウェーハにおいても、基
板にIG能力を付加させることが重要である。
上の高温で行われるために、エピタキシャル成長用基板
を作製したシリコン単結晶を引き上げた時の結晶熱履歴
で形成された酸素析出核が溶体化してしまい、デバイス
作製工程での酸素析出が、通常の未熱処理のCZシリコ
ンウェーハと比較して抑制される。そのために、エピウ
ェーハではIG能力が低下することが問題となってい
る。
程前に800℃程度の熱処理を施すことにより析出核を
大きく成長させて、高温のエピ工程でも消滅しないよう
にする方法がある(例えば、特開平10−223641
号公報参照)。あるいは、本出願人が先に提案した特願
2000−17479号に記載した様に、エピ工程後に
450〜750℃程度の熱処理を施すことにより析出核
を再形成させる方法などがある。
は、結晶熱履歴で形成された析出核を利用するために、
結晶熱履歴が異なるウェーハでは析出核密度が異なる。
従って、結晶引上げ条件や結晶位置の違いにより析出物
密度がばらつくために、安定なゲッタリング能力が得ら
れないという問題点がある。また、Sb(アンチモン)
やAs(砒素)を高濃度にドープしたN+基板(導電型
がn型で、抵抗率が0.1Ωcm以下のシリコンウェー
ハ)では本質的に酸素析出が進行しにくいために、結晶
熱履歴で形成される析出核の密度が低く、エピ工程前の
熱処理による効果がほとんど無い。
+基板は析出核形成が進行しにくいために、十分な密度
を得るためには熱処理時間が長くなるという問題が生じ
る。N+基板において酸素析出が進行しにくいことに対
する理由に関しては、幾つかのモデルが提案されている
が未だに明確になっていないために、ここで記述するこ
とは避ける。
ハ(N+基板上に、n型で0.1Ωcm以上のエピタキ
シャル層を形成したエピウェーハ)は、その構造面から
CCD用材料として有望視されている。しかし、上述し
たようにIG効果が期待できないことから、それに変わ
ってN/Nエピウェーハ(抵抗率0.1Ωcm以上のn
型基板上に、n型で0.1Ωcm以上のエピタキシャル
層を形成したエピウェーハ)が広く用いられている。こ
の場合でも、IG効果を付加させるためには、エピ工程
前あるいは後に酸素析出熱処理を施す必要がある。従っ
て、N/N+エピウェーハにおいて、比較的簡便にIG
効果を付加させることが重要な課題となる。
TA(Rapid Thermal Annealing)と呼ばれる急速加熱
・急速冷却熱処理がある(例えば、特表平6−5048
78号公報参照)。この熱処理を行うことができる熱処
理装置(RTA装置)は、ランプ加熱方式が採用されて
いる場合が多く、10〜100℃/秒程度の昇降温速度
で熱処理が可能である。
れる過剰な空孔が、酸素析出を進行しやすくしていると
考えられている。但し、RTAを行ったとしても、その
直後にエピ工程を施すと析出促進効果がなくなることが
わかっている。これは、エピ工程で空孔が外方拡散して
しまうことが原因と思われる。また、RTA後に450
℃以上800℃以下の熱処理を加えると析出促進効果が
さらに大きくなるが、熱処理温度が低いために析出物の
成長が十分ではなく、高温のエピ工程で残存できない。
特に、酸素析出が起こりにくいN+基板では、その影響
は大きい。
プロセス中での析出物の成長が抑制されることから、十
分なゲッタリング能力が確保できないことが懸念されて
いる。従って、デバイスプロセス前の段階で検出可能な
レベルの大きいサイズの析出物が形成されていることが
好ましい。しかし、従来の方法では、エピ工程直後に検
出可能なサイズの析出物を形成することは困難であっ
た。
基板の結晶熱履歴に影響されることなく安定したIG能
力を発揮し、デバイスプロセスの初期段階から優れたI
G能力を有するエピタキシャルウェーハを製造すること
ができ、特に、N+基板の酸素析出が進行しにくいとい
う問題点に起因するN/N+エピウェーハのIG不足を
簡便に解消することができるシリコンエピタキシャルウ
ェーハの製造方法を提供することを目的とする。
に、本発明のシリコンエピタキシャルウェーハの製造方
法は、エピタキシャル成長用のシリコン基板に対し、1
200℃〜1350℃の温度で1〜120秒のRTA
(急速加熱・急速冷却熱処理)を行い、さらに900℃
〜1050℃の温度で2〜20時間の熱処理を行った
後、前記シリコンウェーハの表面にエピタキシャル層を
形成することを特徴とする。この方法は、抵抗率が0.
1Ωcm以下のn型シリコンウェーハに対し特に効果的
であり、エピタキシャル層の形成温度が1100℃以上
の高温であっても、優れたIG能力を有するエピタキシ
ャルウェーハを製造することができる。
酸素析出物密度を有するようにするためには、RTAの
条件を1200℃以上、1秒以上にする必要があるが、
1350℃を超えるとウェーハへの金属汚染やスリップ
転位の発生等の問題が発生する可能性があるので好まし
くない。また、熱処理時間が120秒を超えるとスルー
プットの低下や熱処理炉の耐久性等の問題が発生し、現
実的ではない。
にN+基板においてエピタキシャル成長後の基板内部に
十分な酸素析出物密度(少なくとも1×107/cm3)を
確実に有するようにするためには、900℃以上で2時
間以上の熱処理が必要であるが、20時間を超える熱処
理を行っても効果が飽和するため意味がない。また、1
050℃を超える温度では基板内部に新たな酸素析出核
の形成が起こりにくくなるので好ましくない。
を添付図面中、図1に基づいて説明するが、図示例は例
示的に示されるもので、本発明の技術思想から逸脱しな
い限り種々の変形が可能なことはいうまでもない。
ウェーハの製造方法の工程順を示すフローチャートであ
る。まず、エピタキシャル成長用のシリコン基板を準備
する(ステップ100)。このシリコン基板としては、
導電型がn型で抵抗率が1.0Ωcm以下のものが好適に
用いられる。このシリコン基板に対してRTA(Rapid
Thermal Annealing、急速加熱・急速冷却熱処理)が行
われる(ステップ102)。このRTAの条件は、12
00℃〜1350℃の温度で1〜120秒の条件で行わ
れる。この条件外では、前述したように、本発明の作用
効果を充分に達成することができない。
さらに熱処理が行われる(ステップ104)。この熱処
理の条件は、900℃〜1050℃の温度で2〜20時
間の条件で行われる。この条件外では、前述したよう
に、本発明の作用効果を有効に発揮することができな
い。このような熱処理をうけたシリコン基板の表面に対
してエピタキシャル層を形成する(ステップ106)。
このエピタキシャル層の形成は、従来と同様に1000
℃以上の高温で行っても問題ない。尚、ステップ104
における熱処理雰囲気は特に限定されないが、酸化性雰
囲気で行う場合、形成される酸化膜を除去してからエピ
工程を行う必要がある。
キシャル成長用のシリコン基板が作製されたシリコン単
結晶の結晶熱履歴により形成された酸素析出核を高温の
RTA工程で消滅させ、そのRTA後に比較的高温(9
00℃〜1050℃)の熱処理を加えることにより、析
出核を形成すると同時にその核を成長させて、エピ工程
でも消滅しない析出物を形成したエピタキシャル成長用
基板を用いてエピタキシャル成長を行うというものであ
る。これにより、エピ工程直後であっても、赤外散乱ト
モグラフ法を用いた測定装置により検出可能なサイズの
析出物を有するエピタキシャルウェーハが得られる。
程前の段階で析出物が成長しているので、デバイスプロ
セスの初期段階からゲッタリング能力を有するエピタキ
シャルウェーハを製造できる。また、結晶熱履歴で形成
される析出核はRTA工程で消滅するために、それに起
因したばらつきは無く、安定したIG能力を有するエピ
タキシャルウェーハを製造できる。
や、RTA工程で注入された空孔は、その後の熱処理工
程での外方拡散により表面近傍から排除されるので、ウ
ェーハ表面近傍には酸素析出物の無欠陥領域(DZ層)
が形成され、その上に形成されるエピタキシャル層の結
晶性に対して有利に作用する。
に説明するが、これらの実施例は例示的に示されるもの
で限定的に解釈されるべきでないことはいうまでもな
い。
00>、初期酸素濃度15ppma(JEIDA(日本
電子工業振興協会)規格)のSbドープ基板を準備し
た。抵抗率は約0.02Ωcmである。この基板に対し
て、窒素雰囲気下で1200℃、30秒間のRTAを施
した。その後、900℃,1000℃,1050℃で2
〜16時間の熱処理を施した。熱処理雰囲気は2%の酸
素を含有する窒素雰囲気(2%O2/N2)とした。さら
に、熱処理後の基板表面の酸化膜を除去し、1150℃
で3μmのエピタキシャル層を成長させた後、酸素析出
物密度を赤外散乱トモグラフ法により測定した。
出物密度との関係を図2に示す。何れの温度においても
2時間の熱処理で既に析出物密度が7乗台以上の密度で
観察され、時間の増加と共に密度が増加した。この結果
から、析出しにくいSbドープ基板において、RTAと
その後の熱処理により高温のエピ工程でも消滅しない析
出物が形成でき、さらにエピ工程直後の段階で検出可能
な十分なサイズをもつ析出物が形成できることがわかっ
た。
00>、初期酸素濃度16.5ppmaのAsドープ基
板を準備した。抵抗率は約0.005Ωcmである。実
施例1と同様に、この基板に対して、窒素雰囲気下で1
200℃,30秒間のRTAを施した。その後、900
℃,1000℃,1050℃で2〜16時間の熱処理
(2%O2/N2)を施した。さらに、熱処理後の基板表
面の酸化膜を除去し、1125℃で5μmエピタキシャ
ル層を成長させた後、酸素析出物密度を赤外散乱トモグ
ラフ法により測定した。
出物密度との関係を図3に示す。何れの温度においても
2時間の熱処理で既に析出物密度が8乗台の密度で観察
され、時間の増加と共に密度が増加した。この結果か
ら、Sbドープ基板と同様にAsドープ基板において
も、RTAとその後の熱処理によりエピ工程でも消滅し
ない析出物が形成でき、さらにエピ工程直後の段階で検
出可能な十分なサイズをもつ析出物が形成できることが
わかった。
若干高いのは、酸素濃度の違いによると思われる。
影響を調べるための実験を行った。実施例1と同様のS
bドープ基板に対して、窒素雰囲気下で30秒間のRT
Aを施した。RTA温度は1150℃(比較例1)、1
200℃及び1250℃(実施例3)とした。
(2%O2/N2)を施した。さらに、その熱処理後の基
板表面の酸化膜を除去し、1150℃で3μmエピタキ
シャル層を成長させた後、酸素析出物密度を赤外散乱ト
モグラフ法により測定した。
図4に示す。1150℃では析出物密度が1×107/c
m3以下と低かったが、1200℃以上では9乗台以上の
密度で析出物が観察された。この結果から、RTA温度
は1200℃以上が好ましいことがわかった。
るための実験を行った。実施例1と同様のSbドープ基
板に対して、水素雰囲気下で1250℃,30秒間のR
TAを施した。RTA後、900℃と1050℃で2〜
14時間の熱処理(2%O2/N2)を施した。さらに、
熱処理後の基板表面の酸化膜を除去し、1150℃で3
μmのエピタキシャル層を成長させた後、酸素析出物密
度を赤外散乱トモグラフ法により測定した。
出物密度との関係を図5に示す。何れの温度においても
2時間の熱処理で既に析出物密度が8乗台以上の密度で
観察され、時間の増加と共に密度が増加した。この結果
から、RTAの雰囲気が水素の場合でも、RTAとその
後の熱処理によりエピ工程でも消滅しない析出物が形成
でき、さらにエピ工程直後の段階で検出可能な十分なサ
イズをもつ析出物が形成できることがわかった。
なSb及びAsドープ基板を準備した。これらの基板に
対して、RTA及びその後の熱処理を施さずに1150
℃で3μmエピタキシャル層を成長させた後、酸素析出
物密度を赤外散乱トモグラフ法により測定した。その結
果、何れの基板を用いた場合も、析出物密度は5×10
6/cm3以下であり、各実施例と比較して極めて低い密度
であった。
なSb及びAsドープ基板を準備した。これらの基板に
対して、窒素雰囲気下で1200℃、30秒間のRTA
を施した。その後、800℃,2時間の熱処理(2%O
2/N2)を施した。その後、基板表面の酸化膜を除去
し、1150℃で3μmエピタキシャル層を成長させた
後、酸素析出物密度を赤外散乱トモグラフ法により測定
した。その結果、何れの基板を用いた場合も、析出物密
度は1×107/cm3以下であった。
結果から、Sb及びAsドープ基板に対して本発明のR
TAおよび900℃〜1050℃の熱処理を加えること
により、エピ工程後でも十分な密度を有する酸素析出物
を形成できることがわかった。
のN+基板でも十分な効果があることから、析出しやす
いB(ボロン)ドープ低抵抗率基板や、P(リン)ドー
プあるいはBドープの通常抵抗率基板においても十分な
効果が得られることは確実である。
ピ成長用基板の結晶熱履歴に影響されることなく安定し
たIG能力を発揮し、デバイスプロセスの初期段階から
優れたIG能力を有するエピタキシャルウェーハを得る
ことができる。特に、酸素析出が進行しにくいN+基板
を用いたN/N+エピウェーハであっても、十分なIG
能力を得ることができる。
製造方法の工程順を示すフローチャートである。
理時間と酸素析出物密度との関係を示すグラフである。
理時間と酸素析出物密度との関係を示すグラフである。
温度での熱処理時間と酸素析出物密度との関係を示すグ
ラフである。
理時間と酸素析出物密度との関係を示すグラフである。
熱処理、106:エピタキシャル層の形成。
Claims (2)
- 【請求項1】 エピタキシャル成長用のシリコン基板に
対し、1200℃〜1350℃の温度で1〜120秒の
RTA(急速加熱・急速冷却熱処理)を行い、さらに9
00℃〜1050℃の温度で2〜20時間の熱処理を行
った後、前記シリコンウェーハの表面にエピタキシャル
層を形成することを特徴とするシリコンエピタキシャル
ウェーハの製造方法。 - 【請求項2】 前記エピタキシャル成長用のシリコン基
板は、導電型がn型で抵抗率が0.1Ωcm以下である
ことを特徴とする請求項1に記載されたシリコンエピタ
キシャルウェーハの製造方法。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000135837A JP4270713B2 (ja) | 2000-05-09 | 2000-05-09 | シリコンエピタキシャルウェーハの製造方法 |
US10/019,298 US6544899B2 (en) | 2000-05-09 | 2001-05-01 | Process for manufacturing silicon epitaxial wafer |
KR1020017016624A KR100774070B1 (ko) | 2000-05-09 | 2001-05-01 | 실리콘 에피텍셜 웨이퍼의 제조방법 |
EP01926083A EP1202334A1 (en) | 2000-05-09 | 2001-05-01 | Method of producing silicon epitaxial wafers |
PCT/JP2001/003758 WO2001086710A1 (fr) | 2000-05-09 | 2001-05-01 | Procede de production de plaquettes epitaxiales de silicium |
TW090110638A TW495830B (en) | 2000-05-09 | 2001-05-03 | Method of producing silicon epitaxial wafers |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000135837A JP4270713B2 (ja) | 2000-05-09 | 2000-05-09 | シリコンエピタキシャルウェーハの製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2001322893A true JP2001322893A (ja) | 2001-11-20 |
JP4270713B2 JP4270713B2 (ja) | 2009-06-03 |
Family
ID=18643867
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000135837A Expired - Fee Related JP4270713B2 (ja) | 2000-05-09 | 2000-05-09 | シリコンエピタキシャルウェーハの製造方法 |
Country Status (6)
Country | Link |
---|---|
US (1) | US6544899B2 (ja) |
EP (1) | EP1202334A1 (ja) |
JP (1) | JP4270713B2 (ja) |
KR (1) | KR100774070B1 (ja) |
TW (1) | TW495830B (ja) |
WO (1) | WO2001086710A1 (ja) |
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EP0959154B1 (en) * | 1998-05-22 | 2010-04-21 | Shin-Etsu Handotai Co., Ltd | A method for producing an epitaxial silicon single crystal wafer and the epitaxial single crystal wafer |
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2000
- 2000-05-09 JP JP2000135837A patent/JP4270713B2/ja not_active Expired - Fee Related
-
2001
- 2001-05-01 US US10/019,298 patent/US6544899B2/en not_active Expired - Lifetime
- 2001-05-01 EP EP01926083A patent/EP1202334A1/en not_active Withdrawn
- 2001-05-01 KR KR1020017016624A patent/KR100774070B1/ko active IP Right Grant
- 2001-05-01 WO PCT/JP2001/003758 patent/WO2001086710A1/ja not_active Application Discontinuation
- 2001-05-03 TW TW090110638A patent/TW495830B/zh not_active IP Right Cessation
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Also Published As
Publication number | Publication date |
---|---|
KR100774070B1 (ko) | 2007-11-06 |
WO2001086710A1 (fr) | 2001-11-15 |
KR20020021386A (ko) | 2002-03-20 |
US20030008480A1 (en) | 2003-01-09 |
JP4270713B2 (ja) | 2009-06-03 |
TW495830B (en) | 2002-07-21 |
EP1202334A1 (en) | 2002-05-02 |
US6544899B2 (en) | 2003-04-08 |
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Legal Events
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FPAY | Renewal fee payment (event date is renewal date of database) |
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R150 | Certificate of patent or registration of utility model |
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Free format text: PAYMENT UNTIL: 20120306 Year of fee payment: 3 |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130306 Year of fee payment: 4 |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130306 Year of fee payment: 4 |
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R250 | Receipt of annual fees |
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