JP2001286186A - チョッピング通電装置 - Google Patents
チョッピング通電装置Info
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- JP2001286186A JP2001286186A JP2000094623A JP2000094623A JP2001286186A JP 2001286186 A JP2001286186 A JP 2001286186A JP 2000094623 A JP2000094623 A JP 2000094623A JP 2000094623 A JP2000094623 A JP 2000094623A JP 2001286186 A JP2001286186 A JP 2001286186A
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- JP
- Japan
- Prior art keywords
- signal
- chopping
- switching means
- energization
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Abstract
(57)【要約】
【課題】 電気モータの一対のスイッチング素子につい
て、チョッピング損失の不平衡を抑制する。 【解決手段】 ハードチョッピングを行うチョッピング
通電装置において、その制御手段が、第１及び第２スイ
ッチング手段の、一方の前記通電指示信号に対応したオ
ン／オフ又はオフ／オンに対して、他方のオン／オフ又
はオフ／オンを遅延させ、さらに先にオン／オフ又はオ
フ／オンするスイッチング手段と後にオン／オフ又はオ
フ／オンするスイッチング手段を交互に切り替えるよう
にした。
て、チョッピング損失の不平衡を抑制する。 【解決手段】 ハードチョッピングを行うチョッピング
通電装置において、その制御手段が、第１及び第２スイ
ッチング手段の、一方の前記通電指示信号に対応したオ
ン／オフ又はオフ／オンに対して、他方のオン／オフ又
はオフ／オンを遅延させ、さらに先にオン／オフ又はオ
フ／オンするスイッチング手段と後にオン／オフ又はオ
フ／オンするスイッチング手段を交互に切り替えるよう
にした。
Description
【０００１】
【発明の属する技術分野】この発明は、負荷の両端のそ
れぞれと電源の間にそれぞれスイッチング素子を介挿
し、両スイッチング素子の同時オンと同時オフを繰り返
すことで、負荷にチョッピング通電する通電装置に関す
るもので、例えばスイッチドリラクタンス（ＳＲ）モー
タの複数相での各相毎の電気コイルの通電制御に用いる
ことができる。
れぞれと電源の間にそれぞれスイッチング素子を介挿
し、両スイッチング素子の同時オンと同時オフを繰り返
すことで、負荷にチョッピング通電する通電装置に関す
るもので、例えばスイッチドリラクタンス（ＳＲ）モー
タの複数相での各相毎の電気コイルの通電制御に用いる
ことができる。
【０００２】
【従来の技術】ＳＲモータに通電する装置は、ＳＲモー
タを回転させるために例えば3相のコイルへの通電（オ
ン／オフ）を切り替え、所要の出力トルクを得るために
各相毎に目標電流値を設定する。各相の電気コイルの両
端にそれぞれ接続した、各コイル当り一対のスイッチン
グ素子の一方（アッパ）側もしくは両者を断続的にオン
／オフ（チョッピング）して目標電流値を維持してい
る。ここでは、チョッピングの際のスイッチング素子の
電力損失が懸念されている。
タを回転させるために例えば3相のコイルへの通電（オ
ン／オフ）を切り替え、所要の出力トルクを得るために
各相毎に目標電流値を設定する。各相の電気コイルの両
端にそれぞれ接続した、各コイル当り一対のスイッチン
グ素子の一方（アッパ）側もしくは両者を断続的にオン
／オフ（チョッピング）して目標電流値を維持してい
る。ここでは、チョッピングの際のスイッチング素子の
電力損失が懸念されている。
【０００３】例えば特開平８−１７２７９３号公報や特
開平１０−３３７０８４号公報に開示があるように、チ
ョッピングの方法としては、各相の電気コイル毎につい
て、一対のスイッチング素子の一方のみをチョッピング
するソフトチョッピングと呼ばれるものと、両方のスイ
ッチング素子をチョッピングするハードチョッピングと
呼ばれるものなどがある。中でも、ハードチョッピング
については、スイッチング素子のスイッチング特性にバ
ラツキがあるため、同一の通電指示信号にしたがって一
対のスイッチング素子をオン／オフ制御しても、両素子
が厳密に同じにオン／オフするわけではない。例えば常
に一方の素子が他方に対して早いタイミングでオンされ
ることにより、他方の素子のみに電力損失、即ちチョッ
ピング損失が集中してしまう。
開平１０−３３７０８４号公報に開示があるように、チ
ョッピングの方法としては、各相の電気コイル毎につい
て、一対のスイッチング素子の一方のみをチョッピング
するソフトチョッピングと呼ばれるものと、両方のスイ
ッチング素子をチョッピングするハードチョッピングと
呼ばれるものなどがある。中でも、ハードチョッピング
については、スイッチング素子のスイッチング特性にバ
ラツキがあるため、同一の通電指示信号にしたがって一
対のスイッチング素子をオン／オフ制御しても、両素子
が厳密に同じにオン／オフするわけではない。例えば常
に一方の素子が他方に対して早いタイミングでオンされ
ることにより、他方の素子のみに電力損失、即ちチョッ
ピング損失が集中してしまう。
【０００４】
【発明が解決しようとする課題】そこで、本発明は、一
対のスイッチング素子について、チョッピング損失の不
平衡を抑制することを技術的課題とする。
対のスイッチング素子について、チョッピング損失の不
平衡を抑制することを技術的課題とする。
【０００５】
【課題を解決するための手段】上記技術的課題を解決す
るためになされた請求項１に記載の発明は、負荷の両端
の一方と電源の一極の間に介挿された第１スイッチング
手段と、前記負荷の他方端と電源の他極の間に介挿され
た第２スイッチング手段と、負荷へのチョッピング通電
を指示する信号を発生する手段とを備え、該通電指示信
号に基づいて第１スイッチング手段および第２スイッチ
ング手段をオン／オフ又はオフ／オンして負荷へチョッ
ピング通電するチョッピング通電装置において、該通電
装置に更に、第１及び第２スイッチング手段の一方の、
前記通電指示信号に対応したオン／オフ又はオフ／オン
に対して、他方のオン／オフ又はオフ／オンを遅延する
制御手段を備え、該制御手段が、先にオン／オフ又はオ
フ／オンするスイッチング手段と後にオン／オフ又はオ
フ／オンするスイッチング手段を交互に切り替えるよう
にした。この手段によれば、両トランジスタのオン／オ
フを繰り返してハードチョッピングを行うことができ、
チョッピング開始直後は一方のスイッチング手段の通電
開始／終了が他方のスイッチング手段の通電開始／終了
よりも遅れているが、次は他方のスイッチング手段の通
電開始／終了が一方のスイッチング手段の通電開始／終
了よりも遅れ、その次は再び一方のスイッチング手段の
通電開始／終了が他方のスイッチング手段の通電開始／
終了よりも遅れと、通電開始／終了が遅れるスイッチン
グ手段が交互に切り替えられる。
るためになされた請求項１に記載の発明は、負荷の両端
の一方と電源の一極の間に介挿された第１スイッチング
手段と、前記負荷の他方端と電源の他極の間に介挿され
た第２スイッチング手段と、負荷へのチョッピング通電
を指示する信号を発生する手段とを備え、該通電指示信
号に基づいて第１スイッチング手段および第２スイッチ
ング手段をオン／オフ又はオフ／オンして負荷へチョッ
ピング通電するチョッピング通電装置において、該通電
装置に更に、第１及び第２スイッチング手段の一方の、
前記通電指示信号に対応したオン／オフ又はオフ／オン
に対して、他方のオン／オフ又はオフ／オンを遅延する
制御手段を備え、該制御手段が、先にオン／オフ又はオ
フ／オンするスイッチング手段と後にオン／オフ又はオ
フ／オンするスイッチング手段を交互に切り替えるよう
にした。この手段によれば、両トランジスタのオン／オ
フを繰り返してハードチョッピングを行うことができ、
チョッピング開始直後は一方のスイッチング手段の通電
開始／終了が他方のスイッチング手段の通電開始／終了
よりも遅れているが、次は他方のスイッチング手段の通
電開始／終了が一方のスイッチング手段の通電開始／終
了よりも遅れ、その次は再び一方のスイッチング手段の
通電開始／終了が他方のスイッチング手段の通電開始／
終了よりも遅れと、通電開始／終了が遅れるスイッチン
グ手段が交互に切り替えられる。
【０００６】
【発明の実施の形態】以下、本発明の実施の形態につい
て図面を参照して説明する。３相ＳＲモータの１相のコ
イル１について、図１にその通電装置を示す。その他の
２つの相の通電装置は図示しないが、図１に示すものと
同一である。電気コイル１の一端はスイッチング手段と
してのアッパ側ゲート絶縁型バイポーラトランジスタ
（ＩＧＢＴ）４を介して電源の高電位ラインと２と接続
され、他端はスイッチング手段としてのロワ側ゲート絶
縁型バイポーラトランジスタ（ＩＧＢＴ）５を介して電
源の低電位ラインと３と接続される。トランジスタ４の
エミッタと低電位ライン３との間にはダイオード６が接
続され、トランジスタ５のコレクタと高電位ライン２の
間にはダイオード７が接続される。したがって、トラン
ジスタ４および５を共にＯＮにすれば電気コイル１に電
流が流れる。電流値センサ８は電気コイル１に流れる電
流値を表す信号Ｓ１を発生し、比較器１４に出力してい
る。
て図面を参照して説明する。３相ＳＲモータの１相のコ
イル１について、図１にその通電装置を示す。その他の
２つの相の通電装置は図示しないが、図１に示すものと
同一である。電気コイル１の一端はスイッチング手段と
してのアッパ側ゲート絶縁型バイポーラトランジスタ
（ＩＧＢＴ）４を介して電源の高電位ラインと２と接続
され、他端はスイッチング手段としてのロワ側ゲート絶
縁型バイポーラトランジスタ（ＩＧＢＴ）５を介して電
源の低電位ラインと３と接続される。トランジスタ４の
エミッタと低電位ライン３との間にはダイオード６が接
続され、トランジスタ５のコレクタと高電位ライン２の
間にはダイオード７が接続される。したがって、トラン
ジスタ４および５を共にＯＮにすれば電気コイル１に電
流が流れる。電流値センサ８は電気コイル１に流れる電
流値を表す信号Ｓ１を発生し、比較器１４に出力してい
る。
【０００７】電気波形生成回路９は、ＳＲモータのロー
タ回転角度を検出するロータ角度センサ１０からの角度
を表す信号Ｓ４ａに基づいて、あるロータ回転角度にお
いて電気コイル１に流すべき基準電流値を表す信号Ｓ３
を生成し加算回路１３に出力する。通常タイミング回路
１９は角度信号Ｓ４ａが、信号Ｓ４ｂで表される通電開
始角度から信号Ｓ４ｃで表される通電終了角度までの間
にわたりＨＩＧＨとなり、その他の回転角度ではＬＯＷ
となる２値信号Ｓ４を生成する。
タ回転角度を検出するロータ角度センサ１０からの角度
を表す信号Ｓ４ａに基づいて、あるロータ回転角度にお
いて電気コイル１に流すべき基準電流値を表す信号Ｓ３
を生成し加算回路１３に出力する。通常タイミング回路
１９は角度信号Ｓ４ａが、信号Ｓ４ｂで表される通電開
始角度から信号Ｓ４ｃで表される通電終了角度までの間
にわたりＨＩＧＨとなり、その他の回転角度ではＬＯＷ
となる２値信号Ｓ４を生成する。
【０００８】昇順鋸波発生回路１１は、周期および振幅
が一定の昇順鋸波信号Ｓ５および信号Ｓ５に同期した周
期の基準チョッピングタイミング信号Ｓ６を生成する。
信号Ｓ６は一周期の時間が経過するごとに瞬間的にＬＯ
Ｗ−ＨＩＧＨ−ＬＯＷと変化する２値信号であり、その
周期は人間の可聴周波数帯域よりはやや高い周波数の一
周期と同じに設定されている。反転回路１２は信号Ｓ５
を反転して降順鋸波信号Ｓ７を生成する。加算回路１３
は基準電流信号Ｓ３に信号Ｓ７を加算して補正基準電流
信号Ｓ８を生成する。比較回路１４は検出電流信号Ｓ１
を信号Ｓ８と比較し、信号Ｓ１がＳ８より小さければＨ
ＩＧＨとなり、信号Ｓ１が信号Ｓ８よりも大きければＬ
ＯＷとなる２値信号Ｓ９を生成する。信号Ｓ９はアンド
ゲート１５の２つの入力端子の一方に入力されると共
に、インバータ１６によって反転されてフリップフロッ
プ１７の入力端子ＣＬＫに入力される。アンドゲート１
５の他方の入力端子には信号Ｓ４が入力されている。ア
ンドゲート１５が出力する信号Ｓ１０は、アンドゲート
１８の２つの入力端子の一方に入力される。アンドゲー
ト１８の他方の入力端子にはフリップフロップ１７の反
転出力端子から出力される２値信号Ｓ１１が入力され
る。フリップフロップ１７の入力端子ＣＬＲには信号Ｓ
６が入力される。フリップフロップ１７の反転出力信号
Ｓ１１は信号Ｓ９の立下りに応答してＨＩＧＨからＬＯ
Ｗへと切り替わり、また信号Ｓ６の立ち上がりに応答し
てＬＯＷからＨＩＧＨへと切り替わる。この信号Ｓ１１
がＨＩＧＨであるときにはアンドゲート１８が出力する
信号Ｓ１２は信号Ｓ１０がＨＩＧＨであればＨＩＧＨと
なり、信号Ｓ１０がＬＯＷであればＬＯＷとなる。
が一定の昇順鋸波信号Ｓ５および信号Ｓ５に同期した周
期の基準チョッピングタイミング信号Ｓ６を生成する。
信号Ｓ６は一周期の時間が経過するごとに瞬間的にＬＯ
Ｗ−ＨＩＧＨ−ＬＯＷと変化する２値信号であり、その
周期は人間の可聴周波数帯域よりはやや高い周波数の一
周期と同じに設定されている。反転回路１２は信号Ｓ５
を反転して降順鋸波信号Ｓ７を生成する。加算回路１３
は基準電流信号Ｓ３に信号Ｓ７を加算して補正基準電流
信号Ｓ８を生成する。比較回路１４は検出電流信号Ｓ１
を信号Ｓ８と比較し、信号Ｓ１がＳ８より小さければＨ
ＩＧＨとなり、信号Ｓ１が信号Ｓ８よりも大きければＬ
ＯＷとなる２値信号Ｓ９を生成する。信号Ｓ９はアンド
ゲート１５の２つの入力端子の一方に入力されると共
に、インバータ１６によって反転されてフリップフロッ
プ１７の入力端子ＣＬＫに入力される。アンドゲート１
５の他方の入力端子には信号Ｓ４が入力されている。ア
ンドゲート１５が出力する信号Ｓ１０は、アンドゲート
１８の２つの入力端子の一方に入力される。アンドゲー
ト１８の他方の入力端子にはフリップフロップ１７の反
転出力端子から出力される２値信号Ｓ１１が入力され
る。フリップフロップ１７の入力端子ＣＬＲには信号Ｓ
６が入力される。フリップフロップ１７の反転出力信号
Ｓ１１は信号Ｓ９の立下りに応答してＨＩＧＨからＬＯ
Ｗへと切り替わり、また信号Ｓ６の立ち上がりに応答し
てＬＯＷからＨＩＧＨへと切り替わる。この信号Ｓ１１
がＨＩＧＨであるときにはアンドゲート１８が出力する
信号Ｓ１２は信号Ｓ１０がＨＩＧＨであればＨＩＧＨと
なり、信号Ｓ１０がＬＯＷであればＬＯＷとなる。
【０００９】アンドゲート１８が出力する信号Ｓ１２が
チョッピング通電信号（通電指示信号）であり、そのＨ
ＩＧＨがオン（通電）を、ＬＯＷがオフ（非通電）を指
示する。信号Ｓ１２は遅延制御器２０に入力される。遅
延制御器２０は遅延回路２１および切替回路２２を備え
ている。図２に遅延回路２１の構成を示す。ここで、遅
延回路２１は４つのフリップフロップ２１ａ乃至２１ｄ
をシリアルに接続したシリアルシフトレジスタである。
クロックパルスに同期して信号Ｓ１２（ＨＩＧＨまたは
ＬＯＷ）が第１のフリップフロップ２１ａに入力され、
次々にクロックパルスに同期して、つまりその信号がＬ
ＯＷからＨＩＧＨになる毎にフリップフロップ２１ｂ乃
至２１ｄに転送され、信号Ｓ１２に所定の遅延（略３Ｔ
ｃ）を与えたチョッピング通電遅延信号Ｓ１２ｄが遅延
回路２１から切替回路２２に出力される。なお、Ｔｃは
クロックパルスの周期である。図３に示す切替回路２２
はフリップフロップ５０、インバータ５１、４つのアン
ドゲート５２乃至５５およびオアゲート５６，５７を備
えている。フリップフロップ５０のＣＬＫ端子には信号
Ｓ１２ｄが入力され、ＪおよびＫ端子には同一の所定の
信号が入力され、Ｑ端子から２値の出力信号Ｓ２０が出
力される。アンドゲート５２の２つの入力端子の一方に
は信号Ｓ１２ｄが入力され、他方の入力端子には信号Ｓ
２０が入力される。アンドゲート５３の２つの入力端子
の一方には信号Ｓ２０がインバータ５１によって反転さ
れた信号が入力され、他方の入力端子には信号Ｓ１２が
入力される。アンドゲート５４の２つの入力端子の一方
には信号Ｓ１２ｄが入力され、他方の入力端子には信号
Ｓ２０がインバータ５１によって反転された信号が入力
される。アンドゲート５５の２つの入力端子の一方には
信号Ｓ１２が入力され、他方の入力端子には信号Ｓ２０
が入力される。アンドゲート５２，５３の出力信号は共
にオアゲート５６に入力され、オアゲート５６の出力信
号Ｓ１２Ａはアッパ側ゲート絶縁型バイポーラトランジ
スタ４を駆動する信号となる。アンドゲート５４，５５
の出力信号は共にオアゲート５７に入力され、オアゲー
ト５７の出力信号Ｓ１２Ｂはロワ側ゲート絶縁型バイポ
ーラトランジスタ５を駆動する信号となる。
チョッピング通電信号（通電指示信号）であり、そのＨ
ＩＧＨがオン（通電）を、ＬＯＷがオフ（非通電）を指
示する。信号Ｓ１２は遅延制御器２０に入力される。遅
延制御器２０は遅延回路２１および切替回路２２を備え
ている。図２に遅延回路２１の構成を示す。ここで、遅
延回路２１は４つのフリップフロップ２１ａ乃至２１ｄ
をシリアルに接続したシリアルシフトレジスタである。
クロックパルスに同期して信号Ｓ１２（ＨＩＧＨまたは
ＬＯＷ）が第１のフリップフロップ２１ａに入力され、
次々にクロックパルスに同期して、つまりその信号がＬ
ＯＷからＨＩＧＨになる毎にフリップフロップ２１ｂ乃
至２１ｄに転送され、信号Ｓ１２に所定の遅延（略３Ｔ
ｃ）を与えたチョッピング通電遅延信号Ｓ１２ｄが遅延
回路２１から切替回路２２に出力される。なお、Ｔｃは
クロックパルスの周期である。図３に示す切替回路２２
はフリップフロップ５０、インバータ５１、４つのアン
ドゲート５２乃至５５およびオアゲート５６，５７を備
えている。フリップフロップ５０のＣＬＫ端子には信号
Ｓ１２ｄが入力され、ＪおよびＫ端子には同一の所定の
信号が入力され、Ｑ端子から２値の出力信号Ｓ２０が出
力される。アンドゲート５２の２つの入力端子の一方に
は信号Ｓ１２ｄが入力され、他方の入力端子には信号Ｓ
２０が入力される。アンドゲート５３の２つの入力端子
の一方には信号Ｓ２０がインバータ５１によって反転さ
れた信号が入力され、他方の入力端子には信号Ｓ１２が
入力される。アンドゲート５４の２つの入力端子の一方
には信号Ｓ１２ｄが入力され、他方の入力端子には信号
Ｓ２０がインバータ５１によって反転された信号が入力
される。アンドゲート５５の２つの入力端子の一方には
信号Ｓ１２が入力され、他方の入力端子には信号Ｓ２０
が入力される。アンドゲート５２，５３の出力信号は共
にオアゲート５６に入力され、オアゲート５６の出力信
号Ｓ１２Ａはアッパ側ゲート絶縁型バイポーラトランジ
スタ４を駆動する信号となる。アンドゲート５４，５５
の出力信号は共にオアゲート５７に入力され、オアゲー
ト５７の出力信号Ｓ１２Ｂはロワ側ゲート絶縁型バイポ
ーラトランジスタ５を駆動する信号となる。
【００１０】以上の構成を供えた通電装置により、図４
に示すチョッピング通電がコイル１に対して行われる。
この図から明らかなように、両トランジスタ４，５のオ
ン／オフを繰り返してハードチョッピングが行われてお
り、最初はロワ側トランジスタ５の通電開始／終了がア
ッパ側トランジスタ４の通電開始／終了よりも遅れてい
るが、次はアッパ側トランジスタ４の通電開始／終了が
ロワ側トランジスタ５の通電開始／終了よりも遅れ、そ
の次は再びロワ側トランジスタ５の通電開始／終了がア
ッパ側トランジスタ４の通電開始／終了よりも遅れと、
チョッピングクロックの周期毎に通電開始／終了が遅れ
るトランジスタが交互に切り替えられる。
に示すチョッピング通電がコイル１に対して行われる。
この図から明らかなように、両トランジスタ４，５のオ
ン／オフを繰り返してハードチョッピングが行われてお
り、最初はロワ側トランジスタ５の通電開始／終了がア
ッパ側トランジスタ４の通電開始／終了よりも遅れてい
るが、次はアッパ側トランジスタ４の通電開始／終了が
ロワ側トランジスタ５の通電開始／終了よりも遅れ、そ
の次は再びロワ側トランジスタ５の通電開始／終了がア
ッパ側トランジスタ４の通電開始／終了よりも遅れと、
チョッピングクロックの周期毎に通電開始／終了が遅れ
るトランジスタが交互に切り替えられる。
【００１１】
【発明の効果】請求項１の発明によれば、一対のスイッ
チング素子について、先にオン／オフ又はオフ／オンす
るスイッチング手段（トランジスタ）と後にオン／オフ
又はオフ／オンするスイッチング手段を交互に切り替え
ているので、チョッピング損失が均等に生じ、一方の素
子への損失集中が防げ、素子の長寿命化を図ることがで
きる。。
チング素子について、先にオン／オフ又はオフ／オンす
るスイッチング手段（トランジスタ）と後にオン／オフ
又はオフ／オンするスイッチング手段を交互に切り替え
ているので、チョッピング損失が均等に生じ、一方の素
子への損失集中が防げ、素子の長寿命化を図ることがで
きる。。
【図１】本発明の実施の形態に従ったチョッピング通電
装置の構成図である。
装置の構成図である。
【図２】図１の遅延回路２１の構成図である。
【図３】図１の切替回路２２の構成図である。
【図４】図１のチョッピング通電装置に従う、スイッチ
ング手段への通電状態を示すタイムチャートである。
ング手段への通電状態を示すタイムチャートである。
【符号の説明】 １・・・コイル、 ４，５・・・スイッチング手段 ２０・・・遅延制御器
───────────────────────────────────────────────────── フロントページの続き Ｆターム(参考） 5H420 BB12 CC02 DD02 DD06 EA11 EA39 EA47 EB04 EB25 EB37 FF04 FF13 5H550 BB08 DD09 GG01 GG05 HA09 LL22 LL35 5H571 BB07 CC01 GG01 GG04 HA10 HB01 HD02 JJ02 LL22 LL32 5H730 BB11 DD03 FD31 FF02
Claims (1)
- 【請求項１】 負荷の両端の一方と電源の一極の間に介
挿された第１スイッチング手段と、 前記負荷の他方端と電源の他極の間に介挿された第２ス
イッチング手段と、 負荷へのチョッピング通電を指示する信号を発生する手
段とを備え、 該通電指示信号に基づいて第１スイッチング手段および
第２スイッチング手段をオン／オフ又はオフ／オンして
負荷へチョッピング通電するチョッピング通電装置にお
いて、 該通電装置は更に、第１及び第２スイッチング手段の一
方の、前記通電指示信号に対応したオン／オフ又はオフ
／オンに対して、他方のオン／オフ又はオフ／オンを遅
延する制御手段を備え、 該制御手段は、先にオン／オフ又はオフ／オンするスイ
ッチング手段と後にオン／オフ又はオフ／オンするスイ
ッチング手段を交互に切り替えることを特徴とするチョ
ッピング通電装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000094623A JP2001286186A (ja) | 2000-03-30 | 2000-03-30 | チョッピング通電装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000094623A JP2001286186A (ja) | 2000-03-30 | 2000-03-30 | チョッピング通電装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2001286186A true JP2001286186A (ja) | 2001-10-12 |
Family
ID=18609649
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000094623A Pending JP2001286186A (ja) | 2000-03-30 | 2000-03-30 | チョッピング通電装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2001286186A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100793213B1 (ko) * | 2000-11-24 | 2008-01-10 | 스위치드 릴럭턴스 드라이브즈 리미티드 | 스위치드 릴럭턴스 드라이브 시스템에서의 전류 초핑 |
-
2000
- 2000-03-30 JP JP2000094623A patent/JP2001286186A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100793213B1 (ko) * | 2000-11-24 | 2008-01-10 | 스위치드 릴럭턴스 드라이브즈 리미티드 | 스위치드 릴럭턴스 드라이브 시스템에서의 전류 초핑 |
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